JPS59117374A - 太め処理装置 - Google Patents
太め処理装置Info
- Publication number
- JPS59117374A JPS59117374A JP23327382A JP23327382A JPS59117374A JP S59117374 A JPS59117374 A JP S59117374A JP 23327382 A JP23327382 A JP 23327382A JP 23327382 A JP23327382 A JP 23327382A JP S59117374 A JPS59117374 A JP S59117374A
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- signal
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は、画像に太め処理を施す太め処理装置に関する
。
。
従来の太め処理装置は、３×３空間フィルタを用いたエ
ツジ検出と補正処理の組み合せＫよって、太め処理を行
う構成であった。即ち、３×３マトリクスレジスタに３
×３画素のデータを抽出し、そのパターンからエツジ部
（白黒境界部）を検出し、エツジ部の白画素を黒画素に
変換するというものであり、処理のアルゴリズムが複雑
であるため装置が高価になる欠点があった。
ツジ検出と補正処理の組み合せＫよって、太め処理を行
う構成であった。即ち、３×３マトリクスレジスタに３
×３画素のデータを抽出し、そのパターンからエツジ部
（白黒境界部）を検出し、エツジ部の白画素を黒画素に
変換するというものであり、処理のアルゴリズムが複雑
であるため装置が高価になる欠点があった。
本発明の目的は、極めて構成が単純で安価に実現できる
太め処理装置を提供することにある。
太め処理装置を提供することにある。
本発明による太め処理の原理は、例えば２×２画素のデ
ータを抽出し、黒画素の右、下、右下または左、上、左
上に位置する白画素を黒画素に変換するというものであ
る。これについて、第１図により説明する。
ータを抽出し、黒画素の右、下、右下または左、上、左
上に位置する白画素を黒画素に変換するというものであ
る。これについて、第１図により説明する。
第１図（ａ）に示す画像上の２×２画素のデータを抽出
し、その２×２画素中の左上の画素が黒画素のとき、残
りの画素をすべて黒画素に変換する。
し、その２×２画素中の左上の画素が黒画素のとき、残
りの画素をすべて黒画素に変換する。
このような処理後の画像は第１図（ｂ）に示す如くにな
り、画像中の線は１画素幅だけ太められる（×印の画素
が肉付けされた画素）。逆に、２×２画素中の右下の画
素が黒画素のときに、残りの画素を黒画素に変換する処
理を行えば、第１図（Ｃ）に示す１画素幅だけ太められ
た画像が得られる。
り、画像中の線は１画素幅だけ太められる（×印の画素
が肉付けされた画素）。逆に、２×２画素中の右下の画
素が黒画素のときに、残りの画素を黒画素に変換する処
理を行えば、第１図（Ｃ）に示す１画素幅だけ太められ
た画像が得られる。
第２図は本発明の一実施例を示す。この実施例では、黒
画素の左、上、左上の画素を黒画素に変換する。
画素の左、上、左上の画素を黒画素に変換する。
図示しないスキャナ等から画素単位でシリアル転送され
て来る２値の画信号ａ（黒は°′１″、白は０′″）は
、フリップフロップ（ＦＦ・）１とシフトレジスタ２に
入力される。ＦＦＩの出力イｄ号すは次のＦＦ８に入力
され、シフトレジスタ２の出力イｇ号ｄはＦＦ４に入力
され、このＦＦ４の出力信号ｅは次０ＦＦ５０入力とな
る。ＦＦＩ、３，４，５の出力信号す、ｃ、ｅ、ｆはオ
ア回路６で閤埋相される。ＦＦＩ、８，４．５とシフト
レジスタ２は画信号ａの転送と同期してクロッキングさ
れるものであり、シフトレジスタ２の出力信号ｄは画信
号ａを１ライン分遅延させたものである。したがって、
ＦＦＩ、８，４，５の出力信号す、ｃ、ｅ。
て来る２値の画信号ａ（黒は°′１″、白は０′″）は
、フリップフロップ（ＦＦ・）１とシフトレジスタ２に
入力される。ＦＦＩの出力イｄ号すは次のＦＦ８に入力
され、シフトレジスタ２の出力イｇ号ｄはＦＦ４に入力
され、このＦＦ４の出力信号ｅは次０ＦＦ５０入力とな
る。ＦＦＩ、３，４，５の出力信号す、ｃ、ｅ、ｆはオ
ア回路６で閤埋相される。ＦＦＩ、８，４．５とシフト
レジスタ２は画信号ａの転送と同期してクロッキングさ
れるものであり、シフトレジスタ２の出力信号ｄは画信
号ａを１ライン分遅延させたものである。したがって、
ＦＦＩ、８，４，５の出力信号す、ｃ、ｅ。
ｆは人力画像から抽出された２Ｘ２画素の各画素のデー
タであり、１８号ｇはそれらの論理和データである。
タであり、１８号ｇはそれらの論理和データである。
ここで、黒画素の左、上、左上の画素を黒画素に変換す
るということは、変換される画素から見れば、その右、
下、右下のいずれかに黒画素があれば黒画素へ変換する
ということであるから、２×２画素の論理和をとるのと
等価である。故に、信号ｇは太め処理画像の画素データ
を示している。
るということは、変換される画素から見れば、その右、
下、右下のいずれかに黒画素があれば黒画素へ変換する
ということであるから、２×２画素の論理和をとるのと
等価である。故に、信号ｇは太め処理画像の画素データ
を示している。
第８図は本発明の他の一実施例であり、これは黒画素の
右、下、右下の画素を黒に変換する構成である。
右、下、右下の画素を黒に変換する構成である。
スキャナ等からの２値の画信号ａはオア回路１゜トシフ
トレシスタ１１に入力される。このシフトレジスタ１１
の出力信号ｆはフリップフロップ（ＦＦ）１３とオア回
路１３に入力される。Ｆ Ｆ １２の出力信号ｄはオア
回路１０，１３．１４に入力さＣる。オア回路１０の出
力信号すはＦ’ Ｆ １５に入力され、その出力信号Ｃ
はオア回路１４に入力される。オア回路１４の出力信号
ｅはシフトレジスタ１６に入力され、その出力信号ｇは
オア回路１３に入力される。このオア回路１３の出力信
号りはＦ Ｆ １７に入力される。Ｆ Ｆ １２．１５
．１７、およびシフトレジスタ１１，１６は画信号ａの
転送と同期してクロッキングさし、シフトレジスタ１１
．１６の出力信号ｆ、ｇはそれぞれの入力信号ａ、ｅを
１ライン分遅延させたものである。
トレシスタ１１に入力される。このシフトレジスタ１１
の出力信号ｆはフリップフロップ（ＦＦ）１３とオア回
路１３に入力される。Ｆ Ｆ １２の出力信号ｄはオア
回路１０，１３．１４に入力さＣる。オア回路１０の出
力信号すはＦ’ Ｆ １５に入力され、その出力信号Ｃ
はオア回路１４に入力される。オア回路１４の出力信号
ｅはシフトレジスタ１６に入力され、その出力信号ｇは
オア回路１３に入力される。このオア回路１３の出力信
号りはＦ Ｆ １７に入力される。Ｆ Ｆ １２．１５
．１７、およびシフトレジスタ１１，１６は画信号ａの
転送と同期してクロッキングさし、シフトレジスタ１１
．１６の出力信号ｆ、ｇはそれぞれの入力信号ａ、ｅを
１ライン分遅延させたものである。
信号ａ、ｃ、ｄ、ｆは人力画像から抽出した２×２画素
のデータを示す（ただし、信号Ｃは対応画素とその右、
上の各画素との論理和データ）ことは明らかである。信
号ｄを注目する画素のデータとすると、その注目画素の
上の画素の注目時における信号ｅ（８画素の論理和デー
タ）が信号ｇとしてシフトレジスタ１６から出力されて
おり、現在の注目画素（ｄ）および右の画素（ｆ）のデ
ータとオア回路１３で論理和される。したがって、この
論理和の結果である信号りを入力するＦＦ１７の出力信
号ｉは、黒画素の右、下、右下の白画素を黒画素に変換
する太め処理後の画像の画素データである。
のデータを示す（ただし、信号Ｃは対応画素とその右、
上の各画素との論理和データ）ことは明らかである。信
号ｄを注目する画素のデータとすると、その注目画素の
上の画素の注目時における信号ｅ（８画素の論理和デー
タ）が信号ｇとしてシフトレジスタ１６から出力されて
おり、現在の注目画素（ｄ）および右の画素（ｆ）のデ
ータとオア回路１３で論理和される。したがって、この
論理和の結果である信号りを入力するＦＦ１７の出力信
号ｉは、黒画素の右、下、右下の白画素を黒画素に変換
する太め処理後の画像の画素データである。
第４図は、黒画素の左、上、左上の画累乞黒画素に変換
する構成のもう１つの実施例を示す。
する構成のもう１つの実施例を示す。
画信号ａはフリップフロップ（ＦＦ）２０とオア回路２
Ｌ ２２．２３、およびシフトレジスタあに入力される
。オア回路器にはＦＦ２０の出力信号すも入力され、そ
の出力信号Ｃはシフトレジスタδに入力される。オア回
路２１にはシフトレジスタ囚の出力信号ｅも入力され、
その出力信号ｆはＦＦ２６に入力される。このＦ Ｆ
２６の出力信号ｇ１シフトレジスタ５の出力信号ｄ、お
よび画信号ａと万ア回路四で論理和される。シフトレジ
スタム、２５とＦＦ ２０ 、２６は画信号ａの転送と
同期してクロッキングされ、信号ｅは画信号ａを１ライ
ン分遅延した信号、信号ｄは信号Ｃを１ライン分遅延し
た信号である。
Ｌ ２２．２３、およびシフトレジスタあに入力される
。オア回路器にはＦＦ２０の出力信号すも入力され、そ
の出力信号Ｃはシフトレジスタδに入力される。オア回
路２１にはシフトレジスタ囚の出力信号ｅも入力され、
その出力信号ｆはＦＦ２６に入力される。このＦ Ｆ
２６の出力信号ｇ１シフトレジスタ５の出力信号ｄ、お
よび画信号ａと万ア回路四で論理和される。シフトレジ
スタム、２５とＦＦ ２０ 、２６は画信号ａの転送と
同期してクロッキングされ、信号ｅは画信号ａを１ライ
ン分遅延した信号、信号ｄは信号Ｃを１ライン分遅延し
た信号である。
画信号ａを汗目する画素のデータとすると、この注目画
素の上の画素のデータが信号ｅ１左の画素のデータが信
号ｂ、左上の画素とその下の画素の論理相データが信号
ｇである。また信号ｄは、注目画素の上の画素が入力さ
れた時の信号Ｃ（その画素と左の画素の論理相データ）
である。したがって、黒１吻索の左、上、左上の画素を
黒画ホに変換する処理を施した画像の画素データが、オ
ア回路２２の出力信号りとして得られる。
素の上の画素のデータが信号ｅ１左の画素のデータが信
号ｂ、左上の画素とその下の画素の論理相データが信号
ｇである。また信号ｄは、注目画素の上の画素が入力さ
れた時の信号Ｃ（その画素と左の画素の論理相データ）
である。したがって、黒１吻索の左、上、左上の画素を
黒画ホに変換する処理を施した画像の画素データが、オ
ア回路２２の出力信号りとして得られる。
以上の説明から明らかなように、本発明によれば、構成
が簡略で安価な太め処理装置を実現でき、その効果は大
きい。
が簡略で安価な太め処理装置を実現でき、その効果は大
きい。
第１図は本発明の原理説明図、第２図ないし第４図はそ
れぞれ本発明の別異の実施例を示す回路図である。 １、 ８． ４． ５．１２．１５．１７．２０．２６
・・・７リツプ７０ツブ、２ 、１１．１６．２４．２
５・・−シフ トＶ＼シスタ、６．１０．１３．１４．
２１．２２．２３・・・オア回路。 第１図 （（１） （ｂ）第２図 第３図
れぞれ本発明の別異の実施例を示す回路図である。 １、 ８． ４． ５．１２．１５．１７．２０．２６
・・・７リツプ７０ツブ、２ 、１１．１６．２４．２
５・・−シフ トＶ＼シスタ、６．１０．１３．１４．
２１．２２．２３・・・オア回路。 第１図 （（１） （ｂ）第２図 第３図
Claims (2)
- （１） 周囲白画素の一部を黒画素に変換する太め処
理装置において、入力画像のｍ Ｘ ｍ画素のデータを
抽出する抽出手段と、該抽出されたｍＸｍ画素のうちの
右上の画素以外の画素のデータの論理和データを得る手
段と、その論理和データを１ライン分遅延させる遅延手
段と、上記抽出手段で抽出されたｍ Ｘ ｍ画素のうち
の上方の画素データと上記遅延手段より出力されるデー
タとの論理和をとって出力する手段とを具備する太め処
理装置。 - （２） 周囲白画素の一部を黒画素に変換する太め処
理装置において、入力画像のｍ Ｘ ｍ画素のデータを
抽出する抽出手段と、該手段により抽出されたｍ Ｘ
ｍ画素のうちの下方の画素データの論理和データを得る
手段と、その論理和データを１ライン分遅延させる遅延
手段と′、上記抽出手段で抽出されたｍ Ｘ ｍ画素の
うち左下の画素を除（画素のデータと上記遅延手段より
出力されるデータとの論理和なとって出力する手段とを
具備する太め処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23327382A JPS59117374A (ja) | 1982-12-23 | 1982-12-23 | 太め処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23327382A JPS59117374A (ja) | 1982-12-23 | 1982-12-23 | 太め処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59117374A true JPS59117374A (ja) | 1984-07-06 |
Family
ID=16952498
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23327382A Pending JPS59117374A (ja) | 1982-12-23 | 1982-12-23 | 太め処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59117374A (ja) |
-
1982
- 1982-12-23 JP JP23327382A patent/JPS59117374A/ja active Pending
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