JPS5890600U - コンピユ−タシステムにおけるアドレス形成のテスト装置 - Google Patents

コンピユ−タシステムにおけるアドレス形成のテスト装置

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JPS5890600U
JPS5890600U JP1982143325U JP14332582U JPS5890600U JP S5890600 U JPS5890600 U JP S5890600U JP 1982143325 U JP1982143325 U JP 1982143325U JP 14332582 U JP14332582 U JP 14332582U JP S5890600 U JPS5890600 U JP S5890600U
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JP
Japan
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instruction
register
buffer
address
selection
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Pending
Application number
JP1982143325U
Other languages
English (en)
Inventor
ジエ−ムス・ノ−マン・ダ−ル
Original Assignee
ハネイウエル・インフオメ−シヨン・システムス・インコ−ポレ−テツド
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by ハネイウエル・インフオメ−シヨン・システムス・インコ−ポレ−テツド filed Critical ハネイウエル・インフオメ−シヨン・システムス・インコ−ポレ−テツド
Publication of JPS5890600U publication Critical patent/JPS5890600U/ja
Pending legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00—Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02—Addressing or allocation; Relocation
    • G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • G06F12/10—Address translation

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  • Engineering & Computer Science (AREA)
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  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Memory System Of A Hierarchy Structure (AREA)
  • Techniques For Improving Reliability Of Storages (AREA)
  • Debugging And Monitoring (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案がその一部である進歩したコンピュータ
・システムのブロック図、第２Ａ図及び第２Ｂ図は本考
案を実現するのに使用される装置のブロック図、第３図
はアドレス準備に使用される標準ディスクリブタ形式の
１つを示す図、第４図はアドレス準備に使用されるスー
パー・ディスクリブタ形式の１つを示す図、第５図及び
第５Ａ図は本考案がその一部である仮想記憶装置に使用
されるアドレス準備シーケンスのブロック図、第６図は
４４ビツトの仮想アドレセに対するデータ形式を示す図
、第７図はＥＰＡＴ命令に対する形式を示す図である。 １００・・・仮想記憶装置兼機密保護装置、１０２・・
・制御装置、１０４・・・アドレス準備装置、２００゜
２０２・・・オペランド・ディスクリブタ・レジスタ・
バフ’７．２０４．２０６・・・命令セグメント・レジ
スタ、２１６・・・保持レジスタ、２１８・・・レジス
タ、２２０，２２２・・・バス。

Claims (1)

  1. 【実用新案登録請求の範囲】 ディスクリブタ参照エントリによって制限されたアクセ
    スをさせる、セグメント化された主記憶装置を含む大規
    模なデータ処理システムにおいて、予め正しいサドレス
    展開が知られているアドレス形成のテスト及び診断モー
    ドで用いる、アドレス形成のテストのための命令をハー
    ドウェアで実現する装置であって、 （ａ）　　複数個のディスクリブタを記憶する第１のレ
    ジスタ装置と、 （ｂ）１つのディスク＋１ブタを記憶する第２のレジス
    タ装置と、 （Ｃ）　　前記命令の選択ビットが第１の状態にある時
    前記第１のレジスタ装置を選択し、前記選択ビットが第
    ２の状態にある時前記第２のレジスタ装置を選択するた
    め前記命令の選択ビットに応答する、前記第１と第２の
    レジスタ装置に接続された第１の選択装置と、。 （ｄ）　　前記命令の選択ビットが第１の状態にある時
    、前記第１のレジスタ装置における複数個のディスクリ
    ブタの１つを選択し、前記選択ビットが第２の状態にあ
    る時、前記第２のレジスタ装置におけるディスクリブタ
    を選択するための前記命令のアドレス・フィールド部分
    における複数個のビットに応答する第２の選択装置と、
    （ｅ）　　前記の選択されたディスクリブタに含まれる
    データをラッチするため前記第１の選択装置に接続され
    る第１のバッファ装置と、 げ）前記ディスクリブタの第１の複数個のビットにより
    選択される作業スペース番号をラッチするための第２の
    バッファ装置と、 （ｇ）　　第２の複数個のディスクリブタ・ビットによ
    り生成されるページ番号及びオフセットと前記命令のア
    ドレス・フィールドに対応するアドレスとをラッチする
    ための第３のバッファ装置と、（ｈ）　　作業スペース
    番号と、ページ番号と、オフセットとから部分的に得ら
    れる実アドレスを保持するための第４のバッファ装置と
    、 （ｉ＞　　前記第１のバッファ装置と接続され、主記憶
    装置に第１のバッファの内容を記憶するため、第１の記
    憶命令に応答する第１のバス装置と、（ｊ）　　前記第
    ２、第３、および第４のバッファ装置に接続され、第２
    の記憶命令に応答して前記各バッファ装置の内容を主記
    憶装置に記憶するための第２のノ寸ス装置とを設ける事
    を特徴とする装置。
JP1982143325U 1976-08-20 1982-09-21 コンピユ−タシステムにおけるアドレス形成のテスト装置 Pending JPS5890600U (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US05/716,315 US4079453A (en) 1976-08-20 1976-08-20 Method and apparatus to test address formulation in an advanced computer system
US716315 1976-08-20

Publications (1)

Publication Number Publication Date
JPS5890600U true JPS5890600U (ja) 1983-06-18

Family

ID=24877556

Family Applications (2)

Application Number Title Priority Date Filing Date
JP9943377A Pending JPS5337336A (en) 1976-08-20 1977-08-19 Method and device for testing address of computer system
JP1982143325U Pending JPS5890600U (ja) 1976-08-20 1982-09-21 コンピユ−タシステムにおけるアドレス形成のテスト装置

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JP9943377A Pending JPS5337336A (en) 1976-08-20 1977-08-19 Method and device for testing address of computer system

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US (1) US4079453A (ja)
JP (2) JPS5337336A (ja)
AU (1) AU513512B2 (ja)
CA (1) CA1104261A (ja)
DE (1) DE2737353A1 (ja)
FR (1) FR2362445A1 (ja)
GB (1) GB1540340A (ja)
HK (1) HK37080A (ja)

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Publication number Publication date
DE2737353A1 (de) 1978-02-23
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US4079453A (en) 1978-03-14
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FR2362445A1 (fr) 1978-03-17
AU513512B2 (en) 1980-12-04
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JPS5337336A (en) 1978-04-06

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