JPS587721Y2 - シンセサイザ−受信機 - Google Patents
シンセサイザ−受信機Info
- Publication number
- JPS587721Y2 JPS587721Y2 JP1977033150U JP3315077U JPS587721Y2 JP S587721 Y2 JPS587721 Y2 JP S587721Y2 JP 1977033150 U JP1977033150 U JP 1977033150U JP 3315077 U JP3315077 U JP 3315077U JP S587721 Y2 JPS587721 Y2 JP S587721Y2
- Authority
- JP
- Japan
- Prior art keywords
- power
- sweep
- turned
- pll
- division ratio
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Landscapes
- Superheterodyne Receivers (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Description
【考案の詳細な説明】
本考案はスーパーヘテロダイン受信機の局部発振回路を
位相同期ループ（ＰＬＬ）で構成し、掃引パルスにより
順次掃引し自動同調を行なうシンセサイザー受信機に関
し、特に電源投入時に遮断前に受信していた局を確実に
再受信できるシンセサイザー受信機に関する。
位相同期ループ（ＰＬＬ）で構成し、掃引パルスにより
順次掃引し自動同調を行なうシンセサイザー受信機に関
し、特に電源投入時に遮断前に受信していた局を確実に
再受信できるシンセサイザー受信機に関する。
一般に局部発振回路１をＰＬＬ ２で構成したシンセサ
イザー受信機は第１図のように構成されている。
イザー受信機は第１図のように構成されている。
即ちＰＬＬ ２を構成するプログラマブル分周器３の分
周比を掃引するパルス発生回路４よりの掃引パルスと、
分周比を設定する掃引カウンター５により可変し掃引を
行ない、放送を受信すれば受信検出信号Ｓにより掃引パ
ルス発生回路４を制御し、パルス発生を停止しその局の
受信を継続するものである。
周比を掃引するパルス発生回路４よりの掃引パルスと、
分周比を設定する掃引カウンター５により可変し掃引を
行ない、放送を受信すれば受信検出信号Ｓにより掃引パ
ルス発生回路４を制御し、パルス発生を停止しその局の
受信を継続するものである。
ところで斯る構成に於いては、電源を遮断すると掃引カ
ウンター５の値は消滅してしまう為、電源投入時遮断前
に受信していた局を受信できないばかりか、どの局が受
信されるか分らす又受信されない場合もあり、電源投入
時受信操作をその度毎に行なう必要があり不便なるもの
であった。
ウンター５の値は消滅してしまう為、電源投入時遮断前
に受信していた局を受信できないばかりか、どの局が受
信されるか分らす又受信されない場合もあり、電源投入
時受信操作をその度毎に行なう必要があり不便なるもの
であった。
そこで従来は第２図に示すように専用メモリー６を設け
、電源遮断時の掃引カウンター５の内容を記憶させてお
き、電源投入時メモリー６から掃引カウンター５に読み
出して、電源遮断前に受信していた局を受信する方法が
行なわれていた。
、電源遮断時の掃引カウンター５の内容を記憶させてお
き、電源投入時メモリー６から掃引カウンター５に読み
出して、電源遮断前に受信していた局を受信する方法が
行なわれていた。
しかしこの方式では専用のメモリーを必要とし、又その
制御回路も必要になる為高価になるものであった。
制御回路も必要になる為高価になるものであった。
その為第３図に示すように掃引カウンター５を不揮発性
素子で構成するとか、あるいは消費電力の極めて少ない
Ｃ−ＭＯＳで構成し、外部から補助バッテリー７で電源
遮断時も保持しておき、電源投入時遮断前受信していた
局を再受信する方法が提案されている。
素子で構成するとか、あるいは消費電力の極めて少ない
Ｃ−ＭＯＳで構成し、外部から補助バッテリー７で電源
遮断時も保持しておき、電源投入時遮断前受信していた
局を再受信する方法が提案されている。
しかしながらこの方式では、電源投入時に発生するノイ
ズにより、あるいは制御入力手段８にタッチキーを使用
した場合には、電源投入時に電源の立上り状態によりタ
ッチ動作が無いにもかかわらず、キー人力があるような
状態になり掃引制御回路９が作動し電源投入時掃引カウ
ンター５の値が変化してしまい、電源遮断前に受信して
いた局を受信できない誤動作を生じ易かった。
ズにより、あるいは制御入力手段８にタッチキーを使用
した場合には、電源投入時に電源の立上り状態によりタ
ッチ動作が無いにもかかわらず、キー人力があるような
状態になり掃引制御回路９が作動し電源投入時掃引カウ
ンター５の値が変化してしまい、電源遮断前に受信して
いた局を受信できない誤動作を生じ易かった。
従って本考案はこの点に鑑みなされたもので、掃引パル
ス発生回路４及び掃引カウンター５を制御する掃引制御
回路９を電源投入時所定期間強制的に不動作にし、電源
投入時の誤動作を防止したシンセサイザー受信機を提供
するものである。
ス発生回路４及び掃引カウンター５を制御する掃引制御
回路９を電源投入時所定期間強制的に不動作にし、電源
投入時の誤動作を防止したシンセサイザー受信機を提供
するものである。
以下本考案の実施例を第４図と共に説明する。
尚第１図と同一構成要素は省略し、本考案の要部につい
てのみ説明する。
てのみ説明する。
８は掃引状態を制御する為のキーで構成された入力手段
、９は該入力手段８よりのキー信号で掃引パルス発生回
路４及び掃引カウンター５を制御する掃引制御回路で、
主にフリップフロップで構成されている。
、９は該入力手段８よりのキー信号で掃引パルス発生回
路４及び掃引カウンター５を制御する掃引制御回路で、
主にフリップフロップで構成されている。
１０は電源投入を検出する電源投入検出手段で、電源投
入時前記掃引制御回路９を所定期間強制的に一定状態に
するよう作用する。
入時前記掃引制御回路９を所定期間強制的に一定状態に
するよう作用する。
例えば掃引制御回路９を構成するフリップフロップをリ
セットさせる。
セットさせる。
斯る構成に依れば電源投入時掃引制御回路９が強制的に
不動作にされる為、掃引パルス発生回路４からのパルス
性ノイズの発生は防止され、掃引カウンター５の値が変
化され受信局が外れるのを防止できる。
不動作にされる為、掃引パルス発生回路４からのパルス
性ノイズの発生は防止され、掃引カウンター５の値が変
化され受信局が外れるのを防止できる。
かくして電源投入時確実に遮断前に受信されていた局を
受信できるものである。
受信できるものである。
尚掃引制御回路の不動作は、電源投入から一定期間のみ
であり、その後は人力手段の操作により制御され得るも
のである。
であり、その後は人力手段の操作により制御され得るも
のである。
上述の如く本考案のシンセサイザー受信機は、ＰＬＬの
プログラマブル分周器の分周比を設定する掃引カウンタ
ーの内容を電源遮断時にも保持し、電源投入時に遮断前
に受信していた局を受信できるもので、電源投入時に所
定期間掃引制御回路を強制的に一定状態に保持し、掃引
カウンターの誤動作を防止して、電源投入時確実に前回
受信していた局を受信できることを特徴とするシンセサ
イザー受信機である。
プログラマブル分周器の分周比を設定する掃引カウンタ
ーの内容を電源遮断時にも保持し、電源投入時に遮断前
に受信していた局を受信できるもので、電源投入時に所
定期間掃引制御回路を強制的に一定状態に保持し、掃引
カウンターの誤動作を防止して、電源投入時確実に前回
受信していた局を受信できることを特徴とするシンセサ
イザー受信機である。
第１図はシンセサイザー受信機の構成を示すブロック図
、第２．第３図は第１図の要部の構成を示す従来例、第
４図は本考案によるシンセサイザー受信機の要部を示す
図である。 １・・・・・・局部発振回路、２・・・・・・ＰＬＬ、
３・・・・・・プログラマブル分周器、４・・・・・・
掃引パルス発生回路、５・・・・・・掃引カウンター、
６・・・・・・メモリー、７・・・・・・補助バッテリ
ー、８・・・・・・入力手段、９・・・・・・掃引制御
回路、１０・・・・・・電源投入検出回路。
、第２．第３図は第１図の要部の構成を示す従来例、第
４図は本考案によるシンセサイザー受信機の要部を示す
図である。 １・・・・・・局部発振回路、２・・・・・・ＰＬＬ、
３・・・・・・プログラマブル分周器、４・・・・・・
掃引パルス発生回路、５・・・・・・掃引カウンター、
６・・・・・・メモリー、７・・・・・・補助バッテリ
ー、８・・・・・・入力手段、９・・・・・・掃引制御
回路、１０・・・・・・電源投入検出回路。
Claims (1)
- 局部発振回路をＰＬＬで構成し、該ＰＬＬを構成するプ
ログラマブル分周器の分周比を、掃引パルス発生回路か
らの掃引パルスが入力される分周比設定手段により変更
して掃引し、且つ電源遮断時に前記分周比設定手段の内
容を保持するよう構成したシンセサイザー受信機に於い
て、前記掃引パルス発生回路を制御することにより前記
分周比設定手段の設定値を制御する掃引制御手段を、電
源投入時所定期間強制的に不動作状態に保持する手段を
設け、電源投入時分周比設定手段に保持されていた内容
がＰＬＬのプログラマブル分周器に入力され、電源遮断
前に受信していた局を確実に受信することを特徴とする
シンセサイザー受信機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1977033150U JPS587721Y2 (ja) | 1977-03-15 | 1977-03-15 | シンセサイザ−受信機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1977033150U JPS587721Y2 (ja) | 1977-03-15 | 1977-03-15 | シンセサイザ−受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS53126510U JPS53126510U (ja) | 1978-10-07 |
| JPS587721Y2 true JPS587721Y2 (ja) | 1983-02-10 |
Family
ID=28888056
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1977033150U Expired JPS587721Y2 (ja) | 1977-03-15 | 1977-03-15 | シンセサイザ−受信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS587721Y2 (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4982211A (ja) * | 1972-11-15 | 1974-08-08 | ||
| JPS504907A (ja) * | 1973-05-01 | 1975-01-20 | ||
| JPS5075324A (ja) * | 1973-11-03 | 1975-06-20 |
-
1977
- 1977-03-15 JP JP1977033150U patent/JPS587721Y2/ja not_active Expired
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4982211A (ja) * | 1972-11-15 | 1974-08-08 | ||
| JPS504907A (ja) * | 1973-05-01 | 1975-01-20 | ||
| JPS5075324A (ja) * | 1973-11-03 | 1975-06-20 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS53126510U (ja) | 1978-10-07 |
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