JPS5866434A - 無線通信方式 - Google Patents
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- JPS5866434A JPS5866434A JP56165037A JP16503781A JPS5866434A JP S5866434 A JPS5866434 A JP S5866434A JP 56165037 A JP56165037 A JP 56165037A JP 16503781 A JP16503781 A JP 16503781A JP S5866434 A JPS5866434 A JP S5866434A
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- 238000004891 communication Methods 0.000 title claims description 13
- 238000012544 monitoring process Methods 0.000 claims abstract description 20
- 230000010355 oscillation Effects 0.000 claims description 23
- 238000000034 method Methods 0.000 claims description 7
- 230000005540 biological transmission Effects 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 4
- 238000007796 conventional method Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000010295 mobile communication Methods 0.000 description 1
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/0802—Details of the phase-locked loop the loop being adapted for reducing power consumption
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/18—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop
- H03L7/197—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between numbers which are variable in time or the frequency divider dividing by a factor variable in time, e.g. for obtaining fractional frequency division
- H03L7/199—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between numbers which are variable in time or the frequency divider dividing by a factor variable in time, e.g. for obtaining fractional frequency division with reset of the frequency divider or the counter, e.g. for assuring initial synchronisation
Landscapes
- Radio Transmission System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、フェーズロックループ回路を用いた発振源會
有する無線機とこれに対向する無線機との間で通信を行
なう方式に係わり、特に発振周波数を安定に保持しｔ上
で消費電力の低減をはかった無線通信方式に関する。
有する無線機とこれに対向する無線機との間で通信を行
なう方式に係わり、特に発振周波数を安定に保持しｔ上
で消費電力の低減をはかった無線通信方式に関する。
近年、移動通信方式等の無線通信方式では、無線機の回
路構成の小型化やＳＮ比の向上管はかる丸め、周波数シ
ンセサイザ等のフェーズロックループ回路を用いた発振
源を有する無線機が多く使用されている。第１図は従来
のフェーズロックループ回路を用いた周波数シンセサイ
ザの基本構成を示すブロック図である。同図において、
上記周波数シンセサイザは、基準発振器１の出力と、電
圧制御発振器ＶＣＯ２の出力を分周器３で分局した出力
との位相差を位相比較器４で検出し、この検出出力をル
ープフィルタ５を介して電圧制御発振器２に供給して所
望の発振周波数を得るものである。
路構成の小型化やＳＮ比の向上管はかる丸め、周波数シ
ンセサイザ等のフェーズロックループ回路を用いた発振
源を有する無線機が多く使用されている。第１図は従来
のフェーズロックループ回路を用いた周波数シンセサイ
ザの基本構成を示すブロック図である。同図において、
上記周波数シンセサイザは、基準発振器１の出力と、電
圧制御発振器ＶＣＯ２の出力を分周器３で分局した出力
との位相差を位相比較器４で検出し、この検出出力をル
ープフィルタ５を介して電圧制御発振器２に供給して所
望の発振周波数を得るものである。
しかしながら、このような従来の周波数シンセサイザを
発振源として無線機に使用した場合、フェーズロックル
ープ回路を構成する各回路、特に分周器の電力消費が大
きいため、例えば水晶発振回路を使用したものに比べて
無線機としての消費電力が増大する欠点があった。この
ため、電源として電池全使用した携帯用の移動無線機等
には適用し難かった。
発振源として無線機に使用した場合、フェーズロックル
ープ回路を構成する各回路、特に分周器の電力消費が大
きいため、例えば水晶発振回路を使用したものに比べて
無線機としての消費電力が増大する欠点があった。この
ため、電源として電池全使用した携帯用の移動無線機等
には適用し難かった。
本発明は、上記事情に着目してなされたもので、その目
的とするところは、フェーズロックループ回路本体を間
欠ロック動作させて消費電力の低減をはかり、しかも発
振周波数の詐容量以上の変化を阻止して常に安定な通信
を行ない得るようにし次無線通信方式全提供することに
ある。
的とするところは、フェーズロックループ回路本体を間
欠ロック動作させて消費電力の低減をはかり、しかも発
振周波数の詐容量以上の変化を阻止して常に安定な通信
を行ない得るようにし次無線通信方式全提供することに
ある。
以下、本発明の一実施例を第２図および９３図を参照し
て説明する。なお、前記第１図と同一部分には同一符号
を付して詳しい説明は省略する。第２因は本実施例にお
けるフェーズロックループ回路を使用し危局波数シンセ
サイザのブロック構成図である。
て説明する。なお、前記第１図と同一部分には同一符号
を付して詳しい説明は省略する。第２因は本実施例にお
けるフェーズロックループ回路を使用し危局波数シンセ
サイザのブロック構成図である。
同図において、フェーズロックループ回路本体６のルー
プフィルタ５と電圧制御発振器ＶＣＯ２との間には第１
のスイッチ７が介在設置しである。また、フェーズキッ
クループ回路本体６のループを構成する各回路のうち電
圧制御発振器２ｔ−除い九各回路、っまり分周器３、位
相比較器４およびループフィルタ５と電源８との間、お
よび基準発振器１と電源８との間の電源出力供給路中に
は、第２のスイッチ９が設けである。これら第１お工び
第２のスイッチ７゜９は、それぞれフェーズロックルー
プ回路本体６のループおよび上記各回路への電源供給路
を開閉するもので、スイッチ駆動回路１ｏからのスイッ
チ閉成信号によって開閉制御される。一方、前記第１の
スイッチ１と電圧制御発振器２との間には、電圧制御発
振器２に対し並列にコンデフｆｌｌが設けである。この
コンデンサ１１は、第１のスイッチ１の閉成時、つまり
フェーズロックループ回路本体ｉのループのロック動作
時に電圧制御発振器２の制御電圧を記憶し、この記憶し
た電圧を前記第１のスイン′ｆｒの開成時に電圧制御発
振器２へ供給するものである。
プフィルタ５と電圧制御発振器ＶＣＯ２との間には第１
のスイッチ７が介在設置しである。また、フェーズキッ
クループ回路本体６のループを構成する各回路のうち電
圧制御発振器２ｔ−除い九各回路、っまり分周器３、位
相比較器４およびループフィルタ５と電源８との間、お
よび基準発振器１と電源８との間の電源出力供給路中に
は、第２のスイッチ９が設けである。これら第１お工び
第２のスイッチ７゜９は、それぞれフェーズロックルー
プ回路本体６のループおよび上記各回路への電源供給路
を開閉するもので、スイッチ駆動回路１ｏからのスイッ
チ閉成信号によって開閉制御される。一方、前記第１の
スイッチ１と電圧制御発振器２との間には、電圧制御発
振器２に対し並列にコンデフｆｌｌが設けである。この
コンデンサ１１は、第１のスイッチ１の閉成時、つまり
フェーズロックループ回路本体ｉのループのロック動作
時に電圧制御発振器２の制御電圧を記憶し、この記憶し
た電圧を前記第１のスイン′ｆｒの開成時に電圧制御発
振器２へ供給するものである。
一方第３図は、本実施例における無線通信方式全適用し
たシステムのブロック構成図で、図中２０は基地局であ
る固定無線機、ＳＯは前記第２図に示した周波数シンセ
サイザ金発振源１２とする移動無線機を示している。
たシステムのブロック構成図で、図中２０は基地局であ
る固定無線機、ＳＯは前記第２図に示した周波数シンセ
サイザ金発振源１２とする移動無線機を示している。
固定無線機２０は、移動無線機３０からの送信信号をア
ンテナ２１を経て受信する受信機２２と、この受信機２
２の出力エリ上記送信信号の搬送波周波数、つまり周波
数シンセサイザ１２の発振周波数の変化を検出する周波
数検出回路２３と、この回路２３で発振周波数の変化が
検出されたとき監視トーン信号の発生を停止する監視ト
ーン発振器２４と、上記監視トーン信号を変調器２５ａ
で変調したのちアンテナ２６ｔ−介して送出する送信機
２５とから構成されている。なお送信機２５は、上記監
視トーン信号の他に通話信号の送信も行なう。
ンテナ２１を経て受信する受信機２２と、この受信機２
２の出力エリ上記送信信号の搬送波周波数、つまり周波
数シンセサイザ１２の発振周波数の変化を検出する周波
数検出回路２３と、この回路２３で発振周波数の変化が
検出されたとき監視トーン信号の発生を停止する監視ト
ーン発振器２４と、上記監視トーン信号を変調器２５ａ
で変調したのちアンテナ２６ｔ−介して送出する送信機
２５とから構成されている。なお送信機２５は、上記監
視トーン信号の他に通話信号の送信も行なう。
一方移動無線機３０は、周波数シンセサイザ１２の発振
周波数により設定されたチャンネルで通話信号をアンテ
ナ３１ｆ介して送信する送信機３２と、前記固定無線機
２０からの通話信号および監視トーン信号をアンテナ３
３會介して受信する受信機３４と、この受信機３４の出
力より監視トーン信号の有無を検出する監視トーン検出
器３５とから構成されている。この監視トーン検出器３
５は、監視トーン信号が有る間は周波数シンセサイザ１
２のスイッチ駆動回路１０に対して非駆動信号を出力し
、一方監視トーン信号が無くなると駆動信号を出力する
。
周波数により設定されたチャンネルで通話信号をアンテ
ナ３１ｆ介して送信する送信機３２と、前記固定無線機
２０からの通話信号および監視トーン信号をアンテナ３
３會介して受信する受信機３４と、この受信機３４の出
力より監視トーン信号の有無を検出する監視トーン検出
器３５とから構成されている。この監視トーン検出器３
５は、監視トーン信号が有る間は周波数シンセサイザ１
２のスイッチ駆動回路１０に対して非駆動信号を出力し
、一方監視トーン信号が無くなると駆動信号を出力する
。
このような構成であるから、スイッチ駆動回路１０から
スイッチ閉成信号が出力されると、第１および第２のス
イッチ２，９が閉成してフェーズロックループ回路本体
σのループが閉となるとともに分局器３等の各回路に電
源８の出力が供給され、この結果周波数シンセサイザ１
２は四ツク動作を行なう。これにエリ、電圧制御発振器
２の発振周波数は、基準発振器１の発振周波数と分局器
３の分周数とで定まる値にロックされる。またこのロッ
ク時における電圧制御発振器２の制御電圧は、コンタン
ｆｉｌに充電され、記憶される。そしてスイッチ駆動回
路１０からのスイッチ閉成信号が断九れると、各スイッ
チ７，９が開となってフェーズロックループ回路本体６
のループは開成し、この結果周波数シンセサイザは非ロ
ツク動作状態となる。゛また上記スイッチ９の開成によ
り、分周器３等への電源８出力の供給が断たれて各回路
は不動作状態となる。しかしながら電圧制御発振器２へ
は、上記ループの開成とともにループフィルタ５の出力
に代わってコンデンサ１ノの充電電圧が制御電圧として
供給される。したがって、フェーズロックループ回路本
体６のループが開となっても、ま九分周器３等への電源
供給が断たれても、電圧制御発振器２は依然として前記
ロック時の発振局波数で発振動作を継続する。
スイッチ閉成信号が出力されると、第１および第２のス
イッチ２，９が閉成してフェーズロックループ回路本体
σのループが閉となるとともに分局器３等の各回路に電
源８の出力が供給され、この結果周波数シンセサイザ１
２は四ツク動作を行なう。これにエリ、電圧制御発振器
２の発振周波数は、基準発振器１の発振周波数と分局器
３の分周数とで定まる値にロックされる。またこのロッ
ク時における電圧制御発振器２の制御電圧は、コンタン
ｆｉｌに充電され、記憶される。そしてスイッチ駆動回
路１０からのスイッチ閉成信号が断九れると、各スイッ
チ７，９が開となってフェーズロックループ回路本体６
のループは開成し、この結果周波数シンセサイザは非ロ
ツク動作状態となる。゛また上記スイッチ９の開成によ
り、分周器３等への電源８出力の供給が断たれて各回路
は不動作状態となる。しかしながら電圧制御発振器２へ
は、上記ループの開成とともにループフィルタ５の出力
に代わってコンデンサ１ノの充電電圧が制御電圧として
供給される。したがって、フェーズロックループ回路本
体６のループが開となっても、ま九分周器３等への電源
供給が断たれても、電圧制御発振器２は依然として前記
ロック時の発振局波数で発振動作を継続する。
しかして、移動無線機３０と固定無線機２０との間では
、上記周波数シンセサイザ１２で設定された周波数を送
受信チャンネルとして通話”がなされる。
、上記周波数シンセサイザ１２で設定された周波数を送
受信チャンネルとして通話”がなされる。
さてこの状態で、例えば周囲温度の変化あるいは電源８
電圧の変動にエリ周波数シンセサイザ１２の発振周波数
が変化し、この変化量が所定範囲を超えると、その旨が
固定無線機２０の周波数検出器２３で検出される。そう
すると監視トーン発振器２４からそれまで発生されてい
り監視トーン信号がオフとなり、移動無線機３０への送
出が断たれる。一方移動無線機３０では、上記監視トー
ン信号の送出停止を監視ト ”−ン検出器３５で検出し
、この監視トーン検出器３５から周波数シンセサイザ１
２に対し駆動信号が出力する。この結果、周波数シンセ
サイザ１２は、スイッチ駆動回路１０からスイッチ閉成
信号を出力して各スイッチ１．９″ｆ：閉成し、ロック
動作を開−始する。これＫより、電圧制御発振器２の発
振周波数の修正がなされる０このように本実施例の無線
通信方式によれば、周波数シンセサイザのフェーズロッ
クループ回路全間欠ロック創作させ、かつ非ｐツク動作
時に任意の回路への電源供給をオフするようにしている
ので、常時ロック動作させてい九従来の方式に比べてル
ープの消費電力全大幅に低減し得、この結果消費電力の
著しく少ない周波数シンセサイザを提供することができ
るｏしたがって、電池を使用した携帯用の移動無線機等
にも周波数シンセサイザを発振源として使用することが
可能となり、移動無線機の小製軽量化および性能向上に
多大な効果１奏する。また本実施例では、固定無線機２
０にて移動無線機３０の発振周波数の変化を監処し、こ
の監視結果を移動無線機へ知らせて周波数シンセサイザ
のロック動作を制御する↓うにしているので、発振周波
数の変化が許容範囲を超える以前に確実に発振周波数を
修正することができ、この結果常に安定な周波数で通信
を行なうことができる。
電圧の変動にエリ周波数シンセサイザ１２の発振周波数
が変化し、この変化量が所定範囲を超えると、その旨が
固定無線機２０の周波数検出器２３で検出される。そう
すると監視トーン発振器２４からそれまで発生されてい
り監視トーン信号がオフとなり、移動無線機３０への送
出が断たれる。一方移動無線機３０では、上記監視トー
ン信号の送出停止を監視ト ”−ン検出器３５で検出し
、この監視トーン検出器３５から周波数シンセサイザ１
２に対し駆動信号が出力する。この結果、周波数シンセ
サイザ１２は、スイッチ駆動回路１０からスイッチ閉成
信号を出力して各スイッチ１．９″ｆ：閉成し、ロック
動作を開−始する。これＫより、電圧制御発振器２の発
振周波数の修正がなされる０このように本実施例の無線
通信方式によれば、周波数シンセサイザのフェーズロッ
クループ回路全間欠ロック創作させ、かつ非ｐツク動作
時に任意の回路への電源供給をオフするようにしている
ので、常時ロック動作させてい九従来の方式に比べてル
ープの消費電力全大幅に低減し得、この結果消費電力の
著しく少ない周波数シンセサイザを提供することができ
るｏしたがって、電池を使用した携帯用の移動無線機等
にも周波数シンセサイザを発振源として使用することが
可能となり、移動無線機の小製軽量化および性能向上に
多大な効果１奏する。また本実施例では、固定無線機２
０にて移動無線機３０の発振周波数の変化を監処し、こ
の監視結果を移動無線機へ知らせて周波数シンセサイザ
のロック動作を制御する↓うにしているので、発振周波
数の変化が許容範囲を超える以前に確実に発振周波数を
修正することができ、この結果常に安定な周波数で通信
を行なうことができる。
なお本発明は上記実施例に限定されるものではない。例
えば、制御電圧の記憶手段として、コンデンｆｌｌ以外
に、Ａ／Ｄ コンバータでデジタル化したのち記憶し
この記憶情＠’ｋＤ／Ａコンバータでアナレグ値に戻し
て電圧制御発振器に供給するものｔ適用してもよい。′
ｔｆｔ非ロック動作時に電源供給をオフする回路は、最
も消費電力の大きい分周器だけであってもよく、要する
にフェーズロックループ回路本体のループを構成する各
回路のうち電圧制御発振器を除いた各回路の少なくとも
１つｔ−電源断すればＬい。さらに、前記実施例では固
定無線機２０からの監視トーン信号が断となったときに
スイッチ閉成信号を出力するようにしたが、一定期間連
続して監視信号が断となったときにスイッチ、閉成信号
を出力するように構成してもよい０このようにすれば、
監視トーン信号の瞬断等による不要なロック動作を防止
でき、より一層効率の良い間欠ロック動作を行なうこと
が可能となる。ま友、逆に、監視トーン信号の送出は周
波数変化が検出されたときのみ行なうようにし、監視ト
ーン検出器３５でこの信号の到来を検出してスイッチ駆
動回路１０に駆動信号全出力するように構成してもよい
。これにより、周波数監視系の消費電力をも低減するこ
とができるＯｌた前記実施例では、発振源として周波数
シンセサイザを使用した場合について説明したが、周波
数のロック用にフェーズロックループ回路を用い、基準
発振器の水晶振動子を交換することにエリ発振周波数金
切換えるものであっても同様に適用できる。その他、フ
ェーズロックループ回路の基本構成や通信の種類等につ
いても、本発明の要旨を逸脱しない範囲で種々変形して
実施できる。
えば、制御電圧の記憶手段として、コンデンｆｌｌ以外
に、Ａ／Ｄ コンバータでデジタル化したのち記憶し
この記憶情＠’ｋＤ／Ａコンバータでアナレグ値に戻し
て電圧制御発振器に供給するものｔ適用してもよい。′
ｔｆｔ非ロック動作時に電源供給をオフする回路は、最
も消費電力の大きい分周器だけであってもよく、要する
にフェーズロックループ回路本体のループを構成する各
回路のうち電圧制御発振器を除いた各回路の少なくとも
１つｔ−電源断すればＬい。さらに、前記実施例では固
定無線機２０からの監視トーン信号が断となったときに
スイッチ閉成信号を出力するようにしたが、一定期間連
続して監視信号が断となったときにスイッチ、閉成信号
を出力するように構成してもよい０このようにすれば、
監視トーン信号の瞬断等による不要なロック動作を防止
でき、より一層効率の良い間欠ロック動作を行なうこと
が可能となる。ま友、逆に、監視トーン信号の送出は周
波数変化が検出されたときのみ行なうようにし、監視ト
ーン検出器３５でこの信号の到来を検出してスイッチ駆
動回路１０に駆動信号全出力するように構成してもよい
。これにより、周波数監視系の消費電力をも低減するこ
とができるＯｌた前記実施例では、発振源として周波数
シンセサイザを使用した場合について説明したが、周波
数のロック用にフェーズロックループ回路を用い、基準
発振器の水晶振動子を交換することにエリ発振周波数金
切換えるものであっても同様に適用できる。その他、フ
ェーズロックループ回路の基本構成や通信の種類等につ
いても、本発明の要旨を逸脱しない範囲で種々変形して
実施できる。
以上詳述したように、−フェーズロックループ回路に、
ループ全開閉する第１の′スイッチを設けるとともにル
ープを構成する各回路のうち電圧制御発振器を除いた各
回路の少なくとも１つの回路への電源供給をオフ・オン
する第２のスイッチを投砂、かつ制御電圧を記憶する記
憶回路を設け、さらにこのフェーズロックループ回路を
備え次無線機と対向する無線機に周波数の監視手段を設
けて周波数変化が所定範囲を超えたときに上記各スイッ
チを閉成してロック動作全行なう工うにした本発明によ
れば、フェーズロックループ回路本体を間欠ロック動作
させて消費電力の低減をはかり、しかも発振周波数の許
容量奮起える変化を阻止して常に安定な通信を行ない得
る無線通信方式全提供することができる。
ループ全開閉する第１の′スイッチを設けるとともにル
ープを構成する各回路のうち電圧制御発振器を除いた各
回路の少なくとも１つの回路への電源供給をオフ・オン
する第２のスイッチを投砂、かつ制御電圧を記憶する記
憶回路を設け、さらにこのフェーズロックループ回路を
備え次無線機と対向する無線機に周波数の監視手段を設
けて周波数変化が所定範囲を超えたときに上記各スイッ
チを閉成してロック動作全行なう工うにした本発明によ
れば、フェーズロックループ回路本体を間欠ロック動作
させて消費電力の低減をはかり、しかも発振周波数の許
容量奮起える変化を阻止して常に安定な通信を行ない得
る無線通信方式全提供することができる。
第１図は従来のフェーズロックループ回路を使用した周
波数シンセサイザの基本構成を示すブロック図、第２図
および第３図は本発明の一実施例を説明するためのもの
で、第２図は周波数シンセサイザのブロック構成図、第
３図は無線通信システムのブロック構成図である。 １・・・基準発振器、２・・・電圧制御発振器（ＶＣＯ
）、３・・・分周器、４・・・位相比較器、５・・・ル
ープフィルタ、６・・・フェーズロックループ回路本体
、１・・・第１のスイッチ、８・・・電源、９゛・・・
第２のスイッチ、１０・・・スイッチ駆動回路、１１・
・・コンデンサ、２０・・・固定無線機、２３・・・周
波数検出器、２４・・・監視トーン発振器、ＳＯ・・・
移動無線機、３５・・・監視トーン検出器、１２・・・
周波数シンセサイザ。 出願人代理人 弁理士 鈴 江 武 彦第１頁の続き ０発 明 者 久下亨 日野市旭が丘３丁目１番地の１ 東京芝浦電気株式会社日野工場
波数シンセサイザの基本構成を示すブロック図、第２図
および第３図は本発明の一実施例を説明するためのもの
で、第２図は周波数シンセサイザのブロック構成図、第
３図は無線通信システムのブロック構成図である。 １・・・基準発振器、２・・・電圧制御発振器（ＶＣＯ
）、３・・・分周器、４・・・位相比較器、５・・・ル
ープフィルタ、６・・・フェーズロックループ回路本体
、１・・・第１のスイッチ、８・・・電源、９゛・・・
第２のスイッチ、１０・・・スイッチ駆動回路、１１・
・・コンデンサ、２０・・・固定無線機、２３・・・周
波数検出器、２４・・・監視トーン発振器、ＳＯ・・・
移動無線機、３５・・・監視トーン検出器、１２・・・
周波数シンセサイザ。 出願人代理人 弁理士 鈴 江 武 彦第１頁の続き ０発 明 者 久下亨 日野市旭が丘３丁目１番地の１ 東京芝浦電気株式会社日野工場
Claims (1)
- 第１の無線機とフェーズロックループ回路を備えた第２
の無線機との間で無線通信を行なうシステムにおいて、
フェーズロックループ回路に、フェーズロックループ回
路本体のループを開閉するとともにこのループを構成す
る各回路のうち電圧制御発振器を除いた各回路の少なく
とも１つの回路の電源管オフ・オンするスイッチ手段と
、上記ループの閉成時に電圧制御発振器の制御電圧を記
憶しこの記憶し九制御電圧ｔループの開成時に電圧制御
発振器に供給して発振動作を継続させる記憶手段と金設
け、第１の無線機に、第２の無線機の送信周波数を監視
する手段と、その監視結果に対応する信号を第２の無線
機へ送出する手段とを設け、かつ第２の無線機に、前記
第１の無線機からの信号を検出してその内容を判定する
手段と、その判定結果に・応じて前記フェーズロックル
ープ回路のスイッチ手段を開閉制御する手段とを設け、
第２の無線機の発振周波数の変化が所定範囲内のときフ
ェーズロックループ回路本体を非ロツク動作状態とする
とともに、周波数の変化が所定範囲を超えたときフェー
ズロックループ回路本体全ロック動作させるようにし次
ことを特徴とする無線通信方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56165037A JPS5866434A (ja) | 1981-10-16 | 1981-10-16 | 無線通信方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56165037A JPS5866434A (ja) | 1981-10-16 | 1981-10-16 | 無線通信方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5866434A true JPS5866434A (ja) | 1983-04-20 |
Family
ID=15804629
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56165037A Pending JPS5866434A (ja) | 1981-10-16 | 1981-10-16 | 無線通信方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5866434A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0202072A2 (en) * | 1985-05-13 | 1986-11-20 | Nec Corporation | Frequency synthesizer |
| EP0209321A2 (en) * | 1985-07-15 | 1987-01-21 | Nec Corporation | Phase-locked loop frequency synthesizer |
| US5202906A (en) * | 1986-12-23 | 1993-04-13 | Nippon Telegraph And Telephone Company | Frequency divider which has a variable length first cycle by changing a division ratio after the first cycle and a frequency synthesizer using same |
-
1981
- 1981-10-16 JP JP56165037A patent/JPS5866434A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0202072A2 (en) * | 1985-05-13 | 1986-11-20 | Nec Corporation | Frequency synthesizer |
| US4673892A (en) * | 1985-05-13 | 1987-06-16 | Nec Corporation | Phase locked loop frequency synthesizer with battery saving circuit |
| EP0209321A2 (en) * | 1985-07-15 | 1987-01-21 | Nec Corporation | Phase-locked loop frequency synthesizer |
| US4667169A (en) * | 1985-07-15 | 1987-05-19 | Nec Corporation | Phase-locked loop frequency synthesizer having reduced power consumption |
| US5202906A (en) * | 1986-12-23 | 1993-04-13 | Nippon Telegraph And Telephone Company | Frequency divider which has a variable length first cycle by changing a division ratio after the first cycle and a frequency synthesizer using same |
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