JPS5843993B2 - 高圧用サイリスタ整流器のための制御回路 - Google Patents
高圧用サイリスタ整流器のための制御回路Info
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- JPS5843993B2 JPS5843993B2 JP48069135A JP6913573A JPS5843993B2 JP S5843993 B2 JPS5843993 B2 JP S5843993B2 JP 48069135 A JP48069135 A JP 48069135A JP 6913573 A JP6913573 A JP 6913573A JP S5843993 B2 JPS5843993 B2 JP S5843993B2
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- control
- gate
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- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
- H02M1/088—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters for the simultaneous control of series or parallel connected semiconductor devices
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
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- H02M7/02—Conversion of ac power input into dc power output without possibility of reversal
- H02M7/04—Conversion of ac power input into dc power output without possibility of reversal by static converters
- H02M7/12—Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/145—Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means
- H02M7/155—Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only
- H02M7/19—Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only arranged for operation in series, e.g. for voltage multiplication
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
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- Rectifiers (AREA)
- Protection Of Static Devices (AREA)
Description
【発明の詳細な説明】
本発明は高電圧用の静止形変換装置におけるサイリスタ
整流器用制御回路に関する。
整流器用制御回路に関する。
サイリスタ整流器は直列に接続された多数のサイリスタ
で構成され、各サイリスタはサイリスタ端子間の電圧を
示す指示信号を発する信号発生装置を有する制御装置を
備えている。
で構成され、各サイリスタはサイリスタ端子間の電圧を
示す指示信号を発する信号発生装置を有する制御装置を
備えている。
サイリスタ整流器用の前記制御回路はサイリスタ整流器
用の点弧命令を受信する入力回路を有する。
用の点弧命令を受信する入力回路を有する。
本発明の目的は少なくとも第１サイリスタが導電方向の
ある正電位に達する迄点弧パルスがサイリスタの制御装
置に伝達されずしかも、最終サイリスタが点弧した後は
点弧パルスが伝達されないことを確実に行うことである
。
ある正電位に達する迄点弧パルスがサイリスタの制御装
置に伝達されずしかも、最終サイリスタが点弧した後は
点弧パルスが伝達されないことを確実に行うことである
。
最籾に述べた条件は通常の動作を行っている場合に必要
であり、例えば制御回路から点弧パルスが発生される前
に個々のサイリスタに加わる電圧が一定の最少値、典型
的には１０ボルトから２０ボルトの値に上昇するのを確
実にし、また点弧パルスが実際にサイリスタを点弧する
ことができるように制御装置の電力蓄積コンデンサが充
電されることを確実にする。
であり、例えば制御回路から点弧パルスが発生される前
に個々のサイリスタに加わる電圧が一定の最少値、典型
的には１０ボルトから２０ボルトの値に上昇するのを確
実にし、また点弧パルスが実際にサイリスタを点弧する
ことができるように制御装置の電力蓄積コンデンサが充
電されることを確実にする。
このように第１条件の目的はサイリスタが実際に点弧す
る可能性を持ったときだげ点弧パルスを発生するように
することである。
る可能性を持ったときだげ点弧パルスを発生するように
することである。
第２条件の理由は制御回路および制御装置における電力
消費を低減するために点弧パルスの長さを限定すること
入試回路の素子の疲労を制限することである。
消費を低減するために点弧パルスの長さを限定すること
入試回路の素子の疲労を制限することである。
さらに本発明は、整流器全体に正電圧が生じると同時に
一部のサイリスタが阻止状態にあり他のサイリスタが導
通している状態で点弧命令を受ける場合にサイリスタを
保護するのに重要である。
一部のサイリスタが阻止状態にあり他のサイリスタが導
通している状態で点弧命令を受ける場合にサイリスタを
保護するのに重要である。
このような場合はサイリスタ整流器が低負荷電流の時に
起り、電流や電圧の変動によりサイリスタが一時的に無
電流になる。
起り、電流や電圧の変動によりサイリスタが一時的に無
電流になる。
サイリスタにはその導電方向で阻止能力を回復するのに
時間がか又るものもあるが他のものはその導通状態を保
持するので正電圧が少数のサイリスタに加わりそれらは
破壊される。
時間がか又るものもあるが他のものはその導通状態を保
持するので正電圧が少数のサイリスタに加わりそれらは
破壊される。
同様のことは、全てのサイリスタが導通方向にその阻止
能力を回復する前に整流器に加わる正電圧が再び生ずる
のに時間を要するとき、導電期間後のインバータ動作に
おいて発生する。
能力を回復する前に整流器に加わる正電圧が再び生ずる
のに時間を要するとき、導電期間後のインバータ動作に
おいて発生する。
この観点からいわゆるサイリスタ用回復保護装置を配置
するのが普通であるが本発明による制御路はそのような
公知の回復保護装置を接続することが可能である。
するのが普通であるが本発明による制御路はそのような
公知の回復保護装置を接続することが可能である。
前記の条件のもとでは、本発明によれば通常の動作のと
きまたは保護方法としてのいづれでも所望されるときは
サイリスタが点弧パルスを受信し、しかもそのサイリス
タは所望の点弧が行われる結果となるときだげ点弧パル
スを受信することを確実にする。
きまたは保護方法としてのいづれでも所望されるときは
サイリスタが点弧パルスを受信し、しかもそのサイリス
タは所望の点弧が行われる結果となるときだげ点弧パル
スを受信することを確実にする。
これはＡＮＤ機能を実行することによって行われる。
こうした状況の主要部分は既に公知であり、そのうちの
いくつかに対し別個の解決方法が存在している。
いくつかに対し別個の解決方法が存在している。
しかし異った方法を同時に用いることは複雑になり、ま
た相互で相客れないことにもなる。
た相互で相客れないことにもなる。
本発明によれば異った事態も結合された制御回路におい
て同時に処理される。
て同時に処理される。
これによって問題を容易にし異る状態に同時に対処しう
る。
る。
その他の点については添付図面を参照して本発明の詳細
な説明する。
な説明する。
第１図は直列に接続された複数のサイリスタ１０ Ｉ
ｎを備えた高電圧用サイリスタ整流器を示している。
ｎを備えた高電圧用サイリスタ整流器を示している。
各サイリスタは制御装置１を備えいる。
この制御装置は米国特許第３７９４９０８号に従って設
計されており、共通制御パルス送信装置８からの制御信
号を受信する部分と対応するサイリスタの電圧が正でし
かもサイリスタの点弧が行われうるよ５に全サイリスク
の点弧回路が充電されていることを示す信号発生装置の
部分とを有する。
計されており、共通制御パルス送信装置８からの制御信
号を受信する部分と対応するサイリスタの電圧が正でし
かもサイリスタの点弧が行われうるよ５に全サイリスク
の点弧回路が充電されていることを示す信号発生装置の
部分とを有する。
即ち、制御装置１は例えば、共通制御パルス送信装置Ｂ
からの制御信号を受けるホトダイオードと光のパルスを
検出器２へ発射する発光ダイオードをもっている。
からの制御信号を受けるホトダイオードと光のパルスを
検出器２へ発射する発光ダイオードをもっている。
発光ダイオードはホトダイオードにかかる実際の制御信
号とは独立であり、制御装置内に含まれるコンデンサが
充分に充電されサイリスタの点弧のための準備を終える
までは光パルスを発射しない。
号とは独立であり、制御装置内に含まれるコンデンサが
充分に充電されサイリスタの点弧のための準備を終える
までは光パルスを発射しない。
１からの信号は光パルスの形で光導体９を通って検出器
２へ伝達され、検出器２はＯＲゲート３へ電気信号を発
生する。
２へ伝達され、検出器２はＯＲゲート３へ電気信号を発
生する。
３からの信号はフリップフロップ４へ伝達され、それを
スイッチオン（セット）する。
スイッチオン（セット）する。
このフリップフロップからの信号は遅延装置５を経てＡ
ＮＤゲート６へ伝達される。
ＮＤゲート６へ伝達される。
この遅延装置５によって、点弧パルスが発信される前に
それぞれのサイリスタに加わる電圧が所望の値に上昇し
てすべてのサイリスタが点弧されうる状態になることが
確実になる。
それぞれのサイリスタに加わる電圧が所望の値に上昇し
てすべてのサイリスタが点弧されうる状態になることが
確実になる。
ＯＲゲート２０がＡＮＤゲート６の第２人力に接続され
ており、このＯＲゲート２０を介してＡＮＤゲート６の
第２人力に２つの装置２Ｌ２２が接続されている。
ており、このＯＲゲート２０を介してＡＮＤゲート６の
第２人力に２つの装置２Ｌ２２が接続されている。
装置２１はサイリスタ整流器用の即ちサイリスタ整流器
を含む静止形変換器用の通常の制御装置である。
を含む静止形変換器用の通常の制御装置である。
このような制御装置は例えば米国特許第３５５１７７８
号に従って設計できる。
号に従って設計できる。
即ち、装置２１は各交流周期において、所定の制御角で
始まり、例えば１２００後に終わる制御パルスを発射す
るものである。
始まり、例えば１２００後に終わる制御パルスを発射す
るものである。
モラ一つの装置２２はいわゆるサイリスタ整流器用回復
保護装置で例えば米国特許第 ３８６５４３８号による。
保護装置で例えば米国特許第 ３８６５４３８号による。
即ち導電期間後にサイリスタ整流器両端間に正電圧が生
じる前に全てのサイリスタがその全阻止能力を回復して
いないとき新らたな点弧命令を発する保護装置である。
じる前に全てのサイリスタがその全阻止能力を回復して
いないとき新らたな点弧命令を発する保護装置である。
即ち、装置２２は、撹乱により整流電圧に異状が生ずる
とＯＲゲート２０に信号を出す。
とＯＲゲート２０に信号を出す。
全部のサイリスタが点弧している場合には、フリップフ
ロップ４は、リセットされ出力は「０」である。
ロップ４は、リセットされ出力は「０」である。
従ってＡＮＤゲート６からの出力も「０」となり、全部
のサイリスタが導通している限り、装置２１及び２２か
らの信号の有無に関係はない。
のサイリスタが導通している限り、装置２１及び２２か
らの信号の有無に関係はない。
しかし、１個あるいはそれ以上のサイリスタが非導通の
場合には、非導通のサイリスタの制御装置１が信号を発
射しフリップフロップ４をセットしてその出力を「１」
にする。
場合には、非導通のサイリスタの制御装置１が信号を発
射しフリップフロップ４をセットしてその出力を「１」
にする。
従って、装置２１または２２からの信号がＡＮＤゲート
６にきている時はＡＮＤゲート６の出力は「１」になり
、送信装置８は全部のサイリスタに対して点弧パルスを
発射し、またフリップフロップ４は「０」にリセットさ
れる 装置２１及び２２の動作は、サイリスタ整流器のうちの
いくつかのサイリスタか導通か非導通かには本質的に無
関係である。
６にきている時はＡＮＤゲート６の出力は「１」になり
、送信装置８は全部のサイリスタに対して点弧パルスを
発射し、またフリップフロップ４は「０」にリセットさ
れる 装置２１及び２２の動作は、サイリスタ整流器のうちの
いくつかのサイリスタか導通か非導通かには本質的に無
関係である。
サイリスタ整流器の両端に電圧があり、また装置２１又
は２２あるいはこれら両方から信号があり、そして全サ
イリスタのうちの１個又はそれ以上が非導通であれば、
これらのサイリスタの制御装置１は信号を発射し、その
信号は検出器２、ＯＲゲート３、フリップフロップ４、
ＡＮＤゲート６、パルス発生装置７からの送信装置８へ
送られる。
は２２あるいはこれら両方から信号があり、そして全サ
イリスタのうちの１個又はそれ以上が非導通であれば、
これらのサイリスタの制御装置１は信号を発射し、その
信号は検出器２、ＯＲゲート３、フリップフロップ４、
ＡＮＤゲート６、パルス発生装置７からの送信装置８へ
送られる。
送信装置８は、そこで点弧パルスを全部のサイリスタに
発射する。
発射する。
ＡＮＤゲート６からの信号はパルス発生装置またはパル
ス形成装置７に伝達される。
ス形成装置７に伝達される。
このパルス形成装置はサイリスタを安全に点弧するのと
素子の疲労を最少にするに適した長さと周波数の点弧パ
ルスを送信装置８へ発生する。
素子の疲労を最少にするに適した長さと周波数の点弧パ
ルスを送信装置８へ発生する。
送信装置８は光ダイオード（図示していない）から光パ
ルスを送出する。
ルスを送出する。
この光パルスは光導体２３を介してサイリスタ１Ｏ−１
ｎの点弧用制御装置１へ伝達される。
ｎの点弧用制御装置１へ伝達される。
パルス発生装置７からのパルスはフリップフロップ４の
他の入力へ送られ、これをスイッチオフ（リセット）し
、サイリスタが点弧した後６，７゜８は阻止される。
他の入力へ送られ、これをスイッチオフ（リセット）し
、サイリスタが点弧した後６，７゜８は阻止される。
パルス発生装置７から点弧パルスが発生されるとフリッ
プフロップ４は常にスイッチオンされる。
プフロップ４は常にスイッチオンされる。
全てのサイリスタが点弧してしまうと、いずれの制御装
置１からも指示信号は発生されず、フリップフロップ４
はリセット状態を維持する。
置１からも指示信号は発生されず、フリップフロップ４
はリセット状態を維持する。
しかしいくつかのサイリスタが点弧しないと、これらサ
イリスタ端子間には正電圧が印加されたままとなり、こ
れらサイリスタの制御装置１は指示信号を発生し、２，
３を介してフリップフロップ４を再びスイッチオンする
。
イリスタ端子間には正電圧が印加されたままとなり、こ
れらサイリスタの制御装置１は指示信号を発生し、２，
３を介してフリップフロップ４を再びスイッチオンする
。
この結果新しい点弧信号がパルス発生装置７から発生さ
れ、そしてフリップフロップ４は再びスイッチオンされ
る。
れ、そしてフリップフロップ４は再びスイッチオンされ
る。
前に述べたようにもし例えば低負荷のときのように通常
の導電期間に電流、電圧の変動によってサイリスタ整流
器がその動作を停止すると同じ事が起る。
の導電期間に電流、電圧の変動によってサイリスタ整流
器がその動作を停止すると同じ事が起る。
この場合、点弧命令の発生は２１がら続げられ、サイリ
スタ整流器に加わる電圧が再び上昇してフリップフロッ
プ４が付勢されることになり、新しい制御パルスが５〜
８を介して発生される このように本発明によればもしサイリスタ端子間の電圧
が導電方向に正であれば、点弧パルスは通常の動作の間
同じシステムで得られる。
スタ整流器に加わる電圧が再び上昇してフリップフロッ
プ４が付勢されることになり、新しい制御パルスが５〜
８を介して発生される このように本発明によればもしサイリスタ端子間の電圧
が導電方向に正であれば、点弧パルスは通常の動作の間
同じシステムで得られる。
そしてもし整ＩＮ、器が通常の導電時にその動作を停止
するすると再点弧される。
するすると再点弧される。
これに加えて、もしサイリスタが正電圧が生ずる前に回
復するのに時間を要しないとすると導電期間の後再び点
弧される。
復するのに時間を要しないとすると導電期間の後再び点
弧される。
第２図は制御装置１用の信号発信器のより簡単な構成を
示しており、サイリスタ１Ｏ−１ｎの１つと並列に、抵
抗２５と直列に接続された光ダイオード２４で簡単に構
成されている。
示しており、サイリスタ１Ｏ−１ｎの１つと並列に、抵
抗２５と直列に接続された光ダイオード２４で簡単に構
成されている。
光ダイオード２４と逆並列に接続されたダイオードは阻
ｔｌ＝、方向電圧から光ダイオードを保護する。
ｔｌ＝、方向電圧から光ダイオードを保護する。
第１図は本発明による制御回路を有するサイリスタ整流
器を示す図である。 第２図はこのような制御回路における信号発生装置の変
形例を示す図である。 １・・・・・・制御装置、２・・・・・・検出器、３・
・・・・・ＯＲゲート、４・・・・・・フリップフロッ
プ、５・・・・・・遅延装置、６・・・・・・ＡＮＤゲ
ート、７・・・・・・パルス形成器、８・・・・・・制
御パルス送信装置、９・・・・・・光導体、１〇−１ｎ
・・・・・・サイリスタ、２０・・・・・・ＯＲゲート
、２１・・・・・・制御装置、２２・・・・・・回復保
護装置、２４・・・・・・光ダイオード、２５・・・・
・・抵抗。
器を示す図である。 第２図はこのような制御回路における信号発生装置の変
形例を示す図である。 １・・・・・・制御装置、２・・・・・・検出器、３・
・・・・・ＯＲゲート、４・・・・・・フリップフロッ
プ、５・・・・・・遅延装置、６・・・・・・ＡＮＤゲ
ート、７・・・・・・パルス形成器、８・・・・・・制
御パルス送信装置、９・・・・・・光導体、１〇−１ｎ
・・・・・・サイリスタ、２０・・・・・・ＯＲゲート
、２１・・・・・・制御装置、２２・・・・・・回復保
護装置、２４・・・・・・光ダイオード、２５・・・・
・・抵抗。
Claims (1)
- 【特許請求の範囲】 １ 高圧用サイリスタ整流器のための制御回路であって
、 前記高圧用サイリスタ整流器は直列に接続された複数の
サイリスタ１Ｏ−１ｎを含み、各サイリスタは制御装置
１を備え、前記制御装置１は前記制御回路内の制御パル
ス送信装置８からの制御信号に応答してそれぞれのサイ
リスタに点弧電流パルスを与えると共に該サイリスタの
導通方向の電圧が一定の値に達すると指示信号を発する
信号発生装置を備え、一方前記制御回路はサイリスク整
流器全体のための通常の点弧信号及び阻止能力を回復し
ていないときの点弧信号が入力される入力回路２０を備
えているものにおいて、 前記信号発生装置はＯＲゲート３に接続され、該ＯＲゲ
ートの出力は双安定回路４を介してＡＮＤゲート６の第
１人力に接続され、該ＡＮＤゲート６の第２人力には前
記入力回路２０が接続され、前記ＡＮＤゲート６の出力
は前記制御パルス送信装置８０入力と前記双安定回路４
のリセット入力に接続されていることを特徴とする高圧
用サイリスタ整流器のための制御回路。
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| SE08150/72A SE364412B (ja) | 1972-06-21 | 1972-06-21 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS4958743A JPS4958743A (ja) | 1974-06-07 |
| JPS5843993B2 true JPS5843993B2 (ja) | 1983-09-30 |
Family
ID=20273275
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP48069135A Expired JPS5843993B2 (ja) | 1972-06-21 | 1973-06-19 | 高圧用サイリスタ整流器のための制御回路 |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US3878448A (ja) |
| JP (1) | JPS5843993B2 (ja) |
| CA (1) | CA983576A (ja) |
| CH (1) | CH556617A (ja) |
| DE (1) | DE2328771B2 (ja) |
| FR (1) | FR2189922B1 (ja) |
| GB (1) | GB1425890A (ja) |
| SE (1) | SE364412B (ja) |
| SU (1) | SU963482A3 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0230069Y2 (ja) * | 1984-09-11 | 1990-08-13 |
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1972
- 1972-06-21 SE SE08150/72A patent/SE364412B/xx unknown
-
1973
- 1973-06-05 US US367100A patent/US3878448A/en not_active Expired - Lifetime
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0230069Y2 (ja) * | 1984-09-11 | 1990-08-13 |
Also Published As
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| FR2189922B1 (ja) | 1980-07-18 |
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