JPS58223989A - ダビングスイツチ付ｖｔｒ - Google Patents
ダビングスイツチ付ｖｔｒInfo
- Publication number
- JPS58223989A JPS58223989A JP57106904A JP10690482A JPS58223989A JP S58223989 A JPS58223989 A JP S58223989A JP 57106904 A JP57106904 A JP 57106904A JP 10690482 A JP10690482 A JP 10690482A JP S58223989 A JPS58223989 A JP S58223989A
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- JP
- Japan
- Prior art keywords
- switch
- signal
- dubbing
- chroma
- luminance signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/87—Regeneration of colour television signals
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/02—Editing, e.g. varying the order of information signals recorded on, or reproduced from, record carriers
- G11B27/022—Electronic editing of analogue information signals, e.g. audio or video signals
- G11B27/024—Electronic editing of analogue information signals, e.g. audio or video signals on tapes
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、２Ｈ（ここで１Ｈとは１水平期間を指す）遅
延線を用いたくし形フィルタを有するＶＴＲ（たとえば
ＰＡＬ用ＶＴＲ，）において、ダビング時に輝度信号と
りａマ信号の時間ずれを防止するためのダビングスイッ
チに関するものである。
延線を用いたくし形フィルタを有するＶＴＲ（たとえば
ＰＡＬ用ＶＴＲ，）において、ダビング時に輝度信号と
りａマ信号の時間ずれを防止するためのダビングスイッ
チに関するものである。
第１図は家庭用（たとえげＶＨ８方式） ＶＴＲのＰＡ
Ｌ信号再生回路の従来例を示したもので、ヘッド１，２
からの再生信号はノリアンズ３．４に加わり、ヘット切
換パルス（ＮＴ８ Ｃ３０Ｈｚ ； ＰＡＬ２５Ｈｚ）
により切換えられるスイッチ回路５によって連続信号と
なり、一部はノ１イバスフィルタ６（以下野と略す）を
通って用輝度信号ａに、一部はローパスフィルタ７（以
下ＬＰＦと略す）を通ってクロマ信号（ＶＢ２では６２
ｙＫＨｚ ）ｂとなる一覧輝度信号ａはピーキング回
路８により白キャリア（ＶＢ２では４−４ＭＨｚ ）付
近をピーキングされた後、スイッチ９，１Ｈ遅延線（Ｉ
Ｈは１水平期間）１０からなるへドロッグアウト補償回
路１１（以下Ａ庶と略す）、復調器１２を通って輝度信
号ｆとなる。スイッチ９の制御はドロラグアウト検出回
路１００により行なわれる。一方ＬＰＦ ７を通りたり
ａマ信号すは、高域変換回路１３９発振器１４により４
．４３■口のクロマ信号Ｃとなった後、２Ｈ遅延線１５
と減算回路１６からなるくし形フィルタ１７を通りこれ
により、テープ上の隣接トラックからの影響が軽減され
たクロマ信号ｅとなる。クロマ信号ｅは、輝度信号ｆと
混合回路１８にて混合され、ビデオ信号Ｖとなる。第２
図は輝度信号１９とクロマ信号２０の時間関係を示した
もので、（１）は第１図における輝度信号ｆとクロマ信
号Ｃとの時間関係（２）は輝度信号ｆと２Ｈ遅延したク
ロマ信号ｄとの時間関係、（３）は輝度信号ｆと、くし
形フィルタ１７の出力であるクロマ信号ｅとの時間関係
を示したものである。（１）においてクロマ信号の重心
（左右対称点）はＣ２とＣ５の間２１にあり、これに対
応する輝度信号の位置はＹ３とＹ４の間である。
Ｌ信号再生回路の従来例を示したもので、ヘッド１，２
からの再生信号はノリアンズ３．４に加わり、ヘット切
換パルス（ＮＴ８ Ｃ３０Ｈｚ ； ＰＡＬ２５Ｈｚ）
により切換えられるスイッチ回路５によって連続信号と
なり、一部はノ１イバスフィルタ６（以下野と略す）を
通って用輝度信号ａに、一部はローパスフィルタ７（以
下ＬＰＦと略す）を通ってクロマ信号（ＶＢ２では６２
ｙＫＨｚ ）ｂとなる一覧輝度信号ａはピーキング回
路８により白キャリア（ＶＢ２では４−４ＭＨｚ ）付
近をピーキングされた後、スイッチ９，１Ｈ遅延線（Ｉ
Ｈは１水平期間）１０からなるへドロッグアウト補償回
路１１（以下Ａ庶と略す）、復調器１２を通って輝度信
号ｆとなる。スイッチ９の制御はドロラグアウト検出回
路１００により行なわれる。一方ＬＰＦ ７を通りたり
ａマ信号すは、高域変換回路１３９発振器１４により４
．４３■口のクロマ信号Ｃとなった後、２Ｈ遅延線１５
と減算回路１６からなるくし形フィルタ１７を通りこれ
により、テープ上の隣接トラックからの影響が軽減され
たクロマ信号ｅとなる。クロマ信号ｅは、輝度信号ｆと
混合回路１８にて混合され、ビデオ信号Ｖとなる。第２
図は輝度信号１９とクロマ信号２０の時間関係を示した
もので、（１）は第１図における輝度信号ｆとクロマ信
号Ｃとの時間関係（２）は輝度信号ｆと２Ｈ遅延したク
ロマ信号ｄとの時間関係、（３）は輝度信号ｆと、くし
形フィルタ１７の出力であるクロマ信号ｅとの時間関係
を示したものである。（１）においてクロマ信号の重心
（左右対称点）はＣ２とＣ５の間２１にあり、これに対
応する輝度信号の位置はＹ３とＹ４の間である。
ところが（３）においては、クロマ信号の重心は輝、
度信号の￥４とＹ５の間２２に位置し、（１）と比べる
と４、 ＩＨ時間的に後にずれている。これは
ＴＶ画面上で画えはＶＴＲに記録再生を１回行なうこと
Ｋより、輝度信号に対してクロマ信号が１Ｈ下忙ずれる
ことに相当する。特Ｋ ＶＴＲにおいてダビングを繰返
し行なうと１回毎に１Ｈずつクロマ重心が下にずれるた
め画質劣化が極めて大きい。
度信号の￥４とＹ５の間２２に位置し、（１）と比べる
と４、 ＩＨ時間的に後にずれている。これは
ＴＶ画面上で画えはＶＴＲに記録再生を１回行なうこと
Ｋより、輝度信号に対してクロマ信号が１Ｈ下忙ずれる
ことに相当する。特Ｋ ＶＴＲにおいてダビングを繰返
し行なうと１回毎に１Ｈずつクロマ重心が下にずれるた
め画質劣化が極めて大きい。
本発明の目的は、ＰＡＬ用ＶＴＲＩｃおいて、ダビング
時に輝度信号とクロマ信号の時間ずれを防ぐためのダビ
ングスイッチを設けることにある。
時に輝度信号とクロマ信号の時間ずれを防ぐためのダビ
ングスイッチを設けることにある。
上記目的を達成するために本発明では、ダビング時に、
ダビングスイッチを動作させることＫより輝度信号のみ
を１Ｈ遅延させることを特徴としている。またビデオド
ロラグアウト補償回路（以下ビデオ、１）ＱＣと略す）
と共に構成できることも特徴としている。
ダビングスイッチを動作させることＫより輝度信号のみ
を１Ｈ遅延させることを特徴としている。またビデオド
ロラグアウト補償回路（以下ビデオ、１）ＱＣと略す）
と共に構成できることも特徴としている。
以下本発明を具体的実施例に基き詳しく説明する＝第３
図は本発明の第一の実施例で、第１図の従来例と異なる
のは、 ＋１１ ＨＰＦ６を通った信号、を発振器２３、高域
変換器２４により高域変換している。
図は本発明の第一の実施例で、第１図の従来例と異なる
のは、 ＋１１ ＨＰＦ６を通った信号、を発振器２３、高域
変換器２４により高域変換している。
（２） ピーキング回路２５、スイッチ２６を通った
ｉ後、信号を２分し、一方を復調器２８により復
調し、他方を１Ｈ遅延線２７を通した後復調器２９によ
り復調している。
ｉ後、信号を２分し、一方を復調器２８により復
調し、他方を１Ｈ遅延線２７を通した後復調器２９によ
り復調している。
などの点である。復調器２日の復調信号を人、復調器２
９の復調信号なりとすると、ＢはＡに対して１Ｈ遅れた
ものとなりている。へ輝度信号ａを高域変換する理由の
１つは、 ＩＨ遅延線２７として低コストなガラス遅
ｇ線を用い、かつ高帯域化し劣化の少ない１Ｈ遅延信号
Ｂを得ることにある。スイッチ２６と１Ｈ遅延線２７は
ＦＭ 、ＤＯＣを構成している。同時Ｋ ＩＨ遅延線２
７、復調器２８、２９、スイッチ３０はビデオ庶をも構
成している。すなわち通常時はスイッチ３ｏの出力はＡ
であり、ドロップアウト時はＩＨ遅延されたＢとなる。
９の復調信号なりとすると、ＢはＡに対して１Ｈ遅れた
ものとなりている。へ輝度信号ａを高域変換する理由の
１つは、 ＩＨ遅延線２７として低コストなガラス遅
ｇ線を用い、かつ高帯域化し劣化の少ない１Ｈ遅延信号
Ｂを得ることにある。スイッチ２６と１Ｈ遅延線２７は
ＦＭ 、ＤＯＣを構成している。同時Ｋ ＩＨ遅延線２
７、復調器２８、２９、スイッチ３０はビデオ庶をも構
成している。すなわち通常時はスイッチ３ｏの出力はＡ
であり、ドロップアウト時はＩＨ遅延されたＢとなる。
ドロラグアウト検出は、ドロラグアウト検出回路１００
により行なわれ、スイッチ２６を制御し、またパルスデ
ィレィ回路１０１で整形した後スイッチ６０をも制御す
る。ビデオ■疋は苗。
により行なわれ、スイッチ２６を制御し、またパルスデ
ィレィ回路１０１で整形した後スイッチ６０をも制御す
る。ビデオ■疋は苗。
庶より一般に性能がすぐれている。本発明の第一の実施
例では、ビデオＤ（ＪＣがある場合でもＦＭ、Ｉ）ＱＣ
は１Ｈ以上の長いドロップアウト補償時に必要である。
例では、ビデオＤ（ＪＣがある場合でもＦＭ、Ｉ）ＱＣ
は１Ｈ以上の長いドロップアウト補償時に必要である。
本発明のポイントは、ビデオ庶用スイッチ３０を、別に
設けたダビングスイッチ３１（たとえばＶＴＲの操作ス
イッチの１つ）で制御することにある。すなわち通常角
生時はダビングスイッチ３１はオフとし、スイッチ３０
は通常のビデオ］）ＱＣスイッチとして動作する。ダビ
ング時ヲマダビングスイッチ６１をオンとすることによ
り、スイッチ６０はドロップアウトの有無に関係なく１
Ｈ遅延信号Ｂを出力する。このときのドロラグアウト補
償は、ＦＭ、 ＤＯＧにより行なう。ダビングスイッチ
５１をオンさせた時の輝度信号１９とクロマ信号２０の
時間関係を第２図＋４１ Ｋ示す。クロマ信号２０は、
原信号（第２図（１））に比べ左右に広がっているが、
クロマ重心位置３２はＹ３とＹ４の間にあり変化しない
。すなわち本発明で＆まダビング時の輝度信号４対する
クロマ信号のずれはテレビ画面上、上下に均等に生じ、
従来のように下方向のみに生じることがなく画質劣化を
防ぐ意味で極めて効果的である。
設けたダビングスイッチ３１（たとえばＶＴＲの操作ス
イッチの１つ）で制御することにある。すなわち通常角
生時はダビングスイッチ３１はオフとし、スイッチ３０
は通常のビデオ］）ＱＣスイッチとして動作する。ダビ
ング時ヲマダビングスイッチ６１をオンとすることによ
り、スイッチ６０はドロップアウトの有無に関係なく１
Ｈ遅延信号Ｂを出力する。このときのドロラグアウト補
償は、ＦＭ、 ＤＯＧにより行なう。ダビングスイッチ
５１をオンさせた時の輝度信号１９とクロマ信号２０の
時間関係を第２図＋４１ Ｋ示す。クロマ信号２０は、
原信号（第２図（１））に比べ左右に広がっているが、
クロマ重心位置３２はＹ３とＹ４の間にあり変化しない
。すなわち本発明で＆まダビング時の輝度信号４対する
クロマ信号のずれはテレビ画面上、上下に均等に生じ、
従来のように下方向のみに生じることがなく画質劣化を
防ぐ意味で極めて効果的である。
なお本発明では、ピーキング回路２５として高周波（た
とえば１０〜２０Ｍ（ｚ 程度）に適した弾性表面波フ
ィルタ（以下ＳＡＷフィルタと略す）を使５ことができ
るのも特長の一つである。ＳＡＷフィルタでは帯域内の
群遅延特性をほぼ平担に保ったままで所望のピーキング
特性を得ることが出来る。またＨＰＦ ６をＳＡＷフィ
ルタに取り込むことも可能である。
とえば１０〜２０Ｍ（ｚ 程度）に適した弾性表面波フ
ィルタ（以下ＳＡＷフィルタと略す）を使５ことができ
るのも特長の一つである。ＳＡＷフィルタでは帯域内の
群遅延特性をほぼ平担に保ったままで所望のピーキング
特性を得ることが出来る。またＨＰＦ ６をＳＡＷフィ
ルタに取り込むことも可能である。
またピーキング回路２５をＨＰＦ６と高域変換回路２４
の間に設置する構成も可能である。
の間に設置する構成も可能である。
第４図は第３図に示した本発明の第一の実施例の中で、
スイッチ３０およびダビングスイッチ３１の一構成例を
示したものである。Ｑ１〜Ｑ６はビデオＤＯＣ用スイッ
チ２ｏ１． Ｑ７〜Ｑ１０はコンパレータ２０２を構成
している。以下動作を述べる。ダビングスイッチ３１が
オフ（ロウレベル）のとき、Ｑ１０はオフであり、この
時の■、の電位＋、 ｖ ＶＡｈ−ｊ６．ＦＭＭ
ＩＫｍ＋ｊ ｇ ｋｔ＠Ｈ＠ｕ ｔａｓ Ｋ ！す、振
幅レベルに応じた直流電位に変換される。
スイッチ３０およびダビングスイッチ３１の一構成例を
示したものである。Ｑ１〜Ｑ６はビデオＤＯＣ用スイッ
チ２ｏ１． Ｑ７〜Ｑ１０はコンパレータ２０２を構成
している。以下動作を述べる。ダビングスイッチ３１が
オフ（ロウレベル）のとき、Ｑ１０はオフであり、この
時の■、の電位＋、 ｖ ＶＡｈ−ｊ６．ＦＭＭ
ＩＫｍ＋ｊ ｇ ｋｔ＠Ｈ＠ｕ ｔａｓ Ｋ ！す、振
幅レベルに応じた直流電位に変換される。
今ドロップアウトでない時、Ｖ、 ＜ＶＡとなるように
検波回路２０６を設定したとすると、この時、Ｑ７；ｔ
７、Ｑ８ 、！ｌ−７、従ッテＶｓ ＞ Ｖａ ドア’
ｊす、Ｑ５４ン、Ｑ６オフとなりて出力２０４ Ｋは、
復調信号人が得られる。ドロップアウト時にはＶ、）Ｖ
Ａとなるように検波回路２０３を設定すれば、この時は
逆に出力２０４には１Ｈ遅延復調信号Ｂが得られる。
検波回路２０６を設定したとすると、この時、Ｑ７；ｔ
７、Ｑ８ 、！ｌ−７、従ッテＶｓ ＞ Ｖａ ドア’
ｊす、Ｑ５４ン、Ｑ６オフとなりて出力２０４ Ｋは、
復調信号人が得られる。ドロップアウト時にはＶ、）Ｖ
Ａとなるように検波回路２０３を設定すれば、この時は
逆に出力２０４には１Ｈ遅延復調信号Ｂが得られる。
以上が通常再生時におけるビデオＤＯＣとしての動作で
ある。
ある。
ダビング時には、ダビングスイッチ３１をオン（ハイレ
ベル）とし、Ｑ１０をオンさせる。このときのＶ２の電
位をＶＢとし、ドロップアウトの有無にかかわらずＶ、
＞ＶＢとなるように抵抗２０５゜２０６を選ぶものとす
る。この場合にはドロップアウトには関係なく出力２０
４には１Ｈ遅延彷調信号Ｂが得られる。
ベル）とし、Ｑ１０をオンさせる。このときのＶ２の電
位をＶＢとし、ドロップアウトの有無にかかわらずＶ、
＞ＶＢとなるように抵抗２０５゜２０６を選ぶものとす
る。この場合にはドロップアウトには関係なく出力２０
４には１Ｈ遅延彷調信号Ｂが得られる。
第５図は本発明の第２の実施例で、第３図の実施例と異
なる点は、ＩＨ遅延線３４が復調器１２の後に位置する
ことである。復調器１２により復 。
なる点は、ＩＨ遅延線３４が復調器１２の後に位置する
ことである。復調器１２により復 。
調された信号はスイッチ３３を通った後２分され、一方
はスイッチ３５、他方は１Ｈ遅延線３４を通った後スイ
ッチ３５に入力される。スイッチ３３の出力を輝度信号
Ａ、１Ｈ遅延線３４の出力を１Ｈ遅延輝度信号Ｂとする
とスイッチ３５はＡとＢを切換える役目を果す。スイッ
チ３３と１Ｈ遅延線５４はフィードバック型のビデオド
ロップアウト補償回路を構成している。なお１Ｈ遅延線
３４としては復調信号を直接遅延できるＣＣＤなどが考
えられる。本発明のポイントは、ダビング時にダビング
スイッチ３１をＯＮさせることにより、スイッチ３５を
１Ｈ遅延輝度信号Ｂを出力するよう忙設定することにあ
る。通常時はスイッチ５５は輝度信号Ａを出力する。ダ
ビングスイッチ３１はたとえばフロントパネルにダビン
グボタンの形で設ける、あるいはダビング端子材ＶＴＲ
ではダビング端子にコードを接続することにより切換わ
る形などが考えられる。
はスイッチ３５、他方は１Ｈ遅延線３４を通った後スイ
ッチ３５に入力される。スイッチ３３の出力を輝度信号
Ａ、１Ｈ遅延線３４の出力を１Ｈ遅延輝度信号Ｂとする
とスイッチ３５はＡとＢを切換える役目を果す。スイッ
チ３３と１Ｈ遅延線５４はフィードバック型のビデオド
ロップアウト補償回路を構成している。なお１Ｈ遅延線
３４としては復調信号を直接遅延できるＣＣＤなどが考
えられる。本発明のポイントは、ダビング時にダビング
スイッチ３１をＯＮさせることにより、スイッチ３５を
１Ｈ遅延輝度信号Ｂを出力するよう忙設定することにあ
る。通常時はスイッチ５５は輝度信号Ａを出力する。ダ
ビングスイッチ３１はたとえばフロントパネルにダビン
グボタンの形で設ける、あるいはダビング端子材ＶＴＲ
ではダビング端子にコードを接続することにより切換わ
る形などが考えられる。
第６図は本発明の第３の実施例で、第２の実施例と異な
る点は、輝度信号Ａを発振器３６、変調器３７により一
旦高周波信号とし１Ｈ遅延線５８、復調器３９により１
Ｈ遅延輝度信号Ｂを得ている点である。この場合１Ｈ遅
延線３８としてＣＣＤなどより安価なガラス遅延線を用
いることができるメリットがある。その他は第３図に示
した本発明の第１の実施例と同じであり、同様の効果が
期待できる。
る点は、輝度信号Ａを発振器３６、変調器３７により一
旦高周波信号とし１Ｈ遅延線５８、復調器３９により１
Ｈ遅延輝度信号Ｂを得ている点である。この場合１Ｈ遅
延線３８としてＣＣＤなどより安価なガラス遅延線を用
いることができるメリットがある。その他は第３図に示
した本発明の第１の実施例と同じであり、同様の効果が
期待できる。
第７図は本発明の第４の実施例で、第２の実施例と異な
る点は、輝度信号ＡをＡ変調器４０．１Ｈ遅延線４１、
珈調器４２により１Ｈ遅延輝度信号Ｂを得ている点であ
る。この場合も第２の実施例と同様な効果が期待できる
。
る点は、輝度信号ＡをＡ変調器４０．１Ｈ遅延線４１、
珈調器４２により１Ｈ遅延輝度信号Ｂを得ている点であ
る。この場合も第２の実施例と同様な効果が期待できる
。
以上述べたように本発明では、ダビング時にダビングス
イッチを動作させることにより輝度信号のみを１Ｈ遅延
させ、クロマ信号との時間ずれを防止するというすぐれ
た効果を有する。また本発明はコスト増加がほとんどな
い形でビデオ回と共に構成できるという極めて大群よ特
長も有している。
イッチを動作させることにより輝度信号のみを１Ｈ遅延
させ、クロマ信号との時間ずれを防止するというすぐれ
た効果を有する。また本発明はコスト増加がほとんどな
い形でビデオ回と共に構成できるという極めて大群よ特
長も有している。
第１図は臂几の再生回路の従来例を示す図。
第２図は従来回路および本発明忙おける輝度信号とクロ
マ信号の時間関係を示す図、第３図は本発明の実施例図
、第４図は第３図の実施例の主要部であるビデオＤＯＣ
スイッチとダビングスイッチの説明図、第５〜７図は本
発明の他の実施例を示す図である。 ２３・・・発撮器 ２４・・・高域変換回路２
５・・・ピーキング回路 １５・・・２Ｈ遅延線２７・
・・ＩＨ遅延線 ２８．２９・・・復調器５０・
・・スイッチ ３１・・・ダビングスイッチ才
＋ 図 ２．ｙ 図
マ信号の時間関係を示す図、第３図は本発明の実施例図
、第４図は第３図の実施例の主要部であるビデオＤＯＣ
スイッチとダビングスイッチの説明図、第５〜７図は本
発明の他の実施例を示す図である。 ２３・・・発撮器 ２４・・・高域変換回路２
５・・・ピーキング回路 １５・・・２Ｈ遅延線２７・
・・ＩＨ遅延線 ２８．２９・・・復調器５０・
・・スイッチ ３１・・・ダビングスイッチ才
＋ 図 ２．ｙ 図
Claims (1)
- １．２Ｈ遅延線を用いたクロマくし形フィルタを有スる
■１において、ダビング時に輝度信号のみを１Ｈ遅延さ
せるためのダビングスイッチを設けたことを特徴とする
ダビングスイッチ付ＶＴＲ。 ２、 ドロラスアウト検出回路と、メイン信号およびメ
イン信号を１Ｈ遅延した信号を切換えるための切換スイ
ッチとを少くとも有し、上記ダビングスイッチを作動さ
せることによりダビング期間は常ＫＩＨ遅延信号を出力
するように該切換スイッチを制御することを特徴とする
特許請求の範囲第一項記載のダビングスイッチ付ＶＴＲ
０
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57106904A JPS58223989A (ja) | 1982-06-23 | 1982-06-23 | ダビングスイツチ付ｖｔｒ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57106904A JPS58223989A (ja) | 1982-06-23 | 1982-06-23 | ダビングスイツチ付ｖｔｒ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58223989A true JPS58223989A (ja) | 1983-12-26 |
Family
ID=14445438
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57106904A Pending JPS58223989A (ja) | 1982-06-23 | 1982-06-23 | ダビングスイツチ付ｖｔｒ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58223989A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6424590A (en) * | 1987-07-20 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Video signal reproducting device |
| JPS6451781A (en) * | 1987-08-21 | 1989-02-28 | Matsushita Electric Ind Co Ltd | Video signal recorder |
-
1982
- 1982-06-23 JP JP57106904A patent/JPS58223989A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6424590A (en) * | 1987-07-20 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Video signal reproducting device |
| JPS6451781A (en) * | 1987-08-21 | 1989-02-28 | Matsushita Electric Ind Co Ltd | Video signal recorder |
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