JPS5821360Y2 - インバ−タ回路 - Google Patents
インバ−タ回路Info
- Publication number
- JPS5821360Y2 JPS5821360Y2 JP13423678U JP13423678U JPS5821360Y2 JP S5821360 Y2 JPS5821360 Y2 JP S5821360Y2 JP 13423678 U JP13423678 U JP 13423678U JP 13423678 U JP13423678 U JP 13423678U JP S5821360 Y2 JPS5821360 Y2 JP S5821360Y2
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- inductance
- capacitor
- inductance element
- inverter circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【考案の詳細な説明】
本考案はインバータトランスを備えたインバータ回路に
関する。
関する。
例えば従来の並列共振プッシュプルインバータは第１図
に示す如く構成され、トランジスタＴＲ１゜ＴＲ２を互
いに逆のオンオフ動作をくりかえさせることにより、イ
ンバータトランスＴの１次巻線ＮＰ側の直流電源Ｅを２
次巻線ＮＳの両端子間に接続した負荷りに交流電圧とし
て供給するようにしているのが二股であるが、回路を第
２図に示す如く構成することにより、トランジスタＴＲ
１＊ＴＲ２に印加される電圧を半減させて、低い耐圧の
トランジスタを使用可能とし、安価でしかもその高周波
特性が良好となるようにしたインバータ回路が既に考案
されている。
に示す如く構成され、トランジスタＴＲ１゜ＴＲ２を互
いに逆のオンオフ動作をくりかえさせることにより、イ
ンバータトランスＴの１次巻線ＮＰ側の直流電源Ｅを２
次巻線ＮＳの両端子間に接続した負荷りに交流電圧とし
て供給するようにしているのが二股であるが、回路を第
２図に示す如く構成することにより、トランジスタＴＲ
１＊ＴＲ２に印加される電圧を半減させて、低い耐圧の
トランジスタを使用可能とし、安価でしかもその高周波
特性が良好となるようにしたインバータ回路が既に考案
されている。
即ち、第２図に釦いて、直流電源Ｅの両端に同一容量の
コンデンサＣ１，Ｃ２が直列接続され、コンデンサＣ１
ｓ Ｃ２の各両端には、インバータトランスＴの一次巻
線を二分割した各一方の分割巻線ＮＰ１．ＮＰ２と、エ
ミッタ、コレクタを介して接続される各三方のトランジ
スタＴＲ１，ＴＲ２と、互いに磁気結合された各一方の
インダクタンス素子ＣＨ１，ＣＨ２との直列回路が夫々
接続されている。
コンデンサＣ１，Ｃ２が直列接続され、コンデンサＣ１
ｓ Ｃ２の各両端には、インバータトランスＴの一次巻
線を二分割した各一方の分割巻線ＮＰ１．ＮＰ２と、エ
ミッタ、コレクタを介して接続される各三方のトランジ
スタＴＲ１，ＴＲ２と、互いに磁気結合された各一方の
インダクタンス素子ＣＨ１，ＣＨ２との直列回路が夫々
接続されている。
従って、コンデンサＣ，，Ｃ２により直流電源Ｅを１／
２の電圧に分圧すると共に、インダクタンス素子をイン
ダクタンス素子ＣＨ１，ＣＨ２に二分割しているので、
分割巻線ＮＰ□ 、Ｎ１３に印加される電圧が１／２と
なり、その結果各トランジスタＴＲ１゜ＴＲ２のコレク
タ、エミッタ間に印加される電圧を半減することができ
る。
２の電圧に分圧すると共に、インダクタンス素子をイン
ダクタンス素子ＣＨ１，ＣＨ２に二分割しているので、
分割巻線ＮＰ□ 、Ｎ１３に印加される電圧が１／２と
なり、その結果各トランジスタＴＲ１゜ＴＲ２のコレク
タ、エミッタ間に印加される電圧を半減することができ
る。
ところが、インダクタンス素子ＣＨ１，ＣＨ２は同一鉄
心上に巻かれ、巻数も同一であり密に結合されており、
インダクタンス素子ＣＨ１，ＣＨ２の電圧は同一になる
ように設定されているが、インダクタンス素子ＣＨ１゜
ＣＨ２の結合は完全にならず、漏洩インダクタンスが生
じ、この漏洩インダクタンスが大きくなった場合、イン
ダクタンス素子ＣＨ，，ＣＨ２の電圧は完全には一致せ
ず、これにスパイク電圧発生し、このスパイク電圧がト
ランジスタＴＲ１，ＴＲ２に印加されて、その電力損が
大きくなるという問題があった。
心上に巻かれ、巻数も同一であり密に結合されており、
インダクタンス素子ＣＨ１，ＣＨ２の電圧は同一になる
ように設定されているが、インダクタンス素子ＣＨ１゜
ＣＨ２の結合は完全にならず、漏洩インダクタンスが生
じ、この漏洩インダクタンスが大きくなった場合、イン
ダクタンス素子ＣＨ，，ＣＨ２の電圧は完全には一致せ
ず、これにスパイク電圧発生し、このスパイク電圧がト
ランジスタＴＲ１，ＴＲ２に印加されて、その電力損が
大きくなるという問題があった。
即ち、このスパイク電圧はトランジスタＴＲ１，ＴＲ２
がオンからオフに移行する時期に多く発生し、その動作
は以下の様になる。
がオンからオフに移行する時期に多く発生し、その動作
は以下の様になる。
例えば、トランジスタＴＲ１がオンからオフに移行し、
トランジスタＴＲ２がオフからオンに移行する場合、ト
ランジスタＴＲ１のオフによりインダクタンス素子ＣＨ
１に流れている電流がＯになると同時に、トランジスタ
ＴＲ２のオンによりコンデンサＣ２の両端電圧がインダ
クタンス素子ＣＨ２及び−次巻線ＮＰ２に印加されるの
であるが、インダクタンス素子ＣＨ２のインピーダンス
は一次巻線ＮＰ２のインピーダンスより充分大きく設定
されている為、コンデンサＣ２の両端電圧はほとんどイ
ンダクタンス素子ＣＨ２に印加され、ご０電圧と同じ大
きさの電圧がインダクタンス素子ＣＨ工に誘起し、この
時の電圧の極性は第２図に示す方向に発生して、コンデ
ンサＣ１からトランジスタＴＲ１に印加される電圧を減
じる方向に動作する。
トランジスタＴＲ２がオフからオンに移行する場合、ト
ランジスタＴＲ１のオフによりインダクタンス素子ＣＨ
１に流れている電流がＯになると同時に、トランジスタ
ＴＲ２のオンによりコンデンサＣ２の両端電圧がインダ
クタンス素子ＣＨ２及び−次巻線ＮＰ２に印加されるの
であるが、インダクタンス素子ＣＨ２のインピーダンス
は一次巻線ＮＰ２のインピーダンスより充分大きく設定
されている為、コンデンサＣ２の両端電圧はほとんどイ
ンダクタンス素子ＣＨ２に印加され、ご０電圧と同じ大
きさの電圧がインダクタンス素子ＣＨ工に誘起し、この
時の電圧の極性は第２図に示す方向に発生して、コンデ
ンサＣ１からトランジスタＴＲ１に印加される電圧を減
じる方向に動作する。
しかし、インダクタンス素子ＣＫ １ ｓ ＣＨ２に漏
洩インダクタンスがある場合、前記のインダクタンス素
子ＣＨ１に誘起する電圧はインダクタンス素子ＣＨ２に
誘起する電圧と同一にならず、インダクタンスＣＨ１の
分布容量と共振を生じル限動電圧となり、振動によりそ
の極性が反対になると、コンデンサＣ□の電圧に加算さ
れる方向の電圧がインダクタンス素子ＣＨ１に印加され
、スパイク電圧が発生する。
洩インダクタンスがある場合、前記のインダクタンス素
子ＣＨ１に誘起する電圧はインダクタンス素子ＣＨ２に
誘起する電圧と同一にならず、インダクタンスＣＨ１の
分布容量と共振を生じル限動電圧となり、振動によりそ
の極性が反対になると、コンデンサＣ□の電圧に加算さ
れる方向の電圧がインダクタンス素子ＣＨ１に印加され
、スパイク電圧が発生する。
そして、トランジスタＴＲ１がオフせずわずかでも電流
が流れている状態でインダクタンス素子ＣＨ１の電圧が
印加されて、トランジスタＴＲ１の電力損が増加する。
が流れている状態でインダクタンス素子ＣＨ１の電圧が
印加されて、トランジスタＴＲ１の電力損が増加する。
本考案は上記問題点に鑑み、互いに磁気結合されたイン
ダクタンス素子に発生するスパイク電圧ヲ無くシ、トラ
ンジスタ等のスイッチング素子の電力損を低減できるイ
ンバータ回路を提供することを目的とし、その特徴とす
るところは、直流電源の両端に同一容量の一対のコンデ
ンサを直列接続すると共に、この各コンデンサの両端に
、互いに磁気結合されたインダクタンス素子と２分割さ
れたインバータトランスの１次巻線と互いに逆動作する
スイッチ素子とを夫々直列接続したインバータ回路であ
って、前記一対のインダクタンス素子と前記一方のコン
デンサとの間で閉回路を形成しかつ前記一対のインダク
タンス素子の両端電圧を同一にするように、前記各イン
ダクタンス素子と１次巻線との接続点間にコンデンサを
接続した点にある。
ダクタンス素子に発生するスパイク電圧ヲ無くシ、トラ
ンジスタ等のスイッチング素子の電力損を低減できるイ
ンバータ回路を提供することを目的とし、その特徴とす
るところは、直流電源の両端に同一容量の一対のコンデ
ンサを直列接続すると共に、この各コンデンサの両端に
、互いに磁気結合されたインダクタンス素子と２分割さ
れたインバータトランスの１次巻線と互いに逆動作する
スイッチ素子とを夫々直列接続したインバータ回路であ
って、前記一対のインダクタンス素子と前記一方のコン
デンサとの間で閉回路を形成しかつ前記一対のインダク
タンス素子の両端電圧を同一にするように、前記各イン
ダクタンス素子と１次巻線との接続点間にコンデンサを
接続した点にある。
以下、本考案を図示の実施例に従って説明すると、第３
図において、コンデンサＣ１ｓＣ２の各両端に、その高
電圧側に各インダクタンス素子ＣＨ１゜ＣＨ２を位置さ
せて、各一方のインダクタンス素子ＣＨ，，ＣＨ２、分
割巻線ＮＰ１．ＮＰ２及びトランジスタＴ Ｒ１ｓ Ｔ
Ｒ２の各直列回路を夫々接続し、インダクタンス素子
ＣＨ１と分割巻線ＮＰ１との接続点Ａ及びインダクタン
ス素子ＣＨ２と分割巻線ＮＰ２との接続点Ａ′にコンデ
ンサＣ３を接続している。
図において、コンデンサＣ１ｓＣ２の各両端に、その高
電圧側に各インダクタンス素子ＣＨ１゜ＣＨ２を位置さ
せて、各一方のインダクタンス素子ＣＨ，，ＣＨ２、分
割巻線ＮＰ１．ＮＰ２及びトランジスタＴ Ｒ１ｓ Ｔ
Ｒ２の各直列回路を夫々接続し、インダクタンス素子
ＣＨ１と分割巻線ＮＰ１との接続点Ａ及びインダクタン
ス素子ＣＨ２と分割巻線ＮＰ２との接続点Ａ′にコンデ
ンサＣ３を接続している。
従って、コンデンサＣ１の両端、即ち点Ｂと点Ｂ′との
間には直流電源ＥをコンデンサＣ１゜Ｃ２で分圧した電
圧が印加され、またコンデンサＣ２の両端に対しても同
様であり、コンデンサＣ１，Ｃ２は同一容量であるから
、コンデンサＣ１゜Ｃ２は直流電源Ｅの１／２電圧の直
流電源として作用する。
間には直流電源ＥをコンデンサＣ１゜Ｃ２で分圧した電
圧が印加され、またコンデンサＣ２の両端に対しても同
様であり、コンデンサＣ１，Ｃ２は同一容量であるから
、コンデンサＣ１゜Ｃ２は直流電源Ｅの１／２電圧の直
流電源として作用する。
なお、コンデンサＣ工、Ｃ２の容量をトランジスタＴＲ
１，ＴＲ２の電流に対してリップルが生じないように充
分大きく設定するとコンデンサＣ１５Ｃ２はリップルを
台筐ない直流電源となる。
１，ＴＲ２の電流に対してリップルが生じないように充
分大きく設定するとコンデンサＣ１５Ｃ２はリップルを
台筐ない直流電源となる。
そして、点Ａの電圧は点Ｂの電圧からインダクタンス素
子ＣＨ１の電圧を引いたものであり、点Ａ′の電圧は点
Ｂ′の電圧からインダクタンス素子ＣＨ２の電圧を引い
たものであるから、インダクタンス素子ＣＨ工、ＣＨ２
の電圧が同一であると、点Ａ 、ＡＭの電圧は点Ｂ 、
Ｂ’間の電圧と同一となり、コンデンサＣ３はインダ
クタンス素子ＣＨ１゜ＣＨ２を介してコンデンサＣ０の
両端電圧と同一である直流電源Ｅの１／２電圧渣で充電
される。
子ＣＨ１の電圧を引いたものであり、点Ａ′の電圧は点
Ｂ′の電圧からインダクタンス素子ＣＨ２の電圧を引い
たものであるから、インダクタンス素子ＣＨ工、ＣＨ２
の電圧が同一であると、点Ａ 、ＡＭの電圧は点Ｂ 、
Ｂ’間の電圧と同一となり、コンデンサＣ３はインダ
クタンス素子ＣＨ１゜ＣＨ２を介してコンデンサＣ０の
両端電圧と同一である直流電源Ｅの１／２電圧渣で充電
される。
従って、例えばトランジスタＴＲ１がオンからオフへ移
行し、トランジスタＴＲ２がオフからオンへ移行する場
合、トランジスタＴＲ２のオンによってインダクタンス
素子ＣＨ２に電圧が印加されると、インダクタンス素子
ＣＨ１にはインダクタンス素子ＣＨ２との巻線による結
合により電圧が誘起されると同時に、コンデンサＣ３を
介して点Ａの電圧をインダクタンス素子ＣＨ２に発生し
た電圧だけ変化させるように働き、インダクタンス素子
ＣＨ０，ＣＨ２間に漏洩インダクタンスがあり共振が生
じようとしても、コンデンサＣ３が強制的に各インダク
タンス素子ＣＨ１，ＣＨ２の両端電圧を同一にするよう
に作用して、前記の共振を吸収してし１い、インダクタ
ンス素子ＣＨ１，ＣＨ２にスパイク電圧が発生しなくな
り、トランジスタＴ Ｒ１＊ Ｔ Ｒ２の電力損を低減
する。
行し、トランジスタＴＲ２がオフからオンへ移行する場
合、トランジスタＴＲ２のオンによってインダクタンス
素子ＣＨ２に電圧が印加されると、インダクタンス素子
ＣＨ１にはインダクタンス素子ＣＨ２との巻線による結
合により電圧が誘起されると同時に、コンデンサＣ３を
介して点Ａの電圧をインダクタンス素子ＣＨ２に発生し
た電圧だけ変化させるように働き、インダクタンス素子
ＣＨ０，ＣＨ２間に漏洩インダクタンスがあり共振が生
じようとしても、コンデンサＣ３が強制的に各インダク
タンス素子ＣＨ１，ＣＨ２の両端電圧を同一にするよう
に作用して、前記の共振を吸収してし１い、インダクタ
ンス素子ＣＨ１，ＣＨ２にスパイク電圧が発生しなくな
り、トランジスタＴ Ｒ１＊ Ｔ Ｒ２の電力損を低減
する。
そして、インダクタンス素子ＣＨ１，ＣＨ２の電圧が同
一になると、コンデンサＣ３の両端電圧は変化しない為
、それに印加される電圧は一定となり、コンデンサＣ３
を設けたことによるインバータ回路への影響はなく各ト
ランジスタＴＲ１，ＴＲ２のコレクタ、エミッタ間に印
加される電圧を従来と同様に半減する。
一になると、コンデンサＣ３の両端電圧は変化しない為
、それに印加される電圧は一定となり、コンデンサＣ３
を設けたことによるインバータ回路への影響はなく各ト
ランジスタＴＲ１，ＴＲ２のコレクタ、エミッタ間に印
加される電圧を従来と同様に半減する。
なお、前記実施例では直流電源ＥをコンデンサＣ□ｓ
Ｃ２により分圧することにより、コンデンサＣ□、Ｃ２
を直流電源としているが、コンデンサＣ□ｓＣ２に代え
２個の独立した直流電源を使用する事も可能である。
Ｃ２により分圧することにより、コンデンサＣ□、Ｃ２
を直流電源としているが、コンデンサＣ□ｓＣ２に代え
２個の独立した直流電源を使用する事も可能である。
また、前記実施例ではベース駆動回路を省略しているが
、ベース駆動回路は自励発振式であっても、或いは発振
器を別に設けた他励発振式であってもよい。
、ベース駆動回路は自励発振式であっても、或いは発振
器を別に設けた他励発振式であってもよい。
さらにトランジスタＴＲ１，ＴＲ２の代りにＧＴＯサイ
リスタ等の半導体スイッチを使用してオンオフ動作させ
るようにしてもよい。
リスタ等の半導体スイッチを使用してオンオフ動作させ
るようにしてもよい。
本考案によるインバータ回路は、一対のインダクタンス
素子と２分割された１方の１次巻線との間で閉回路を形
成しかつ前記インダクタンス素子の両端電圧を同一にす
るように、前記各インダクタンス素子と１次巻線との接
続点間にコンデンサを接続しているから両インダクタン
ス素子間に漏洩インダクタンスがあり共振が生じようと
しても、各インダクタンス素子の両端電圧は強制的に同
一はされるので、前記共振は吸収され、各インダクタン
ス素子にスパイク電圧が発生することがなくなり、スイ
ッチ素子の電力損を低減することができる。
素子と２分割された１方の１次巻線との間で閉回路を形
成しかつ前記インダクタンス素子の両端電圧を同一にす
るように、前記各インダクタンス素子と１次巻線との接
続点間にコンデンサを接続しているから両インダクタン
ス素子間に漏洩インダクタンスがあり共振が生じようと
しても、各インダクタンス素子の両端電圧は強制的に同
一はされるので、前記共振は吸収され、各インダクタン
ス素子にスパイク電圧が発生することがなくなり、スイ
ッチ素子の電力損を低減することができる。
第１図及び第２図は夫々従来例を示すインバータ回路の
回路図、第３図は本考案の一実施例を示すインバータ回
路の回路図である。 Ｅ・・・・・・直流電源、Ｔ・・・・・・インバータト
ランス、ＮＰ□、ＮＦ２・・・・・・１次巻線（分割巻
線）、ＮＳ・・・・・・２次巻線、Ｃ１，Ｃ２・・・・
・・コンデンサ（直流電源）、ＴＲ０，ＴＲ２・・・・
・・トランジスタ（スイッチ素子） 、ＣＨ１１ＣＨ２
・・・・・・インダクタンス素子、Ｃ３・・・・・・コ
ンデンサ。
回路図、第３図は本考案の一実施例を示すインバータ回
路の回路図である。 Ｅ・・・・・・直流電源、Ｔ・・・・・・インバータト
ランス、ＮＰ□、ＮＦ２・・・・・・１次巻線（分割巻
線）、ＮＳ・・・・・・２次巻線、Ｃ１，Ｃ２・・・・
・・コンデンサ（直流電源）、ＴＲ０，ＴＲ２・・・・
・・トランジスタ（スイッチ素子） 、ＣＨ１１ＣＨ２
・・・・・・インダクタンス素子、Ｃ３・・・・・・コ
ンデンサ。
Claims (1)
- 直流電源の両端に同一容量の二対のコンデンサを直列接
続すると共に、この各コンデンサの両端に、互いに磁気
結合されたインダクタンス素子と２分割されたインバー
タトランスの１次巻線と互いに逆動作するスイッチ素子
とを夫々直列接続したインバータ回路であって、前記一
対のインダクタンス素子と前記一方のコンデンサとの間
で閉回路を形成しかつ前記二対のインダクタンス素子の
両端電圧を同一にするように、前記各インダクタンス素
子と１次巻線との接続点間にコンデンサを接続したこと
を特徴とするインバータ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13423678U JPS5821360Y2 (ja) | 1978-09-29 | 1978-09-29 | インバ−タ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13423678U JPS5821360Y2 (ja) | 1978-09-29 | 1978-09-29 | インバ−タ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5551657U JPS5551657U (ja) | 1980-04-05 |
| JPS5821360Y2 true JPS5821360Y2 (ja) | 1983-05-06 |
Family
ID=29103433
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13423678U Expired JPS5821360Y2 (ja) | 1978-09-29 | 1978-09-29 | インバ−タ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5821360Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5868380U (ja) * | 1981-10-29 | 1983-05-10 | セイレイ工業株式会社 | 動力運搬車の運転席フロア−機構 |
-
1978
- 1978-09-29 JP JP13423678U patent/JPS5821360Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5551657U (ja) | 1980-04-05 |
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