JPS5819921A - 多出力スイッチング電源 - Google Patents
多出力スイッチング電源Info
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- JPS5819921A JPS5819921A JP11881581A JP11881581A JPS5819921A JP S5819921 A JPS5819921 A JP S5819921A JP 11881581 A JP11881581 A JP 11881581A JP 11881581 A JP11881581 A JP 11881581A JP S5819921 A JPS5819921 A JP S5819921A
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- switching power
- switching
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
- H02M3/325—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
- H02M3/33561—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only having more than one ouput with independent control
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、過電流保護機能を有する多出力スイッチング
電源に関する。
電源に関する。
従来のこの種の多出力スイッチング電源の一例を第１Ｅ
に示す。この図において、出カドランス１の一次巻線１
人にはスイッチング回路２より矩形波電圧が供給され、
出カドランス１の二次側の出力巻線ＩＢ、ＩＣに夫々ダ
イオードＤｉ ＊ Ｄ雪及びコンデンサＣ１，Ｃ２から
成る整流平滑回路が設けられている。そして、所定の直
流出力が出力端子Ｐｉ、Ｎ関及び出力端子Ｐ、、Ｎ間に
出力されるようになっている。この場合、スイッチング
回路２内のスイッチング素子に過電流が流れて破損に到
らないように、出力端子Ｎに接続された共通帰線３に直
列に抵抗器８を挿入し、この両端の電圧Ｂより負荷電＃
ｌＯ總和総和）、これによってスイッチング回路２内の
スイッチング素子のオン期間又はオフ期間あるいけ動作
周波数を制御してスイッチング素子に流れる電流を制限
するようにしている。
に示す。この図において、出カドランス１の一次巻線１
人にはスイッチング回路２より矩形波電圧が供給され、
出カドランス１の二次側の出力巻線ＩＢ、ＩＣに夫々ダ
イオードＤｉ ＊ Ｄ雪及びコンデンサＣ１，Ｃ２から
成る整流平滑回路が設けられている。そして、所定の直
流出力が出力端子Ｐｉ、Ｎ関及び出力端子Ｐ、、Ｎ間に
出力されるようになっている。この場合、スイッチング
回路２内のスイッチング素子に過電流が流れて破損に到
らないように、出力端子Ｎに接続された共通帰線３に直
列に抵抗器８を挿入し、この両端の電圧Ｂより負荷電＃
ｌＯ總和総和）、これによってスイッチング回路２内の
スイッチング素子のオン期間又はオフ期間あるいけ動作
周波数を制御してスイッチング素子に流れる電流を制限
するようにしている。
しかし、単純に負荷電流の総和を検出していたのでは、
出力端子Ｐｉ 、 Ｎ＠０電圧値と出力端子Ｐｇ、Ｎ１
１ｌＯ電圧値との差異が大きい場合には、スイッチング
素子に過電流が流にる恐れがある。すなわち、電圧値の
大きい方の負荷が重（なり喪ときは、同一負荷電流であ
っても出力電力は大きく′ｊｋｇ、スイッチング素子の
電流ｓｗａｍするからである。
出力端子Ｐｉ 、 Ｎ＠０電圧値と出力端子Ｐｇ、Ｎ１
１ｌＯ電圧値との差異が大きい場合には、スイッチング
素子に過電流が流にる恐れがある。すなわち、電圧値の
大きい方の負荷が重（なり喪ときは、同一負荷電流であ
っても出力電力は大きく′ｊｋｇ、スイッチング素子の
電流ｓｗａｍするからである。
本発明社、上記の点に銖み、出カドランスの二次側出力
電力の総和に比例した合成検出電圧を利用してスイッチ
ング素子のオン期間又紘オフ期間あるいは動作周波数を
可変制御することによｐ１スイッチング素子の過電流を
確実に防止し、しか−過負荷とならない範囲の限界まで
効果的に作動させることが可能な多出力スイッチング電
源を提供しようとするものである。
電力の総和に比例した合成検出電圧を利用してスイッチ
ング素子のオン期間又紘オフ期間あるいは動作周波数を
可変制御することによｐ１スイッチング素子の過電流を
確実に防止し、しか−過負荷とならない範囲の限界まで
効果的に作動させることが可能な多出力スイッチング電
源を提供しようとするものである。
以下、本発明に係る多出力スイッチング電源の実施例を
図面に従つて説明する。
図面に従つて説明する。
第２１社本発明のＩ１１実施例を示す。このＷＡにおい
て、出カシランス１０はタップ付の一次巻線１０Ａと、
二次側Ｅｌｌ数の出力巻線１０Ｂ、１０Ｃとを有してお
り、スイッチングトランジスタＱのコレクタは一次巻纏
１０Ａの一端ＫＩＮ絖されている−６また、−次巻線１
０人の他端とトランジスタＱの工建ツタとの間にダイオ
ードＤｓが接続される。入力端子Ｘ、Ｙ間には交流入力
電圧が供給され、これは金談整流器１１で整流され、コ
ンデンサＣ３で平滑された後、−次巻線１０Ａのタップ
とトランジスタＱのエンツタとの間に給電され、トラン
ジスタＱのスイッチング動作により断続される。この結
果、出カドランス１０の一次巻線１０Ａは矩形液パルス
電圧により励磁され、二次側の出力巻線１０Ｂ、１０Ｃ
には所定の巻線比に応じ−て矩形波パルス電圧が誘起さ
れる。出力巻線１０８に＃ｉダイオードＤ４ｔ Ｄｉｅ
チ冒−クコイルＣＨＩ及びコンデンサＣ４からなる整流
平滑回路が接続され、出力巻線１０ＣＫはダイオードＤ
・、Ｄｌ、チ曹−タコイＪ＆−ＣＨｌ及びコンデンサＣ
５からなる整流平滑回路が同様に歎けもれて−る。ζこ
で、チッークコイルＣＨＩ、ＣＨＩ社相互に磁気的に密
結合されて−る。これは、一方Ｏ出力の負荷が重く、他
方が無負荷のような場４Ｉ！にも同じ割合で電圧降下が
生じるようにして、一方の出力の安定化制御を行えｄ１
倫方もこれに隼じて安定化されるようにするえめである
。前記各整流平滑回路の直流出力は夫々出力端子Ｐ１
ｍ Ｎ１、−及びＰＭ ？ ％間に導出される。ただし
、出力端子Ｎ１１ ＮｘＫ１１絖される負側線路１２．
１３に紘夫々抵抗ｌ！ＲｈＲ，が挿入されている。こや
抵抗器Ｒ１ｓ Ｉ’Ｓの一端（非接地側）と誤差増幅器
、１４の一方の入力端との間に夫々抵抗器ａｌ、、 Ｉ
Ｌ！ｓが接続される。誤差増幅器１４の他方の入力端に
は基準電圧源１５が接続されており、誤差増＠ｓ１４の
出力に応じて、スイッチンダトランジスタＱＯオン期間
又はオフ期間ある−は動作周波数が可変制御されるよう
になって−ゐ、′＆訃、図示していないが、別の誤差増
幅器が直流出力の安定化の喪めに設けられておシ、例え
ｄ出力端子Ｐ１ ｅ Ｎ１間の定格出力電圧Ｂ１が一定
で、出力端子’Ｍ ｅ Ｎ２間の定格出力電圧１．もほ
ぼ安定し専状態に制御されるものとする。
て、出カシランス１０はタップ付の一次巻線１０Ａと、
二次側Ｅｌｌ数の出力巻線１０Ｂ、１０Ｃとを有してお
り、スイッチングトランジスタＱのコレクタは一次巻纏
１０Ａの一端ＫＩＮ絖されている−６また、−次巻線１
０人の他端とトランジスタＱの工建ツタとの間にダイオ
ードＤｓが接続される。入力端子Ｘ、Ｙ間には交流入力
電圧が供給され、これは金談整流器１１で整流され、コ
ンデンサＣ３で平滑された後、−次巻線１０Ａのタップ
とトランジスタＱのエンツタとの間に給電され、トラン
ジスタＱのスイッチング動作により断続される。この結
果、出カドランス１０の一次巻線１０Ａは矩形液パルス
電圧により励磁され、二次側の出力巻線１０Ｂ、１０Ｃ
には所定の巻線比に応じ−て矩形波パルス電圧が誘起さ
れる。出力巻線１０８に＃ｉダイオードＤ４ｔ Ｄｉｅ
チ冒−クコイルＣＨＩ及びコンデンサＣ４からなる整流
平滑回路が接続され、出力巻線１０ＣＫはダイオードＤ
・、Ｄｌ、チ曹−タコイＪ＆−ＣＨｌ及びコンデンサＣ
５からなる整流平滑回路が同様に歎けもれて−る。ζこ
で、チッークコイルＣＨＩ、ＣＨＩ社相互に磁気的に密
結合されて−る。これは、一方Ｏ出力の負荷が重く、他
方が無負荷のような場４Ｉ！にも同じ割合で電圧降下が
生じるようにして、一方の出力の安定化制御を行えｄ１
倫方もこれに隼じて安定化されるようにするえめである
。前記各整流平滑回路の直流出力は夫々出力端子Ｐ１
ｍ Ｎ１、−及びＰＭ ？ ％間に導出される。ただし
、出力端子Ｎ１１ ＮｘＫ１１絖される負側線路１２．
１３に紘夫々抵抗ｌ！ＲｈＲ，が挿入されている。こや
抵抗器Ｒ１ｓ Ｉ’Ｓの一端（非接地側）と誤差増幅器
、１４の一方の入力端との間に夫々抵抗器ａｌ、、 Ｉ
Ｌ！ｓが接続される。誤差増幅器１４の他方の入力端に
は基準電圧源１５が接続されており、誤差増＠ｓ１４の
出力に応じて、スイッチンダトランジスタＱＯオン期間
又はオフ期間ある−は動作周波数が可変制御されるよう
になって−ゐ、′＆訃、図示していないが、別の誤差増
幅器が直流出力の安定化の喪めに設けられておシ、例え
ｄ出力端子Ｐ１ ｅ Ｎ１間の定格出力電圧Ｂ１が一定
で、出力端子’Ｍ ｅ Ｎ２間の定格出力電圧１．もほ
ぼ安定し専状態に制御されるものとする。
以上の構成にお−て、出カシランス１０ｐ二次側の出力
電力の総和Ｐｂ社、抵抗器Ｒ１ｓ ａｍに流れる電流を
ＩＩ、Ｉ意としたとき次式で示される。
電力の総和Ｐｂ社、抵抗器Ｒ１ｓ ａｍに流れる電流を
ＩＩ、Ｉ意としたとき次式で示される。
ＥＩ１１＋′Ｂ＊Ｉｚ ＝Ｐｏ ”・”
（１）また、アース電位を零としたとき、誤差増幅器
１４の一方の入力端の電位を一１ｉｏとすると、Ｒ１゜
ｌｈ ＜＜ Ｒｉｓ ｓ Ｒｚｓなる条件下ではが成立
する。ここで、Ｒｓ、 Ｂｗｓ 、 ８口、Ｒ３−の抵
抗値をうまく設定すると、 Ｐｏ ａｃ Ｅ ｉｏ ・・
・・・（３）なる関係を得ることができる。この（３）
式の成立するための条件は次式で示される通りであり、
この（４）式を満足させれば、ＥｉｏはＰｏに正比例し
九合成検出電圧となる。この場合、Ｂ１ ＃ ”２は設
計段階で既知であるから、”１＊ ＲＭｅ Ｒ１１ｔ
Ｒおの値を（４）式が成立するように設定することは害
鳥である。
（１）また、アース電位を零としたとき、誤差増幅器
１４の一方の入力端の電位を一１ｉｏとすると、Ｒ１゜
ｌｈ ＜＜ Ｒｉｓ ｓ Ｒｚｓなる条件下ではが成立
する。ここで、Ｒｓ、 Ｂｗｓ 、 ８口、Ｒ３−の抵
抗値をうまく設定すると、 Ｐｏ ａｃ Ｅ ｉｏ ・・
・・・（３）なる関係を得ることができる。この（３）
式の成立するための条件は次式で示される通りであり、
この（４）式を満足させれば、ＥｉｏはＰｏに正比例し
九合成検出電圧となる。この場合、Ｂ１ ＃ ”２は設
計段階で既知であるから、”１＊ ＲＭｅ Ｒ１１ｔ
Ｒおの値を（４）式が成立するように設定することは害
鳥である。
従って、誤差増幅器１４の他方の入力端へ印加される基
準電圧源１５よりの基準電圧−ＦｆＲＩＦを、取出し得
る最大電力Ｐｏｍａｘのときの−Ｅｉｏに一致させれば
、誤差増幅器１４は二次側出力電力の総和ＰＯが最大電
力Ｐｏｍａｘを越えた時点で作動し、トランジスタＱの
オン期間を短く、又はオフ期間を長く、又は動作周波数
を高くする方向に制御し、トランジスタＱの過電流を防
止する。
準電圧源１５よりの基準電圧−ＦｆＲＩＦを、取出し得
る最大電力Ｐｏｍａｘのときの−Ｅｉｏに一致させれば
、誤差増幅器１４は二次側出力電力の総和ＰＯが最大電
力Ｐｏｍａｘを越えた時点で作動し、トランジスタＱの
オン期間を短く、又はオフ期間を長く、又は動作周波数
を高くする方向に制御し、トランジスタＱの過電流を防
止する。
前記（４）式において、さらにＲ１ｓ＋Ｒｚｓに設定し
九場合には が得られる。この（５）式の条件によれば、各抵抗器の
値の設定を極めて容ＪＩＫ実行できる利点がある。
九場合には が得られる。この（５）式の条件によれば、各抵抗器の
値の設定を極めて容ＪＩＫ実行できる利点がある。
さらに、（４）式を満足させると共に、次式ＲＩＩＩＯ
幻ＲｚＩｗｏ 曲” （６）（但し、Ｉｌ
６ ｉｔ Ｉｌ ’ｆ）最大定格電流、Ｂｉｏ ＦｉＩ
ｓ （Ｄ最大定格電流）を満足させれば、最大定格動作
時における抵抗器Ｒ１＊ Ｒ２の消費電力を同一にでき
、抵抗器Ｒ１ｍ Ｂｍの電力容量を同じにできる。また
、この場合には各出力の効率を均一化できる利点もある
。
幻ＲｚＩｗｏ 曲” （６）（但し、Ｉｌ
６ ｉｔ Ｉｌ ’ｆ）最大定格電流、Ｂｉｏ ＦｉＩ
ｓ （Ｄ最大定格電流）を満足させれば、最大定格動作
時における抵抗器Ｒ１＊ Ｒ２の消費電力を同一にでき
、抵抗器Ｒ１ｍ Ｂｍの電力容量を同じにできる。また
、この場合には各出力の効率を均一化できる利点もある
。
以上説明し喪ように、上記第１実施例によれ杜、誤差増
幅器１４は、出カドランス１ｏの二次側出力電力の総和
ＰＧが最大電力Ｐｏｍａｘを越えたとき動作し、各出力
に接続され喪負荷の軽、重には影響され表いから、いか
なる場合にも確実にスイッチングトランジスタＱの過電
流を防止し、これの保護ができる。ｔた、過負荷となら
ない範囲の限界までトランジスタＱを効果的に動作させ
得る利点もある。
幅器１４は、出カドランス１ｏの二次側出力電力の総和
ＰＧが最大電力Ｐｏｍａｘを越えたとき動作し、各出力
に接続され喪負荷の軽、重には影響され表いから、いか
なる場合にも確実にスイッチングトランジスタＱの過電
流を防止し、これの保護ができる。ｔた、過負荷となら
ない範囲の限界までトランジスタＱを効果的に動作させ
得る利点もある。
第３図は本発明の第２実施例を示す。この図において、
出カドランス１０の二次側の出力巻線１０ＢＫＨダイオ
ードＤ＄及び；ンデンサＣ６の整流平滑回路が、出力巻
線１００にはダイオードＤ−及びコンデンサＣ７の整流
平滑囲路が夫々接続されている。出力巻線１０Ｂ側の整
流出力は出力端子ＰＢｅＮ間に導出されて負荷ＲＬＩに
供給される。ただし出力端子Ｐ３に接続され大正側線路
２０には抵抗器Ｒ３が挿入されている。出力巻線１０Ｃ
側の整流出力は出力端子Ｐ４ ｍ ２８間に導出され、
この結果、負荷ＲＬ２には両方の整流出力の利が供給さ
れる。
出カドランス１０の二次側の出力巻線１０ＢＫＨダイオ
ードＤ＄及び；ンデンサＣ６の整流平滑回路が、出力巻
線１００にはダイオードＤ−及びコンデンサＣ７の整流
平滑囲路が夫々接続されている。出力巻線１０Ｂ側の整
流出力は出力端子ＰＢｅＮ間に導出されて負荷ＲＬＩに
供給される。ただし出力端子Ｐ３に接続され大正側線路
２０には抵抗器Ｒ３が挿入されている。出力巻線１０Ｃ
側の整流出力は出力端子Ｐ４ ｍ ２８間に導出され、
この結果、負荷ＲＬ２には両方の整流出力の利が供給さ
れる。
ただし、出力巻線１００と出力端子Ｐｓとの間の負側線
路２１には抵抗器Ｒ４が挿入されている。
路２１には抵抗器Ｒ４が挿入されている。
そして、抵抗器Ｒｓの一端は誤差増幅器１４の一方の入
力端に直結され、抵抗器Ｒ４の一端は基準電圧源１５を
介して誤差増幅器１４の他方の入力端に接続される。な
お、出カドランス１０の一次側の回路は第２図の場合と
同様である。
力端に直結され、抵抗器Ｒ４の一端は基準電圧源１５を
介して誤差増幅器１４の他方の入力端に接続される。な
お、出カドランス１０の一次側の回路は第２図の場合と
同様である。
以上の構成において、出カドランス１０の二次側の出力
電力の総和Ｐｏ Ｂ 、抵抗器Ｒ３％負荷ＲＬｉｅＲＬ
２に夫々流れる電流を■ＩＩ ＊ ＩＬＸ ＊ Ｉｌ２
、負荷ＲＬＩ ＊ ａＬｓの両喝の電圧を１８ ＊ Ｂ
Ｌｍとしたとき、次式で示される。
電力の総和Ｐｏ Ｂ 、抵抗器Ｒ３％負荷ＲＬｉｅＲＬ
２に夫々流れる電流を■ＩＩ ＊ ＩＬＸ ＊ Ｉｌ２
、負荷ＲＬＩ ＊ ａＬｓの両喝の電圧を１８ ＊ Ｂ
Ｌｍとしたとき、次式で示される。
Ｐｏ＝ＢｓＩＬｔ＋＆ａＩｘ、＊＝ｌｓＩ３＋１４ＩＢ
−（’ｙ）（但し、Ｂ４はＢ４ ｅ Ｂ３間の電圧
）壕え、基準電圧源１５の負側端と誤差増幅器１４の一
方の入力端との間の電位差−ＢｉｏはＥｊｏ ＝Ｒ３Ｉ
３＋Ｒ４Ｉｕ ・・・・・・（
８）となる。従って、前述の（３）式のように合成検出
電圧としてのＢｉｏがｐｏに正比例する条件社となる。
−（’ｙ）（但し、Ｂ４はＢ４ ｅ Ｂ３間の電圧
）壕え、基準電圧源１５の負側端と誤差増幅器１４の一
方の入力端との間の電位差−ＢｉｏはＥｊｏ ＝Ｒ３Ｉ
３＋Ｒ４Ｉｕ ・・・・・・（
８）となる。従って、前述の（３）式のように合成検出
電圧としてのＢｉｏがｐｏに正比例する条件社となる。
従りて、基準電圧源１５０基準電圧−Ｅ ＩＩＩＦを、
取出し得る最大電力ＰＯｍＪＩＸのと者の−Ｂｉｏに一
致させれば、誤差増幅器１４は二次側出力電力の総和ｐ
ｏが最大電力ＰＯｍａＫを越えた時点で作動し、トラン
ジスタＱに過電流が流れないように制御する。
取出し得る最大電力ＰＯｍＪＩＸのと者の−Ｂｉｏに一
致させれば、誤差増幅器１４は二次側出力電力の総和ｐ
ｏが最大電力ＰＯｍａＫを越えた時点で作動し、トラン
ジスタＱに過電流が流れないように制御する。
以上説明したように、出カドランスの二次側の各出力に
おける出力電流を直列抵抗により検出し、抵抗回路によ
って前記出力電流に対応する検出電圧を合成し九合成検
出電圧１１ｏが、各出力電圧におおよそ比例した係数と
、各出力電流との積の総和、すなわちｉｉｏミΣに１・
Ｉｉ （ただし、ＫｌミＡ−Ｅｉで、Ｋｉは抵抗囲路
の伝達抵抗、人は定数、Ｂｉは各定格出力電圧、１１は
各出力電流）であるようになし、この合成検出電圧Ｅｉ
ｏを用いてスイッチング素子を制御しているので、スイ
ッチング素子を過電流から確実に保護し、しかも過負荷
をならない範囲の限界まで効果的に作動させることが可
能な多出力スイッチング電源を得ることができる。
おける出力電流を直列抵抗により検出し、抵抗回路によ
って前記出力電流に対応する検出電圧を合成し九合成検
出電圧１１ｏが、各出力電圧におおよそ比例した係数と
、各出力電流との積の総和、すなわちｉｉｏミΣに１・
Ｉｉ （ただし、ＫｌミＡ−Ｅｉで、Ｋｉは抵抗囲路
の伝達抵抗、人は定数、Ｂｉは各定格出力電圧、１１は
各出力電流）であるようになし、この合成検出電圧Ｅｉ
ｏを用いてスイッチング素子を制御しているので、スイ
ッチング素子を過電流から確実に保護し、しかも過負荷
をならない範囲の限界まで効果的に作動させることが可
能な多出力スイッチング電源を得ることができる。
第１図は従来の多出力スイッチング電源の一例を示す回
路図、第２図は本発明に係る多出力スイッチング電源の
第１実施例を示す回路図、第３図は第２実施例を示す回
路図である。 １ｏ・・・出カドランス、１ｏ人・・・−次巻線、１０
Ｂ、１０Ｃ・・・出力巻線、１４・・・誤差増幅器、１
５・・・基準電圧源、Ｃ１乃至Ｃ７・・・コンデンサ、
Ｄｌ乃至Ｄ９・・・ダイオード、ＣＨｌ、ＣＨ２・・・
チ璽−クコイル、Ｑ・・・トランジスタ、Ｒ１乃至Ｒ４
＊ Ｒｕ１ｅＲ１ｓ・・・抵抗器。 特許出原人 東京電気化学工業株式会社 代理人 弁理士 村 井 峰 Ω−ｃＬ ７
路図、第２図は本発明に係る多出力スイッチング電源の
第１実施例を示す回路図、第３図は第２実施例を示す回
路図である。 １ｏ・・・出カドランス、１ｏ人・・・−次巻線、１０
Ｂ、１０Ｃ・・・出力巻線、１４・・・誤差増幅器、１
５・・・基準電圧源、Ｃ１乃至Ｃ７・・・コンデンサ、
Ｄｌ乃至Ｄ９・・・ダイオード、ＣＨｌ、ＣＨ２・・・
チ璽−クコイル、Ｑ・・・トランジスタ、Ｒ１乃至Ｒ４
＊ Ｒｕ１ｅＲ１ｓ・・・抵抗器。 特許出原人 東京電気化学工業株式会社 代理人 弁理士 村 井 峰 Ω−ｃＬ ７
Claims (3)
- （１） 出カドランスの一次巻線にスイッチング回路
を設けて該出カドランスをパルス電圧で励磁し、該出カ
ドランスの二次側の複数の出力巻線に誘起された交流電
圧を夫々整流、平滑して複数の安定化出力を得る多出力
スイッチング電源において、前記複数の出力の各出力電
流を直列抵抗により検出して抵抗回路によって前記各出
力電流に対応する検出電圧を合成し九合成検出電圧（Ｐ
ｉｉｏ）が、各出力電圧におおよそ比例した係数と、各
出力電流との積の総和であるようになし、前記合成検出
電圧（Ｅｉｏ）を検出して、前記スイッチング回路のス
イッチング素子の過電流保護を表すように１轟該スイツ
チング素子のオン期間又はオフ期間あるいは動作周波数
を可変制御することを特徴とする多出力スイッチング電
源。 - （２）前記複数の出力の各出力電力に略比例した抵抗損
失となる如く前記直列抵抗の値を設定した特許請求の範
囲第１項記載の多出力スイッチング電源。 - （３） 前記複数の出力の最大定格電流出′力時に、
前記各直列抵抗の抵抗損失が、夫々略等しくなる如く当
該直列抵抗の値を設定した特許請求の範囲第１項記載の
多出力スイッチング電源。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11881581A JPS5819921A (ja) | 1981-07-29 | 1981-07-29 | 多出力スイッチング電源 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11881581A JPS5819921A (ja) | 1981-07-29 | 1981-07-29 | 多出力スイッチング電源 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5819921A true JPS5819921A (ja) | 1983-02-05 |
| JPS634421B2 JPS634421B2 (ja) | 1988-01-28 |
Family
ID=14745816
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11881581A Granted JPS5819921A (ja) | 1981-07-29 | 1981-07-29 | 多出力スイッチング電源 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5819921A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60157615A (ja) * | 1984-01-27 | 1985-08-17 | Fujitsu Ltd | 中点直接接地型定電流回路 |
| US4586119A (en) * | 1984-04-16 | 1986-04-29 | Itt Corporation | Off-line switching mode power supply |
| JPH0326283U (ja) * | 1989-07-21 | 1991-03-18 | ||
| JP2010252512A (ja) * | 2009-04-15 | 2010-11-04 | Denso Corp | Ｄｃｄｃコンバータの制御装置及び制御システム |
| GB2492875A (en) * | 2011-07-01 | 2013-01-16 | Canon Kk | Power supply apparatus and printing apparatus |
-
1981
- 1981-07-29 JP JP11881581A patent/JPS5819921A/ja active Granted
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Also Published As
| Publication number | Publication date |
|---|---|
| JPS634421B2 (ja) | 1988-01-28 |
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