JPS58177068A - フアクシミリ - Google Patents
フアクシミリInfo
- Publication number
- JPS58177068A JPS58177068A JP5908182A JP5908182A JPS58177068A JP S58177068 A JPS58177068 A JP S58177068A JP 5908182 A JP5908182 A JP 5908182A JP 5908182 A JP5908182 A JP 5908182A JP S58177068 A JPS58177068 A JP S58177068A
- Authority
- JP
- Japan
- Prior art keywords
- recording
- address
- line
- decoding
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Storing Facsimile Image Data (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は主走査において離散的に１ラインを記録する７
アクンミリに関する。
アクンミリに関する。
平向走査形デジタルファクシミリ（以下ファクシミリと
称する）において、主走査方向の記録を行う場合、画素
あるいは連続しだ画素の染まり（以下ブロックと称する
）の配列順に順次配録を行う方式が通常とられている。
称する）において、主走査方向の記録を行う場合、画素
あるいは連続しだ画素の染まり（以下ブロックと称する
）の配列順に順次配録を行う方式が通常とられている。
しかし、前Ｉ己の方式では、例えば感熱記録の場合には
局部的に熱が集中し画質および部品等の劣化の一因とな
る事や、Ｉ！亀記録の場合には１１Ｌ極間の容重結合あ
るいは記録特性の違いによって１［荷の移動が生じやす
ぐ、ゴーストが生じる等の欠点がある。こうした欠点を
防ぐため、画素あるいはブロックの記録順序を変えて、
最初に端の画素、次に真ん中の画素という様に、＠接す
る画素あるいはブロックを連続して記録しない方式が提
案されている。しかし本方式を実行する場合、少くとも
１走査分の画素（以下ｌラインと称する）を一度記録回
路内に蓄える必要があり、ハードウェアが大きくなる欠
点がある〇 一方、ファクシミリにｈ・いてＦｉ７アク７ミリ画信号
を符号化することでファクシミリ画信号の冗長度を抑圧
し、伝送効率を向上させる参が、一般に行なわれている
。このため受信機においては、伝送されてきた符号を逐
次画信号に変換する復号回路があ夛、この中には、１ラ
インを合成するためのラインメモリを有している。
局部的に熱が集中し画質および部品等の劣化の一因とな
る事や、Ｉ！亀記録の場合には１１Ｌ極間の容重結合あ
るいは記録特性の違いによって１［荷の移動が生じやす
ぐ、ゴーストが生じる等の欠点がある。こうした欠点を
防ぐため、画素あるいはブロックの記録順序を変えて、
最初に端の画素、次に真ん中の画素という様に、＠接す
る画素あるいはブロックを連続して記録しない方式が提
案されている。しかし本方式を実行する場合、少くとも
１走査分の画素（以下ｌラインと称する）を一度記録回
路内に蓄える必要があり、ハードウェアが大きくなる欠
点がある〇 一方、ファクシミリにｈ・いてＦｉ７アク７ミリ画信号
を符号化することでファクシミリ画信号の冗長度を抑圧
し、伝送効率を向上させる参が、一般に行なわれている
。このため受信機においては、伝送されてきた符号を逐
次画信号に変換する復号回路があ夛、この中には、１ラ
インを合成するためのラインメモリを有している。
従来の７アクシミリにおいては、記録回路と復号（ロ）
路が独立した回路として傳成されていたため、互いに１
ライン分以上の記憶機能を有しそのために多くのハード
ウェアを必要とする欠点があった。
路が独立した回路として傳成されていたため、互いに１
ライン分以上の記憶機能を有しそのために多くのハード
ウェアを必要とする欠点があった。
本発明の目的は、前記欠点を除去し、軸性的なハードウ
ェアにより良質な記録を得るファクシミリを提供する事
にある。
ェアにより良質な記録を得るファクシミリを提供する事
にある。
前記目的を達成するために、本発明によるファクシミリ
は、入力してくる画素あるいはブロックを逐次離散した
位置に分配し記録する記録回路と、該記録回路において
記録する順番に従って画素あるいはブロックを出力する
復号回路を有し、該復号回路においてｌラインの復号が
完了すると、該ラインを読み出し、離散的に分配しなが
ら１ラインのｈ記録を行う様に粥成しである。
は、入力してくる画素あるいはブロックを逐次離散した
位置に分配し記録する記録回路と、該記録回路において
記録する順番に従って画素あるいはブロックを出力する
復号回路を有し、該復号回路においてｌラインの復号が
完了すると、該ラインを読み出し、離散的に分配しなが
ら１ラインのｈ記録を行う様に粥成しである。
以下、図面等を参照して本発明をさらに詳しく説明する
。説明を簡単にするために、１ラインの画素数を１０画
素とし、画素名を記録位置に従って左−より１乃至１０
とする。そして各画素の記鱈順を１，６，２，７．．３
，８，４，９，５．１０とする。
。説明を簡単にするために、１ラインの画素数を１０画
素とし、画素名を記録位置に従って左−より１乃至１０
とする。そして各画素の記鱈順を１，６，２，７．．３
，８，４，９，５．１０とする。
復号回路はラインメモリを１ライン有し復号した後に記
録を行なら方式とする。記録方式は静電記録方式とし記
録電極と背面ｉｋ極が共にＯＮになった位置にＮ記録を
行なうものとする。
録を行なら方式とする。記録方式は静電記録方式とし記
録電極と背面ｉｋ極が共にＯＮになった位置にＮ記録を
行なうものとする。
第１図は、本発明のｌ実施例のブロック図で、１は復号
部、２は書込アドレスカウンタ、３は続出アドレスカウ
ンタ、４は読出アドレス変換ＲＩＯＭ５はアドレスセレ
クタ、６はメモリ、７はＨｅ鯨電極駆動回路、８は記録
アドレスカウンタ、９Ｉ／′ｉ記録アドレスデコーダ、
１０ｔｉ背ｔｈＩ電極駆動回路、１１は記録電極、１２
は背面電極である。
部、２は書込アドレスカウンタ、３は続出アドレスカウ
ンタ、４は読出アドレス変換ＲＩＯＭ５はアドレスセレ
クタ、６はメモリ、７はＨｅ鯨電極駆動回路、８は記録
アドレスカウンタ、９Ｉ／′ｉ記録アドレスデコーダ、
１０ｔｉ背ｔｈＩ電極駆動回路、１１は記録電極、１２
は背面電極である。
第２図に館、出アドレス変換ＲＵＭ４の内容を入力、出
力の値を１０進数で示す′０ 第３図に記録篭ａｌｌと背ｌ１１ｏ電極１２の位置関係
、および背面１ｋＬ健駆動回路１０を検数する１０個の
駆動回路と背ｌ１ｋｌｉ！ｌ、＃Ａの接続関係を示して
いる。
力の値を１０進数で示す′０ 第３図に記録篭ａｌｌと背ｌ１１ｏ電極１２の位置関係
、および背面１ｋＬ健駆動回路１０を検数する１０個の
駆動回路と背ｌ１ｋｌｉ！ｌ、＃Ａの接続関係を示して
いる。
次に上記実施例の動作を説明する。復号部１はアドレス
セレクタ５が畳込アドレスをメモリアドレスとして選択
する様にセレクタ制御信号を設犀したのち、畳込制御信
号をＯＮにして書込アドレスカウンタ２のりｙアを鱗除
し、畳込クロックとそれに同期した畳込データを発生す
る。畳込クロックは畳込アドレスカウンタ２とメモリ６
に供給され、メモリ６に畳込データを書込むと同時に畳
込アドレスの更新も行なう。復号部は畳込終了信号がＯ
Ｎになり、１２４７分の符号受信が完了すると１ライン
の復号を終了し、畳込制御信号をＯＦ Ｆにする。この
結果メモリ６のＯ帯地から９傘地に画信号の畳込が終了
する。
セレクタ５が畳込アドレスをメモリアドレスとして選択
する様にセレクタ制御信号を設犀したのち、畳込制御信
号をＯＮにして書込アドレスカウンタ２のりｙアを鱗除
し、畳込クロックとそれに同期した畳込データを発生す
る。畳込クロックは畳込アドレスカウンタ２とメモリ６
に供給され、メモリ６に畳込データを書込むと同時に畳
込アドレスの更新も行なう。復号部は畳込終了信号がＯ
Ｎになり、１２４７分の符号受信が完了すると１ライン
の復号を終了し、畳込制御信号をＯＦ Ｆにする。この
結果メモリ６のＯ帯地から９傘地に画信号の畳込が終了
する。
次にアドレスセレクタ５が変換アドレスをメモリアドレ
スとして選択する様にセレクタ制御信号を設定したのち
、続出、制御信号をＯＮにして続出および配球を開始す
る。読出制御信号がＯＮになると、続出アドレスカウン
タ３はクリアが解除され続出クロックに同期して計数を
行ない、続出アドレスセレクタする。続出アドレスは、
続出アドレスｉ９４ｋＬＵＭ４により、変換アドレスに
変換され、アドレスセレクタ５をへてメモリアドレスと
してメモリ６に供給する。従って記録画信号はに換アド
レスで示されたアドレスの内容のＪＩｋＬに出力し、記
録１ｋＬ極駆動回路で駆動され、記録電極は画信号に対
応してＯＮ 、 （Ｊ１１″Ｆを行なう。読出、終了信
号がＯＮになると復号部１は続出制御信号をＯＦＦにし
て１ラインの続出を終了する。１方記録アドレスカウン
タ８は、続出制御信号がＯＮになると読出クロックに同
期して計数を行ない、記録アドレスを出力する。記録ア
ドレスは記録アドレスデコーダ９によりデコードされ、
背面電極駆動回路１０内の１つの駆動回路を駆動する。
スとして選択する様にセレクタ制御信号を設定したのち
、続出、制御信号をＯＮにして続出および配球を開始す
る。読出制御信号がＯＮになると、続出アドレスカウン
タ３はクリアが解除され続出クロックに同期して計数を
行ない、続出アドレスセレクタする。続出アドレスは、
続出アドレスｉ９４ｋＬＵＭ４により、変換アドレスに
変換され、アドレスセレクタ５をへてメモリアドレスと
してメモリ６に供給する。従って記録画信号はに換アド
レスで示されたアドレスの内容のＪＩｋＬに出力し、記
録１ｋＬ極駆動回路で駆動され、記録電極は画信号に対
応してＯＮ 、 （Ｊ１１″Ｆを行なう。読出、終了信
号がＯＮになると復号部１は続出制御信号をＯＦＦにし
て１ラインの続出を終了する。１方記録アドレスカウン
タ８は、続出制御信号がＯＮになると読出クロックに同
期して計数を行ない、記録アドレスを出力する。記録ア
ドレスは記録アドレスデコーダ９によりデコードされ、
背面電極駆動回路１０内の１つの駆動回路を駆動する。
記録アドレスカウンタ８の計数に応じて駆動回路は１か
ら１−企に駆動し、第３図に示す様に記録位＃ａ−が、
１゜６．２，７，３，８，４，９，５．１０の背１ＩＮ
１１１Ｌ憔をｊ−査に選択椙動する。従ってメモリ６か
ら変換アドレスに応じて読出したｌピ録画信号は変換ア
ドレスに応じた背面電極上で逐時（ＪＮ−ＯＦＦ を繰
り返して移ｗｙ＋Ｌｘラインを記録する。
ら１−企に駆動し、第３図に示す様に記録位＃ａ−が、
１゜６．２，７，３，８，４，９，５．１０の背１ＩＮ
１１１Ｌ憔をｊ−査に選択椙動する。従ってメモリ６か
ら変換アドレスに応じて読出したｌピ録画信号は変換ア
ドレスに応じた背面電極上で逐時（ＪＮ−ＯＦＦ を繰
り返して移ｗｙ＋Ｌｘラインを記録する。
同一ラインを複数回配球する場合は、前記脱出記録動作
を必要回数行なう拳で実現できる。
を必要回数行なう拳で実現できる。
本実施例では復号回路のラインメモリを１ラインとした
が、処理能力を上けるため被数ラインの構成をとった場
合も本例に示す様に読出アドレスカウンタ出力を読出ア
ドレス変１１ｋＲＯＭを用いてアドレス変換する事によ
シ、記録回路に応じて画毎号を胱出す拳ができる。
が、処理能力を上けるため被数ラインの構成をとった場
合も本例に示す様に読出アドレスカウンタ出力を読出ア
ドレス変１１ｋＲＯＭを用いてアドレス変換する事によ
シ、記録回路に応じて画毎号を胱出す拳ができる。
本実施例では、１画素の単位で記録したか複数画素を１
ブロツクとして記録する場合は記録画信号′ｆｒｌブロ
ック分記憶する要素と記録電極駆動回路に１ブロツク分
の駆動回路を加える事で実現できる。また、背面電極駆
動回路の各駆動回路と、篭悼の位置の関係を記録の順番
に固定したが、記録アドレスカウンタの出力を記録アド
レス変換用の１（ＯＭを用いて変ｍしたのち記録アドレ
スデコードに入力する構成をとる事で、ＲＯＭの内容の
変換で記録の順番と電憔の位置の関係を簡単に変える事
もできる。さらに、本実施例では静電記録方式について
示したが感熱記録の場曾も駆動回路の構成を変えること
で夾玩できる。
ブロツクとして記録する場合は記録画信号′ｆｒｌブロ
ック分記憶する要素と記録電極駆動回路に１ブロツク分
の駆動回路を加える事で実現できる。また、背面電極駆
動回路の各駆動回路と、篭悼の位置の関係を記録の順番
に固定したが、記録アドレスカウンタの出力を記録アド
レス変換用の１（ＯＭを用いて変ｍしたのち記録アドレ
スデコードに入力する構成をとる事で、ＲＯＭの内容の
変換で記録の順番と電憔の位置の関係を簡単に変える事
もできる。さらに、本実施例では静電記録方式について
示したが感熱記録の場曾も駆動回路の構成を変えること
で夾玩できる。
本発明は以上説明したように、記録回路の画素の紀鯨編
に応じて、復号回路の画素の胱出しを行なうように構成
することにより、記録回路のハードウェアｖｈ減する拳
ができる。
に応じて、復号回路の画素の胱出しを行なうように構成
することにより、記録回路のハードウェアｖｈ減する拳
ができる。
第１図は本発明の１実施例で、ｌ・・・・・・複号部、
２・・・・・・誓込アドレスカウンタ、３・・・・・・
読出アドレスカウンタ、４・・・・・・読出アドレス変
％ＲＯＭ、５・・・・・・アドレスセレクタ、６・・・
・・・メモリ、７・・・・・・記録電極、８・・・・・
・記録アドレスカウンタ、９・・・・・・６［；録アド
レスデコーダ、１０・・・・・・背面電極駆動回路、１
１・・・・・・記録電極、１２・・・・・・背面電極で
ある。 第２図は読出アドレス変換）１０Ｍの内容を示す。 第３図は記録電極と背面′ｖ！Ｌ極と背面電極駆動回路
の関係を示してお夛、１１・・・・・・記録電極、１２
・・・・・・背面１１ＩＬ極、１０・：・・・・背面電
極駆動回路である。 背面を極１２の谷数字は画素名を示している。背面Ｓ、
極駆動回路ｌＯ内の谷数字は駆動回路名を示している。
２・・・・・・誓込アドレスカウンタ、３・・・・・・
読出アドレスカウンタ、４・・・・・・読出アドレス変
％ＲＯＭ、５・・・・・・アドレスセレクタ、６・・・
・・・メモリ、７・・・・・・記録電極、８・・・・・
・記録アドレスカウンタ、９・・・・・・６［；録アド
レスデコーダ、１０・・・・・・背面電極駆動回路、１
１・・・・・・記録電極、１２・・・・・・背面電極で
ある。 第２図は読出アドレス変換）１０Ｍの内容を示す。 第３図は記録電極と背面′ｖ！Ｌ極と背面電極駆動回路
の関係を示してお夛、１１・・・・・・記録電極、１２
・・・・・・背面１１ＩＬ極、１０・：・・・・背面電
極駆動回路である。 背面を極１２の谷数字は画素名を示している。背面Ｓ、
極駆動回路ｌＯ内の谷数字は駆動回路名を示している。
Claims (2)
- （１）主走査方向を記録する場合に一定の１１１番に従
って離散した位置の画素を選択しながら、ラインｋ ｔ
ｉｅ録するデジタルファクシミリにおいて、符号化され
たファクシミリ画信号を復号化する手段と、復号化され
たファクシミリ画信号をすくなくとも１走査側分以上記
憶する手段と、蓄積されたファクシミリ画信号をＢピ録
を行なう１１番に従って絖み出す復号手段と、読み出さ
れるファクシミリ画信号を逐次離散した位置に分配し配
録を行なうｄじ録十段とを包含し、該復号手段において
ｌラインの復号が完了すると該１ラインのファクシミリ
画信号を該記録手段で記録する順番に従って仇み出し、
１ｏＪ時に離散的に分配しなからｌラインの記録を付な
う事を特徴とするファクシミリ。 - （２）初号回路内の復号化した画信号を記憶しているメ
モリの読み出しアドレスの発生に、記録ＩＩ釜をｅピ憶
しているリードオンリーメモリ金相い記録する順番に従
って画素を記録回路に対して出力する事を特徴とする特
許請求の雄Ｉ！囲第（１）項記載のファクシミリ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5908182A JPS58177068A (ja) | 1982-04-09 | 1982-04-09 | フアクシミリ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5908182A JPS58177068A (ja) | 1982-04-09 | 1982-04-09 | フアクシミリ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58177068A true JPS58177068A (ja) | 1983-10-17 |
Family
ID=13103034
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5908182A Pending JPS58177068A (ja) | 1982-04-09 | 1982-04-09 | フアクシミリ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58177068A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02132485A (ja) * | 1987-10-30 | 1990-05-21 | Nec Corp | データ処理装置 |
-
1982
- 1982-04-09 JP JP5908182A patent/JPS58177068A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02132485A (ja) * | 1987-10-30 | 1990-05-21 | Nec Corp | データ処理装置 |
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