JPS58169222A - 信号トレ−ス方式 - Google Patents
信号トレ−ス方式Info
- Publication number
- JPS58169222A JPS58169222A JP57052073A JP5207382A JPS58169222A JP S58169222 A JPS58169222 A JP S58169222A JP 57052073 A JP57052073 A JP 57052073A JP 5207382 A JP5207382 A JP 5207382A JP S58169222 A JPS58169222 A JP S58169222A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- cpu4
- control circuit
- signals
- ifn
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R29/00—Arrangements for measuring or indicating electric quantities not covered by groups G01R19/00 - G01R27/00
- G01R29/02—Measuring characteristics of individual pulses, e.g. deviation from pulse flatness, rise time or duration
- G01R29/027—Indicating that a pulse characteristic is either above or below a predetermined value or within or beyond a predetermined range of values
- G01R29/0273—Indicating that a pulse characteristic is either above or below a predetermined value or within or beyond a predetermined range of values the pulse characteristic being duration, i.e. width (indicating that frequency of pulses is above or below a certain limit)
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く分野〉
本発明は多信号のインターフェース４８号を安価にトレ
ースできるトレース装置Ｋ１１する。
ースできるトレース装置Ｋ１１する。
く従来技術〉
マイク目プｐセッサ等を内蔵する装置を試験する際、従
来から、マイクルプロセッサの制御下にある各動作機器
と、マイク胃プ■セッサとの間のインターフェース償奇
５ｃｔａ＊状態を、そのインターフェース信号−の状態
を取出し、磁気テープ勢の外部記憶装置に一旦記憶し、
試験終了後、このデータ及び信号を感ＪＪｔ、ＩＩｋ等
の媒体く出力することが行われている。
来から、マイクルプロセッサの制御下にある各動作機器
と、マイク胃プ■セッサとの間のインターフェース償奇
５ｃｔａ＊状態を、そのインターフェース信号−の状態
を取出し、磁気テープ勢の外部記憶装置に一旦記憶し、
試験終了後、このデータ及び信号を感ＪＪｔ、ＩＩｋ等
の媒体く出力することが行われている。
しかゐにこうした従来の手法であると、償今の無量間で
あるＫも係らず、信号状態を感光紙上に出力しているた
め、用紙が不必要に多く消費されるという欠点を有して
いる０ 〈目的〉 本発明の目的は、こうした従来の欠点を取除くべく無駄
な記録媒体管削減し得る信号トレース方式を提供する事
にある。
あるＫも係らず、信号状態を感光紙上に出力しているた
め、用紙が不必要に多く消費されるという欠点を有して
いる０ 〈目的〉 本発明の目的は、こうした従来の欠点を取除くべく無駄
な記録媒体管削減し得る信号トレース方式を提供する事
にある。
く畳点〉
上記目的ｔＲｔ、するために、本発明においてはインタ
ーフェース信号を圧縮するようにしたものである。
ーフェース信号を圧縮するようにしたものである。
〈実施例〉
第１図は本発明が適用される一実施例の信号トレース装
置のブロック図、第２図（ａ）は出力フォーマット、ｗ
Ｉｔ２図６）は信号タイムチャートである０図中、ｌｆ
ｌ 〜ｉｆｎはインターフェース信号線、１０〜Ｉｎｔ
ｊ変化点検出回路、２ＦｉＯＲ回路、３は割込制御回路
、４はマイクロプロ慟ツサ、４０はコミ、ニケーシ曹ン
バス（以下バスト略す）、Ｓｔ！タイマ、６はタイマ値
センス制御回路、７はスティタスセンス回路、８はデー
タセンス制御回路、９１はメモリ、９ｂはプリンタ等出
力装置である。
置のブロック図、第２図（ａ）は出力フォーマット、ｗ
Ｉｔ２図６）は信号タイムチャートである０図中、ｌｆ
ｌ 〜ｉｆｎはインターフェース信号線、１０〜Ｉｎｔ
ｊ変化点検出回路、２ＦｉＯＲ回路、３は割込制御回路
、４はマイクロプロ慟ツサ、４０はコミ、ニケーシ曹ン
バス（以下バスト略す）、Ｓｔ！タイマ、６はタイマ値
センス制御回路、７はスティタスセンス回路、８はデー
タセンス制御回路、９１はメモリ、９ｂはプリンタ等出
力装置である。
また＃ｌ１図のｉｆｌ〜ｎの信号状態は第２図伽）にそ
れぞれ０が付して示されたものに対応し、更に第２図（
ａ）ＫおけるＩＰＩ〜ＩＦｎにそれぞれ対応する０更に
Ｔは時間間隔項を示す０ 動作を説明する０％種装置のインターフェース信号線に
各々接続されたインターフェース信号線ｉｆｌ〜ｎにそ
れぞれの信号の立上シ、立下９検出回路１０〜１ｎを設
ける。この信号線の信号費化’ｔＯＲ回路２にて一本化
し、割込み制御回路３全通してＩＲＱ信号として、バス
４０を経由し、マイクロプロセッサ４に通知する〇一方
この信号状態はステータスセンス回路７に供給される０
マイクロブｎセｙ ９’ ４は、プログラム制御にて動
作しておｐ、 ｉｆｆ〜！ＩＯヌテイタス状ｓ’ｅプロ
セッサ４が、データセンス制御回路８を起動してセンス
し、その状態をメ売り９ａＫストア１〜、記憶する。
れぞれ０が付して示されたものに対応し、更に第２図（
ａ）ＫおけるＩＰＩ〜ＩＦｎにそれぞれ対応する０更に
Ｔは時間間隔項を示す０ 動作を説明する０％種装置のインターフェース信号線に
各々接続されたインターフェース信号線ｉｆｌ〜ｎにそ
れぞれの信号の立上シ、立下９検出回路１０〜１ｎを設
ける。この信号線の信号費化’ｔＯＲ回路２にて一本化
し、割込み制御回路３全通してＩＲＱ信号として、バス
４０を経由し、マイクロプロセッサ４に通知する〇一方
この信号状態はステータスセンス回路７に供給される０
マイクロブｎセｙ ９’ ４は、プログラム制御にて動
作しておｐ、 ｉｆｆ〜！ＩＯヌテイタス状ｓ’ｅプロ
セッサ４が、データセンス制御回路８を起動してセンス
し、その状態をメ売り９ａＫストア１〜、記憶する。
°また、ハードタイｗ５がある場合にはＯＲ回路２の出
力信号によりタイマ５１−動作させ、次の信号変化でタ
イマを停止する。ブ豐セッサ４け、そのときの割込信号
にて、信号線１ｆｌ〜ｎのスティタスを、スティタスセ
ンス回路を起動してタイマ値をタイマ値センス制御回路
６を起動してセンスし、メモリ９＠にストアし、記憶し
、再びタイマ５を動作させる〇 適＾表時期にこれらの動作を停止させ、メモリ９ａ内の
データを、プリンタ９ｂＫ出力すればインク７工−ス信
号１１１ｆｌ〜ｉｆｎの状態変化が容易にわか）、タイ
ムチャート的なデータが圧縮された形で表わされる０例
えば、第２図（ｂ） Ｉｃ示す信号変化がインターフェ
ース信号ｉｆｆ ｉｆｆ〜ｎ上に表われたとすると、各
信号の変化点毎にメモ１７９ ａには各インターフェー
ス信号線のその時点の状態及びタイマ値がセットされる
ので、出力されたフォーマット（第２図（ａ） ） Ｋ
示す様、各インターフェース信号線の２値状態ＩＰＩ〜
ＩＦｎと時間項Ｔとして各信号の変化点間の時間間隔＠
５”、 ＠１６″、・・・・・・・・・が表示できる。
力信号によりタイマ５１−動作させ、次の信号変化でタ
イマを停止する。ブ豐セッサ４け、そのときの割込信号
にて、信号線１ｆｌ〜ｎのスティタスを、スティタスセ
ンス回路を起動してタイマ値をタイマ値センス制御回路
６を起動してセンスし、メモリ９＠にストアし、記憶し
、再びタイマ５を動作させる〇 適＾表時期にこれらの動作を停止させ、メモリ９ａ内の
データを、プリンタ９ｂＫ出力すればインク７工−ス信
号１１１ｆｌ〜ｉｆｎの状態変化が容易にわか）、タイ
ムチャート的なデータが圧縮された形で表わされる０例
えば、第２図（ｂ） Ｉｃ示す信号変化がインターフェ
ース信号ｉｆｆ ｉｆｆ〜ｎ上に表われたとすると、各
信号の変化点毎にメモ１７９ ａには各インターフェー
ス信号線のその時点の状態及びタイマ値がセットされる
ので、出力されたフォーマット（第２図（ａ） ） Ｋ
示す様、各インターフェース信号線の２値状態ＩＰＩ〜
ＩＦｎと時間項Ｔとして各信号の変化点間の時間間隔＠
５”、 ＠１６″、・・・・・・・・・が表示できる。
尚タイＹ５の値はプロセッサ４の動作時間の誤差がある
ので、・その点を考慮に入れ補正する必要がある。
ので、・その点を考慮に入れ補正する必要がある。
く効果〉
以上記載し九様に本発明によれば、出力データはインタ
ーフェース信号を圧縮した形で出力できるので、記録媒
体を効率良く利用できる効果を奏し得る。
ーフェース信号を圧縮した形で出力できるので、記録媒
体を効率良く利用できる効果を奏し得る。
第１図は本発明の実施例のブロック図、第２図（（転）
、（ｂ）はその出力フォーマット及びタイムチャートで
ある◇ 図中、１１〜１ｎは変化点検出回路、５＃ｉタイｗ、９
４はメモリ、９ｂ＃ｉ、プリンタである。
、（ｂ）はその出力フォーマット及びタイムチャートで
ある◇ 図中、１１〜１ｎは変化点検出回路、５＃ｉタイｗ、９
４はメモリ、９ｂ＃ｉ、プリンタである。
Claims (1)
- ２値の信号を発生する信号発生装置と、し信号発生装置
の発生する信号に対応した信号を記録すゐ記録計とを備
え、皺２値信号の状態を記録して可視化する信号トレー
ス方式にお馳て、骸２Ｖｉ信号の変化点を検出する検出
手段と、該変化漬断点で出力される信号に基き、起動さ
れるタイマ手段とを設け、該変化点の時間間隔を記録す
ることを特徴とする信号トレース方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57052073A JPS58169222A (ja) | 1982-03-30 | 1982-03-30 | 信号トレ−ス方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57052073A JPS58169222A (ja) | 1982-03-30 | 1982-03-30 | 信号トレ−ス方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58169222A true JPS58169222A (ja) | 1983-10-05 |
Family
ID=12904640
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57052073A Pending JPS58169222A (ja) | 1982-03-30 | 1982-03-30 | 信号トレ−ス方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58169222A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0773447A3 (en) * | 1995-11-13 | 1998-03-04 | Matsushita Electric Industrial Co., Ltd. | Time counting circuit, pulse converting circuit and FM demodulating circuit |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS49128642A (ja) * | 1973-04-07 | 1974-12-10 | ||
| JPS5559567A (en) * | 1978-10-27 | 1980-05-06 | Nec Corp | Error reproduction system for peripheral unit |
| JPS5679553A (en) * | 1979-12-03 | 1981-06-30 | Fujitsu Ltd | Line monitor |
-
1982
- 1982-03-30 JP JP57052073A patent/JPS58169222A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS49128642A (ja) * | 1973-04-07 | 1974-12-10 | ||
| JPS5559567A (en) * | 1978-10-27 | 1980-05-06 | Nec Corp | Error reproduction system for peripheral unit |
| JPS5679553A (en) * | 1979-12-03 | 1981-06-30 | Fujitsu Ltd | Line monitor |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0773447A3 (en) * | 1995-11-13 | 1998-03-04 | Matsushita Electric Industrial Co., Ltd. | Time counting circuit, pulse converting circuit and FM demodulating circuit |
| US5982841A (en) * | 1995-11-13 | 1999-11-09 | Matsushita Electric Industrial Co., Ltd. | Time counting circuit, pulse converting circuit and FM demodulating circuit |
| US6172557B1 (en) | 1995-11-13 | 2001-01-09 | Matsushita Electric Industrial Co., Ltd. | Time counting circuit, pulse converting circuit and FM demodulating circuit |
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