JPS58163265A - 並列接続多相サイリスタ電源制御装置 - Google Patents
並列接続多相サイリスタ電源制御装置Info
- Publication number
- JPS58163265A JPS58163265A JP4458282A JP4458282A JPS58163265A JP S58163265 A JPS58163265 A JP S58163265A JP 4458282 A JP4458282 A JP 4458282A JP 4458282 A JP4458282 A JP 4458282A JP S58163265 A JPS58163265 A JP S58163265A
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- JP
- Japan
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- current
- parallel
- converter
- circuit
- load coil
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
- H02M1/084—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters using a control circuit common to several phases of a multi-phase system
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Power Conversion In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は核Mf制#装置用のサイリスタ電源制御装置に
係り、特に、この電源回路を並列接続の多相整流回路と
したときく好適な電源制#装置に関する。
係り、特に、この電源回路を並列接続の多相整流回路と
したときく好適な電源制#装置に関する。
従来の多相サイリスタ電源の例を第1図に(12相電源
)を示す。図において、サイリスタ変換器2.3は変換
器用変圧器4.5を介して、位相が3011ずれた交流
T11−を供給されるため、12相[fi回路となる。
)を示す。図において、サイリスタ変換器2.3は変換
器用変圧器4.5を介して、位相が3011ずれた交流
T11−を供給されるため、12相[fi回路となる。
負荷コイル1を流れる電流は、制御装置13により所定
の電流が流れるよう制御されている。この制御装置11
3はDCCT6の出力をフィードバック値として取込み
、ポテンショメータ8による基準値との偏差を増幅器9
で増幅し、演算回路10に入力する。演算回路では制御
演算を行い、そ′の嫌作緻を決定し、位相回路11.1
2を介してサイリスタ変換器2.3のゲートを制御する
。
の電流が流れるよう制御されている。この制御装置11
3はDCCT6の出力をフィードバック値として取込み
、ポテンショメータ8による基準値との偏差を増幅器9
で増幅し、演算回路10に入力する。演算回路では制御
演算を行い、そ′の嫌作緻を決定し、位相回路11.1
2を介してサイリスタ変換器2.3のゲートを制御する
。
このフィードバック制御回路は第2図のような制御ブロ
ック図で示される。これより系の伝達関数は、 となる0位相制御回路11.12の特性は、必ずしも同
一でないため、KIは位相制御回路11によるKI′、
12によるに、″の間で変化する。これにより、制御系
の安定度が乱され、制御精度の低下をきたす。
ック図で示される。これより系の伝達関数は、 となる0位相制御回路11.12の特性は、必ずしも同
一でないため、KIは位相制御回路11によるKI′、
12によるに、″の間で変化する。これにより、制御系
の安定度が乱され、制御精度の低下をきたす。
また、K1′とに、″の差が著しい場合には、並列群間
の電流がアンバランスとなり、片方の変換器が過負荷と
なる。なお、7はレベル変換器である。
の電流がアンバランスとなり、片方の変換器が過負荷と
なる。なお、7はレベル変換器である。
本発明の目的は、並列接続の多相整流回路からなる電源
回路の並列群に流れる電流が、どの並列群も常に等しく
なるように制御できる電源制御装置を提供するにある。
回路の並列群に流れる電流が、どの並列群も常に等しく
なるように制御できる電源制御装置を提供するにある。
並列接続のサイリスタ変換器に灼して、それぞれ位相制
御回路出力が与えられている場合、位相制御1gl路の
特性、さらには、並列変換器の特性が多少違っているた
め、並列群を流れる電流がアンバランスとなる。これを
防止するため、奎列群の電流を検出し、これと負荷コイ
ル電流のl/n(n;並列数 12相でn=2)の値と
の偏差を求め、これをもとに補正値を作る。この補正値
で負荷コイルのwL流(電圧)フィードバック値と設定
電流(電圧)の偏差から求めた位相制御回路への操装置
を補正して変換器への宿性としている。
御回路出力が与えられている場合、位相制御1gl路の
特性、さらには、並列変換器の特性が多少違っているた
め、並列群を流れる電流がアンバランスとなる。これを
防止するため、奎列群の電流を検出し、これと負荷コイ
ル電流のl/n(n;並列数 12相でn=2)の値と
の偏差を求め、これをもとに補正値を作る。この補正値
で負荷コイルのwL流(電圧)フィードバック値と設定
電流(電圧)の偏差から求めた位相制御回路への操装置
を補正して変換器への宿性としている。
第3図に本発明の実施例を示す。これは位相制御回路の
特性差を電流で検出して、これを補肥しようとするもの
である。
特性差を電流で検出して、これを補肥しようとするもの
である。
サイリスタ変換器3を流れる電流をIl、サイリスタ変
換器2を流れる電流を工3、負荷コイル1を流れる電流
をIOとする。工。、II 、Itをそれぞれ とする。もし、位相制御回路11.12の特性が等しけ
ればα=β=0のはずである。I、、IいI(l Fi
DccTl 5.14.6により検出され、制御装置1
3に取込まれる。■。はレベル変換器7で1/2にレベ
ル変換されてI、、I、と比較される。増幅fi20に
は の偏差が人力する。増幅器19には の(lift差が人力する。これが位相制御回路11.
12の特性差を補正するための補正値となる。
換器2を流れる電流を工3、負荷コイル1を流れる電流
をIOとする。工。、II 、Itをそれぞれ とする。もし、位相制御回路11.12の特性が等しけ
ればα=β=0のはずである。I、、IいI(l Fi
DccTl 5.14.6により検出され、制御装置1
3に取込まれる。■。はレベル変換器7で1/2にレベ
ル変換されてI、、I、と比較される。増幅fi20に
は の偏差が人力する。増幅器19には の(lift差が人力する。これが位相制御回路11.
12の特性差を補正するための補正値となる。
一方、負荷コイルw11ILはレベル変換器7を介して
、ポテンショメータ8で設定される基11に値と比較さ
れる。この偏差を増@器9、演算器10を通して位相制
御回路の操作瞳が決定される。この操作−にi1シて(
6)式、(7)式で与えられる補正をガロえでいるので
、位相制御回路11.12のパルス出力で点弧されたサ
イリスタ変換42.3の@光出力電圧は等しくなるはず
である。
、ポテンショメータ8で設定される基11に値と比較さ
れる。この偏差を増@器9、演算器10を通して位相制
御回路の操作瞳が決定される。この操作−にi1シて(
6)式、(7)式で与えられる補正をガロえでいるので
、位相制御回路11.12のパルス出力で点弧されたサ
イリスタ変換42.3の@光出力電圧は等しくなるはず
である。
なお、図中、16はレベル変換器、17.18.20.
21.22.23は増幅器である。
21.22.23は増幅器である。
本発明によれば、並列接続のサイリスタ変換源において
も、位相*lJ御回路及びサイリスタ変換器の特性差を
補正するよう制御しているため、並列群を流れる(It
がアンバランスになることはない。
も、位相*lJ御回路及びサイリスタ変換器の特性差を
補正するよう制御しているため、並列群を流れる(It
がアンバランスになることはない。
このため、高精度の制御がロエ能となる。
第1図は従来の制御系統図、第2図は第1図の制御ブロ
ック図、@3図は本発明の実施例の系統図である。 1・・・負荷コイル、2.3・・・サイリスタ変換器、
4.5・・・変換器用トランス、6.14.15・・・
I)CCT。 7・・・レベル変換器、8・・・ポテンショメータ、9
.17.18.19.20.22.23・・・増幅器、
10・・・演算回路、11.12・・・位相制御回路、
13¥1目 茅2図
ック図、@3図は本発明の実施例の系統図である。 1・・・負荷コイル、2.3・・・サイリスタ変換器、
4.5・・・変換器用トランス、6.14.15・・・
I)CCT。 7・・・レベル変換器、8・・・ポテンショメータ、9
.17.18.19.20.22.23・・・増幅器、
10・・・演算回路、11.12・・・位相制御回路、
13¥1目 茅2図
Claims (1)
- 1、 並列接続多相整流回路、負荷コイルおよび負荷コ
イル電流検出器からなる#L電源回路制御装置であって
、電流フィードバック値のレベル変換器、電流設定器、
増幅器、演算回路および位相制御回路から嘴成されるも
のにおいて、並列変換11s群の*/leを取込み、こ
れと負荷コイル電流とで補正電圧を作り、@記位相制御
回路への操作緻を補正して、常に前記並列変換器を流れ
る電流が等しくなるように制御する回路を設けたことを
%倣とする並列接続多相サイリスタ電源制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4458282A JPS58163265A (ja) | 1982-03-23 | 1982-03-23 | 並列接続多相サイリスタ電源制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4458282A JPS58163265A (ja) | 1982-03-23 | 1982-03-23 | 並列接続多相サイリスタ電源制御装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58163265A true JPS58163265A (ja) | 1983-09-28 |
Family
ID=12695477
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4458282A Pending JPS58163265A (ja) | 1982-03-23 | 1982-03-23 | 並列接続多相サイリスタ電源制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58163265A (ja) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5312539B1 (ja) * | 1970-04-20 | 1978-05-01 |
-
1982
- 1982-03-23 JP JP4458282A patent/JPS58163265A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5312539B1 (ja) * | 1970-04-20 | 1978-05-01 |
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