JPS58155402A - 制御装置の同期運転方法 - Google Patents
制御装置の同期運転方法Info
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- JPS58155402A JPS58155402A JP3717182A JP3717182A JPS58155402A JP S58155402 A JPS58155402 A JP S58155402A JP 3717182 A JP3717182 A JP 3717182A JP 3717182 A JP3717182 A JP 3717182A JP S58155402 A JPS58155402 A JP S58155402A
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- control device
- analog
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- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B9/00—Safety arrangements
- G05B9/02—Safety arrangements electric
- G05B9/03—Safety arrangements electric with multiple-channel loop, i.e. redundant control systems
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Feedback Control In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔％明の技術分野〕
本発明はアナログ演算式の制御装置とディジタル＠真式
の１！ｌｌｌＩ４１Ｉ７Ｉｅ置を同期をとって運転する
制御装置の同期運転方法（＝関するものである。
の１！ｌｌｌＩ４１Ｉ７Ｉｅ置を同期をとって運転する
制御装置の同期運転方法（＝関するものである。
ル１図は２ｆｆｉの負荷にそれぞれアナログ演Ｓ制Ｍｌ
随およびディジタル演算制御装置を介して電匝を供紺す
る゛磁流制御装置のブロック図である。
随およびディジタル演算制御装置を介して電匝を供紺す
る゛磁流制御装置のブロック図である。
すなわち第１図（＝おいて、負荷ＩＡ、ＩＢはそれぞれ
サイリスタ電源２Ａ、２Ｂから給′題され、その電流値
１Ａ、ｉＢはそれぞれ電流検出！３Ａ、３Ｂで検出され
る。
サイリスタ電源２Ａ、２Ｂから給′題され、その電流値
１Ａ、ｉＢはそれぞれ電流検出！３Ａ、３Ｂで検出され
る。
′峨流基準発生器５は負荷ＩＡ、ＩＢの＠流基準１、Ａ
、 ＩｏＢをディジタル値であたえる。
、 ＩｏＢをディジタル値であたえる。
電流基準■。ＡはＤ／Ａ変換器６でアナログ値１０人口
変換されて電流検出値ｉＡと比較され、その差ΔＩＡす
なわち１゜Ａ−ｉＡはアナログ演算器７Ａで増幅されア
ナログ位相制御器４Ａを介してサイリスタ゛屯源２人の
点弧位相を制御し、これ（二よって負荷電流ＩＡを゛心
流基準値■。Ａ（：゛制御している。
変換されて電流検出値ｉＡと比較され、その差ΔＩＡす
なわち１゜Ａ−ｉＡはアナログ演算器７Ａで増幅されア
ナログ位相制御器４Ａを介してサイリスタ゛屯源２人の
点弧位相を制御し、これ（二よって負荷電流ＩＡを゛心
流基準値■。Ａ（：゛制御している。
一方′屯流基準値工。Ｂは電流検出値ＩＢをＡ／Ｄ変換
器９を通して得られたディジタル電流検出値ＩＢと比較
され、そ５の差ΔＩＢすなわち工。Ｂ −ＩＢはディジ
タル演算器７Ｂで増幅され、さらにＤ／Ａ ＆換器８で
アナログ１１１ｔに変換された後アナログ位相制御器４
Ｂを介してサイリスタ４源２Ｂの点弧位相を制御し、こ
れによって負荷電流ｉＢを電流基早臘ＩＢ＋：を制御し
ている。
器９を通して得られたディジタル電流検出値ＩＢと比較
され、そ５の差ΔＩＢすなわち工。Ｂ −ＩＢはディジ
タル演算器７Ｂで増幅され、さらにＤ／Ａ ＆換器８で
アナログ１１１ｔに変換された後アナログ位相制御器４
Ｂを介してサイリスタ４源２Ｂの点弧位相を制御し、こ
れによって負荷電流ｉＢを電流基早臘ＩＢ＋：を制御し
ている。
上記アナログ演算器７Ａは必要な比例、積分、ｌｌ分等
の演算をアナログ回路で行ない、ディジタル演算器７Ｂ
は同じくディジタル回路で行なうものであるが、−収に
ディジタル演算はアナログ演算に比較して演算時間が長
いので、上記Ｗ＆１図の構成では、負荷１人の４訛と負
荷ＩＢの電流とを同期して市Ｊ＠することが困難である
。
の演算をアナログ回路で行ない、ディジタル演算器７Ｂ
は同じくディジタル回路で行なうものであるが、−収に
ディジタル演算はアナログ演算に比較して演算時間が長
いので、上記Ｗ＆１図の構成では、負荷１人の４訛と負
荷ＩＢの電流とを同期して市Ｊ＠することが困難である
。
不発明は、アナログ演算式制御装置をディジタル演算式
制御装置を同期して制御する制御装置の同期運転方法を
提供することを目的としている。
制御装置を同期して制御する制御装置の同期運転方法を
提供することを目的としている。
本発明はアナログ演算器を用いた制御装置とディジタル
演算器を用いた制御装置が並列運転される制御％Ｉ装置
において、各演算器（；所定のサンプル周期をもった演
算タイミングをあたえると共に、各演算タイミングごと
畜；すべての演算器の演算が終了したことを条件として
各演算器の演算結果を同時（二実行する制御装置の同期
運転方法である。
演算器を用いた制御装置が並列運転される制御％Ｉ装置
において、各演算器（；所定のサンプル周期をもった演
算タイミングをあたえると共に、各演算タイミングごと
畜；すべての演算器の演算が終了したことを条件として
各演算器の演算結果を同時（二実行する制御装置の同期
運転方法である。
不発明の一実施例を第２図（−示す。
第２図は、それぞれサイリスタ”Ａｔ＃２Ａ、２Ｂから
給′鑞される負荷ＬＡ、Ｂの電流ＩＡ、ｉＢをディジタ
ル電流基準信号。Ａ＋ＩｏＢｔ二対応してそれぞれアナ
ログ演算器７Ａ 、ディジタル演算＠７Ｂで制御するこ
とは第１図と同じであるが、サイリスク電源２Ａ、２Ｂ
Ｏ点弧位相の１ｆｌｌ ｍ ｌニデイジタル位相制御器
１１Ａ 、 ＩＩＢを用いると共（−その実行タイミン
グの同期をとるためのタイミング同期回路１２が追加さ
れ、さら（二電流基準発生器５は電流基準信号ＩＯＡ、
Ｉ。Ｂの他Ｃ；、演算動作（：所定のサンプリング周期
をあたえるタイミング信号ＴＩＡ 、 ＴＩＢを出力す
るよう（；なっている。
給′鑞される負荷ＬＡ、Ｂの電流ＩＡ、ｉＢをディジタ
ル電流基準信号。Ａ＋ＩｏＢｔ二対応してそれぞれアナ
ログ演算器７Ａ 、ディジタル演算＠７Ｂで制御するこ
とは第１図と同じであるが、サイリスク電源２Ａ、２Ｂ
Ｏ点弧位相の１ｆｌｌ ｍ ｌニデイジタル位相制御器
１１Ａ 、 ＩＩＢを用いると共（−その実行タイミン
グの同期をとるためのタイミング同期回路１２が追加さ
れ、さら（二電流基準発生器５は電流基準信号ＩＯＡ、
Ｉ。Ｂの他Ｃ；、演算動作（：所定のサンプリング周期
をあたえるタイミング信号ＴＩＡ 、 ＴＩＢを出力す
るよう（；なっている。
以下第２図の動作を説明する。
′砿流基準工◎ＡはＤ／Ａ変換器６でアナログ値ｉ。Ａ
（二置換されて電流検出値ＩＡと比較され、その差Δｉ
Ａはアナログ演算器７Ａで演算増幅され、さら（ニタイ
ミング信号ＴＩＡ ｌ＝同期してＡ／Ｄ変換＆Ｆ１０で
ディジタル４１号（二便侠され、そのデータはディジタ
ル位相制御器１１Ａ（二人力されて保持される。
（二置換されて電流検出値ＩＡと比較され、その差Δｉ
Ａはアナログ演算器７Ａで演算増幅され、さら（ニタイ
ミング信号ＴＩＡ ｌ＝同期してＡ／Ｄ変換＆Ｆ１０で
ディジタル４１号（二便侠され、そのデータはディジタ
ル位相制御器１１Ａ（二人力されて保持される。
同様（二゛罐流基準Ｉ、Ｂは電流検出値ｉＢをＡ／Ｄ変
換器９を通して得られたディジタル電流検出値ＩＢと比
較され、その差ΔＩＢはタイ電ング信号ＴＩＢに同期し
てディジタル演算器７Ｂで演算され、その出力データは
ディジタル位相制御器１１Ｂ（：、入力されて保持され
る。
換器９を通して得られたディジタル電流検出値ＩＢと比
較され、その差ΔＩＢはタイ電ング信号ＴＩＢに同期し
てディジタル演算器７Ｂで演算され、その出力データは
ディジタル位相制御器１１Ｂ（：、入力されて保持され
る。
ζ０ときＡ／Ｄ変換器１０およびディジタル演算器７Ｂ
のそれぞれの動作完了タイミング信号Ｔ２人。
のそれぞれの動作完了タイミング信号Ｔ２人。
Ｔ０ｎはタイきング同期鱈踏１２（二印加１ｔする。
タイ建ング同期回路認はタイ擢ング償号Ｔ２人。
とＴ０ｎとの論理項てあたえられるタイ電ング信号Ｔ３
を出力し、上記ディジタル位相制御器Ｕ人、１１Ｂ毫二
対して同時６：トリガＩｆとしてあたえる。仁れ１；よ
って位相−御＠１１ｍ、ＩＩＢはそれぞれ保持されたデ
ータを位相制御備考として同時に出力し、ナイリスタ電
源話、 ２Ｂを周期して点弧させる。
を出力し、上記ディジタル位相制御器Ｕ人、１１Ｂ毫二
対して同時６：トリガＩｆとしてあたえる。仁れ１；よ
って位相−御＠１１ｍ、ＩＩＢはそれぞれ保持されたデ
ータを位相制御備考として同時に出力し、ナイリスタ電
源話、 ２Ｂを周期して点弧させる。
これ域＝よって負荷電流１ム、ｌＢの同期制御が実現で
きる。
きる。
上記説明は、サイリスタの点弧位相６；よる電流制御−
二ついて行なったが、電圧中速度などの制御４；ついて
も同様な同期運転が可能である。
二ついて行なったが、電圧中速度などの制御４；ついて
も同様な同期運転が可能である。
また第２図はアナログ制御回路１台、ディジタル制御回
路１台の場合を示したが、複数台の場合ニ一ついても同
様な同期運転が可能である。
路１台の場合を示したが、複数台の場合ニ一ついても同
様な同期運転が可能である。
以上説明したように不発ＢＡ（：よれば、アナログ演算
式の制御装置とディジタル演算式の制御装置が並列運転
される制御値［（二おいて、両方の制御を同期して運転
することが可能となる。
式の制御装置とディジタル演算式の制御装置が並列運転
される制御値［（二おいて、両方の制御を同期して運転
することが可能となる。
特にディジタル電子計算機を用いた制御システム（＝お
いて、−１１（”ｌ−安価なアナログ演算器を組合せる
ことが可能となるので、全体として経済的な制御システ
ムを実現することができる。
いて、−１１（”ｌ−安価なアナログ演算器を組合せる
ことが可能となるので、全体として経済的な制御システ
ムを実現することができる。
第１図は従来Ｏ制御装置の構成を示すブロック図、第２
図は本発明（二よる制御装置の同期運転方法の一実施例
を示すブロック図である。 ＩＡ、ＩＢ ｊＬ荷 録１．２Ｂ サイリスタ電源 話、 ３１１ 電流検出器 ４Ａ、４Ｂ アナログ位相制御餘 ５ 電流基準発生器 ６．８ Ｄ／Ａ変換器 ７ム アナログ演算器 ７Ｂ ディジタル演算器 ９．１０Ａ／Ｄ質ＩＩ＆器 １１Ａ、 ＩＩＢ ディジタル位相制御器１２
タイ々ング同期回路
図は本発明（二よる制御装置の同期運転方法の一実施例
を示すブロック図である。 ＩＡ、ＩＢ ｊＬ荷 録１．２Ｂ サイリスタ電源 話、 ３１１ 電流検出器 ４Ａ、４Ｂ アナログ位相制御餘 ５ 電流基準発生器 ６．８ Ｄ／Ａ変換器 ７ム アナログ演算器 ７Ｂ ディジタル演算器 ９．１０Ａ／Ｄ質ＩＩ＆器 １１Ａ、 ＩＩＢ ディジタル位相制御器１２
タイ々ング同期回路
Claims (1)
- アナログ演ｌＪｌ器を用いた制御装置とディジタル演算
器を用いた制御装置が並列運転される制御装置Ｍにおい
て、％演算器仁所定のサンプル周期をもった演算タイミ
ングをあたえると共−二、各演算タイミングとと（二す
べての演算器の演算が終了したことを条件として６演算
器の演算結果を同時（二実行することを特徴とする制御
装置の同期運転方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3717182A JPS58155402A (ja) | 1982-03-11 | 1982-03-11 | 制御装置の同期運転方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3717182A JPS58155402A (ja) | 1982-03-11 | 1982-03-11 | 制御装置の同期運転方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58155402A true JPS58155402A (ja) | 1983-09-16 |
Family
ID=12490144
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3717182A Pending JPS58155402A (ja) | 1982-03-11 | 1982-03-11 | 制御装置の同期運転方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58155402A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002257255A (ja) * | 2001-02-28 | 2002-09-11 | Ckd Corp | パイロット式電磁弁及び流体圧シリンダ |
-
1982
- 1982-03-11 JP JP3717182A patent/JPS58155402A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002257255A (ja) * | 2001-02-28 | 2002-09-11 | Ckd Corp | パイロット式電磁弁及び流体圧シリンダ |
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