JPH11312900A - 印刷回路板の素子の検証方法 - Google Patents

印刷回路板の素子の検証方法

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JPH11312900A
JPH11312900A JP11054598A JP5459899A JPH11312900A JP H11312900 A JPH11312900 A JP H11312900A JP 11054598 A JP11054598 A JP 11054598A JP 5459899 A JP5459899 A JP 5459899A JP H11312900 A JPH11312900 A JP H11312900A
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JP
Japan
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circuit board
printed circuit
board
image
scanner
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Application number
JP11054598A
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English (en)
Inventor
Cyntia Jane Whitehead
ジェーン ホワイトヘッド シンシア
Stephen J Foster
ジェイ フォスター スチーブン
Evan J Evans
ジェイ エバンス エバン
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Cyberoptics Corp
Original Assignee
Cyberoptics Corp
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    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R31/00Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
    • G01R31/28Testing of electronic circuits, e.g. by signal tracer
    • G01R31/302Contactless testing
    • G01R31/308Contactless testing using non-ionising electromagnetic radiation, e.g. optical radiation
    • G01R31/309Contactless testing using non-ionising electromagnetic radiation, e.g. optical radiation of printed or hybrid circuits or circuit substrates

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  • General Physics & Mathematics (AREA)
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  • Tests Of Electronic Circuits (AREA)

Abstract

(57)【要約】 【課題】 印刷回路板の素子の種類及び正しい配向につ
いての検証を可能にする改良型システムを提供する。 【解決手段】 素子を取付けた欠陥のない印刷回路板と
欠陥を含むか素子が誤って挿入された恐れのある印刷回
路板をスキャナ(12)により走査してそれらの回路板
全体の走査画像を発生・保存し、それらの保存画像をデ
ィスプレイ上の整合位置で交互に重ね合わせて表示する
ことにより印刷回路板の素子を検証する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は印刷回路板の素子を
試験及び修理するためのシステム及び方法に関し、さら
に詳細には、印刷回路板上の素子が正しく配置されてい
るか否かをスキャナ装置により検証する方法に関する。
【0002】
【従来の技術及び発明が解決しようとする課題】印刷回
路板は、電気絶縁性材料で形成した支持体の少なくとも
1つの側面に一連の導電性パスまたはリードを形成して
トレース及びパッドとしたものである。印刷回路板には
通常、複数の開口を形成し、各素子から延びるように導
電性ピンを挿入することによって回路板に素子を取付け
る。次いで、素子の導電性ピンと印刷回路板の導電性リ
ードとをはんだ付けして種々の素子間で必要な電気的接
続を行なう。
【0003】ところで、ある特定の回路板上において多
数の素子を交換、付加または除去したり、試験したりす
る必要がある場合、作業員のミスが発生することが多
い。例えば、素子には多くの種類があるが、それらの機
能はまったく異なるものの外観はほとんど同一である。
種々の素子を比較的隣接する場所に配置するように特定
の印刷回路板が設計されている場合、間違った所へ素子
を取付けたり、間違った所の素子を試験したり、間違っ
た所の素子の取外したりすることが多々ある。さらに、
集積回路及び他の素子には特定の極性をもつものが多
い。かかる素子の導電性ピンを正しい開口に挿入した場
合でも、その素子の向きが反対で、極性が反対になるこ
とがある。
【0004】印刷回路板の素子の検証を行うシステムと
しては種々のものが提案されているが、その一例として
1984年9月4日付けでRobert E. Whiteheadに発行
された米国特許第4,469,553号がある。この米
国特許のシステムは、例えばゲルベル(Gerber)データの
ような回路板のデータをコンピュータのプラズマスクリ
ーンからハーフミラーの上に投影する。印刷回路板はミ
ラーの下方に置く。回路板をミラーを通して見ると同時
にゲルベルデータと素子データを回路板と整合するミラ
ー上の位置に投影することにより、作業員はミラーを介
して回路板を視認し、ミラー上に投影されたゲルベルデ
ータと素子データをミラーの下の実際の回路板と相関さ
せることができる。
【0005】印刷回路板の素子及びその正しい配向につ
き検証を行う改良型システムに対する需要が存在する。
【0006】
【課題を解決するための手段】本発明による印刷回路板
の素子の検証方法は、素子を取付けた印刷回路板をスキ
ャナにより走査して回路板全体の走査画像を発生させる
ステップを含む。印刷回路板が欠陥を含まないことを確
認した後、その走査画像を欠陥を含まない印刷回路板の
走査画像としてメモリーに保存する。テストを受ける、
欠陥を含む恐れのある印刷回路板をスキャナにより走査
して回路板全体の走査画像を発生させる。テストを受け
る印刷回路板の走査画像をメモリーに保存する。欠陥を
含まない印刷回路板の保存画像と欠陥を含む恐れのある
印刷回路板の保存画像とをディスプレイ上において整合
する位置に交互に重ね合わせて、印刷回路板の素子が欠
陥を含むか或いはその配置が間違っているかの可視表示
が作業員に与えられるようにする。
【0007】
【発明の実施の形態】図1を参照して、本発明の方法は
総括的に参照番号10で示すワークステーションにより
実施される。ワークステーション10は、例えばHewlet
t-Packard社製のモデル6100Cのようなオプティキ
ャルスキャナ12を含む。スキャナ12は、欠陥のある
素子が取付けられていない「欠陥のない」印刷回路板
(「ゴールデンボード」14)の画像を発生させる。ス
キャナ12はまた、テストを受ける印刷回路板、即ち素
子の配置及び取付けが正しいか否かを検査中の「未検
証」ボード16を走査してその画像を発生させる。
【0008】スキャナ12の出力は、関連のキーボード
20を有するモニター18上に表示される。コンピュー
タのプロセッサ/メモリ22はスキャナ12が発生させ
た走査画像を保存し、スキャナ12及びディスプレイ1
8の動作を制御する。本発明は、ゴールデンボードの画
像と未検証ボードの画像を作業員が交互にディスプレイ
18上に表示させることにより未検証ボードの画像とゴ
ールデンボードの画像との光学的比較を可能にする。ス
キャナ12はX/Y位置決め機構に取付けた従来型カメ
ラにとって代わるものである。かくして、ゴールデンボ
ード14と未検証ボード16の全体画像を単一ステップ
で発生させることによりカメラの再配置が不要になる。
【0009】図2及び3を参照して、本発明方法のこれ
らのステップをブロック図で示す。テストはステップ3
0で開始される。ステップ32において、ゴールデンボ
ードとなりうるボードをスキャナ12の走査位置に配置
する。ステップ34において、CADデータをプロセッ
サ22から取出す。ステップ36において、CADデー
タを素子の種類ごとに分類する。ステップ38におい
て、最適の走査解像度を選択する。ステップ40におい
て、スキャナ12によりゴールデンボードを走査する。
ステップ48において、CADデータと走査により発生
させた画像とを整列させる。ステップ44において、ゴ
ールデンボード14に取付けた第1の素子を選択する。
ステップ46において、CADデータと素子を走査して
発生させたグラフィック画像とをディスプレイ18上に
表示させる。ステップ48において、作業員がディスプ
レイ18により素子の種類を検証する。ステップ50に
おいて、作業員が素子の位置を検証し、ステップ52に
おいて素子の配向を検証する。
【0010】ステップ54において、ゴールデンボード
14上に他に未検証の素子があるか否かを判定する。答
えが「YES」であれば、ステップ56において、CA
Dデータから次の素子を選び、ステップ46において、
次のステップを実行する。
【0011】ステップ54の答えが「NO」であれば、
ステップ58において、ゴールデンボードとなり得るボ
ードに何等かのエラーがあるか否かを判定する。もしエ
ラーが見つかれば、ステップ60において、これらのエ
ラーを修正し、ステップ32に戻る。ステップ58にお
いてエラーが見つからなければ、ステップ62におい
て、発生させた画像をメモリ22にゴールデンボード1
4として保存する。
【0012】その後、ステップ64において、未検証ボ
ード16をスキャナ12に配置する。ステップ66にお
いて、未検証ボードをスキャナ12により走査してその
画像を発生させメモリ/プロセッサ22に保存する。ス
テップ68において、ゴールデンボード14の画像をメ
モリ/プロセッサ22に入力する。
【0013】ステップ70において、ディスプレイ18
上に表示する点検に最適のウインドーサイズを選ぶ。ス
テップ72において、ゴールデンボード14の点検ウイ
ンドーサイズを選択し、ステップ74において、未検証
ボード14につき同じウインドーサイズを選ぶ。
【0014】図3を参照して、ステップ76において、
ゴールデンボード14の走査画像をディスプレイ18上
の点検ウインドーサイズについて迅速に表示させる。ス
テップ78において、未検証ボード16の走査画像をデ
ィスプレイ18上の同じウインドーサイズについて迅速
に表示させる。ステップ80において、2つの表示(ス
テップ76及び78からの)が相違するか否かの判定を
行う。もし判定結果が「YES」であれば、ステップ8
2において、キーボード20を走査してカーソルを表示
された画像の相違箇所に移動させる。ステップ84にお
いて、点検ウインドーのサイズを減少させる。ステップ
86において、ゴールデンボードのウインドーを選ぶ。
ステップ88において、未検証ボード16につき、減少
させた同じウインドーサイズを選ぶ。ステップ90にお
いて、ゴールデンボード14をディスプレイ18上の新
しいウインドーサイズにつき迅速に表示させる。ステッ
プ92において、スキャナ12により走査した未検証ボ
ード16の画像をディスプレイ18上の減少したウイン
ドーサイズにつき迅速に表示させる。その後、ステップ
94において、作業員はエラーのタイプを識別する。ス
テップ96において、そのエラーをエラー記録に記録す
る。
【0015】ステップ80において表示同士に相違がな
ければ、ステップ98において、未検証ボード16上に
さらに点検を要するウインドーがあるか否かを判定す
る。ステップ98の判断結果が「NO」であれば、ステ
ップ100において、未検証ボード16をスキャナ12
から取外す。その後、ステップ102において、さらに
別のボードを検証すべきか否かを判定する。もし答えが
「NO」であれば、ステップ104において、未検証ボ
ード16の出力エラーデータを修理のために出力し、ス
テップ106において、プロセスを終了させる。
【0016】ステップ98の答えが「YES」であれ
ば、プロセスはステップ72(図2)へ戻る。ステップ
102における答えが「YES」であれば、プロセスは
ステップ64(図2)へ戻る。
【0017】以上より、本発明は、ゴールデンボードと
未検証ボードを走査して走査画像を発生させた後表示さ
せて素子の種類の検証及びかかる素子が印刷回路板上に
正しく取付けられているか否かの検証を行うことを可能
にすることが分かる。
【0018】以上において、本発明を特定の実施例につ
き説明した。当業者にとっては種々の変形例及び設計変
更が想到されるであろうが、それは頭書した特許請求の
範囲に含まれる全ての変形例及び設計変更を包含するも
のであることを理解されたい。
【図面の簡単な説明】
【図1】 本発明の方法を実施するシステムのブロック
図である。
【図2】 印刷回路板の素子の検証を行う本発明方法の
ステップを説明するブロック図である。
【図3】 印刷回路板の素子の検証を行う本発明方法の
ステップを説明するブロック図である。 10 ワークステーション 12 スキャナ 18 デイスプレイ 20 キーボード 22 メモリ・プロセッサ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 スチーブン ジェイ フォスター アメリカ合衆国 テキサス州 75040 ガ ーランド ライムストーン 2502 (72)発明者 エバン ジェイ エバンス アメリカ合衆国 テキサス州 76225− 9764 アルボード プライヴェット・ロー ド 2593

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】印刷回路板の素子を検証する方法であっ
    て、 素子を取付けた欠陥のない印刷回路板をスキャナにより
    走査して回路板全体の走査画像を発生させ、 素子を取付けた欠陥のない印刷回路板の走査画像を保存
    し、 欠陥を含むか素子が誤って挿入された恐れのある印刷回
    路板をスキャナにより走査して回路板全体の走査画像を
    発生させ、 欠陥を含むか素子が誤って挿入された恐れのある印刷回
    路板の走査画像を保存し、 欠陥のない印刷回路板の保存画像と欠陥を含むか素子が
    誤って挿入された恐れのある印刷回路板の保存情報とを
    ディスプレイ上の整合する位置で交互に重ね合わせて表
    示するステップよりなる印刷回路板の素子の検証方法。
JP11054598A 1998-03-02 1999-03-02 印刷回路板の素子の検証方法 Pending JPH11312900A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US09/033358 1998-03-02
US09/033,358 US6049740A (en) 1998-03-02 1998-03-02 Printed circuit board testing system with page scanner

Publications (1)

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JPH11312900A true JPH11312900A (ja) 1999-11-09

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JP11054598A Pending JPH11312900A (ja) 1998-03-02 1999-03-02 印刷回路板の素子の検証方法

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