JPH11304602A - 半導体チップの応力分布検出方法 - Google Patents
半導体チップの応力分布検出方法Info
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Abstract
チップ実装される半導体チップにおける実装検査工程時
の応力分布を検出する方法を提供する。 【解決手段】半導体チップの表面にモアレ干渉検出用パ
ターンを形成し、応力の発生に伴うチップの変形を前記
パターンを用いたモアレ干渉法により検出する。チップ
表面に形成するモアレ干渉検出用パターンは、直線状、
縞状、同心円状、格子状のいずれかとすることが好まし
い。また、チップ表面にモアレ干渉検出用パターンを形
成する方法としては、異方性エッチングによりウェハに
溝を掘る方法、あるいは、フリップチップ実装後のチッ
プ表面に印刷や捺印によってパターンを付加する方法が
好ましい。
Description
装を施す半導体チップにおける実装検査工程時の応力分
布検出方法に関するものである。
ップをフェイスダウンして基板に接合するフリップチッ
プ実装技術が開発されている。フリップチップ実装では
チップと基板との間に金属ボールを配し、これらを一括
して溶融接合する。しかし、この際に発生する熱応力に
より、冷却時に接合部が断たれることがある。また、フ
リップチップ実装された基板の使用環境から生じる熱応
力によっても接合部が断たれることがある。フリップチ
ップ実装では、実装検査工程時に従来のワイヤボンディ
ング実装のように接合部を目視により確認することがで
きない。よって、接合部の状態は、これを介した全回路
の導通検査によって行われている。以上のことから、チ
ップに生じる熱応力を検出する方法、チップの応力分布
を検出し接合部の状態を予測する手法の確立が重要であ
る。
おける応力分布の従来の検出方法には、第一に、素子の
表面を鏡面にし、光学的干渉を用いて応力分布を検出す
る方法がある。この方法では素子に応力が発生すると表
面である鏡面に変形が生じ、これによって起こる光学的
干渉を観察することで応力分布を検出できる。次に、ピ
エゾ抵抗を配置した応力検出用の専用チップを用いる方
法が考えられる。この方法では、チップ内に応力が発生
しこれが変形する際に、ひずみによって変化するピエゾ
抵抗値を検出することで応力分布を検出できる。
布の検出方法において、素子の表面を鏡面にして光学的
干渉を用いて検出する方法は、検査方法は簡素であるも
のの、素子に鏡面を形成する工程にコストがかかる。ま
た、ピエゾ抵抗を配置した応力検出用の専用素子を用い
る方法は、測定装置は安価であるものの、一般の素子に
対しては応力分布を検出することができない。
のであり、その目的とするところは、比較的安価に且つ
簡素な検査方法で、フリップチップ実装される半導体チ
ップにおける実装検査工程時の応力分布を検出する方法
を提供することにある。
ば、上記の課題を解決するために、フリップチップ実装
を施す半導体チップに生じる応力の分布を検出する方法
において、半導体チップの表面にモアレ干渉検出用パタ
ーンを形成し、応力の発生に伴うチップの変形を前記パ
ターンを用いたモアレ干渉法により検出することを特徴
とするものである。ここで、半導体チップの表面に形成
するモアレ干渉検出用パターンは直線状、縞状、同心円
状、格子状のいずれかとすることが好ましい。半導体チ
ップの表面にモアレ干渉検出用パターンを形成する方法
としては、ウェハに溝を掘る、特に、異方性エッチング
を用いてV字状の溝を形成する方法が有効である。ま
た、ウェハ表面にパターンを付加する、特に、フリップ
チップ実装後のチップ表面に印刷や捺印によってパター
ンを付加する方法も好適である。
めの装置の外観を示す斜視図である。図中、1は半導体
チップ、2はフリップチップ実装基板である。半導体チ
ップ1は、フェイスダウンして基板2に実装されてい
る。Pはモアレ干渉検出用パターンであり、半導体チッ
プ1の表面(実装面と反対側の表面)に形成されてい
る。3はテレビカメラであり、フィルター用のモアレ干
渉検出用パターンP2を介して半導体チップ1の表面の
モアレ干渉検出用パターンPを撮影する。4はモニター
であり、テレビカメラ3により撮影されたモアレ干渉縞
を映し出している。半導体チップ1に加わる応力によ
り、半導体チップ1が変形すると、モアレ干渉縞が様々
に変化することにより、応力分布を検出することができ
る。
出用パターンを示す斜視図である。図2(a)は直線状
(縞状)のパターンであり、図1の実施例で使用してい
る。図2(b)は同心円状のパターン、図2(c)は格
子状のパターンである。このほかにも、モアレ干渉縞を
生じ得るパターンであれば、任意のパターンを使用でき
ることは言うまでもない。
(a)は直線状のパターンを使用した場合、図3(b)
は同心円状のパターンを使用した場合について、それぞ
れチップが変形したときに、観察されるモアレ干渉縞を
例示している。
レ干渉検出用パターンを形成する方法の一例を示す説明
図であり、図4(a)は半導体チップの外観を示す斜視
図、図4(b)はその要部断面図である。この例では、
半導体チップ1の製造過程において異方性エッチングに
より表面に溝5を掘る方法でモアレ干渉検出用パターン
を形成するものである。
レ干渉検出用パターンを形成する方法の他の一例を示す
説明図であり、この例では、ウェハの製造過程で母材1
0を覆う被覆材11にフォトリソグラフィ技術等を用い
て形成したマスク12の開口部から粒子照射等を施し
て、部分的に被覆材11を除去した部分を形成すること
により、図2(a)〜(c)に例示したようなモアレ干
渉検出用パターンを形成するものである。
レ干渉検出用パターンを形成する方法のさらに他の一例
を示す説明図であり、この例では、半導体チップ1をフ
リップチップ実装基板2に実装した後、印刷や捺印等に
よりモアレ干渉検出用パターンPを形成するものであ
る。例えば、インクジェットによる印刷であれば、半導
体チップ1に与える影響は少ないと考えられる。
レ干渉検出用パターンを形成する方法のさらに別の例を
示す説明図である。図7(a)は半導体チップの外観を
示す斜視図であり、図中のA−A’線についての断面構
造を図7(b)〜(d)に例示している。ここに示され
た方法は、半導体チップの製造過程においてモアレ干渉
検出用パターンを形成する方法である。
渉検出用パターンを形成する例であり、図中、1は半導
体チップ、6は酸化膜、7はレジスト、8はCuやAl
の微細配線層である。このようなCuやAlの微細配線
層を用いれば、半導体製造技術を用いて約0.3μmの
微細な線間隔のパターンを付加することができる。
出用パターンを形成する例であり、図中、1は半導体チ
ップ、6は酸化膜、9は窒化膜である。この例では、ウ
ェハに窒化膜を形成し、これをエッチングしてパターン
とするものであり、半導体製造技術を用いて約0.3μ
mの微細な線間隔のパターンを付加することができる。
出用パターンを形成する例であり、図中、1は半導体チ
ップ、6は酸化膜である。この例では、ウェハに酸化膜
を形成し、これをエッチングしてパターンとするもので
あり、半導体製造技術を用いて約0.3μmの微細な線
間隔のパターンを付加することができる。
の表面にモアレ干渉検出用パターンを形成し、応力の発
生に伴うチップの変形をこのパターンを用いたモアレ干
渉法により検出することで、素子内の応力分布をリアル
タイムに可視化することができる。これによって、応力
検出用の専用チップを用いずに一般のチップに対しても
応力分布を検出することができる。
表面に形成するモアレ干渉検出用パターンを直線状(縞
状)、同心円状、格子状とすることで、チップの平面内
の変形や反りなどの三次元変形を可視化しやすくするこ
とができ、チップの変形を検出しやすくすることができ
る。
製造過程において異方性エッチング等により表面に溝を
掘る方法でモアレ干渉検出用パターンを形成すれば、応
力検出用の専用チップを用いずに一般のチップに対して
も応力分布を検出することができる。
表面にモアレ干渉検出用パターンを付加することで、精
度の高い応力分布の検出ができる。さらに、半導体チッ
プの表面にモアレ干渉検出用パターンを形成する方法と
して、請求項5のように、フリップチップ実装後のチッ
プ表面に印刷や捺印によってパターンを付加すれば、ウ
ェハの裏面を鏡面にする必要がないので安価にパターン
を形成することができ、応力分布の検出ができる。これ
によって、応力検出用の専用チップを用いずに一般のチ
ップに対しても安価にかつ簡略な方法で応力分布を検出
することができる。
置の外観を示す斜視図である。
ンを示す斜視図である。
用パターンを形成する方法の一例を示す説明図であり、
(a)は半導体チップの外観を示す斜視図、(b)はそ
の要部断面図である。
用パターンを形成する方法の他の一例を示す断面図であ
る。
用パターンを形成する方法のさらに他の一例を示す斜視
図である。
用パターンを形成する方法を示す説明図であり、(a)
は半導体チップの外観を示す斜視図、(b)〜(d)は
その要部断面図である。
Claims (5)
- 【請求項1】 フリップチップ実装を施す半導体チッ
プに生じる応力の分布を検出する方法において、半導体
チップの表面にモアレ干渉検出用パターンを形成し、応
力の発生に伴うチップの変形を前記パターンを用いたモ
アレ干渉法により検出することを特徴とする半導体チッ
プの応力分布検出方法。 - 【請求項2】 半導体チップの表面に形成するモアレ
干渉検出用パターンは直線状、縞状、同心円状、格子状
のいずれかであることを特徴とする請求項1記載の半導
体チップの応力分布検出方法。 - 【請求項3】 半導体チップの表面にモアレ干渉検出
用パターンを形成する方法として半導体ウェハに溝を掘
ることを特徴とする請求項1又は2に記載の半導体チッ
プの応力分布検出方法。 - 【請求項4】 半導体チップの表面にモアレ干渉検出
用パターンを形成する方法として半導体ウェハ表面にパ
ターンを付加することを特徴とする請求項1又は2に記
載の半導体チップの応力分布検出方法。 - 【請求項5】 半導体チップの表面にモアレ干渉検出
用パターンを形成する方法としてフリップチップ実装後
のチップ表面に印刷や捺印によってパターンを付加する
ことを特徴とする請求項1又は2又は4に記載の半導体
チップの応力分布検出方法。
Priority Applications (1)
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JP10519098A JP3541671B2 (ja) | 1998-04-15 | 1998-04-15 | 半導体チップの応力分布検出方法 |
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-
1998
- 1998-04-15 JP JP10519098A patent/JP3541671B2/ja not_active Expired - Fee Related
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