JPH11265899A - Printed wiring board - Google Patents

Printed wiring board

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JPH11265899A
JPH11265899A JP8921198A JP8921198A JPH11265899A JP H11265899 A JPH11265899 A JP H11265899A JP 8921198 A JP8921198 A JP 8921198A JP 8921198 A JP8921198 A JP 8921198A JP H11265899 A JPH11265899 A JP H11265899A
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wiring board
tantalum oxide
brazing
oxide layer
layer
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Abstract

PROBLEM TO BE SOLVED: To provide a printed wiring board that is capable of withstanding the brazing temperature of wax with a high melting point and has a unwetting brazing layer which is efficiently formed in state of substrate aggregate (large size) prior to Au plating. SOLUTION: A tantalum oxide layer 15 is formed between a region 12a for brazing electronic components on a conductive circuit and a pad site 13a. The tantalum oxide layer 15 can withstand the melting point of Ag alloy wax. Therefore, even when an element 25 is brazed in an IC package 20 where the a printed wiring board 1 is such that the element 25 brazed later is brazed to a body 22 and a heat sink 21 for assembly, a non-wet brazing layer can be formed without fail. Also, the tantalum oxide layer 15 is not exposed to an Au plating layer 16, thus the tantalum oxide layer 15 is formed at a substrate aggregate stage.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、ICパッケージな
ど、半導体集積回路素子(以下、半導体素子若しくは単
に素子ともいう)などの電子部品が接合(搭載)される
セラミックなどからなる配線基板(回路基板)に関す
る。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a wiring board (circuit board) made of ceramic or the like to which electronic components such as a semiconductor integrated circuit element (hereinafter, also referred to as a semiconductor element or simply an element) such as an IC package are joined (mounted). ).

【0002】[0002]

【従来の技術】この種のセラミック製の配線基板(以
下、セラミック基板若しくは単に基板ともいう)では、
半導体素子をダイアタッチ面の素子(電子部品)ロウ付
け用領域にロウ付けする際などに、溶融ロウがその接合
面から他に濡れ拡がらないようにするため、必要に応じ
て適所にロウ不濡れ層を形成している。例えば、ダイア
タッチ面(導電回路のうちの素子取付け面)にAu合金
系ロウ(Au−Si系合金ロウやAu−Sn系合金ロ
ウ、Au−Ge系合金ロウなど)でロウ付けした半導体
素子の電極とその素子ロウ付け用領域に連なるボンディ
ングパッド部位(以下、パッド部位ともいう)とをワイ
ヤボンディングする場合には、そのパッド部位に素子ロ
ウ付け時の溶融ロウが濡れ拡がると、ワイヤボンディン
グ(以下、単にボンディングともいう)が困難となるた
め、このような濡れ拡がり(流れ)を防止するように、
素子ロウ付け用領域(接合面)とパッド部位との間にロ
ウ不濡れ層を形成している。
2. Description of the Related Art In a ceramic wiring board of this type (hereinafter, also referred to as a ceramic substrate or simply a substrate),
When a semiconductor element is brazed to an element (electronic component) brazing region on a die attach surface, for example, if necessary, a molten solder is not placed in an appropriate position to prevent the molten solder from spreading from the joint surface. A wetting layer is formed. For example, a semiconductor element brazed to a die attach surface (an element mounting surface of a conductive circuit) with an Au alloy-based solder (Au-Si-based alloy solder, Au-Sn-based alloy solder, Au-Ge-based alloy solder, or the like). When wire bonding is performed between an electrode and a bonding pad portion (hereinafter, also referred to as a pad portion) connected to the device brazing region, when the molten solder at the time of device brazing wets and spreads on the pad portion, wire bonding (hereinafter, referred to as “pad bonding”) is performed. , Simply referred to as bonding), so that such wetting spreading (flow) is prevented,
A brazing non-wetting layer is formed between the element brazing region (bonding surface) and the pad portion.

【0003】このようなロウ不濡れ層は、セラミック製
の配線基板でも導電回路(金属厚膜)が同時焼成されて
形成されるものの場合には、次のようにして形成でき
る。すなわち、導電回路をなすように、W(タングステ
ン)やMo(モリブデン)などの高融点金属を主成分と
するメタライズペーストを未焼成セラミック(グリーン
シート)に印刷した後、ロウ不濡れ層をなす必要箇所
に、前記の溶融ロウが濡れない例えばセラミックペース
トを塗布しておき、焼成することで、導電回路(金属厚
膜)上にセラミックからなるロウ不濡れ層を形成すると
いうものである。このように導電回路が同時焼成によっ
て形成されるものでは、ロウ不濡れ層はセラミックによ
って問題なく形成できる。
[0003] Such a wax non-wetting layer can be formed as follows in the case where a conductive circuit (thick metal film) is formed by simultaneously firing even a ceramic wiring board. That is, it is necessary to form a non-wetting layer after printing a metallizing paste mainly containing a refractory metal such as W (tungsten) or Mo (molybdenum) on an unfired ceramic (green sheet) so as to form a conductive circuit. For example, a ceramic paste which does not wet the above-mentioned molten solder is applied to the portion, and the paste is baked to form a wax non-wetting layer made of ceramic on the conductive circuit (thick metal film). In the case where the conductive circuit is formed by co-firing as described above, the braze non-wetting layer can be formed of ceramic without any problem.

【0004】ところで、電極ピッチの微小化や高密度化
のために高精度が要請される配線基板では、導電回路を
同時焼成によって形成するのは不向きである。このた
め、このような配線基板では焼成後のセラミック基板
に、スパッタリング、蒸着、或いはイオンプレーティン
グなどの物理蒸着法(以下、単にスパッタリングともい
う)によりTi(チタン)やMoなどの金属薄膜(以
下、単に薄膜という)を形成することで導電回路を形成
している。そして、従来、このように導電回路が薄膜で
形成されるものでは薄膜上にガラスや樹脂(ソルダーレ
ジストやポリイミド等)を塗布(印刷)したりしてロウ
不濡れ層としていた。
On the other hand, in the case of a wiring board which requires high precision for miniaturization and high density of electrode pitch, it is not suitable to form a conductive circuit by simultaneous firing. For this reason, in such a wiring substrate, a metal thin film (hereinafter, referred to as Ti (Ti) or Mo) is formed on a fired ceramic substrate by a physical vapor deposition method (hereinafter, also simply referred to as sputtering) such as sputtering, vapor deposition, or ion plating. , Simply referred to as a thin film) to form a conductive circuit. Conventionally, when the conductive circuit is formed of a thin film, glass or resin (solder resist, polyimide, or the like) is applied (printed) on the thin film to form a wax non-wetting layer.

【0005】[0005]

【発明が解決しようとする課題】ところが、例えば通信
用の配線(回路)基板を搭載した高周波用のICパッケ
ージのように、半導体素子がロウ付けされるセラミック
製の配線基板(部品)を、外部リード等の外部端子部材
やヒートシンク(放熱部材)などと一緒(同時)にAg
−Cu系合金ロウなどによってロウ付けしてICパッケ
ージとして組立て、その後、Auメッキ(金メッキ)す
ることで仕上げられるような配線基板では、ガラスや樹
脂によるロウ不濡れ層が形成できないといった問題があ
った。
However, for example, a ceramic wiring board (part) to which a semiconductor element is brazed, such as a high-frequency IC package on which a wiring (circuit) board for communication is mounted, is externally mounted. Ag together with (simultaneously with) external terminal members such as leads and heat sinks (radiation members)
In a wiring board that can be finished by brazing with a Cu-based alloy braze or the like, assembling it as an IC package, and then performing Au plating (gold plating), there is a problem that a brazing non-wetting layer made of glass or resin cannot be formed. .

【0006】というのは、このようなICパッケージの
組立てに使用される、Ag−Cu合金ロウの融点は約7
80℃以上あるのが普通であり、ロウ不濡れ層をガラス
や樹脂で形成した場合には、そのロウ付け温度に耐えら
れないためである。このように、薄膜で導電回路が形成
された回路基板でも、前記のようにロウ付けされて組み
立てられる高周波用のICパッケージなどではロウ不濡
れ層を形成できないといった問題があった。
The reason is that the melting point of the Ag-Cu alloy brazing used for assembling such an IC package is about 7 mm.
This is because the temperature is usually 80 ° C. or higher, and when the brazing non-wetting layer is formed of glass or resin, it cannot withstand the brazing temperature. As described above, there is a problem that even with a circuit board on which a conductive circuit is formed by a thin film, a wax non-wetting layer cannot be formed in a high-frequency IC package assembled by brazing as described above.

【0007】一方、このような問題に対しては、次のよ
うな技術を提案することもできる。すなわち、基板上の
薄膜の導電回路に、ロウに濡れにくい金属として例えば
Moをスパッタリングし、レジストを塗布し、所定のパ
ターンに露光・現像処理し、Mo薄膜をロウ不濡れ層と
するというものである。しかし、Mo等の薄膜でロウ不
濡れ層を形成する場合には、導電回路に、Niメッキ及
び仕上げのAuメッキをかけた後で形成しないといけな
い。というのは、Auメッキをかける前に形成すれば、
そのMo薄膜にAuメッキがかかってしまい、ロウ不濡
れ層とならないためである。
On the other hand, the following technique can be proposed to solve such a problem. That is, for example, Mo is sputtered onto a conductive circuit of a thin film on a substrate as a metal which is not easily wetted by a wax, a resist is applied, and a predetermined pattern is exposed and developed to make the Mo thin film a non-wetting layer. is there. However, when forming a non-wetting layer with a thin film of Mo or the like, it must be formed after Ni plating and finish Au plating are applied to the conductive circuit. Because if it is formed before applying Au plating,
This is because the Mo thin film is plated with Au and does not become a wax non-wetting layer.

【0008】したがって、前記のようなICパッケー
ジ、つまり配線基板(部品)をヒートシンクにAg−C
u系合金ロウによって、本体や外部リードなどと一緒に
ロウ付けし、その後、AuメッキすることでICパッケ
ージとして仕上げられるものでは、このように組立てて
仕上げた後で、そのロウ不濡れ層を形成することにな
る。しかし、こうしたICパッケージでは、配線基板の
なすダイアタッチ面(電子部品搭載面)が通常、ICパ
ッケージ本体の表面より低位となるように構成されるこ
とから、露光・現像用マスクとダイアタッチ面との間に
間隙ができるため、前記提案技術の実現は困難な場合が
多い。
Therefore, the IC package as described above, that is, the wiring board (parts) is used as a heat sink for the Ag-C
In the case where the IC package is finished by brazing together with the main body and external leads with a u-based alloy braze and then plating with Au, the non-wetting layer is formed after the assembly and finishing in this way. Will do. However, in such an IC package, the die attach surface (electronic component mounting surface) formed by the wiring board is usually configured to be lower than the surface of the IC package body. Since there is a gap between the two, it is often difficult to realize the proposed technique.

【0009】また、仮に実現可能であるとしても、仕上
げAuメッキ後のICパッケージ(配線基板)ごとに、
Mo等をスパッタリングすることになるため、極めて製
造効率が悪い。なお、フリップチップ接続方式の配線基
板のように、ダイアタッチ面が低位とならない平坦なも
のでは、前記のような露光・現像上の問題はないもの
の、それでもMo等のスパッタリングは仕上げのAuメ
ッキ後となる。したがって、このような配線基板におい
ても基板集合体(大判)を切断して1基板ごとに分割
し、要すれば外部リードをロウ付けし、そしてAuメッ
キした後でMo等をスパッタリングすることになるため
生産効率が悪い。
[0009] Even if it can be realized, for each IC package (wiring board) after finishing Au plating,
Since Mo or the like is sputtered, the production efficiency is extremely low. In the case of a flat substrate such as a flip-chip connection type wiring substrate in which the die attach surface does not become low, there is no problem in exposure and development as described above, but sputtering of Mo or the like is still performed after finishing Au plating. Becomes Therefore, even in such a wiring substrate, the substrate assembly (large format) is cut and divided into individual substrates, external leads are brazed if necessary, and after Au plating, Mo or the like is sputtered. Therefore, production efficiency is poor.

【0010】このように、ダイアタッチ面をなす導電回
路が金属薄膜により形成される配線基板では、ロウ不濡
れ層として、Ag−Cu合金ロウなどの高融点ロウのロ
ウ付け温度に耐え得る適切なものがなく、また同融点に
耐え得るとしても効率良く形成できるロウ不濡れ層は存
在しなかった。本発明は、こうした問題点に鑑みて成さ
れたもので、その目的とするところは、Ag−Cu合金
系ロウなどの高融点ロウのロウ付け温度に耐え得、しか
も、Auメッキ前の基板集合体(大判)の状態において
効率よく形成できるロウ不濡れ層を備えた配線基板を提
供することにある。
As described above, in a wiring board in which a conductive circuit forming a die attach surface is formed by a metal thin film, an appropriate non-wetting layer capable of withstanding the brazing temperature of a high melting point brazing such as an Ag-Cu alloy brazing. There was no wax non-wetting layer that could be formed efficiently even though it could withstand the same melting point. The present invention has been made in view of these problems, and an object of the present invention is to withstand the brazing temperature of a high melting point brazing such as an Ag-Cu alloy brazing, and to assemble a substrate assembly before Au plating. An object of the present invention is to provide a wiring board having a wax non-wetting layer that can be efficiently formed in a body (large format) state.

【0011】[0011]

【課題を解決するための手段】前記の目的を達成するた
め、本発明の配線基板は、導電回路上の適所に、溶融ロ
ウの濡れ拡がり防止手段として酸化タンタル層(Ta2
O5 層)を設けたことを特徴とする。
In order to achieve the above object, a wiring board according to the present invention is provided with a tantalum oxide layer (Ta2
O5 layer).

【0012】本発明では、ロウの濡れ拡がり防止手段
(ロウ不濡れ層)として酸化タンタル層を設けたため、
これによって、電子部品などを接合するロウの濡れ拡が
りが防止される。しかも酸化タンタル層は、Ag合金系
ロウのロウ付け温度(例えば800℃)にも問題なく耐
えられる。なお、酸化タンタル層は、ロウの濡れ拡がり
の起点と、濡れ拡がり防止の目的部位との間に、その目
的部位へのロウの濡れ拡がりを防止できるように適宜に
形成すればよい。
In the present invention, the tantalum oxide layer is provided as a means for preventing the wetting and spreading of the wax (the non-wetting layer for the wax).
This prevents the wetting and spreading of the brazing joining electronic components and the like. In addition, the tantalum oxide layer can withstand the brazing temperature (for example, 800 ° C.) of the Ag alloy brazing without any problem. The tantalum oxide layer may be appropriately formed between the starting point of the wetting and spreading of the wax and the target portion for preventing the wetting and spreading so as to prevent the wetting and spreading of the wax to the target portion.

【0013】また、このような酸化タンタル層は次のよ
うに、基板集合体の状態で効率よく形成できる。すなわ
ち、セラミック基板に、例えばTi、Moをスパッタリ
ングした後、レジスト塗布、露光・現像工程等を経て、
その上にNiメッキをかけて導電回路(Auメッキな
し)を形成する。そして、その上に窒化タンタル(Ta
2 N)をスパッタリングする。次いで、レジストを塗布
してマスクをセットして露光・現像し、エッチングして
窒化タンタル膜をロウ不濡れ層のパターンとし、レジス
トを除去した後、酸化処理する。すると、窒化タンタル
層の表面は酸化タンタル層となり、Niメッキ層の表面
は酸化ニッケル層となる。しかして、その後、還元処理
し、Niメッキ層の表面の酸化膜を除去する。こうする
ことで、酸化タンタル層は還元しないから、所望とする
部位(箇所)にロウ不濡れ層として、酸化タンタル層が
形成される。なお、その後、Auメッキをかけても酸化
タンタル層上には析出しないから、ロウの濡れ拡がりを
止められる。
Further, such a tantalum oxide layer can be efficiently formed in the state of a substrate aggregate as follows. That is, after sputtering, for example, Ti or Mo on a ceramic substrate, a resist coating, an exposure / development process, and the like are performed.
A conductive circuit (without Au plating) is formed by applying Ni plating thereon. Tantalum nitride (Ta)
2N) is sputtered. Next, a resist is applied, a mask is set, exposure and development are performed, etching is performed to form the tantalum nitride film into a pattern of a wax non-wetting layer, and after the resist is removed, oxidation treatment is performed. Then, the surface of the tantalum nitride layer becomes a tantalum oxide layer, and the surface of the Ni plating layer becomes a nickel oxide layer. Then, thereafter, a reduction treatment is performed to remove the oxide film on the surface of the Ni plating layer. By doing so, the tantalum oxide layer is not reduced, so that the tantalum oxide layer is formed as a wax non-wetting layer at a desired portion (location). After that, even if Au plating is applied, no precipitation occurs on the tantalum oxide layer, so that the wetting and spreading of the wax can be stopped.

【0014】このように、本発明によれば、最終的な仕
上げAuメッキ(金メッキ)前の基板集合体(基板単位
に分割前のいわゆる大判)の状態で、つまり多数の基板
に同一工程で、ロウの濡れ拡がり防止手段(ロウ不濡れ
層)を形成できるので、所望とするロウ不濡れ層及びこ
れを備えた配線基板が極めて効率的に製造できる。すな
わち、ヒートシンクや外部リード等と一緒にロウ付けさ
れて組立てられるようなICパッケージに使用される配
線基板であろうと、ワイヤボンディング接続タイプのI
Cパッケージ本体をなす配線基板であろうとも、配線基
板集合体の製造時に、ロウ不濡れ層が形成できる。
As described above, according to the present invention, in a state of a substrate assembly (a so-called large format before dividing into substrate units) before final Au plating (gold plating), that is, in a same process for many substrates, Since the means for preventing the wetting and spreading of the wax (wax non-wetting layer) can be formed, a desired wax non-wetting layer and a wiring board having the same can be manufactured very efficiently. That is, a wiring board used for an IC package that can be assembled by being brazed together with a heat sink and external leads, etc.
Even when the wiring board forms the C package body, a wax non-wetting layer can be formed when the wiring board assembly is manufactured.

【0015】本発明では、導電回路上の適所に、つまり
ロウの濡れ拡がりを防止したい適所に酸化タンタル層を
設ければよい。ボンディングパッド部位への濡れ拡がり
を防止したい場合には、導電回路上における同パッド部
位に溶融ロウが濡れ拡がらないように、その導電回路上
の適所に酸化タンタル層を設ければよい。このようにし
ておけば、導電回路上に半導体集積回路素子などの電子
部品をロウ付けした際でも、そのロウは電子部品の電極
とのボンディングのためのパッド部位に濡れ拡がらない
ことから、ロウ付け後のワイヤボンディングに支障を招
くこともない。なお、この場合、電子部品ロウ付け用領
域を包囲するように形成してもよいが、このように包囲
することなく、導電回路上におけるボンディングパッド
部位と電子部品ロウ付け用領域との間に酸化タンタル層
を設けておくことでもよい。
In the present invention, the tantalum oxide layer may be provided at an appropriate position on the conductive circuit, that is, at an appropriate position where it is desired to prevent the wet spreading of the wax. If it is desired to prevent the spread of the wet to the bonding pad portion, a tantalum oxide layer may be provided at an appropriate position on the conductive circuit so that the molten solder does not spread to the pad portion on the conductive circuit. In this way, even when an electronic component such as a semiconductor integrated circuit element is brazed on a conductive circuit, the brazing does not spread to a pad portion for bonding to an electrode of the electronic component. There is no hindrance to wire bonding after attachment. In this case, it may be formed so as to surround the electronic component brazing region. However, without surrounding in this way, oxidation between the bonding pad site and the electronic component brazing region on the conductive circuit is performed. A tantalum layer may be provided.

【0016】また、導電回路上における電子部品ロウ付
け用領域から溶融ロウが濡れ拡がらないように、その導
電回路上に酸化タンタル層を設けてもよい。このように
した場合には、接合用のロウ材層の厚さ不足を招くこと
もないので、接合の信頼性も高められる。ロウの濡れ拡
がりが大きいほど、ロウ材層の厚さ不足を招く原因とな
るが、電子部品ロウ付け用領域の周囲を包囲するように
酸化タンタル層を形成しておくことで、その濡れ拡がり
が止められる結果、ロウ材層の厚さ不足を招かない。
In addition, a tantalum oxide layer may be provided on the conductive circuit so that the molten solder does not spread from the soldering region of the electronic component on the conductive circuit. In this case, since the thickness of the brazing material layer for bonding does not become insufficient, the reliability of bonding can be improved. The greater the wetting spread of the brazing, the more the thickness of the brazing material layer becomes insufficient.However, by forming a tantalum oxide layer so as to surround the periphery of the electronic component brazing area, the wetting spreading is reduced. As a result, the thickness of the brazing material layer does not become insufficient.

【0017】[0017]

【発明の実施の形態】本発明に係る配線基板の実施の形
態について、図1ないし5を参照しながら詳細に説明す
る。図中1は、ICパッケージを構成する部品であっ
て、窒化アルミニウムからなる一定厚さのセラミック基
板2を主体とする配線基板であり、その1主面(上面)
にはTi薄膜3がスパッタリングにより形成され、その
上にMo薄膜4がスパッタリングにより形成されてい
る。そして、その上にNiメッキがかけられ、Niメッ
キ膜(層)5が形成され、同主面に図示しないビアに導
通する、Auメッキ前の導電回路11が形成されてい
る。そして、本例では同主面の導電回路11を図中左右
に2分するように、酸化タンタル層15が形成されてい
る。
DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of a wiring board according to the present invention will be described in detail with reference to FIGS. In the figure, reference numeral 1 denotes a component constituting an IC package, which is a wiring substrate mainly composed of a ceramic substrate 2 of aluminum nitride having a constant thickness, and one main surface (upper surface) thereof
Has a Ti thin film 3 formed by sputtering, and a Mo thin film 4 formed thereon by sputtering. Then, Ni plating is applied thereon to form a Ni plating film (layer) 5, and a conductive circuit 11 before Au plating, which is electrically connected to a via (not shown), is formed on the main surface. In this example, the tantalum oxide layer 15 is formed so as to divide the conductive circuit 11 on the main surface into two right and left sides in the figure.

【0018】すなわち、本例では、半導体素子がロウ付
けされる電子部品ロウ付け用領域(2点鎖線図示部)1
2aを含む部位12とボンディングパッド部位(2点鎖
線図示部)13aを含む部位13とを左右に区画するよ
うに、酸化タンタル層15が所定の幅(0.1〜0.2
mm)で配線基板1の導電回路11を横断するように形
成されている。ただし、酸化タンタル層15はその上面
がAuメッキ前の導電回路(Niメッキ膜5)11の上
面より0.1〜0.5μm高位となるように形成された
窒化タンタル層(Ta2 N)の表面を熱酸化してなるも
のである。
That is, in this example, the electronic component brazing region (the portion shown by the two-dot chain line) 1 to which the semiconductor element is to be brazed.
The tantalum oxide layer 15 has a predetermined width (0.1 to 0.2) so as to partition right and left a part 12 including 2a and a part 13 including a bonding pad part (a part shown by a two-dot chain line) 13a.
mm) so as to cross the conductive circuit 11 of the wiring board 1. However, the surface of the tantalum nitride layer (Ta2N) formed so that the upper surface thereof is higher than the upper surface of the conductive circuit (Ni plating film 5) 11 by 0.1 to 0.5 [mu] m before Au plating. Is thermally oxidized.

【0019】しかして、このような配線基板1は、図3
に示したように、別途製造されたCu−W合金製のヒー
トシンク(Niメッキ付き)21の上面に、ICパッケ
ージ本体(Niメッキ付きセラミックフレーム)22と
共に、所定のAgロウ箔(図示せず)を介して配置し、
さらに所定のAgロウ箔を介してNiメッキ付き外部リ
ード(コバール製)23を配置する。そして、この状態
の下で、例えば800℃に加熱してこれらをロウ付けし
て組み立てられるが、このロウ付け工程において酸化タ
ンタル層15はそのロウ付け温度にも問題なく耐えられ
る。そして、その後は、図4に示したように、仕上げメ
ッキとして導電回路11などの表面にAuメッキ層(A
uメッキ膜)16を所定厚さ(例えば1〜2μm)形成
することでICパッケージ20として完成するが、この
際には、酸化タンタル層15にはAuメッキがかからな
い。なお、酸化タンタル層15の上面はAuメッキ層1
6の上面より両者の厚さの相違に基いて低位となる。
The wiring board 1 as shown in FIG.
As shown in the figure, a predetermined Ag brazing foil (not shown) is provided on the upper surface of a separately manufactured heat sink (with Ni plating) 21 made of a Cu-W alloy, together with an IC package body (ceramic frame with Ni plating) 22. Placed through,
Further, an external lead (made of Kovar) 23 with Ni plating is arranged via a predetermined Ag brazing foil. Then, under these conditions, the assembly is performed by brazing by heating to 800 ° C., for example. In this brazing step, the tantalum oxide layer 15 can withstand the brazing temperature without any problem. Then, as shown in FIG. 4, an Au plating layer (A) is formed on the surface of the conductive circuit 11 or the like as finish plating.
The IC package 20 is completed by forming the u-plated film 16 to a predetermined thickness (for example, 1 to 2 μm), but in this case, the tantalum oxide layer 15 is not plated with Au. Note that the upper surface of the tantalum oxide layer 15 is
6 is lower than the upper surface of No. 6 based on the difference in thickness between the two.

【0020】したがって、その後は図5に示したよう
に、その配線基板1における電子部品ロウ付け用領域
(Auメッキ層16面上)12aに半導体素子25が例
えばAu−Si系ロウでロウ付けされるが、この際、溶
融ロウが濡れ拡がっても、その濡れ拡がりはその酸化タ
ンタル層15で止まり、ボンディングパッド部位13a
を含む領域には濡れ拡がらない。これにより、半導体素
子25の電極と配線基板1のパッド部位13aとはワイ
ヤ27によって問題なくワイヤボンディングすることが
できる。
Therefore, thereafter, as shown in FIG. 5, the semiconductor element 25 is brazed to the electronic component brazing region (on the Au plating layer 16 surface) 12a of the wiring board 1 by, for example, an Au-Si-based brazing. However, at this time, even if the molten solder spreads wet, the wet spread stops at the tantalum oxide layer 15 and the bonding pad portion 13a
Does not spread to the region containing. Thereby, the electrode of the semiconductor element 25 and the pad portion 13a of the wiring board 1 can be wire-bonded by the wire 27 without any problem.

【0021】なお、前記配線基板1は、窒化アルミニウ
ムの配線基板集合体の焼成、製造後、次のようにして製
造される(図6,図7参照)。すなわち、配線基板集合
体(図6,7−A参照)31の上面の所定部位に導電回
路11をスパッタリングにより形成する(図6,7−B
参照)。例えば、Ti薄膜を2000オングストローム
形成し、その上にMo薄膜を5000オングストローム
形成し、レジスト塗布、露光・現像工程を経て、さら
に、Niメッキを例えば1〜2μmかける。次に、導電
回路11の全面にスパッタリングにより、窒化タンタル
(Ta2 N)膜14を1000〜5000オングストロ
ームの厚さ形成する(図6,7−C参照)。
The wiring board 1 is manufactured as follows after firing and manufacturing the wiring board assembly of aluminum nitride (see FIGS. 6 and 7). That is, the conductive circuit 11 is formed on a predetermined portion of the upper surface of the wiring board assembly (see FIGS. 6, 7-A) 31 by sputtering (see FIGS. 6, 7-B).
reference). For example, a 2,000 angstrom thick Ti film is formed thereon, and a 5,000 angstrom thin Mo film is formed thereon, followed by resist coating, exposure and development steps, and then Ni plating, for example, by 1 to 2 μm. Next, a tantalum nitride (Ta2N) film 14 is formed on the entire surface of the conductive circuit 11 by sputtering to a thickness of 1000 to 5000 angstroms (see FIGS. 6 and 7-C).

【0022】そして、レジスト17を塗布し(図6,7
−D参照)、露光・現像してロウ不濡れ層をなす部位に
のみレジスト17を残存させる(図6,7−E参照)。
そして、エッチングによってロウ不濡れ層をなす部位を
除いて窒化タンタル膜14を除去し、ロウ不濡れ層をな
す部位に窒化タンタル膜14を残存させ、レジスト17
を除去する(図6,7−F参照)。すると、配線基板集
合体(セラミック大判)31の表面にはニッケルメッキ
膜5が露出し、ロウ不濡れ層をなす部位に窒化タンタル
層14が露出する。
Then, a resist 17 is applied (FIGS. 6 and 7).
-D), and the resist 17 is left only in a portion that forms a wax non-wetting layer by exposure and development (see FIGS. 6 and 7-E).
Then, the tantalum nitride film 14 is removed by etching except for the portion forming the wax non-wetting layer, and the tantalum nitride film 14 is left at the portion forming the wax non-wetting layer.
Is removed (see FIGS. 6, 7-F). Then, the nickel plating film 5 is exposed on the surface of the wiring board assembly (ceramic large format) 31, and the tantalum nitride layer 14 is exposed on the portion forming the brazing non-wetting layer.

【0023】次に、この配線基板集合体31を例えば5
00℃のドライエアー中などの酸化雰囲気下に通して酸
化処理し、Niメッキ膜と窒化タンタル層の表面を酸化
させ、それぞれ酸化Ni膜5aと酸化タンタル層15と
する(図6,7−G参照)。そして、水素雰囲気下70
0℃で還元熱処理する。すると、Niメッキ膜の酸化膜
は除去されるが、酸化タンタル層15は還元しない。こ
うして、Auメッキもかからず、しかもロウに濡れない
酸化タンタル層15がNiメッキ膜5に形成される(図
6,7−H参照)。以後、配線基板単位に切断すること
で、所望とするロウ不濡れ層すなわち酸化タンタル層1
5の形成された導電回路(Niメッキ付き)を備えた配
線基板(単体)が得られる。したがって、以後は前記し
たように、この配線基板を、ヒートシンク、ICパッケ
ージ本体、及び外部リードと共にセットし、ロウ付け
し、Auメッキをかけることで所望とするICパッケー
ジとして完成する。
Next, this wiring board assembly 31 is
The substrate is oxidized by passing it through an oxidizing atmosphere such as in dry air at 00 ° C. to oxidize the surfaces of the Ni plating film and the tantalum nitride layer to obtain a Ni oxide film 5a and a tantalum oxide layer 15, respectively (FIGS. 6, 7-G). reference). And under hydrogen atmosphere 70
A reduction heat treatment is performed at 0 ° C. Then, the oxide film of the Ni plating film is removed, but the tantalum oxide layer 15 is not reduced. In this way, the tantalum oxide layer 15 that does not undergo Au plating and is not wetted by the wax is formed on the Ni plating film 5 (see FIGS. 6 and 7H). Thereafter, by cutting into wiring board units, the desired wax non-wetting layer, that is, the tantalum oxide layer 1 is cut.
A wiring substrate (single unit) provided with the conductive circuit (with Ni plating) formed with No. 5 is obtained. Therefore, thereafter, as described above, this wiring board is set together with a heat sink, an IC package body, and external leads, brazed, and plated with Au to complete a desired IC package.

【0024】さて次に、図8及び9に基づいて本発明の
別形態例について説明するが、前記形態における配線基
板がICパッケージの部品であったのに対し、本例の配
線基板は、ワイヤボンディング接続タイプのICパッケ
ージ本体をなすものであるという点が相違するだけで、
本質的相違はないので相違点を中心に説明し、同一部位
には同一の符号を付し、適宜その説明を省略する。
Next, another embodiment of the present invention will be described with reference to FIGS. 8 and 9. The wiring board in this embodiment is a component of an IC package. The only difference is that it forms the IC package body of the bonding connection type.
Since there is no essential difference, the description will be focused on the difference, the same portions will be denoted by the same reference numerals, and the description thereof will be appropriately omitted.

【0025】すなわち、本例の配線基板41は、詳しく
は図示しないが、アルミナセラミックを積層してなる平
板状のもので、その上面の中央寄り部位に、前例と同様
の金属薄膜による導電回路11が形成されている。そし
て、この導電回路11のなす電子部品ロウ付け用領域1
2aと、その右側のボンディングパッド部位13aとの
間に、前例と同様の酸化タンタル層15が形成されてい
る。なお、基板41の上面周縁には、封止用リッド42
をハンダ付するため、導電回路11と同様の封止用金属
薄膜43が枠状に形成されている。そして、裏面に外部
リード23がロウ付けされ、酸化タンタル層15を除
き、導電回路11や封止用金属薄膜43などの表面にA
uメッキ層16がかけられている。
That is, although not shown in detail, the wiring board 41 of this embodiment is a flat plate formed by laminating alumina ceramics. Are formed. The electronic component brazing region 1 formed by the conductive circuit 11
A tantalum oxide layer 15 similar to the previous example is formed between 2a and the bonding pad portion 13a on the right side thereof. Note that a sealing lid 42 is provided on the periphery of the upper surface of the substrate 41.
Are formed in a frame shape in the same manner as the conductive circuit 11. Then, an external lead 23 is brazed to the back surface, and the surface of the conductive circuit 11 and the metal thin film 43 for sealing is removed except for the tantalum oxide layer 15.
The u plating layer 16 is applied.

【0026】このような本例の配線基板41は、前記形
態と同様に、酸化タンタル層15の形成まで基板集合体
において一括して形成できる。そして、その基板集合体
の製造後、基板単位に分割し、要すれば外部リード23
をロウ付けし、その後、導電回路11や封止用金属薄膜
43などの表面にAuメッキをかけることで外部リード
23付の配線基板41として完成する。そしてこの製造
過程おいて酸化タンタル層15は、外部リード23のロ
ウ付け温度にも問題ないし、Auメッキもかからない。
したがって、その後、半導体素子25をロウ付けして、
そのロウが濡れ拡がってもその濡れ拡がりは酸化タンタ
ル層15で止められ、ボンディングパッド部位13aに
は至らない。かくして、溶融ロウの濡れ拡がりを問題な
く防止できる。
The wiring board 41 of this embodiment can be formed collectively in the board assembly up to the formation of the tantalum oxide layer 15 as in the above embodiment. Then, after manufacturing the substrate assembly, the substrate assembly is divided into substrate units, and if necessary, external leads 23 are formed.
Then, the surfaces of the conductive circuit 11 and the metal thin film 43 for sealing are plated with Au to complete the wiring board 41 with the external leads 23. In this manufacturing process, the tantalum oxide layer 15 has no problem with the brazing temperature of the external leads 23 and does not require Au plating.
Therefore, after that, the semiconductor element 25 is brazed and
Even if the wax spreads, the wet spreading is stopped by the tantalum oxide layer 15 and does not reach the bonding pad portion 13a. Thus, the spread of the molten wax can be prevented without any problem.

【0027】なお、本例のような平坦な配線基板41で
は、仕上げAuメッキ後においてMo薄膜でロウ不濡れ
層を作ることもできる。しかし、前記もしたようにその
ようにする場合には、予め、基板単位に切断して1基板
ごとに外部リード23をロウ付けしてAuメッキし、そ
の下で、一基板ごとにMoをスパッタリングすることに
なるため、極めて製造効率が悪い。これに対し、本発明
によれば、前記の形態とまったく同様に、Auメッキ工
程前の基板集合体の状態で、一括して酸化タンタル層を
形成できるから極めて効率的に製造できる。
In the case of the flat wiring substrate 41 as in this example, a wax non-wetting layer can be formed with a Mo thin film after the finish Au plating. However, as described above, in such a case, in advance, the substrate is cut in units of a substrate, the external leads 23 are brazed for each substrate, Au plating is performed, and then Mo is sputtered for each substrate. Therefore, the production efficiency is extremely low. On the other hand, according to the present invention, the tantalum oxide layer can be formed collectively in the state of the substrate assembly before the Au plating step, and the production can be performed very efficiently, just like the above embodiment.

【0028】上記においては、ボンディングパッド部位
に、電子部品ロウ付用のロウが濡れ拡がらないように、
酸化タンタル層を形成した場合を説明したが、本発明に
おける酸化タンタル層はこのような目的のものに限定さ
れるものではない。外部リードのロウ付け時のロウが濡
れ拡がるのを防止するためなど、ひろく溶融ロウが濡れ
拡がるのを防止するように導電回路上の適所に設けるこ
とができる。
In the above, in order to prevent the solder for electronic component brazing from spreading to the bonding pad site.
Although the case where the tantalum oxide layer is formed has been described, the tantalum oxide layer in the present invention is not limited to such a purpose. It can be provided at an appropriate position on the conductive circuit so as to prevent the molten solder from spreading and spreading, for example, to prevent the solder from spreading when the external leads are brazed.

【0029】そして、酸化タンタル層の平面形態(パタ
ーン)は、濡れ拡がるロウの流れ方向などとの関係で、
目的部位に溶融ロウが濡れ拡がらないように適宜の形態
とすればよい。したがって、酸化タンタル層は、前記の
ように金属薄膜面を横断するように直線状に設ける必要
は必ずしもなく、パッド部位などの濡れ拡がり防止の目
的部位を完全に包囲する環状、或いは包囲することな
く、直線状、円弧状(曲線状)或いは「くの字形」など
として、ロウの濡れ拡がりの起点と、濡れ拡がり防止の
目的部位との間に、その目的部位へのロウの濡れ拡がり
を防止できるように設ければよい。また、酸化タンタル
層の幅は、使用されるロウの濡れ拡がり性やロウの設定
厚さ(量)などに応じ、その濡れ拡がりを阻止できる範
囲で適宜に設定すればよい。
The planar form (pattern) of the tantalum oxide layer is related to the flow direction of the wetting and spreading wax, and the like.
An appropriate form may be used so that the molten wax does not spread to the target site. Therefore, the tantalum oxide layer does not necessarily need to be provided linearly so as to cross the metal thin film surface as described above, and does not necessarily encircle the target portion such as the pad portion for preventing the spread of wetness, or does not surround the target portion. Between the starting point of the wetting and spreading of the wax and the target site for preventing the wetting and spreading, such as a straight line, an arc (curved shape), or a "C" shape, the wetting and spreading of the wax to the target site can be prevented. What is necessary is just to provide. Further, the width of the tantalum oxide layer may be appropriately set within a range in which the wetting and spreading can be prevented, depending on the wetting and spreading properties of the wax used, the set thickness (amount) of the wax, and the like.

【0030】上記においては、窒化アルミニウム(Al
N)又はアルミナを主成分とする配線基板で具体化した
場合を例示したが、ムライト、炭化けい素(SiC)な
どからなる配線基板でも同様に具体化できる。また、導
電回路をなす薄膜(Niメッキ下地)は上記では、Ti
及びMoとしたが、Moに代えてWでもよいし、Ti及
びPa(パラジウム)或いはTi及びAt(白金)など
としても、同様に酸化タンタル層を形成できる。なお、
本発明における配線基板は、ICパッケージの構成部品
としてのもの、さらには、ワイヤボンディング接続方式
のICパッケージ本体をなすものにおいても広く適用で
きる。
In the above, aluminum nitride (Al
Although the case where the present invention is embodied with a wiring substrate containing N) or alumina as a main component is exemplified, the present invention can be similarly embodied with a wiring substrate made of mullite, silicon carbide (SiC), or the like. Further, the thin film (underlying Ni plating) forming the conductive circuit is made of Ti
And Mo, W may be used instead of Mo, and a tantalum oxide layer can be formed in the same manner using Ti and Pa (palladium) or Ti and At (platinum). In addition,
The wiring board according to the present invention can be widely applied to components as components of an IC package, and further to those forming an IC package body of a wire bonding connection system.

【0031】[0031]

【発明の効果】以上の説明から明らかなように、本発明
に係る配線基板によれば、溶融ロウの濡れ拡がり防止手
段(ロウ不濡れ層)が酸化タンタル層(Ta2 O5 層)
からなるから、Ag−Cu合金系ロウなどの高融点ロウ
のロウ付け温度にも問題なく耐えられる。したがって、
導電回路が薄膜で形成された配線基板で、これがヒート
シンクに本体などと一緒にロウ付けされて組み立てられ
る高周波用のICパッケージなどでも、その後も問題な
くロウ不濡れ層となすことができる。したがって、本発
明によれば、ボンディングパッド部位など溶融ロウの濡
れ拡がりを防止したい目的部位と、溶融ロウの濡れ拡が
りの起点となる部位との間の適所に、酸化タンタル層を
設けておくことで、ロウ付け温度に影響されることな
く、ロウ付け後も問題なくロウの濡れ拡がりを防止でき
る。
As is apparent from the above description, according to the wiring board of the present invention, the means for preventing the molten wax from spreading and spreading (the non-wetting layer) is a tantalum oxide layer (Ta2 O5 layer).
, It can withstand the brazing temperature of a high melting point brazing such as an Ag-Cu alloy brazing without any problem. Therefore,
Even a high-frequency IC package or the like in which a conductive circuit is formed of a thin film and is assembled by being brazed to a heat sink together with a main body or the like can be used as a braze non-wetting layer without any problem thereafter. Therefore, according to the present invention, by providing a tantalum oxide layer at an appropriate position between a target portion, such as a bonding pad portion, where the wetting and spreading of the molten wax is to be prevented, and a portion serving as a starting point of the wetting and spreading of the molten wax. It is possible to prevent the spread and spread of the brazing without being affected by the brazing temperature and without any problem even after brazing.

【0032】また、酸化タンタル層にはAuメッキがか
からない上に、Auメッキ前の基板集合体(大判)の状
態においてこれを形成できるので、金属薄膜からなる導
電回路をもつ配線基板で、ロウ不濡れ層を備えたものが
効率的に製造できる。
Also, since the tantalum oxide layer is not plated with Au and can be formed in the state of a substrate assembly (large format) before Au plating, the wiring board having a conductive circuit made of a metal thin film can be used. Those having a wetting layer can be manufactured efficiently.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明に係る配線基板(配線基板)の実施形態
例を説明する概略断面図。
FIG. 1 is a schematic sectional view illustrating an embodiment of a wiring board (wiring board) according to the present invention.

【図2】図1の配線基板の平面図。FIG. 2 is a plan view of the wiring board of FIG. 1;

【図3】図1の配線基板をロウ付けしてICパッケージ
として組立てた状態の概略断面図。
FIG. 3 is a schematic cross-sectional view showing a state where the wiring board of FIG. 1 is brazed and assembled as an IC package.

【図4】図3のICパッケージにAuメッキをかけた状
態の説明用断面図。
FIG. 4 is an explanatory cross-sectional view showing a state where the Au package is applied to the IC package of FIG. 3;

【図5】図3のICパッケージの配線基板上に半導体素
子をロウ付けし、ボディングした図。
FIG. 5 is a diagram in which a semiconductor element is brazed on a wiring board of the IC package of FIG.

【図6】図1の配線基板の製造工程説明用の断面図。FIG. 6 is a sectional view for explaining a manufacturing process of the wiring board of FIG. 1;

【図7】図1の配線基板の製造工程図。FIG. 7 is a manufacturing process diagram of the wiring board of FIG. 1;

【図8】本発明に係る配線基板の別の実施形態例を説明
する概略断面図。
FIG. 8 is a schematic cross-sectional view illustrating another embodiment of the wiring board according to the present invention.

【図9】図8の配線基板の平面図。FIG. 9 is a plan view of the wiring board of FIG. 8;

【符号の説明】[Explanation of symbols]

1 配線基板 11 導電回路 12a 電子部品ロウ付け用領域 13a ボンディングパッド部位 15 酸化タンタル層 DESCRIPTION OF SYMBOLS 1 Wiring board 11 Conductive circuit 12a Electronic component brazing area 13a Bonding pad part 15 Tantalum oxide layer

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 導電回路上の適所に、溶融ロウの濡れ拡
がり防止手段として酸化タンタル層を設けたことを特徴
とする配線基板。
1. A wiring board, wherein a tantalum oxide layer is provided at an appropriate position on a conductive circuit as a means for preventing the molten wax from spreading.
【請求項2】 導電回路上におけるボンディングパッド
部位に溶融ロウが濡れ拡がらないように、その導電回路
上の適所に酸化タンタル層を設けたことを特徴とする配
線基板。
2. A wiring board, wherein a tantalum oxide layer is provided at an appropriate position on a conductive circuit so that molten solder does not spread to a bonding pad portion on the conductive circuit.
【請求項3】 導電回路上におけるボンディングパッド
部位と電子部品ロウ付け用領域との間に酸化タンタル層
を設けたことを特徴とする配線基板。
3. A wiring board, wherein a tantalum oxide layer is provided between a bonding pad site on a conductive circuit and an electronic component brazing region.
【請求項4】 導電回路上における電子部品ロウ付け用
領域から溶融ロウが濡れ拡がらないように、その導電回
路上に酸化タンタル層を設けたことを特徴とする配線基
板。
4. A wiring board, wherein a tantalum oxide layer is provided on a conductive circuit of a conductive circuit so that molten solder does not spread from an electronic component brazing region on the conductive circuit.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4557406B2 (en) * 2000-10-27 2010-10-06 京セラ株式会社 Package for pressure detection device
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