JPH1118078A - 映像信号処理装置およびその方法 - Google Patents
映像信号処理装置およびその方法Info
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- JPH1118078A JPH1118078A JP16242997A JP16242997A JPH1118078A JP H1118078 A JPH1118078 A JP H1118078A JP 16242997 A JP16242997 A JP 16242997A JP 16242997 A JP16242997 A JP 16242997A JP H1118078 A JPH1118078 A JP H1118078A
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Abstract
(57)【要約】
【課題】 デコーダの前段のＦＩＦＯがオーバーフロー
した場合でも、画像の劣化を最小限に押さえられる映像
信号処理装置を提供する 【解決手段】 映像信号Ｓ０を記憶し、映像信号Ｓ０を
入力順に読み出して出力するＦＩＦＯメモリ１３と、Ｆ
ＩＦＯメモリ１３のオーバーフローを検出する手段と、
ＦＩＦＯメモリ１３から出力された映像信号Ｓ１３を復
号するＭＰＥＧデコーダ１２と、復号された映像信号Ｓ
１２を入力して記憶し、制御信号Ｓ１５ｃに基づいて、
記憶された映像信号を入力された順序で読み出して順次
出力するか、あるいは、同一の映像信号を継続して出力
するメモリ１４と、オーバーフローが検出されたとき
に、当該オーバーフローの影響を受けていない同一の映
像信号を継続して出力することを指示する制御信号Ｓ１
５ｃをメモリ１４に出力するＣＰＵ１５とを有する。
した場合でも、画像の劣化を最小限に押さえられる映像
信号処理装置を提供する 【解決手段】 映像信号Ｓ０を記憶し、映像信号Ｓ０を
入力順に読み出して出力するＦＩＦＯメモリ１３と、Ｆ
ＩＦＯメモリ１３のオーバーフローを検出する手段と、
ＦＩＦＯメモリ１３から出力された映像信号Ｓ１３を復
号するＭＰＥＧデコーダ１２と、復号された映像信号Ｓ
１２を入力して記憶し、制御信号Ｓ１５ｃに基づいて、
記憶された映像信号を入力された順序で読み出して順次
出力するか、あるいは、同一の映像信号を継続して出力
するメモリ１４と、オーバーフローが検出されたとき
に、当該オーバーフローの影響を受けていない同一の映
像信号を継続して出力することを指示する制御信号Ｓ１
５ｃをメモリ１４に出力するＣＰＵ１５とを有する。
Description
【０００１】
【発明の属する技術分野】本発明は、映像信号処理装置
およびその方法に関する。
およびその方法に関する。
【０００２】
【従来の技術】画像処理技術や信号処理施技術の進展に
より、映像（動画像）信号を圧縮符号化する種々の方式
が提案され、実用化されつつある。このような種々の映
像符号化方式の中の高画質で高能率に符号化することが
できる方式の一つであり、広く使用されている方式にＭ
ＰＥＧ(Moving Picture coding Experts Group) による
高品質動画符号化方式がある。
より、映像（動画像）信号を圧縮符号化する種々の方式
が提案され、実用化されつつある。このような種々の映
像符号化方式の中の高画質で高能率に符号化することが
できる方式の一つであり、広く使用されている方式にＭ
ＰＥＧ(Moving Picture coding Experts Group) による
高品質動画符号化方式がある。
【０００３】ＭＰＥＧ方式を採用いたＡＶ(Audio Visua
l)信号処理装置では、エンコーダにおいて、入力画面を
ピクチャタイプ（Ｉ(Intra coded) ピクチャ、Ｐ(Predi
ctivecoded) ピクチャ、Ｂ(Bidirectionally predictiv
e coded)ピクチャ）に合わせて並べ替え、動き補償予測
エンコード処理、ＤＣＴ処理、量子化エンコード処理お
よびＶＬＣエンコード処理を行う。そして、得られた映
像信号を記録あるいは伝送した後に、デコーダにおいて
映像信号を復号する。このとき、デコーダでは、逆ＶＬ
Ｃ処理、量子化デコード処理、逆ＤＣＴ処理および動き
補償予測デコード処理を行う。なお、ＭＰＥＧ方式で
は、ランダムアクセスを可能にするために、画面内だけ
で閉じた情報による符号化ピクチャであるＩピクチャを
定期的に挿入し、このＩピクチャが少なくとも１枚入っ
たピクチャ群であるＧＯＰ(Group Of Pictures)単位と
して処理を行う場合がある。
l)信号処理装置では、エンコーダにおいて、入力画面を
ピクチャタイプ（Ｉ(Intra coded) ピクチャ、Ｐ(Predi
ctivecoded) ピクチャ、Ｂ(Bidirectionally predictiv
e coded)ピクチャ）に合わせて並べ替え、動き補償予測
エンコード処理、ＤＣＴ処理、量子化エンコード処理お
よびＶＬＣエンコード処理を行う。そして、得られた映
像信号を記録あるいは伝送した後に、デコーダにおいて
映像信号を復号する。このとき、デコーダでは、逆ＶＬ
Ｃ処理、量子化デコード処理、逆ＤＣＴ処理および動き
補償予測デコード処理を行う。なお、ＭＰＥＧ方式で
は、ランダムアクセスを可能にするために、画面内だけ
で閉じた情報による符号化ピクチャであるＩピクチャを
定期的に挿入し、このＩピクチャが少なくとも１枚入っ
たピクチャ群であるＧＯＰ(Group Of Pictures)単位と
して処理を行う場合がある。
【０００４】ＡＶ信号処理装置では、図４に示すよう
に、デコーダ２の前段に入力バッファメモリとしてＦＩ
ＦＯ(First In First Out)メモリ３が備えられいる。す
なわち、映像信号Ｓ０が、ＦＩＦＯ３に入力されて記憶
された後に、入力順に映像信号Ｓ３としてデコーダ２に
出力される。映像信号Ｓ３は、デコーダ２においてデコ
ードされ、映像信号Ｓ２として出力される。ＦＩＦＯ３
は、通常、オーバーフローやアンダーフローが生じない
ように、映像信号Ｓ０の入力および映像信号Ｓ３の出力
が制御されている。なお、ピクチャとは復号以前の圧縮
信号をいい、フレームとは復号された後の映像信号をい
う。
に、デコーダ２の前段に入力バッファメモリとしてＦＩ
ＦＯ(First In First Out)メモリ３が備えられいる。す
なわち、映像信号Ｓ０が、ＦＩＦＯ３に入力されて記憶
された後に、入力順に映像信号Ｓ３としてデコーダ２に
出力される。映像信号Ｓ３は、デコーダ２においてデコ
ードされ、映像信号Ｓ２として出力される。ＦＩＦＯ３
は、通常、オーバーフローやアンダーフローが生じない
ように、映像信号Ｓ０の入力および映像信号Ｓ３の出力
が制御されている。なお、ピクチャとは復号以前の圧縮
信号をいい、フレームとは復号された後の映像信号をい
う。
【０００５】
【発明が解決しようとする課題】しかしながら、上述し
た従来のＡＶ信号処理装置では、設定値以上の転送レー
トで入力されてしまった場合などが原因で、ＦＩＦＯ３
にオーバーフローが生じると、デコーダ２に出力される
映像信号が欠落し、デコーダ２において正確なデコード
処理を行うことができず、ブロックノイズなどが生じて
しまうという問題がある。また、オーバーフローによっ
て、ＦＩＦＯ３からデコーダ２に出力されるべきＩピク
チャが欠落すると、１ＧＯＰの間、画像が破綻してしま
う。また、上述した従来のＡＶ信号処理装置では、設定
値以下の転送レートで入力されてしまった場合などが原
因で、ＦＩＦＯ３にアンダーフローが生じると、アンダ
ーフローが解消され必要な映像信号Ｓ２がデコーダ２に
出力されるまで、デコーダ２から映像信号Ｓ２が出力さ
れなくなり、画像がフリーズする。
た従来のＡＶ信号処理装置では、設定値以上の転送レー
トで入力されてしまった場合などが原因で、ＦＩＦＯ３
にオーバーフローが生じると、デコーダ２に出力される
映像信号が欠落し、デコーダ２において正確なデコード
処理を行うことができず、ブロックノイズなどが生じて
しまうという問題がある。また、オーバーフローによっ
て、ＦＩＦＯ３からデコーダ２に出力されるべきＩピク
チャが欠落すると、１ＧＯＰの間、画像が破綻してしま
う。また、上述した従来のＡＶ信号処理装置では、設定
値以下の転送レートで入力されてしまった場合などが原
因で、ＦＩＦＯ３にアンダーフローが生じると、アンダ
ーフローが解消され必要な映像信号Ｓ２がデコーダ２に
出力されるまで、デコーダ２から映像信号Ｓ２が出力さ
れなくなり、画像がフリーズする。
【０００６】本発明は、上述した従来技術に鑑みてなさ
れ、デコーダの前段に設けられたＦＩＦＯがオーバーフ
ローしたときの画質の劣化を最小限に押さえ、高品質の
画像を安定して出力できる映像信号処理装置およびその
方法を提供することを目的とする。
れ、デコーダの前段に設けられたＦＩＦＯがオーバーフ
ローしたときの画質の劣化を最小限に押さえ、高品質の
画像を安定して出力できる映像信号処理装置およびその
方法を提供することを目的とする。
【０００７】
【課題を解決するための手段】上述した従来技術の問題
点を解決し、上述した目的を達成するために、本発明の
映像信号処理装置では、入力した映像信号を記憶し、当
該記憶した映像信号を前記入力順に読み出して出力する
第１の記憶手段と、前記第１の記憶手段にオーバーフロ
ーが発生したか否かを検出するオーバーフロー検出手段
と、前記第１の記憶手段から出力された映像信号を復号
する復号手段と、前記復号された映像信号を入力して記
憶し、制御信号に基づいて、記憶された映像信号を出力
する第２の記憶手段と、前記オーバーフロー検出手段の
検出結果に基づいて、オーバーフローが発生したとき
に、当該オーバーフローの影響を受けていない同一の映
像信号を継続して出力することを指示し、オーバーフロ
ーが発生していないときに、記憶された映像信号を前記
入力された順序で読み出して順次出力することを指示す
る前記制御信号を前記第２の記憶手段に出力する制御手
段とを有する。
点を解決し、上述した目的を達成するために、本発明の
映像信号処理装置では、入力した映像信号を記憶し、当
該記憶した映像信号を前記入力順に読み出して出力する
第１の記憶手段と、前記第１の記憶手段にオーバーフロ
ーが発生したか否かを検出するオーバーフロー検出手段
と、前記第１の記憶手段から出力された映像信号を復号
する復号手段と、前記復号された映像信号を入力して記
憶し、制御信号に基づいて、記憶された映像信号を出力
する第２の記憶手段と、前記オーバーフロー検出手段の
検出結果に基づいて、オーバーフローが発生したとき
に、当該オーバーフローの影響を受けていない同一の映
像信号を継続して出力することを指示し、オーバーフロ
ーが発生していないときに、記憶された映像信号を前記
入力された順序で読み出して順次出力することを指示す
る前記制御信号を前記第２の記憶手段に出力する制御手
段とを有する。
【０００８】また、本発明の映像信号処理装置は、好ま
しくは、前記制御手段は、前記オーバーフローが発生し
たときに、当該オーバーフローによって破綻した映像信
号のピクチャの直前のピクチャを復号した映像信号を継
続して出力することを指示する前記制御信号を前記第２
の記憶手段に出力する。
しくは、前記制御手段は、前記オーバーフローが発生し
たときに、当該オーバーフローによって破綻した映像信
号のピクチャの直前のピクチャを復号した映像信号を継
続して出力することを指示する前記制御信号を前記第２
の記憶手段に出力する。
【０００９】本発明の映像信号処理装置では、通常動作
時において、入力された映像信号が、第１の記憶手段に
記憶され、当該記憶された映像信号が前記入力順に読み
出されて、復号手段において復号された後に、第２の記
憶手段に記憶される。そして、この復号された映像信号
が、第２の記憶手段から、入力順に読み出されて出力さ
れる。一方、第１の記憶手段にオーバーフローが発生す
ると、オーバーフロー検出手段において当該オーバーフ
ローが検出される。そして、制御手段から制御信号が第
２の記憶手段に出力され、第２の記憶手段から、当該オ
ーバーフローの影響を受けていない同一の映像信号、例
えば、当該オーバーフローによって破綻した映像信号の
ピクチャの直前のピクチャを復号した同一の映像信号が
継続して出力される。
時において、入力された映像信号が、第１の記憶手段に
記憶され、当該記憶された映像信号が前記入力順に読み
出されて、復号手段において復号された後に、第２の記
憶手段に記憶される。そして、この復号された映像信号
が、第２の記憶手段から、入力順に読み出されて出力さ
れる。一方、第１の記憶手段にオーバーフローが発生す
ると、オーバーフロー検出手段において当該オーバーフ
ローが検出される。そして、制御手段から制御信号が第
２の記憶手段に出力され、第２の記憶手段から、当該オ
ーバーフローの影響を受けていない同一の映像信号、例
えば、当該オーバーフローによって破綻した映像信号の
ピクチャの直前のピクチャを復号した同一の映像信号が
継続して出力される。
【００１０】
【発明の実施の形態】以下、本発明の実施形態に係わる
ＡＶ信号処理装置およびその方法について説明する。図
１は、本実施形態のＡＶ信号処理装置１の構成図であ
る。図１に示すように、ＡＶ信号処理装置１は、ＦＩＦ
Ｏメモリ１３、ＭＰＥＧデコーダ１２、メモリ１４およ
びＣＰＵ(Central Processing Unit) １５を有する。図
２は、図１に示すＦＩＦＯメモリ１３の構成を説明する
ための図である。図２に示すように、ＦＩＦＯメモリ１
３は、ＤＲＡＭ(Dynamic Random AccessMemory)２２お
よびＤＲＡＭコントローラ２１を有する。ＦＩＦＯメモ
リ１３は、ＣＰＵ１５からの制御信号Ｓ１５ａに基づい
て、ＭＰＥＧ規格で圧縮符号化されたＡＶ信号Ｓ０をピ
クチャ単位で入力して記憶し、入力された順序でＡＶ信
号Ｓ１３としてＭＰＥＧデコーダ１２に出力する。
ＡＶ信号処理装置およびその方法について説明する。図
１は、本実施形態のＡＶ信号処理装置１の構成図であ
る。図１に示すように、ＡＶ信号処理装置１は、ＦＩＦ
Ｏメモリ１３、ＭＰＥＧデコーダ１２、メモリ１４およ
びＣＰＵ(Central Processing Unit) １５を有する。図
２は、図１に示すＦＩＦＯメモリ１３の構成を説明する
ための図である。図２に示すように、ＦＩＦＯメモリ１
３は、ＤＲＡＭ(Dynamic Random AccessMemory)２２お
よびＤＲＡＭコントローラ２１を有する。ＦＩＦＯメモ
リ１３は、ＣＰＵ１５からの制御信号Ｓ１５ａに基づい
て、ＭＰＥＧ規格で圧縮符号化されたＡＶ信号Ｓ０をピ
クチャ単位で入力して記憶し、入力された順序でＡＶ信
号Ｓ１３としてＭＰＥＧデコーダ１２に出力する。
【００１１】ＤＲＡＭ２２は、１ＧＯＰ分のＡＶ信号の
データ量より小さな記憶容量を備え、ＤＲＡＭコントロ
ーラ２１からの制御信号Ｓ２１ａに基づいて、ＡＶ信号
Ｓ０をピクチャ単位で入力して記憶し、入力された順序
でピクチャ単位でＡＶ信号Ｓ１３としてＭＰＥＧデコー
ダ１２に出力する。ＤＲＡＭコントローラ２１は、ＤＲ
ＡＭ２２に入力されるＡＶ信号Ｓ０のピクチャ数と、Ｄ
ＲＡＭ２２から出力されるＡＶ信号Ｓ１３のピクチャ数
とをカウントし、「（ＤＲＡＭ２２に入力されたピクチ
ャ数）−（ＤＲＡＭ２２から出力されたピクチャ数）」
を算出し、当該算出結果から求められるＤＲＡＭ２２に
記憶されているＡＶ信号のデータ量が、ＤＲＡＭ２２の
記憶容量を越えたときに、ＤＲＡＭ２２にオーバーフロ
ーが生じたことを検出する。このオーバーフローの検出
結果は信号Ｓ２１ｂとしてＣＰＵ１５に出力される。
データ量より小さな記憶容量を備え、ＤＲＡＭコントロ
ーラ２１からの制御信号Ｓ２１ａに基づいて、ＡＶ信号
Ｓ０をピクチャ単位で入力して記憶し、入力された順序
でピクチャ単位でＡＶ信号Ｓ１３としてＭＰＥＧデコー
ダ１２に出力する。ＤＲＡＭコントローラ２１は、ＤＲ
ＡＭ２２に入力されるＡＶ信号Ｓ０のピクチャ数と、Ｄ
ＲＡＭ２２から出力されるＡＶ信号Ｓ１３のピクチャ数
とをカウントし、「（ＤＲＡＭ２２に入力されたピクチ
ャ数）−（ＤＲＡＭ２２から出力されたピクチャ数）」
を算出し、当該算出結果から求められるＤＲＡＭ２２に
記憶されているＡＶ信号のデータ量が、ＤＲＡＭ２２の
記憶容量を越えたときに、ＤＲＡＭ２２にオーバーフロ
ーが生じたことを検出する。このオーバーフローの検出
結果は信号Ｓ２１ｂとしてＣＰＵ１５に出力される。
【００１２】ところで、ＡＶ信号Ｓ０の各ピクチャのヘ
ッダには、ＧＯＰ内での表示順序を示す番号ＴＲ(Tempo
ral Reference)が含まれている。ＤＲＡＭコントローラ
２１は、ＤＲＡＭ２２に入力されるＡＶ信号Ｓ０のピク
チャのヘッダを読み取り、このヘッダから、ＤＲＡＭ２
２に現在入力中のピクチャの番号ＴＲを得る。このピク
チャの番号ＴＲは、信号Ｓ２１ｂとしてＣＰＵ１５に出
力される。また、ＤＲＡＭコントローラ２１は、ＤＲＡ
Ｍ２２から出力されるＡＶ信号Ｓ１３のピクチャのヘッ
ダを読み取り、このヘッダから、ＭＰＥＧデコーダ１２
において現在デコードされているピクチャ、すなわち現
在表示中のピクチャの番号ＴＲを得る。このピクチャの
番号ＴＲは、信号Ｓ２１ｂとしてＣＰＵ１５に出力され
る。
ッダには、ＧＯＰ内での表示順序を示す番号ＴＲ(Tempo
ral Reference)が含まれている。ＤＲＡＭコントローラ
２１は、ＤＲＡＭ２２に入力されるＡＶ信号Ｓ０のピク
チャのヘッダを読み取り、このヘッダから、ＤＲＡＭ２
２に現在入力中のピクチャの番号ＴＲを得る。このピク
チャの番号ＴＲは、信号Ｓ２１ｂとしてＣＰＵ１５に出
力される。また、ＤＲＡＭコントローラ２１は、ＤＲＡ
Ｍ２２から出力されるＡＶ信号Ｓ１３のピクチャのヘッ
ダを読み取り、このヘッダから、ＭＰＥＧデコーダ１２
において現在デコードされているピクチャ、すなわち現
在表示中のピクチャの番号ＴＲを得る。このピクチャの
番号ＴＲは、信号Ｓ２１ｂとしてＣＰＵ１５に出力され
る。
【００１３】ＭＰＥＧデコーダ１２は、通常動作では、
ＦＩＦＯメモリ１３からのＡＶ信号Ｓ１３を、逆ＶＬＣ
処理、量子化デコード処理、逆ＤＣＴ処理および動き補
償予測デコード処理して復号し、復号されたＡＶ信号Ｓ
１２をメモリ１４に出力する。また、ＭＰＥＧデコーダ
１２は、ＣＰＵ１５から、デコード結果の破棄を示す制
御信号Ｓ１５ｂを入力すると、ＦＩＦＯメモリ１３にお
いて破綻したピクチャの影響がなくなるまで、デコード
結果を破棄する。このとき、ＦＩＦＯメモリ１３におい
てオーバーフローが発生してから、破綻したピクチャの
影響がなくなるまでに、最大１ＧＯＰ分のデコード結果
がＭＰＥＧデコーダ１２において破棄される。
ＦＩＦＯメモリ１３からのＡＶ信号Ｓ１３を、逆ＶＬＣ
処理、量子化デコード処理、逆ＤＣＴ処理および動き補
償予測デコード処理して復号し、復号されたＡＶ信号Ｓ
１２をメモリ１４に出力する。また、ＭＰＥＧデコーダ
１２は、ＣＰＵ１５から、デコード結果の破棄を示す制
御信号Ｓ１５ｂを入力すると、ＦＩＦＯメモリ１３にお
いて破綻したピクチャの影響がなくなるまで、デコード
結果を破棄する。このとき、ＦＩＦＯメモリ１３におい
てオーバーフローが発生してから、破綻したピクチャの
影響がなくなるまでに、最大１ＧＯＰ分のデコード結果
がＭＰＥＧデコーダ１２において破棄される。
【００１４】メモリ１４は、ＣＰＵ１５からの制御信号
Ｓ１５ｃに基づいて、通常動作では、ＰＥＧデコーダ１
２からのデコード（復号）されたＡＶ信号Ｓ１２を順次
に入力して記憶すると共に、記憶したＡＶ信号Ｓ１２の
フレームを入力順に読み出して、ＡＶ信号Ｓ１４として
出力する。また、メモリ１４は、ＣＰＵ１５からの制御
信号Ｓ１５ｃがフリーズを示す場合には、同じフレーム
のＡＶ信号Ｓ１４を継続して出力する。また、メモリ１
４は、ＣＰＵ１５からの制御信号Ｓ１５ｃがフリーズ解
除を示す場合には、前述した通常動作に戻る。
Ｓ１５ｃに基づいて、通常動作では、ＰＥＧデコーダ１
２からのデコード（復号）されたＡＶ信号Ｓ１２を順次
に入力して記憶すると共に、記憶したＡＶ信号Ｓ１２の
フレームを入力順に読み出して、ＡＶ信号Ｓ１４として
出力する。また、メモリ１４は、ＣＰＵ１５からの制御
信号Ｓ１５ｃがフリーズを示す場合には、同じフレーム
のＡＶ信号Ｓ１４を継続して出力する。また、メモリ１
４は、ＣＰＵ１５からの制御信号Ｓ１５ｃがフリーズ解
除を示す場合には、前述した通常動作に戻る。
【００１５】ＣＰＵ１５は、ＦＩＦＯメモリ１３から入
力された信号Ｓ２１ｂがオーバーフローを示すことを検
出すると、信号Ｓ２１ｂに示されるＤＲＡＭ２２に入力
中のピクチャの番号ＴＲに基づいて、オーバーフローに
よって破綻したピクチャを特定する。また、ＣＰＵ１５
は、この破綻が特定されたピクチャと、信号Ｓ２１ｂに
示されるＭＰＥＧデコーダ１２においてデコード中のピ
クチャの番号ＴＲとに基づいて、フリーズを示す制御信
号Ｓ１５ｃをメモリ１４に出力する。具体的には、ＣＰ
Ｕ１５は、フリーズを示す制御信号Ｓ１５ｃによって、
破綻が特定されたピクチャの一つ前のピクチャを復号し
たフレームをメモリ１４に記憶保持させ、このフレーム
のＡＶ信号Ｓ１４を継続して出力させるようにメモリ１
４を制御する。また、ＣＰＵ１５は、ＭＰＥＧデコーダ
１２に、破綻したピクチャの影響がなくなるまでデコー
ド結果を破棄することを示す制御信号Ｓ１５ｂをＭＰＥ
Ｇデコーダ１２に出力する。ＣＰＵ１５は、破綻したピ
クチャの影響が無くなると、フリーズ解除を示す制御信
号Ｓ１５ｃをメモリ１４に出力する。
力された信号Ｓ２１ｂがオーバーフローを示すことを検
出すると、信号Ｓ２１ｂに示されるＤＲＡＭ２２に入力
中のピクチャの番号ＴＲに基づいて、オーバーフローに
よって破綻したピクチャを特定する。また、ＣＰＵ１５
は、この破綻が特定されたピクチャと、信号Ｓ２１ｂに
示されるＭＰＥＧデコーダ１２においてデコード中のピ
クチャの番号ＴＲとに基づいて、フリーズを示す制御信
号Ｓ１５ｃをメモリ１４に出力する。具体的には、ＣＰ
Ｕ１５は、フリーズを示す制御信号Ｓ１５ｃによって、
破綻が特定されたピクチャの一つ前のピクチャを復号し
たフレームをメモリ１４に記憶保持させ、このフレーム
のＡＶ信号Ｓ１４を継続して出力させるようにメモリ１
４を制御する。また、ＣＰＵ１５は、ＭＰＥＧデコーダ
１２に、破綻したピクチャの影響がなくなるまでデコー
ド結果を破棄することを示す制御信号Ｓ１５ｂをＭＰＥ
Ｇデコーダ１２に出力する。ＣＰＵ１５は、破綻したピ
クチャの影響が無くなると、フリーズ解除を示す制御信
号Ｓ１５ｃをメモリ１４に出力する。
【００１６】以下、図１および図２に示すＡＶ信号処理
装置１の動作について説明する。図３は、ＡＶ信号処理
装置１の動作のフローチャートである。 ステップＳ１：図２にに示すＤＲＡＭコントローラ２１
において、ＤＲＡＭ２２に入力されるＡＶ信号Ｓ０のピ
クチャ数と、ＤＲＡＭ２２から出力されるＡＶ信号Ｓ１
３のピクチャ数とがカウントされ、「（ＤＲＡＭ２２に
入力されたピクチャ数）−（ＤＲＡＭ２２から出力され
たピクチャ数）」が算出され、当該算出結果とＲＡＭ２
２の記憶容量とから、ＤＲＡＭ２２にオーバーフローが
生じたか否かが判断される。このオーバーフローの判断
結果は信号Ｓ２１ｂとしてＣＰＵ１５に出力される。こ
のとき、オーバーフローと判断された場合にはステップ
Ｓ２の処理が実行され、オーバーフローではないと判断
された場合には再びステップＳ１の処理が行われる。
装置１の動作について説明する。図３は、ＡＶ信号処理
装置１の動作のフローチャートである。 ステップＳ１：図２にに示すＤＲＡＭコントローラ２１
において、ＤＲＡＭ２２に入力されるＡＶ信号Ｓ０のピ
クチャ数と、ＤＲＡＭ２２から出力されるＡＶ信号Ｓ１
３のピクチャ数とがカウントされ、「（ＤＲＡＭ２２に
入力されたピクチャ数）−（ＤＲＡＭ２２から出力され
たピクチャ数）」が算出され、当該算出結果とＲＡＭ２
２の記憶容量とから、ＤＲＡＭ２２にオーバーフローが
生じたか否かが判断される。このオーバーフローの判断
結果は信号Ｓ２１ｂとしてＣＰＵ１５に出力される。こ
のとき、オーバーフローと判断された場合にはステップ
Ｓ２の処理が実行され、オーバーフローではないと判断
された場合には再びステップＳ１の処理が行われる。
【００１７】ステップＳ２：ＣＰＵ１５において、ＦＩ
ＦＯメモリ１３から入力された信号Ｓ２１ｂがオーバー
フローを示すことが検出されると、信号Ｓ２１ｂに示さ
れるＤＲＡＭ２２に入力中のピクチャの番号ＴＲに基づ
いて、オーバーフローによって破綻したピクチャが特定
される。そして、ＣＰＵ１５において、この破綻が特定
されたピクチャと、信号Ｓ２１ｂに示されるＭＰＥＧデ
コーダ１２においてデコード中のピクチャの番号ＴＲと
に基づいて、フリーズを示す制御信号Ｓ１５ｃがメモリ
１４に出力される。これによって、メモリ１４において
フリーズ動作が行われ、破綻が特定されたピクチャの一
つ前のピクチャを復号したフレームの記憶が保持され、
このフレームがＡＶ信号Ｓ１４として、破綻したピクチ
ャの影響が無くなるまで、最長１ＧＯＰのフレームを出
力する時間だけ、継続して出力される。
ＦＯメモリ１３から入力された信号Ｓ２１ｂがオーバー
フローを示すことが検出されると、信号Ｓ２１ｂに示さ
れるＤＲＡＭ２２に入力中のピクチャの番号ＴＲに基づ
いて、オーバーフローによって破綻したピクチャが特定
される。そして、ＣＰＵ１５において、この破綻が特定
されたピクチャと、信号Ｓ２１ｂに示されるＭＰＥＧデ
コーダ１２においてデコード中のピクチャの番号ＴＲと
に基づいて、フリーズを示す制御信号Ｓ１５ｃがメモリ
１４に出力される。これによって、メモリ１４において
フリーズ動作が行われ、破綻が特定されたピクチャの一
つ前のピクチャを復号したフレームの記憶が保持され、
このフレームがＡＶ信号Ｓ１４として、破綻したピクチ
ャの影響が無くなるまで、最長１ＧＯＰのフレームを出
力する時間だけ、継続して出力される。
【００１８】ステップＳ３：ＣＰＵ１５からＭＰＥＧデ
コーダ１２に制御信号Ｓ１５ｂが出力され、破綻したピ
クチャの影響がなくなるまで、すなわち、フリーズが解
除されるまで、ＭＰＥＧデコーダ１２においてデコード
結果が破棄される。
コーダ１２に制御信号Ｓ１５ｂが出力され、破綻したピ
クチャの影響がなくなるまで、すなわち、フリーズが解
除されるまで、ＭＰＥＧデコーダ１２においてデコード
結果が破棄される。
【００１９】ステップＳ４：破綻したピクチャの影響が
無くなると、ＣＰＵ１５からフリーズを解除することを
示す制御信号Ｓ１５ｂ，Ｓ１５ｃが、それぞれＭＰＥＧ
デコーダ１２およびメモリ１４に出力される。これによ
って、ＭＰＥＧデコーダ１２およびメモリ１４が通常動
作に戻る。
無くなると、ＣＰＵ１５からフリーズを解除することを
示す制御信号Ｓ１５ｂ，Ｓ１５ｃが、それぞれＭＰＥＧ
デコーダ１２およびメモリ１４に出力される。これによ
って、ＭＰＥＧデコーダ１２およびメモリ１４が通常動
作に戻る。
【００２０】以上説明したように、ＡＶ信号処理装置１
によれば、ＦＩＦＯメモリ１３においてオーバーフロー
が発生した場合でも、オーバーフローによって破綻した
ピクチャの直前のピクチャを復号したフレームをＡＶ信
号Ｓ１４として、破綻したピクチャの影響が無くなるま
で、継続して出力する。その結果、破綻したピクチャの
影響でＭＰＥＧデコーダ１２において正確にデコードさ
れたなかったフレームが、ＡＶ信号Ｓ１４として出力さ
れることを効果的に防止でき、出力される画像にブロッ
クノイズが発生することを効果的に抑制できる。
によれば、ＦＩＦＯメモリ１３においてオーバーフロー
が発生した場合でも、オーバーフローによって破綻した
ピクチャの直前のピクチャを復号したフレームをＡＶ信
号Ｓ１４として、破綻したピクチャの影響が無くなるま
で、継続して出力する。その結果、破綻したピクチャの
影響でＭＰＥＧデコーダ１２において正確にデコードさ
れたなかったフレームが、ＡＶ信号Ｓ１４として出力さ
れることを効果的に防止でき、出力される画像にブロッ
クノイズが発生することを効果的に抑制できる。
【００２１】本発明は上述した実施形態には限定されな
い。例えば、上述した実施形態では、ＤＲＡＭコントロ
ーラ２１において、「（ＤＲＡＭ２２に入力されたピク
チャ数）−（ＤＲＡＭ２２から出力されたピクチャ
数）」が算出され、当該算出結果とＲＡＭ２２の記憶容
量とから、オーバーフローの検出を行っていたが、ＦＩ
ＦＯメモリ１３として、オーバーフローを検出するオー
バーフロー検出機能付きのものを用いてもよい。また、
ＤＲＡＭコントローラ２１において、ＡＶ信号Ｓ０の入
力レートと、ＡＶ信号Ｓ１３の出力レートと、ＦＩＦＯ
メモリ１３の記憶容量とに基づいて、ＦＩＦＯメモリ１
３におけるオーバーフローを検出するようにしてもよ
い。
い。例えば、上述した実施形態では、ＤＲＡＭコントロ
ーラ２１において、「（ＤＲＡＭ２２に入力されたピク
チャ数）−（ＤＲＡＭ２２から出力されたピクチャ
数）」が算出され、当該算出結果とＲＡＭ２２の記憶容
量とから、オーバーフローの検出を行っていたが、ＦＩ
ＦＯメモリ１３として、オーバーフローを検出するオー
バーフロー検出機能付きのものを用いてもよい。また、
ＤＲＡＭコントローラ２１において、ＡＶ信号Ｓ０の入
力レートと、ＡＶ信号Ｓ１３の出力レートと、ＦＩＦＯ
メモリ１３の記憶容量とに基づいて、ＦＩＦＯメモリ１
３におけるオーバーフローを検出するようにしてもよ
い。
【００２２】また、上述した実施形態では、ＡＶ信号を
処理する場合を例示したが、本発明は、映像信号のみを
処理する場合にも同様に適用できる。
処理する場合を例示したが、本発明は、映像信号のみを
処理する場合にも同様に適用できる。
【００２３】
【発明の効果】以上説明したように、本発明によれば、
第１の記憶手段がオーバーフローした場合に発生する画
質の劣化を最小限に押さえ、高画質な画像を安定して出
力できる。
第１の記憶手段がオーバーフローした場合に発生する画
質の劣化を最小限に押さえ、高画質な画像を安定して出
力できる。
【図１】図１は、本発明の実施形態のＡＶ信号処理装置
の構成図である。
の構成図である。
【図２】図２は、図１に示すＦＩＦＯメモリの構成を説
明するための図である。
明するための図である。
【図３】図３は、図１に示すＡＶ信号処理装置の動作の
フローチャートである。
フローチャートである。
【図４】図４は、従来のＡＶ信号処理装置の構成図であ
る。
る。
１…ＡＶ信号処理装置、２，１２…ＭＰＥＧデコーダ、
３，１３…ＦＩＦＯ、１４…メモリ、１５…ＣＰＵ、２
１…ＤＲＡＭコントローラ、２２…ＤＲＡＭ
３，１３…ＦＩＦＯ、１４…メモリ、１５…ＣＰＵ、２
１…ＤＲＡＭコントローラ、２２…ＤＲＡＭ
Claims (9)
- 【請求項１】入力した映像信号を記憶し、当該記憶した
映像信号を前記入力順に読み出して出力する第１の記憶
手段と、 前記第１の記憶手段にオーバーフローが発生したか否か
を検出するオーバーフロー検出手段と、 前記第１の記憶手段から出力された映像信号を復号する
復号手段と、 前記復号された映像信号を入力して記憶し、制御信号に
基づいて、記憶された映像信号を出力する第２の記憶手
段と、 前記オーバーフロー検出手段の検出結果に基づいて、オ
ーバーフローが発生したときに、当該オーバーフローの
影響を受けていない同一の映像信号を継続して出力する
ことを指示し、オーバーフローが発生していないとき
に、記憶された映像信号を前記入力された順序で読み出
して順次出力することを指示する前記制御信号を前記第
２の記憶手段に出力する制御手段とを有する映像信号処
理装置。 - 【請求項２】前記制御手段は、前記オーバーフローが発
生したときに、当該オーバーフローによって破綻した映
像信号のピクチャの直前のピクチャを復号した映像信号
を継続して出力することを指示する前記制御信号を前記
第２の記憶手段に出力する請求項１に記載の映像信号処
理装置。 - 【請求項３】復号前の前記映像信号に含まれる複数のピ
クチャのそれぞれに、復号後に表示する順序を示す表示
番号データが付されており、 前記第１の記憶手段に入力された映像信号のピクチャの
表示番号データを読み取る読み取り手段をさらに有し、 前記制御手段は、前記読み取られた表示番号データおよ
び前記オーバーフロー検出手段の検出結果から、オーバ
ーフローによって破綻したピクチャを特定し、 当該特定されたピクチャが前記復号手段における復号に
与える影響が無くなるまで同一の映像信号を継続して出
力することを指示する制御信号を前記第２の記憶手段に
出力する請求項１に記載の映像信号処理装置。 - 【請求項４】前記制御手段は、前記特定されたピクチャ
が前記復号手段における復号に与える影響が無くなる
と、記憶された映像信号を前記入力された順序で読み出
して順次出力することを指示する制御信号を前記第２の
記憶手段に出力する請求項３に記載の映像信号処理装
置。 - 【請求項５】前記復号手段は、入力された映像信号に含
まれるピクチャを他のピクチャを参照して復号し、前記
オーバーフローが検出されると、当該オーバーフローに
よって破綻したピクチャから影響を受ける復号結果を破
棄する請求項１に記載の映像信号処理装置。 - 【請求項６】前記オーバーフロー検出手段は、前記第１
の記憶手段に入力された映像信号に含まれるピクチャの
数から、前記第１の記憶手段から出力された映像信号に
含まれるピクチャの数を減算した減算値から求められる
前記第１の記憶手段に記憶されている映像信号のデータ
量が、前記記憶手段の記憶容量を越えたときに、オーバ
ーフローが発生したことを検出する請求項１に記載の映
像信号処理装置。 - 【請求項７】前記映像信号には、画面内で閉じた情報に
よる符号化ピクチャであるＩピクチャを定期的に挿入
し、このＩピクチャが少なくとも１枚入ったピクチャ群
であるＧＯＰが規定されており、 前記第１の記憶手段は、１個のＧＯＰに属するピクチャ
のデータ量より小さい記憶容量を有する請求項１に記載
の映像信号処理装置。 - 【請求項８】前記第１の記憶手段および前記第２の記憶
手段は、映像信号に加えて音声信号をも記憶する請求項
１に記載の映像信号処理装置。 - 【請求項９】入力した映像信号を第１の記憶手段に記憶
し、当該記憶した映像信号を前記第１の記憶手段から入
力順に読み出して出力し、 前記第１の記憶手段にオーバーフローが発生したか否か
を検出し、 前記第１の記憶手段から出力された映像信号を復号し、 前記復号された映像信号を第２の記憶手段に入力して記
憶し、前記オーバーフローが検出されていないときに、
記憶された映像信号を前記第２の記憶手段から入力され
た順序で読み出して順次出力し、前記オーバーフローが
検出されると、当該オーバーフローによって破綻した映
像信号のピクチャの直前のピクチャを復号した映像信号
を継続して出力する映像信号処理方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16242997A JPH1118078A (ja) | 1997-06-19 | 1997-06-19 | 映像信号処理装置およびその方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16242997A JPH1118078A (ja) | 1997-06-19 | 1997-06-19 | 映像信号処理装置およびその方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1118078A true JPH1118078A (ja) | 1999-01-22 |
Family
ID=15754447
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16242997A Pending JPH1118078A (ja) | 1997-06-19 | 1997-06-19 | 映像信号処理装置およびその方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1118078A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6717535B2 (en) | 2001-05-11 | 2004-04-06 | Nec Corporation | System and method for preventing input of variable length codes from being interrupted |
| US7433409B2 (en) | 2000-07-10 | 2008-10-07 | Matsushita Electric Industrial Co., Ltd. | Apparatus and method of multiple decoding |
-
1997
- 1997-06-19 JP JP16242997A patent/JPH1118078A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7433409B2 (en) | 2000-07-10 | 2008-10-07 | Matsushita Electric Industrial Co., Ltd. | Apparatus and method of multiple decoding |
| US6717535B2 (en) | 2001-05-11 | 2004-04-06 | Nec Corporation | System and method for preventing input of variable length codes from being interrupted |
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