JPH11122113A - データ復号化装置及び方法 - Google Patents
データ復号化装置及び方法Info
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- JPH11122113A JPH11122113A JP27702297A JP27702297A JPH11122113A JP H11122113 A JPH11122113 A JP H11122113A JP 27702297 A JP27702297 A JP 27702297A JP 27702297 A JP27702297 A JP 27702297A JP H11122113 A JPH11122113 A JP H11122113A
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- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】
【課題】 圧縮符号化された可変レートの入力データに
対してもデコードの開始タイミングが遅れないようにす
る。 【解決手段】 コードバッファメモリ２１に蓄積された
ＭＰＥＧ画像コードデータは直ちにコントローラ１５に
より読み出され、バイト／ワード変換部１３６に送られ
る。コードバッファメモリ２１にデコードできる量（こ
こでは１ワード）のＭＰＥＧ画像コードデータが蓄積さ
れると、バイト／ワード変換部１３６がＶＬＤ部１３１
のＶＬＤテーブルを引けるようになるので、ＶＬＤ部１
３１、ＩＱ部１３２、及びＩＤＣＴ部１３３にクロック
信号が供給されるようになり、デコードが開始される。
対してもデコードの開始タイミングが遅れないようにす
る。 【解決手段】 コードバッファメモリ２１に蓄積された
ＭＰＥＧ画像コードデータは直ちにコントローラ１５に
より読み出され、バイト／ワード変換部１３６に送られ
る。コードバッファメモリ２１にデコードできる量（こ
こでは１ワード）のＭＰＥＧ画像コードデータが蓄積さ
れると、バイト／ワード変換部１３６がＶＬＤ部１３１
のＶＬＤテーブルを引けるようになるので、ＶＬＤ部１
３１、ＩＱ部１３２、及びＩＤＣＴ部１３３にクロック
信号が供給されるようになり、デコードが開始される。
Description
【０００１】
【発明の属する技術分野】この発明は、例えばＭＰＥＧ
（Ｍｏｖｉｎｇ Ｐｉｃｔｕｒｅ Ｅｘｐｅｒｔｓ Ｇ
ｒｏｕｐ）方式により圧縮符号化された画像データを復
号化する装置及び方法に関し、詳細には可変レートで圧
縮符号化されたデータを復号化する際に復号化タイミン
グを制御する技術に関する。
（Ｍｏｖｉｎｇ Ｐｉｃｔｕｒｅ Ｅｘｐｅｒｔｓ Ｇ
ｒｏｕｐ）方式により圧縮符号化された画像データを復
号化する装置及び方法に関し、詳細には可変レートで圧
縮符号化されたデータを復号化する際に復号化タイミン
グを制御する技術に関する。
【０００２】
【従来の技術】図３は従来の画像データ復号化装置の構
成を示す。この画像データ復号化装置は、ビデオデコー
ダ１とそれに接続されたメモリ２とから構成されてい
る。
成を示す。この画像データ復号化装置は、ビデオデコー
ダ１とそれに接続されたメモリ２とから構成されてい
る。
【０００３】ビデオデコーダ１は、大別すると入力イン
タフェース１１と、メモリインタフェース１２と、画像
伸長部１３と、出力インタフェース１４と、コントロー
ラ１５とから構成されている。メモリ２はコードバッフ
ァメモリ２１と、フレームメモリ２２とを備えており、
ビデオデコーダ１内のメモリインタフェース１２に接続
されている。
タフェース１１と、メモリインタフェース１２と、画像
伸長部１３と、出力インタフェース１４と、コントロー
ラ１５とから構成されている。メモリ２はコードバッフ
ァメモリ２１と、フレームメモリ２２とを備えており、
ビデオデコーダ１内のメモリインタフェース１２に接続
されている。
【０００４】画像伸長部１３は、ＶＬＤ（Ｖａｒｉａｂ
ｌｅ Ｌｅｎｇｔｈ Ｄｅｃｏｄｉｎｇ：可変長復号）
部１３１と、ＩＱ（Ｉｎｖｅｒｓｅ Ｑｕａｎｔｉｚａ
ｔｉｏｎ：逆量子化）部１３２と、ＩＤＣＴ（Ｉｎｖｅ
ｒｓｅ ＤｉｓｃｒｅｔｅＣｏｓｉｎｅ Ｔｒａｎｓｆ
ｏｒｍ：逆離散コサイン変換）部１３３と、ＭＶＣ（Ｍ
ｏｔｉｏｎ Ｖｅｃｔｏｒ Ｃａｌｃｕｌａｔｉｏｎ：
動きベクトル計算）部１３４と、ＭＣ（Ｍｏｔｉｏｎ
Ｃｏｍｐｅｎｓａｔｉｏｎ：動き補償）部１３５と、パ
ーサー１３８とから構成されている。
ｌｅ Ｌｅｎｇｔｈ Ｄｅｃｏｄｉｎｇ：可変長復号）
部１３１と、ＩＱ（Ｉｎｖｅｒｓｅ Ｑｕａｎｔｉｚａ
ｔｉｏｎ：逆量子化）部１３２と、ＩＤＣＴ（Ｉｎｖｅ
ｒｓｅ ＤｉｓｃｒｅｔｅＣｏｓｉｎｅ Ｔｒａｎｓｆ
ｏｒｍ：逆離散コサイン変換）部１３３と、ＭＶＣ（Ｍ
ｏｔｉｏｎ Ｖｅｃｔｏｒ Ｃａｌｃｕｌａｔｉｏｎ：
動きベクトル計算）部１３４と、ＭＣ（Ｍｏｔｉｏｎ
Ｃｏｍｐｅｎｓａｔｉｏｎ：動き補償）部１３５と、パ
ーサー１３８とから構成されている。
【０００５】次に、この画像データ復号化装置の動作を
説明する。この動作の制御はコントローラ１５が行う。
説明する。この動作の制御はコントローラ１５が行う。
【０００６】ＭＰＥＧ方式で圧縮符号化された画像のコ
ードデータ（以下ＭＰＥＧ画像コードデータという）は
入力インタフェース１１に入力され、ここでエラー訂正
処理等を施され、メモリインタフェース１２を経由して
コードバッファメモリ２１に蓄積される。
ードデータ（以下ＭＰＥＧ画像コードデータという）は
入力インタフェース１１に入力され、ここでエラー訂正
処理等を施され、メモリインタフェース１２を経由して
コードバッファメモリ２１に蓄積される。
【０００７】コードバッファメモリ２１に蓄積されたＭ
ＰＥＧ画像コードデータは、デコードのタイミング（こ
のタイミングについては後述する）になったら、コード
バッファメモリ２１から読み出され、ＶＬＤ部１３１に
おいて、可変長符号化を用いて圧縮符号化されている圧
縮コードのデコードを施される。また、コードバッファ
メモリ２１から読み出されたデータは、パーサー１３８
に送られ、ここで検出されたＰＴＳ（Ｐｒｅｓｅｎｔａ
ｓｉｏｎ Ｔｉｍｅ Ｓｔａｍｐ）がコントローラ１５
に送られる。
ＰＥＧ画像コードデータは、デコードのタイミング（こ
のタイミングについては後述する）になったら、コード
バッファメモリ２１から読み出され、ＶＬＤ部１３１に
おいて、可変長符号化を用いて圧縮符号化されている圧
縮コードのデコードを施される。また、コードバッファ
メモリ２１から読み出されたデータは、パーサー１３８
に送られ、ここで検出されたＰＴＳ（Ｐｒｅｓｅｎｔａ
ｓｉｏｎ Ｔｉｍｅ Ｓｔａｍｐ）がコントローラ１５
に送られる。
【０００８】ＶＬＤ部１３１の出力はＩＱ部１３２とＭ
ＶＣ部１３４へ送られる。ＭＶＣ部１３４では、ＶＬＤ
部１３１にてデコードされた動きベクトルパラメータか
ら、動きベクトルの値を計算し、フレームメモリ２２か
ら必要なデータを読み出し、ＭＣ部１３５で動き補償の
演算が行なえるようにする。また、ＩＱ部１３２では画
像データのＤＣＴ係数の逆量子化を行なう。
ＶＣ部１３４へ送られる。ＭＶＣ部１３４では、ＶＬＤ
部１３１にてデコードされた動きベクトルパラメータか
ら、動きベクトルの値を計算し、フレームメモリ２２か
ら必要なデータを読み出し、ＭＣ部１３５で動き補償の
演算が行なえるようにする。また、ＩＱ部１３２では画
像データのＤＣＴ係数の逆量子化を行なう。
【０００９】ＩＤＣＴ部１３３では、画像データを離散
コサイン変換したＤＣＴ係数が入力されるので、逆離散
コサイン変換が行なわれ、もとの画像データが復元さ
れ、ＭＣ部１３５へ送られる。
コサイン変換したＤＣＴ係数が入力されるので、逆離散
コサイン変換が行なわれ、もとの画像データが復元さ
れ、ＭＣ部１３５へ送られる。
【００１０】ＭＣ部１３５では、フレーム間予測符号化
されたＰピクチャとＢピクチャに対して、動きベクトル
値に基づいてフレームメモリ２２から読み出されたデー
タと、ＩＤＣＴ部１３３からのデータを用い、動き補償
の演算を行ない完全に復号化された画像データを作成す
る。
されたＰピクチャとＢピクチャに対して、動きベクトル
値に基づいてフレームメモリ２２から読み出されたデー
タと、ＩＤＣＴ部１３３からのデータを用い、動き補償
の演算を行ない完全に復号化された画像データを作成す
る。
【００１１】復号化された画像データは、一度フレーム
メモリ２２に蓄えられ、表示のタイミングに合わせて読
み出され、出力インタフェース１４から外部へ出力され
る。次に図４を参照しながら図３に示した画像データ復
号化装置におけるデコードのタイミングについて説明す
る。図４において縦軸は入力データのサイズを表し、横
軸は時刻を表す。また、傾斜した直線Ａと直線Ｂとの間
隔がコードバッファメモリ２１のサイズを表す。さら
に、傾斜した直線Ａと直線Ｂは入力データのビットレー
トを表し、直線Ａと直線Ｂに挟まれた領域でコードバッ
ファメモリ２１内のデータの蓄積状態を表す。入力デー
タのレートが固定の場合には直線Ａと直線Ｂの傾きは一
定であるが、可変レートの場合には時間とともに変化す
る。また、階段上の線が直線Ｂを越えて右側にはみ出す
ことは、コードバッファメモリ２１のオーバーフロー状
態を示し、逆に階段上の線が直線Ａを越えて左側にはみ
出すことは、コードバッファメモリ２１のアンダーフロ
ー状態を示す。コントローラ１５はこのようなオーバー
フロー及びアンダーフローが発生しないように制御す
る。
メモリ２２に蓄えられ、表示のタイミングに合わせて読
み出され、出力インタフェース１４から外部へ出力され
る。次に図４を参照しながら図３に示した画像データ復
号化装置におけるデコードのタイミングについて説明す
る。図４において縦軸は入力データのサイズを表し、横
軸は時刻を表す。また、傾斜した直線Ａと直線Ｂとの間
隔がコードバッファメモリ２１のサイズを表す。さら
に、傾斜した直線Ａと直線Ｂは入力データのビットレー
トを表し、直線Ａと直線Ｂに挟まれた領域でコードバッ
ファメモリ２１内のデータの蓄積状態を表す。入力デー
タのレートが固定の場合には直線Ａと直線Ｂの傾きは一
定であるが、可変レートの場合には時間とともに変化す
る。また、階段上の線が直線Ｂを越えて右側にはみ出す
ことは、コードバッファメモリ２１のオーバーフロー状
態を示し、逆に階段上の線が直線Ａを越えて左側にはみ
出すことは、コードバッファメモリ２１のアンダーフロ
ー状態を示す。コントローラ１５はこのようなオーバー
フロー及びアンダーフローが発生しないように制御す
る。
【００１２】図４においてＴ０は最初のＭＰＥＧ画像コ
ードデータがコードバッファメモリ２１に入力される時
刻を示す。コードバッファメモリ２１に入力されたＭＰ
ＥＧ画像コードデータは、時刻Ｔ０からＶＢＶ＿ｄｅｌ
ａｙだけ経過した時刻Ｔ１に外部へ出力されるようにデ
コードされる。すなわち、ＶＢＶ＿ｄｅｌａｙは入力イ
ンタフェース１１からコントローラ１５に送られるパケ
ットのピクチャヘッダ中に記載されているので、コント
ローラ１５はその時刻Ｔ１からデコードされた画像デー
タの出力が始まるように、コードバッファメモリ２１か
らＭＰＥＧ画像コードデータを読み出し、画像伸長部１
３がデコードを開始する。図４では、まずＩピクチャが
時刻Ｔ１から出力されるようにデコードされる。そし
て、以後はパーサー１３８が検出したＰＴＳが示すフレ
ーム周期（ＮＴＳＣ方式では２９．９７Ｈｚ、ＰＡＬ方
式では２５Ｈｚ）の時刻Ｔ２、Ｔ３、Ｔ４、Ｔ５におい
て順次Ｐピクチャ、Ｂピクチャ、Ｂピクチャ、Ｐピクチ
ャの出力が開始されるようにデコードが開始される。
ードデータがコードバッファメモリ２１に入力される時
刻を示す。コードバッファメモリ２１に入力されたＭＰ
ＥＧ画像コードデータは、時刻Ｔ０からＶＢＶ＿ｄｅｌ
ａｙだけ経過した時刻Ｔ１に外部へ出力されるようにデ
コードされる。すなわち、ＶＢＶ＿ｄｅｌａｙは入力イ
ンタフェース１１からコントローラ１５に送られるパケ
ットのピクチャヘッダ中に記載されているので、コント
ローラ１５はその時刻Ｔ１からデコードされた画像デー
タの出力が始まるように、コードバッファメモリ２１か
らＭＰＥＧ画像コードデータを読み出し、画像伸長部１
３がデコードを開始する。図４では、まずＩピクチャが
時刻Ｔ１から出力されるようにデコードされる。そし
て、以後はパーサー１３８が検出したＰＴＳが示すフレ
ーム周期（ＮＴＳＣ方式では２９．９７Ｈｚ、ＰＡＬ方
式では２５Ｈｚ）の時刻Ｔ２、Ｔ３、Ｔ４、Ｔ５におい
て順次Ｐピクチャ、Ｂピクチャ、Ｂピクチャ、Ｐピクチ
ャの出力が開始されるようにデコードが開始される。
【００１３】
【発明が解決しようとする課題】入力データが固定レー
トの場合には、前述した方法でデコードすることによ
り、所定のタイミングで出力し表示することが可能とな
る。しかし、入力データが可変レートの場合にはＶＢＶ
＿ｄｅｌａｙの値が“０ｘＦＦＦＦ”となっているた
め、Ｔ０にＶＢＶ＿ｄｅｌａｙの値を加算した時刻で出
力されるようにデコードしたのでは、デコードを開始す
る時刻が遅くなってしまう。
トの場合には、前述した方法でデコードすることによ
り、所定のタイミングで出力し表示することが可能とな
る。しかし、入力データが可変レートの場合にはＶＢＶ
＿ｄｅｌａｙの値が“０ｘＦＦＦＦ”となっているた
め、Ｔ０にＶＢＶ＿ｄｅｌａｙの値を加算した時刻で出
力されるようにデコードしたのでは、デコードを開始す
る時刻が遅くなってしまう。
【００１４】そこで、本発明は可変レートの入力データ
に対してもデコードの開始タイミングが遅れないように
したデータ復号化装置及び方法を提供することを目的と
する。また、本発明はあらゆるレートの入力データの復
号化に対応できるデータ復号化装置及び方法を提供する
ことを目的とする。
に対してもデコードの開始タイミングが遅れないように
したデータ復号化装置及び方法を提供することを目的と
する。また、本発明はあらゆるレートの入力データの復
号化に対応できるデータ復号化装置及び方法を提供する
ことを目的とする。
【００１５】
【課題を解決するための手段】本発明に係るデータ復号
化装置は、圧縮符号化されたデータを一時蓄積する第１
の手段と、第１の手段から読み出したデータを復号化す
る第２の手段とを備え、第２の手段は第１の手段に所定
量のデータが蓄積された時点で復号化を開始することを
特徴とするものである。
化装置は、圧縮符号化されたデータを一時蓄積する第１
の手段と、第１の手段から読み出したデータを復号化す
る第２の手段とを備え、第２の手段は第１の手段に所定
量のデータが蓄積された時点で復号化を開始することを
特徴とするものである。
【００１６】本発明に係るデータ復号化方法は、圧縮符
号化されたデータを復号化する際に、圧縮符号化された
データを一時蓄積するバッファに所定量のデータが蓄積
された時点で復号化を開始することを特徴とするもので
ある。
号化されたデータを復号化する際に、圧縮符号化された
データを一時蓄積するバッファに所定量のデータが蓄積
された時点で復号化を開始することを特徴とするもので
ある。
【００１７】本発明によれば、圧縮符号化されたデータ
は第１の手段に一時蓄積される。そして、蓄積量が所定
の値になると第２の手段により復号化が開始される。
は第１の手段に一時蓄積される。そして、蓄積量が所定
の値になると第２の手段により復号化が開始される。
【００１８】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照しながら詳細に説明する。
て図面を参照しながら詳細に説明する。
【００１９】図１は本発明を適用した画像データ復号化
装置の構成を示すブロック図である。ここで、図３と対
応する部分には図３で付した符号と同一の符号が付して
ある。
装置の構成を示すブロック図である。ここで、図３と対
応する部分には図３で付した符号と同一の符号が付して
ある。
【００２０】この画像データ復号化装置は、ビデオデコ
ーダ１’とそれに接続されたメモリ２とから構成されて
いる。ビデオデコーダ１’は、大別すると入力インタフ
ェース１１と、メモリインタフェース１２と、画像伸長
部１３’と、出力インタフェース１４と、コントローラ
１５とから構成されている。メモリ２はコードバッファ
メモ２１と、フレームメリ２２とを備えており、ビデオ
デコーダ１内のメモリインタフェース１２に接続されて
いる。以上の基本的構成は、前述した従来の画像データ
復号化装置と同じである。
ーダ１’とそれに接続されたメモリ２とから構成されて
いる。ビデオデコーダ１’は、大別すると入力インタフ
ェース１１と、メモリインタフェース１２と、画像伸長
部１３’と、出力インタフェース１４と、コントローラ
１５とから構成されている。メモリ２はコードバッファ
メモ２１と、フレームメリ２２とを備えており、ビデオ
デコーダ１内のメモリインタフェース１２に接続されて
いる。以上の基本的構成は、前述した従来の画像データ
復号化装置と同じである。
【００２１】画像伸長部１３’は、ＶＬＤ部１３１と、
ＩＱ部１３２と、ＩＤＣＴ部１３３と、ＭＶＣ部１３４
と、ＭＣ部１３５と、バイト／ワード変換部１３６と、
クロック制御部１３７と、パーサー１３８とから構成さ
れている。
ＩＱ部１３２と、ＩＤＣＴ部１３３と、ＭＶＣ部１３４
と、ＭＣ部１３５と、バイト／ワード変換部１３６と、
クロック制御部１３７と、パーサー１３８とから構成さ
れている。
【００２２】バイト／ワード変換部１３６はコードバッ
ファ２１から読み出したバイト単位のコードデータをワ
ード単位のデータに変換する。そして、ＶＬＤ部１３１
内のＶＬＤテーブルが引けるようになるまではコントロ
ーラ１５及びクロック制御部１３７に対してアンダーフ
ロー信号を送り続ける。クロック制御部１３７はアンダ
ーフロー信号を受けている間はＶＬＤ部１３１、ＩＱ部
１３２、及びＩＤＣＴ部１３３にクロック信号が供給さ
れないように制御する。コントローラ１５はアンダーフ
ロー信号を受けても、最初に入力されるピクチャに対し
てはこれを無視する。パーサー１３８はバイト／ワード
変換部１３６の出力からＰＴＳを検出し、コントローラ
１５に送る。
ファ２１から読み出したバイト単位のコードデータをワ
ード単位のデータに変換する。そして、ＶＬＤ部１３１
内のＶＬＤテーブルが引けるようになるまではコントロ
ーラ１５及びクロック制御部１３７に対してアンダーフ
ロー信号を送り続ける。クロック制御部１３７はアンダ
ーフロー信号を受けている間はＶＬＤ部１３１、ＩＱ部
１３２、及びＩＤＣＴ部１３３にクロック信号が供給さ
れないように制御する。コントローラ１５はアンダーフ
ロー信号を受けても、最初に入力されるピクチャに対し
てはこれを無視する。パーサー１３８はバイト／ワード
変換部１３６の出力からＰＴＳを検出し、コントローラ
１５に送る。
【００２３】次に図２を参照しながら図１に示した画像
データ復号化装置におけるデコードのタイミングについ
て説明する。ここで、図４と対応する部分には図４で付
した符号と同一の符号が付してある。
データ復号化装置におけるデコードのタイミングについ
て説明する。ここで、図４と対応する部分には図４で付
した符号と同一の符号が付してある。
【００２４】時刻Ｔ０において最初のＭＰＥＧ画像コー
ドデータがコードバッファメモリ２１に入力される。そ
して、デコードできる量（ここでは１ワード）のＭＰＥ
Ｇ画像コードデータが蓄積された時刻Ｔ１’からデコー
ドが開始される。
ドデータがコードバッファメモリ２１に入力される。そ
して、デコードできる量（ここでは１ワード）のＭＰＥ
Ｇ画像コードデータが蓄積された時刻Ｔ１’からデコー
ドが開始される。
【００２５】すなわち、コードバッファメモリ２１に蓄
積されたＭＰＥＧ画像コードデータは直ちにコントロー
ラ１５により読み出され、バイト／ワード変換部１３６
に送られるが、バイト／ワード変換部１３６は所定量の
コードデータが入力され、ＶＬＤ部１３１のＶＬＤテー
ブルが引けるようになるまではアンダーフロー信号を出
力し続ける。そして、クロック制御部１３７は、このア
ンダーフロー信号が入力されている間はＶＬＤ部１３
１、ＩＱ部１３２、及びＩＤＣＴ部１３３にクロック信
号が供給されないように制御するので、デコードが行わ
れない。そして、時刻Ｔ１’になるとバイト／ワード変
換部１３６がＶＬＤ部１３１のＶＬＤテーブルを引ける
ようになるので、ＶＬＤ部１３１、ＩＱ部１３２、及び
ＩＤＣＴ部１３３にクロック信号が供給されるようにな
り、デコードが開始される。
積されたＭＰＥＧ画像コードデータは直ちにコントロー
ラ１５により読み出され、バイト／ワード変換部１３６
に送られるが、バイト／ワード変換部１３６は所定量の
コードデータが入力され、ＶＬＤ部１３１のＶＬＤテー
ブルが引けるようになるまではアンダーフロー信号を出
力し続ける。そして、クロック制御部１３７は、このア
ンダーフロー信号が入力されている間はＶＬＤ部１３
１、ＩＱ部１３２、及びＩＤＣＴ部１３３にクロック信
号が供給されないように制御するので、デコードが行わ
れない。そして、時刻Ｔ１’になるとバイト／ワード変
換部１３６がＶＬＤ部１３１のＶＬＤテーブルを引ける
ようになるので、ＶＬＤ部１３１、ＩＱ部１３２、及び
ＩＤＣＴ部１３３にクロック信号が供給されるようにな
り、デコードが開始される。
【００２６】バイト／ワード変換部１３６の出力はパー
サー１３８に送られる。パーサー１３８はバイト／ワー
ド変換部１３６の出力データ中のＰＴＳを検出し、コン
トローラ１５に送る。コントローラ１５は最初のＩピク
チャのＰＴＳを検出したら、それが示す時刻にＩピクチ
ャが出力されるように制御する。すなわち、最初のＩピ
クチャのデコードは本来のタイミングよりも早く終了す
るので、時間Ｔｄだけ待った後、時刻Ｔ１から出力を開
始する。以後は、各ピクチャ毎にパーサー１３８が検出
したＰＴＳが示すフレーム周期の時刻Ｔ２、Ｔ３、Ｔ
４、Ｔ５において順次Ｐピクチャ、Ｂピクチャ、Ｂピク
チャ、Ｐピクチャの出力が開始されるようにデコードが
開始される。
サー１３８に送られる。パーサー１３８はバイト／ワー
ド変換部１３６の出力データ中のＰＴＳを検出し、コン
トローラ１５に送る。コントローラ１５は最初のＩピク
チャのＰＴＳを検出したら、それが示す時刻にＩピクチ
ャが出力されるように制御する。すなわち、最初のＩピ
クチャのデコードは本来のタイミングよりも早く終了す
るので、時間Ｔｄだけ待った後、時刻Ｔ１から出力を開
始する。以後は、各ピクチャ毎にパーサー１３８が検出
したＰＴＳが示すフレーム周期の時刻Ｔ２、Ｔ３、Ｔ
４、Ｔ５において順次Ｐピクチャ、Ｂピクチャ、Ｂピク
チャ、Ｐピクチャの出力が開始されるようにデコードが
開始される。
【００２７】ここで、最初のＩピクチャについては、デ
コードを開始するタイミングが早過ぎるため、コードバ
ッファメモリ２１は、デコード開始後、最初のピクチャ
をデコードしている間はアンダーフローとなりうる。こ
のとき、コントローラ１５に対してインタラプト（ｉｎ
ｔｅｒｒｕｐｔ）が発生するが、これはＣＰＵ側として
は無視して、デコード対象のコードバッファメモリ２１
に必要なデータが溜まり次第デコードをし続ける。第２
番目以降のピクチャは、１つ前のピクチャがＰＴＳのタ
イミングで表示されるのに同期してデコードされるの
で、ＶＢＶバッファについてのアンダーフローは起こら
ない。
コードを開始するタイミングが早過ぎるため、コードバ
ッファメモリ２１は、デコード開始後、最初のピクチャ
をデコードしている間はアンダーフローとなりうる。こ
のとき、コントローラ１５に対してインタラプト（ｉｎ
ｔｅｒｒｕｐｔ）が発生するが、これはＣＰＵ側として
は無視して、デコード対象のコードバッファメモリ２１
に必要なデータが溜まり次第デコードをし続ける。第２
番目以降のピクチャは、１つ前のピクチャがＰＴＳのタ
イミングで表示されるのに同期してデコードされるの
で、ＶＢＶバッファについてのアンダーフローは起こら
ない。
【００２８】なお、以上の説明はコードバッファメモリ
２１に１ワードのデータが蓄積されると復号化が開始さ
れる場合であったが、例えばコードバッファメモリ２１
にその容量の１／２のデータが蓄積された時点から１ワ
ード単位で復号化を行うように構成してもよい。
２１に１ワードのデータが蓄積されると復号化が開始さ
れる場合であったが、例えばコードバッファメモリ２１
にその容量の１／２のデータが蓄積された時点から１ワ
ード単位で復号化を行うように構成してもよい。
【００２９】このように本実施の形態によれば、ＰＴＳ
のみを参照するビデオデコーダにおいて、ＰＴＳのタイ
ミングで確実にデコードしたピクチャを表示できる。ま
た、ＶＢＶ＿ｄｅｌａｙを参照しないでデコードを起動
できるので、ＶＢＶ＿ｄｅｌａｙ＝０ｘＦＦＦＦとなる
可変レート対応のビットストリームのデコードに関して
も問題なく行える。
のみを参照するビデオデコーダにおいて、ＰＴＳのタイ
ミングで確実にデコードしたピクチャを表示できる。ま
た、ＶＢＶ＿ｄｅｌａｙを参照しないでデコードを起動
できるので、ＶＢＶ＿ｄｅｌａｙ＝０ｘＦＦＦＦとなる
可変レート対応のビットストリームのデコードに関して
も問題なく行える。
【００３０】
【発明の効果】以上、詳細に説明したように、本発明に
よれば、可変レートの入力データに対してもデコードの
開始タイミングが遅れないようにすることができる。ま
た、本発明によればあらゆるレートの入力データの復号
化に対応できる。
よれば、可変レートの入力データに対してもデコードの
開始タイミングが遅れないようにすることができる。ま
た、本発明によればあらゆるレートの入力データの復号
化に対応できる。
【図１】本発明を適用した画像データ復号化装置の構成
を示すブロック図である。
を示すブロック図である。
【図２】本発明を適用した画像データ復号化装置におけ
るデコードのタイミングを説明するための図である。
るデコードのタイミングを説明するための図である。
【図３】従来の画像データ復号化装置の構成を示すブロ
ック図である。
ック図である。
【図４】従来の画像データ復号化装置におけるデコード
のタイミングを説明するための図である。
のタイミングを説明するための図である。
１…ビデオデコーダ、２…メモリ、１５…コントロー
ラ、２１…コードバッファメモリ、１３６…バイト／ワ
ード変換部、１３７…クロック制御部、１３８…パーサ
ー。
ラ、２１…コードバッファメモリ、１３６…バイト／ワ
ード変換部、１３７…クロック制御部、１３８…パーサ
ー。
Claims (4)
- 【請求項１】 圧縮符号化されたデータを一時蓄積する
第１の手段と、 前記第１の手段から読み出したデータを復号化する第２
の手段とを備え、前記第２の手段は前記第１の手段に所
定量のデータが蓄積された時点で復号化を開始すること
を特徴とするデータ復号化装置。 - 【請求項２】 前記所定量は１ワードである請求項１に
記載のデータ復号化装置。 - 【請求項３】 前記所定量は第１の手段の蓄積容量の１
／２である請求項１に記載のデータ復号化装置。 - 【請求項４】 圧縮符号化されたデータを復号化する際
に、圧縮符号化されたデータを一時蓄積するバッファに
所定量のデータが蓄積された時点で復号化を開始するこ
とを特徴とするデータ復号化方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27702297A JPH11122113A (ja) | 1997-10-09 | 1997-10-09 | データ復号化装置及び方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27702297A JPH11122113A (ja) | 1997-10-09 | 1997-10-09 | データ復号化装置及び方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11122113A true JPH11122113A (ja) | 1999-04-30 |
Family
ID=17577687
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27702297A Pending JPH11122113A (ja) | 1997-10-09 | 1997-10-09 | データ復号化装置及び方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11122113A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004010707A1 (ja) * | 2002-07-19 | 2004-01-29 | Sony Corporation | 符号化装置、符号化方法、復号化装置及び復号化方法 |
| WO2009122675A1 (ja) * | 2008-03-31 | 2009-10-08 | パナソニック株式会社 | 可変長符号復号化装置及びその方法 |
-
1997
- 1997-10-09 JP JP27702297A patent/JPH11122113A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004010707A1 (ja) * | 2002-07-19 | 2004-01-29 | Sony Corporation | 符号化装置、符号化方法、復号化装置及び復号化方法 |
| US8228988B2 (en) | 2002-07-19 | 2012-07-24 | Sony Corporation | Encoding device, encoding method, decoding device, and decoding method |
| US8259799B2 (en) | 2002-07-19 | 2012-09-04 | Sony Corporation | Encoding device, encoding method, decoding device, and decoding method |
| WO2009122675A1 (ja) * | 2008-03-31 | 2009-10-08 | パナソニック株式会社 | 可変長符号復号化装置及びその方法 |
| JP4763853B2 (ja) * | 2008-03-31 | 2011-08-31 | パナソニック株式会社 | 可変長符号復号化装置及びその方法 |
| US8228214B2 (en) | 2008-03-31 | 2012-07-24 | Panasonic Corporation | Variable-length code decoding apparatus and method |
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