JPH11161230A - Ｌｅｄ表示装置 - Google Patents
Ｌｅｄ表示装置Info
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- JPH11161230A JPH11161230A JP32178397A JP32178397A JPH11161230A JP H11161230 A JPH11161230 A JP H11161230A JP 32178397 A JP32178397 A JP 32178397A JP 32178397 A JP32178397 A JP 32178397A JP H11161230 A JPH11161230 A JP H11161230A
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Abstract
(57)【要約】
【課題】 ダイナミック駆動方式のＬＥＤユニットによ
り構成されたＬＥＤ表示パネルの表示画面に生じるフリ
ッカーを解消する。 【解決手段】 表示装置に、パソコン等の１フレームの
画面を複数回表示させるためのＮ倍速ＬＥＤユニットコ
ントロール部４を付加する。これにより、ＬＥＤが消灯
している間隔を人間の目では感知できない時間まで短く
し、フリッカーを解消する。
り構成されたＬＥＤ表示パネルの表示画面に生じるフリ
ッカーを解消する。 【解決手段】 表示装置に、パソコン等の１フレームの
画面を複数回表示させるためのＮ倍速ＬＥＤユニットコ
ントロール部４を付加する。これにより、ＬＥＤが消灯
している間隔を人間の目では感知できない時間まで短く
し、フリッカーを解消する。
Description
【０００１】
【発明の属する技術分野】本発明は、ＬＥＤ（発光ダイ
オード）表示装置に係わり、特にＬＥＤがドットマトリ
クス状に複数個配列された表示ユニットを複数個並べて
構成されるＬＥＤ表示パネルを表示駆動するＬＥＤ表示
装置に関する。
オード）表示装置に係わり、特にＬＥＤがドットマトリ
クス状に複数個配列された表示ユニットを複数個並べて
構成されるＬＥＤ表示パネルを表示駆動するＬＥＤ表示
装置に関する。
【０００２】
【従来の技術】従来、この種のＬＥＤ表示装置は、例え
ば特開平８−２４１０５８号公報に示されているよう
に、パソコン（パーソナルコンピュータ）等からのアナ
ログＲＧＢ信号の画像を表示する目的で使用されてい
る。図８は従来のＬＥＤ表示装置の一例の構成を示すブ
ロック図である。この図において、デジタルフィールド
信号生成部３１は、パソコンからのアナログＲＧＢ信号
をＡ／Ｄ変換したデジタルデータを、水平同期信号Ｈ
s、垂直同期信号Ｖsから生成したタイミングにより、内
部のフィールドメモリに書き込む。
ば特開平８−２４１０５８号公報に示されているよう
に、パソコン（パーソナルコンピュータ）等からのアナ
ログＲＧＢ信号の画像を表示する目的で使用されてい
る。図８は従来のＬＥＤ表示装置の一例の構成を示すブ
ロック図である。この図において、デジタルフィールド
信号生成部３１は、パソコンからのアナログＲＧＢ信号
をＡ／Ｄ変換したデジタルデータを、水平同期信号Ｈ
s、垂直同期信号Ｖsから生成したタイミングにより、内
部のフィールドメモリに書き込む。
【０００３】１６ラインメモリ制御部３３は、フィール
ドメモリから１６ライン分のデータを読み出してメモリ
３４に書き込む。メモリ３４の読み出しはリフレッシュ
設定ＳＷ３２の設定値に従い、１６ラインメモリ制御部
３３によってタイミングが制御される。ＬＥＤユニット
書き込みタイミング生成部３５は、１６ラインメモリ制
御部３３の制御信号に基づきＬＥＤユニットへの制御信
号を発生させる。ＬＥＤ表示パネル３６は１６×１６ド
ットマトリクスＬＥＤユニットで構成されている。
ドメモリから１６ライン分のデータを読み出してメモリ
３４に書き込む。メモリ３４の読み出しはリフレッシュ
設定ＳＷ３２の設定値に従い、１６ラインメモリ制御部
３３によってタイミングが制御される。ＬＥＤユニット
書き込みタイミング生成部３５は、１６ラインメモリ制
御部３３の制御信号に基づきＬＥＤユニットへの制御信
号を発生させる。ＬＥＤ表示パネル３６は１６×１６ド
ットマトリクスＬＥＤユニットで構成されている。
【０００４】このような構成において、パソコンの１フ
レーム分の画像データは、１６ラインメモリ制御部３３
とＬＥＤユニット書き込みタイミング生成部３５によ
り、１／１６デューティダイナミック駆動となるタイミ
ングでＬＥＤ表示パネル３６のＬＥＤユニットに転送さ
れる。その時のＬＥＤユニットの動作のタイムチャート
を図９に示す。この図のように、パソコンが１フレーム
分の画像を表示している間、ＬＥＤユニットのＬＥＤは
上のラインから順次点灯し、次のフレームになる前に１
６ラインの点灯を終了する。以後、フレーム毎に同様の
動作を繰り返す。
レーム分の画像データは、１６ラインメモリ制御部３３
とＬＥＤユニット書き込みタイミング生成部３５によ
り、１／１６デューティダイナミック駆動となるタイミ
ングでＬＥＤ表示パネル３６のＬＥＤユニットに転送さ
れる。その時のＬＥＤユニットの動作のタイムチャート
を図９に示す。この図のように、パソコンが１フレーム
分の画像を表示している間、ＬＥＤユニットのＬＥＤは
上のラインから順次点灯し、次のフレームになる前に１
６ラインの点灯を終了する。以後、フレーム毎に同様の
動作を繰り返す。
【０００５】
【発明が解決しようとする課題】ところで、上述した従
来のＬＥＤ表示装置にあっては、ＬＥＤ表示パネルの表
示画面にフリッカー（黒帯状のちらつき）が生じ、画像
品質が劣化するという問題点がある。その理由は、パソ
コン等からのアナログＲＧＢ信号と同一のフレーム周波
数でＬＥＤをダイナミック駆動しているため、あるライ
ンのＬＥＤが点灯し、そして同じラインが再び点灯する
までの時間が長すぎるため、フリッカーとして人間の目
が感知してしまうからである。
来のＬＥＤ表示装置にあっては、ＬＥＤ表示パネルの表
示画面にフリッカー（黒帯状のちらつき）が生じ、画像
品質が劣化するという問題点がある。その理由は、パソ
コン等からのアナログＲＧＢ信号と同一のフレーム周波
数でＬＥＤをダイナミック駆動しているため、あるライ
ンのＬＥＤが点灯し、そして同じラインが再び点灯する
までの時間が長すぎるため、フリッカーとして人間の目
が感知してしまうからである。
【０００６】そこで本発明は、ダイナミック駆動による
ＬＥＤ表示パネルの表示画面上に生ずるフリッカーを解
消できるＬＥＤ表示装置を提供することを目的とする。
ＬＥＤ表示パネルの表示画面上に生ずるフリッカーを解
消できるＬＥＤ表示装置を提供することを目的とする。
【０００７】
【課題を解決するための手段】上記の目的を達成するた
め、本発明は、表示画面上のフリッカーを解消するた
め、パソコン等の１フレームの画面を複数回表示させる
Ｎ倍速（Ｎ＝２、３、…の自然数）表示を行う。１フレ
ームの画面を複数回表示させるＮ倍速表示を行っている
ので、ＬＥＤの消灯している間隔が短くなり、人間の目
はＬＥＤの消灯を感知しなくなる。これにより、フリッ
カーが解消される。具体的には請求項１によって、ダイ
ナミックスキャン方式のＬＥＤユニットを備えたＬＥＤ
表示装置であって、１フレーム分の画像を複数回表示さ
せる手段を備えたことを特徴とするＬＥＤ表示装置を提
供する。また、請求項２では、前記手段は、１フレーム
分の画像データを前記ＬＥＤユニット内のメモリに書き
込んだ後、Ｎ倍（Ｎ＝１、２、３、…の自然数）の数の
表示信号により前記画像データを読み出し、この画像デ
ータを元に１フレームの画面をＮ倍速表示することを特
徴とする請求項１記載のＬＥＤ表示装置を提供する。請
求項３では、ダイナミックスキャン方式のＬＥＤユニッ
トを備えたＬＥＤ表示装置であって、画像データを記憶
するためのメモリと、ＬＥＤユニットを構成する複数個
のＬＥＤをＮ倍速表示させるためのＬＥＤ表示タイミン
グ信号を生成するＬＥＤ表示タイミング生成部と、Ｎ倍
速表示に対応した階調基準クロックを生成するＬＥＤ階
調基準クロック生成部と、前記メモリに１フレーム分の
画像データを書き込んだ後、ＬＥＤ表示タイミング信号
に基づき前記メモリから画像データを読み出し、その画
像データと前記階調基準クロックを基に前記複数個のＬ
ＥＤの夫々の点灯時間を決定し、ＬＥＤを点灯させる信
号を前記ＬＥＤユニットのドライバに出力するＬＥＤユ
ニット制御部と、を備えたことを特徴とするＬＥＤ表示
装置を提供する。
め、本発明は、表示画面上のフリッカーを解消するた
め、パソコン等の１フレームの画面を複数回表示させる
Ｎ倍速（Ｎ＝２、３、…の自然数）表示を行う。１フレ
ームの画面を複数回表示させるＮ倍速表示を行っている
ので、ＬＥＤの消灯している間隔が短くなり、人間の目
はＬＥＤの消灯を感知しなくなる。これにより、フリッ
カーが解消される。具体的には請求項１によって、ダイ
ナミックスキャン方式のＬＥＤユニットを備えたＬＥＤ
表示装置であって、１フレーム分の画像を複数回表示さ
せる手段を備えたことを特徴とするＬＥＤ表示装置を提
供する。また、請求項２では、前記手段は、１フレーム
分の画像データを前記ＬＥＤユニット内のメモリに書き
込んだ後、Ｎ倍（Ｎ＝１、２、３、…の自然数）の数の
表示信号により前記画像データを読み出し、この画像デ
ータを元に１フレームの画面をＮ倍速表示することを特
徴とする請求項１記載のＬＥＤ表示装置を提供する。請
求項３では、ダイナミックスキャン方式のＬＥＤユニッ
トを備えたＬＥＤ表示装置であって、画像データを記憶
するためのメモリと、ＬＥＤユニットを構成する複数個
のＬＥＤをＮ倍速表示させるためのＬＥＤ表示タイミン
グ信号を生成するＬＥＤ表示タイミング生成部と、Ｎ倍
速表示に対応した階調基準クロックを生成するＬＥＤ階
調基準クロック生成部と、前記メモリに１フレーム分の
画像データを書き込んだ後、ＬＥＤ表示タイミング信号
に基づき前記メモリから画像データを読み出し、その画
像データと前記階調基準クロックを基に前記複数個のＬ
ＥＤの夫々の点灯時間を決定し、ＬＥＤを点灯させる信
号を前記ＬＥＤユニットのドライバに出力するＬＥＤユ
ニット制御部と、を備えたことを特徴とするＬＥＤ表示
装置を提供する。
【０００８】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面と共に説明する。 （Ａ）ＬＥＤ表示装置の構成 図１は、本発明に係るＬＥＤ表示装置の実施の形態の構
成を示すブロック図である。この図において、アナログ
ＲＧＢデジタイズ部１は、パソコン等からのアナログＲ
ＧＢ信号をＡ／Ｄ変換し、画像データを内部のメモリに
格納する。また、同時に水平同期信号Ｈsに同期したク
ロックの生成も行う。画像データコントロール部２は、
アナログＲＧＢデジタイズ部１からＣＰＵ３により設定
された矩形領域の画像データを取り込み、制御信号とと
もにＮ倍速ＬＥＤユニットコントロール部４に出力す
る。
て図面と共に説明する。 （Ａ）ＬＥＤ表示装置の構成 図１は、本発明に係るＬＥＤ表示装置の実施の形態の構
成を示すブロック図である。この図において、アナログ
ＲＧＢデジタイズ部１は、パソコン等からのアナログＲ
ＧＢ信号をＡ／Ｄ変換し、画像データを内部のメモリに
格納する。また、同時に水平同期信号Ｈsに同期したク
ロックの生成も行う。画像データコントロール部２は、
アナログＲＧＢデジタイズ部１からＣＰＵ３により設定
された矩形領域の画像データを取り込み、制御信号とと
もにＮ倍速ＬＥＤユニットコントロール部４に出力す
る。
【０００９】ＣＰＵ３は、アナログＲＧＢデジタイズ部
１と画像データコントロール部２の制御を行っている。
Ｎ倍速ＬＥＤユニットコントロール部４は、ＬＥＤを点
灯させるための画像データ及び制御信号を表示パネル５
に出力する。表示パネル５は、ＬＥＤユニット６が複数
枚集まって構成されたものである。ＬＥＤユニット６の
信号ケーブルは、横方向のユニット同士でチェーン状に
接続されており、同じ横のラインのＬＥＤは同じタイミ
ングで点灯する。ＬＥＤユニット６は１６×１６ドット
マトリクス・ダイナミック駆動方式であり、Ｒ（赤
色）、Ｇ（緑色）、Ｂ（青色）のＬＥＤで構成されたフ
ルカラーＬＥＤユニットである。ここでフルカラーと
は、Ｒ、Ｇ、Ｂ各色を２５６階調表示することである。
１と画像データコントロール部２の制御を行っている。
Ｎ倍速ＬＥＤユニットコントロール部４は、ＬＥＤを点
灯させるための画像データ及び制御信号を表示パネル５
に出力する。表示パネル５は、ＬＥＤユニット６が複数
枚集まって構成されたものである。ＬＥＤユニット６の
信号ケーブルは、横方向のユニット同士でチェーン状に
接続されており、同じ横のラインのＬＥＤは同じタイミ
ングで点灯する。ＬＥＤユニット６は１６×１６ドット
マトリクス・ダイナミック駆動方式であり、Ｒ（赤
色）、Ｇ（緑色）、Ｂ（青色）のＬＥＤで構成されたフ
ルカラーＬＥＤユニットである。ここでフルカラーと
は、Ｒ、Ｇ、Ｂ各色を２５６階調表示することである。
【００１０】次に、図１で示した各ブロックの詳細な構
成について説明する。 （Ｂ）画像データコントロール部２の構成 図２は本発明の実施形態のＬＥＤ表示装置の画像データ
コントロール部２の構成を示すブロック図である。この
図において、フィールドバッファ８は、矩形領域のＲ、
Ｇ、Ｂ各画像データを取り込むメモリである。単位パネ
ル制御部９はＳＷ１０により自分が表示制御を担当する
ラインを認識する。
成について説明する。 （Ｂ）画像データコントロール部２の構成 図２は本発明の実施形態のＬＥＤ表示装置の画像データ
コントロール部２の構成を示すブロック図である。この
図において、フィールドバッファ８は、矩形領域のＲ、
Ｇ、Ｂ各画像データを取り込むメモリである。単位パネ
ル制御部９はＳＷ１０により自分が表示制御を担当する
ラインを認識する。
【００１１】単位パネル制御部９は、フィールドバッフ
ァ８の書き込み、読み出し、そしてＬＥＤユニットコン
トロール部４への出力を制御する。単位パネル制御部９
は、フィールドバッファ８から読み出したＲ、Ｇ、Ｂ各
８ビットのデータを４ビットのデータＲ３〜Ｒ０、Ｇ３
〜Ｇ０、Ｂ３〜Ｂ０に分けて２回出力する。これは、デ
ータのための信号線を削減するためである。
ァ８の書き込み、読み出し、そしてＬＥＤユニットコン
トロール部４への出力を制御する。単位パネル制御部９
は、フィールドバッファ８から読み出したＲ、Ｇ、Ｂ各
８ビットのデータを４ビットのデータＲ３〜Ｒ０、Ｇ３
〜Ｇ０、Ｂ３〜Ｂ０に分けて２回出力する。これは、デ
ータのための信号線を削減するためである。
【００１２】単位パネル制御部９は、制御信号としてデ
ータのシフトクロックＢＣＬＫ、ＬＥＤユニット６の何
ライン目にデータを書き込むかを示すＬＩＮＥ３〜ＬＩ
ＮＥ０、データの書き込みタイミングを作るＬＡＴ、そ
して制御基準クロックＦＲＣＬＫを出力する。本発明で
あるＮ倍速表示を実現させるためには、ＬＥＤユニット
６へのデータ転送速度を速くする必要があるため、単位
パネル制御部９にドットクロックと同じ周波数のクロッ
クを入力し、フィールドバッファ８からの読み出し速度
を速めている。ＬＥＤ階調基準クロック生成部１１はＮ
倍速表示に対応した階調基準クロックＧＤＲ、ＧＤＧ、
ＧＤＢを生成する。
ータのシフトクロックＢＣＬＫ、ＬＥＤユニット６の何
ライン目にデータを書き込むかを示すＬＩＮＥ３〜ＬＩ
ＮＥ０、データの書き込みタイミングを作るＬＡＴ、そ
して制御基準クロックＦＲＣＬＫを出力する。本発明で
あるＮ倍速表示を実現させるためには、ＬＥＤユニット
６へのデータ転送速度を速くする必要があるため、単位
パネル制御部９にドットクロックと同じ周波数のクロッ
クを入力し、フィールドバッファ８からの読み出し速度
を速めている。ＬＥＤ階調基準クロック生成部１１はＮ
倍速表示に対応した階調基準クロックＧＤＲ、ＧＤＧ、
ＧＤＢを生成する。
【００１３】画像データコントロール部２とＮ倍速ＬＥ
Ｄユニットコントロール部４は、通常離して使用するた
め、両者間の通信はＲＳ−４２２ドライバー１２によっ
て変換された信号によって行われる。画像データコント
ロール部２は、単位パネル制御部９を含む回路７をＬＥ
Ｄユニットの行数だけ持っている。
Ｄユニットコントロール部４は、通常離して使用するた
め、両者間の通信はＲＳ−４２２ドライバー１２によっ
て変換された信号によって行われる。画像データコント
ロール部２は、単位パネル制御部９を含む回路７をＬＥ
Ｄユニットの行数だけ持っている。
【００１４】（Ｃ）Ｎ倍速ＬＥＤユニットコントロール
部４の構成 図３はＮ倍速ＬＥＤユニットコントロール部４の構成を
示すブロック図である。この図において、ＲＳ−４２２
レシーバー１３は、画像データコントロール部２からの
信号をＣＭＯＳレベルの信号に変換して出力する。画像
データデマルチプレクサ１４は、ＢＣＬＫを分周回路１
５で２分周したクロックを基づき、４ビット２回で送信
されてくる画像データを各８ビットのデータＲ７〜Ｒ
０、Ｇ７〜Ｇ０、Ｂ７〜Ｂ０に戻す。
部４の構成 図３はＮ倍速ＬＥＤユニットコントロール部４の構成を
示すブロック図である。この図において、ＲＳ−４２２
レシーバー１３は、画像データコントロール部２からの
信号をＣＭＯＳレベルの信号に変換して出力する。画像
データデマルチプレクサ１４は、ＢＣＬＫを分周回路１
５で２分周したクロックを基づき、４ビット２回で送信
されてくる画像データを各８ビットのデータＲ７〜Ｒ
０、Ｇ７〜Ｇ０、Ｂ７〜Ｂ０に戻す。
【００１５】シフトクロック生成部１６は、ＬＥＤユニ
ット６へ出力する画像データのシフトクロックＳＣＬＫ
を生成し出力する。ＬＥＤ書き込みタイミング生成部１
７は、ＬＡＴ、ＦＲＣＬＫに基づきＬＥＤユニット６へ
出力する画像データの書き込み信号ＨＰ及びＬＥＤ表示
ラインリセット信号ＶＰを生成し出力する。Ｓ／Ｐ変換
部１８は、ＳＴ１、ＳＴ０によりシリアルデータとして
送信されてくるＮ倍速表示を行うための設定データをシ
リアル−パラレル変換し出力する。ＬＥＤ表示タイミン
グ生成部１９は、Ｓ／Ｐ変換部１８の出力データに基づ
きＬＥＤをＮ倍速表示させるためのＬＥＤ表示タイミン
グ信号ＲＣＬＫを生成し出力する。ＬＥＤ表示タイミン
グ生成部１９は、例えばカウンタと比較器等の組み合わ
せにより実現できる。
ット６へ出力する画像データのシフトクロックＳＣＬＫ
を生成し出力する。ＬＥＤ書き込みタイミング生成部１
７は、ＬＡＴ、ＦＲＣＬＫに基づきＬＥＤユニット６へ
出力する画像データの書き込み信号ＨＰ及びＬＥＤ表示
ラインリセット信号ＶＰを生成し出力する。Ｓ／Ｐ変換
部１８は、ＳＴ１、ＳＴ０によりシリアルデータとして
送信されてくるＮ倍速表示を行うための設定データをシ
リアル−パラレル変換し出力する。ＬＥＤ表示タイミン
グ生成部１９は、Ｓ／Ｐ変換部１８の出力データに基づ
きＬＥＤをＮ倍速表示させるためのＬＥＤ表示タイミン
グ信号ＲＣＬＫを生成し出力する。ＬＥＤ表示タイミン
グ生成部１９は、例えばカウンタと比較器等の組み合わ
せにより実現できる。
【００１６】（Ｄ）ＬＥＤユニット６の構成 図４はＬＥＤユニット６の構成を示すブロック図であ
る。この図において、シフトレジスタ２０は１６段のシ
フトレジスタであり、ＳＣＬＫに基づき画像データＲ７
〜Ｒ０、Ｇ７〜Ｇ０、Ｂ７〜Ｂ０をシフトする。メモリ
２１は画像データを格納するメモリである。ＬＥＤユニ
ット制御部２２は、ＬｌＮＥ３〜ＬＩＮＥ０及びＨＰに
基づきメモリ２１がシフトレジスタ２０から画像データ
を取り込むタイミングを制御する。
る。この図において、シフトレジスタ２０は１６段のシ
フトレジスタであり、ＳＣＬＫに基づき画像データＲ７
〜Ｒ０、Ｇ７〜Ｇ０、Ｂ７〜Ｂ０をシフトする。メモリ
２１は画像データを格納するメモリである。ＬＥＤユニ
ット制御部２２は、ＬｌＮＥ３〜ＬＩＮＥ０及びＨＰに
基づきメモリ２１がシフトレジスタ２０から画像データ
を取り込むタイミングを制御する。
【００１７】また、ＬＥＤユニット制御部２２は、ＶＰ
とＲＣＬＫに基づきメモリ２１から画像データを読み出
し、そのデータとＧＤＲ、ＧＤＧ、ＧＤＢを基に各ＬＥ
Ｄの点灯時間を決定し、ＬＥＤを点灯させる信号をドラ
イバー２３、２５に出力する。１６×１６ＬＥＤドット
マトリクス２４は、制御信号に従い上のラインから１ラ
インずつ順次点灯を繰り返す。
とＲＣＬＫに基づきメモリ２１から画像データを読み出
し、そのデータとＧＤＲ、ＧＤＧ、ＧＤＢを基に各ＬＥ
Ｄの点灯時間を決定し、ＬＥＤを点灯させる信号をドラ
イバー２３、２５に出力する。１６×１６ＬＥＤドット
マトリクス２４は、制御信号に従い上のラインから１ラ
インずつ順次点灯を繰り返す。
【００１８】（Ｅ）ＬＥＤ表示装置の動作 次に、本実施の形態のＬＥＤ表示装置の動作について、
図面を参照して説明する。パソコン等の１フレーム分の
画像データは、画像データコントロール部２とＮ倍速Ｌ
ＥＤユニットコントロール部４により、パソコン等が１
フレーム分の画像を表示している間に表示パネル５では
Ｎ回表示を行うようなタイミングでＬＥＤユニット６に
転送される。
図面を参照して説明する。パソコン等の１フレーム分の
画像データは、画像データコントロール部２とＮ倍速Ｌ
ＥＤユニットコントロール部４により、パソコン等が１
フレーム分の画像を表示している間に表示パネル５では
Ｎ回表示を行うようなタイミングでＬＥＤユニット６に
転送される。
【００１９】その時のＬＥＤユニット６の動作を図５に
示す。この図に示すように、パソコン等が１フレーム分
の画像を表示している間、ＬＥＤユニット６のＬＥＤ
は、上のライン（ＬＥＤ表示ライン０）から順次点灯
し、一番下のライン（表示ライン１５）の点灯が終了す
ると、再び上のラインからの点灯をＮ回線り返す。以
後、フレーム毎に同様の動作を繰り返す。１フレーム分
の画像を複数回表示させることにより、ＬＥＤの消灯し
ている間隔を短くすることができ、フリッカーを解消す
ることができる。
示す。この図に示すように、パソコン等が１フレーム分
の画像を表示している間、ＬＥＤユニット６のＬＥＤ
は、上のライン（ＬＥＤ表示ライン０）から順次点灯
し、一番下のライン（表示ライン１５）の点灯が終了す
ると、再び上のラインからの点灯をＮ回線り返す。以
後、フレーム毎に同様の動作を繰り返す。１フレーム分
の画像を複数回表示させることにより、ＬＥＤの消灯し
ている間隔を短くすることができ、フリッカーを解消す
ることができる。
【００２０】次に、本発明の実施形態の具体例について
図面を参照して説明する。図６は、本発明の実施形態の
具体例を示すブロック図である。この具体例は、パソコ
ン２６からのアナログＲＧＢ信号またはレーザーディス
ク２７のＮＴＳＣ信号をスキャンコンバータ２８でアナ
ログＲＧＢに変換した信号を入力信号とし、それを５倍
速表示する装置である。５倍速ＬＥＤユニットコントロ
ール部２９は、図１のＮ倍速ＬＥＤユニットコントロー
ル部４を５倍速に設定したものである。表示パネル３０
は１２×９個のＬＥＤユニット６で構成されている。
図面を参照して説明する。図６は、本発明の実施形態の
具体例を示すブロック図である。この具体例は、パソコ
ン２６からのアナログＲＧＢ信号またはレーザーディス
ク２７のＮＴＳＣ信号をスキャンコンバータ２８でアナ
ログＲＧＢに変換した信号を入力信号とし、それを５倍
速表示する装置である。５倍速ＬＥＤユニットコントロ
ール部２９は、図１のＮ倍速ＬＥＤユニットコントロー
ル部４を５倍速に設定したものである。表示パネル３０
は１２×９個のＬＥＤユニット６で構成されている。
【００２１】このような構成において、ＬＥＤユニット
の点灯タイミングは、図７のようになり、図９の従来例
と比べてＬＥＤの消灯している間隔を短くすることがで
き、フリッカーを解消できる。経験的に２倍速表示や８
倍速表示を行った場合でも、ある程度フリッカーを低減
できるが、完全にフリッカーを解消するまでには至らな
い。
の点灯タイミングは、図７のようになり、図９の従来例
と比べてＬＥＤの消灯している間隔を短くすることがで
き、フリッカーを解消できる。経験的に２倍速表示や８
倍速表示を行った場合でも、ある程度フリッカーを低減
できるが、完全にフリッカーを解消するまでには至らな
い。
【００２２】次に、本発明の第２の実施形態について説
明する。上述した第１の実施形態は、１６×１６ドット
マトリクス・ダイナミック駆動方式のフルカラーＬＥＤ
ユニットにより構成された表示装置についての発明であ
るが、他の方式のＬＥＤユニットにより成された表示装
置にも応用できる。他の方式のＬＥＤユニットの例とし
ては、ＲＧＢ各色６４階調のＬＥＤユニット、ＲＧＢ各
２階調のＬＥＤユニット、ＲＧだけで構成されたＬＥＤ
ユニットなどである。
明する。上述した第１の実施形態は、１６×１６ドット
マトリクス・ダイナミック駆動方式のフルカラーＬＥＤ
ユニットにより構成された表示装置についての発明であ
るが、他の方式のＬＥＤユニットにより成された表示装
置にも応用できる。他の方式のＬＥＤユニットの例とし
ては、ＲＧＢ各色６４階調のＬＥＤユニット、ＲＧＢ各
２階調のＬＥＤユニット、ＲＧだけで構成されたＬＥＤ
ユニットなどである。
【００２３】
【発明の効果】以上説明したように、本発明によれば、
表示画面のフリツカーを解消できるので、表示装置の表
示画面の画質を向上させることができる。
表示画面のフリツカーを解消できるので、表示装置の表
示画面の画質を向上させることができる。
【図１】 本発明の実施の形態のＬＥＤ表示装置の構成
を示すブロック図
を示すブロック図
【図２】 実施の形態のＬＥＤ表示装置の画像データコ
ントロール部の構成を示すブロック図
ントロール部の構成を示すブロック図
【図３】 実施の形態のＬＥＤ表示装置のＮ倍速ＬＥＤ
ユニットコントロール部の構成を示すブロック図
ユニットコントロール部の構成を示すブロック図
【図４】 実施の形態のＬＥＤ表示装置のＬＥＤユニッ
トの構成を示すブロック図
トの構成を示すブロック図
【図５】 実施の形態のＬＥＤ表示装置のＬＥＤユニッ
トの動作を示すタイムチャート
トの動作を示すタイムチャート
【図６】 本発明の実施形態の具体例のＬＥＤ表示装置
の構成を示すブロック図
の構成を示すブロック図
【図７】 同実施形態の具体例のＬＥＤ表示装置の動作
を示すタイムチャート
を示すタイムチャート
【図８】 従来のＬＥＤ表示装置の構成を示すブロック
図
図
【図９】 従来のＬＥＤ表示装置の動作を示すタイムチ
ャート
ャート
１ アナログＲＧＢデジタイズ部 ２ 画像データコントロール部 ３ ＣＰＵ ４ Ｎ倍速ＬＥＤユニットコントロール部 ５ 表示パネル ６ ＬＥＤユニット ８ フィールドバッファ ９ 単位パネル制御部 １０ ＳＷ １１ ＬＥＤ階調基準クロック生成部 １２ ＲＳ−４２２ドライバー １３ ＲＳ−４２２レシーバー １４ 画像データデマルチプレクサ １５ 分周回路 １６ シフトクロック生成部 １７ ＬＥＤ書き込みタイミング生成部 １８ Ｓ／Ｐ変換部 １９ ＬＥＤ表示タイミング生成部 ２０ シフトレジスタ ２１ メモリ ２２ ＬＥＤユニット制御部 ２３、２５ ドライバー ２４ １６×１６ＬＥＤドットマトリクス
Claims (3)
- 【請求項１】 ダイナミックスキャン方式のＬＥＤユニ
ットを備えたＬＥＤ表示装置であって、１フレーム分の
画像を複数回表示させる手段を備えたことを特徴とする
ＬＥＤ表示装置 - 【請求項２】 前記手段は、１フレーム分の画像データ
を前記ＬＥＤユニット内のメモリに書き込んだ後、Ｎ倍
（Ｎ＝１、２、３、…の自然数）の数の表示信号により
前記画像データを読み出し、この画像データを元に１フ
レームの画面をＮ倍速表示することを特徴とする請求項
１記載のＬＥＤ表示装置 - 【請求項３】 ダイナミックスキャン方式のＬＥＤユニ
ットを備えたＬＥＤ表示装置であって、 画像データを記憶するためのメモリと、 ＬＥＤユニットを構成する複数個のＬＥＤをＮ倍速表示
させるためのＬＥＤ表示タイミング信号を生成するＬＥ
Ｄ表示タイミング生成部と、 Ｎ倍速表示に対応した階調基準クロックを生成するＬＥ
Ｄ階調基準クロック生成部と、 前記メモリに１フレーム分の画像データを書き込んだ
後、ＬＥＤ表示タイミング信号に基づき前記メモリから
画像データを読み出し、その画像データと前記階調基準
クロックを基に前記複数個のＬＥＤの夫々の点灯時間を
決定し、ＬＥＤを点灯させる信号を前記ＬＥＤユニット
のドライバに出力するＬＥＤユニット制御部と、 を備えたことを特徴とするＬＥＤ表示装置
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32178397A JPH11161230A (ja) | 1997-11-21 | 1997-11-21 | Ｌｅｄ表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32178397A JPH11161230A (ja) | 1997-11-21 | 1997-11-21 | Ｌｅｄ表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11161230A true JPH11161230A (ja) | 1999-06-18 |
Family
ID=18136383
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32178397A Pending JPH11161230A (ja) | 1997-11-21 | 1997-11-21 | Ｌｅｄ表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11161230A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP2717249A1 (en) | 2012-10-04 | 2014-04-09 | Panasonic Corporation | LED indicator and heating cooker having same |
| JP2015015994A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015996A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015992A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015998A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2016083072A (ja) * | 2014-10-24 | 2016-05-19 | 株式会社三共 | 遊技機 |
-
1997
- 1997-11-21 JP JP32178397A patent/JPH11161230A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP2717249A1 (en) | 2012-10-04 | 2014-04-09 | Panasonic Corporation | LED indicator and heating cooker having same |
| JP2015015994A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015996A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015992A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2015015998A (ja) * | 2013-07-09 | 2015-01-29 | 株式会社三共 | 遊技機 |
| JP2016083072A (ja) * | 2014-10-24 | 2016-05-19 | 株式会社三共 | 遊技機 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000516 |