JPH1042176A - 撮像装置 - Google Patents
撮像装置Info
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- JPH1042176A JPH1042176A JP8213252A JP21325296A JPH1042176A JP H1042176 A JPH1042176 A JP H1042176A JP 8213252 A JP8213252 A JP 8213252A JP 21325296 A JP21325296 A JP 21325296A JP H1042176 A JPH1042176 A JP H1042176A
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- Japan
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- signal
- unit
- phase
- clock
- synchronization
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N23/00—Cameras or camera modules comprising electronic image sensors; Control thereof
- H04N23/60—Control of cameras or camera modules
- H04N23/66—Remote control of cameras or camera parts, e.g. by remote control devices
- H04N23/663—Remote control of cameras or camera parts, e.g. by remote control devices for controlling interchangeable camera parts based on electronic image sensor signals
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Studio Devices (AREA)
Abstract
(57)【要約】
【課題】 カメラヘッド部とメイン部間の信号数、信号
線数を削減して、ケーブル長による遅延時間の影響を無
くする撮像装置。 【解決手段】 撮像部６１からの信号、ＣＬＫおよびＨ
Ｄ信号のいずれかを決められた手順に従って選択してカ
メラヘッド部９からメイン部１０へ電送する手段（ＳＷ
回路３，ＣＰＵ１）と、電送されたＣＬＫおよびＨＤ信
号を決められた手順でメイン部１０の信号と比較し位相
同期させる位相制御手段（位相制御ブロック５，ＣＰＵ
２）と、メイン部の信号に位相同期したＣＬＫおよびＨ
Ｄ信号をカメラヘッド部へ電送し同期補正する手段（Ｃ
ＰＵ１，ＣＰＵ２，ＳＳＧ４，ＴＧ６４）を備えてい
る。
線数を削減して、ケーブル長による遅延時間の影響を無
くする撮像装置。 【解決手段】 撮像部６１からの信号、ＣＬＫおよびＨ
Ｄ信号のいずれかを決められた手順に従って選択してカ
メラヘッド部９からメイン部１０へ電送する手段（ＳＷ
回路３，ＣＰＵ１）と、電送されたＣＬＫおよびＨＤ信
号を決められた手順でメイン部１０の信号と比較し位相
同期させる位相制御手段（位相制御ブロック５，ＣＰＵ
２）と、メイン部の信号に位相同期したＣＬＫおよびＨ
Ｄ信号をカメラヘッド部へ電送し同期補正する手段（Ｃ
ＰＵ１，ＣＰＵ２，ＳＳＧ４，ＴＧ６４）を備えてい
る。
Description
【０００１】
【発明の属する技術分野】本発明は、撮像装置に関し、
特に撮像部と信号処理部をケーブル等で接続して分離し
て使用する撮像装置に関するものである。
特に撮像部と信号処理部をケーブル等で接続して分離し
て使用する撮像装置に関するものである。
【０００２】
【従来の技術】従来、固体撮像素子（以下、ＣＣＤと略
す）を用いた撮像装置は、最近ＣＣＤ撮像部とＣＣＤか
らの信号を処理してビデオ信号として出力する信号処理
部を分離し、その間をケーブル等で延長する、いわゆる
ヘッド分離型カメラと呼ばれる撮像装置が数多く提案さ
れている。
す）を用いた撮像装置は、最近ＣＣＤ撮像部とＣＣＤか
らの信号を処理してビデオ信号として出力する信号処理
部を分離し、その間をケーブル等で延長する、いわゆる
ヘッド分離型カメラと呼ばれる撮像装置が数多く提案さ
れている。
【０００３】また、ＣＣＤ撮像方式は、最近、小型，軽
量化が進んできて、とりわけ半導体技術の進歩により高
速のアナログ−デジタル変換器（以降、Ａ／Ｄ変換器と
略す）、デジタル−アナログ変換器（以降、Ｄ／Ａ変換
器と略す）を用いてデジタル信号として信号処理する方
式が盛んに提案されている。
量化が進んできて、とりわけ半導体技術の進歩により高
速のアナログ−デジタル変換器（以降、Ａ／Ｄ変換器と
略す）、デジタル−アナログ変換器（以降、Ｄ／Ａ変換
器と略す）を用いてデジタル信号として信号処理する方
式が盛んに提案されている。
【０００４】但し、これらのヘッド分離型カメラは操作
性はよいものの、カメラヘッド部とメイン部間でＣＣＤ
信号や、同期合わせのためのＨＤ，ＶＤ，ＣＬＫ（クロ
ック）、更に制御信号等多数の信号が必要となり、電送
ケーブルに多大のコストが発生していた。また、ＣＬ
Ｋ，ＨＤ，ＣＣＤ信号等それぞれ別々の信号線で電送し
ているような場合、電送ケーブルの長さを変えた場合に
ケーブル遅延による同期ズレ、色信号が反転するといっ
た問題が発生したり、更に外部同期ができるシステムを
構成できなかったので、接続する電子機器同志間の同期
合わせが難しかった。
性はよいものの、カメラヘッド部とメイン部間でＣＣＤ
信号や、同期合わせのためのＨＤ，ＶＤ，ＣＬＫ（クロ
ック）、更に制御信号等多数の信号が必要となり、電送
ケーブルに多大のコストが発生していた。また、ＣＬ
Ｋ，ＨＤ，ＣＣＤ信号等それぞれ別々の信号線で電送し
ているような場合、電送ケーブルの長さを変えた場合に
ケーブル遅延による同期ズレ、色信号が反転するといっ
た問題が発生したり、更に外部同期ができるシステムを
構成できなかったので、接続する電子機器同志間の同期
合わせが難しかった。
【０００５】図６はこうした従来の撮像装置のブロック
図である。図６において、６１はＣＣＤ、６２はＣＣＤ
の出力をサンプルホールドするサンプルホールド（Ｓ
Ｈ）回路、６３はＣＣＤ信号のゲインを制御するＡＧＣ
制御回路、６４はＣＣＤ６１やＳＨ回路６２などに必要
なタイミング信号を発生させるタイミングコントローラ
ＴＧ、６７はカメラヘッド各部の制御を行うＣＰＵであ
る。ＴＧ６４にはＣＬＫの２倍の周波数のクロックであ
る２ＣＬＫが入力している。ＴＧ用のクロックはＣＣＤ
６１を駆動するための各種タイミング信号の時間精度を
上げるためクロックＣＬＫの２倍のものを通常必要とす
る。
図である。図６において、６１はＣＣＤ、６２はＣＣＤ
の出力をサンプルホールドするサンプルホールド（Ｓ
Ｈ）回路、６３はＣＣＤ信号のゲインを制御するＡＧＣ
制御回路、６４はＣＣＤ６１やＳＨ回路６２などに必要
なタイミング信号を発生させるタイミングコントローラ
ＴＧ、６７はカメラヘッド各部の制御を行うＣＰＵであ
る。ＴＧ６４にはＣＬＫの２倍の周波数のクロックであ
る２ＣＬＫが入力している。ＴＧ用のクロックはＣＣＤ
６１を駆動するための各種タイミング信号の時間精度を
上げるためクロックＣＬＫの２倍のものを通常必要とす
る。
【０００６】ケーブル８はカメラヘッド２００とメイン
３００を接続するためのもので、ケーブル８により、Ｃ
ＣＤ信号及びＣＣＤ信号に同期したＣＬＫ、ＣＰＵ６７
とＣＰＵ７４の通信用ＲＸ信号が、カメラヘッド２００
からメイン３００に出力される。また、ケーブル８によ
りＣＣＤ６１と信号処理回路７０の同期合わせのための
ＨＤ（水平同期）信号、ＶＤ（垂直同期）信号、ＣＰＵ
６７とＣＰＵ７４の通信用ＴＸ信号が、メイン３００か
らカメラヘッド２００に出力される。
３００を接続するためのもので、ケーブル８により、Ｃ
ＣＤ信号及びＣＣＤ信号に同期したＣＬＫ、ＣＰＵ６７
とＣＰＵ７４の通信用ＲＸ信号が、カメラヘッド２００
からメイン３００に出力される。また、ケーブル８によ
りＣＣＤ６１と信号処理回路７０の同期合わせのための
ＨＤ（水平同期）信号、ＶＤ（垂直同期）信号、ＣＰＵ
６７とＣＰＵ７４の通信用ＴＸ信号が、メイン３００か
らカメラヘッド２００に出力される。
【０００７】ＴＧ６４は、ＨＤ信号によりカメラ用のデ
ジタル信号処理回路ＤＳＰ７０と、ＣＣＤ６１の水平同
期を合わせている。同様に、ＴＧはＶＤ信号によりＤＳ
Ｐ７０と、ＣＣＤ６１の垂直同期を合わせている。ま
た、ＣＰＵ６７はＣＰＵ７４とＴＸ，ＲＸ信号により通
信を行い、ＡＧＣ６３でＣＣＤ６１のゲインを、その他
カメラのアイリス、ズーム（図示していない）などを制
御している。
ジタル信号処理回路ＤＳＰ７０と、ＣＣＤ６１の水平同
期を合わせている。同様に、ＴＧはＶＤ信号によりＤＳ
Ｐ７０と、ＣＣＤ６１の垂直同期を合わせている。ま
た、ＣＰＵ６７はＣＰＵ７４とＴＸ，ＲＸ信号により通
信を行い、ＡＧＣ６３でＣＣＤ６１のゲインを、その他
カメラのアイリス、ズーム（図示していない）などを制
御している。
【０００８】ケーブル８でメイン部３００へ電送された
ＣＣＤ信号は、Ａ／Ｄ変換器６９でＣＬＫ信号に同期し
てデジタル信号に変換され、信号処理回路ＤＳＰ７０で
カラー撮像装置に必要なフィルタ，色分離，ガンマ，マ
トリクス，クリップ等のデジタル処理を行って、Ｄ／Ａ
変換器７１でデジタル−アナログ変換してＮＴＳＣ信号
（ビデオ信号）として出力する。
ＣＣＤ信号は、Ａ／Ｄ変換器６９でＣＬＫ信号に同期し
てデジタル信号に変換され、信号処理回路ＤＳＰ７０で
カラー撮像装置に必要なフィルタ，色分離，ガンマ，マ
トリクス，クリップ等のデジタル処理を行って、Ｄ／Ａ
変換器７１でデジタル−アナログ変換してＮＴＳＣ信号
（ビデオ信号）として出力する。
【０００９】
【発明が解決しようとする課題】しかしながら、上記従
来例では、カメラヘッド部２００と、メイン部３００の
間でＣＣＤ信号や、同期合わせのためのＨＤ，ＶＤ，Ｃ
ＬＫ，通信用ＴＸ，ＲＸ信号などの多数の信号とその信
号線が必要なので、信号送信受信のための部品点数が増
大し、ローコスト，省スペースにはなりにくいという問
題がある。
来例では、カメラヘッド部２００と、メイン部３００の
間でＣＣＤ信号や、同期合わせのためのＨＤ，ＶＤ，Ｃ
ＬＫ，通信用ＴＸ，ＲＸ信号などの多数の信号とその信
号線が必要なので、信号送信受信のための部品点数が増
大し、ローコスト，省スペースにはなりにくいという問
題がある。
【００１０】また、電送ケーブル８の長さを変えた場合
に、信号の遅延が発生して、ＨＤ，ＶＤ，ＣＬＫなどの
同期がズレたり、１画素毎に色信号が異なる、いわゆる
単板カラーＣＣＤ信号の場合は、ＣＣＤからの読出しタ
イミングとデジタル信号処理とのタイミングが１画素ズ
レることで、色が反転した色出力になってしまう。例え
ば、シァン＋グリーン信号と、イエロー＋マゼンタ信号
が入れ代わって処理されてしまうといった問題がある。
に、信号の遅延が発生して、ＨＤ，ＶＤ，ＣＬＫなどの
同期がズレたり、１画素毎に色信号が異なる、いわゆる
単板カラーＣＣＤ信号の場合は、ＣＣＤからの読出しタ
イミングとデジタル信号処理とのタイミングが１画素ズ
レることで、色が反転した色出力になってしまう。例え
ば、シァン＋グリーン信号と、イエロー＋マゼンタ信号
が入れ代わって処理されてしまうといった問題がある。
【００１１】更に、クロック発生源（２ＣＬＫ）がカメ
ラヘッド２００側なので、外部の信号にクロック単位で
同期させることができないという問題がある。
ラヘッド２００側なので、外部の信号にクロック単位で
同期させることができないという問題がある。
【００１２】依って、請求項１に記載の発明の目的は、
カメラヘッド部とメイン部間での信号本数を削減して、
１本の信号線でクロックと水平同期信号とＣＣＤ信号を
切換えて出力することで信号線の本数も削減し、同時に
ケーブルの長さが変化しても同期ズレが発生しない撮像
装置を提供することにある。
カメラヘッド部とメイン部間での信号本数を削減して、
１本の信号線でクロックと水平同期信号とＣＣＤ信号を
切換えて出力することで信号線の本数も削減し、同時に
ケーブルの長さが変化しても同期ズレが発生しない撮像
装置を提供することにある。
【００１３】更に、請求項２に記載の発明の目的は、外
部同期を可能にして機器間の同期合わせを容易にする撮
像装置を提供することにある。
部同期を可能にして機器間の同期合わせを容易にする撮
像装置を提供することにある。
【００１４】更に、請求項３に記載の発明の目的は、装
置の電源立ち上げ時に、クロック、水平同期信号等の同
期合わせ手順を済ませて、実際の撮像時には同期ズレの
影響が無くなったクリアな画像の撮像が可能な撮像装置
を提供することにある。
置の電源立ち上げ時に、クロック、水平同期信号等の同
期合わせ手順を済ませて、実際の撮像時には同期ズレの
影響が無くなったクリアな画像の撮像が可能な撮像装置
を提供することにある。
【００１５】更に、請求項４に記載の発明の目的は、カ
メラヘッド側からメイン部へ１本の電送線で、クロッ
ク、水平同期信号、ＣＣＤ信号の３つの信号を時分割に
より迅速に正確に電送することによって、信号線を削減
し、ケーブル長による遅延時間の影響を無くすことがで
きる撮像装置を提供することにある。
メラヘッド側からメイン部へ１本の電送線で、クロッ
ク、水平同期信号、ＣＣＤ信号の３つの信号を時分割に
より迅速に正確に電送することによって、信号線を削減
し、ケーブル長による遅延時間の影響を無くすことがで
きる撮像装置を提供することにある。
【００１６】更に、請求項５に記載の発明の目的は、カ
メラヘッド部とメイン部間のクロックと、水平同期信号
の位相を比較して正確に同期調整することが可能な撮像
装置を提供することにある。
メラヘッド部とメイン部間のクロックと、水平同期信号
の位相を比較して正確に同期調整することが可能な撮像
装置を提供することにある。
【００１７】更に、請求項６に記載の発明の目的は、メ
イン部側で調整したクロックの位相にカメラヘッド側の
クロックを正確に同期させ、ケーブル長による遅延時間
を補正できる撮像装置を提供することにある。
イン部側で調整したクロックの位相にカメラヘッド側の
クロックを正確に同期させ、ケーブル長による遅延時間
を補正できる撮像装置を提供することにある。
【００１８】更に、請求項７に記載の発明の目的は、メ
イン部側で調整した水平同期信号の位相にカメラヘッド
側の水平同期信号を正確に同期させ、ケーブル長による
遅延時間を補正できる撮像装置を提供することにある。
イン部側で調整した水平同期信号の位相にカメラヘッド
側の水平同期信号を正確に同期させ、ケーブル長による
遅延時間を補正できる撮像装置を提供することにある。
【００１９】
【課題を解決するための手段】本出願に係る発明の目的
を実現する構成は、請求項１に記載のように、光信号を
電気信号に変換するための撮像部、同期信号発生器およ
び制御部から成るカメラヘッド部と、前記同期信号発生
器、信号処理回路および制御部から成るメイン部とを有
し、それぞれ別体のカメラヘッド部とメイン部をケーブ
ルで接続した撮像装置において、前記撮像部からの信
号、クロックおよび水平同期信号のいずれかの信号を決
められた手順により選択してカメラヘッド部からメイン
部へ電送する手段と、前記電送されたクロックおよび水
平同期信号を前記決められた手順によりメイン部のクロ
ックおよび水平同期信号と位相比較してメイン部の信号
に位相同期するように制御する位相制御手段と、前記メ
イン部の信号に位相同期したクロックおよび水平同期信
号を前記決められた手順でメイン部よりカメラヘッド部
へ電送して同期を補正する手段とを備えたことを特徴と
する撮像装置にある。
を実現する構成は、請求項１に記載のように、光信号を
電気信号に変換するための撮像部、同期信号発生器およ
び制御部から成るカメラヘッド部と、前記同期信号発生
器、信号処理回路および制御部から成るメイン部とを有
し、それぞれ別体のカメラヘッド部とメイン部をケーブ
ルで接続した撮像装置において、前記撮像部からの信
号、クロックおよび水平同期信号のいずれかの信号を決
められた手順により選択してカメラヘッド部からメイン
部へ電送する手段と、前記電送されたクロックおよび水
平同期信号を前記決められた手順によりメイン部のクロ
ックおよび水平同期信号と位相比較してメイン部の信号
に位相同期するように制御する位相制御手段と、前記メ
イン部の信号に位相同期したクロックおよび水平同期信
号を前記決められた手順でメイン部よりカメラヘッド部
へ電送して同期を補正する手段とを備えたことを特徴と
する撮像装置にある。
【００２０】この構成によれば、カメラヘッド部からメ
イン部へ１本の信号線でクロック、水平同期信号、ＣＣ
Ｄ信号を決められた手順に従って切換え電送し、決めら
れた手順に従ってクロック若しくは水平同期信号をメイ
ン部のクロック若しくは水平同期信号と位相同期させ、
位相同期させたクロック、水平同期信号を決められた手
順でカメラヘッド側へバックして同期を補正することが
できる。
イン部へ１本の信号線でクロック、水平同期信号、ＣＣ
Ｄ信号を決められた手順に従って切換え電送し、決めら
れた手順に従ってクロック若しくは水平同期信号をメイ
ン部のクロック若しくは水平同期信号と位相同期させ、
位相同期させたクロック、水平同期信号を決められた手
順でカメラヘッド側へバックして同期を補正することが
できる。
【００２１】本出願に係る発明の目的を実現する他の構
成は、請求項２に記載のように、請求項１に記載の撮像
装置において、前記メイン部の同期信号発生器は外部か
らの水平同期信号および垂直同期信号に位相同期し、外
部からのクロック入力を基準として動作することを特徴
とする撮像装置にある。
成は、請求項２に記載のように、請求項１に記載の撮像
装置において、前記メイン部の同期信号発生器は外部か
らの水平同期信号および垂直同期信号に位相同期し、外
部からのクロック入力を基準として動作することを特徴
とする撮像装置にある。
【００２２】この構成によれば、水平、垂直同期信号、
クロックの外部との同期合わせが可能になる。
クロックの外部との同期合わせが可能になる。
【００２３】本出願に係る発明の目的を実現する具体的
な構成は、請求項３に記載のように、前記カメラヘッド
部の電送する手段による各信号の切換え電送と、前記メ
イン部の位相制御手段による位相同期手順は、電源立ち
上げ時に行うことを特徴とする請求項１又は２記載の撮
像装置にある。
な構成は、請求項３に記載のように、前記カメラヘッド
部の電送する手段による各信号の切換え電送と、前記メ
イン部の位相制御手段による位相同期手順は、電源立ち
上げ時に行うことを特徴とする請求項１又は２記載の撮
像装置にある。
【００２４】この構成によれば、電源立ち上げ時に各信
号の同期調整をすることで以降はクリアな撮像を行うこ
とができる。
号の同期調整をすることで以降はクリアな撮像を行うこ
とができる。
【００２５】本出願に係る発明の目的を実現する他の具
体的な構成は、請求項４に記載のように、前記電送する
手段は、前記撮像部の信号、クロックおよび水平同期信
号の各信号を時分割多重して前記決められた手順により
選択出力することを特徴とする請求項１記載の撮像装置
にある。
体的な構成は、請求項４に記載のように、前記電送する
手段は、前記撮像部の信号、クロックおよび水平同期信
号の各信号を時分割多重して前記決められた手順により
選択出力することを特徴とする請求項１記載の撮像装置
にある。
【００２６】この構成によれば、撮像部の信号、クロッ
クおよび水平同期信号をカメラヘッド部からメイン部へ
１本の信号線で、決められた順序に従い迅速に正確に電
送することができる。
クおよび水平同期信号をカメラヘッド部からメイン部へ
１本の信号線で、決められた順序に従い迅速に正確に電
送することができる。
【００２７】本出願に係る発明の目的を実現する他の具
体的な構成は、請求項５に記載のように、光信号を電気
信号に変換するための撮像部、同期信号発生器および制
御部から成るカメラヘッド部と、前記同期信号発生器、
信号処理回路および制御部から成るメイン部とを有し、
それぞれ別体のカメラヘッド部とメイン部をケーブルで
接続した撮像装置において、前記撮像部からの信号、ク
ロックおよび水平同期信号のいずれかの信号を決められ
た手順により選択してカメラヘッド部からメイン部へ電
送する手段と、前記電送されたクロックおよび水平同期
信号を前記決められた手順によりメイン部のクロックお
よび水平同期信号と位相比較してメイン部の信号に位相
同期するように制御する位相制御手段と、前記メイン部
の信号に位相同期したクロックおよび水平同期信号を前
記決められた手順でメイン部よりカメラヘッド部へ電送
して同期を補正する手段とを備え、前記位相制御手段
は、カメラヘッド部とメイン部のクロック位相を比較す
るクロック位相検出器と、カメラヘッド部とメイン部の
水平同期信号の位相を比較する同期信号位相検出器と、
前記クロック位相検出器で検出した位相差を調整する位
相シフト回路と、前記同期信号位相検出器で検出した位
相差を合わせる同期信号発生器とを有することを特徴と
する撮像装置にある。
体的な構成は、請求項５に記載のように、光信号を電気
信号に変換するための撮像部、同期信号発生器および制
御部から成るカメラヘッド部と、前記同期信号発生器、
信号処理回路および制御部から成るメイン部とを有し、
それぞれ別体のカメラヘッド部とメイン部をケーブルで
接続した撮像装置において、前記撮像部からの信号、ク
ロックおよび水平同期信号のいずれかの信号を決められ
た手順により選択してカメラヘッド部からメイン部へ電
送する手段と、前記電送されたクロックおよび水平同期
信号を前記決められた手順によりメイン部のクロックお
よび水平同期信号と位相比較してメイン部の信号に位相
同期するように制御する位相制御手段と、前記メイン部
の信号に位相同期したクロックおよび水平同期信号を前
記決められた手順でメイン部よりカメラヘッド部へ電送
して同期を補正する手段とを備え、前記位相制御手段
は、カメラヘッド部とメイン部のクロック位相を比較す
るクロック位相検出器と、カメラヘッド部とメイン部の
水平同期信号の位相を比較する同期信号位相検出器と、
前記クロック位相検出器で検出した位相差を調整する位
相シフト回路と、前記同期信号位相検出器で検出した位
相差を合わせる同期信号発生器とを有することを特徴と
する撮像装置にある。
【００２８】この構成によれば、クロック位相検出器で
カメラヘッド部のクロックの位相ズレを検出して、位相
シフト回路でメイン部のクロックに同期させ、同期信号
位相検出器でカメラヘッド部の水平同期信号の位相ズレ
を検出して、同期信号発生器でメイン部の水平同期信号
の位相に合わせることができる。
カメラヘッド部のクロックの位相ズレを検出して、位相
シフト回路でメイン部のクロックに同期させ、同期信号
位相検出器でカメラヘッド部の水平同期信号の位相ズレ
を検出して、同期信号発生器でメイン部の水平同期信号
の位相に合わせることができる。
【００２９】本出願に係る発明の目的を実現する他の具
体的な構成は、請求項６に記載のように、前記補正する
手段は、前記カメラヘッド部とメイン部のクロック位相
同期をカメラヘッド部とメイン部の制御部間のＴＸ，Ｒ
Ｘ通信によってタイミングを合わせ、前記決められた手
順で補正することを特徴とする請求項１記載の撮像装置
にある。
体的な構成は、請求項６に記載のように、前記補正する
手段は、前記カメラヘッド部とメイン部のクロック位相
同期をカメラヘッド部とメイン部の制御部間のＴＸ，Ｒ
Ｘ通信によってタイミングを合わせ、前記決められた手
順で補正することを特徴とする請求項１記載の撮像装置
にある。
【００３０】この構成によれば、メイン部からのカメラ
ヘッド部のクロックの同期補正は、制御部間のＴＸ，Ｒ
Ｘ通信で合わせ決められた手順に従って補正することが
できる。
ヘッド部のクロックの同期補正は、制御部間のＴＸ，Ｒ
Ｘ通信で合わせ決められた手順に従って補正することが
できる。
【００３１】本出願に係る発明の目的を実現する他の具
体的な構成は、請求項７に記載のように、前記補正する
手段は、前記カメラヘッド部とメイン部の水平同期信号
位相同期をカメラヘッド部とメイン部の制御部間のＴ
Ｘ，ＲＸ通信によってタイミングを合わせ前記決められ
た手順で補正することを特徴とする請求項１記載の撮像
装置にある。
体的な構成は、請求項７に記載のように、前記補正する
手段は、前記カメラヘッド部とメイン部の水平同期信号
位相同期をカメラヘッド部とメイン部の制御部間のＴ
Ｘ，ＲＸ通信によってタイミングを合わせ前記決められ
た手順で補正することを特徴とする請求項１記載の撮像
装置にある。
【００３２】この構成によれば、メイン部からのカメラ
ヘッド部の水平同期信号の同期補正は、双方の制御部間
のＴＸ，ＲＸ通信によってタイミングを合わせ決められ
た手順に従って補正することができる。
ヘッド部の水平同期信号の同期補正は、双方の制御部間
のＴＸ，ＲＸ通信によってタイミングを合わせ決められ
た手順に従って補正することができる。
【００３３】
【発明の実施の形態】以下、本発明の実施の形態につい
て図に基づいて説明する。図１は本発明の実施の形態に
係る撮像装置のブロック図である。図２は図１に示す位
相制御ブロックのブロック図である。図３は図１に示す
撮像装置のクロック同期合わせのタイムチャートであ
る。図４は図１に示す撮像装置の水平同期合わせのタイ
ムチャートである。図５は図１に示す撮像装置の同期合
わせのシーケンスを示す図である。
て図に基づいて説明する。図１は本発明の実施の形態に
係る撮像装置のブロック図である。図２は図１に示す位
相制御ブロックのブロック図である。図３は図１に示す
撮像装置のクロック同期合わせのタイムチャートであ
る。図４は図１に示す撮像装置の水平同期合わせのタイ
ムチャートである。図５は図１に示す撮像装置の同期合
わせのシーケンスを示す図である。
【００３４】図１において、９はカメラヘッド部、１０
はメイン部であり、ケーブル８で接続されている。
はメイン部であり、ケーブル８で接続されている。
【００３５】カメラヘッド部９中、６１はＣＣＤ、６２
はＳＨ回路、６３はＣＣＤ信号のゲインを制御するＡＧ
Ｃ制御回路、６４はＣＣＤ６１やＳＨ回路６２などに必
要なタイミング信号を発生するタイミングコントローラ
であり、ここまでは図６に示す従来例と同一であり、以
降が本発明の新構成の部分である。
はＳＨ回路、６３はＣＣＤ信号のゲインを制御するＡＧ
Ｃ制御回路、６４はＣＣＤ６１やＳＨ回路６２などに必
要なタイミング信号を発生するタイミングコントローラ
であり、ここまでは図６に示す従来例と同一であり、以
降が本発明の新構成の部分である。
【００３６】１はカメラヘッド側のＣＰＵで、制御信号
ＣＮＴ１，ＣＮＴ２によって決められた手順を実行し、
メイン部１０側のＣＰＵ２と通信用ＴＸ，ＲＸ信号によ
る通信を行い、ＡＧＣ回路６３におけるＣＣＤゲイン
や、カメラのアイリス、ズーム（図示していない）等の
制御も行う。３はＡＧＣ回路６３からのＣＣＤ信号と、
ＨＤ信号（水平同期）、ＣＬＫ信号（クロック）のいず
れか１つの信号を、決められた手順を示すＣＰＵ１のＣ
ＮＴ１信号，ＣＮＴ２信号により選択して、１本の信号
線（ＣＣＤライン）を介しメイン部１０側へ電送するＳ
Ｗ回路である。
ＣＮＴ１，ＣＮＴ２によって決められた手順を実行し、
メイン部１０側のＣＰＵ２と通信用ＴＸ，ＲＸ信号によ
る通信を行い、ＡＧＣ回路６３におけるＣＣＤゲイン
や、カメラのアイリス、ズーム（図示していない）等の
制御も行う。３はＡＧＣ回路６３からのＣＣＤ信号と、
ＨＤ信号（水平同期）、ＣＬＫ信号（クロック）のいず
れか１つの信号を、決められた手順を示すＣＰＵ１のＣ
ＮＴ１信号，ＣＮＴ２信号により選択して、１本の信号
線（ＣＣＤライン）を介しメイン部１０側へ電送するＳ
Ｗ回路である。
【００３７】４はメイン部１０からのコンポジット信号
（ＨＤ，ＶＤ多重信号）ＳＹＮＣに同期して、水平同期
ＨＤ、垂直同期ＶＤなどの同期信号を発生する同期信号
発生器ＳＳＧ、なお、ＴＧ６４はＳＳＧ４からのＨＤ信
号によりＣＣＤ６１の水平同期を合わせ、ＶＤ信号によ
って垂直同期を合わせている。また、ＴＧ６４は、２Ｃ
ＬＫを１／２に分周してＳＳＧ４へＣＬＫを送ってい
る。
（ＨＤ，ＶＤ多重信号）ＳＹＮＣに同期して、水平同期
ＨＤ、垂直同期ＶＤなどの同期信号を発生する同期信号
発生器ＳＳＧ、なお、ＴＧ６４はＳＳＧ４からのＨＤ信
号によりＣＣＤ６１の水平同期を合わせ、ＶＤ信号によ
って垂直同期を合わせている。また、ＴＧ６４は、２Ｃ
ＬＫを１／２に分周してＳＳＧ４へＣＬＫを送ってい
る。
【００３８】一方、メイン部１０中、６９はＣＣＤ信号
をＡ／Ｄ変換するＡ／Ｄ変換器、７０はＡ／Ｄ変換され
た信号に、フィルタ，色分離，ガンマ，マトリックス，
クリップ等のデジタル処理を行うＤＳＰ回路、７１はＤ
／Ａ変換器で信号をＤ／Ａ変換してＮＴＳＣ信号として
モニタ等へ出力する。ここまでは図６に示す従来例のメ
イン部と同一であり、以降が本発明の新構成の部分であ
る。
をＡ／Ｄ変換するＡ／Ｄ変換器、７０はＡ／Ｄ変換され
た信号に、フィルタ，色分離，ガンマ，マトリックス，
クリップ等のデジタル処理を行うＤＳＰ回路、７１はＤ
／Ａ変換器で信号をＤ／Ａ変換してＮＴＳＣ信号として
モニタ等へ出力する。ここまでは図６に示す従来例のメ
イン部と同一であり、以降が本発明の新構成の部分であ
る。
【００３９】２はメイン部１０のＣＰＵで、決められた
手順を示すＣＮＴ１，ＣＮＴ２による位相制御ブロック
５の制御を始めとするメイン部全体の制御と、通信用Ｔ
Ｘ，ＲＸ信号によるＣＰＵ１との通信を行う。６はメイ
ン部外の外部発振器で基準クロック２ＣＬＫ、水平同期
ＨＤ、垂直同期ＶＤ信号をメンイ部１０へ入力している
（これによって外部装置との同期合わせを可能にしてい
る）。
手順を示すＣＮＴ１，ＣＮＴ２による位相制御ブロック
５の制御を始めとするメイン部全体の制御と、通信用Ｔ
Ｘ，ＲＸ信号によるＣＰＵ１との通信を行う。６はメイ
ン部外の外部発振器で基準クロック２ＣＬＫ、水平同期
ＨＤ、垂直同期ＶＤ信号をメンイ部１０へ入力している
（これによって外部装置との同期合わせを可能にしてい
る）。
【００４０】水平同期ＨＤ、垂直同期ＶＤ信号は同期信
号発生器ＳＳＧ７２に入力して、外部発振器１５との水
平同期、垂直同期の外部同期が取られる。また、２倍の
基準クロック２ＣＬＫは分周器７で１／２分周して、Ａ
／Ｄ，Ｄ／Ａ変換器６９，７１、ＤＳＰ７０の基準クロ
ックとなる。
号発生器ＳＳＧ７２に入力して、外部発振器１５との水
平同期、垂直同期の外部同期が取られる。また、２倍の
基準クロック２ＣＬＫは分周器７で１／２分周して、Ａ
／Ｄ，Ｄ／Ａ変換器６９，７１、ＤＳＰ７０の基準クロ
ックとなる。
【００４１】５は位相制御ブロックで、外部発振器６か
らの２ＣＬＫを所定の位相に調整して、基準クロックと
してカメラヘッド９へ送る。また、ＳＳＧ７２からの水
平同期ＨＤ、垂直同期ＶＤ信号を所定の位相に調整後、
コンポジット信号（ＨＤ，ＶＤ多重信号）ＳＹＮＣとし
てカメラヘッド９へ送り、基準の水平、垂直同期とす
る。また、電源立ち上げ時にはカメラヘッド９のＳＷ回
路３からの、ＣＬＫ，ＨＤ信号を位相補正する調整をＣ
ＰＵ２の制御に基づいて行う。
らの２ＣＬＫを所定の位相に調整して、基準クロックと
してカメラヘッド９へ送る。また、ＳＳＧ７２からの水
平同期ＨＤ、垂直同期ＶＤ信号を所定の位相に調整後、
コンポジット信号（ＨＤ，ＶＤ多重信号）ＳＹＮＣとし
てカメラヘッド９へ送り、基準の水平、垂直同期とす
る。また、電源立ち上げ時にはカメラヘッド９のＳＷ回
路３からの、ＣＬＫ，ＨＤ信号を位相補正する調整をＣ
ＰＵ２の制御に基づいて行う。
【００４２】つぎに動作について説明する。先ず、電源
立ち上げ時に、「決められた手順」として、例えば図５
のシーケンスに示すように、ＣＬＫ出力，ＨＤ出力，Ｃ
ＣＤ信号出力，の順に行うものとすれば、ＳＷ回路３の
切換え順序を、ＣＬＫ，ＨＤ，ＣＣＤ信号の順に切換え
て出力し、ＣＰＵ１はＣＬＫ：ＣＮＴ１，ＨＤ：ＣＮＴ
２の対応順に１本の信号線で時分割多重により電送す
る。
立ち上げ時に、「決められた手順」として、例えば図５
のシーケンスに示すように、ＣＬＫ出力，ＨＤ出力，Ｃ
ＣＤ信号出力，の順に行うものとすれば、ＳＷ回路３の
切換え順序を、ＣＬＫ，ＨＤ，ＣＣＤ信号の順に切換え
て出力し、ＣＰＵ１はＣＬＫ：ＣＮＴ１，ＨＤ：ＣＮＴ
２の対応順に１本の信号線で時分割多重により電送す
る。
【００４３】ＳＷ回路３からの信号はメイン部１０の位
相制御ブロック５に入力される。図２はその位相制御ブ
ロック５のブロック図である。位相制御ブロック５は、
位相シフト回路５２と、ＣＮＴ１スイッチ５３と、ＣＮ
Ｔ２スイッチ５６と、ＣＬＫ信号の位相検出器５４と、
ＨＤ信号の位相検出器５５と、同期信号発生器ＳＳＧ５
７から成っている。
相制御ブロック５に入力される。図２はその位相制御ブ
ロック５のブロック図である。位相制御ブロック５は、
位相シフト回路５２と、ＣＮＴ１スイッチ５３と、ＣＮ
Ｔ２スイッチ５６と、ＣＬＫ信号の位相検出器５４と、
ＨＤ信号の位相検出器５５と、同期信号発生器ＳＳＧ５
７から成っている。
【００４４】先ずＣＬＫ位相制御のシーケンスではＣＰ
Ｕ２のＣＮＴ１による制御となり、ＳＷ回路３からＨＥ
ＡＤ（カメラヘッド）のＣＬＫ信号が入力し、位相検出
器５４でメイン部１０のＣＬＫと比較して、位相エラー
信号がＣＮＴ１スイッチ５３を通って位相シフト回路５
２へ送られる。位相シフト回路５２では、位相エラーが
零になるようにカメラヘッド部９へ送る２ＣＬＫ信号の
位相を制御する。これによってヘッド９側のＣＬＫとメ
イン部１０のＣＬＫの位相が一致する。
Ｕ２のＣＮＴ１による制御となり、ＳＷ回路３からＨＥ
ＡＤ（カメラヘッド）のＣＬＫ信号が入力し、位相検出
器５４でメイン部１０のＣＬＫと比較して、位相エラー
信号がＣＮＴ１スイッチ５３を通って位相シフト回路５
２へ送られる。位相シフト回路５２では、位相エラーが
零になるようにカメラヘッド部９へ送る２ＣＬＫ信号の
位相を制御する。これによってヘッド９側のＣＬＫとメ
イン部１０のＣＬＫの位相が一致する。
【００４５】次に、ＨＤ信号の位相制御ではＣＰＵ２に
よるＣＮＴ２による制御となり、ＳＷ回路３からＨＥＡ
ＤのＨＤ信号が入力し、位相検出器５５でメイン部１０
のＨＤ信号と比較され、位相エラー信号がＣＮＴ２スイ
ッチ５６を通って、同期信号発生器ＳＳＧ５７へ送られ
る。ＳＳＧ５７は位相エラーが零になるように、カメラ
ヘッド部９へ送るＳＹＮＣの水平同期位相を制御する。
これによってカメラヘッド９のＨＤ信号とメイン部１０
のＨＤ信号の位相が一致する。
よるＣＮＴ２による制御となり、ＳＷ回路３からＨＥＡ
ＤのＨＤ信号が入力し、位相検出器５５でメイン部１０
のＨＤ信号と比較され、位相エラー信号がＣＮＴ２スイ
ッチ５６を通って、同期信号発生器ＳＳＧ５７へ送られ
る。ＳＳＧ５７は位相エラーが零になるように、カメラ
ヘッド部９へ送るＳＹＮＣの水平同期位相を制御する。
これによってカメラヘッド９のＨＤ信号とメイン部１０
のＨＤ信号の位相が一致する。
【００４６】この位相制御でも、最初のＳＷ回路３から
切換え電送した際の、「決められた手順」つまりＣＬＫ
−ＨＤ−ＣＣＤ信号（ＣＮＴ１−ＣＮＴ２の順）の順序
に従い、ＣＰＵ２はＣＮＴ１−ＣＮＴ２（２ＣＬＫ−Ｈ
Ｄ）の順の制御によって、カメラヘッド９のＣＬＫの補
正を行い、続いてＨＤ信号の補正が行われる。
切換え電送した際の、「決められた手順」つまりＣＬＫ
−ＨＤ−ＣＣＤ信号（ＣＮＴ１−ＣＮＴ２の順）の順序
に従い、ＣＰＵ２はＣＮＴ１−ＣＮＴ２（２ＣＬＫ−Ｈ
Ｄ）の順の制御によって、カメラヘッド９のＣＬＫの補
正を行い、続いてＨＤ信号の補正が行われる。
【００４７】これは、図３のクロック同期合わせのタイ
ムチャートと、図４の水平同期合わせのタイムチャート
に示すように、図３ではＣＮＴ１のタイミングでＨＥＡ
ＤＣＬＫとＣＬＫの位相制御を行い、図４ではＣＮＴ２
のタイミングでＨＥＡＤＨＤとＨＤの位相制御を行って
いる順序と一致する。
ムチャートと、図４の水平同期合わせのタイムチャート
に示すように、図３ではＣＮＴ１のタイミングでＨＥＡ
ＤＣＬＫとＣＬＫの位相制御を行い、図４ではＣＮＴ２
のタイミングでＨＥＡＤＨＤとＨＤの位相制御を行って
いる順序と一致する。
【００４８】このような、ＳＷ回路３から切換え信号に
よりＨＥＡＤ ＣＬＫ，ＨＤを入力してから、位相補正
して再度カメラ側にフィードバックする同期合わせにつ
いては、ＣＰＵ１とＣＰＵ２間でＴＸ，ＲＸ信号による
定期的通信によりＣＮＴ１，ＣＮＴ２のタイミングを確
認して実行するので、ケーブル８の遅延時間の影響も吸
収される。
よりＨＥＡＤ ＣＬＫ，ＨＤを入力してから、位相補正
して再度カメラ側にフィードバックする同期合わせにつ
いては、ＣＰＵ１とＣＰＵ２間でＴＸ，ＲＸ信号による
定期的通信によりＣＮＴ１，ＣＮＴ２のタイミングを確
認して実行するので、ケーブル８の遅延時間の影響も吸
収される。
【００４９】以上の同期合わせによって、カメラヘッド
部９のＣＣＤ信号と、メイン部１０の信号処理回路ＤＳ
Ｐ７０のタイミングを、ＣＬＫ及びＨＤ信号によって合
わせることができる。
部９のＣＣＤ信号と、メイン部１０の信号処理回路ＤＳ
Ｐ７０のタイミングを、ＣＬＫ及びＨＤ信号によって合
わせることができる。
【００５０】このように、本実施の形態によれば、同じ
長さの同じケーブル８を使用して、ＣＬＫやＨＤ等の同
期信号と、ＣＣＤ信号を切換えて電送するためにそれら
の信号間の遅延時間がケーブル長に影響されずに、常に
決まったタイミングになるので、信号遅延による同期ズ
レ、色反転等の問題が発生しない。
長さの同じケーブル８を使用して、ＣＬＫやＨＤ等の同
期信号と、ＣＣＤ信号を切換えて電送するためにそれら
の信号間の遅延時間がケーブル長に影響されずに、常に
決まったタイミングになるので、信号遅延による同期ズ
レ、色反転等の問題が発生しない。
【００５１】また、従来例ではＣＬＫ，ＨＤ，ＣＣＤ信
号等を夫々別々の信号線で電送していたのに対して、本
実施の形態では、このように１本の信号線を使用してＨ
Ｄ信号とクロック、ＣＣＤ信号を切換えて出力すること
で信号線の本数を減らすと共に、ケーブル長による遅延
時間の影響も無くすことができるものである。
号等を夫々別々の信号線で電送していたのに対して、本
実施の形態では、このように１本の信号線を使用してＨ
Ｄ信号とクロック、ＣＣＤ信号を切換えて出力すること
で信号線の本数を減らすと共に、ケーブル長による遅延
時間の影響も無くすことができるものである。
【００５２】（請求項対応の説明）電送する手段は、Ｃ
ＰＵ１のＣＮＴ１，ＣＮＴ２制御により、ＳＷ回路３か
らメイン部へＣＬＫ，ＨＤ，ＣＣＤ信号の切換え電送処
理を行う。
ＰＵ１のＣＮＴ１，ＣＮＴ２制御により、ＳＷ回路３か
らメイン部へＣＬＫ，ＨＤ，ＣＣＤ信号の切換え電送処
理を行う。
【００５３】「決められた手順」とは、各信号の切換え
電送、同期合わせの際の信号処理順序を示し、ＣＮＴ１
−ＣＮＴ２で表している。
電送、同期合わせの際の信号処理順序を示し、ＣＮＴ１
−ＣＮＴ２で表している。
【００５４】位相制御手段は、ＣＰＵ２のＣＮＴ１，Ｃ
ＮＴ２制御により、位相制御ブロック５でＨＥＡＤ Ｃ
ＬＫとＣＬＫ、ＨＥＡＤ ＨＤとＨＤの位相制御を行
う。
ＮＴ２制御により、位相制御ブロック５でＨＥＡＤ Ｃ
ＬＫとＣＬＫ、ＨＥＡＤ ＨＤとＨＤの位相制御を行
う。
【００５５】補正する手段は、ＣＰＵ１とＣＰＵ２間の
ＴＸ，ＲＸ信号通信によるカメラヘッド部９とメイン部
１０のＣＬＫ，ＨＤの同期合わせを行う。
ＴＸ，ＲＸ信号通信によるカメラヘッド部９とメイン部
１０のＣＬＫ，ＨＤの同期合わせを行う。
【００５６】（他の実施の形態）これまで、「決められ
た手順」として、ＣＬＫ−ＨＤ−ＣＣＤ信号（ＣＮＴ１
−ＣＮＴ２−）の順序で行うとして説明したが、この順
序に限らず別の順序を設定してもよく、要は最後まで予
め決めた順序に従って行うということである。
た手順」として、ＣＬＫ−ＨＤ−ＣＣＤ信号（ＣＮＴ１
−ＣＮＴ２−）の順序で行うとして説明したが、この順
序に限らず別の順序を設定してもよく、要は最後まで予
め決めた順序に従って行うということである。
【００５７】また、同期合わせのタイミングとして電源
立上げ時に実行するとしたが、一定の周期で割り込みを
かけて撮像途中でも行うようにすることも可能である。
立上げ時に実行するとしたが、一定の周期で割り込みを
かけて撮像途中でも行うようにすることも可能である。
【００５８】また、本実施の形態では、カメラヘッドと
メイン部をケーブルで接続する例を説明したが、この例
に限らず、電子機器同志あるいは電子機器と付属装置間
等をケーブルで接続して使用するようなケースに、全て
適用可能であることは勿論である。
メイン部をケーブルで接続する例を説明したが、この例
に限らず、電子機器同志あるいは電子機器と付属装置間
等をケーブルで接続して使用するようなケースに、全て
適用可能であることは勿論である。
【００５９】
【発明の効果】以上、説明したように、請求項１に記載
の発明によれば、電送する手段によってＣＣＤ信号、Ｃ
ＬＫおよびＨＤの信号を決められた手順で選択してカメ
ラヘッド部からメイン部へ電送し、位相制御手段により
メイン部のＣＬＫ，ＨＤ信号と比較して位相制御した
後、補正する手段でカメラヘッド部へ再電送して同期を
補正するように構成したので、カメラヘッド部とメイン
部間の信号数および信号線の本数が削減できると共に、
ケーブルの長さが変化しても同期ズレが発生しないよう
にすることができる。
の発明によれば、電送する手段によってＣＣＤ信号、Ｃ
ＬＫおよびＨＤの信号を決められた手順で選択してカメ
ラヘッド部からメイン部へ電送し、位相制御手段により
メイン部のＣＬＫ，ＨＤ信号と比較して位相制御した
後、補正する手段でカメラヘッド部へ再電送して同期を
補正するように構成したので、カメラヘッド部とメイン
部間の信号数および信号線の本数が削減できると共に、
ケーブルの長さが変化しても同期ズレが発生しないよう
にすることができる。
【００６０】更に、請求項２に記載の発明によれば、メ
イン部の同期信号発生器は外部からのＨＤ，ＶＤ信号に
位相同期し、外部からのＣＬＫを基準として動作するの
で、外部同期が可能になり接続機器間の同期合わせが容
易になる。
イン部の同期信号発生器は外部からのＨＤ，ＶＤ信号に
位相同期し、外部からのＣＬＫを基準として動作するの
で、外部同期が可能になり接続機器間の同期合わせが容
易になる。
【００６１】更に、請求項３に記載の発明によれば、初
期の同期合わせ手順を電源立ち上げ時に行うようにした
ので、同期合わせ以降は同期ズレの無いクリアな画像撮
像が可能になる。
期の同期合わせ手順を電源立ち上げ時に行うようにした
ので、同期合わせ以降は同期ズレの無いクリアな画像撮
像が可能になる。
【００６２】更に、請求項４に記載の発明によれば、電
送する手段は、ＣＣＤ信号、ＣＬＫおよびＨＤ信号を決
められた手順に従い時分割多重して選択出力するので、
カメラヘッド部からメイン部へ１本の電送線でＣＣＤ信
号，ＣＬＫ，ＨＤを時分割多重により迅速に電送するこ
とで、信号線本数を削減し、ケーブル長による遅延時間
の影響を無くすことができる。
送する手段は、ＣＣＤ信号、ＣＬＫおよびＨＤ信号を決
められた手順に従い時分割多重して選択出力するので、
カメラヘッド部からメイン部へ１本の電送線でＣＣＤ信
号，ＣＬＫ，ＨＤを時分割多重により迅速に電送するこ
とで、信号線本数を削減し、ケーブル長による遅延時間
の影響を無くすことができる。
【００６３】更に、請求項５に記載の発明によれば、位
相制御手段は、ＣＬＫ用のクロック位相検出器と、ＨＤ
用の同期信号位相検出器と、位相シフト回路と、同期信
号発生器とで構成したので、カメラヘッド部とメイン部
間のＣＬＫ，ＨＤ信号の位相を検出器で比較して比較差
を基に正確に位相制御することができる。
相制御手段は、ＣＬＫ用のクロック位相検出器と、ＨＤ
用の同期信号位相検出器と、位相シフト回路と、同期信
号発生器とで構成したので、カメラヘッド部とメイン部
間のＣＬＫ，ＨＤ信号の位相を検出器で比較して比較差
を基に正確に位相制御することができる。
【００６４】更に、請求項６に記載の発明によれば、補
正する手段は、ＣＬＫの位相同期を制御部間のＴＸ，Ｒ
Ｘ通信でタイミングを合わせて決められた手順に従い補
正するので、カメラヘッド部とメイン部間のＣＬＫの同
期合わせを正確に実行して、ケーブル長による遅延時間
の影響を無くすことができる。
正する手段は、ＣＬＫの位相同期を制御部間のＴＸ，Ｒ
Ｘ通信でタイミングを合わせて決められた手順に従い補
正するので、カメラヘッド部とメイン部間のＣＬＫの同
期合わせを正確に実行して、ケーブル長による遅延時間
の影響を無くすことができる。
【００６５】更に、請求項７に記載の発明によれば、補
正する手段は、ＨＤ信号の位相同期を制御部間のＴＸ，
ＲＸ通信でタイミングを合わせ決められた手順に従い補
正するので、カメラヘッド部とメイン部間におけるＨＤ
信号の同期合わせを正確に実行して、ケーブル長による
遅延時間の影響を無くすことができる。
正する手段は、ＨＤ信号の位相同期を制御部間のＴＸ，
ＲＸ通信でタイミングを合わせ決められた手順に従い補
正するので、カメラヘッド部とメイン部間におけるＨＤ
信号の同期合わせを正確に実行して、ケーブル長による
遅延時間の影響を無くすことができる。
【図１】本発明の実施の形態に係る撮像装置のブロック
図である。
図である。
【図２】図１に示す位相制御ブロックのブロック図であ
る。
る。
【図３】図１に示す撮像装置のクロック同期合わせのタ
イムチャートである。
イムチャートである。
【図４】図１に示す撮像装置の水平同期合わせのタイム
チャートである。
チャートである。
【図５】図１に示す撮像装置の同期合わせのシーケンス
を示す図である。
を示す図である。
【図６】従来の撮像装置のブロック図である。
１，２ ＣＰＵ ３ ＳＷ回路 ４ ＳＳＧ ５ 位相制御ブロック ６ 外部発振器 ７ 分周器 ８ ケーブル ９ カメラヘッド部 １０ メイン部
Claims (7)
- 【請求項１】 光信号を電気信号に変換するための撮像
部、同期信号発生器および制御部から成るカメラヘッド
部と、前記同期信号発生器、信号処理回路および制御部
から成るメイン部とを有し、それぞれ別体のカメラヘッ
ド部とメイン部をケーブルで接続した撮像装置におい
て、 前記撮像部からの信号、クロックおよび水平同期信号の
いずれかの信号を決められた手順により選択してカメラ
ヘッド部からメイン部へ電送する手段と、前記電送され
たクロックおよび水平同期信号を前記決められた手順に
よりメイン部のクロックおよび水平同期信号と位相比較
してメイン部の信号に位相同期するように制御する位相
制御手段と、前記メイン部の信号に位相同期したクロッ
クおよび水平同期信号を前記決められた手順でメイン部
よりカメラヘッド部へ電送して同期を補正する手段とを
備えたことを特徴とする撮像装置。 - 【請求項２】 請求項１記載の撮像装置において、前記
メイン部の同期信号発生器は外部からの水平同期信号お
よび垂直同期信号に位相同期し、外部からのクロック入
力を基準として動作することを特徴とする撮像装置。 - 【請求項３】 前記カメラヘッド部の電送する手段によ
る各信号の切換え電送と、前記メイン部の位相制御手段
による位相同期手順は、電源立ち上げ時に行うことを特
徴とする請求項１又は２記載の撮像装置。 - 【請求項４】 前記電送する手段は、前記撮像部からの
信号、クロックおよび水平同期信号の各信号を時分割多
重して前記決められた手順により選択出力することを特
徴とする請求項１記載の撮像装置。 - 【請求項５】 光信号を電気信号に変換するための撮像
部、同期信号発生器および制御部から成るカメラヘッド
部と、前記同期信号発生器、信号処理回路および制御部
から成るメイン部とを有し、それぞれ別体のカメラヘッ
ド部とメイン部をケーブルで接続した撮像装置におい
て、 前記撮像部からの信号、クロックおよび水平同期信号の
いずれかの信号を決められた手順により選択してカメラ
ヘッド部からメイン部へ電送する手段と、前記電送され
たクロックおよび水平同期信号を前記決められた手順に
よりメイン部のクロックおよび水平同期信号と位相比較
してメイン部の信号に位相同期するように制御する位相
制御手段と、前記メイン部の信号に位相同期したクロッ
クおよび水平同期信号を前記決められた手順でメイン部
よりカメラヘッド部へ電送して同期を補正する手段とを
備え、前記位相制御手段は、カメラヘッド部とメイン部
のクロックの位相を比較するクロック位相検出器と、カ
メラヘッド部とメイン部の水平同期信号の位相を比較す
る同期信号位相検出器と、前記クロック位相検出器で検
出した位相差を調整する位相シフト回路と、前記同期信
号位相検出器で検出した位相差を合わせる同期信号発生
器とを有することを特徴とする撮像装置。 - 【請求項６】 前記補正する手段は、前記カメラヘッド
部とメイン部のクロック位相同期をカメラヘッド部とメ
イン部の制御部間のＴＸ，ＲＸ通信によってタイミング
を合わせ前記決められた手順で補正することを特徴とす
る請求項１記載の撮像装置。 - 【請求項７】 前記補正する手段は、前記カメラヘット
部とメイン部の水平同期信号位相同期をカメラヘッド部
とメイン部の制御部間のＴＸ，ＲＸ通信によってタイミ
ングを合わせ前記決められた手順で補正することを特徴
とする請求項１記載の撮像装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8213252A JPH1042176A (ja) | 1996-07-25 | 1996-07-25 | 撮像装置 |
| US08/898,293 US6449007B1 (en) | 1996-07-25 | 1997-07-22 | Method for establishing synchronization in head-detachable image sensing system, and image sensing system adopting the method |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8213252A JPH1042176A (ja) | 1996-07-25 | 1996-07-25 | 撮像装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1042176A true JPH1042176A (ja) | 1998-02-13 |
Family
ID=16636030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8213252A Pending JPH1042176A (ja) | 1996-07-25 | 1996-07-25 | 撮像装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6449007B1 (ja) |
| JP (1) | JPH1042176A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7053950B2 (en) * | 2001-06-22 | 2006-05-30 | Fuji Photo Film Co., Ltd. | Drive unit for transferring CCD charge |
| JP2007116734A (ja) * | 2003-03-19 | 2007-05-10 | Hitachi Kokusai Electric Inc | 信号伝送方法及び信号伝送装置 |
| JP2008005142A (ja) * | 2006-06-21 | 2008-01-10 | Sony Corp | 撮像装置 |
| US7460156B2 (en) | 2003-03-19 | 2008-12-02 | Hitachi, Ltd. | Signal transmission method between television camera and video apparatus and apparatus using the method |
| US7714894B2 (en) | 2008-01-18 | 2010-05-11 | Kabushiki Kaisha Toshiba | Remote head camera |
| KR100992111B1 (ko) * | 2008-10-16 | 2010-11-04 | 주식회사 맥스포 | 영상 센서의 고속 동기화 방법 및 시스템 |
| CN107534743A (zh) * | 2015-06-22 | 2018-01-02 | 奥林巴斯株式会社 | 摄像装置 |
Families Citing this family (13)
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