JPH10294646A - サンプリングレート変換装置 - Google Patents

サンプリングレート変換装置

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JPH10294646A
JPH10294646A JP2035614A JP3561490A JPH10294646A JP H10294646 A JPH10294646 A JP H10294646A JP 2035614 A JP2035614 A JP 2035614A JP 3561490 A JP3561490 A JP 3561490A JP H10294646 A JPH10294646 A JP H10294646A
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sampling
frequency
sampling frequency
coefficient
circuit
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Tadao Fujita
忠男 藤田
San Kou
▲ ▼ 高山
Takeshi Ninomiya
健 二宮
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Sony Corp
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Abstract

(57)【要約】 電子出願以前の出願であるので 要約・選択図及び出願人の識別番号は存在しない。

Description

【発明の詳細な説明】 以下の順序で本発明を説明する。
Ａ産業上の利用分野 Ｂ発明の概要 Ｃ従来の技術 Ｄ発明が解決しようとする問題点 Ｅ問題点を解決するための手段（第１図及び第３図） Ｆ作用（第１図及び第３図） Ｇ実施例 (G1)の実施例（第１図及び第２図） (G2)の実施例（第３図〜第７図） (G3)他の実施例 Ｈ発明の効果 Ａ産業上の利用分野 本発明はサンプリングレート変換装置に関し、特に第
１又は第２のサンプリン グ周波数でなるデイジタル信号のサンプリング周波数を
第２又は第１のサンプリ ング周波数に変換するものに適用し得る。
Ｂ発明の概要 第１の発明は、サンプリングレート変換装置におい
て、第１及び第２のサンプ リング周波数の周波数比が簡易な整数関係にある場合、
その周波数比の最小公倍 数に応じた長さのＦＩＲ型デイジタルフイルタでオーバ
ーサンプリングフイルタ を構成するようにしたことにより、デイジタル信号の第
１又は第２のサンプリン グ周波数を第２又は第１のサンプリング周波数に変換し
得る。
また第２の発明は、サンプリングレート変換装置にお
いて、選択可能な複数の 係数データを含む係数発生手段の係数データを選択し
て、オーバーサンプリング フイルタの重付け手段に与える係数を変更するようにし
たことにより、第１及び 第２のサンプリング周波数の周波数比が簡易な整数関係
にない場合にも、デイジ タル信号の第１又は第２のサンプリング周波数を第２又
は第１のサンプリング周 波数に変換し得る。
Ｃ従来の技術 従来、アナログ信号を所定のサンプリング周波数でサ
ンプリングし、この結果 得られるデイジタル信号を任意のサンプリング周波数に
変換するためデイジタル フイルタ構成のサンプリングレート変換装置が用いられ
ている。
一般にこのようなサンプリングレート変換装置は、そ
の伝送系の変換特性とし てナイキスト周波数を厳守するため、高次のオーバーサ
ンプリングフイルタで構 成されている。
Ｄ発明が解決しようとする問題点 ところでこのようなサンプリングレート変換装置を用
いて、例えばデイジタル ビデオテープレコーダ（ＤＶＴＲ）におけるＤ−１フオ
ーマツトに基づく625/50 コンポーネントデイジタルビデオ信号のサンプリング周
波数を、Ｄ−２フオーマ ツトに基づくＰＡＬコンポジツトデイジタルビデオ信号
に応じたサンプリング周 波数に変換しようとする場合、サンプリング周波数を周
波数13.5〔ＭHz〕から周 波数17.734475〔ＭHz〕にレート変換するため、デイジ
タルビデオ信号間で直接 サンプリング周波数を変換することができず、近似的に
長さが16500次程度の次 数を有するオーバーサンプリングフイルタを構成する必
要がある。
また逆にＰＡＬコンポジツトデイジタルビデオ信号の
サンプリング周波数を62 5/50コンポーネントデイジタルビデオ信号に応じたサン
プリング周波数に変換す る場合も、サンプリング周波数を周波数17.734475〔ＭH
z〕から周波数13.5〔Ｍ Hz〕にレート変換するため、上述と同等の回路規模で専
用のオーバーサンプリン グフイルタを構成する必要があり、全体として各々専用
の回路を持つことにより、 回路規模が複雑かつ大型化することを避け得ない問題が
あつた。
本発明は以上の点を考慮してなされたもので、第１又
は第２のサンプリング周 波数でなるデイジタル信号のサンプリング周波数を第２
又は第１のサンプリング 周波数に変換し得る、すなわち、双方向にサンプリング
レートを変換し得るサン プリングレート変換装置を提案しようとするものであ
る。
Ｅ問題点を解決するための手段 かかる問題点を解決するため第１の発明においては、
第１又は第２のサンプリ ング周波数ｆ１又はｆ２でサンプリングされてなるデイ
ジタル信号ＤINを、その 第１又は第２のサンプリング周波数ｆ１又はｆ２に対し
て周波数比が簡易な整数 関係にある第２又は第１のサンプリング周波数ｆ２又は
ｆ１に変換するサンプリ ングレート変換装置１において、第１及び第２のサンプ
リング周波数ｆ１及び ｆ２の周波数比の最小公倍数に応じた長さのＦＩＲ型デ
イジタルフイルタでなる オーバーサンプリングフイルタ２Ａ〜２Ｋ、３Ａ〜３
Ｌ、４Ａ〜４Ｋを設け、デ イジタル信号ＤINの第１又は第２のサンプリング周波数
ｆ１又はｆ２を第２又は 第１のサンプリング周波数ｆ２又はｆ１に変換するよう
にした。
また第２の発明においては、第１又は第２のサンプリ
ング周波数でサンプリン グされてなるデイジタル信号ＳIN10を、第２又は第１の
サンプリング周波数に変 換するサンプリングレート変換装置１０において、第１
及び第２のサンプリング 周波数の周波数比に応じた長さのＦＩＲ型デイジタルフ
イルタでなるオーバーサ ンプリングフイルタ１１Ａ、１１Ｂ、１１Ｃ、１１Ｄ
と、選択可能な複数の係数 データを含んでなり、選択された当該係数データに応じ
た係数ｃ20、ｃ21、ｃ22、 ｃ23、ｃ24をオーバーサンプリングフイルタ１１Ａ、１
１Ｂ、１１Ｃ、１１Ｄの 重付け手段１５Ａ、１５Ｂ、１５Ｃ、１５Ｄ、１５Ｅに
与える係数発生手段１７ Ａ、１７Ｂ、１７Ｃ、１７Ｄ、１７Ｅとを設け、第１又
は第２のサンプリング周 波数の周波数比が簡易な整数関係にない場合にも、デイ
ジタル信号ＳIN10の第１ 又は第２のサンプリング周波数を第２又は第１のサンプ
リング周波数に変換する 際、その変換方向に応じて係数発生手段１７Ａ〜１７Ｅ
の係数データを選択する ようにした。
Ｆ作用 第１及び第２のサンプリング周波数ｆ１及びｆ２の周
波数比が簡易な整数関 係にある場合、その周波数比の最小公倍数に応じた長さ
のＦＩＲ型デイジタルフ イルタでオーバーサンプリングフイルタ２Ａ〜２Ｋ、３
Ａ〜３Ｌ、４Ａ〜４Ｋを 構成するようにしたことにより、デイジタル信号ＤINの
第１又は第２のサンプリ ング周波数ｆ１又はｆ２を第２又は第１のサンプリング
周波数ｆ２又はｆ１に変 換し得る。
また選択可能な複数の係数データを含む係数発生手段
１７Ａ〜１７Ｅの係数デ ータを選択し、オーバーサンプリングフイルタ１１Ａ〜
１１Ｄの重付け手段１５ Ａ〜１５Ｅに与える係数ｃ20〜ｃ24を変更するようにし
たことにより、第１又は 第２のサンプリング周波数の周波数比が簡易な整数関係
にない場合にも、デイジ タル信号ＳIN10の第１又は第２のサンプリング周波数を
第２又は第１のサンプリ ング周波数に変換し得る。
Ｇ実施例 以下図面について、本発明の一実施例を詳述する。
(G1)第１の実施例 この実施例は第１の発明による双方向のサンプリング
レート変換装置を示し、 例えばサンプリングレートを変換するデイジタル信号の
第１及び第２のサンプリ ング周波数ｆ１及びｆ２の周波数比が４：３に選定さ
れ、この第１のサンプリン グ周波数ｆ１でなるデイジタル信号Ｓ１及び第２のサン
プリング周波数ｆ２でな るデイジタル信号Ｓ２間の双方向で、サンプリング周波
数ｆ１及びｆ２を変換し 得るようになされている。
この場合サンプリングレート変換装置１は第１図に示
すように、第１及び第２ のデイジタル信号Ｓ１及びＳ２間でそれぞれサンプリン
グ周波数ｆ１及びｆ２を 変換する際、所望のナイキスト特性を含む周波数特性を
得るため、第１及び第２ のデイジタル信号Ｓ１及びＳ２のサンプリング周波数ｆ
１及びｆ２の最小公倍数 の値でなるオーバーサンプリングフイルタで構成されて
いる。
すなわちこのサンプリングレート変換装置１は、いわ
ゆるＦＩＲ(finite impu lse response)型デイジタルフイルタで構成されてお
り、まず第１のデイジタル 信号Ｓ１のサンプリング周波数ｆ１を第２のサンプリン
グ周波数ｆ２にレート変 換して第２のデイジタル信号Ｓ２を得ようとする場合、
入力デイジタル信号ＤIN として第１のデイジタル信号Ｓ１が入力される。
この実施例の場合サンプリングレート変換装置１はオ
ーバーサンプリング周波 数３ｆ1(＝４ｆ2)で動作する長さ12次のＦＩＲ型デイジ
タルフイルタでなり、そ れぞれ遅延時間Ｔを有する11個のフリツプフロツプ２Ａ
〜２Ｋの直列回路で構成 されている。
なおそれぞれのフリツプフロツプ２Ａ〜２Ｋの遅延時
間Ｔは次式 Ｔ＝１／１２×３ｆ１＝１／１２×４ｆ２
……（１） で表される値に選定されている。
また入力デイジタル信号ＤIN及び各フリツププロツプ
２Ａ〜２Ｋの出力デイジ タル信号Ｄ１〜Ｄ11はそれぞれ12個の乗算回路３Ａ〜３
Ｌでなる重付け手段に入 力される。
なおここで第１のサンプリング周波数ｆ１から第２の
サンプリング周波数ｆ２ にレート変換する場合、第１、第４、第７及び第１０の
乗算回路３Ａ、３Ｄ、３ Ｇ及び３Ｊに対して、それぞれ所定の係数、ｃ０、
ｃ３、ｃ６及びｃ９が与えられ ており、またその他の乗算回路３Ｂ、３Ｃ、３Ｅ、３
Ｆ、３Ｈ、３Ｉ、３Ｋ、３ Ｌに対してそれぞれ値「０」でなる係数ｃ１、ｃ２、ｃ
４、ｃ５、ｃ７、ｃ８、 ｃ10、ｃ11が入力されている。
かくして第１、第４、第７及び第１０の乗算回路３
Ａ、３Ｄ、３Ｇ及び３Ｊに 入力される入力デイジタル信号ＤIN、第３、第６及び第
９のフリツプフロツプ２ Ｃ、２Ｆ及び２Ｉの出力デイジタル信号Ｄ３、Ｄ６及び
Ｄ９は、それぞれ所定の 係数ｃ０、ｃ３、ｃ６及びｃ９と乗算され全乗算結果が
加算回路４Ａ〜４Ｋを用 いて加算される。
このようにすれば入力デイジタル信号ＤINを第１のサ
ンプリング周波数ｆ１の ３倍のオーバーサンプリング周波数３ｆ１でオーバーサ
ンプリングすると共に、 これを1/4倍の周波数でリサンプリングすることがで
き、かくして出力デイジタ ル信号Ｄ OUTとして第２のサンプリング周波数ｆ２でな
る第２のデイジタル信号 Ｓ２を送出し得るようになされている。
またこれに対して第２のデイジタル信号Ｓ２のサンプ
リング周波数ｆ２のサン プリングレートを第１のサンプリング周波数ｆ１に変換
して第１のデイジタル信 号Ｓ１を得ようとする際、入力デイジタル信号ＤINとし
て第２のデイジタル信号 Ｓ２が入力される。
この場合には第１、第５及び第９の乗算回路３Ａ、３
Ｅ及び３Ｉに対して、そ れぞれ所定の係数ｃ０、ｃ４及びｃ８が入力され、また
その他の乗算回路３Ｂ、 ３Ｃ、３Ｄ、３Ｆ、３Ｇ、３Ｈ、３Ｊ、３Ｋ、３Ｌに対
してそれぞれ値「０」で なる係数ｃ１、ｃ２、ｃ３、ｃ５、ｃ６、ｃ７、ｃ９、
ｃ10、ｃ11が入力されて いる。
かくして第１、第５及び第９の乗算回路３Ａ、３Ｅ及
び３Ｉに入力される入力 デイジタル信号ＤIN、第４及び第８のフリツプフロツプ
２Ｄ及び２Ｈの出力デイ ジタル信号Ｄ４及びＤ８はそれぞれ所定の係数ｃ０、ｃ
４及びｃ８と乗算され全 乗算結果が加算回路４Ａ〜４Ｋを用いて加算される。
このようにすれば入力デイジタル信号ＤINを第２のサ
ンプリング周波数ｆ２の４倍のオーバーサンプリング周
波数４ｆ２でオーバーサンプリングすると共に、 これを 1/3倍の周波数でリサンプリングすることがで
き、かくして出力デイジタ ル信号Ｄ OUTとして第１のサンプリング周波数ｆ１でな
る第１のデイジタル信号 Ｓ１を送出し得るようになされている。
なおこのサンプリングレート変換装置１においては、
オーバーサンプリング周 波数が互いのサンプリング周波数ｆ１及びｆ２の最小公
倍数でなることにより、 第２図に示すように第１のサンプリング周波数ｆ１から
第２のサンプリング周波 数ｆ２にレート変換する際も、第２のサンプリング周波
数ｆ２から第１のサンプ リング周波数ｆ１にレート変換する際も、各々必要なナ
イキスト周波数（ｆ1/２、 ｆ2/２）に対して全く同一のナイキスト特性ＴNQを有す
るようになされている。
以上の構成によれば、第１及び第２のサンプリング周
波数ｆ１及びｆ２の最小 公倍数でなる長さのＦＩＲ型デイジタルフイルタ２Ａ〜
２Ｋ、３Ａ〜３Ｌ、４Ａ 〜４Ｋを用いて、オーバーサンプリングの手法でレート
変換するようにしたこと により、第１及び第２のサンプリング周波数ｆ１及びｆ
２間で双方向にレート変 換し得るサンプリングレート変換装置１を実現できる。
(G2)第２の実施例 (G2-1)実施例の原理 第２の実施例は第２の発明によるサンプリングレート
変換装置を示し、上述し たＤ−１フオーマツトによる625/50コンポーネントデイ
ジタルビデオ信号のサン プリング周波数を、Ｄ−２フオーマツトによるＰＡＬコ
ンポジツトデイジタルビ デオ信号に応じたサンプリング周波数にレート変換する
と共に、逆にＰＡＬコン ポジツトデイジタルビデオ信号のサンプリング周波数
を、625/50コンポーネント デイジタルビデオ信号に応じたサンプリング周波数にレ
ート変換するものである。
なお実際上このＤ−１フオーマツトに基づく625/50コ
ンポーネントデイジタル ビデオ信号のサンプリング周波数ｆD1は、周波数13.5
〔ＭHz〕に規定されており、 これによりデイジタルビデオ信号の１ライン当たりのサ
ンプル数は864 サンプル となり、従つて１フレームの総サンプル数は540000サン
プルとなる。
またＤ−２フオーマツトに基づくＰＡＬコンポジツト
デイジタルビデオ信号の サンプリング周波数ｆD2は、水平周波数ｆh を周波数1
5. 625 〔ＫHz〕とおいて 次式 ｆsc＝(284−１／４） ｆh ＋50／２＝４．４３３６１
８７５ 〔ＭHz〕 ……（２） に基づいて算出した副搬送波周波数ｆscを４倍した周波
数 17.734475〔ＭHz〕と なり、これによりデイジタルビデオ信号の１ライン当た
りのサンプル数は 1135. 0064サンプルとなり、従つて１フレームの総サンプル数
は709379サンプルとなる。
このようにＰＡＬコンポーネントデイジタルビデオ信
号と、ＰＡＬコンポジツ トデイジタルビデオ信号との１ライン当たりのサンプル
数の比は864:1135.0064 であり、適当な整数の関係を有していないことがわか
る。
従つて必然的に従来同様に長さ 16500次ものオーバー
サンプリングフイルタに よるサンプリングレート変換方法を取らざるを得ない。
そこでこの実施例によるサンプリングレート変換装置
においては、上述した１ ライン当りのサンプル数の比から、近似的に例えば長さ
4554次のオーバーサンプ リングフイルタを構成し、これにより双方向についてサ
ンプリングレートを変換 し得るようになされている。
すなわち625/50コンポーネントデイジタルビデオ信号
のサンプリング周波数か らＰＡＬコンポジツトデイジタルビデオ信号に応じたサ
ンプリング周波数に変換 する場合には、サンプリング周波数ｆD1（＝13.5〔ＭH
z〕）の 506倍の周波数で オーバーサンプリングした後 1/414倍の周波数でリサン
プリングする。
また逆にＰＡＬコンポジツトデイジタルビデオ信号の
サンプリング周波数を62 5/50コンポーネントデイジタルビデオ信号に応じたサン
プリング周波数に変換す る場合には、サンプリング周波数ｆD2（＝ 17.734475
〔ＭHz〕）の 414倍の周波 数でオーバーサンプリングした後 1/506倍の周波数でリ
サンプリングする。
このようにすればオーバーサンプリング周波数自体は
それぞれ周波数6831〔Ｍ Hz〕及び ７３４２．０４〔ＭHz〕となり、この結果オ
ーバーサンプリング周波数による ナイキスト特性には７〔％〕程度の相違が生じる。
このためこの実施例によるサンプリングレート交換装
置においては、ナイキス ト周波数自体を実用上問題のない周波数に設定し、これ
により625/50コンポーネ ントデイジタルビデオ信号とＰＡＬコンポジツトデイジ
タルビデオ信号との間で 双方向に互いにサンプリング周波数のレート変換を実行
し得るようになされてい る。
(G2-2)オーバーサンプリングフイルタの構成 第３図において、１０は全体として上述した原理を用
いた625/50コンポーネン トデイジタルビデオ信号及びＰＡＬコンポジツトデイジ
タルビデオ信号間の双方 向のサンプリングレート変換装置を示し、この実施例の
場合それぞれ集積回路化 された１個のオーバーサンプリングフイルタ１１を４個
（１１Ａ、１１Ｂ、１１ Ｃ、１１Ｄ）組み合わせて構成されている。
実際上この集積回路化された１個分のオーバーサンプ
リングフイルタ１１（１ １Ａ〜１１Ｄ）は第４図に示すように長さが最大５次ま
でのＦＩＲ型デイジタル フイルタで構成できるようになつており、第１の入力端
１１ａを通じて入力され るデイジタル信号ＤＧINが遅延入力選択回路１２を介し
て、それぞれ所定の遅延 時間Ｔ1 を有する第１、第２、第３及び第４のフリツプ
フロツプ１３Ａ、１３Ｂ、 １３Ｃ及び１３Ｄの直列回路に供給される。
遅延入力選択回路１２はそれぞれ遅延時間Ｔ1 、２倍
の遅延時間２Ｔ1 、３倍 の遅延時間３Ｔ1 でなるフリツプフロツプ１２Ａ、１２
Ｂ、１２Ｃを有し、デイ ジタル信号ＤＧINが各フリツプフロツプ１２Ａ、１２
Ｂ、１２Ｃを通じてそれぞ れ所定時間遅延され、それぞれの遅延出力が続くスイツ
チ回路１２Ｄの第１、第 ２、第３の入力端ａ、ｂ、ｃに入力されている。
このスイツチ回路１２Ｄにおいては、フイルタ制御回
路１４から供給される第 １の選択制御信号ＣＮＴ1 に応じて第１〜第３の入力端
ａ〜ｃが選択され、これ により入力されるデイジタル信号ＤＧINをフイルタ制御
回路１４の制御に応じた 遅延時間分だけ遅延させ、この結果得られる遅延デイジ
タル信号ＤＧ10が続く第 １のフリツプフロツプ１３Ａに送出されると共に第１の
乗算回路１５Ａに入力さ れる。
また第１、第２、第３のフリツプフロツプ１３Ａ、１
３Ｂ、１３Ｃからそれぞ れ送出される遅延デイジタル信号ＤＧ11、ＤＧ12、ＤＧ
13は、それぞれ後段の第 ２、第３、第４のフリツプフロツプ１３Ｂ、１３Ｃ、１
３Ｄに送出されると共に 第２、第３、第４の乗算回路１５Ｂ、１５Ｃ、１５Ｄに
入力される。
ここで第４のフリツプフロツプ１３Ｄから送出される
遅延デイジタル信号ＤＧ14 は、第１の出力端１１ｂを通じてオーバーサンプリング
フイルタ１１全体の出力 遅延デイジタル信号ＤＤOUT として送出されると共に遅
延量選択回路１６の第１ の入力端ａに入力される。
なお第３のフリツプフロツプ１３Ｃから送出される遅
延デイジタル信号ＤＧ13 は、上述に加えて３倍の遅延時間３Ｔ1 を有するフリツ
プフロツプ１３Ｅに入力 され、その遅延デイジタル信号ＤＧ15が遅延量選択回路
１６の第２の入力端ｂに 入力されている。
遅延量選択回路１６はフイルタ制御回路１４から供給
される第２の選択制御信 号ＣＮＴ2 に応じて第１又は第２の入力端ａ又はｂを選
択制御し、この結果第４ のフリツプフロツプ１３Ｄから送出される遅延デイジタ
ル信号ＤＧ14又はこれに 対して２倍の遅延時間２Ｔ1 だけ遅延した遅延デイジタ
ル信号ＤＧ15の何れかが 第５の乗算回路１５Ｅに入力される。
この第１〜第５の乗算回路１５Ａ〜１５Ｅにはそれぞ
れＲＯＭ（read only me mory）構成でなる第１〜第５の係数発生回路１７Ａ〜１
７Ｅからそれぞれ係数デ ータｃ20、ｃ21、ｃ22、ｃ23、ｃ24が入力されている。
この結果第１〜第５の乗算回路１５Ａ〜１５Ｅにおい
て、それぞれ遅延デイジ タル信号ＤＧ10、ＤＧ11、ＤＧ12、ＤＧ13、ＤＧ14（又
はＤＧ15）と対応する係 数データｃ20、ｃ21、ｃ22、ｃ23、ｃ24とが乗算され、
各乗算結果が第１〜第５ の加算入力選択回路１８Ａ〜１８Ｅの第１の入力端ａに
入力され、それぞれの出 力端を通じて第１〜第５の加算回路１９Ａ〜１９Ｅに入
力される。
なお第１〜第５の加算入力選択回路１８Ａ〜１８Ｅの
それぞれ第２の入力端ｂ は接地され、これによりフイルタ制御回路１４から入力
される第３の選択制御信 号ＣＮＴ3 に応じて第１〜第５の加算入力選択回路１８
Ａ〜１８Ｅの第１の入力 端ａが選択された場合、第１〜第５の加算回路１９Ａ〜
１９Ｅにおいて、第２の 入力端１１ｃを通じて外部から入力される加算デイジタ
ルデータＤＡINと、第１ 〜第５の乗算回路１５Ａ〜１５Ｅから入力される乗算結
果とが全加算されこれが 第２の出力端１１ｄを通じて出力デイジタル信号ＤＧ
OUT として送出される。
また第３の選択制御信号ＣＮＴ3 によつて第１〜第５
の加算入力選択回路１８ Ａ〜１８Ｅの第２の入力端ｂが選択された場合、第１〜
第５の加算回路１９Ａ〜 １９Ｅに第１〜第５の加算入力選択回路１８Ａ〜１８Ｅ
から値「０」のデータが 入力されることにより、外部から入力される加算デイジ
タルデータＤＡINがその まま出力デイジタ信号ＤＧOUT として送出される。
ここでこの実施例によるオーバーサンプリングフイル
タ１１の場合、それぞれ 第１〜第５の係数発生回路１７Ａ〜１７ＥのＲＯＭ内部
の記憶領域には 506個の 係数からなる係数データｃ20〜ｃ24が格納されており、
各係数は所定の遅延時間 Ｔ1 毎に選択されて出力されるようになつている。
実際上このオーバーサンプリングフイルタ１１の場
合、動作モードに応じて係 数発生回路１７Ａ〜１７ＥのＲＯＭの読出し領域を指定
するＲＯＭモードデータ ＤＴROM 及びクロツク信号に応じてＲＯＭの読出しタイ
ミングを指定するアドレ スデータＤＴADR がフイルタ制御回路１４及びアドレス
発生回路２０Ａ〜２０Ｅ に入力される。
アドレス発生回路２０Ａ〜２０ＥはＲＯＭモードデー
タＤＴROM 及びアドレス データＤＴADR に応じた読出しアドレスＡＤＲ0 〜ＡＤ
Ｒ4 を発生し、これを第 １〜第５の係数発生回路１７Ａ〜１７Ｅに供給する。
かくして係数発生回路１７Ａ〜１７Ｅに書き込まれて
いる係数データｃ20〜ｃ24 は、それぞれ対応するアドレス発生回路２０Ａ〜２０Ｅ
から与えられる読出しア ドレスＡＤＲ0 〜ＡＤＲ4 に応じて読み出される。
またフイルタ制御回路１４はＲＯＭモードデータＤＴ
ROM 及びアドレスデータ ＤＴADR と、設定入力された制御データＤＴCNT とに基
づいて、オーバーサンプ リングフイルタ１１全体をどのように制御すべきかを示
す動作モードを検出する。
これによりフイルタ制御回路１４はこの動作モードに
応じて遅延入力選択回路 １２、遅延量選択回路１６、第１〜第５の加算入力選択
回路１８Ａ〜１８Ｅをそ れぞれ制御する第１、第２及び第３の選択制御信号ＣＮ
Ｔ1 、ＣＮＴ2 及びＣＮ Ｔ3 を発生し、このようにしてオーバーサンプリングフ
イルタ１１全体の動作モ ードを制御するようになされている。
本発明の双方向のサンプリングレート変換装置は、以
上述べたような集積回路 化された１個分のオーバーサンプリングフイルタ１１が
４個で構成されている。
以下に全体の構成を述べる。
第１及び第２のオーバーサンプリングフイルタ１１Ａ
及び１１Ｂ、第３及び第 ４のオーバーサンプリングフイルタ１１Ｃ及び１１Ｄが
直列接続され、レート変 換の対象となるデイジタル信号ＳIN10が第１及び第３の
オーバーサンプリングフ イルタ１１Ａ及び１１Ｃの第１の入力端１１ａに入力デ
イジタル信号ＤＧINとし て入力されている。
この第１及び第３のオーバーサンプリングフイルタ１
１Ａ及び１１Ｃの第２の 入力端１１ｃは接地されており、これによりそれぞれ加
算デイジタルデータＤＡIN として値「０」が入力される。
また第１及び第３のオーバーサンプリングフイルタ１
１Ａ及び１１Ｃの第１の 出力端１１ｂは、それぞれ第２及び第４のオーバーサン
プリングフイルタ１１Ｂ 及び１１Ｄの第１の入力端１１ａに接続され、第１及び
第３のオーバーサンプリ ングフイルタ１１Ａ及び１１Ｃから送出される出力遅延
デイジタル信号ＤＧOUTA 及びＤＧOUTCが、第２及び第４のオーバーサンプリング
フイルタ１１Ｂ及び１１ Ｄの入力デイジタル信号ＤＧINとして入力される。
さらに第１及び第３のオーバーサンプリングフイルタ
１１Ａ及び１１Ｃの第２ の出力端１１ｄは、それぞれ第２及び第４のオーバーサ
ンプリングフイルタ１１ Ｂ及び１１Ｄの第２の入力端１１ｂに接続され、第１及
び第３のオーバーサンプ リングフイルタ１１Ａ及び１１Ｃから送出される出力デ
イジタル信号ＤＧOUTA及 びＤＧOUTCが、第２及び第４のオーバーサンプリングフ
イルタ１１Ｂ及び１１Ｄ の加算デイジタルデータＤＡINとして入力される。
このようにして直列接続された第１及び第２のオーバ
ーサンプリングフイルタ １１Ａ及び１１Ｂ、第３及び第４のオーバーサンプリン
グフイルタ１１Ｃ及び１ １Ｄは、それぞれ全体としてＦＩＲ型デイジタルフイル
タでなる長さ4554次のオ ーバーサンプリングフイルタを構成している。
この結果第２及び第４のオーバーサンプリングフイル
タ１１Ｂ及び１１Ｄから 送出される出力デイジタル信号ＤＧOUTB及びＤＧOUTDは
加算回路２１に入力され、 これにより得られる加算デイジタル信号がレート変換後
のデイジタル信号ＳOUT10 として送出される。
以上のような全体の構成により、本発明のサンプリン
グレート変換装置はＤ− １からＤ−２へのサンプリングレート変換、あるいはＤ
−２からＤ−１へのサン プリングレート変換を選択的に行うものである。
次に、本発明のサンプリングレート変換装置のＤ−１
からＤ−２へのレート変 換時の動作と、Ｄ−２からＤ−１へのレート変換時の動
作について述べるが、そ れぞれのレート変換におけるオーバーサンプリングフイ
ルタの基本構成を第３図 によつて説明すると、Ｄ−１からＤ−２へのレート変換
時は、上側の２つのオー バーサンプリングフイルタを直列接続した構成であり、
Ｄ−２からＤ−１へのレ ート変換時は、第３図全体で示される構成である。それ
ぞれの構成の切り換えは、 先に述べたフイルタ制御回路１４で形成される選択制御
信号ＣＮＴ1 、ＣＮＴ2 、 ＣＮＴ3 によつて行われる。
(G2-3)Ｄ−１からＤ−２へのレート変換時の動作 第５図において、３０は全体として上述した双方向の
サンプリングレート変換 装置１０を用いて、Ｄ−１フオーマツトによる625/50コ
ンポーネントデイジタル ビデオ信号のサンプリング周波数を、Ｄ−２フオーマツ
トによるＰＡＬコンポジ ツトデイジタルビデオ信号に応じたサンプリング周波数
にレート変換する場合の サンプリングレート変換装置の等価回路を示す。
すなわちこの場合、直列接続された第１及び第２のオ
ーバーサンプリングフイ ルタ１１Ａ及び１１Ｂの各遅延入力選択回路１２のスイ
ツチ回路１２Ｄは、フイ ルタ制御回路１４から送出される第１の選択制御信号Ｃ
ＮＴ1 によつて第１の入 力端ａが選択されている。
また各遅延量選択回路１６はフイルタ制御回路１４か
ら送出される第２の選択 制御信号ＣＮＴ2 によつて第１の入力端ａが選択され、
さらに各第１〜第５の加 算入力選択回路１８Ａ〜１８Ｅはフイルタ制御回路１４
から送出される第３の選 択制御信号ＣＮＴ3 によつて第１の入力端ａが選択され
ている。
これに対して直列接続された第３及び第４のオーバー
サンプリングフイルタ１ １Ｃ及び１１Ｄの各第１〜第５の加算入力選択回路１８
Ａ〜１８Ｅは、フイルタ 制御回路１４から送出される第３の選択制御信号ＣＮＴ
3 によつて第２の入力端 ｂが選択されている。
このようにしてこのサンプリングレート変換装置３０
においては、第３及び第 ４のオーバーサンプリングフイルタ１１Ｃ及び１１Ｄを
動作しない状態に制御し、 第１及び第２のオーバーサンプリングフイルタ１１Ａ及
び１１Ｂを用いた長さ９ 次（回路構成は１０次であるが、後で述べるように最終
段の乗算は行なわないの で９次となる）のＦＩＲ型デイジタルフイルタで構成さ
れている。
従つて入力されるＰＡＬコンポーネントデイジタルビ
デオ信号ＳIND1は、各々 所定の遅延時間Ｔ1 でなる10個のフリツプフロツプ３１
Ａ〜３１Ｊの直列回路に 順次入力され、各フリツプフロツプ３１Ａ〜３１Ｊの出
力デイジタル信号Ｄ30〜 Ｄ39が続くフリツプフロツプ３１Ｂ〜３１Ｊに入力され
る。
またこれと共に各フリツプフロツプ３１Ａ〜３１Ｊの
出力デイジタル信号Ｄ30 〜Ｄ39は乗算回路３２Ａ〜３２Ｊに入力され所定の係数
ｃ30〜ｃ39と乗算された 後、全乗算結果が加算回路３３Ａ〜３３Ｊを用いて加算
され、このようにしてＰ ＡＬコンポーネントデイジタルビデオ信号ＳIND1のサン
プリング周波数をレート 変換して、ＰＡＬコンポジツトデイジタルビデオ信号の
サンプリング周波数に応 じたデイジタル信号ＳOUTD2 を得るようになされてい
る。
ここで最後部の乗算回路３２Ｊに入力される係数ｃ39
は常に値「０」に選定さ れ、また他の乗算回路３２Ａ〜３２Ｉに入力される係数
ｃ30〜ｃ38は、第６図（ Ａ）及び（Ｂ）に示すように所定の遅延時間Ｔ1 毎に、
第１及び第２のオーバー サンプリングフイルタ１１Ａ及び１１Ｂの係数発生回路
１７Ａ〜１７ＥのＲＯＭ 領域に記憶された506 個分の係数でなる係数データｃ20
〜ｃ24がそれぞれ供給さ れている。
なおこのように 506個分の係数でなる係数データｃ20
〜ｃ24を所定の遅延時間 Ｔ1 毎に与えることにより、625/50コンポーネントデイ
ジタルビデオ信号ＳIND1 は 506倍の周波数でオーバーサンプリングされると共
に、このオーバーサンプリ ング周波数に対して 1/414倍の周波数のタイミングで発
生する所定の係数を与え ることにより、 1/414倍の周波数でリサンプリングされ
る。
このようにこのサンプリングレート変換装置３０は、
全体として、入力される 625/50コンポーネントデイジタルビデオ信号ＳIND1を 5
06倍の周波数でオーバー サンプリングすると共に、このオーバーサンプリング周
波数を 1/414倍の周波数 でリサンプリングする4554次（９次× 506倍でなる）の
オーバーサンプリングフ イルタを構成している。
以上のようにして625/50コンポーネントデイジタルビ
デオ信号ＳIND1のサンプ リング周波数をレート変換し、ＰＡＬコンポジツトデイ
ジタルビデオ信号のサン プリング周波数に応じたデイジタル信号ＳOUTD2 を得る
ことのできるサンプリン グレート変換装置３０は実現される。
(G2-4)Ｄ−２からＤ−１へのレート変換時の動作 第７図において、４０は全体として上述した双方向の
サンプリングレート変換 装置１０を用いて、Ｄ−２フオーマツトによるＰＡＬコ
ンポジツトデイジタルビ デオ信号のサンプリング周波数を、Ｄ−１フオーマツト
による625/50コンポーネ ントデイジタルビデオ信号に応じたサンプリング周波数
にレート変換する場合の サンプリングレート変換装置の等価回路を示す。
すなわちこの場合まず第１のオーバーサンプリングフ
イルタ１１Ａの遅延入力 選択回路１２のスイツチ回路１２Ｄは、フイルタ制御回
路１４から送出される第 １の選択制御信号ＣＮＴ1 によつて第１の入力端ａが選
択され、遅延量選択回路 １６は第２の選択制御信号ＣＮＴ2 に応じた所定のタイ
ミングで第１又は第２の 入力端ａ又はｂが切換制御されている。
また第２のオーバーサンプリングフイルタ１１Ｂの遅
延入力選択回路１２のス イツチ回路１２Ｄは、フイルタ制御回路１４から送出さ
れる第１の選択制御信号 ＣＮＴ1 によつて第３の入力端ｃが選択され、遅延量選
択回路１６は第２の選択 制御信号ＣＮＴ2 によつて第１の入力端ａが選択されて
いる。
さらに第３のオーバーサンプリングフイルタ１１Ｃの
遅延入力選択回路１２の スイツチ回路１２Ｄは、フイルタ制御回路１４から送出
される第１の選択制御信 号ＣＮＴ1 によつて第２の入力端ｂが選択され、遅延量
選択回路１６は第２の選 択制御信号ＣＮＴ2 によつて第１の入力端ａが選択され
ている。
さらにまた第４のオーバーサンプリングフイルタ１１
Ｄの遅延入力選択回路１ ２のスイツチ回路１２Ｄは、フイルタ制御回路１４から
送出される第１の選択制 御信号ＣＮＴ1 によつて第１の入力端ａが選択され、遅
延量選択回路１６は第２ の選択制御信号ＣＮＴ2 によつて第１の入力端ａが選択
されている。
なお第１〜第４のオーバーサンプリングフイルタ１１
Ａ〜１１Ｄのそれぞれ第 １〜第５の加算入力選択回路１８Ａ〜１８Ｅは各フイル
タ制御回路１４から送出 される第３の選択制御信号ＣＮＴ3 によつて第１の入力
端ａが選択されている。
このようにしてこのサンプリングレート変換装置４０
においては、第１及び第 ２のオーバーサンプリングフイルタ１１Ａ及び１１Ｂに
対して、第３及び第４の オーバーサンプリングフイルタ１１Ｃ及び１１Ｄを所定
の遅延時間Ｔ1 分遅延さ せ、それぞれのデイジタル出力を加算することにより、
全体として長さ11次のＦ ＩＲ型デイジタルフイルタを構成している。
従つてＰＡＬコンポジツトデイジタルビデオ信号Ｓ
IND2は、それぞれ10個のフ リツプフロツプ４１Ａ〜４１Ｊ及び４４Ａ〜４４Ｊの直
列回路に入力されている。
ここでまずフリツプフロツプ４１Ａ〜４１Ｊは各々所
定の遅延時間Ｔ1 でなり、 それぞれのフリツプフロツプ４１Ａ〜４１Ｊの出力デイ
ジタル信号Ｄ40〜Ｄ49が 続くフリツプフロツプ４１Ｂ〜４１Ｊに入力される。
またこれと共に各フリツプフロツプ４１Ａ〜４１Ｊの
出力デイジタル信号Ｄ40 〜Ｄ49は乗算回路４２Ａ〜４２Ｊに入力され所定の係数
ｃ40〜ｃ49と乗算された 後、全乗算結果が加算回路４３Ａ〜４３Ｊを用いて加算
され、この加算結果が加 算回路２１に入力される。
なお第５の乗算回路４２Ｅに入力される出力デイジタ
ル信号Ｄ44は、遅延量選 択回路１６によつて第５のフリツプフロツプ４１Ｅから
送出される出力デイジタ ル信号Ｄ44A か又は第１１のフリツプフロツプ４１Ｋの
出力デイジタル信号Ｄ44B かの何れかが選択されて入力されている。
実際上第５のフリツプフロツプ４１Ｅから送出される
出力デイジタル信号Ｄ44A は、第４のフリツプフロツプ４１Ｄから送出される出力
デイジタル信号Ｄ43を所 定の遅延時間Ｔ1 だけ遅延してなる。
また第１１のフリツプフロツプ４１Ｋの出力デイジタ
ル信号Ｄ44B は、第５の フリツプフロツプ４１Ｅから送出される出力デイジタル
信号Ｄ44A に対して２倍 の遅延時間２Ｔ1 だけ遅延するようになされている。
これに対してフリツプフロツプ４４Ａ〜４４Ｊのう
ち、第１のフリツプフロツ プ４４Ａは２倍の遅延時間２Ｔ1 、また第２から第１０
のフリツプフロツプ４４ Ｂ〜４４Ｊは各々所定の遅延時間Ｔ1 でなり、それぞれ
のフリツプフロツプ４４ Ａ〜４４Ｊの出力デイジタル信号Ｄ50〜Ｄ59が続くフリ
ツプフロツプ４４Ｂ〜４ ４Ｊに入力される。
またこれと共に各フリツプフロツプ４４Ａ〜４４Ｊの
出力デイジタル信号Ｄ50 〜Ｄ59は乗算回路４５Ａ〜４５Ｊに入力され所定の係数
ｃ50〜ｃ59と乗算された 後、全乗算結果が加算回路４６Ａ〜４６Ｊを用いて加算
され、この加算結果が加 算回路２１に入力される。
このようにしてＰＡＬコンポジツトデイジタルビデオ
信号ＳIND2のサンプリン グ周波数をレート変換し、625/50コンポーネントデイジ
タルビデオ信号に応じた サンプリング周波数でなるデイジタル信号ＳOUTD1 を得
るようになされている。
ここでこの実施例の場合、第６図（Ｃ）及び（Ｅ）に
示すように、上段の乗算 回路４２Ａ〜４２Ｊに与えられる係数ｃ40〜ｃ49は、所
定の遅延時間Ｔ1毎に、 第１及び第２のオーバーサンプリングフイルタ１１Ａ及
び１１Ｂの係数発生回路 １７Ａ〜１７ＥのＲＯＭ領域に記憶された 506個分の係
数データｃ20〜ｃ24がそ れぞれ供給されている。なお、第１及び第２のオーバー
サンプリングフイルタ１ １Ａ及び１１Ｂの係数発生回路１７Ａ〜１７Ｅは、既に
述べたＤ−１からＤ−２ へのレート変換時と全く同じものが使われる。そして、
各乗算回路４２Ａ〜４２ Ｊに割り付けられる係数は次のようになつている。
実際上第１の乗算回路４２Ａに与えられる係数ｃ
40は、 506個分の係数データ ｃ20の中の０〜 413番目までの 414個の係数が与えら
れ、 414〜 505番目までの 係数については、その係数は与えられず、代わりに値
「０」が与えられる。
また第２の乗算回路４２Ｂに与えられる係数ｃ41は、
506個分の係数データｃ21 の中の０〜 321番目までの 322個の係数が与えられ、 3
22〜 505番目までの係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
さらに第３の乗算回路４２Ｃに与えられる係数ｃ
42は、 506個分の係数データ ｃ22の中の０〜 229番目までの 230個の係数が与えら
れ、 230〜 505番目までの 係数については、その係数は与えられず、代わりに値
「０」が与えられる。
またさらに第４の乗算回路４２Ｄに与えられる係数ｃ
43は、 506個分の係数デ ータｃ23の中の０〜 137番目までの 138個分の係数が与
えられ、 138〜 505番目 までの係数については、その係数は与えられず、代わり
に値「０」が与えられる。
ここで第５の乗算回路４２Ｅに与えられる係数ｃ
44は、 506個分の係数データ ｃ24の中の０〜45番目までの46個と 460〜 505番目まで
の46個の係数が与えられ、 46〜 459番目までの係数については、その係数は与えら
れず、代わりに値「０」 が与えられる。
これに続いて第６の乗算回路４２Ｆに与えられる係数
ｃ45は、 506個分の係数 データｃ21の中の 368〜 505番目までの 138個の係数が
与えられ、０〜 367番目 までの係数については、その係数は与えられず、代わり
に値「０」が与えられる。
さらに第７の乗算回路４２Ｇに与えられる係数ｃ
46は、 506個分の係数データ ｃ22の中の 276〜 505番目までの 230個の係数が与えら
れ、０〜 275番目までの 係数については、その係数は与えられず、代わりに値
「０」が与えられる。
また第８の乗算回路４２Ｈに与えられる係数ｃ47は、
506個分の係数データｃ23 の中の 184〜 505番目までの 322個の係数が与えられ、
０〜 183番目までの係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
さらに第９の乗算回路４２Ｉに与えられる係数ｃ
48は、 506個分の係数データ ｃ24の中の92〜 505番目までの 414個の係数が与えら
れ、０〜91番目までの係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
そして、第１０の乗算回路４２Ｊに与えられる係数ｃ
49は、全て値「０」に選 定される。
これに対して第６図（Ｄ）及び（Ｆ）に示すように、
下段の乗算回路４５Ａ〜 ４５Ｊに与えられる係数ｃ50〜ｃ59は、所定の遅延時間
Ｔ1 毎に第３及び第４の オーバーサンプリングフイルタ１１Ｃ及び１１Ｄの係数
発生回路１７Ａ〜１７Ｅ のＲＯＭ領域に記憶された 506個分の係数データｃ20〜
ｃ24がそれぞれ供給され ている。
各乗算回路４５Ａ〜４５Ｊに与えられる係数は次のよ
うになつている。
実際上第１の乗算回路４５Ａに与えられる係数ｃ
50は、 506個分の係数データ ｃ20の中の 414〜 505番目までの92個の係数が与えら
れ、０〜 413番目までの係 数については、その係数については、その係数は与えら
れず、代わりに値「０」 が与えられる。
また第２の乗算回路４５Ｂに与えられる係数ｃ51は、
506個分の係数データｃ21 の中の 322〜 505番目までの 184個の係数が与えられ、
０〜 321番目までの係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
さらに第３の乗算回路４５Ｃに与えられる係数ｃ
52は、 506個分の係数データ ｃ22の中の 230〜 505番目までの 276個の係数が与えら
れ、０〜 229番目までの 係数については、その係数は与えられず、代わりに値
「０」が与えられる。
またさらに第４の乗算回路４５Ｄに与えられる係数ｃ
53は、 506個分の係数デ ータｃ23の中の 138〜 505番目までの 368個の係数が与
えられ、０〜 137番目ま での係数については、その係数は与えられず、代わりに
値「０」が与えられる。
また第５の乗算回路４５Ｅに与えられる係数ｃ54は、
506個分の係数データｃ24 の中の46〜 459番目までの 414個の係数が与えられ、０
〜45番目及び 460〜 505 番目の係数については、その係数は与えられず、代わり
に値「０」が与えられる。
さらに第６の乗算回路４５Ｆに与えられる係数ｃ
55は、 506個分の係数データ ｃ20の中の０〜 367番目までの 368個の係数が与えら
れ、 368〜 505番目の係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
またさらに第７の乗算回路４５Ｇに与えられる係数ｃ
56は、 506個分の係数デ ータｃ21の中の０〜 275番目までの 276個の係数が与え
られ、 276〜 505番目ま での係数については、その係数は与えられず、代わりに
値「０」が与えられる。
また第８の乗算回路４５Ｈに与えられる係数ｃ57は、
506個分の係数データｃ22 の中の０〜 183番目までの 184個の係数が与えられ、 1
84〜 505番目までの係数 については、その係数は与えられず、代わりに値「０」
が与えられる。
さらに第９の乗算回路４５Ｉに与えられる係数ｃ
58は、 506個分の係数データ ｃ23の中の０〜91番目までの92個の係数が与えられ、92
〜 505番目までの係数に ついては、その係数は与えられず、代わりに値「０」が
与えられる。
さらに第１０の乗算回路４２Ｊに与えられる係数ｃ59
は、全て値「０」に選定 される。
ところで、各乗算回路４２Ａ〜４２Ｊ、４５Ａ〜４５
Ｊにおいて乗算する係数 データをフリツプフロツプ出力とは、タイミングを考慮
する必要がある。それは、 各係数発生回路に格納されている 506個の係数をＤ−１
からＤ−２へのレート変 換時とＤ−２からＤ−１へのレート変換時で共用するた
め、Ｄ−２からＤ−１へ のレート変換においては、係数データとフリツプフロツ
プで転送されるサンプリ ングデータとの間にずれを生じるからである。このずれ
は、サンプリングデータ に対して係数データの位相を合わせるか、あるいは係数
データに対してサンプリ ングデータの位相を合わせるか、どちらかの方法で補正
することができる。本発 明におけるオーバーサンプリングフイルタでは、後者
の、係数データに対してサ ンプリングデータの位相を合わせる方法を採つている。
すなわち、第７図の下段 側のオーバーサンプリングフイルタは、一番先頭にある
フリツプフロツプ４４Ａ の遅延時間として、遅延入力選択回路１２において２Ｔ
1 が与えられており、こ の下段側のオーバーサンプリングフイルタは、１クロツ
ク分遅らせたサンプリン グデータに対して係数データｃ50〜ｃ59を乗算する。上
段側のオーバーサンプリ ングフイルタの乗算回路４２Ａ〜４２Ｄは、入力される
サンプリングデータに対 してそのまま係数データｃ40〜ｃ43を乗算するが、乗算
回路４２Ｅは、０〜45番 目の係数の乗算と、この乗算に用いられたサンプリング
データを２クロツク分遅 らせたデータに対しても 460〜 505番目の係数の乗算を
する必要がある。従つて 乗算回路４２Ｅに送られるサンプリングデータのタイミ
ングは遅延量選択回路１ ６においてＴ1 又は３Ｔ1 遅延され、係数データｃ44と
乗算される。
また、係数データｃ45〜ｃ48はサンプリングデータに
対して２クロツク分ずれ る。従つて、遅延入力選択回路１２においてさらに２Ｔ
1 の遅延時間を与えてい る。なお、これはフリツプフロツプ４１Ｆに相当する。
このようにして、本発明におけるオーバーサンプリン
グフイルタは、 506個分 の係数データを 414個分毎に組み合わせて所定の遅延時
間Ｔ1 毎に係数データｃ40 〜ｃ49、ｃ50〜ｃ59として乗算回路４２Ａ〜４２Ｊ、４
５Ａ〜４５Ｊに与えるこ とにより、全体として、入力されるＰＡＬコンポジツト
デイジタルビデオ信号 ＳIND2を 414倍の周波数でオーバーサンプリングすると
共に、このオーバーサン プリング周波数の 1/506倍の周波数でリサンプリングす
る4554次（11次× 414倍 でなる）のオーバーサンプリングフイルタを構成してい
る。
以上のようにしてＰＡＬコンポジツトデイジタルビデ
オ信号ＳIND2のサンプリ ング周波数をレート変換し、ＰＡＬコンポーネントデイ
ジタルビデオ信号のサン プリング周波数に応じたデイジタル信号ＳOUTD1 を得る
ことのできるサンプリン グレート変換装置４０は実現される。
(G2-4)第２実施例の効果 以上の構成によれば、それぞれ乗算回路に与える係数
を選択し得るようになさ れたＦＩＲ型デイジタルフイルタ構成のオーバーサンプ
リングフイルタを組み合 わせ、625/50コンポーネントデイジタルビデオ信号及び
ＰＡＬコンポジツトデイ ジタルビデオ信号間のサンプリングレート変換方向に応
じて、各オーバーサンプ リングフイルタに所定の係数を与えるようにしたことに
より、ＰＡＬコンポーネ ントデイジタルビデオ信号のサンプリング周波数をＰＡ
Ｌコンポジツトデイジタ ルビデオ信号に応じたサンプリング周波数に変換すると
共に、ＰＡＬコンポジツ トデイジタルビデオ信号のサンプリング周波数を625/50
コンポーネントデイジタ ルビデオ信号に応じたサンプリング周波数に変換し得る
双方向のサンプリングレ ート変換装置を実現できる。
(G3)他の実施例 (1) 上述の第１の実施例においては、レート変換の対
象となるデイジタル信号の サンプリング周波数の周波数比を３：４に選定し、長さ
12次のオーバーサンプリ ングフイルタを用いて双方向にサンプリングレートを変
換する場合について述べ たが、本発明はこれに限らず、サンプリング周波数の周
波数比が簡単な整数比の 関係を有する場合には、その周波数比の最小公倍数に応
じた長さのオーバーサン プリングフイルタを構成すれば、上述の第１の実施例と
同様の効果を実現できる。
(2) 上述の第２の実施例においては、625/50コンポー
ネントデイジタルビデオ信 号のサンプリング周波数及び及びＰＡＬコンポジツトデ
イジタルビデオ信号のサンプ リング周波数の周波数比の関係より、近似的に長さ4554
次のオーバーサンプリン グフイルタを用いて双方向にサンプリングレートを変換
する場合について述べた が、本発明はこれに限らず、種々のデイジタル信号のサ
ンプリング周波数と他の サンプリング周波数間で双方向にサンプリングレートを
変換する場合に広く適用 し得、この場合オーバーサンプリングフイルタの長さを
これに応じて選定するよ うにすれば良い。
(3) 上述の第２の実施例においては、集積回路化され
た長さ５次のＦＩＲ型デイ ジタルフイルタを４個組み合わせてサンプリングレート
変換装置を構成した場合 について述べたが、サンプリングレート変換装置の構成
はこれに限らず、例えば 全体を集積回路化する等種々の構成を用いるようにして
も上述の実施例と同様の 効果を実現できる。
Ｈ発明の効果 上述のように第１の発明によれば、第１及び第２のサ
ンプリング周波数の周波 数比が簡易な整数関係にある場合、その周波数比の最小
公倍数に応じた長さのＦ ＩＲ型デイジタルフイルタでオーバーサンプリングフイ
ルタを構成するようにし たことにより、デイジタル信号の第１又は第２のサンプ
リング周波数を第２又は 第１のサンプリング周波数に変換し得るサンプリングレ
ート変換装置を実現でき る。
また第２の発明によれば、ＦＩＲ型デイジタルフイル
タ構成のオーバーサンプ リングフイルタの重付け手段に与える係数を選択し得る
ようにしたことにより、 第１及び第２のサンプリング周波数の周波数比が簡易な
整数関係にない場合、デ イジタル信号の第１又は第２のサンプリング周波数を第
２又は第１のサンプリン グ周波数に変換し得るサンプリングレート変換装置を実
現できる。
【図面の簡単な説明】
第１図は第１の発明によるサンプリングレート変換装
置の一実施例を示すブロ ツク図、第２図はそのナイキスト特性を示す特性曲線
図、第３図は第２の発明に よるサンプリングレート変換装置の一実施例を示すブロ
ツク図、第４図はオーバ ーサンプリングフイルタの構成を示すブロツク図、第５
図はＰＡＬコンポーネン トデイジタルビデオ信号のサンプリング周波数をＰＡＬ
コンポジツトデイジタル ビデオ信号に応じたサンプリング周波数に変換する場合
の等価回路を示すブロツ ク図、第６図は係数データの供給手順の説明に供するタ
イミングチヤート、第７ 図はＰＡＬコンポジツトデイジタルビデオ信号のサンプ
リング周波数をＰＡＬコ ンポーネントデイジタルビデオ信号に応じたサンプリン
グ周波数に変換する場合 の等価回路を示すブロツク図である。 １、１０、３０、４０……サンプリングレート変換装
置、２Ａ〜２Ｋ、１２Ａ 〜１２Ｃ、１３Ａ〜１３Ｅ、３１Ａ〜３１Ｊ、４１Ａ〜
４１Ｋ、４４Ａ〜４４Ｊ ……フリツプフロツプ、３Ａ〜３Ｌ、１５Ａ〜１５Ｅ、
３２Ａ〜３２Ｊ、４２Ａ 〜４２Ｊ、４５Ａ〜４５Ｊ……乗算回路、４Ａ〜４Ｋ、
１９Ａ〜１９Ｅ、２１、 ３３Ａ〜３３Ｊ、４３Ａ〜４３Ｊ、４６Ａ〜４５Ｊ……
加算回路、１１、１１Ａ 〜１１Ｄ……オーバーサンプリングフイルタ、１４……
フイルタ制御回路、１７ Ａ〜１７Ｅ……係数発生回路、２０Ａ〜２０Ｅ……アド
レス発生回路。

Claims (2)

    【特許請求の範囲】
  1. 【請求項１】 第１又は第２のサンプリング周波数でサ
    ンプリングされてなるデイジタル信 号を、当該第１又は第２のサンプリング周波数に対して
    周波数比が簡易な整数関係 にある第２又は第１のサンプリング周波数に変換するサ
    ンプリングレート変換装 置において、 上記第１及び第２のサンプリング周波数の上記周波数
    比の最小公倍数に応じた 長さのＦＩＲ型デイジタルフイルタでなるオーバーサン
    プリングフイルタ を具え、上記デイジタル信号の上記第１又は第２のサ
    ンプリング周波数を上記 第２又は第１のサンプリング周波数に変換するようにし
    た ことを特徴とするサンプリングレート変換装置。
  2. 【請求項２】 第１又は第２のサンプリング周波数でサ
    ンプリングされてなるデイジタル信 号を、第２又は第１のサンプリング周波数に変換するサ
    ンプリングレート変換装 置において、 上記第１及び第２のサンプリング周波数の上記周波数
    比に応じた長さのＦＩＲ 型デイジタルフイルタでなるオーバーサンプリングフイ
    ルタと、 選択可能な複数の係数データを含んでなり、選択され
    た当該係数データに応じ た係数を上記オーバーサンプリングフイルタの重付け手
    段に与える係数発生手段 と を具え、第１又は第２のサンプリング周波数の周波数
    比が簡易な整数関係にな い場合、デイジタル信号の第１又は第２のサンプリング
    周波数を第２又は第１の サンプリング周波数に変換する際、当該変換方向に応じ
    て上記係数発生手段の上 記係数データを選択するようにした ことを特徴とするサンプリングレート変換装置。
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