JPH10209205A - チップの実装構造 - Google Patents

チップの実装構造

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JPH10209205A
JPH10209205A JP1218497A JP1218497A JPH10209205A JP H10209205 A JPH10209205 A JP H10209205A JP 1218497 A JP1218497 A JP 1218497A JP 1218497 A JP1218497 A JP 1218497A JP H10209205 A JPH10209205 A JP H10209205A
Authority
JP
Japan
Prior art keywords
chip
spacer
solder
mounting structure
substrate
Prior art date
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Pending
Application number
JP1218497A
Other languages
English (en)
Inventor
Takashi Ueda
貴史 上田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP1218497A priority Critical patent/JPH10209205A/ja
Publication of JPH10209205A publication Critical patent/JPH10209205A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • H01L2224/1401Structure
    • H01L2224/1403Bump connectors having different sizes, e.g. different diameters, heights or widths
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8112Aligning
    • H01L2224/81136Aligning involving guiding structures, e.g. spacers or supporting members
    • H01L2224/81138Aligning involving guiding structures, e.g. spacers or supporting members the guiding structures being at least partially left in the finished device
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3431Leadless components
    • H05K3/3436Leadless components having an array of bottom contacts, e.g. pad grid array or ball grid array components

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  • Wire Bonding (AREA)

Abstract

(57)【要約】 【課題】 部品点数を削減し、半田の高さを十分に高く
確保できるとともに、形状の良い半田を形成できるチッ
プの実装構造を提供することを目的とする。 【解決手段】 基板1とチップ3の間に板状のスペーサ
10を介在させる。スペーサ10には基板1のパッド2
とチップ3のパッド4に対応する孔部11が多数開孔さ
れている。半田5の高さはスペーサ10の厚さで決定さ
れ、また半田5の断面形状は孔部11の形状で決定され
る。したがって所望の高さと形状を有する半田5を形成
して、チップ3を基板1にしっかり半田付けできる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、チップのパッドを
基板のパッドに半田付けするチップの実装構造に関する
ものである。
【0002】
【従来の技術】図10は、従来のチップの実装構造の断
面図である。基板1の上面のパッド2には、チップ3の
下面のパッド4が半田5で半田付けされている。Bは半
田5の高さである。
【0003】実装後の高温環境下での熱変形などに対す
る信頼性を確保するためには、半田の高さを高くし、ま
たその形状を良くして熱変形に強いものにする必要があ
るが、図10に示す従来方法では半田5はチップ3の重
みで押しつぶされるので十分な高さや良好な形状を確保
しにくいものであった。
【0004】そこで従来、以下に述べる実装構造が知ら
れている。図11は、他の従来のチップの実装構造の断
面図である。基板1とチップ3の間にはスペーサ6が介
在させてあり、これにより半田5がチップ3の重みで押
しつぶされないようにし、半田5に十分な高さCを確保
するとともに、半田5を形状の良いつづみ形にしてい
る。7はスペーサ6を基板1に接着するボンドである。
【0005】
【発明が解決しようとする課題】しかしながら図11に
示す従来例では、複数のスペーサ6を必要とし、かつ各
スペーサ6をそれぞれボンド7で基板1に接着しなけれ
ばならないので工程数が多くなり、生産性があがらない
ものであった。また各スペーサ6の高さがばらつくと、
スペーサ6としての機能を果せないので、スペーサ6の
加工精度を十分に高くする必要があり、コストアップの
原因となっていた。
【0006】したがって本発明は、部品点数を削減し、
半田の高さを十分に高く確保できるとともに、形状の良
い半田を形成できるチップの実装構造を提供することを
目的とする。
【0007】
【課題を解決するための手段】本発明は、基板上面のパ
ッドにチップ下面のパッドを半田付けするチップの実装
構造であって、前記パッドに対応する位置に孔部が開孔
されたスペーサを前記基板と前記チップの間に介在さ
せ、前記孔部の内部の半田で前記基板のパッドと前記チ
ップのパッドを接続する。
【0008】
【発明の実施の形態】本発明によれば、1個のスペーサ
により、形状がよくしかも十分な高さを有する半田を形
成してチップを基板に半田付けすることができる。
【0009】(実施の形態1)図1は、本発明の実施の
形態1の基板とチップとスペーサの斜視図、図2は同チ
ップの下面側から見た斜視図、図3は同チップの実装構
造の断面図である。なお各図において、従来例と同一要
素には同一符号を付している。
【0010】図1において、10はスペーサである。こ
のスペーサ10は板状であって、絶縁材により形成され
ており、そのタテヨコのサイズはチップ3とほぼ同じで
ある。基板1の上面には多数個のパッド2がマトリクス
状に多数形成されており、またチップ3の下面にも同様
にパッド4が多数形成されている。またスペーサ10に
は、パッド2、4に対応する位置に孔部11が多数開孔
されている。また図1に示すように、基板1のパッド2
上には半田5が形成されている。
【0011】したがってチップ3は、スペーサ10を介
在させて基板1上に搭載され、半田5を加熱処理するこ
とにより半田付けされるが(図3を参照)、スペーサ1
0によりチップ3が沈み込んで半田5が押しつぶされる
ことはなく、十分な半田5の高さAを確保することがで
きる。なお孔部11の直径Dは半田5の直径dよりもや
や大きくしてある。またスペーサ10は基板1の上面と
チップ3の下面に面接触するので、熱変化条件下におけ
る熱変形をその接触摩擦力で押えることができる。
【0012】(実施の形態2)図4は、本発明の実施の
形態2のチップの実装構造の断面図である。スペーサ1
0aの孔部11aの中央部はくびれており、したがって
つづみ形の半田5が形成される。
【0013】(実施の形態3)図5は、本発明の実施の
形態3のチップの実装構造の断面図である。スペーサ1
0bの孔部11bは下方へ末広がり状であり、したがっ
て半田5の断面形状は台形となる。
【0014】(実施の形態4)図6は、本発明の実施の
形態4のチップの実装構造の断面図である。チップ3の
パッド4は基板1のパッド2よりも外側へずれており、
したがってパッド2とパッド4を接続できるように、ス
ペーサ10cの孔部11cは傾斜している。以上の各実
施の形態から明らかなように、半田5の高さはスペーサ
10cの厚さで決定され、半田5の断面形状は孔部11
cの形状で決定される。
【0015】(実施の形態5)図7は、本発明の実施の
形態5のスペーサの平面図である。スペーサ10dの孔
部11dの直径は、中央から外側へ向って次第に大きく
してある。孔部11dの直径分布をこのようにすること
により、中央から外側へ向う基板とチップの半田付けに
ともなう伸縮や回転位置ずれに対して、半田の全方向へ
のせん断応力が高まり、変形しにくくなるという作用効
果が得られる。
【0016】(実施の形態6)図8は、本発明の実施の
形態6のスペーサの平面図である。スペーサ10eの孔
部11eは楕円形もしくは長円形であって、その長径は
中央から外側へ向って次第に大きくしてある。孔部11
eの形状や分布をこのように構成することにより、中央
から外側へ向う基板とチップの半田付けにともなう伸縮
に対して、半田のせん断応力が高まり、変形しにくくな
るという作用効果が得られる。
【0017】(実施の形態7)図9は、本発明の実施の
形態7のスペーサの斜視図である。スペーサ10の上面
と下面にはボンド12、13が付着されており、これに
より基板1とチップ3に接着する。このボンド12、1
3も、高温環境下における熱変形を押える作用を有す
る。
【0018】
【発明の効果】本発明によれば、1個のスペーサによ
り、形状がよくしかも十分な高さを有する半田によりチ
ップを基板に半田付けすることができる。しかも孔部の
形状などを変えることにより、所望形状の半田を形成す
ることができる。
【図面の簡単な説明】
【図1】本発明の実施の形態1の基板とチップとスペー
サの斜視図
【図2】本発明の実施の形態1のチップの下面側から見
た斜視図
【図3】本発明の実施の形態1のチップの実装構造の断
面図
【図4】本発明の実施の形態2のチップの実装構造の断
面図
【図5】本発明の実施の形態3のチップの実装構造の断
面図
【図6】本発明の実施の形態4のチップの実装構造の断
面図
【図7】本発明の実施の形態5のスペーサの平面図
【図8】本発明の実施の形態6のスペーサの平面図
【図9】本発明の実施の形態7のスペーサの斜視図
【図10】従来のチップの実装構造の断面図
【図11】他の従来のチップの実装構造の断面図
【符号の説明】
1 基板 2 パッド 3 チップ 4 パッド 5 半田 10、10a、10b、10c、10d、10e スペ
ーサ 11、11a、11b、11c、11d、11e 孔部

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】基板上面のパッドにチップ下面のパッドを
    半田付けするチップの実装構造であって、前記パッドに
    対応する位置に孔部が開孔されたスペーサを前記基板と
    前記チップの間に介在させ、前記孔部の内部の半田で前
    記基板のパッドと前記チップのパッドを接続することを
    特徴とするチップの実装構造。
JP1218497A 1997-01-27 1997-01-27 チップの実装構造 Pending JPH10209205A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1218497A JPH10209205A (ja) 1997-01-27 1997-01-27 チップの実装構造

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1218497A JPH10209205A (ja) 1997-01-27 1997-01-27 チップの実装構造

Publications (1)

Publication Number Publication Date
JPH10209205A true JPH10209205A (ja) 1998-08-07

Family

ID=11798338

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1218497A Pending JPH10209205A (ja) 1997-01-27 1997-01-27 チップの実装構造

Country Status (1)

Country Link
JP (1) JPH10209205A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7036216B2 (en) 2000-03-23 2006-05-02 Infineon Technologies Ag Method and apparatus for connecting at least one chip to an external wiring configuration
JP2013033803A (ja) * 2011-08-01 2013-02-14 Ngk Spark Plug Co Ltd 回路基板、半導体パワーモジュール、製造方法
JP2013051389A (ja) * 2011-08-01 2013-03-14 Ngk Spark Plug Co Ltd 回路基板、半導体パワーモジュール、製造方法
CN103733330A (zh) * 2011-08-01 2014-04-16 日本特殊陶业株式会社 半导体功率模块、半导体功率模块的制造方法、电路板

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