JPH10187551A - Ｉｃカード - Google Patents
ＩｃカードInfo
- Publication number
- JPH10187551A JPH10187551A JP8348226A JP34822696A JPH10187551A JP H10187551 A JPH10187551 A JP H10187551A JP 8348226 A JP8348226 A JP 8348226A JP 34822696 A JP34822696 A JP 34822696A JP H10187551 A JPH10187551 A JP H10187551A
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- JP
- Japan
- Prior art keywords
- data
- error
- memory
- main memory
- error detection
- Prior art date
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- Pending
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- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】 （修正有）
【課題】 ＩＣカードに内蔵されている不揮発性メモリ
に記憶したデータの誤りを検出する。 【解決手段】 主制御部は起動時などの質問器とデータ
のやりとりを行なっていないときにメインメモリまたは
サブメモリに記憶されているデータの誤りを誤り検出回
路によって行ない、エラーを検出したデータの補正を行
なう。
に記憶したデータの誤りを検出する。 【解決手段】 主制御部は起動時などの質問器とデータ
のやりとりを行なっていないときにメインメモリまたは
サブメモリに記憶されているデータの誤りを誤り検出回
路によって行ない、エラーを検出したデータの補正を行
なう。
Description
【０００１】
【発明の属する技術分野】この発明はＩＣカードに関
し、特に、各種データを記憶するための不揮発性メモリ
を内蔵していて、質問器と称される制御部との間でデー
タのやり取りを行なうようなＩＣカードに関する。
し、特に、各種データを記憶するための不揮発性メモリ
を内蔵していて、質問器と称される制御部との間でデー
タのやり取りを行なうようなＩＣカードに関する。
【０００２】
【従来の技術】ＩＣカードには、端子を制御部に電気的
に接続してデータのやり取りを行なうものと、非接触で
データのやり取りを行なうものがある。この非接触式の
ＩＣカードは、アンテナから送信されてくる電波から電
力を得て、内部の不揮発性メモリに記憶している情報を
送信するものであり、スキー場のリフトや鉄道の改札や
荷物の仕分けなどに利用されている。
に接続してデータのやり取りを行なうものと、非接触で
データのやり取りを行なうものがある。この非接触式の
ＩＣカードは、アンテナから送信されてくる電波から電
力を得て、内部の不揮発性メモリに記憶している情報を
送信するものであり、スキー場のリフトや鉄道の改札や
荷物の仕分けなどに利用されている。
【０００３】
【発明が解決しようとする課題】上述の接触式，非接触
式を問わず、ＩＣカードはその構造上外部からの応力に
弱く、静電気などによって不揮発性メモリに記憶してい
るデータが変化してしまう可能性がある。従来は、ＩＣ
カードの不揮発性メモリでは、そのようなデータの変化
を誤りとして検知することができず、ましてやデータの
誤り訂正などを行なうことができなかった。
式を問わず、ＩＣカードはその構造上外部からの応力に
弱く、静電気などによって不揮発性メモリに記憶してい
るデータが変化してしまう可能性がある。従来は、ＩＣ
カードの不揮発性メモリでは、そのようなデータの変化
を誤りとして検知することができず、ましてやデータの
誤り訂正などを行なうことができなかった。
【０００４】それゆえに、この発明の主たる目的は、不
揮発性メモリの非動作時に記憶しているデータの誤りを
検出できるようなＩＣカードを提供することである。
揮発性メモリの非動作時に記憶しているデータの誤りを
検出できるようなＩＣカードを提供することである。
【０００５】
【課題を解決するための手段】請求項１に係る発明は、
質問器との間でデータのやり取りを行なうＩＣカードに
おいて、質問器からのデータを記憶する不揮発性記憶手
段と、不揮発性記憶手段の非選択時に不揮発性記憶手段
に記憶しているデータの誤りを検出する誤り検出手段と
を備えて構成される。
質問器との間でデータのやり取りを行なうＩＣカードに
おいて、質問器からのデータを記憶する不揮発性記憶手
段と、不揮発性記憶手段の非選択時に不揮発性記憶手段
に記憶しているデータの誤りを検出する誤り検出手段と
を備えて構成される。
【０００６】請求項２に係る発明では、請求項１の不揮
発性記憶手段に記憶されているデータと同じデータまた
は１対１に対応が行なえるデータを記憶する予備用不揮
発性記憶手段を含み、誤り検出手段は不揮発性記憶手段
または予備用不揮発性記憶手段に記憶されているデータ
の誤りを検出する。
発性記憶手段に記憶されているデータと同じデータまた
は１対１に対応が行なえるデータを記憶する予備用不揮
発性記憶手段を含み、誤り検出手段は不揮発性記憶手段
または予備用不揮発性記憶手段に記憶されているデータ
の誤りを検出する。
【０００７】請求項３に係る発明では、請求項１の誤り
検出手段は、誤り検出結果に基づいて、不揮発性記憶手
段または予備用不揮発性記憶手段に記憶しているデータ
を補正する。
検出手段は、誤り検出結果に基づいて、不揮発性記憶手
段または予備用不揮発性記憶手段に記憶しているデータ
を補正する。
【０００８】
【発明の実施の形態】図１はこの発明の一実施形態を示
すブロック図である。この図１に示したＩＣカードは、
データの送受および非接触式カードへの電力の供給を１
つの周波数の信号で行なう信号重畳方式を例にとって説
明するが、データの送受と電力供給を別々の周波数の信
号を使用して行なう信号分離方式のＩＣカードであって
もよい。
すブロック図である。この図１に示したＩＣカードは、
データの送受および非接触式カードへの電力の供給を１
つの周波数の信号で行なう信号重畳方式を例にとって説
明するが、データの送受と電力供給を別々の周波数の信
号を使用して行なう信号分離方式のＩＣカードであって
もよい。
【０００９】図１において、コイルＬとコンデンサＣと
からなる同調回路１は質問器（図示せず）から送られて
来る変調信号に同調し、所定の期間無変調で送られて来
るキャリアを整流回路２に与える。整流回路２はそのキ
ャリアを整流し、直流電源として各部に直流電圧を供給
する。また、同調回路１は変調信号が送られて来たとき
には、その変調出力を増幅復調部３に与え、増幅復調部
３はその変調信号からデータを復調する。この復調出力
のデータはシリアルに送られて来ているので、Ｓ／Ｐ変
換部５によってパラレルなデータに変換されて、主制御
部７に与えられる。
からなる同調回路１は質問器（図示せず）から送られて
来る変調信号に同調し、所定の期間無変調で送られて来
るキャリアを整流回路２に与える。整流回路２はそのキ
ャリアを整流し、直流電源として各部に直流電圧を供給
する。また、同調回路１は変調信号が送られて来たとき
には、その変調出力を増幅復調部３に与え、増幅復調部
３はその変調信号からデータを復調する。この復調出力
のデータはシリアルに送られて来ているので、Ｓ／Ｐ変
換部５によってパラレルなデータに変換されて、主制御
部７に与えられる。
【００１０】また、主制御部７は質問器へ応答を返すと
きには、不揮発性記憶手段としてのメインメモリ１０か
らのデータをＰ／Ｓ変換器６に与えてシリアルデータに
変換し、シリアルデータを変調増幅部４に与え、変調増
幅部４はそのデータを増幅しかつ同調回路１に無変調波
が与えられたときに変調する。さらに、主制御部７に
は、セレクタ８，９を介してメインメモリ１０と予備用
不揮発性記憶手段としてのサブメモリ１１とが接続され
る。
きには、不揮発性記憶手段としてのメインメモリ１０か
らのデータをＰ／Ｓ変換器６に与えてシリアルデータに
変換し、シリアルデータを変調増幅部４に与え、変調増
幅部４はそのデータを増幅しかつ同調回路１に無変調波
が与えられたときに変調する。さらに、主制御部７に
は、セレクタ８，９を介してメインメモリ１０と予備用
不揮発性記憶手段としてのサブメモリ１１とが接続され
る。
【００１１】メインメモリ１０とサブメモリ１１はたと
えばＥ2 ＲＯＭやフラッシュメモリや強誘電体メモリな
どが用いられる。サブメモリ１１はメインメモリ１０の
バックアップ用として用いられ、メインメモリ１０と同
じデータまたは１対１で対応が行なえるデータを書込
む。メインメモリ１０とサブメモリ１１のそれぞれに対
応して書込んだデータの誤りを検出するために誤り検出
回路１２，１３が設けられる。誤り検出回路１２，１３
としてはパリティチェック回路やＣＲＣチェック回路な
どが用いられる。誤り検出回路１２，１３によって検出
された誤りを補正するために誤り補正回路１６，１７が
設けられる。
えばＥ2 ＲＯＭやフラッシュメモリや強誘電体メモリな
どが用いられる。サブメモリ１１はメインメモリ１０の
バックアップ用として用いられ、メインメモリ１０と同
じデータまたは１対１で対応が行なえるデータを書込
む。メインメモリ１０とサブメモリ１１のそれぞれに対
応して書込んだデータの誤りを検出するために誤り検出
回路１２，１３が設けられる。誤り検出回路１２，１３
としてはパリティチェック回路やＣＲＣチェック回路な
どが用いられる。誤り検出回路１２，１３によって検出
された誤りを補正するために誤り補正回路１６，１７が
設けられる。
【００１２】質問器からデータが変調信号として送信さ
れると、同調回路１がその変調信号に同調し、増幅復調
部３によってデータが復調され、シリアルなデータがＳ
／Ｐ変換部５によってパラレルなデータに変換され、主
制御部７に与えられる。主制御部７はそのデータを、セ
レクタ８，９を介してメインメモリ１０とサブメモリ１
１に記憶させる。誤り検出回路１２，１３はそれぞれメ
インメモリ１０とサブメモリ１１に記憶されているデー
タに誤りがあるか否かを検出する。誤り検出回路１２は
メインメモリ１０に誤りがなければ、セレクタ８によっ
てメインメモリ１０からデータが主制御部７に読出され
るように制御し、サブメモリ１１からデータが読出され
ないようにセレクタ９を制御する。誤り検出回路１２
は、もしメインメモリ１０にデータの誤りがあることを
検出した場合には、メインメモリ１０からデータが読出
されないようにセレクタ８を制御し、サブメモリ１１か
らデータが読出されるようにセレクタ９を制御する。誤
り検出回路１３はサブメモリ１１に記憶したデータに誤
りがあるかを検出する。もし、メインメモリ１０のみな
らずサブメモリ１１にもデータの誤りがあれば、メイン
メモリ１０およびサブメモリ１１からデータが主制御部
７に与えられない。この場合、主制御部７は質問器に対
してデータの送信を再要求するまたはデータに誤りがあ
ることを明示することになる。その後、誤り検出回路１
２，１３によって検出された誤りを誤り補正回路１６，
１７が補正する。
れると、同調回路１がその変調信号に同調し、増幅復調
部３によってデータが復調され、シリアルなデータがＳ
／Ｐ変換部５によってパラレルなデータに変換され、主
制御部７に与えられる。主制御部７はそのデータを、セ
レクタ８，９を介してメインメモリ１０とサブメモリ１
１に記憶させる。誤り検出回路１２，１３はそれぞれメ
インメモリ１０とサブメモリ１１に記憶されているデー
タに誤りがあるか否かを検出する。誤り検出回路１２は
メインメモリ１０に誤りがなければ、セレクタ８によっ
てメインメモリ１０からデータが主制御部７に読出され
るように制御し、サブメモリ１１からデータが読出され
ないようにセレクタ９を制御する。誤り検出回路１２
は、もしメインメモリ１０にデータの誤りがあることを
検出した場合には、メインメモリ１０からデータが読出
されないようにセレクタ８を制御し、サブメモリ１１か
らデータが読出されるようにセレクタ９を制御する。誤
り検出回路１３はサブメモリ１１に記憶したデータに誤
りがあるかを検出する。もし、メインメモリ１０のみな
らずサブメモリ１１にもデータの誤りがあれば、メイン
メモリ１０およびサブメモリ１１からデータが主制御部
７に与えられない。この場合、主制御部７は質問器に対
してデータの送信を再要求するまたはデータに誤りがあ
ることを明示することになる。その後、誤り検出回路１
２，１３によって検出された誤りを誤り補正回路１６，
１７が補正する。
【００１３】なお、誤り検出回路１３を省略し、誤り検
出回路１２のみによってメインメモリ１０のデータの誤
りの検出のみを行なうようにしてもよい。
出回路１２のみによってメインメモリ１０のデータの誤
りの検出のみを行なうようにしてもよい。
【００１４】図２は図１に示した誤り検出回路の一例を
示すブロック図である。この図２に示した誤り検出回路
１２はＣＲＣチェックを行なうものであり、５ビットの
シフトレジスタ１２１と７ビットのシフトレジスタ１２
２と４ビットのシフトレジスタ１２３を、ＥＸＯＲゲー
ト１２４，１２５，１２６によってシリアルに接続した
ものである。
示すブロック図である。この図２に示した誤り検出回路
１２はＣＲＣチェックを行なうものであり、５ビットの
シフトレジスタ１２１と７ビットのシフトレジスタ１２
２と４ビットのシフトレジスタ１２３を、ＥＸＯＲゲー
ト１２４，１２５，１２６によってシリアルに接続した
ものである。
【００１５】図３はこの発明の動作を説明するための図
であり、図４はこの発明の一実施形態の動作を説明する
ためのフローチャートである。
であり、図４はこの発明の一実施形態の動作を説明する
ためのフローチャートである。
【００１６】次に、図１〜図４を参照して、この発明の
一実施形態の動作について説明する。ＩＣカードは、図
３に示すように、起動時は質問器からデータが送信さ
れ、それを主制御部７が認識しており、その間は主制御
部７は質問器とデータのやりとりを行なっておらず、メ
インメモリ１０，サブメモリ１１も非動作となってい
る。そこで、この発明では、この期間内にメインメモリ
１０とサブメモリ１１に記憶しているデータの誤り検出
およびデータの補正を行なう。
一実施形態の動作について説明する。ＩＣカードは、図
３に示すように、起動時は質問器からデータが送信さ
れ、それを主制御部７が認識しており、その間は主制御
部７は質問器とデータのやりとりを行なっておらず、メ
インメモリ１０，サブメモリ１１も非動作となってい
る。そこで、この発明では、この期間内にメインメモリ
１０とサブメモリ１１に記憶しているデータの誤り検出
およびデータの補正を行なう。
【００１７】すなわち、図４に示すように、主制御部７
はデータのやりとり中であるか否かを判別し、データの
やりとり中であればメモリの誤り検出動作を行なわな
い。データのやりとり中でなければ誤り検出を行ない、
その検出結果をメインメモリ１０またはサブメモリ１１
に記憶する。これにより、誤りが複数あっても対処でき
る。メインメモリ１０またはサブメモリ１１のすべての
バイトについて誤り検出を行なったかを判別し、すべて
のバイトについて誤り検出を行なう。もし、誤りを検出
しなければ誤り検出動作を終了し、質問器とデータのや
りとりを行なうのを待つ。
はデータのやりとり中であるか否かを判別し、データの
やりとり中であればメモリの誤り検出動作を行なわな
い。データのやりとり中でなければ誤り検出を行ない、
その検出結果をメインメモリ１０またはサブメモリ１１
に記憶する。これにより、誤りが複数あっても対処でき
る。メインメモリ１０またはサブメモリ１１のすべての
バイトについて誤り検出を行なったかを判別し、すべて
のバイトについて誤り検出を行なう。もし、誤りを検出
しなければ誤り検出動作を終了し、質問器とデータのや
りとりを行なうのを待つ。
【００１８】メインメモリ１０またはサブメモリ１１の
いずれかのメモリで誤りを検出した場合には、質問器と
データのやりとりを行なうかを判別し、動作中でなけれ
ばデータの補正を行なう。そして、すべてのエラーにつ
いてデータの補正をしたかを判別し、その途中で実プロ
グラムが動作中になると補正結果を記憶し、一連の動作
を終了する。
いずれかのメモリで誤りを検出した場合には、質問器と
データのやりとりを行なうかを判別し、動作中でなけれ
ばデータの補正を行なう。そして、すべてのエラーにつ
いてデータの補正をしたかを判別し、その途中で実プロ
グラムが動作中になると補正結果を記憶し、一連の動作
を終了する。
【００１９】なお、上述の実施形態では、起動時の質問
器とデータのやりとりを行なっていないときに、データ
の誤り検出を行なうようにしたが、これに限ることなく
起動時以外の質問器とデータのみやりとりを行なってい
ない期間に、メインメモリ１０またはサブメモリ１１の
データの誤り検出およびデータの補正を行なうようにし
てもよい。
器とデータのやりとりを行なっていないときに、データ
の誤り検出を行なうようにしたが、これに限ることなく
起動時以外の質問器とデータのみやりとりを行なってい
ない期間に、メインメモリ１０またはサブメモリ１１の
データの誤り検出およびデータの補正を行なうようにし
てもよい。
【００２０】
【発明の効果】以上のように、この発明によれば、本来
の不揮発性記憶手段の非選択時にデータの誤り検出およ
びデータの補正を行なうようにしたので、実際の通信時
間を変更することなく行なうことができ、実時間を短縮
できる。
の不揮発性記憶手段の非選択時にデータの誤り検出およ
びデータの補正を行なうようにしたので、実際の通信時
間を変更することなく行なうことができ、実時間を短縮
できる。
【図１】この発明の一実施形態を示すブロック図であ
る。
る。
【図２】図１に示した誤り検出回路のブロック図であ
る。
る。
【図３】質問器とＩＣカードのシーケンスを示す図であ
る。
る。
【図４】この発明の一実施形態の動作を説明するための
フローチャートである。
フローチャートである。
１ 同調回路 ２ 整流回路 ３ 増幅復調部 ４ 変調増幅部 ５ Ｓ／Ｐ変換部 ６ Ｐ／Ｓ変換部 ７ 主制御部 ８，９ セレクタ １０ メインメモリ １１ サブメモリ １２，１３ 誤り検出回路 １６，１７ 誤り補正回路
Claims (3)
- 【請求項１】 質問器とデータのやり取りを行なうＩＣ
カードにおいて、 前記質問器からのデータを記憶する不揮発性記憶手段
と、 前記不揮発性記憶手段の非選択時に前記不揮発性記憶手
段に記憶されているデータの誤りを検出する誤り検出手
段を備えた、ＩＣカード。 - 【請求項２】 さらに、前記不揮発性記憶手段に記憶さ
れているデータと同じデータまたは１対１に対応が行な
えるデータを記憶する予備不揮発性記憶手段を含み、 前記誤り検出手段は前記不揮発性記憶手段または前記予
備不揮発性記憶手段に記憶されているデータの誤りを検
出することを特徴とする、請求項１のＩＣカード。 - 【請求項３】 前記誤り検出手段は誤り検出結果に基づ
いて、前記不揮発性記憶手段または前記予備不揮発性記
憶手段に記憶しているデータを補正することを特徴とす
る、請求項１のＩＣカード。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8348226A JPH10187551A (ja) | 1996-12-26 | 1996-12-26 | Ｉｃカード |
| AU78928/98A AU7892898A (en) | 1996-12-26 | 1997-12-18 | IC card |
| PCT/JP1997/004691 WO1998029814A1 (fr) | 1996-12-26 | 1997-12-18 | Carte a circuit integre |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8348226A JPH10187551A (ja) | 1996-12-26 | 1996-12-26 | Ｉｃカード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10187551A true JPH10187551A (ja) | 1998-07-21 |
Family
ID=18395600
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8348226A Pending JPH10187551A (ja) | 1996-12-26 | 1996-12-26 | Ｉｃカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10187551A (ja) |
-
1996
- 1996-12-26 JP JP8348226A patent/JPH10187551A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20050118 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050310 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20050412 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050607 |
|
| A911 | Transfer of reconsideration by examiner before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20050620 |
|
| A912 | Removal of reconsideration by examiner before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A912 Effective date: 20050722 |