JPH10135828A - Ａ／ｄ変換装置 - Google Patents
Ａ／ｄ変換装置Info
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- JPH10135828A JPH10135828A JP9294297A JP29429797A JPH10135828A JP H10135828 A JPH10135828 A JP H10135828A JP 9294297 A JP9294297 A JP 9294297A JP 29429797 A JP29429797 A JP 29429797A JP H10135828 A JPH10135828 A JP H10135828A
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
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- H03M1/1028—Calibration at two points of the transfer characteristic, i.e. by adjusting two reference values, e.g. offset and gain error
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- H03—ELECTRONIC CIRCUITRY
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- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/18—Automatic control for modifying the range of signals the converter can handle, e.g. gain ranging
- H03M1/181—Automatic control for modifying the range of signals the converter can handle, e.g. gain ranging in feedback mode, i.e. by determining the range to be selected from one or more previous digital output values
- H03M1/183—Automatic control for modifying the range of signals the converter can handle, e.g. gain ranging in feedback mode, i.e. by determining the range to be selected from one or more previous digital output values the feedback signal controlling the gain of an amplifier or attenuator preceding the analogue/digital converter
Abstract
(57)【要約】
【課題】 アナログ入力信号が増幅器の利得制御に影響
を及ぼすことのないＡ／Ｄ変換装置を提供する。 【解決手段】 本発明はアナログ入力信号Ｖｉｎの変換
により生ずるデジタル信号Ｖout(0:7)を出力側に供給す
るとともに出力信号Ｖout(0:7)との比較によって装置の
伝達特性を規定するために用いる制御信号ＣＲＳを受信
するＡ／Ｄ変換装置に関連する。かかる装置はアナログ
入力電圧Ｖｉｎが零の際に出力信号Ｖout(0:7)のデジタ
ル値を所定の値に調整せしめる基準モジュール（ＡＯ，
ＣＭＰ２）と、装置が制御モードにある際に所定値の基
準電圧Ｖｒｅｆを前記入力電圧Ｖｉｎと置換する手段
（Ｍｘ，Ｖａｃｔ）を具える。
を及ぼすことのないＡ／Ｄ変換装置を提供する。 【解決手段】 本発明はアナログ入力信号Ｖｉｎの変換
により生ずるデジタル信号Ｖout(0:7)を出力側に供給す
るとともに出力信号Ｖout(0:7)との比較によって装置の
伝達特性を規定するために用いる制御信号ＣＲＳを受信
するＡ／Ｄ変換装置に関連する。かかる装置はアナログ
入力電圧Ｖｉｎが零の際に出力信号Ｖout(0:7)のデジタ
ル値を所定の値に調整せしめる基準モジュール（ＡＯ，
ＣＭＰ２）と、装置が制御モードにある際に所定値の基
準電圧Ｖｒｅｆを前記入力電圧Ｖｉｎと置換する手段
（Ｍｘ，Ｖａｃｔ）を具える。
Description
【０００１】
【産業上の利用分野】本発明はアナログ入力電圧を受け
るアナログ入力端子と、調整信号を受ける入力端子と、
アナログ入力電圧の変換によるデジタル信号を供給する
デジタル出力端子戸を具えるＡ／Ｄ変換装置において、
出力端子および前記アナログ入力端子に接続された第１
信号入力端子および利得の変更を行う電圧を受けると共
に蓄積コンデンサを経て電力供給端子に接続された第２
利得制御入力端子を有する第１増幅器と、この増幅器の
出力端子側に接続されたアナログ入力端子および装置の
出力端子を構構成する出力端子を有するＡ／Ｄ変換器
と、イネーブル信号を受けるイネーブル入力端子を有
し、前記コンデンサの端子電圧を変化し得る蓄積コンデ
ンサ入力端子接続された第１可制御電流源および前記第
１増幅器の電圧を表わす信号および基準信号を比較する
と共に前記イネーブル信号が能動状態にある際に前記電
流源の導通を制御する信号を供給する第１比較器を具え
る調整モジュールとを有するＡ／Ｄ変換装置に関するも
のである。
るアナログ入力端子と、調整信号を受ける入力端子と、
アナログ入力電圧の変換によるデジタル信号を供給する
デジタル出力端子戸を具えるＡ／Ｄ変換装置において、
出力端子および前記アナログ入力端子に接続された第１
信号入力端子および利得の変更を行う電圧を受けると共
に蓄積コンデンサを経て電力供給端子に接続された第２
利得制御入力端子を有する第１増幅器と、この増幅器の
出力端子側に接続されたアナログ入力端子および装置の
出力端子を構構成する出力端子を有するＡ／Ｄ変換器
と、イネーブル信号を受けるイネーブル入力端子を有
し、前記コンデンサの端子電圧を変化し得る蓄積コンデ
ンサ入力端子接続された第１可制御電流源および前記第
１増幅器の電圧を表わす信号および基準信号を比較する
と共に前記イネーブル信号が能動状態にある際に前記電
流源の導通を制御する信号を供給する第１比較器を具え
る調整モジュールとを有するＡ／Ｄ変換装置に関するも
のである。
【０００２】
【従来の技術】この種装置はヨーロッパ特許出願公開第
0 271 936B1から既知である。このヨーロッパ特許出願
には、第１増幅器の利得を、この増幅器の、入力信号の
閾値に相当する出力信号の基準閾値の電圧レベルの識別
および制御に基づき制御するシステムが記載されてい
る。この増幅器の利得を充分に制御して出力信号のＡ／
Ｄ変換の結果が最大デジタル値と称されるある値以上と
ならないようにする。
0 271 936B1から既知である。このヨーロッパ特許出願
には、第１増幅器の利得を、この増幅器の、入力信号の
閾値に相当する出力信号の基準閾値の電圧レベルの識別
および制御に基づき制御するシステムが記載されてい
る。この増幅器の利得を充分に制御して出力信号のＡ／
Ｄ変換の結果が最大デジタル値と称されるある値以上と
ならないようにする。
【０００３】
【発明が解決しようとする課題】このシステムの欠点
は、電磁ノイズによりしばしば変化するビデオ信号タイ
プの基準閾値を有する信号によってのみシステムが作動
し得る点である。この基準閾値は極めて信頼性に乏し
く、増幅器の利得制御を危険にさらす用になる。さら
に、基準閾値を有さない信号のＡ／Ｄ変換はかかる装置
によっては不可能である。
は、電磁ノイズによりしばしば変化するビデオ信号タイ
プの基準閾値を有する信号によってのみシステムが作動
し得る点である。この基準閾値は極めて信頼性に乏し
く、増幅器の利得制御を危険にさらす用になる。さら
に、基準閾値を有さない信号のＡ／Ｄ変換はかかる装置
によっては不可能である。
【０００４】本発明の目的は、アナログ入力信号が増幅
器の利得制御に影響を及ぼさないＡ／Ｄ変換装置を提供
することによってかかる欠点を除去せんとするものであ
る。
器の利得制御に影響を及ぼさないＡ／Ｄ変換装置を提供
することによってかかる欠点を除去せんとするものであ
る。
【０００５】
【課題を解決するための手段】本発明はアナログ入力電
圧を受けるアナログ入力端子と、調整信号を受ける入力
端子と、アナログ入力電圧の変換によるデジタル信号を
供給するデジタル出力端子戸を具えるＡ／Ｄ変換装置に
おいて、出力端子および前記アナログ入力端子に接続さ
れた第１信号入力端子および利得の変更を行う電圧を受
けると共に蓄積コンデンサを経て電力供給端子に接続さ
れた第２利得制御入力端子を有する第１増幅器と、この
増幅器の出力端子側に接続されたアナログ入力端子およ
び装置の出力端子を構構成する出力端子を有するＡ／Ｄ
変換器と、イネーブル信号を受けるイネーブル入力端子
を有し、前記コンデンサの端子電圧を変化し得る蓄積コ
ンデンサ入力端子接続された第１可制御電流源および前
記第１増幅器の電圧を表わす信号および基準信号を比較
すると共に前記イネーブル信号が能動状態にある際に前
記電流源の導通を制御する信号を供給する第１比較器を
具える調整モジュールとを有するＡ／Ｄ変換装置におい
て、前記増幅器の信号入力端子の電圧が零の際にＡ／Ｄ
変換器の出力信号のデジタル値を所定の値に調整せしめ
る基準モジュールと、前記イネーブル信号が能動状態に
ある際に所定値の基準電圧を前記アナログ入力電圧と置
換する手段とを具えることを特徴とする。
圧を受けるアナログ入力端子と、調整信号を受ける入力
端子と、アナログ入力電圧の変換によるデジタル信号を
供給するデジタル出力端子戸を具えるＡ／Ｄ変換装置に
おいて、出力端子および前記アナログ入力端子に接続さ
れた第１信号入力端子および利得の変更を行う電圧を受
けると共に蓄積コンデンサを経て電力供給端子に接続さ
れた第２利得制御入力端子を有する第１増幅器と、この
増幅器の出力端子側に接続されたアナログ入力端子およ
び装置の出力端子を構構成する出力端子を有するＡ／Ｄ
変換器と、イネーブル信号を受けるイネーブル入力端子
を有し、前記コンデンサの端子電圧を変化し得る蓄積コ
ンデンサ入力端子接続された第１可制御電流源および前
記第１増幅器の電圧を表わす信号および基準信号を比較
すると共に前記イネーブル信号が能動状態にある際に前
記電流源の導通を制御する信号を供給する第１比較器を
具える調整モジュールとを有するＡ／Ｄ変換装置におい
て、前記増幅器の信号入力端子の電圧が零の際にＡ／Ｄ
変換器の出力信号のデジタル値を所定の値に調整せしめ
る基準モジュールと、前記イネーブル信号が能動状態に
ある際に所定値の基準電圧を前記アナログ入力電圧と置
換する手段とを具えることを特徴とする。
【０００６】
【作用】増幅器の利得が一定である場合には、出力信号
のデジタル値の発生に際しアナログ入力電圧の関数とし
て規定されるこの装置の伝達特性は直線性となる。この
特性の２つの作動点は装置の特性を規定するに充分であ
る。最初基準モジュールによって第１動作点を規定し、
しかも調整信号の値によって伝達特性の第２動作点の位
置を調整する。即ち、イネーブル信号が能動状態にある
際に、装置は、値が既知の基準電圧を増幅器の信号入力
端子に受ける調整モードに従って作動する。増幅器の利
得は蓄積コンデンサの両端間の電圧によって決まり、こ
の端子電圧は比較器が受ける信号が等しくなるように調
整する。これがため、調整信号の値の選択によってアナ
ログ入力電圧とは無関係に装置の作動を簡単に調整する
ことができる。
のデジタル値の発生に際しアナログ入力電圧の関数とし
て規定されるこの装置の伝達特性は直線性となる。この
特性の２つの作動点は装置の特性を規定するに充分であ
る。最初基準モジュールによって第１動作点を規定し、
しかも調整信号の値によって伝達特性の第２動作点の位
置を調整する。即ち、イネーブル信号が能動状態にある
際に、装置は、値が既知の基準電圧を増幅器の信号入力
端子に受ける調整モードに従って作動する。増幅器の利
得は蓄積コンデンサの両端間の電圧によって決まり、こ
の端子電圧は比較器が受ける信号が等しくなるように調
整する。これがため、調整信号の値の選択によってアナ
ログ入力電圧とは無関係に装置の作動を簡単に調整する
ことができる。
【０００７】本発明の一例では、デジタル形態の調整信
号に対して、前記第１比較器は、この調整信号を受ける
第１デジタル入力端子およびＡ／Ｄ変換器の出力側に接
続された第２デジタル入力端子を有するようにする。
号に対して、前記第１比較器は、この調整信号を受ける
第１デジタル入力端子およびＡ／Ｄ変換器の出力側に接
続された第２デジタル入力端子を有するようにする。
【０００８】調整信号を例えば抵抗に記憶し得るこの例
は、この抵抗の内容を再プログラミングすることによっ
て装置の再構成を容易にする。
は、この抵抗の内容を再プログラミングすることによっ
て装置の再構成を容易にする。
【０００９】制御信号と比較し得る信号は増幅によって
発生させる。これがため制御信号の値を修正することに
よって増幅器の利得が著しく変化する危険が生じる。従
ってこの利得の値を微調整制御するのが有利である。
発生させる。これがため制御信号の値を修正することに
よって増幅器の利得が著しく変化する危険が生じる。従
ってこの利得の値を微調整制御するのが有利である。
【００１０】本発明の変形例では、所定の一定電圧を受
ける第１電圧入力端子、制御信号を受ける第２制御入力
端子およびその値が前記制御信号により決まる電位差を
前記一定電圧に対し有する基準信号を供給する出力端子
を有する変化モデュールを更に具えるようにする。
ける第１電圧入力端子、制御信号を受ける第２制御入力
端子およびその値が前記制御信号により決まる電位差を
前記一定電圧に対し有する基準信号を供給する出力端子
を有する変化モデュールを更に具えるようにする。
【００１１】この変化モデュールによって基準電圧値を
変更し、かくして基準モードに対し得られた変化の振幅
を一定電圧の値に対し低くする。これがため、調整信号
によって達成された第２動作点を再び微調整することが
できる。
変更し、かくして基準モードに対し得られた変化の振幅
を一定電圧の値に対し低くする。これがため、調整信号
によって達成された第２動作点を再び微調整することが
できる。
【００１２】かかる変形例では，前記変化モジュール
は、前記一定電圧を受ける第１端子および可調整電流源
を有する第２電流源に接続され前記変化モジュールの出
力端子を構成する第２端子を有する抵抗と、前記変化モ
ジュールの制御入力端子を構成する前記第２電流源によ
り供給される電流の値を調整する信号を供給するアナロ
グ出力端子を有するＤ／Ａ変換器とを具えるようにす
る。
は、前記一定電圧を受ける第１端子および可調整電流源
を有する第２電流源に接続され前記変化モジュールの出
力端子を構成する第２端子を有する抵抗と、前記変化モ
ジュールの制御入力端子を構成する前記第２電流源によ
り供給される電流の値を調整する信号を供給するアナロ
グ出力端子を有するＤ／Ａ変換器とを具えるようにす
る。
【００１３】この例では、制御信号をレジスタに記憶す
ることができ、これによってレジスタの内容を再プログ
ラミングすることにより装置の再構成を容易に行うこと
ができる。
ることができ、これによってレジスタの内容を再プログ
ラミングすることにより装置の再構成を容易に行うこと
ができる。
【００１４】本発明の有利な例では、２つの抵抗間の各
接続点で基準コードを画成する変換器によって用いられ
る電圧を供給する抵抗ラダーをＡ／Ｄ変換器に設け、前
記基準モデュールは、 信号入力端子が零電位の箇所に
位置し、利得制御入力端子が所定電位の箇所に位置する
前記第１増幅器と同様の第２増幅器と、出力端子、第２
増幅器の出力側に接続された第１入力端子と、前記抵抗
ラダーの接続点のひとつに接続された第２入力端子とを
有する第２比較器と、前記第２比較器の出力側の電圧の
値によって決まる値のバイアス電流を前記抵抗ラダーを
経て供給する第３可制御電流源とを具えるようにする。
接続点で基準コードを画成する変換器によって用いられ
る電圧を供給する抵抗ラダーをＡ／Ｄ変換器に設け、前
記基準モデュールは、 信号入力端子が零電位の箇所に
位置し、利得制御入力端子が所定電位の箇所に位置する
前記第１増幅器と同様の第２増幅器と、出力端子、第２
増幅器の出力側に接続された第１入力端子と、前記抵抗
ラダーの接続点のひとつに接続された第２入力端子とを
有する第２比較器と、前記第２比較器の出力側の電圧の
値によって決まる値のバイアス電流を前記抵抗ラダーを
経て供給する第３可制御電流源とを具えるようにする。
【００１５】基準モデュールは基準ラダーをバイアスす
ることによって装置の第１動作点を簡単かつ信頼し得る
状態で本質的に規定することができる。抵抗ラダーを流
れるバイアスは絶えず制御して比較器に接続された接続
点の一つの抵抗ラダー内の位置によって決まる出力信号
の一定デジタル値に入力電圧の零値が対応し得るように
する。
ることによって装置の第１動作点を簡単かつ信頼し得る
状態で本質的に規定することができる。抵抗ラダーを流
れるバイアスは絶えず制御して比較器に接続された接続
点の一つの抵抗ラダー内の位置によって決まる出力信号
の一定デジタル値に入力電圧の零値が対応し得るように
する。
【００１６】
【実施例】図１は本発明によるＡ／Ｄ変換装置の一例を
示す。このＡ／Ｄ変換装置はアナログ入力電圧Ｖｉｎを
受けるアナログ入力端子と、第１レジスタＲＣから調整
信号ＣＲＳを受ける入力端子と、アナログ入力電圧Ｖｉ
ｎの変換により得られたデジタル信号Ｖout(0:7)を供給
するデジタル出力端子とを有する。
示す。このＡ／Ｄ変換装置はアナログ入力電圧Ｖｉｎを
受けるアナログ入力端子と、第１レジスタＲＣから調整
信号ＣＲＳを受ける入力端子と、アナログ入力電圧Ｖｉ
ｎの変換により得られたデジタル信号Ｖout(0:7)を供給
するデジタル出力端子とを有する。
【００１７】このＡ／Ｄ変換装置は、例えばギルバート
セルに基づき構成され、出力端子および前記アナログ入
力端子に接続された第１信号入力端子および増幅器の利
得の変更を行う電圧を受けると共に蓄積コンデンサＣｓ
を経て電力供給端子ＧＮＤに接続された第２利得制御入
力端子を有する第１増幅器ＡＧＣと、この増幅器ＡＧＣ
の出力端子側に接続されたアナログ入力端子および装置
の出力端子を構成する出力端子，本例では８ビットに符
号化された出力端子を有し、２つの抵抗間の各接続点に
変換器によって用いられ基準符号を規定する電圧を供給
する抵抗ラダーＬＤが設けられたＡ／Ｄ変換器ＡＤＣ
と、イネーブル信号Ｖａｃｔを受けるイネーブル入力端
子を有し、前記蓄積コンデンサＣｓに接続されその両端
の電圧を変化し得る第１可制御電流源Ｉｓおよび、出力
信号Ｖout(0:7)および調整信号ＣＲＳ間をデジタル比較
して前記イネーブル信号Ｖａｃｔが能動状態にある際に
可制御電流源Ｉｓの導通制御を行う信号を電荷ポンプＣ
Ｐに供給する第１比較器ＣＭＰ１を具える調整モジュー
ルと、を具える。また、Ａ／Ｄ変換装置は第１増幅器Ａ
ＧＣの信号入力端子に接続された出力端子、所定値の基
準電圧Ｖｒｅｆを受ける第１入力端子、アナログ入力電
圧Ｖｉｎを受ける第２データ入力端子およびイネーブル
信号Ｖａｃｔを受ける選択入力端子を具える。このマル
チプレクサによって、イネーブル信号Ｖａｃｔが能動状
態にある際に、即ち、調整モードにある際に、アナログ
入力電圧Ｖｉｎを基準電圧Ｖｒｅｆに置換する。更に、
Ａ／Ｄ変換装置は増幅器ＡＧＣの信号入力端子の電圧が
零の場合に変換器ＡＤＣの出力信号Ｖout(0:7)のデジタ
ル値を所定値に調整する基準モデュールを具える。
セルに基づき構成され、出力端子および前記アナログ入
力端子に接続された第１信号入力端子および増幅器の利
得の変更を行う電圧を受けると共に蓄積コンデンサＣｓ
を経て電力供給端子ＧＮＤに接続された第２利得制御入
力端子を有する第１増幅器ＡＧＣと、この増幅器ＡＧＣ
の出力端子側に接続されたアナログ入力端子および装置
の出力端子を構成する出力端子，本例では８ビットに符
号化された出力端子を有し、２つの抵抗間の各接続点に
変換器によって用いられ基準符号を規定する電圧を供給
する抵抗ラダーＬＤが設けられたＡ／Ｄ変換器ＡＤＣ
と、イネーブル信号Ｖａｃｔを受けるイネーブル入力端
子を有し、前記蓄積コンデンサＣｓに接続されその両端
の電圧を変化し得る第１可制御電流源Ｉｓおよび、出力
信号Ｖout(0:7)および調整信号ＣＲＳ間をデジタル比較
して前記イネーブル信号Ｖａｃｔが能動状態にある際に
可制御電流源Ｉｓの導通制御を行う信号を電荷ポンプＣ
Ｐに供給する第１比較器ＣＭＰ１を具える調整モジュー
ルと、を具える。また、Ａ／Ｄ変換装置は第１増幅器Ａ
ＧＣの信号入力端子に接続された出力端子、所定値の基
準電圧Ｖｒｅｆを受ける第１入力端子、アナログ入力電
圧Ｖｉｎを受ける第２データ入力端子およびイネーブル
信号Ｖａｃｔを受ける選択入力端子を具える。このマル
チプレクサによって、イネーブル信号Ｖａｃｔが能動状
態にある際に、即ち、調整モードにある際に、アナログ
入力電圧Ｖｉｎを基準電圧Ｖｒｅｆに置換する。更に、
Ａ／Ｄ変換装置は増幅器ＡＧＣの信号入力端子の電圧が
零の場合に変換器ＡＤＣの出力信号Ｖout(0:7)のデジタ
ル値を所定値に調整する基準モデュールを具える。
【００１８】この基準モデュールは、前記基準モデュー
ルは、零電位の信号入力端子および所定電位Ｖｇｃの利
得制御入力端子を有する前記第１増幅器ＡＧＣと同様の
第２増幅器ＡＯと、 出力端子、第２増幅器ＡＯの出力
側に接続された第１入力端子、前記抵抗ラダーＬＤの接
続点のひとつに接続された第２入力端子を有する第２比
較器ＣＭＰ２と、前記第２比較器ＣＭＰ２の出力側の電
圧の値によって決まる値のバイアス電流ＩＯを前記抵抗
ラダーＬＤを経て供給する第３可制御電流源とを具え
る。
ルは、零電位の信号入力端子および所定電位Ｖｇｃの利
得制御入力端子を有する前記第１増幅器ＡＧＣと同様の
第２増幅器ＡＯと、 出力端子、第２増幅器ＡＯの出力
側に接続された第１入力端子、前記抵抗ラダーＬＤの接
続点のひとつに接続された第２入力端子を有する第２比
較器ＣＭＰ２と、前記第２比較器ＣＭＰ２の出力側の電
圧の値によって決まる値のバイアス電流ＩＯを前記抵抗
ラダーＬＤを経て供給する第３可制御電流源とを具え
る。
【００１９】図示のＡ／Ｄ変換装置は前記一定電圧ＶＯ
を受ける第１端子および可調整電流源Ｉｒを有する電流
源に接続され基準電圧Ｖｒｅｆを供給する第２端子を有
する抵抗Ｒを具える。また、Ａ／Ｄ変換装置はレジスタ
から制御信号ＦＮＥを受けるデジタル入力端子および可
調整電流源Ｉｒの値を制御する信号を供給するアナログ
出力端子を具える。本例では、Ｄ／Ａ変換器ＤＡＣは４
ビットで符号化する。
を受ける第１端子および可調整電流源Ｉｒを有する電流
源に接続され基準電圧Ｖｒｅｆを供給する第２端子を有
する抵抗Ｒを具える。また、Ａ／Ｄ変換装置はレジスタ
から制御信号ＦＮＥを受けるデジタル入力端子および可
調整電流源Ｉｒの値を制御する信号を供給するアナログ
出力端子を具える。本例では、Ｄ／Ａ変換器ＤＡＣは４
ビットで符号化する。
【００２０】第２比較器ＣＭ２に接続された抵抗ラダー
ＬＤの接続点を、本例では、抵抗ラダーの半分の箇所に
位置させる。Ａ／Ｄ変換器ＡＤＣの出力を８ビットで符
号化資、従って符号に関しては２５６個の異なる値を取
り得るため、この点によって符号１２８を規定する。こ
の点の電位は第２増幅器ＡＯの入力側の零値に相当する
ため、これを増幅器ＡＧＣのレプリカとする。従って、
アナログ入力電圧Ｖｉｎが零である場合には、Ａ／Ｄ変
換器ＡＤＣの出力側に得られる符号は符号１２８とな
る。入力電圧Ｖｉｎが負である場合には、出力側入力得
られる符号は符号１２８よりも小さくなり、入力電圧Ｖ
ｉｎが正である場合には、出力側入力得られる符号は符
号１２８よりも大きくなる。これら後者の２つの場合に
は、符号の値は第１増幅器ＡＧＣの利得値の関数とな
る：即ち、調整信号ＣＲＳは最小値ＣＲＳｍｉｎおよび
最大値ＣＲＳｍａｘ間の値のある数と見なすことができ
る。同一の基準電圧Ｖｒｅｆに対しては調整信号ＣＲＳ
のあた値を高い値に変化させて装置が調整モードにある
際に次の影響が生ずるようにする。即ち、Ａ／Ｄ変換器
ＡＤＣの出力信号Ｖout(0:7)を調整信号ＣＲＳの値より
も小さくして、比較器ＣＭＰ１の出力が電荷ポンプＣＰ
に作用してイネーブル信号Ｖａｃｔが能動状態にある際
に電流源Ｉｓが電流を蓄積コンデンサＣｓに注入し得る
ようにする。蓄積コンデンサＣｓの両端間の電圧が増大
すると、増幅器ＡＧＣの利得も出力信号Ｖout(0:7)およ
び調整信号ＣＲＳの値が等しくなるまで増大し、これに
より装置の伝達特性を修正し、従って、その特性を再規
定し得るようにする。基準電圧を変化しないように保持
することによって調整信号ＣＲＳの２つの順次の値に対
して得られた２つの符号を分離する符号の数を規定し得
る調整信号ＣＲＳの値を変化させることによって得られ
る変化ギャップは重要である。このギャップを減少する
とともに基準電圧Ｖｒｅｆを変化させて伝達特性の規定
を改善することは重要であり、これを本例ではＤ／Ａ変
換器ＤＡＣによって達成する。かくして得られた変化の
振幅は一定電圧ＶＯの値に対して低く保持される。制御
信号ＦＮＥは０および１５間の１６の異なる値を採るも
のとし、これによって多くの異なる値とし得る電流Ｉｒ
の導通を制御する。抵抗Ｒを流れるこの電流Ｉｒによっ
てこの抵抗の両端間に制御信号ＦＮＥのデジタル値に直
接依存する値の電圧降下を発生する。この値が０の場合
には、制御モジュールによって得られた利得は変化しな
い。この値が０以外の値である場合には、基準電圧Ｖｒ
ｅｆが増大し、出力信号Ｖout(0:7)のデジタル値が減少
する。この例では調整信号ＣＲＳの値が変化しないの
で、比較器ＣＭＰ１によって電流Ｉｓの蓄積コンデンサ
Ｃｓへの注入を制御し、従って第１比較器ＣＭＰ１の入
力信号が等しくなるまで、増幅器ＡＧＣの利得を増大す
る。
ＬＤの接続点を、本例では、抵抗ラダーの半分の箇所に
位置させる。Ａ／Ｄ変換器ＡＤＣの出力を８ビットで符
号化資、従って符号に関しては２５６個の異なる値を取
り得るため、この点によって符号１２８を規定する。こ
の点の電位は第２増幅器ＡＯの入力側の零値に相当する
ため、これを増幅器ＡＧＣのレプリカとする。従って、
アナログ入力電圧Ｖｉｎが零である場合には、Ａ／Ｄ変
換器ＡＤＣの出力側に得られる符号は符号１２８とな
る。入力電圧Ｖｉｎが負である場合には、出力側入力得
られる符号は符号１２８よりも小さくなり、入力電圧Ｖ
ｉｎが正である場合には、出力側入力得られる符号は符
号１２８よりも大きくなる。これら後者の２つの場合に
は、符号の値は第１増幅器ＡＧＣの利得値の関数とな
る：即ち、調整信号ＣＲＳは最小値ＣＲＳｍｉｎおよび
最大値ＣＲＳｍａｘ間の値のある数と見なすことができ
る。同一の基準電圧Ｖｒｅｆに対しては調整信号ＣＲＳ
のあた値を高い値に変化させて装置が調整モードにある
際に次の影響が生ずるようにする。即ち、Ａ／Ｄ変換器
ＡＤＣの出力信号Ｖout(0:7)を調整信号ＣＲＳの値より
も小さくして、比較器ＣＭＰ１の出力が電荷ポンプＣＰ
に作用してイネーブル信号Ｖａｃｔが能動状態にある際
に電流源Ｉｓが電流を蓄積コンデンサＣｓに注入し得る
ようにする。蓄積コンデンサＣｓの両端間の電圧が増大
すると、増幅器ＡＧＣの利得も出力信号Ｖout(0:7)およ
び調整信号ＣＲＳの値が等しくなるまで増大し、これに
より装置の伝達特性を修正し、従って、その特性を再規
定し得るようにする。基準電圧を変化しないように保持
することによって調整信号ＣＲＳの２つの順次の値に対
して得られた２つの符号を分離する符号の数を規定し得
る調整信号ＣＲＳの値を変化させることによって得られ
る変化ギャップは重要である。このギャップを減少する
とともに基準電圧Ｖｒｅｆを変化させて伝達特性の規定
を改善することは重要であり、これを本例ではＤ／Ａ変
換器ＤＡＣによって達成する。かくして得られた変化の
振幅は一定電圧ＶＯの値に対して低く保持される。制御
信号ＦＮＥは０および１５間の１６の異なる値を採るも
のとし、これによって多くの異なる値とし得る電流Ｉｒ
の導通を制御する。抵抗Ｒを流れるこの電流Ｉｒによっ
てこの抵抗の両端間に制御信号ＦＮＥのデジタル値に直
接依存する値の電圧降下を発生する。この値が０の場合
には、制御モジュールによって得られた利得は変化しな
い。この値が０以外の値である場合には、基準電圧Ｖｒ
ｅｆが増大し、出力信号Ｖout(0:7)のデジタル値が減少
する。この例では調整信号ＣＲＳの値が変化しないの
で、比較器ＣＭＰ１によって電流Ｉｓの蓄積コンデンサ
Ｃｓへの注入を制御し、従って第１比較器ＣＭＰ１の入
力信号が等しくなるまで、増幅器ＡＧＣの利得を増大す
る。
【００２１】図２はかかる装置に対応する種々の伝達関
数を示す。符号１２８を一定とし、これは、第１増幅器
ＡＧＣの利得値に係わりなく零アナログ入力電圧Ｖｉｎ
に対応する。４つの特定の場合をここに示す：即ち、実
線Ｄ１は調整信号ＣＲＳが最小値ＣＲＳｍｉｎを有し、
制御信号ＦＮＥの値が零の場合に相当する。このとき、
増幅器ＡＧＣの利得は最小となる。実線Ｄ２は制御信号
ＦＮＥの値は調整信号ＣＲＳが１５でその最大値であ
り、しかも調整信号ＣＲＳの値がいまだＣＲＳｍｉｎで
ある場合に相当する。これら実線を分離する面は微細な
ギャップで制御信号ＦＮＥの値を０および１５間で変化
させることによって走査することができる。調整信号Ｃ
ＲＳがその最大値ＣＲＳｍａｘを有し、制御信号ＦＮＥ
が零値を有する場合に相当する。実線Ｄ３は調整信号Ｃ
ＲＳがその最大値ＣＲＳｍａｘを有し、制御信号ＦＮＥ
が零値を有する場合に相当する。実線Ｄ４は調整信号Ｃ
ＲＳがいまだその最大値ＣＲＳｍａｘを有し、制御信号
ＦＮＥの値が１５でその最大値にある場合に相当する。
従って、増幅器ＡＧＣの利得はその最大値にある。これ
ら実線を分離する面は微細なギャップで制御信号ＦＮＥ
の値を０および１５間で変化させることによって走査す
ることができる。
数を示す。符号１２８を一定とし、これは、第１増幅器
ＡＧＣの利得値に係わりなく零アナログ入力電圧Ｖｉｎ
に対応する。４つの特定の場合をここに示す：即ち、実
線Ｄ１は調整信号ＣＲＳが最小値ＣＲＳｍｉｎを有し、
制御信号ＦＮＥの値が零の場合に相当する。このとき、
増幅器ＡＧＣの利得は最小となる。実線Ｄ２は制御信号
ＦＮＥの値は調整信号ＣＲＳが１５でその最大値であ
り、しかも調整信号ＣＲＳの値がいまだＣＲＳｍｉｎで
ある場合に相当する。これら実線を分離する面は微細な
ギャップで制御信号ＦＮＥの値を０および１５間で変化
させることによって走査することができる。調整信号Ｃ
ＲＳがその最大値ＣＲＳｍａｘを有し、制御信号ＦＮＥ
が零値を有する場合に相当する。実線Ｄ３は調整信号Ｃ
ＲＳがその最大値ＣＲＳｍａｘを有し、制御信号ＦＮＥ
が零値を有する場合に相当する。実線Ｄ４は調整信号Ｃ
ＲＳがいまだその最大値ＣＲＳｍａｘを有し、制御信号
ＦＮＥの値が１５でその最大値にある場合に相当する。
従って、増幅器ＡＧＣの利得はその最大値にある。これ
ら実線を分離する面は微細なギャップで制御信号ＦＮＥ
の値を０および１５間で変化させることによって走査す
ることができる。
【００２２】図２は装置の伝達特性を著しく変化させる
ために、信号ＣＲＳを８ビットで符号化する必要のない
場合を示す。これがため、比較器ＣＭＰ１の複雑性を減
少し、従って、その実現に必要な面を減少させることが
できる。他方、上述した例において、比較器ＣＭＰ1に
よってＡ／Ｄ変換器ＡＤＣの出力信号Ｖout(0:7)と調整
信号ＣＲＳとをデジタル比較し、発明の要旨を変更せ
ず、当業者の容易な実施の範囲内にある他の例において
は、第１比較器ＡＧＣのアナログ出力とアナログ調整信
号とをアナログ形態の比較器ＣＭＰ１により比較するこ
とができる。同様に、この場合に処理されたアナログ信
号が非対称信号である場合には当業者は装置を僅かに変
更して非対称信号を処理することができる。
ために、信号ＣＲＳを８ビットで符号化する必要のない
場合を示す。これがため、比較器ＣＭＰ１の複雑性を減
少し、従って、その実現に必要な面を減少させることが
できる。他方、上述した例において、比較器ＣＭＰ1に
よってＡ／Ｄ変換器ＡＤＣの出力信号Ｖout(0:7)と調整
信号ＣＲＳとをデジタル比較し、発明の要旨を変更せ
ず、当業者の容易な実施の範囲内にある他の例において
は、第１比較器ＡＧＣのアナログ出力とアナログ調整信
号とをアナログ形態の比較器ＣＭＰ１により比較するこ
とができる。同様に、この場合に処理されたアナログ信
号が非対称信号である場合には当業者は装置を僅かに変
更して非対称信号を処理することができる。
【図１】本発明Ａ／Ｄ変換装置の構成を部分的に示す説
明図である。
明図である。
【図２】Ａ／Ｄ変換装置の伝達特性を示す説明図であ
る。
る。
ＣＲＳ、 調整信号 ＡＧＣ、 増幅器 ＡＤＣ、 Ａ／Ｄ変換器 ＬＤ， 抵抗ラダー Ｃｓ， 蓄積コンデンサ ＣＭＰ， 比較器 ＣＰ， 電荷コンデンサ Ｖｉｎ， アナログ入力電圧 ＡＯ， 増幅器 ＤＡＣ， Ｄ／Ａ変換器
Claims (5)
- 【請求項１】 アナログ入力電圧を受けるアナログ入力
端子と、調整信号を受ける入力端子と、アナログ入力電
圧の変換によるデジタル信号を供給するデジタル出力端
子戸を具えるＡ／Ｄ変換装置において、 出力端子および前記アナログ入力端子に接続された第１
信号入力端子および利得の変更を行う電圧を受けると共
に蓄積コンデンサを経て電力供給端子に接続された第２
利得制御入力端子を有する第１増幅器と、 この増幅器の出力端子側に接続されたアナログ入力端子
および装置の出力端子を構構成する出力端子を有するＡ
／Ｄ変換器と、 イネーブル信号を受けるイネーブル入力端子を有し、前
記コンデンサの端子電圧を変化し得る蓄積コンデンサに
接続された第１可制御電流源および前記第１増幅器の電
圧を表わす信号および基準信号を比較すると共に前記イ
ネーブル信号が能動状態にある際に前記電流源の導通を
制御する信号を供給する第１比較器を具える調整モジュ
ールとを有するＡ／Ｄ変換装置において、 前記増幅器の信号入力端子の電圧が零の際にＡ／Ｄ変換
器の出力信号のデジタル値を所定の値に調整せしめる基
準モジュールと、 前記イネーブル信号が能動状態にある際に所定値の基準
電圧を前記アナログ入力電圧と置換する手段とを具える
ことを特徴とするＡ／Ｄ変換装置。 - 【請求項２】 デジタル形態の調整信号に対して、前記
第１比較器は、この調整信号を受ける第１デジタル入力
端子およびＡ／Ｄ変換器の出力側に接続された第２デジ
タル入力端子を有することを特徴とする請求項１に記載
のＡ／Ｄ変換装置。 - 【請求項３】 所定の一定電圧を受ける第１電圧入力端
子、制御信号を受ける第２制御入力端子およびその値が
前記制御信号により決まる電位差を前記一定電圧に対し
有する基準信号を供給する出力端子を有する変化モデュ
ールを更に具えることを特徴とする請求項１または２に
記載のＡ／Ｄ変換装置。 - 【請求項４】 前記変化モジュールは、前記一定電圧を
受ける第１端子および可調整電流源を有する第２電流源
に接続され前記変化モジュールの出力端子を構成する第
２端子を有する抵抗と、前記変化モジュールの制御入力
端子を構成する前記第２電流源により供給される電流の
値を調整する信号を供給するアナログ出力端子を有する
Ｄ／Ａ変換器とを具えることを特徴とする請求項３に記
載のＡ／Ｄ変換装置。 - 【請求項５】 ２つの抵抗間の各接続点で基準コードを
画成する変換器によって用いられる電圧を供給する抵抗
ラダーをＡ／Ｄ変換器に設け、前記基準モデュールは、
信号入力端子が零電位の箇所に位置し、利得制御入力
端子が所定電位の箇所に位置する前記第１増幅器と同様
の第２増幅器と、 出力端子、第２増幅器の出力側に接続された第１入力端
子と、前記抵抗ラダーの接続点のひとつに接続された第
２入力端子とを有する第２比較器と、 前記第２比較器の出力側の電圧の値によって決まる値の
バイアス電流を前記抵抗ラダーを経て供給する第３可制
御電流源とを具えることを特徴とする請求項１〜４の何
れかの項に記載のＡ／Ｄ変換装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR9613067 | 1996-10-25 | ||
| FR9613067A FR2755325A1 (fr) | 1996-10-25 | 1996-10-25 | Dispositif de conversion analogique/numerique a caracteristique de transfert programmable |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10135828A true JPH10135828A (ja) | 1998-05-22 |
Family
ID=9497049
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9294297A Pending JPH10135828A (ja) | 1996-10-25 | 1997-10-27 | Ａ／ｄ変換装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5990817A (ja) |
| EP (1) | EP0838904A1 (ja) |
| JP (1) | JPH10135828A (ja) |
| FR (1) | FR2755325A1 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6384638B1 (en) * | 1998-12-21 | 2002-05-07 | Sony Corporation | Differential charge pump for providing a low charge pump current |
| US6617991B2 (en) * | 2001-04-11 | 2003-09-09 | International Business Machines Corporation | Structure for adjusting gain in a flash analog to digital converter |
| DE102015212842A1 (de) | 2015-07-09 | 2017-01-12 | Forschungszentrum Jülich GmbH | Spannungsverstärker für einen programmierbaren Spannungsbereich |
| FR3066060B1 (fr) | 2017-05-03 | 2020-03-27 | Stmicroelectronics (Rousset) Sas | Commande d'alimentation a decoupage |
| FR3066061B1 (fr) * | 2017-05-03 | 2019-06-21 | Stmicroelectronics (Rousset) Sas | Convertisseur numerique-analogique |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5873231A (ja) * | 1981-10-27 | 1983-05-02 | Shimadzu Corp | Ａｄ変換装置 |
| JPS637024A (ja) * | 1986-06-27 | 1988-01-12 | Fujitsu Ltd | 自動ドリフト制御回路 |
| FR2606956A1 (fr) * | 1986-11-14 | 1988-05-20 | Radiotechnique Compelec | Dispositif de conversion analogique-numerique comportant un dispositif de controle automatique de gain |
| DE3710291A1 (de) * | 1987-03-28 | 1988-10-13 | Thomson Brandt Gmbh | Schaltung zur analog/digital-wandlung von signalen unterschiedlicher pegel |
| JPS63311806A (ja) * | 1987-06-15 | 1988-12-20 | Victor Co Of Japan Ltd | 自動利得制御方式 |
| US5343200A (en) * | 1990-08-31 | 1994-08-30 | Canon Kabushiki Kaisha | Analog/digital converter with digital automatic gain control |
| CH688459A5 (de) * | 1992-02-04 | 1997-09-30 | Ascom Audiosys Ag | Verfahren zur Digitalisierung eines Signals, Verarbeitungseinheit zu dessen Ausfuehrung |
| US5608399A (en) * | 1995-08-01 | 1997-03-04 | Psc Inc. | Resolution enhancer circuit for analog to digital converters |
-
1996
- 1996-10-25 FR FR9613067A patent/FR2755325A1/fr not_active Withdrawn
-
1997
- 1997-10-14 EP EP97203200A patent/EP0838904A1/fr not_active Withdrawn
- 1997-10-23 US US08/956,819 patent/US5990817A/en not_active Expired - Fee Related
- 1997-10-27 JP JP9294297A patent/JPH10135828A/ja active Pending
Also Published As
| Publication number | Publication date |
|---|---|
| FR2755325A1 (fr) | 1998-04-30 |
| US5990817A (en) | 1999-11-23 |
| EP0838904A1 (fr) | 1998-04-29 |
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