JPH10108212A - カラーエンコーダ用マトリックス装置および信号合成方法 - Google Patents
カラーエンコーダ用マトリックス装置および信号合成方法Info
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- JPH10108212A JPH10108212A JP8275555A JP27555596A JPH10108212A JP H10108212 A JPH10108212 A JP H10108212A JP 8275555 A JP8275555 A JP 8275555A JP 27555596 A JP27555596 A JP 27555596A JP H10108212 A JPH10108212 A JP H10108212A
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Abstract
(57)【要約】
【課題】 デジタル方式のカラーエンコーダ用マトリッ
クス回路において、回路規模を削減し、ＩＣ化を容易に
しかつ低価格化を図る。 【解決手段】 ３原色信号Ｒ，Ｇ，Ｂから、輝度信号Ｙ
と色差信号Ｒ−Ｙ，Ｂ−Ｙを合成するカラーエンコーダ
用マトリックス装置において、３原色信号から第１およ
び第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇを生成し、第１，第
２の引き算信号にかかる合成係数のうち、それぞれに最
小のものを使用して第１，第２の最小常数かけ算信号
０．３（Ｒ−Ｇ），０．１１（Ｂ−Ｇ）を生成し、前記
第１，第２の引き算信号からそれぞれ前記第１，第２の
最小常数かけ算信号を引き算して第３，第４の常数かけ
算信号（１−０．３）（Ｒ−Ｇ），（１−０．１１）
（Ｂ−Ｇ）を生成し、第１，第２の最小常数かけ算信号
と第３，第４の常数かけ算信号と前記他の１色の色信号
との加減算で輝度信号と色差信号とを得る。
クス回路において、回路規模を削減し、ＩＣ化を容易に
しかつ低価格化を図る。 【解決手段】 ３原色信号Ｒ，Ｇ，Ｂから、輝度信号Ｙ
と色差信号Ｒ−Ｙ，Ｂ−Ｙを合成するカラーエンコーダ
用マトリックス装置において、３原色信号から第１およ
び第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇを生成し、第１，第
２の引き算信号にかかる合成係数のうち、それぞれに最
小のものを使用して第１，第２の最小常数かけ算信号
０．３（Ｒ−Ｇ），０．１１（Ｂ−Ｇ）を生成し、前記
第１，第２の引き算信号からそれぞれ前記第１，第２の
最小常数かけ算信号を引き算して第３，第４の常数かけ
算信号（１−０．３）（Ｒ−Ｇ），（１−０．１１）
（Ｂ−Ｇ）を生成し、第１，第２の最小常数かけ算信号
と第３，第４の常数かけ算信号と前記他の１色の色信号
との加減算で輝度信号と色差信号とを得る。
Description
【０００１】
【発明の属する技術分野】本発明は、カラーエンコーダ
用マトリックス装置および信号合成方法に関し、特に必
要最小限のかけ算器とデジタル回路で比較的実現しやす
い加減算回路を使用することにより、マトリックス装置
の回路規模を削減しＩＣ化を容易にする技術に関する。
用マトリックス装置および信号合成方法に関し、特に必
要最小限のかけ算器とデジタル回路で比較的実現しやす
い加減算回路を使用することにより、マトリックス装置
の回路規模を削減しＩＣ化を容易にする技術に関する。
【０００２】
【従来の技術】例えばテレビカメラのカラー信号エンコ
ーダ部に使用するマトリックス回路は、ＮＴＳＣ方式の
場合は赤信号（Ｒ）、緑信号（Ｇ）、青信号（Ｂ）の各
色信号から、輝度信号（Ｙ）と２つの色差信号（Ｒ−
Ｙ），（Ｂ−Ｙ）もしくは２つの色差信号を比較化した
信号（Ｃｒ，Ｃｂ）とに変換する回路である。
ーダ部に使用するマトリックス回路は、ＮＴＳＣ方式の
場合は赤信号（Ｒ）、緑信号（Ｇ）、青信号（Ｂ）の各
色信号から、輝度信号（Ｙ）と２つの色差信号（Ｒ−
Ｙ），（Ｂ−Ｙ）もしくは２つの色差信号を比較化した
信号（Ｃｒ，Ｃｂ）とに変換する回路である。
【０００３】このようなマトリックス回路によって行な
われる変換処理は次のような数式で表わすことができ
る。
われる変換処理は次のような数式で表わすことができ
る。
【数１】 Ｙ＝ ０．３Ｒ＋０．５９Ｇ＋０．１１Ｂ Ｒ−Ｙ＝ １．４Ｃｒ＝ ０．７Ｒ−０．５９Ｇ−０．１１Ｂ Ｂ−Ｙ＝１．７８Ｃｂ＝０．８９Ｂ−０．５９Ｇ− ０．３Ｒ
【０００４】このような数式１を使用して輝度信号Ｙお
よび色差信号Ｒ−Ｙ，Ｂ−Ｙを求めるためには、各色信
号に常数０．３，０．５９，０．１１，０．７，０．８
９をかけ算するための常数かけ算回路５個と符号つき足
し算回路を必要とする。さらに、２つの色差信号Ｒ−
Ｙ，Ｂ−Ｙを規格化した信号Ｃｒ，Ｃｂを得るためにさ
らに２つの常数かけ算回路を必要とする。
よび色差信号Ｒ−Ｙ，Ｂ−Ｙを求めるためには、各色信
号に常数０．３，０．５９，０．１１，０．７，０．８
９をかけ算するための常数かけ算回路５個と符号つき足
し算回路を必要とする。さらに、２つの色差信号Ｒ−
Ｙ，Ｂ−Ｙを規格化した信号Ｃｒ，Ｃｂを得るためにさ
らに２つの常数かけ算回路を必要とする。
【０００５】必要なかけ算回路の数を低減するために前
記数式１を次のように書き換えることが知られている。
記数式１を次のように書き換えることが知られている。
【数２】 Ｙ＝Ｇ＋０．３（Ｒ−Ｇ）＋０．１１（Ｂ−Ｇ） Ｒ−Ｙ＝ ０．７（Ｒ−Ｇ）−０．１１（Ｂ−Ｇ） Ｂ−Ｙ＝ −０．３（Ｒ−Ｇ）＋０．８９（Ｂ−Ｇ）
【０００６】この数式を使用することにより、かけ算す
べき常数の種類が少なくなり、したがって常数かけ算回
路の数が前記数式１による場合よりも１個少なく４個に
削減される。また、各色信号の差信号を使用して常数か
け算を行なうため、誤差信号が出にくく、信号処理がし
やすくなる。このような信号処理は、アナログ信号処理
の場合は引き算回路として差動増幅器が使用され、かつ
常数かけ算器は各信号のゲインを変えれば済むので比較
的実現しやすく、ＩＣ化も容易であった。
べき常数の種類が少なくなり、したがって常数かけ算回
路の数が前記数式１による場合よりも１個少なく４個に
削減される。また、各色信号の差信号を使用して常数か
け算を行なうため、誤差信号が出にくく、信号処理がし
やすくなる。このような信号処理は、アナログ信号処理
の場合は引き算回路として差動増幅器が使用され、かつ
常数かけ算器は各信号のゲインを変えれば済むので比較
的実現しやすく、ＩＣ化も容易であった。
【０００７】
【発明が解決しようとする課題】しかしながら、前記数
式２を使用してマトリックス回路を実現する場合でも、
前述のように４種類の常数かけ算器が必要となる。特に
デジタル回路でマトリックス回路を実現する場合には、
デジタル方式のかけ算器は一般にアナログ方式のかけ算
器に比べて複雑になるため、マトリックス回路全体とし
て回路規模がかなり大きくなり、ＩＣ化に際してＩＣ基
板上の大きな面積を占有するという不都合があった。
式２を使用してマトリックス回路を実現する場合でも、
前述のように４種類の常数かけ算器が必要となる。特に
デジタル回路でマトリックス回路を実現する場合には、
デジタル方式のかけ算器は一般にアナログ方式のかけ算
器に比べて複雑になるため、マトリックス回路全体とし
て回路規模がかなり大きくなり、ＩＣ化に際してＩＣ基
板上の大きな面積を占有するという不都合があった。
【０００８】本発明の目的は、前述の従来例の装置にお
ける問題点に鑑み、デジタル方式のマトリックス回路に
おいて、常数かけ算回路の数をさらに低減しかつかけ算
すべき常数の値を小さな値とすることができるようにし
て、回路規模を削減し少ない占有面積で容易にＩＣ化で
きるようにすることにある。
ける問題点に鑑み、デジタル方式のマトリックス回路に
おいて、常数かけ算回路の数をさらに低減しかつかけ算
すべき常数の値を小さな値とすることができるようにし
て、回路規模を削減し少ない占有面積で容易にＩＣ化で
きるようにすることにある。
【０００９】
【課題を解決するための手段】本発明では、例えばＮＴ
ＳＣ方式の場合、前記数式２を次のように書き換える。
ＳＣ方式の場合、前記数式２を次のように書き換える。
【数３】 Ｙ＝ Ｇ＋０．３（Ｒ−Ｇ） ＋０．１１（Ｂ−Ｇ） Ｒ−Ｙ＝（１−０．３）（Ｒ−Ｇ） −０．１１（Ｂ−Ｇ） Ｂ−Ｙ＝ −０．３（Ｒ−Ｇ）＋（１−０．１１）（Ｂ−Ｇ）
【００１０】数式３において、輝度信号Ｙについては前
記数式２のものと同じであるが、２つの色差信号Ｒ−
Ｙ，Ｂ−Ｙについては、常数０．７を（１−０．３）で
置き換え、かつ常数０．８９は（１−０．１１）で置き
換えている。これによって、常数の数が前記数式２では
４種類であったのに対し、数式３では２種類のみとなっ
ている。すなわち、前記数式２における４つの常数の
内、加算すると１になる２組の常数があることに着目
し、数式３を得ることができる。
記数式２のものと同じであるが、２つの色差信号Ｒ−
Ｙ，Ｂ−Ｙについては、常数０．７を（１−０．３）で
置き換え、かつ常数０．８９は（１−０．１１）で置き
換えている。これによって、常数の数が前記数式２では
４種類であったのに対し、数式３では２種類のみとなっ
ている。すなわち、前記数式２における４つの常数の
内、加算すると１になる２組の常数があることに着目
し、数式３を得ることができる。
【００１１】すなわち加算すると１になる１組の常数
０．３および０．７の内大きい方の常数０．７は小さい
方の常数０．３を使用して（１−０．３）の演算で実現
し、他の１組の加算すると１になる常数０．１１および
０．８９の内大きい方の常数０．８９は小さい方の常数
０．１１を使用して（１−０．１１）の演算で実現す
る。これによって、０．３（Ｒ−Ｇ）と０．１１（Ｂ−
Ｇ）の部分にのみ常数かけ算器を使用し、後は符号つき
足し算回路を使用することによりマトリックス回路を実
現できることが分かる。
０．３および０．７の内大きい方の常数０．７は小さい
方の常数０．３を使用して（１−０．３）の演算で実現
し、他の１組の加算すると１になる常数０．１１および
０．８９の内大きい方の常数０．８９は小さい方の常数
０．１１を使用して（１−０．１１）の演算で実現す
る。これによって、０．３（Ｒ−Ｇ）と０．１１（Ｂ−
Ｇ）の部分にのみ常数かけ算器を使用し、後は符号つき
足し算回路を使用することによりマトリックス回路を実
現できることが分かる。
【００１２】このように、常数かけ算器の係数は最小の
常数をかけ算するよう構成し、かけ算結果の精度が一定
とすれば必要なビット幅を削減できるようにすることが
できる。例えば、Ｒ，Ｇ，Ｂの各入力が正の整数８ビッ
ト精度であったとすると、（Ｒ−Ｇ）は同じ精度では通
常９ビットの２の補数の整数となるが、０．３（Ｒ−
Ｇ）は常数が１／２以下なので、８ビットの２の補数の
整数で表現できる。同様に、０．１１（Ｂ−Ｙ）は１／
８以下なので、６ビットの２の補数の整数で表現でき、
常数かけ算器の計算ビット数の削減を図ることができ
る。
常数をかけ算するよう構成し、かけ算結果の精度が一定
とすれば必要なビット幅を削減できるようにすることが
できる。例えば、Ｒ，Ｇ，Ｂの各入力が正の整数８ビッ
ト精度であったとすると、（Ｒ−Ｇ）は同じ精度では通
常９ビットの２の補数の整数となるが、０．３（Ｒ−
Ｇ）は常数が１／２以下なので、８ビットの２の補数の
整数で表現できる。同様に、０．１１（Ｂ−Ｙ）は１／
８以下なので、６ビットの２の補数の整数で表現でき、
常数かけ算器の計算ビット数の削減を図ることができ
る。
【００１３】以上の原理にもとづき、前記目的を達成す
るために、本発明の第１の態様では、３原色信号から、
輝度信号と色差信号を合成するカラーエンコーダ用マト
リックス装置が提供され、該マトリックス装置は、３原
色の内の２つの色の色信号からそれぞれ他の１色の色信
号を引き算して第１および第２の引き算信号を生成する
第１および第２の引き算手段と、前記第１および第２の
引き算信号のそれぞれにかかる合成係数の内、それぞれ
に最小のものを使用して第１および第２の最小常数かけ
算信号を生成する第１および第２の常数かけ算手段と、
前記第１および第２の引き算信号からそれぞれ前記第１
および第２の最小常数かけ算信号を引き算して第３およ
び第４の常数かけ算信号を生成する第３および第４の引
き算手段と、前記第１および第２の最小常数かけ算信号
と前記第３および第４の常数かけ算信号と前記他の１色
の色信号との加減算で前記輝度信号と色差信号とを得る
ための加減算手段とを備えている。
るために、本発明の第１の態様では、３原色信号から、
輝度信号と色差信号を合成するカラーエンコーダ用マト
リックス装置が提供され、該マトリックス装置は、３原
色の内の２つの色の色信号からそれぞれ他の１色の色信
号を引き算して第１および第２の引き算信号を生成する
第１および第２の引き算手段と、前記第１および第２の
引き算信号のそれぞれにかかる合成係数の内、それぞれ
に最小のものを使用して第１および第２の最小常数かけ
算信号を生成する第１および第２の常数かけ算手段と、
前記第１および第２の引き算信号からそれぞれ前記第１
および第２の最小常数かけ算信号を引き算して第３およ
び第４の常数かけ算信号を生成する第３および第４の引
き算手段と、前記第１および第２の最小常数かけ算信号
と前記第３および第４の常数かけ算信号と前記他の１色
の色信号との加減算で前記輝度信号と色差信号とを得る
ための加減算手段とを備えている。
【００１４】この場合、前記加減算手段は、前記第１お
よび第２の最小常数かけ算信号と前記第３および第４の
常数かけ算信号との加減算により色差信号を生成し、前
記第３および第４の常数かけ算信号と前記他の１色の色
信号の加減算により輝度信号を生成するよう構成でき
る。
よび第２の最小常数かけ算信号と前記第３および第４の
常数かけ算信号との加減算により色差信号を生成し、前
記第３および第４の常数かけ算信号と前記他の１色の色
信号の加減算により輝度信号を生成するよう構成でき
る。
【００１５】また、前記第１および第２の常数かけ算手
段はＲＯＭテーブルで実現することもでき、構成を簡略
化することができる。
段はＲＯＭテーブルで実現することもでき、構成を簡略
化することができる。
【００１６】さらに、前記加減算手段で得られた色差信
号に所定の常数をかけ算することにより規格化された色
差信号を得るための第３および第４の常数かけ算手段を
設けることができる。
号に所定の常数をかけ算することにより規格化された色
差信号を得るための第３および第４の常数かけ算手段を
設けることができる。
【００１７】本発明の第２の態様では、３原色信号Ｒ
（赤），Ｇ（緑），Ｂ（青）から、輝度信号Ｙと２つの
色差信号Ｒ−Ｙ，Ｂ−Ｙを合成するカラーエンコーダ用
マトリックス装置が提供され、該マトリックス装置は、
３原色の内の２つの色の色信号Ｒ，Ｂからそれぞれ他の
色の色信号Ｇを引き算して第１および第２の引き算信号
Ｒ−Ｇ，Ｂ−Ｇを生成する第１および第２の引き算手段
と、前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇの
それぞれにかかる合成係数の内それぞれに最小のもので
ある０．３および０．１１をかけ算して第１および第２
の最小常数かけ算信号０．３（Ｒ−Ｇ），０．１１（Ｂ
−Ｇ）を生成する第１および第２の常数かけ算手段と、
前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇからそ
れぞれ前記第１および第２の最小常数かけ算信号０．３
（Ｒ−Ｇ），０．１１（Ｂ−Ｇ）を引き算して第３およ
び第４の常数かけ算信号（１−０．３）（Ｒ−Ｇ），
（１−０．１１）（Ｂ−Ｇ）を生成する第３および第４
の引き算手段と、前記第３の常数かけ算信号（１−０．
３）（Ｒ−Ｇ）から前記第２の最小常数かけ算信号０．
１１（Ｂ−Ｇ）を減算して第１の色差信号Ｒ−Ｙを生成
し、前記第４の常数かけ算信号（１−０．１１）（Ｂ−
Ｇ）から前記第１の最小常数かけ算信号０．３（Ｒ−
Ｇ）を減算して第２の色差信号Ｂ−Ｙを生成し、かつ前
記他の１色の色信号Ｇと前記第１の最小常数かけ算信号
０．３（Ｒ−Ｇ）と前記第２の最小常数かけ算信号０．
１１（Ｂ−Ｇ）とを加算し輝度信号を生成する加減算手
段とを備えている。
（赤），Ｇ（緑），Ｂ（青）から、輝度信号Ｙと２つの
色差信号Ｒ−Ｙ，Ｂ−Ｙを合成するカラーエンコーダ用
マトリックス装置が提供され、該マトリックス装置は、
３原色の内の２つの色の色信号Ｒ，Ｂからそれぞれ他の
色の色信号Ｇを引き算して第１および第２の引き算信号
Ｒ−Ｇ，Ｂ−Ｇを生成する第１および第２の引き算手段
と、前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇの
それぞれにかかる合成係数の内それぞれに最小のもので
ある０．３および０．１１をかけ算して第１および第２
の最小常数かけ算信号０．３（Ｒ−Ｇ），０．１１（Ｂ
−Ｇ）を生成する第１および第２の常数かけ算手段と、
前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇからそ
れぞれ前記第１および第２の最小常数かけ算信号０．３
（Ｒ−Ｇ），０．１１（Ｂ−Ｇ）を引き算して第３およ
び第４の常数かけ算信号（１−０．３）（Ｒ−Ｇ），
（１−０．１１）（Ｂ−Ｇ）を生成する第３および第４
の引き算手段と、前記第３の常数かけ算信号（１−０．
３）（Ｒ−Ｇ）から前記第２の最小常数かけ算信号０．
１１（Ｂ−Ｇ）を減算して第１の色差信号Ｒ−Ｙを生成
し、前記第４の常数かけ算信号（１−０．１１）（Ｂ−
Ｇ）から前記第１の最小常数かけ算信号０．３（Ｒ−
Ｇ）を減算して第２の色差信号Ｂ−Ｙを生成し、かつ前
記他の１色の色信号Ｇと前記第１の最小常数かけ算信号
０．３（Ｒ−Ｇ）と前記第２の最小常数かけ算信号０．
１１（Ｂ−Ｇ）とを加算し輝度信号を生成する加減算手
段とを備えている。
【００１８】さらに、前記加減算手段によって得られた
第１および第２の色差信号Ｒ−Ｙ，Ｂ−Ｙにそれぞれ所
定の常数をかけ算して規格化された色差信号を生成する
第３および第４の常数かけ算手段を設けることができ
る。
第１および第２の色差信号Ｒ−Ｙ，Ｂ−Ｙにそれぞれ所
定の常数をかけ算して規格化された色差信号を生成する
第３および第４の常数かけ算手段を設けることができ
る。
【００１９】本発明の第３の態様では、３原色信号か
ら、輝度信号と２つの色差信号を合成する方法が提供さ
れ、該方法は、３原色のうちの２つの色の色信号からそ
れぞれ他の１色の色信号を引き算して第１および第２の
引き算信号を生成する段階と、前記第１および第２の引
き算信号のそれぞれにかかる合成係数の内それぞれの最
小のものを使用してかけ算を行ない第１および第２の最
小常数かけ算信号を生成する段階と、前記第１および第
２の引き算信号からそれぞれ前記第１および第２の最小
常数かけ算信号を引き算してそれぞれ第３および第４の
常数かけ算信号を生成する段階と、前記第３の常数かけ
算信号から前記第２の最小常数かけ算信号を減算して第
１の色差信号を生成し、前記第４の常数かけ算信号から
前記第１の最小常数かけ算信号を減算して第２の色差信
号を生成し、かつ前記他の１色の色信号と前記第１の最
小常数かけ算信号と前記第２の最小常数かけ算信号との
加算により輝度信号を生成する段階とを備えている。
ら、輝度信号と２つの色差信号を合成する方法が提供さ
れ、該方法は、３原色のうちの２つの色の色信号からそ
れぞれ他の１色の色信号を引き算して第１および第２の
引き算信号を生成する段階と、前記第１および第２の引
き算信号のそれぞれにかかる合成係数の内それぞれの最
小のものを使用してかけ算を行ない第１および第２の最
小常数かけ算信号を生成する段階と、前記第１および第
２の引き算信号からそれぞれ前記第１および第２の最小
常数かけ算信号を引き算してそれぞれ第３および第４の
常数かけ算信号を生成する段階と、前記第３の常数かけ
算信号から前記第２の最小常数かけ算信号を減算して第
１の色差信号を生成し、前記第４の常数かけ算信号から
前記第１の最小常数かけ算信号を減算して第２の色差信
号を生成し、かつ前記他の１色の色信号と前記第１の最
小常数かけ算信号と前記第２の最小常数かけ算信号との
加算により輝度信号を生成する段階とを備えている。
【００２０】この場合、前記第１および第２の色差信号
にそれぞれ所定の常数をかけ算して規格化された色差信
号を得る段階を備えると好都合である。
にそれぞれ所定の常数をかけ算して規格化された色差信
号を得る段階を備えると好都合である。
【００２１】
【発明の実施の形態】以下図面を参照して本発明に係わ
るカラーエンコーダ用マトリックス装置および信号合成
方法につき説明する。図１は、本発明の一実施形態に係
わるカラーエンコーダ用マトリックス装置の概略の構成
を示すもので、ＮＴＳＣ方式の場合の例を示す。図１の
マトリックス装置は、引き算回路１，２，３，４，６，
７と、足し算回路５，８と、常数かけ算器９，１０，１
１，１２と、信号のタイミングを合わせるための遅延回
路１３，１４，１５と、リミッタ回路１６と、Ｄフリッ
プフロップ回路１７，１８，１９，２０，２１，２２，
２３，２４，２５となどで構成される。
るカラーエンコーダ用マトリックス装置および信号合成
方法につき説明する。図１は、本発明の一実施形態に係
わるカラーエンコーダ用マトリックス装置の概略の構成
を示すもので、ＮＴＳＣ方式の場合の例を示す。図１の
マトリックス装置は、引き算回路１，２，３，４，６，
７と、足し算回路５，８と、常数かけ算器９，１０，１
１，１２と、信号のタイミングを合わせるための遅延回
路１３，１４，１５と、リミッタ回路１６と、Ｄフリッ
プフロップ回路１７，１８，１９，２０，２１，２２，
２３，２４，２５となどで構成される。
【００２２】引き算回路１，２，３，４，６，７は符号
つき足し算器で構成できる。マイナスの符号を有する側
の入力が２の補数となり、該２の補数と他方の側の入力
とが足し算され、結果として引き算が行なわれる。ま
た、足し算回路５，８は符号つき足し算器で構成され
る。常数かけ算器９，１０，１１，１２は通常パイプラ
インプロセッサによって実現されるが、後に説明するよ
うにリードオンリメモリ（ＲＯＭ）テーブルで構成する
こともできる。常数かけ算器９および１１は、それぞれ
入力信号に対し常数０．３および０．１１を乗算するも
のである。他の常数かけ算器１１，１２は入力信号に対
しそれぞれ常数１／１．４および１／１．７８を乗算し
て規格化された色差信号ＣｒおよびＣｂを生成するもの
である。
つき足し算器で構成できる。マイナスの符号を有する側
の入力が２の補数となり、該２の補数と他方の側の入力
とが足し算され、結果として引き算が行なわれる。ま
た、足し算回路５，８は符号つき足し算器で構成され
る。常数かけ算器９，１０，１１，１２は通常パイプラ
インプロセッサによって実現されるが、後に説明するよ
うにリードオンリメモリ（ＲＯＭ）テーブルで構成する
こともできる。常数かけ算器９および１１は、それぞれ
入力信号に対し常数０．３および０．１１を乗算するも
のである。他の常数かけ算器１１，１２は入力信号に対
しそれぞれ常数１／１．４および１／１．７８を乗算し
て規格化された色差信号ＣｒおよびＣｂを生成するもの
である。
【００２３】信号のタイミングを合わせるための遅延回
路１３，１４，１５は、任意の遅延回路で構成でき、例
えば複数個のインバータを縦続接続したもの、あるいは
ＣＣＤ素子、その他が使用される。Ｄフリップフロップ
１７，１８，１９，２０，２１，２２，２３，２４，２
５はパイプライン信号処理を行なう場合のタイミング合
わせなどに使用される。
路１３，１４，１５は、任意の遅延回路で構成でき、例
えば複数個のインバータを縦続接続したもの、あるいは
ＣＣＤ素子、その他が使用される。Ｄフリップフロップ
１７，１８，１９，２０，２１，２２，２３，２４，２
５はパイプライン信号処理を行なう場合のタイミング合
わせなどに使用される。
【００２４】また、リミッタ回路１６は、計算誤差によ
る出力のオーバフローおよびアンダフローを防止し、出
力信号の値の範囲を所定の範囲に限定する働きをなす。
る出力のオーバフローおよびアンダフローを防止し、出
力信号の値の範囲を所定の範囲に限定する働きをなす。
【００２５】図１１の回路は、各色の色信号入力Ｇｉ
ｎ，Ｒｉｎ，Ｂｉｎを受けて輝度信号出力Ｙｏｕｔ、規
格化された色差信号Ｃｒ，Ｃｂを出力するものである。
赤色の信号入力Ｇｉｎは引き算回路１のマイナス符号側
入力と、引き算回路２のマイナス符号側入力と遅延回路
１３の入力に接続されている。赤色の信号入力Ｒｉｎは
引き算回路１の他方の入力に接続されている。青色の信
号入力Ｂｉｎは引き算回路２の他方の入力に接続されて
いる。
ｎ，Ｒｉｎ，Ｂｉｎを受けて輝度信号出力Ｙｏｕｔ、規
格化された色差信号Ｃｒ，Ｃｂを出力するものである。
赤色の信号入力Ｇｉｎは引き算回路１のマイナス符号側
入力と、引き算回路２のマイナス符号側入力と遅延回路
１３の入力に接続されている。赤色の信号入力Ｒｉｎは
引き算回路１の他方の入力に接続されている。青色の信
号入力Ｂｉｎは引き算回路２の他方の入力に接続されて
いる。
【００２６】引き算回路１の出力はＤフリップフロップ
１７を介して常数かけ算器９の一方の入力と遅延回路１
４の入力に接続されている。常数かけ算器９の他方の入
力には常数０．３を表わす信号が供給され、常数かけ算
器９の出力は引き算回路３のマイナス符号側入力に接続
されかつＤフリップフロップ１９を介して足し算回路５
の一方の入力におよび引き算回路７のマイナス符号側入
力に接続されている。遅延回路１４の出力は引き算回路
３の他方の入力に接続され、引き算回路３の出力はＤフ
リップフロップ２０を介して引き算回路６のプラス符号
側入力に接続されている。
１７を介して常数かけ算器９の一方の入力と遅延回路１
４の入力に接続されている。常数かけ算器９の他方の入
力には常数０．３を表わす信号が供給され、常数かけ算
器９の出力は引き算回路３のマイナス符号側入力に接続
されかつＤフリップフロップ１９を介して足し算回路５
の一方の入力におよび引き算回路７のマイナス符号側入
力に接続されている。遅延回路１４の出力は引き算回路
３の他方の入力に接続され、引き算回路３の出力はＤフ
リップフロップ２０を介して引き算回路６のプラス符号
側入力に接続されている。
【００２７】引き算回路２の出力はＤフリップフロップ
１８を介して常数かけ算器１０の一方の入力におよび遅
延回路１５の入力に接続されている。常数かけ算器１０
の他方の入力には常数０．１１を表わす信号が供給され
ている。常数かけ算器１０の出力は引き算回路４のマイ
ナス符号側入力に接続され、かつＤフリップフロップ２
１を介して足し算回路５の他方の入力および引き算回路
６のマイナス符号側入力に接続されている。遅延回路１
５の出力は引き算回路４の入力に接続され、引き算回路
４の出力はＤフリップフロップ２２を介して引き算回路
７のプラス符号側入力に接続されている。
１８を介して常数かけ算器１０の一方の入力におよび遅
延回路１５の入力に接続されている。常数かけ算器１０
の他方の入力には常数０．１１を表わす信号が供給され
ている。常数かけ算器１０の出力は引き算回路４のマイ
ナス符号側入力に接続され、かつＤフリップフロップ２
１を介して足し算回路５の他方の入力および引き算回路
６のマイナス符号側入力に接続されている。遅延回路１
５の出力は引き算回路４の入力に接続され、引き算回路
４の出力はＤフリップフロップ２２を介して引き算回路
７のプラス符号側入力に接続されている。
【００２８】遅延回路１３の出力は足し算回路８の一方
の入力に接続され、該足し算回路８の他方の入力には足
し算回路５の出力がＤフリップフロップ２３を介して接
続されている。足し算回路８の出力はリミッタ回路１６
を介して輝度信号出力Ｙｏｕｔを提供する。
の入力に接続され、該足し算回路８の他方の入力には足
し算回路５の出力がＤフリップフロップ２３を介して接
続されている。足し算回路８の出力はリミッタ回路１６
を介して輝度信号出力Ｙｏｕｔを提供する。
【００２９】引き算回路６の出力はＤフリップフロップ
２４を介して常数かけ算器１１の一方の入力に接続され
ている。常数かけ算器１１の他方の入力には常数１／
１．４を表わす信号が供給されている。常数かけ算器１
１の出力は規格化された色差信号Ｃｒを提供する。
２４を介して常数かけ算器１１の一方の入力に接続され
ている。常数かけ算器１１の他方の入力には常数１／
１．４を表わす信号が供給されている。常数かけ算器１
１の出力は規格化された色差信号Ｃｒを提供する。
【００３０】また、引き算回路７の出力はＤフリップフ
ロップ２５を介して常数かけ算器１２の一方の入力に接
続されている。常数かけ算器１２の他方の入力には常数
１／１．７８を表わす信号が供給されている。常数かけ
算器１２の出力は規格化された色差信号Ｃｂを提供す
る。
ロップ２５を介して常数かけ算器１２の一方の入力に接
続されている。常数かけ算器１２の他方の入力には常数
１／１．７８を表わす信号が供給されている。常数かけ
算器１２の出力は規格化された色差信号Ｃｂを提供す
る。
【００３１】次に、以上のような構成を有するマトリッ
クス回路の動作を説明する。緑色および赤色の色信号が
それぞれ入力ＧｉｎおよびＲｉｎから引き算回路１に供
給され、引き算信号Ｒ−Ｇが計算される。また、緑色の
色信号が入力Ｇｉｎからかつ青色の色信号が入力Ｂｉｎ
から引き算回路２に供給されて、引き算信号Ｂ−Ｇが計
算される。
クス回路の動作を説明する。緑色および赤色の色信号が
それぞれ入力ＧｉｎおよびＲｉｎから引き算回路１に供
給され、引き算信号Ｒ−Ｇが計算される。また、緑色の
色信号が入力Ｇｉｎからかつ青色の色信号が入力Ｂｉｎ
から引き算回路２に供給されて、引き算信号Ｂ−Ｇが計
算される。
【００３２】引き算回路１から出力された引き算信号Ｒ
−ＧはＤフリップフロップ１７でタイミングを合わせた
後、常数かけ算器９において常数０．３をかけ算し０．
３（Ｒ−Ｇ）が計算される。一方、Ｄフリップフロップ
１７から出力される引き算信号Ｒ−Ｇは遅延回路１４で
かけ算器９とタイミングを合わせた後、引き算器３に供
給され、前記常数かけ算器９で得られた０．３（Ｒ−
Ｇ）が引き算されることにより（１−０．３）（Ｒ−
Ｇ）＝０．７（Ｒ−Ｇ）が計算される。
−ＧはＤフリップフロップ１７でタイミングを合わせた
後、常数かけ算器９において常数０．３をかけ算し０．
３（Ｒ−Ｇ）が計算される。一方、Ｄフリップフロップ
１７から出力される引き算信号Ｒ−Ｇは遅延回路１４で
かけ算器９とタイミングを合わせた後、引き算器３に供
給され、前記常数かけ算器９で得られた０．３（Ｒ−
Ｇ）が引き算されることにより（１−０．３）（Ｒ−
Ｇ）＝０．７（Ｒ−Ｇ）が計算される。
【００３３】また、前記引き算器２から出力された引き
算信号Ｂ−ＧはＤフリップフロップ１８でタイミングを
合わせた後、常数かけ算器１０に入力され常数０．１１
と乗算されて０．１１（Ｂ−Ｇ）が計算される。また、
Ｄフリップフロップ１８から出力された引き算信号Ｂ−
Ｇは遅延回路１５によって常数かけ算器１０の出力とタ
イミングを合わせた後、引き算回路４において前記０．
１１（Ｂ−Ｇ）が減算されて（１−０．１）（Ｂ−Ｇ）
＝０．８９（Ｂ−Ｇ）が計算される。
算信号Ｂ−ＧはＤフリップフロップ１８でタイミングを
合わせた後、常数かけ算器１０に入力され常数０．１１
と乗算されて０．１１（Ｂ−Ｇ）が計算される。また、
Ｄフリップフロップ１８から出力された引き算信号Ｂ−
Ｇは遅延回路１５によって常数かけ算器１０の出力とタ
イミングを合わせた後、引き算回路４において前記０．
１１（Ｂ−Ｇ）が減算されて（１−０．１）（Ｂ−Ｇ）
＝０．８９（Ｂ−Ｇ）が計算される。
【００３４】以上のようにして得られた４つの信号０．
３（Ｒ−Ｇ）と、０．７（Ｒ−Ｇ）と、０．１１（Ｂ−
Ｇ）と、０．８９（Ｂ−Ｇ）とはそれぞれＤフリップフ
ロップ回路１９，２０，２１，２２でタイミングを合わ
せた後、足し算回路５、引き算回路６，７において演算
処理される。
３（Ｒ−Ｇ）と、０．７（Ｒ−Ｇ）と、０．１１（Ｂ−
Ｇ）と、０．８９（Ｂ−Ｇ）とはそれぞれＤフリップフ
ロップ回路１９，２０，２１，２２でタイミングを合わ
せた後、足し算回路５、引き算回路６，７において演算
処理される。
【００３５】すなわち、引き算回路６では０．７（Ｒ−
Ｇ）−０．１１（Ｂ−Ｇ）が計算され色差信号（Ｒ−
Ｙ）が求められる。また、引き算回路７では、−０．３
（Ｒ−Ｇ）＋０．８９（Ｂ−Ｇ）が計算され色差信号Ｂ
−Ｙが求められる。
Ｇ）−０．１１（Ｂ−Ｇ）が計算され色差信号（Ｒ−
Ｙ）が求められる。また、引き算回路７では、−０．３
（Ｒ−Ｇ）＋０．８９（Ｂ−Ｇ）が計算され色差信号Ｂ
−Ｙが求められる。
【００３６】また、足し算回路５では０．３（Ｒ−Ｇ）
＋０．１１（Ｂ−Ｇ）が求められＤフリップフロップ回
路２３を介して足し算回路８に供給される。足し算回路
８では入力Ｇｉｎから供給される緑色の色信号が遅延回
路１３によってタイミングを合わせた後に供給され、前
記足し算回路５の足し算結果と加算される。これによっ
て、Ｇ＋０．３（Ｒ−Ｇ）＋０．１１（Ｂ−Ｇ）すなわ
ち輝度信号Ｙが得られる。この輝度信号Ｙはリミッタ回
路１６を介してオーバフローおよびアンダフローが除去
され輝度信号Ｙｏｕｔとして出力される。
＋０．１１（Ｂ−Ｇ）が求められＤフリップフロップ回
路２３を介して足し算回路８に供給される。足し算回路
８では入力Ｇｉｎから供給される緑色の色信号が遅延回
路１３によってタイミングを合わせた後に供給され、前
記足し算回路５の足し算結果と加算される。これによっ
て、Ｇ＋０．３（Ｒ−Ｇ）＋０．１１（Ｂ−Ｇ）すなわ
ち輝度信号Ｙが得られる。この輝度信号Ｙはリミッタ回
路１６を介してオーバフローおよびアンダフローが除去
され輝度信号Ｙｏｕｔとして出力される。
【００３７】また、前記引き算回路６において計算され
た色差信号Ｒ−Ｙは、Ｄフリップフロップ回路２４にお
いてタイミングを合わせた後、常数かけ算器１１に入力
され、所定の規格化因子１／１．４がかけ算されて規格
化された色差信号がＣｒとして出力される。また、引き
算回路７で求められた色差信号Ｂ−ＹはＤフリップフロ
ップ回路２５においてタイミングを合わせた後、常数か
け算器１２において規格化因子１／１．７８がかけ算さ
れて規格化された色差信号Ｃｂが求められ出力される。
なお、常数かけ算器１１，１２における規格化因子１／
１．４および１／１．７８の大きさを補正することによ
り、色信号の大きさと色相を変更調整することもでき
る。
た色差信号Ｒ−Ｙは、Ｄフリップフロップ回路２４にお
いてタイミングを合わせた後、常数かけ算器１１に入力
され、所定の規格化因子１／１．４がかけ算されて規格
化された色差信号がＣｒとして出力される。また、引き
算回路７で求められた色差信号Ｂ−ＹはＤフリップフロ
ップ回路２５においてタイミングを合わせた後、常数か
け算器１２において規格化因子１／１．７８がかけ算さ
れて規格化された色差信号Ｃｂが求められ出力される。
なお、常数かけ算器１１，１２における規格化因子１／
１．４および１／１．７８の大きさを補正することによ
り、色信号の大きさと色相を変更調整することもでき
る。
【００３８】なお、以上の実施形態に係わるマトリック
ス回路はＮＴＳＣ方式に関するものであるが、ＰＡＬ方
式およびハイビジョン方式の映像信号についても同様の
構成でかけ算すべき常数を変更することによって実現す
ることができる。
ス回路はＮＴＳＣ方式に関するものであるが、ＰＡＬ方
式およびハイビジョン方式の映像信号についても同様の
構成でかけ算すべき常数を変更することによって実現す
ることができる。
【００３９】図２は、図１の常数かけ算器９，１０をＲ
ＯＭテーブル２６，２７で構成した例を示す。今例えば
Ｒ，Ｇ，Ｂがそれぞれ正の整数で８ビットの精度を有す
るものとすると、前述のように（Ｒ−Ｇ）および（Ｂ−
Ｇ）は同じ精度では通常９ビットの２の補数の整数とな
る。常数０．３は１／２以下であるから、０．３（Ｒ−
Ｇ）は８ビットの２の補数の整数で表現できる。同様
に、常数０．１１は１／８以下であるから、０．１１
（Ｂ−Ｇ）は６ビットの２の補数の整数で表現できる。
ＯＭテーブル２６，２７で構成した例を示す。今例えば
Ｒ，Ｇ，Ｂがそれぞれ正の整数で８ビットの精度を有す
るものとすると、前述のように（Ｒ−Ｇ）および（Ｂ−
Ｇ）は同じ精度では通常９ビットの２の補数の整数とな
る。常数０．３は１／２以下であるから、０．３（Ｒ−
Ｇ）は８ビットの２の補数の整数で表現できる。同様
に、常数０．１１は１／８以下であるから、０．１１
（Ｂ−Ｇ）は６ビットの２の補数の整数で表現できる。
【００４０】従って、０．３（Ｒ−Ｇ）を得るためのＲ
ＯＭテーブルは、９ビットの（Ｒ−Ｇ）信号をアドレス
とし、０．３（Ｒ−Ｇ）を表わす８ビットのデータを出
力するものとなる。従って、この目的で使用するＲＯＭ
は４，０９６ビットの容量が必要となる。
ＯＭテーブルは、９ビットの（Ｒ−Ｇ）信号をアドレス
とし、０．３（Ｒ−Ｇ）を表わす８ビットのデータを出
力するものとなる。従って、この目的で使用するＲＯＭ
は４，０９６ビットの容量が必要となる。
【００４１】これに対し、０．１１（Ｂ−Ｇ）を得るた
めのＲＯＭテーブルは、９ビットの（Ｂ−Ｇ）信号をア
ドレスデータとして受け入れ、０．１１（Ｂ−Ｇ）を表
わす６ビットのデータを出力するものとなる。従って、
このためのＲＯＭとしては３，０７２ビットの容量があ
れば良い。これに対し、例えば０．７（Ｒ−Ｇ）や０．
８９（Ｂ−Ｇ）をＲＯＭテーブルで実現しようとする
と、出力データのビット数が増大するため、さらに最大
容量のＲＯＭが必要となる。０．７（Ｒ−Ｇ）や０．８
９（Ｂ−Ｇ）を実現するのに比べて、０．３（Ｒ−Ｇ）
や０．１１（Ｂ−Ｇ）を実現する場合にはＲＯＭテーブ
ルの容量はそれぞれ１／２と１／８のビット規模で実現
できることになる。
めのＲＯＭテーブルは、９ビットの（Ｂ−Ｇ）信号をア
ドレスデータとして受け入れ、０．１１（Ｂ−Ｇ）を表
わす６ビットのデータを出力するものとなる。従って、
このためのＲＯＭとしては３，０７２ビットの容量があ
れば良い。これに対し、例えば０．７（Ｒ−Ｇ）や０．
８９（Ｂ−Ｇ）をＲＯＭテーブルで実現しようとする
と、出力データのビット数が増大するため、さらに最大
容量のＲＯＭが必要となる。０．７（Ｒ−Ｇ）や０．８
９（Ｂ−Ｇ）を実現するのに比べて、０．３（Ｒ−Ｇ）
や０．１１（Ｂ−Ｇ）を実現する場合にはＲＯＭテーブ
ルの容量はそれぞれ１／２と１／８のビット規模で実現
できることになる。
【００４２】なお、図２の各ＲＯＭテーブルは、それぞ
れアドレス信号として入力されるＲ−ＧおよびＢ−Ｇの
各データに対応して０．３（Ｒ−Ｇ）および０．１１
（Ｂ−Ｇ）の値を記憶しておけば良い。なお、Ｒ−Ｇ，
Ｂ−Ｇの値のうち有意の出力を生じる値についてのみ出
力データを記憶しておけばよいことはもちろんである。
れアドレス信号として入力されるＲ−ＧおよびＢ−Ｇの
各データに対応して０．３（Ｒ−Ｇ）および０．１１
（Ｂ−Ｇ）の値を記憶しておけば良い。なお、Ｒ−Ｇ，
Ｂ−Ｇの値のうち有意の出力を生じる値についてのみ出
力データを記憶しておけばよいことはもちろんである。
【００４３】また、ＲＯＭテーブルの出力のビット数が
８ビットに満たない場合は、次段の引き算回路などにお
いては、上位ビット部分に０を必要な数だけ加えてビッ
ト幅を増やすことにより、通常の８ビットの計算処理な
どを行なうことができる。
８ビットに満たない場合は、次段の引き算回路などにお
いては、上位ビット部分に０を必要な数だけ加えてビッ
ト幅を増やすことにより、通常の８ビットの計算処理な
どを行なうことができる。
【００４４】
【発明の効果】以上のように、本発明によれば、カラー
エンコーダ用のマトリックス回路において、かけ算器の
数を低減するとともに、かけ算器として小さな常数をか
け算するものを使用することができる。従って、マトリ
ックス回路の主要部分をこのような小さな常数のかけ算
器と加減算器のみで構成できるから、回路規模が削減で
き、ＩＣ基板上の占有面積を少なくしかつ低価格でＩＣ
化できるようになる。さらに、前述のように常数かけ算
器をＲＯＭテーブルで実現すれば、さらに回路規模を大
幅に縮小できる。すなわち、本発明によれば、デジタル
方式のカラーエンコーダ用マトリックス回路の回路規模
を縮小し、ＩＣ化を容易にしかつ回路装置の低価格化を
図ることが可能になる。
エンコーダ用のマトリックス回路において、かけ算器の
数を低減するとともに、かけ算器として小さな常数をか
け算するものを使用することができる。従って、マトリ
ックス回路の主要部分をこのような小さな常数のかけ算
器と加減算器のみで構成できるから、回路規模が削減で
き、ＩＣ基板上の占有面積を少なくしかつ低価格でＩＣ
化できるようになる。さらに、前述のように常数かけ算
器をＲＯＭテーブルで実現すれば、さらに回路規模を大
幅に縮小できる。すなわち、本発明によれば、デジタル
方式のカラーエンコーダ用マトリックス回路の回路規模
を縮小し、ＩＣ化を容易にしかつ回路装置の低価格化を
図ることが可能になる。
【図１】本発明の１実施形態に係わるカラーエンコーダ
用マトリックス回路の概略の構成を示すブロック図であ
る。
用マトリックス回路の概略の構成を示すブロック図であ
る。
【図２】本発明に係わるカラーエンコーダ用マトリック
ス回路において、常数かけ算器と等価な機能をＲＯＭテ
ーブルで実現するための構成例を示す説明図である。
ス回路において、常数かけ算器と等価な機能をＲＯＭテ
ーブルで実現するための構成例を示す説明図である。
１，２，３，４，６，７ 引き算回路 ５，８ 足し算回路 ９，１０，１１，１２ 常数かけ算器 １３，１４，１５ 遅延回路 １６ リミッタ回路 １７，１８，１９，…，２５ Ｄフリップフロップ回路 ２６，２７ ＲＯＭテーブル
Claims (8)
- 【請求項１】 ３原色信号から、輝度信号と色差信号を
合成するカラーエンコーダ用マトリックス装置であっ
て、 ３原色の内の２つの色の色信号からそれぞれ他の１色の
色信号を引き算して第１および第２の引き算信号を生成
する第１および第２の引き算手段と、 前記第１および第２の引き算信号のそれぞれにかかる合
成係数の内、それぞれに最小のものを使用して第１およ
び第２の最小常数かけ算信号を生成する第１および第２
の常数かけ算手段と、 前記第１および第２の引き算信号からそれぞれ前記第１
および第２の最小常数かけ算信号を引き算して第３およ
び第４の常数かけ算信号を生成する第３および第４の引
き算手段と、 前記第１および第２の最小常数かけ算信号と前記第３お
よび第４の常数かけ算信号と前記他の１色の色信号との
加減算で前記輝度信号と色差信号とを得るための加減算
手段と、 を具備することを特徴とするカラーエンコーダ用マトリ
ックス装置。 - 【請求項２】 前記加減算手段は、前記第１および第２
の最小常数かけ算信号と前記第３および第４の常数かけ
算信号との加減算により色差信号を生成し、前記第３お
よび第４の常数かけ算信号と前記他の１色の色信号の加
減算により輝度信号を生成することを特徴とする請求項
１に記載のカラーエンコーダ用マトリックス装置。 - 【請求項３】 前記第１および第２の常数かけ算手段は
ＲＯＭテーブルで実現したことを特徴とする請求項１ま
たは２に記載のカラーエンコーダ用マトリックス装置。 - 【請求項４】 さらに、前記加減算手段で得られた色差
信号に所定の常数をかけ算することにより規格化された
色差信号を得るための第３および第４の常数かけ算手段
を具備することを特徴とする請求項１または２に記載の
カラーエンコーダ用マトリックス装置。 - 【請求項５】 ３原色信号Ｒ（赤），Ｇ（緑），Ｂ
（青）から、輝度信号Ｙと２つの色差信号Ｒ−Ｙ，Ｂ−
Ｙを合成するカラーエンコーダ用マトリックス装置であ
って、 ３原色の内の２つの色の色信号Ｒ，Ｂからそれぞれ他の
色の色信号Ｇを引き算して第１および第２の引き算信号
Ｒ−Ｇ，Ｂ−Ｇを生成する第１および第２の引き算手段
と、 前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇのそれ
ぞれにかかる合成係数の内それぞれに最小のものである
０．３および０．１１をかけ算して第１および第２の最
小常数かけ算信号０．３（Ｒ−Ｇ），０．１１（Ｂ−
Ｇ）を生成する第１および第２の常数かけ算手段と、 前記第１および第２の引き算信号Ｒ−Ｇ，Ｂ−Ｇからそ
れぞれ前記第１および第２の最小常数かけ算信号０．３
（Ｒ−Ｇ），０．１１（Ｂ−Ｇ）を引き算して第３およ
び第４の常数かけ算信号（１−０．３）（Ｒ−Ｇ），
（１−０．１１）（Ｂ−Ｇ）を生成する第３および第４
の引き算手段と、 前記第３の常数かけ算信号（１−０．３）（Ｒ−Ｇ）か
ら前記第２の最小常数かけ算信号０．１１（Ｂ−Ｇ）を
減算して第１の色差信号Ｒ−Ｙを生成し、前記第４の常
数かけ算信号（１−０．１１）（Ｂ−Ｇ）から前記第１
の最小常数かけ算信号０．３（Ｒ−Ｇ）を減算して第２
の色差信号Ｂ−Ｙを生成し、かつ前記他の１色の色信号
Ｇと前記第１の最小常数かけ算信号０．３（Ｒ−Ｇ）と
前記第２の最小常数かけ算信号０．１１（Ｂ−Ｇ）とを
加算し輝度信号を生成する加減算手段と、 を具備することを特徴とするカラーエンコーダ用マトリ
ックス装置。 - 【請求項６】 さらに、前記加減算手段によって得られ
た第１および第２の色差信号Ｒ−Ｙ，Ｂ−Ｙにそれぞれ
所定の常数をかけ算して規格化された色差信号を生成す
る第３および第４の常数かけ算手段を具備することを特
徴とする請求項５に記載のカラーエンコーダ用マトリッ
クス装置。 - 【請求項７】 ３原色信号から、輝度信号と２つの色差
信号を合成する方法であって、 ３原色のうちの２つの色の色信号からそれぞれ他の１色
の色信号を引き算して第１および第２の引き算信号を生
成する段階と、 前記第１および第２の引き算信号のそれぞれにかかる合
成係数の内それぞれの最小のものを使用してかけ算を行
ない第１および第２の最小常数かけ算信号を生成する段
階と、 前記第１および第２の引き算信号からそれぞれ前記第１
および第２の最小常数かけ算信号を引き算してそれぞれ
第３および第４の常数かけ算信号を生成する段階と、 前記第３の常数かけ算信号から前記第２の最小常数かけ
算信号を減算して第１の色差信号を生成し、前記第４の
常数かけ算信号から前記第１の最小常数かけ算信号を減
算して第２の色差信号を生成し、かつ前記他の１色の色
信号と前記第１の最小常数かけ算信号と前記第２の最小
常数かけ算信号との加算により輝度信号を生成する段階
と、 を具備することを特徴とする３原色信号から、輝度信号
と２つの色差信号を合成する方法。 - 【請求項８】 さらに、前記第１および第２の色差信号
にそれぞれ所定の常数をかけ算して規格化された色差信
号を得る段階を具備することを特徴とする請求項７に記
載の３原色信号から、輝度信号と２つの色差信号を合成
する方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8275555A JPH10108212A (ja) | 1996-09-26 | 1996-09-26 | カラーエンコーダ用マトリックス装置および信号合成方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8275555A JPH10108212A (ja) | 1996-09-26 | 1996-09-26 | カラーエンコーダ用マトリックス装置および信号合成方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10108212A true JPH10108212A (ja) | 1998-04-24 |
Family
ID=17557088
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8275555A Pending JPH10108212A (ja) | 1996-09-26 | 1996-09-26 | カラーエンコーダ用マトリックス装置および信号合成方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10108212A (ja) |
-
1996
- 1996-09-26 JP JP8275555A patent/JPH10108212A/ja active Pending
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