JPH0997114A - サーボエラー信号処理装置 - Google Patents
サーボエラー信号処理装置Info
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- JPH0997114A JPH0997114A JP27623495A JP27623495A JPH0997114A JP H0997114 A JPH0997114 A JP H0997114A JP 27623495 A JP27623495 A JP 27623495A JP 27623495 A JP27623495 A JP 27623495A JP H0997114 A JPH0997114 A JP H0997114A
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- error signal
- servo error
- signal processing
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Abstract
(57)【要約】
【課題】 サーボエラー信号のオフセット・バランス・
ゲインの自動調整を行ない、且つサーボゲイン交点略３
ｋＨｚ以上を実現するサーボエラー信号処理装置を提供
する。 【解決手段】 サーボエラー信号を検出するサーボエラ
ー信号検出回路３と、前記サーボエラー信号検出回路の
出力が供給されて位相補償の低域分の処理を行なうデジ
タル信号処理回路６と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の高域分の処理を行なうア
ナログ位相補償回路４と、前記デジタル信号処理回路６
の出力と前記アナログ位相補償回路４の出力とを加算す
る加算器８とを備えて、前記加算器出力で駆動機構を駆
動する。
ゲインの自動調整を行ない、且つサーボゲイン交点略３
ｋＨｚ以上を実現するサーボエラー信号処理装置を提供
する。 【解決手段】 サーボエラー信号を検出するサーボエラ
ー信号検出回路３と、前記サーボエラー信号検出回路の
出力が供給されて位相補償の低域分の処理を行なうデジ
タル信号処理回路６と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の高域分の処理を行なうア
ナログ位相補償回路４と、前記デジタル信号処理回路６
の出力と前記アナログ位相補償回路４の出力とを加算す
る加算器８とを備えて、前記加算器出力で駆動機構を駆
動する。
Description
【０００１】
【発明の属する技術分野】この発明は、情報が記録され
ている光ディスク等の情報記録媒体から情報再生信号を
処理するサーボエラー信号処理装置に関する。
ている光ディスク等の情報記録媒体から情報再生信号を
処理するサーボエラー信号処理装置に関する。
【０００２】
【従来の技術】サーボエラー信号のオフセット・バラン
ス・ゲインの自動調整及びサーボゲイン交点略１ｋＨｚ
程度の位相補償系をデジタル信号処理回路で実現してい
るＣＤドライブやＣＤ−ＲＯＭドライブがある。
ス・ゲインの自動調整及びサーボゲイン交点略１ｋＨｚ
程度の位相補償系をデジタル信号処理回路で実現してい
るＣＤドライブやＣＤ−ＲＯＭドライブがある。
【０００３】
【発明が解決しようとする課題】高密度光ディスクドラ
イブや高速回転を必要とするｎ倍速ＣＤ−ＲＯＭドライ
ブは、サーボエラー信号のオフセット・バランス・ゲイ
ンの自動調整が必要であり、デジタル信号処理回路を用
いることにより容易に調整が可能である。
イブや高速回転を必要とするｎ倍速ＣＤ−ＲＯＭドライ
ブは、サーボエラー信号のオフセット・バランス・ゲイ
ンの自動調整が必要であり、デジタル信号処理回路を用
いることにより容易に調整が可能である。
【０００４】しかし、高いサーボ改善度（ゲイン交点略
３ｋＨｚ以上）を必要とする場合に、位相補償系をデジ
タル信号処理回路で実現しようとすると、デジタル系の
遅れ（サンプリング周波数、計算時間遅れ）により位相
余裕が取れなくなってしまう課題があった。ここで、高
いサーボ改善度（ゲイン交点略３ｋＨｚ以上）を必要と
する理由を説明する。
３ｋＨｚ以上）を必要とする場合に、位相補償系をデジ
タル信号処理回路で実現しようとすると、デジタル系の
遅れ（サンプリング周波数、計算時間遅れ）により位相
余裕が取れなくなってしまう課題があった。ここで、高
いサーボ改善度（ゲイン交点略３ｋＨｚ以上）を必要と
する理由を説明する。
【０００５】高密度光ディスク（ｎ倍速ＣＤ−ＲＯＭ）
は通常のＣＤ，ＣＤ−ＲＯＭに比べて高速回転し、線速
度が、ＣＤ，ＣＤ−ＲＯＭ（1.2 〜1.4 ｍ／ｓ）に対し
て３〜４ｍ／ｓである。偏芯加速度は角速度に比例する
ために、高密度光ディスクでは通常のＣＤ，ＣＤ−ＲＯ
Ｍに比べて偏芯加速度が大きくなる。サーボの最低必要
ゲインの高い周波数成分（30〜50Ｈｚ以上）は、偏芯加
速度と比例関係にある。よって、最低必要ゲインが高く
り、高いサーボ改善度を必要とするため、ゲイン交点を
略１ＫＨｚ程度から略３ＫＨｚ以上に、上げなければな
らない。
は通常のＣＤ，ＣＤ−ＲＯＭに比べて高速回転し、線速
度が、ＣＤ，ＣＤ−ＲＯＭ（1.2 〜1.4 ｍ／ｓ）に対し
て３〜４ｍ／ｓである。偏芯加速度は角速度に比例する
ために、高密度光ディスクでは通常のＣＤ，ＣＤ−ＲＯ
Ｍに比べて偏芯加速度が大きくなる。サーボの最低必要
ゲインの高い周波数成分（30〜50Ｈｚ以上）は、偏芯加
速度と比例関係にある。よって、最低必要ゲインが高く
り、高いサーボ改善度を必要とするため、ゲイン交点を
略１ＫＨｚ程度から略３ＫＨｚ以上に、上げなければな
らない。
【０００６】また、量子化誤差によりＤ／Ａの出力が飽
和してしまうためにダイナミックレンジに余裕がなくな
ってしまう課題があった。
和してしまうためにダイナミックレンジに余裕がなくな
ってしまう課題があった。
【０００７】
【課題を解決するための手段】トラッキングエラーのオ
フセット・バランス・ゲインの自動調整とトラッキング
サーボゲインの位相補償フィルタの低域分をデジタル信
号処理回路で行ない、デジタル信号処理回路では実現が
難しい高域分の位相補償フィルタをデジタル信号処理回
路と並列接続したアナログ位相補償回路で対応する。
フセット・バランス・ゲインの自動調整とトラッキング
サーボゲインの位相補償フィルタの低域分をデジタル信
号処理回路で行ない、デジタル信号処理回路では実現が
難しい高域分の位相補償フィルタをデジタル信号処理回
路と並列接続したアナログ位相補償回路で対応する。
【０００８】即ち、サーボエラー信号を検出するサーボ
エラー信号検出回路と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の低域分の処理を行なうデ
ジタル信号処理回路と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の高域分の処理を行なうア
ナログ位相補償回路と、前記デジタル信号処理回路の出
力と前記アナログ位相補償回路の出力とを加算する加算
器を備えて、前記加算器出力で駆動機構を駆動する。
エラー信号検出回路と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の低域分の処理を行なうデ
ジタル信号処理回路と、前記サーボエラー信号検出回路
の出力が供給されて位相補償の高域分の処理を行なうア
ナログ位相補償回路と、前記デジタル信号処理回路の出
力と前記アナログ位相補償回路の出力とを加算する加算
器を備えて、前記加算器出力で駆動機構を駆動する。
【０００９】
【発明の実施の形態】本発明のサーボエラー信号処理装
置の一実施例について、図と共に以下に説明する。本発
明は、トラッキングエラーのオフセット・バランス・ゲ
インの自動調整とトラッキングサーボゲインの位相補償
（フィルタ）の低域分をデジタル信号処理回路で行な
い、デジタル信号処理回路での実現が難しい高域分の位
相補償（フィルタ）をデジタル信号処理回路と並列接続
したアナログ位相補償回路で対応したものである。
置の一実施例について、図と共に以下に説明する。本発
明は、トラッキングエラーのオフセット・バランス・ゲ
インの自動調整とトラッキングサーボゲインの位相補償
（フィルタ）の低域分をデジタル信号処理回路で行な
い、デジタル信号処理回路での実現が難しい高域分の位
相補償（フィルタ）をデジタル信号処理回路と並列接続
したアナログ位相補償回路で対応したものである。
【００１０】図１は本発明のサーボエラー信号処理装置
のブロック構成を示したものである。このサーボエラー
信号処理装置１は、３のサーボエラー信号検出回路、４
のアナログ位相補償回路、５のＡ／Ｄ変換器、６のデジ
タル信号処理回路、７のＤ／Ａ変換器、及び、８の加算
器により構成されている。
のブロック構成を示したものである。このサーボエラー
信号処理装置１は、３のサーボエラー信号検出回路、４
のアナログ位相補償回路、５のＡ／Ｄ変換器、６のデジ
タル信号処理回路、７のＤ／Ａ変換器、及び、８の加算
器により構成されている。
【００１１】本発明は、サーボエラー信号検出回路３の
出力信号ａを並列に供給して、位相補償フィルタの低域
分をデジタル信号処理回路６に供給して演算し、位相補
償フィルタの高域分をアナログ位相補償回路４に供給し
て処理を行ない、デジタル信号処理回路６の出力信号ｄ
をＤ／Ａ変換器７によりＤ／Ａ変換された信号ｅとアナ
ログ位相補償回路４の出力信号ｂを加算する加算器８に
より目標とする位相補償フィルタを実現したものであ
る。
出力信号ａを並列に供給して、位相補償フィルタの低域
分をデジタル信号処理回路６に供給して演算し、位相補
償フィルタの高域分をアナログ位相補償回路４に供給し
て処理を行ない、デジタル信号処理回路６の出力信号ｄ
をＤ／Ａ変換器７によりＤ／Ａ変換された信号ｅとアナ
ログ位相補償回路４の出力信号ｂを加算する加算器８に
より目標とする位相補償フィルタを実現したものであ
る。
【００１２】加算器８の出力信号（ｂ＋ｅ）は、後段の
ドライブ回路（図示せず。）に接続されアクチュエータ
を駆動する。また、自動調整は、サーボエラー信号検出
回路３の出力ａからＡ／Ｄ変換器５によりＡ／Ｄ変換さ
れた信号ｃをデジタル信号処理回路６に供給して行なわ
れる。
ドライブ回路（図示せず。）に接続されアクチュエータ
を駆動する。また、自動調整は、サーボエラー信号検出
回路３の出力ａからＡ／Ｄ変換器５によりＡ／Ｄ変換さ
れた信号ｃをデジタル信号処理回路６に供給して行なわ
れる。
【００１３】サーボエラー信号は、入力端子２を介して
サーボエラー信号検出回路３に供給される。サーボエラ
ー信号検出回路３の出力信号ａは、並列に供給して、ア
ナログ位相補償回路４とＡ／Ｄ変換器５とに供給され
る。
サーボエラー信号検出回路３に供給される。サーボエラ
ー信号検出回路３の出力信号ａは、並列に供給して、ア
ナログ位相補償回路４とＡ／Ｄ変換器５とに供給され
る。
【００１４】ここで、トラッキングサーボゲインの位相
補償フィルタの低域分をサーボエラー信号処理装置１の
デジタル信号処理回路６で行なう。Ａ／Ｄ変換器５でＡ
／Ｄ変換された信号ｃは、デジタル信号処理回路６に供
給されて、位相補償（フィルタ）の低域分をデジタル信
号処理回路６により演算を行なう。ここでは、低域フィ
ルタを挿入して高域成分を除去する等の処理を行なう。
補償フィルタの低域分をサーボエラー信号処理装置１の
デジタル信号処理回路６で行なう。Ａ／Ｄ変換器５でＡ
／Ｄ変換された信号ｃは、デジタル信号処理回路６に供
給されて、位相補償（フィルタ）の低域分をデジタル信
号処理回路６により演算を行なう。ここでは、低域フィ
ルタを挿入して高域成分を除去する等の処理を行なう。
【００１５】デジタル信号処理回路６の出力信号ｄは、
Ｄ／Ａ変換器７に供給されてＤ／Ａ変換される。また、
サーボエラー信号検出回路３の出力信号ａは、同時にサ
ーボエラー信号処理装置１のアナログ位相補償回路４に
供給される。
Ｄ／Ａ変換器７に供給されてＤ／Ａ変換される。また、
サーボエラー信号検出回路３の出力信号ａは、同時にサ
ーボエラー信号処理装置１のアナログ位相補償回路４に
供給される。
【００１６】ここで、高密度光ディスクドライブや高速
回転を必要とするｎ倍速ＣＤ−ＲＯＭドライブ等高いサ
ーボ改善度を必要とする場合にデジタル信号処理回路６
での実現が難しい高域分の位相補償（フィルタ）をデジ
タル信号処理回路６と並列接続したアナログ位相補償回
路４でアナログ処理を行ない対応するものである。
回転を必要とするｎ倍速ＣＤ−ＲＯＭドライブ等高いサ
ーボ改善度を必要とする場合にデジタル信号処理回路６
での実現が難しい高域分の位相補償（フィルタ）をデジ
タル信号処理回路６と並列接続したアナログ位相補償回
路４でアナログ処理を行ない対応するものである。
【００１７】デジタル信号処理回路６の出力信号ｄをＤ
／Ａ変換器７によりＤ／Ａ変換された信号ｅとアナログ
位相補償回路４の出力信号ｂとを加算器８に供給して目
標とする位相補償（フィルタ）を実現している。
／Ａ変換器７によりＤ／Ａ変換された信号ｅとアナログ
位相補償回路４の出力信号ｂとを加算器８に供給して目
標とする位相補償（フィルタ）を実現している。
【００１８】加算器８の出力信号（ｂ＋ｅ）は、制御信
号出力端子９から後段のドライブ回路（図示せず。）に
供給されて、アクチュエータを駆動する。
号出力端子９から後段のドライブ回路（図示せず。）に
供給されて、アクチュエータを駆動する。
【００１９】図２に示した位相補償フィルタのボード線
図を使用して以下に説明する。図２のＸはトラッキング
サーボで必要とする位相補償フィルタのボード線図の一
例である。低域分を上げているのは定常安定性の改善
（偏芯成分を改善）であり、高域分を上げているのは過
渡特性を改善（位相余裕を確保）するためである。
図を使用して以下に説明する。図２のＸはトラッキング
サーボで必要とする位相補償フィルタのボード線図の一
例である。低域分を上げているのは定常安定性の改善
（偏芯成分を改善）であり、高域分を上げているのは過
渡特性を改善（位相余裕を確保）するためである。
【００２０】図２のＹはデジタル信号処理回路６にて構
成された位相補償フィルタの低域分のボード線図を示し
たものである。Ｚはアナログ位相補償回路４にて構成さ
れた位相補償フィルタの高域分のボード線図を示したも
のである。位相進み補償を行なうことにより位相余裕を
確保している。
成された位相補償フィルタの低域分のボード線図を示し
たものである。Ｚはアナログ位相補償回路４にて構成さ
れた位相補償フィルタの高域分のボード線図を示したも
のである。位相進み補償を行なうことにより位相余裕を
確保している。
【００２１】図２に示したＹ（デジタル信号処理回路６
側の出力ｅ）とＺ（アナログ位相補償回路４の出力ｂ）
とを加算器８により加算することにより、トラッキング
サーボで必要とする位相補償フィルタのボード線図Ｘを
実現している。
側の出力ｅ）とＺ（アナログ位相補償回路４の出力ｂ）
とを加算器８により加算することにより、トラッキング
サーボで必要とする位相補償フィルタのボード線図Ｘを
実現している。
【００２２】次に本発明のアナログ位相補償回路４の構
成例を図３に示す。図３は演算増幅器Ｑ１、コンデンサ
Ｃ１，Ｃ２、抵抗Ｒ１，Ｒ２，Ｒ３を使用して構成した
ものであり、簡単な回路構成で高域分の位相補償を実現
することが出来る。デジタル信号処理回路での実現が難
しい高域分の位相補償フィルタをデジタル信号処理回路
と並列接続したアナログ位相補償回路４で対応した一例
である。ここで、位相進み補償回路により位相余裕を増
加させている。
成例を図３に示す。図３は演算増幅器Ｑ１、コンデンサ
Ｃ１，Ｃ２、抵抗Ｒ１，Ｒ２，Ｒ３を使用して構成した
ものであり、簡単な回路構成で高域分の位相補償を実現
することが出来る。デジタル信号処理回路での実現が難
しい高域分の位相補償フィルタをデジタル信号処理回路
と並列接続したアナログ位相補償回路４で対応した一例
である。ここで、位相進み補償回路により位相余裕を増
加させている。
【００２３】以上のようして、位相補償フィルタを構成
するとデジタル信号処理回路のみで構成したときに問題
となるデジタル系の遅れ（サンプリング周波数、計算時
間遅れ）により位相余裕が取れなくなる、量子化誤差に
よりＤ／Ａの出力が飽和してしまうためにダイナミック
レンジに余裕がなくなるという問題を解消している。
するとデジタル信号処理回路のみで構成したときに問題
となるデジタル系の遅れ（サンプリング周波数、計算時
間遅れ）により位相余裕が取れなくなる、量子化誤差に
よりＤ／Ａの出力が飽和してしまうためにダイナミック
レンジに余裕がなくなるという問題を解消している。
【００２４】また、回路の追加は演算増幅器，Ｃ，Ｒで
済むうえに、デジタル信号処理回路のサンプリング周波
数を低く（小さく）することが可能となるためにコスト
ダウンすることが可能となる。
済むうえに、デジタル信号処理回路のサンプリング周波
数を低く（小さく）することが可能となるためにコスト
ダウンすることが可能となる。
【００２５】この実施例は、光ディスクドライブのトラ
ッキングについて述べたものであるが、勿論光ディスク
ドライブのフォーカスについても有効なものである。ま
た、光ディスク以外の磁気ディスクドライブや光磁気デ
ィスクドライブ等についても適用可能である。
ッキングについて述べたものであるが、勿論光ディスク
ドライブのフォーカスについても有効なものである。ま
た、光ディスク以外の磁気ディスクドライブや光磁気デ
ィスクドライブ等についても適用可能である。
【００２６】
【発明の効果】本発明は、トラッキングエラーのオフセ
ット・バランス・ゲインの自動調整とトラッキングサー
ボゲインの位相補償フィルタの低域分をデジタル信号処
理回路で行ない、デジタル信号処理回路での実現が難し
い高域分の位相補償フィルタをデジタル信号処理回路と
並列接続したアナログ位相補償回路で対応したものであ
り、下記の効果を有する。デジタル信号処理回路のみで
構成したときに問題となるデジタル系の遅れ（サンプリ
ング周波数、計算時間遅れ）により位相余裕が取れなく
なるという問題を解消することが出来る。
ット・バランス・ゲインの自動調整とトラッキングサー
ボゲインの位相補償フィルタの低域分をデジタル信号処
理回路で行ない、デジタル信号処理回路での実現が難し
い高域分の位相補償フィルタをデジタル信号処理回路と
並列接続したアナログ位相補償回路で対応したものであ
り、下記の効果を有する。デジタル信号処理回路のみで
構成したときに問題となるデジタル系の遅れ（サンプリ
ング周波数、計算時間遅れ）により位相余裕が取れなく
なるという問題を解消することが出来る。
【００２７】また、量子化誤差によりＤ／Ａの出力が飽
和してしまうためにダイナミックレンジに余裕がなくな
るという問題を解消することが出来る。
和してしまうためにダイナミックレンジに余裕がなくな
るという問題を解消することが出来る。
【図１】本発明のサーボエラー信号処理装置の一実施例
のブロック構成を示す図である。
のブロック構成を示す図である。
【図２】本発明のサーボエラー信号処理装置の位相補償
フィルタのボード線図である。
フィルタのボード線図である。
【図３】本発明のサーボエラー信号処理装置のアナログ
位相補償回路の一実施例である。
位相補償回路の一実施例である。
１ サーボエラー信号処理装置 ２ サーボエラー信号入力（端子） ３ サーボエラー信号検出回路 ４ アナログ位相補償回路 ５ Ａ／Ｄ変換器 ６ デジタル信号処理回路 ７ Ｄ／Ａ変換器 ８ 加算器 ９ 制御信号出力（端子） Ｃ１，Ｃ２ コンデンサ Ｒ１，Ｒ２，Ｒ３ 抵抗 Ｑ１ 演算増幅器 Ｘ トラッキングサーボで必要な位相補償フィルタのボ
ード線図の一例 Ｙ デジタル信号処理回路６にて構成された位相補償フ
ィルタの低域分のボード線図 Ｚ アナログ位相補償回路４にて構成された位相補償フ
ィルタの高域分のボード線図
ード線図の一例 Ｙ デジタル信号処理回路６にて構成された位相補償フ
ィルタの低域分のボード線図 Ｚ アナログ位相補償回路４にて構成された位相補償フ
ィルタの高域分のボード線図
Claims (2)
- 【請求項１】サーボエラー信号を検出するサーボエラー
信号検出回路と、 前記サーボエラー信号検出回路の出力が供給されて位相
補償の低域分の処理を行なうデジタル信号処理回路と、 前記サーボエラー信号検出回路の出力が供給されて位相
補償の高域分の処理を行なうアナログ位相補償回路と、 前記デジタル信号処理回路の出力と前記アナログ位相補
償回路の出力とを加算する加算器とを有して構成したこ
とを特徴とするサーボエラー信号処理装置。 - 【請求項２】前記請求項１に記載のサーボエラー信号処
理装置において、サーボエラー信号のオフセット・バラ
ンス・ゲインの自動調整を行ない、且つサーボゲイン交
点略３ｋＨｚ以上とすることを特徴とするサーボエラー
信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27623495A JPH0997114A (ja) | 1995-09-29 | 1995-09-29 | サーボエラー信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27623495A JPH0997114A (ja) | 1995-09-29 | 1995-09-29 | サーボエラー信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0997114A true JPH0997114A (ja) | 1997-04-08 |
Family
ID=17566572
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27623495A Pending JPH0997114A (ja) | 1995-09-29 | 1995-09-29 | サーボエラー信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0997114A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005300387A (ja) * | 2004-04-13 | 2005-10-27 | Mitsutoyo Corp | 微細表面性状検出装置 |
-
1995
- 1995-09-29 JP JP27623495A patent/JPH0997114A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005300387A (ja) * | 2004-04-13 | 2005-10-27 | Mitsutoyo Corp | 微細表面性状検出装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040419 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040625 |
|
| A02 | Decision of refusal |
Effective date: 20041102 Free format text: JAPANESE INTERMEDIATE CODE: A02 |