JPH09283654A - ガラスセラミック基板とその製造方法 - Google Patents
ガラスセラミック基板とその製造方法Info
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Abstract
(57)【要約】
【課題】 焼成中の金属イオンの移動を防ぎ、高密度に
配線された電気回路を有する基板においても、焼成時の
ショート不良を発生しない基板及びその製造方法を提供
する。 【解決手段】 電気的機能として独立すべき複数の回路
が接続された状態よりなる導体2をガラスセラミック絶
縁層1上に形成する工程と、前記導体2が形成されたガ
ラスセラミック絶縁層1を焼成する工程と、焼成後に前
記道体層2を独立した複数の回路に切断する工程とによ
り製造されたガラスセラミック基板、及びその製造方法
である。
配線された電気回路を有する基板においても、焼成時の
ショート不良を発生しない基板及びその製造方法を提供
する。 【解決手段】 電気的機能として独立すべき複数の回路
が接続された状態よりなる導体2をガラスセラミック絶
縁層1上に形成する工程と、前記導体2が形成されたガ
ラスセラミック絶縁層1を焼成する工程と、焼成後に前
記道体層2を独立した複数の回路に切断する工程とによ
り製造されたガラスセラミック基板、及びその製造方法
である。
Description
【0001】
【発明の属する技術分野】本発明はLSI素子を高密度
に実装するためのガラスセラミック基板、特に低温で焼
結できるガラスセラミック基板とその製造方法に関する
ものである。
に実装するためのガラスセラミック基板、特に低温で焼
結できるガラスセラミック基板とその製造方法に関する
ものである。
【0002】
【従来の技術】半導体技術の発展に伴い電子装置は、シ
ステムの小型化、高速化が益々要求されている。半導体
素子においては、VLSI、ULSIと高密度高集積化
され、これらをアッセンブリするための実装技術は極め
て高密度微細化が必要とされている。特に半導体素子を
搭載するための実装基板は配線密度の増大による微細配
線化とともに配線抵抗の低減化、高速化に対応した基板
材料の低誘電率化および高密度配線化が要求されてい
る。
ステムの小型化、高速化が益々要求されている。半導体
素子においては、VLSI、ULSIと高密度高集積化
され、これらをアッセンブリするための実装技術は極め
て高密度微細化が必要とされている。特に半導体素子を
搭載するための実装基板は配線密度の増大による微細配
線化とともに配線抵抗の低減化、高速化に対応した基板
材料の低誘電率化および高密度配線化が要求されてい
る。
【0003】これらの条件を満足するLSI搭載基板と
してAgやCuなどの低抵抗金属を配線導体とする低誘
電率のガラスセラミック多層基板が開発・実用化されて
きた。
してAgやCuなどの低抵抗金属を配線導体とする低誘
電率のガラスセラミック多層基板が開発・実用化されて
きた。
【0004】ガラスセラミック多層基板の製造方法は一
般にグリーンシート積層法による。ガラスとセラミック
の粉末を有機バインダーと混合しスラリー化した後、こ
れを乾燥しグリーンシート化する。このグリーンシート
にヴィアホールを形成し、導体ペーストを埋め込み、さ
らには必要な電気回路パターンをスクリーン印刷法によ
り形成する。これらのシートを積層圧着後、およそ85
0〜1000℃の温度で焼成してできあがる。
般にグリーンシート積層法による。ガラスとセラミック
の粉末を有機バインダーと混合しスラリー化した後、こ
れを乾燥しグリーンシート化する。このグリーンシート
にヴィアホールを形成し、導体ペーストを埋め込み、さ
らには必要な電気回路パターンをスクリーン印刷法によ
り形成する。これらのシートを積層圧着後、およそ85
0〜1000℃の温度で焼成してできあがる。
【0005】
【発明が解決しようとする課題】しかし、850〜10
00℃の高温においては、AgやCuの金属導体とガラ
スセラミックの間で酸化還元反応が生じるため、電子の
授受が発生する。このため接続されていない2つの独立
な電気回路の間に電位差が発生し、ガラス中をAgやC
uのイオンが電場に沿って移動して、やがては、2つの
独立な回路をショートさせてしまうという問題が起き
る。
00℃の高温においては、AgやCuの金属導体とガラ
スセラミックの間で酸化還元反応が生じるため、電子の
授受が発生する。このため接続されていない2つの独立
な電気回路の間に電位差が発生し、ガラス中をAgやC
uのイオンが電場に沿って移動して、やがては、2つの
独立な回路をショートさせてしまうという問題が起き
る。
【0006】すなわち、焼成前の積層体のときにはオー
プンしている2つの電気回路が焼成後にはショート不良
を起こしてしまっているか、あるいは極端に絶縁抵抗が
落ちているというような不良を発生させるのである。し
かも、それは配線が高密度になればなるほど顕著な現象
であった。
プンしている2つの電気回路が焼成後にはショート不良
を起こしてしまっているか、あるいは極端に絶縁抵抗が
落ちているというような不良を発生させるのである。し
かも、それは配線が高密度になればなるほど顕著な現象
であった。
【0007】本発明の目的は、このような焼成中の金属
イオンの移動を防ぎ、高密度に配線された電気回路を有
する基板においても、焼成時のショート不良を発生しな
い基板及びその製造方法を提供することにある。
イオンの移動を防ぎ、高密度に配線された電気回路を有
する基板においても、焼成時のショート不良を発生しな
い基板及びその製造方法を提供することにある。
【0008】
【課題を解決するための手段】本発明のガラスセラミッ
ク基板は、焼成前の積層体の段階で、基板内の独立した
電気回路同士を第1層において、すべて接続(プリショ
ート)した状態で製造したものである。
ク基板は、焼成前の積層体の段階で、基板内の独立した
電気回路同士を第1層において、すべて接続(プリショ
ート)した状態で製造したものである。
【0009】各回路をあらかじめ接続されたスクリーン
マスクを作製し、第1層の回路印刷の際にこのマスクを
使用することで、回路間の接続は容易に行える。これに
より、焼成中はすべての回路が電気的に同電位であるた
めに金属イオンの移動は全く発生せずに、焼成後の電気
的な不良を発生することもない。
マスクを作製し、第1層の回路印刷の際にこのマスクを
使用することで、回路間の接続は容易に行える。これに
より、焼成中はすべての回路が電気的に同電位であるた
めに金属イオンの移動は全く発生せずに、焼成後の電気
的な不良を発生することもない。
【0010】焼成後には、金属カッター、レーザー、な
どにより所定の位置の導体を切断することにより、独立
な回路は独立な状態にもどし、基板本来の電気的機能を
有する状態にする。
どにより所定の位置の導体を切断することにより、独立
な回路は独立な状態にもどし、基板本来の電気的機能を
有する状態にする。
【0011】本発明のガラスセラミック基板によれば、
従来問題となっていたイオン移動の駆動力が焼成工程に
おける850〜1000℃の温度下での回路間での電位
差発生によるものであるので、焼成時にこれらの回路間
を接続(プリショート)しておけば、電気的に同電位で
あるため、金属イオンの移動は全く起こらない。したが
って、焼成時のショート不良は発生しない。
従来問題となっていたイオン移動の駆動力が焼成工程に
おける850〜1000℃の温度下での回路間での電位
差発生によるものであるので、焼成時にこれらの回路間
を接続(プリショート)しておけば、電気的に同電位で
あるため、金属イオンの移動は全く起こらない。したが
って、焼成時のショート不良は発生しない。
【0012】
【発明の実施の形態】ガラスセラミック層を絶縁層1と
し、導体層2をAg、Cuとして、断面図が図1となる
ような評価基板を作製する。図中のxμm は、導体間の
距離を表す。さらにこの評価基板を上から見た図が図2
である。図2(a)は従来技術による基板であり、図2
(b)が本発明の基板である。焼成前には、プリショー
トしてあるが、焼成後に不要なパターンを取り除いてあ
る。
し、導体層2をAg、Cuとして、断面図が図1となる
ような評価基板を作製する。図中のxμm は、導体間の
距離を表す。さらにこの評価基板を上から見た図が図2
である。図2(a)は従来技術による基板であり、図2
(b)が本発明の基板である。焼成前には、プリショー
トしてあるが、焼成後に不要なパターンを取り除いてあ
る。
【0013】表1はこれらの基板を焼成した後に回路間
の電気抵抗を測定した結果を示している。表1からも明
らかなように、本発明により、電気的に信頼性の高いガ
ラスセラミック多層基板を容易に得ることができる。
の電気抵抗を測定した結果を示している。表1からも明
らかなように、本発明により、電気的に信頼性の高いガ
ラスセラミック多層基板を容易に得ることができる。
【0014】
【表1】
【0015】
【発明の効果】本発明によれば、高密度微細配線でしか
も高速化が期待できるガラスセラミック多層基板を、焼
成工程中に電気的不良を発生させず、高い信頼性を有し
た状態で提供することが可能である。
も高速化が期待できるガラスセラミック多層基板を、焼
成工程中に電気的不良を発生させず、高い信頼性を有し
た状態で提供することが可能である。
【図1】本発明の、ガラスセラミック層を絶縁層とし導
体層をAg、Cuとしてた評価基板の断面図である。
体層をAg、Cuとしてた評価基板の断面図である。
【図2】図1の評価基板を上から見た図であり、(a)
は従来技術による基板、(b)は本発明による基板を示
す図である。
は従来技術による基板、(b)は本発明による基板を示
す図である。
1 ガラスセラミック絶縁層 2 導体
Claims (3)
- 【請求項1】焼成前には接続されていたガラスセラミッ
ク絶縁層上の導体を、焼成後に切断することによって回
路を形成したことを特徴とするガラスセラミック基板。 - 【請求項2】焼成前には接続されていたガラスセラミッ
ク絶縁層上の導体を、焼成後に切断することによって回
路を形成し、さらにこれを積層することを特徴とするガ
ラスセラミック多層基板。 - 【請求項3】電気的機能として独立すべき複数の回路が
接続された状態よりなる導体をガラスセラミック絶縁層
上に形成する工程と、前記導体が形成されたガラスセラ
ミック絶縁層を焼成する工程と、焼成後に前記道体層を
独立した複数の回路に切断する工程とを有することを特
徴とするガラスセラミック基板の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8095414A JPH09283654A (ja) | 1996-04-17 | 1996-04-17 | ガラスセラミック基板とその製造方法 |
US08/842,778 US5948192A (en) | 1996-04-17 | 1997-04-17 | Glass-ceramic substrate and method of producing the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8095414A JPH09283654A (ja) | 1996-04-17 | 1996-04-17 | ガラスセラミック基板とその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH09283654A true JPH09283654A (ja) | 1997-10-31 |
Family
ID=14137032
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8095414A Pending JPH09283654A (ja) | 1996-04-17 | 1996-04-17 | ガラスセラミック基板とその製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US5948192A (ja) |
JP (1) | JPH09283654A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19961537B4 (de) * | 1998-12-24 | 2006-02-09 | Murata Mfg. Co., Ltd., Nagaokakyo | Verfahren zur Herstellung einer Glaskeramiktafel |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3407710B2 (ja) * | 2000-04-26 | 2003-05-19 | 株式会社村田製作所 | 誘電体線路の製造方法 |
US6916670B2 (en) * | 2003-02-04 | 2005-07-12 | International Business Machines Corporation | Electronic package repair process |
US20040230289A1 (en) * | 2003-05-15 | 2004-11-18 | Scimed Life Systems, Inc. | Sealable attachment of endovascular stent to graft |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02230790A (ja) * | 1989-03-03 | 1990-09-13 | Toshiba Corp | セラミックス回路基板の製造方法 |
JPH0778904A (ja) * | 1993-07-13 | 1995-03-20 | Matsushita Electric Works Ltd | プリント配線板の製造方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5148166A (en) * | 1974-10-22 | 1976-04-24 | Nippon Electric Co | Tasohaisenkibanno seizohoho |
US4221047A (en) * | 1979-03-23 | 1980-09-09 | International Business Machines Corporation | Multilayered glass-ceramic substrate for mounting of semiconductor device |
US4681656A (en) * | 1983-02-22 | 1987-07-21 | Byrum James E | IC carrier system |
JPH04221888A (ja) * | 1990-12-21 | 1992-08-12 | Matsushita Electric Ind Co Ltd | セラミック配線基板とその製造方法 |
US5292624A (en) * | 1992-09-14 | 1994-03-08 | International Technology Research Institute | Method for forming a metallurgical interconnection layer package for a multilayer ceramic substrate |
-
1996
- 1996-04-17 JP JP8095414A patent/JPH09283654A/ja active Pending
-
1997
- 1997-04-17 US US08/842,778 patent/US5948192A/en not_active Expired - Lifetime
Patent Citations (2)
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JPH02230790A (ja) * | 1989-03-03 | 1990-09-13 | Toshiba Corp | セラミックス回路基板の製造方法 |
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DE19961537B4 (de) * | 1998-12-24 | 2006-02-09 | Murata Mfg. Co., Ltd., Nagaokakyo | Verfahren zur Herstellung einer Glaskeramiktafel |
Also Published As
Publication number | Publication date |
---|---|
US5948192A (en) | 1999-09-07 |
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Legal Events
Date | Code | Title | Description |
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A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19990615 |