JPH09187029A - Dcレベルシフト回路 - Google Patents
Dcレベルシフト回路Info
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- JPH09187029A JPH09187029A JP7341605A JP34160595A JPH09187029A JP H09187029 A JPH09187029 A JP H09187029A JP 7341605 A JP7341605 A JP 7341605A JP 34160595 A JP34160595 A JP 34160595A JP H09187029 A JPH09187029 A JP H09187029A
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- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
- H04N9/72—Circuits for processing colour signals for reinsertion of DC and slowly varying components of colour signals
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- H04N9/77—Circuits for processing the brightness signal and the chrominance signal relative to each other, e.g. adjusting the phase of the brightness signal relative to the colour signal, correcting differential gain or differential phase
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Abstract
電位をシフトすることを目的とする。 【解決手段】 文字信号挿入回路5の直流電位に応じ
て、Y/C信号処理回路4からの輝度信号の直流電位を
シフトさせる定電流回路6、あるいはカレントミラー回
路と、定電流回路6の出力を一旦バッファし、次段の文
字信号挿入回路5へ不要な電気的影響を防止するバッフ
ァ回路7と、から構成される。
Description
号を接続するインタフェース回路、特に、輝度信号の直
流電位をシフトさせるDCレベルシフト回路に関する。
ある。VTR等において、Y/C信号分離回路4から出
力された輝度信号(Y)、あるいは複合映像信号をクラ
ンプ回路8を介し、Y/C信号ミックス回路(図示せ
ず)で加算して、文字信号挿入回路5に入力し、ここで
複合映像信号から分離した同期信号に同期してビデオス
イッチ(図示せず)を切り替えて、複合映像信号に文字
信号をスーパーインポーズする。
直、水平同期信号の分離やA/D変換等を行うときに複
合映像信号の黒レベルを一定にすることで、直流再生と
もいう。図4の(b)に示すように、クランプは、ピー
ク値をクランプするピーククランプと同期信号をクラン
プするシンクチップ・クランプがある。映像信号の輝度
信号の部分ではトランジスタTR4はオフになったまま
で、同期信号の部分でトランジスタTR4がオンになっ
てコンデンサC+ が充電される。そして再びオフになる
と充電した電荷を放電する。この電圧レベルがシンクチ
ップ・クランプレベルに固定され、結果として直流電位
が再生される。
では、Y/C信号処理回路4と文字信号挿入回路5との
間にクランプ回路8を挿入しており、R3及びTR5の
入力インピーダンスとC + でLPFを構成して周波数特
性が悪化し、その結果、垂直同期信号にサグが発生し画
質が劣化するという問題点があった。
で、図4の(c)に示すように、方形波の平坦部が傾斜
して生ずる歪みのことである。主に低周波特性の劣化に
よって生ずる。
DCレベルシフト回路の基本構成を示す図である。既に
図5で説明した同様の構成には、同一の参照番号あるい
は記号を付して示す。本発明の基本構成は、従来の回路
とは異なりクランプ回路8の代わりに複合映像信号、よ
り正確にいえば輝度信号の直流電位をシフトさせるDC
レベルシフト回路を挿入している。
号のDCレベルをシフトさせて得た結果は、ほぼ同じ結
果が得られ、周波数特性の劣化もなく動作も高速であ
る。ただしクランプの場合は、輝度信号のシンクレベル
を固定して直流電位を決定するが、本発明のDCレベル
シフト回路は、輝度信号全体シフトさせて直流電位を決
定している点が異なる。
形態を示す図である。この実施形態による要旨は次の点
にある。本発明の実施形態によれば、電源電圧や温度変
化にかかわらず常に一定の電流を送出する定電流回路
6、あるいはカレントミラー回路と、次段の文字信号挿
入回路5への不要な電気的影響を防止するバッファ回路
7とから構成される。
詳しく説明する。第1のトランジスタTR1と第2のト
ランジスタTR2とで定電流回路6を構成している。こ
こで定電流回路6はカレントミラー回路である。カレン
トミラーとは、2つのトランジスタを電気的、温度特性
的にほぼ同じ特性にすると、両方のトランジスタのV VE
(ベース−エミッタ間電圧)は同じになり、第1のトラ
ンジスタTR1のコレクタに入力する電流と第2のトラ
ンジスタTR2のコレクタから出力される電流が同じに
なる。定電流回路6は、電源電圧や温度の変動に対し電
流を一定にする機能がある。Y/C信号処理回路4の出
力をDCレベルシフト回路の第1のトランジスタTR1
のコレクタに入力したY信号(同期信号を含む)は、第
1のトランジスタTR1のベースから第2のトランジス
タのTR2のベースに入りコレクタから出力される。こ
のとき、第1の抵抗R1と第2のトランジスタTR2に
流れる電流Iによりa点の直流電位が図4に示すよう
に、R1×I(V)降下する。第2の抵抗R2の値を大
きくすると直流電位のレベルが低くなり、第2の抵抗R
2の値を小さくすると直流電位のレベルが高くなる。
る理由は、Y/C信号処理回路4の複合映像信号の直流
電位はすでに固定されているが、この電位では、集積回
路化されている文字信号挿入回路5には多少電位が高く
最適に動作できないため、直流電位を降下させる必要が
あるから、画面の明るさ、すなわち輝度を低下させて適
度な画面の明るさにするためである。
低くなると文字信号の輝度レベルが低くなり、直流電位
が高くなると文字信号の輝度レベルが高くなるという相
関関係がある。一般に、容量結合した増幅回路を用いる
と、直流成分が失われ複合映像信号の黒レベルが変動す
る。複合映像信号が水平同期信号の最低レベルでシンク
チップ・クランプされていると、文字信号の輝度レベル
は、複合映像信号のペデスタル・レベル以上の電圧でな
ければならない。
ランジスタTR3と第3の抵抗R3で構成されるバッフ
ァ7を経て文字信号挿入回路5に供給される。図3は、
本発明に係わる第2実施形態を示す図である。この第2
実施形態は第1実施形態と回路構成は同じである。第1
実施形態では、DCレベルシフト回路の入力先がY/C
信号処理回路4、出力先が文字信号挿入回路5になって
いたのが、第2実施形態では、複合映像信号処理回路9
と同期信号分離回路やA/D変換回路10などの間に追
加することが可能である。同期信号分離やA/D変換を
行うときにも同様に直流電位を固定する必要がある。も
し、直流電位が一定でなく絶えず変動すると正常な信号
処理を行うことができなくなる。第2実施形態の詳細な
回路動作は第1実施形態と同じなので省略する。
次のような顕著な効果を有する。 (i)電源投入時など、クランプ回路8の追加時の欠点
である直流電位が固定されるまでの時間がかからない。 (ii)周波数特性の劣化による垂直同期信号のサグの
発生を防ぐことができる。
成を示すブロック図である。
施形態を示す回路図である。
施形態を示す回路図である。
の発生を示す説明図である。
回路図である。
Claims (4)
- 【請求項1】 輝度・色信号(Y/C)処理回路(4)
と文字信号挿入回路(5)との間に設けられ、直流電位
を再設定するためのDCレべルシフト回路において、 文字信号挿入回路(5)の直流電位に応じて、輝度・色
信号(Y/C)処理回路(4)からの直流電位をシフト
させる定電流手段(1)と、 前記定電流手段(1)の出力を一旦バッファし、不要な
電気的影響を防止する緩衝手段(2)と、を具備するこ
とを特徴とするDCレベルシフト回路。 - 【請求項2】 輝度・色信号処理回路(4)と文字信号
挿入回路(5)との間に設けられるDCレベルシフト回
路であって、 映像信号の交流成分を変化させずに直流電位をシフトさ
せる定電流回路(1)と、前記定電流回路(1)の出力
を一旦バッファし、次段への不要な電気的影響を防止す
るバッファ回路(2)とを備えることを特徴とするDC
レベルシフト回路。 - 【請求項3】 前記定電流回路(1)は、前記輝度・色
信号処理回路(4)に直列に接続した第1の抵抗(R
1)と、電源(Vcc)とコレクタとの間に接続された
第2の抵抗(R2)と、前記コレクタとベースを短絡
し、エミッタを接地した第1のトランジスタ(TR1)
と、前記第1のトランジスタ(TR1)のベースにベー
スが共通接続され、コレクタと前記第1の抵抗が接続さ
れた第2のトランジスタ(TR2)と、を具備する請求
項2に記載のDCレベルシフト回路。 - 【請求項4】 前記バッファ回路(2)は、前記第1の
抵抗(R1)と前記第2のトランジスタ(TR2)のコ
レクタ出力にベースを共通接続し、コレクタを接地した
第3のトランジスタ(TR3)と、前記第3のトランジ
スタ(TR3)のエミッタに接続され、エミッタと第3
の抵抗(R3)の共通接点を前記文字信号挿入回路
(5)の入力に接続した第3の抵抗(R3)と、を具備
する請求項2に記載のDCレベルシフト回路。
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- 1995-12-27 JP JP34160595A patent/JP3759646B2/ja not_active Expired - Fee Related
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