JPH08977B2 - プラズマcvd法及び装置 - Google Patents
プラズマcvd法及び装置Info
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- JPH08977B2 JPH08977B2 JP3211126A JP21112691A JPH08977B2 JP H08977 B2 JPH08977 B2 JP H08977B2 JP 3211126 A JP3211126 A JP 3211126A JP 21112691 A JP21112691 A JP 21112691A JP H08977 B2 JPH08977 B2 JP H08977B2
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Description
マ化し、このプラズマのもとで被成膜基板上に薄膜を形
成するプラズマCVD法及び装置に関する。
ン(a−Si)太陽電池、液晶表示装置等の各種薄膜デ
バイスの形成に広く利用されている。プラズマCVD装
置は代表的には、真空成膜室、該室中に設けた高周波電
極及びこれに対向する接地電極を備えており、この成膜
室に原料ガスを導入するとともに所定の成膜真空度を維
持しつつ、前記両電極間に高周波電力(通常、サイン 波
高周波電力)を印加して原料ガスをプラズマ化させるこ
とで、接地電極上の基板に所望の薄膜を形成するもので
ある。 このようなプラズマCVD方法及び装置では、成
膜基板上にダストが付着することを防止するため、プラ
ズマCVD装置の成膜室への基板搬送系や成膜室におけ
る基板の各配置を、ダスト発生が少なくなるように工夫
している。また、ダスト発生を抑制するため、成膜条件
を工夫したり、成膜室への基板の設置時や装置の運転の
合間に成膜室内電極や基板搬送系等を清掃することも行
われており、これらによって例えば液晶表示基板上の成
膜ではかなりの効果があがっている。
マCVDにより、例えば原料ガスにシラン(SiH 4 )
を使ってガラス等の基板上にアモルファスシリコン(a
−Si)膜を形成すると、たとえ前述の如く、ダスト発
生の少ない条件を設定しても、該成膜中に基板にダスト
が付着する。これは、本発明者の研究によると、たと
え、ダストが生成される最低のミニマムダストの条件で
成膜しても、その成膜中に、なお、基板に近い領域のプ
ラズマにミニマムダストが蓄積されるからである。
がプラズマ化されることによりSiH3 ラジカル、Si
H2 ラジカル、SiHラジカルが生成されるが、(a−
Si)膜の形成には主としてSiH3 ラジカルが寄与
し、SiH2 ラジカルやSiHラジカルといった低シラ
ン系ラジカルはSiH4 と反応して高次シランSixH
yが生成され、これがダストパーティクルになると考え
られる。
化し、このプラズマのもとで被成膜基板上に薄膜を形成
するプラズマCVD法及び装置において、成膜反応に寄
与するラジカル種の生成を妨げず、しかもダスト発生の
原因となるラジカル種の発生を選択的に抑制して、所望
の成膜速度を維持したまま、ダストの基板上成膜部への
付着、混入を抑制することを目的とする。
程を支配するプラズマ中には、前述のとおり多くのラジ
カルが存在し、また、イオンが存在する。プラズマ中に
おけるエネルギー交換、ラジカル生成の主役は電子であ
り、電界により加速された電子が、イオンや中性粒子と
衝突を繰り返し、多種多様のイオン、ラジカルが生成さ
れる。従ってプラズマCVD法及び装置においては、イ
オン、ラジカル制御は電子(エネルギー又は密度)制御
により制御でき、これを制御することで、生成される各
種ラジカルのうち、成膜反応に不必要なラジカルの発生
を抑制し、成膜反応に必要なラジカルのみを増加させ得
ると考えられる。
ズマ中における電子エネルギーや密度は生成される各種
ラジカルの密度の空間分布により決定されること、換言
すると、プラズマ中における電子エネルギーが各種イオ
ン、ラジカルの生成に関係することに着目するととも
に、各種ラジカル密度の比はプラズマ発生のための高周
波入力(RF入力)のオン時、オフ時からの時間遷移を
持つこと、すなわち、例えば原料ガスがSiH4 の場
合、成膜反応に利用すべきSiH3 ラジカルは、プラズ
マ発生のための高周波入力オンにより、ダスト発生の原
因となるSiH2 ラジカルやSiHラジカルとともに増
加するが、高周波入力オフ後、SiH3 ラジカルは寿命
が比較的長いのに対し、SiH2 ラジカルやSiHラジ
カルは寿命が短いことに着目した。さらに、電子エネル
ギー或いは密度は、図5に示すように、高周波入力オン
にともない急速に立ち上がり、再び急速に降下して一定
となることに着目し、結論として、原料ガスへの高周波
電力印加の時間間隔を制御することで成膜反応に不必要
なラジカルの発生を選択的に抑制し、成膜反応に必要な
ラジカルのみを選択的に増加させ得ることを見出し、本
発明を完成した。
ため、成膜原料ガスをプラズマ化し、該プラズマのもと
で被成膜基板上に薄膜を形成するプラズマCVD法にお
いて、前記原料ガスのプラズマ化を、所定周波数の高周
波電力に1kHz以下の第1のパルス変調及び該変調よ
り短い周期をもつ第2のパルス変調を重畳させてオン・
オフの繰り返しを伴った状態とした高周波電力の印加に
より行うことを特徴とするプラズマCVD法、及び成膜
原料ガスをプラズマ化し、該プラズマのもとで被成膜基
板上に薄膜を形成するプラズマCVD装置において、前
記原料ガスのプラズマ化のための高周波電力印加手段
が、所定周波数の高周波電力に1kHz以下の第1のパ
ルス変調及び該変調より短い周期をもつ第2のパルス変
調を重畳させてオン・オフの繰り返しを伴った状態とし
た高周波電力を印加するものであることを特徴とするプ
ラズマCVD装置を提供するものである。
基板温度、原料ガス種等の多くのパラメーターにより、
随時変化させる必要があるが、一般的には、前記第1の
パルス変調は1kHz以下の条件とすることが考えられ
る。周期が1kHz相当のものより短いと、不必要なラ
ジカル種発生を抑制し難い。一方、必要なラジカル種を
十分増加させる上で、例えば400Hz以上とすること
が考えられる。また、必要なラジカル種を選択的に増加
させ、不必要なラジカル種の発生、残存を選択的に抑制
するうえで、前記第2のパルス変調におけるオンタイム
T1を0.5μsec<T1<100μsecの範囲
で、オフタイムT2を3μsec<T2<100μse
cの範囲で選択決定することが代表的な例として考えら
れる。なお、本明細書において「μsec」は「10 -6
秒」を意味している。
所定周波数の高周波電力に1kHz以下の第1のパルス
変調及び該変調より短い周期をもつ第2のパルス変調を
重畳させてオン・オフの繰り返しを伴う状態とされた高
周波電力が原料ガスに印加され、各電力印加オン時にお
ける電子エネルギー・密度の急速且つ一時的な立ち上が
り及び各電力オフ時の成膜反応に不必要なラジカルの比
較的速やかな消滅とにより、成膜反応に必要なラジカル
種が選択的に発生、増加する一方、成膜反応に不必要な
ラジカル種の発生が抑制された状態で、基板上に所望の
薄膜が形成される。このように、成膜中、成膜反応に不
必要なラジカル種の発生が抑制されることでダストパー
ティクルの発生率は激減し、且つ、成膜反応に必要なラ
ジカル種は選択的に発生、増加することで所望の成膜速
度が得られる。
する。図1は本発明方法の実施に使用するプラズマCV
D装置の一例の概略断面を示している。図示の装置は、
真空チャンバ1、該チャンバに電磁弁21を介して接続
した真空ポンプ2、チャンバ1内に設置した電極3、
4、チャンバ1に接続した成膜用ガス源5及び電磁弁6
1を介して接続したベント用ガス源6を備えている。
度調節用のヒータ31が付設されている。電極4にはそ
れ自体既に知られているマッチングボックス8を介して
高周波電源7から高周波電圧が印加される。これら電極
3、4は、基板9へのダスト付着を少なくするため、い
ずれも垂直に配置してある。
が可能な高周波信号発生器71及び高周波増幅器(RF
パワーアンプ)72を有しており、本発明に従って、所
定周波数の高周波に400Hz〜1kHzの第1のパル
ス変調及び該変調より短い周期をもつ第2のパルス変調
を重畳させてオン・オフを伴った状態の高周波電力を印
加できるように構成してある。第2のパルス変調では、
本発明に従い、オンタイム(On−Time)T1を
0.5μsec<T1<100μsecの範囲から、オ
フタイム(Off−Time)T2を3μsec<T2
<100μsecの範囲から選択決定できる。
オフ状態は図2の(A)に示すようになり、第2パルス
変調による高周波入力のオン、オフ状態は図2の(B)
下段に概略的に示すようになる。以上説明した装置によ
ると、本発明方法は次のように実施される。先ず、成膜
すべき基板9を装着したトレー10を電極3上に設置す
る。しかるのち、チャンバ1内を電磁弁21の開成とポ
ンプ2の運転にて所定圧まで真空引きし、成膜用ガス源
5から成膜用原料ガスをチャンバ内に導入する。次い
で、電源7にてこのガスに第1及び第2パルス変調され
た高周波電力を印加し、プラズマ化させ、基板9上に成
膜させる。成膜後、電磁弁61を開いてベントガス源6
からチャンバ内へベントガス(例えばN2 ガス)を導入
してベント処理したのち、基板9をチャンバ1から取り
出す。或いは、チャンバ1内の真空を維持したまま、基
板9をトレー10ごと、次のプロセスチャンバへ移動さ
せることも考えられる。
ン・オフを繰り返す、第1及び第2パルス変調された高
周波電力が印加されるので、各電力印加オン時における
電子エネルギー・密度の急速且つ一時的な立ち上がり及
び各電力オフ時の成膜反応に不必要なラジカルの比較的
速やかな消滅とにより、成膜反応に必要なラジカル種が
選択的に発生、増加する一方、成膜反応に不必要なラジ
カル種の発生が抑制された状態で、基板9上に所望の薄
膜が形成される。このように、成膜中、成膜反応に不必
要なラジカル種の発生が抑制されることでダストパーテ
ィクルの発生率は激減し、且つ、成膜反応に必要なラジ
カル種が選択的に発生、増加することで成膜速度が向上
し、また、プラズマエネルギー或いは密度の制御により
良質な成膜を行える。
図2の(A)に示すように、ダストパーティクルの発生
率は高いが、第2パルス変調も重畳するときは、図2の
(B)に示すように、ダストパーティクルの発生率は著
しく低下する。また、前記実施例によると、原料ガス流
量やプラズマ発生のための投入パワーを増加させても、
ダスト発生の増加が抑制されるので、それだけ成膜速度
を向上させることができる。
間の最適条件で成膜した膜は、物理的特性(バンドギャ
ップ、キャリア移動度等)の安定した特性が得られる。
以上説明した方法及び装置に基づき、次の具体的条件で
ガラス基板上に厚さ500〜1000Åのアモルファス
シリコン(a−Si)膜を形成したところ、該膜上に実
用上問題となるダストの付着は殆ど見られず、成膜時間
もパルス変調無しで、他の条件を同一とした成膜時より
短縮された。
00〜250℃ 電極3、4 :300mm角 高周波電力 :200〜500W、13.56MHzの
サイン波連続高周波電 力 第1パルス変調条件 :400〜1000Hz 第2パルス変調 :オンタイムT1 10μsec オフタイムT2 20μsec チャンバ1の成膜時真空度 :0.5〜1Torr 原料ガス :シラン、水素、不活性ガス 400scc
m以下 成膜に要した時間 :5〜10分 その他 :基板−電極間隔 4cm なお、本発明は前記実施例に限定されるものではなく、
他にも種々の態様で実施できる。例えば、高周波電源7
は、図3や図4に示すように構成してもよく、或いは、
さらに他の構成としてもよい。
からの第1パルス変調された高周波出力を、アナログス
イッチAS、RFパワーアンプ74及びマッチングボッ
クス81を介して供給するように構成する一方、アナロ
グスイッチASを、位相同期回路75にてパルス信号の
同期をとりつつパルス信号発生器76にて操作すること
で第2パルス変調を行うようにしたものである。
からの高周波出力をアナログスイッチAS1及びAS2
を介してRFパワーアンプ78及びマッチングポックス
82を介して供給するように構成する一方、アナログス
イッチAS1及びAS2を、位相同期回路79にてパル
ス信号の同期をとりつつパルス信号発生器801、80
2にて操作することで第1及び第2パルス変調を行うよ
うにしたものである。
D法及び装置には次のような利点がある。 成膜反応に寄与するラジカル種の生成を妨げず、し
かもダスト発生の原因となるラジカル種の発生を選択的
に抑制して、所望の成膜速度を維持したまま、ダストの
基板上成膜部への付着、混入を抑制することができる。 ガス流量や、原料ガスプラズマ化のための投入パワ
ーを増加させても、ダストの発生率の増加を引き起こさ
ないので、それだけ成膜速度を向上させることができ
る。 装置の大幅な改造を必要としないため、装置コス
ト、成膜コストが安価に抑制される。 ダストの発生が抑制されるため、装置のメインテナ
ンス性の向上が得られる。
VD装置の一例の概略断面図である。
る。
ある。
化を示すグラフである。
Claims (3)
- 【請求項1】 成膜原料ガスをプラズマ化し、該プラズ
マのもとで被成膜基板上に薄膜を形成するプラズマCV
D法において、前記原料ガスのプラズマ化を、所定周波
数の高周波電力に1kHz以下の第1のパルス変調及び
該変調より短い周期をもつ第2のパルス変調を重畳させ
てオン・オフの繰り返しを伴った状態とした高周波電力
の印加により行うことを特徴とするプラズマCVD法。 - 【請求項2】 前記第2のパルス変調におけるオンタイ
ムT1が0.5μsec<T1<100μsecの範囲
にあり、オフタイムT2が3μsec<T2<100μ
secの範囲にある請求項1記載のプラズマCVD法。 - 【請求項3】 成膜原料ガスをプラズマ化し、該プラズ
マのもとで被成膜基板上に薄膜を形成するプラズマCV
D装置において、前記原料ガスのプラズマ化のための高
周波電力印加手段が、所定周波数の高周波電力に1kH
z以下の第1のパルス変調及び該変調より短い周期をも
つ第2のパルス変調を重畳させてオン・オフの繰り返し
を伴った状態とした高周波電力を印加するものであるこ
とを特徴とするプラズマCVD装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP3211126A JPH08977B2 (ja) | 1991-08-22 | 1991-08-22 | プラズマcvd法及び装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP3211126A JPH08977B2 (ja) | 1991-08-22 | 1991-08-22 | プラズマcvd法及び装置 |
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JPH0551753A JPH0551753A (ja) | 1993-03-02 |
JPH08977B2 true JPH08977B2 (ja) | 1996-01-10 |
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ID=16600825
Family Applications (1)
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JP3211126A Expired - Fee Related JPH08977B2 (ja) | 1991-08-22 | 1991-08-22 | プラズマcvd法及び装置 |
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-
1991
- 1991-08-22 JP JP3211126A patent/JPH08977B2/ja not_active Expired - Fee Related
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