JPH0855881A - Packaging structure of microelectronics device and manufacture thereof - Google Patents
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- 238000004377 microelectronic Methods 0.000 title claims description 80
- 238000004519 manufacturing process Methods 0.000 title claims description 19
- 238000004806 packaging method and process Methods 0.000 title 1
- 238000000034 method Methods 0.000 claims description 192
- 239000010410 layer Substances 0.000 claims description 152
- 239000000463 material Substances 0.000 claims description 59
- 239000011810 insulating material Substances 0.000 claims description 33
- 239000004065 semiconductor Substances 0.000 claims description 27
- 229910052737 gold Inorganic materials 0.000 claims description 25
- 239000010931 gold Substances 0.000 claims description 25
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 claims description 22
- 229910052751 metal Inorganic materials 0.000 claims description 20
- 239000002184 metal Substances 0.000 claims description 20
- 238000005520 cutting process Methods 0.000 claims description 18
- 230000003014 reinforcing effect Effects 0.000 claims description 17
- 230000009969 flowable effect Effects 0.000 claims description 14
- 238000000465 moulding Methods 0.000 claims description 14
- 230000015572 biosynthetic process Effects 0.000 claims description 13
- 239000000853 adhesive Substances 0.000 claims description 11
- 230000001070 adhesive effect Effects 0.000 claims description 11
- 239000012530 fluid Substances 0.000 claims description 11
- 239000011247 coating layer Substances 0.000 claims description 9
- 238000003825 pressing Methods 0.000 claims description 9
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 claims description 8
- 229910052718 tin Inorganic materials 0.000 claims description 8
- 238000005304 joining Methods 0.000 claims description 6
- 229910052710 silicon Inorganic materials 0.000 claims description 6
- 239000010703 silicon Substances 0.000 claims description 6
- 238000010438 heat treatment Methods 0.000 claims description 5
- 239000011888 foil Substances 0.000 claims description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 3
- 230000000712 assembly Effects 0.000 claims description 3
- 238000000429 assembly Methods 0.000 claims description 3
- 238000006073 displacement reaction Methods 0.000 claims description 3
- 229910052732 germanium Inorganic materials 0.000 claims description 3
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 claims description 3
- 238000000151 deposition Methods 0.000 claims description 2
- 239000003550 marker Substances 0.000 claims 1
- 238000002360 preparation method Methods 0.000 claims 1
- 235000012431 wafers Nutrition 0.000 description 85
- 230000008569 process Effects 0.000 description 61
- 229910052802 copper Inorganic materials 0.000 description 34
- 239000010949 copper Substances 0.000 description 34
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical group [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 32
- 239000000758 substrate Substances 0.000 description 32
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 26
- 229910000679 solder Inorganic materials 0.000 description 26
- 230000036961 partial effect Effects 0.000 description 25
- 229910052759 nickel Inorganic materials 0.000 description 13
- 230000004048 modification Effects 0.000 description 12
- 238000012986 modification Methods 0.000 description 12
- 238000005530 etching Methods 0.000 description 10
- 239000004020 conductor Substances 0.000 description 9
- 238000012360 testing method Methods 0.000 description 9
- 238000009413 insulation Methods 0.000 description 7
- 238000007747 plating Methods 0.000 description 7
- 238000005476 soldering Methods 0.000 description 7
- 239000002344 surface layer Substances 0.000 description 7
- 230000008901 benefit Effects 0.000 description 6
- 239000006023 eutectic alloy Substances 0.000 description 6
- 230000035882 stress Effects 0.000 description 6
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 5
- 239000000203 mixture Substances 0.000 description 5
- 229920001296 polysiloxane Polymers 0.000 description 5
- 230000000694 effects Effects 0.000 description 4
- 238000007772 electroless plating Methods 0.000 description 4
- 229910052750 molybdenum Inorganic materials 0.000 description 4
- 239000011733 molybdenum Substances 0.000 description 4
- 230000009471 action Effects 0.000 description 3
- 230000008602 contraction Effects 0.000 description 3
- 238000001723 curing Methods 0.000 description 3
- 238000009713 electroplating Methods 0.000 description 3
- 230000004907 flux Effects 0.000 description 3
- 150000002343 gold Chemical class 0.000 description 3
- 239000007769 metal material Substances 0.000 description 3
- 229920000642 polymer Polymers 0.000 description 3
- 238000012545 processing Methods 0.000 description 3
- 229910021591 Copper(I) chloride Inorganic materials 0.000 description 2
- 229910000881 Cu alloy Inorganic materials 0.000 description 2
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 2
- 239000004820 Pressure-sensitive adhesive Substances 0.000 description 2
- PPBRXRYQALVLMV-UHFFFAOYSA-N Styrene Chemical compound C=CC1=CC=CC=C1 PPBRXRYQALVLMV-UHFFFAOYSA-N 0.000 description 2
- 238000000137 annealing Methods 0.000 description 2
- 239000011248 coating agent Substances 0.000 description 2
- 238000000576 coating method Methods 0.000 description 2
- 150000001879 copper Chemical class 0.000 description 2
- OXBLHERUFWYNTN-UHFFFAOYSA-M copper(I) chloride Chemical compound [Cu]Cl OXBLHERUFWYNTN-UHFFFAOYSA-M 0.000 description 2
- 238000011161 development Methods 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 229920001971 elastomer Polymers 0.000 description 2
- 239000000806 elastomer Substances 0.000 description 2
- 238000004070 electrodeposition Methods 0.000 description 2
- 230000006872 improvement Effects 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- 239000007788 liquid Substances 0.000 description 2
- 230000000873 masking effect Effects 0.000 description 2
- 229920001721 polyimide Polymers 0.000 description 2
- 239000000523 sample Substances 0.000 description 2
- 230000008685 targeting Effects 0.000 description 2
- 229910001369 Brass Inorganic materials 0.000 description 1
- 241001391944 Commicarpus scandens Species 0.000 description 1
- 241000784732 Lycaena phlaeas Species 0.000 description 1
- 239000004642 Polyimide Substances 0.000 description 1
- 238000002679 ablation Methods 0.000 description 1
- 230000001133 acceleration Effects 0.000 description 1
- 230000003213 activating effect Effects 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 239000002313 adhesive film Substances 0.000 description 1
- 229910052782 aluminium Chemical group 0.000 description 1
- 230000003064 anti-oxidating effect Effects 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 238000003491 array Methods 0.000 description 1
- 235000013405 beer Nutrition 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 239000010951 brass Substances 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 229920001577 copolymer Polymers 0.000 description 1
- 230000007797 corrosion Effects 0.000 description 1
- 238000005260 corrosion Methods 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 230000009849 deactivation Effects 0.000 description 1
- 238000007598 dipping method Methods 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 230000005496 eutectics Effects 0.000 description 1
- 238000009432 framing Methods 0.000 description 1
- 230000008014 freezing Effects 0.000 description 1
- 238000007710 freezing Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- JVPLOXQKFGYFMN-UHFFFAOYSA-N gold tin Chemical compound [Sn].[Au] JVPLOXQKFGYFMN-UHFFFAOYSA-N 0.000 description 1
- 230000005484 gravity Effects 0.000 description 1
- 239000003779 heat-resistant material Substances 0.000 description 1
- 238000009434 installation Methods 0.000 description 1
- 238000010030 laminating Methods 0.000 description 1
- 239000011133 lead Substances 0.000 description 1
- LQBJWKCYZGMFEV-UHFFFAOYSA-N lead tin Chemical compound [Sn].[Pb] LQBJWKCYZGMFEV-UHFFFAOYSA-N 0.000 description 1
- WABPQHHGFIMREM-FTXFMUIASA-N lead-202 Chemical compound [202Pb] WABPQHHGFIMREM-FTXFMUIASA-N 0.000 description 1
- 230000000670 limiting effect Effects 0.000 description 1
- 239000007791 liquid phase Substances 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- 230000007246 mechanism Effects 0.000 description 1
- 230000008018 melting Effects 0.000 description 1
- 238000002844 melting Methods 0.000 description 1
- 239000012528 membrane Substances 0.000 description 1
- 230000000116 mitigating effect Effects 0.000 description 1
- 150000002815 nickel Chemical class 0.000 description 1
- 238000010899 nucleation Methods 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 229910052763 palladium Inorganic materials 0.000 description 1
- 150000002940 palladium Chemical class 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920006254 polymer film Polymers 0.000 description 1
- 238000007639 printing Methods 0.000 description 1
- 239000011253 protective coating Substances 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- 230000002829 reductive effect Effects 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000004332 silver Substances 0.000 description 1
- 239000002904 solvent Substances 0.000 description 1
- 239000007858 starting material Substances 0.000 description 1
- 238000001029 thermal curing Methods 0.000 description 1
- 230000008646 thermal stress Effects 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
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- H05K2201/0332—Structure of the conductor
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Abstract
Description
【0001】[0001]
【発明の属する技術分野】本発明は、半導体チップ等の
マイクロエレクトロニクス素子の搭載ないし接続に用い
る、搭載ないし接続のためのデバイス及び方法に関す
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a device and method for mounting or connecting a microelectronic device such as a semiconductor chip.
【0002】[0002]
【従来の技術及び発明が解決しようとする課題】最近の
半導体チップ等の、複雑な構造のマイクロエレクトロニ
クス・デバイスでは、他のエレクトロニクス部品に接続
せねばならない接続の数が非常に多い。例えば、複雑な
構造のマイクロプロセッサ・チップなどでは、外部のデ
バイスへ接続するための、必要な接続の数が数百にも及
ぶものがある。2. Description of the Related Art In a recent microelectronic device having a complicated structure such as a semiconductor chip, the number of connections that must be connected to other electronic components is very large. For example, some microprocessor chips with complicated structures require hundreds of connections to connect to external devices.
【0003】半導体チップを実装基板上の電気配線パタ
ーンに接続するための方法として、広く一般的に採用さ
れている方法には、次の3つの方法がある。それらは、
ワイヤ・ボンディング法、TAB(tape automated bon
ding)法、それにフリップチップ・ボンディング法であ
る。ワイヤ・ボンディング法では、チップの底面即ち裏
面を基板に当接させ、接点装備面であるそのチップの正
面即ち上面を上方へ、即ち基板とは反対側へ向けて、そ
のチップを基板上に載置する。そして、チップ上の複数
の接点と基板上の複数のパッドとを、個々の金またはア
ルミニウムのボンディング・ワイヤで接続する。TAB
法では、可撓性を有する絶縁体製のテープ上に複数のリ
ードから成るリード・アレイを予め形成しておき、その
テープをチップ及び基板の上にあてて、チップ上の複数
の接点と基板上の複数のパッドとに、個々のリードをボ
ンディングして行く。これらのワイヤ・ボンディング法
や従来のTAB法では、いずれも、チップが占有する領
域の周囲に基板上のパッドが配設され、多数のボンディ
ング・ワイヤまたはリードが、そのチップから周囲のそ
れら多数のパッドへ放射状に広がって延出することにな
る。こうして形成されるサブアセンブリの全体が占有す
る領域の面積は、チップ自体が占有する領域の面積より
もはるかに大きい。そのためこれらの方式を採用した場
合には、それによってアセンブリの全体がかなり大きな
ものになる。マイクロエレクトロニクスのアセンブリの
動作可能速度は、そのアセンブリの大きさに逆比例する
ため、このことは重大な短所に他ならない。更に、ワイ
ヤ・ボンディング法やTAB法を最も良好に適用し得る
のは、一般的に、複数の接点がチップの外周に沿って並
べられているチップに対してである。即ちこれらの方法
は、複数の接点が、いわゆる面アレイを成すように、即
ち格子状のパターンを成すように、チップの正面の全面
ないし大部分に亙って並べられているチップに適用する
のは困難である。As a method for connecting a semiconductor chip to an electric wiring pattern on a mounting board, there are the following three methods that are widely and generally adopted. They are,
Wire bonding method, TAB (tape automated bon)
ding) method and flip-chip bonding method. In the wire bonding method, the bottom surface or the back surface of the chip is brought into contact with the substrate, and the front surface or the top surface of the chip, which is the contact mounting surface, faces upward, that is, the side opposite to the substrate, and the chip is mounted on the substrate. Place. Then, the contacts on the chip and the pads on the substrate are connected by individual gold or aluminum bonding wires. TAB
In the method, a lead array consisting of a plurality of leads is formed in advance on a tape made of a flexible insulator, and the tape is applied to a chip and a substrate, and a plurality of contacts on the chip and the substrate are attached. Bond individual leads to the pads on top. In both of these wire bonding methods and the conventional TAB method, pads on the substrate are arranged around the area occupied by the chip, and a large number of bonding wires or leads are formed on the substrate from the chip to the surrounding area. It will spread and extend radially to the pad. The area occupied by the entire subassembly thus formed is much larger than the area occupied by the chip itself. Therefore, when these methods are adopted, the whole assembly is considerably increased. This is a serious disadvantage because the speed at which a microelectronic assembly can operate is inversely proportional to the size of the assembly. Further, the wire bonding method and the TAB method are most preferably applied to a chip in which a plurality of contacts are arranged along the outer circumference of the chip. That is, these methods are applied to a chip in which a plurality of contacts are arranged over the entire front surface or most of the front surface of the chip so as to form a so-called surface array, that is, in a grid pattern. It is difficult.
【0004】フリップチップ搭載法では、チップの接点
装備面を、基板に対向させる。そして、そのチップの複
数の接点の各々を、はんだ付けによって、基板上の対応
するパッドに接続する。また、その接続のためには、例
えば、先ず、基板とチップとの一方にはんだボールを設
け、続いてチップを下向きにして基板に重ね合わせ、は
んだを瞬間溶融即ちリフローさせる。このフリップチッ
プ法によれば、コンパクトなアセンブリが得られる。そ
れは、基板上の占有される領域の面積が、チップ自体が
占有する領域の面積以上にならないからである。しかし
ながら、フリップチップ法を用いて構成したアセンブリ
には、熱応力という深刻な問題が存在している。チップ
の接点と基板とを接合しているはんだによる接合部は大
きな剛性を有する。使用中の熱膨張及び熱収縮によっ
て、チップと基板とは寸法変化を生じ、それによって、
剛性の大きなはんだ接合部に大きな応力が発生する。こ
の大きな応力のために、接合部が疲労破壊するおそれが
ある。更に、チップを基板に搭載する前にテストするこ
とが困難であり、そのため、特に多数のチップを含んで
いるアセンブリ等では、完成したアセンブリに要求され
る製品としての品質レベルを維持することが困難であ
る。In the flip chip mounting method, the contact mounting surface of the chip is made to face the substrate. Then, each of the plurality of contacts of the chip is connected to the corresponding pad on the substrate by soldering. Further, for the connection, for example, first, a solder ball is provided on one of the substrate and the chip, and then the chip is faced downward to be superposed on the substrate to instantaneously melt or reflow the solder. This flip chip method results in a compact assembly. This is because the area of the occupied area on the substrate does not exceed the area of the area occupied by the chip itself. However, there is a serious problem of thermal stress in the assembly formed by using the flip chip method. The joint portion of the solder that joins the contact point of the chip and the substrate has great rigidity. Due to thermal expansion and contraction during use, the chip and substrate undergo a dimensional change, which
Large stress is generated in the solder joint with high rigidity. This large stress can lead to fatigue failure of the joint. Furthermore, it is difficult to test the chips before mounting them on the substrate, which makes it difficult to maintain the product quality level required for the completed assembly, especially in an assembly containing a large number of chips. Is.
【0005】以上の問題を解決するためにこれまでに様
々な試みが成されている。有用な幾つかの解決法が米国
特許第 5,148,265号及び米国特許第 5,148,266号に開示
されており、これら米国特許は本願の基礎米国出願の譲
受人に譲渡されている。これら米国特許に開示されてい
る好適実施例の構造は「インターポーザ」または「チッ
プ・キャリヤ」と呼ばれる、可撓性を有するシート状の
構造体を含んでいる。好適なチップ・キャリヤは、可撓
性を有するシート状の最上層に複数の端子を設けたもの
である。使用法について説明すると、インターポーザ
は、その複数の端子を設けた側を上向きに、即ちチップ
とは反対側に向けて、そのチップの正面即ち接点装備面
の上に載置する。続いて、インターポーザの複数の端子
をチップの複数の接点に接続する。この接続の方法とし
て最も好ましいのは、インターポーザに予め複数のリー
ドを形成しておき、それらリードに押当てるツールを使
用して、それらリードをチップの複数の接点にボンディ
ングするというものである。続いて、こうして完成した
アセンブリを基板に接続し、この接続は、チップ・キャ
リヤの端子を基板にボンディングすることによって行
う。チップ・キャリアに形成した複数のリードとチップ
・キャリヤを構成している絶縁層とは、共に可撓性を有
するため、チップ・キャリヤ上の複数の端子は、チップ
上の複数の接点に対して相対的に移動可能であり、その
移動によって、リードとチップとの間の接合部や、端子
と基板との間の接合部に、大きな応力が発生することは
ない。従ってこのアセンブリは熱の影響を緩和すること
ができる。更にこのアセンブリは、その最も好ましい構
成例においては、チップ・キャリヤの複数の端子とチッ
プそれ自体の表面との間に変形容易な層を備えており、
この層は、例えばエラストマー層であり、チップ・キャ
リヤに組込まれていて、チップ・キャリヤの絶縁体層と
チップとの間に介装されている。この変形容易な構造体
によって、個々の端子が個別に、チップに近付く方向へ
変位できるようにしている。これによって、サブアセン
ブリとテスト・フィクスチャとを、効果的に接触させる
ことができるようになっている。従って、多数の電気接
点を備えたテスト・フィクスチャを、端子どうしの間に
小さな高さのばらつきがあっても、そのサブアセンブリ
の全ての端子に接触させることができる。サブアセンブ
リは、基板にボンディングする前にテストすることがで
き、そのため、テストを通った、良品であることが確認
された部品を基板アセンブリ作業へまわすことができ
る。これによって更に、非常に大きな経済的及び品質的
利点が得られている。Various attempts have been made to solve the above problems. Some useful solutions are disclosed in US Pat. Nos. 5,148,265 and 5,148,266, which are assigned to the assignee of the basic US application of the present application. The preferred embodiment structure disclosed in these U.S. patents includes a flexible sheet-like structure called an "interposer" or "chip carrier". A preferred chip carrier has a plurality of terminals provided on a flexible sheet-like top layer. Describing the usage, the interposer is mounted on the front surface of the chip, that is, the contact mounting surface, with the side provided with the plurality of terminals facing upward, that is, the side opposite to the chip. Subsequently, the terminals of the interposer are connected to the contacts of the chip. The most preferable method of this connection is to form a plurality of leads on the interposer in advance and bond the leads to a plurality of contacts of the chip by using a tool for pressing the leads. The assembly thus completed is then connected to a substrate, which is done by bonding the terminals of the chip carrier to the substrate. Since the leads formed on the chip carrier and the insulating layer forming the chip carrier are both flexible, the terminals on the chip carrier are connected to the contacts on the chip with respect to each other. It is relatively movable, and due to the movement, a large stress is not generated at the joint between the lead and the chip and the joint between the terminal and the substrate. Therefore, this assembly can mitigate the effects of heat. In addition, the assembly, in its most preferred construction, comprises a deformable layer between the terminals of the chip carrier and the surface of the chip itself,
This layer, which is, for example, an elastomer layer, is incorporated in the chip carrier and is interposed between the insulator layer of the chip carrier and the chip. With this easily deformable structure, each terminal can be individually displaced in the direction toward the chip. This allows the subassembly and the test fixture to be in effective contact. Thus, a test fixture with multiple electrical contacts can contact all terminals of its subassembly, even with small height variations between the terminals. The sub-assembly can be tested prior to bonding to the substrate, thus passing the tested and confirmed good parts to the substrate assembly operation. This also provides enormous economic and quality advantages.
【0006】本願の基礎米国出願の同時係属出願である
米国特許出願第08/190,779号(以下「特許出願第'779
号」という)には更なる改善が記載されている。この特
許出願第'799号は、可撓性を有する絶縁シートである最
上層シートを使用しており、この最上層シートは上面と
底面とを有する。この最上層シートには複数の端子が取
付けられている。この最上層シートの下に支持層が配設
されており、この支持層は、最上層シートとは反対側の
面が下面となっている。最上層シートの複数の端子に
は、複数の導電性の細長いリードが接続されており、そ
れらリードは互いに略々並んで夫々の端子から下方へ、
支持層の中を貫通して延在している。どのリードも、そ
の下端が支持層の下面に達している。それらリードの下
端には、共晶合金形接合材料等の、導電性接合材料が備
えられている。支持層はリードを囲繞してリードを支持
している。Basis of the present application US patent application Ser. No. 08 / 190,779 (hereinafter “Patent Application No. 779”, which is a co-pending application of the US application)
No.)) describes further improvements. This patent application '799 uses a top layer sheet that is a flexible insulating sheet having a top surface and a bottom surface. A plurality of terminals are attached to this top layer sheet. A support layer is arranged below the uppermost sheet, and the surface of the support layer opposite to the uppermost sheet is the lower surface. A plurality of electrically conductive elongated leads are connected to the plurality of terminals of the uppermost sheet, and the leads are arranged substantially in parallel with each other and downward from the respective terminals,
It extends through the support layer. The lower end of each lead reaches the lower surface of the support layer. The lower ends of the leads are provided with a conductive bonding material such as a eutectic alloy bonding material. The support layer surrounds the leads and supports the leads.
【0007】以上の構成を有する部品を半導体チップや
ウェーハ等のマイクロエレクトロニクス部品に接続する
には、支持層の底面をチップの接点装備面に重ね合わせ
て、複数のリードの夫々の下端をそのチップの複数の接
点に接触させ、その後に、そのアセンブリに高温及び高
圧を作用させる。全てのリードの夫々の下端がチップの
夫々の接点に略々同時にボンディングされる。こうして
ボンディングされた複数のリードが、最上層シートの複
数の端子とチップの複数の接点とを接続する。支持層
は、比較的弾性係数の小さな変形容易な材料で形成する
か、或いは、そうでない材料で形成した場合にはリード
のボンディング・ステップの完了後に除去して、そのよ
うな変形容易な材料の層に交換することが望ましい。完
成したアセンブリは、その複数の端子がチップに対して
相対的に移動可能であるため、テストが可能であり、ま
た、熱の影響を緩和できるという、望ましいものとなっ
ている。また、それらばかりでなく、特許出願第'799号
の部品及び方法は、更に幾つもの利点を提供するもので
あり、それら利点のうちには、張合せプロセスに類似し
たプロセスを1回実行するだけで、チップ等の部材に対
する全ての接合を完了させることができるということも
含まれている。この特許出願第'799号の部品及び方法
は、複数の接点を備え、それら接点が面アレイを成すよ
うに配列されている、チップ等のマイクロエレクトロニ
クス素子に用いたときに特に有利なものである。In order to connect the component having the above structure to a microelectronic component such as a semiconductor chip or a wafer, the bottom surface of the supporting layer is superposed on the contact mounting surface of the chip, and the lower ends of the leads are attached to the chip. Of the contacts, and then subjecting the assembly to high temperature and pressure. The respective lower ends of all leads are bonded to the respective contacts of the chip at approximately the same time. The leads thus bonded connect the terminals of the uppermost sheet and the contacts of the chip. The support layer may be formed of a deformable material having a relatively low modulus of elasticity, or if formed of a material other than that, may be removed after the lead bonding step is completed to remove such a deformable material. Exchange with layers is desirable. The finished assembly is desirable because its terminals are movable relative to the chip, allowing testing and mitigating thermal effects. Also, the components and methods of patent application '799, as well as those, provide a number of additional advantages, of which only a single process similar to the laminating process is performed. Therefore, it is also possible to complete all the joining to members such as chips. The components and methods of this patent application '799 are particularly advantageous for use in microelectronic devices such as chips, which have multiple contacts and are arranged in a planar array. .
【0008】しかしながら、これら従来例には、以上の
利点並びに更にその他の利点がある一方で、更に改善す
る必要も存在している。However, while these conventional examples have the above-mentioned advantages as well as other advantages, there is also a need for further improvement.
【0009】[0009]
【課題を解決するための手段】本発明の1つの局面は、
マイクロエレクトロニクス用のリード・アレイの製造方
法を提供するものである。本発明のこの局面にかかる方
法は第1要素を用意するステップを含んでおり、該第1
要素は複数の細長い可撓性リードを備えた第1面を有
し、それら複数のリードは該第1面に沿って延在してお
り、それら複数のリードの各々は、該第1要素に取付け
られた端子側端部と、該端子側端部から、第1面に平行
な所定の第1水平方向へオフセットした先端側端部とを
有する。この方法は更に、前記複数のリードの全てを同
時に成形するステップを含んでおり、このリード成形ス
テップでは、前記複数のリードの夫々の前記先端側端部
の全てを、それら複数のリードの夫々の前記端子側端部
に対して相対的に、従って前記第1要素に対して相対的
に移動させることによって、前記先端側端部を前記第1
要素から離れる方向へ屈曲させる。前記先端側端部は所
定変位をなすように移動され、それによって、前記複数
のリードの全てが同時に所定の変形態様で変形させられ
る。One aspect of the present invention is:
A method of manufacturing a lead array for microelectronics is provided. The method according to this aspect of the invention includes the step of providing a first element, the first element comprising:
The element has a first surface with a plurality of elongate flexible leads, the plurality of leads extending along the first surface, each of the plurality of leads being attached to the first element. It has an attached terminal side end and a tip side end offset from the terminal side end in a predetermined first horizontal direction parallel to the first surface. The method further includes the step of simultaneously molding all of the plurality of leads, wherein in the lead forming step, all of the tip end portions of each of the plurality of leads are By moving the tip side end portion relative to the terminal side end portion, and thus relative to the first element, the tip end side end portion is moved to the first side.
Bend away from the element. The tip end is moved so as to make a predetermined displacement, whereby all of the plurality of leads are simultaneously deformed in a predetermined deformation mode.
【0010】前記複数のリードの夫々の前記先端側端部
が、前記第1要素に分離可能に止着されており、前記複
数のリードの夫々の前記先端側端部が前記移動ステップ
の実行中に前記第1要素から引き離されるようにするこ
とが好ましい。前記複数のリードの全ての前記先端側端
部が第2要素に取付けられており、前記複数のリードの
夫々の前記先端側端部をそれらリードの夫々の前記端子
側端部に対して相対的に移動させる前記ステップが、前
記第2要素を前記第1要素に対して相対的に移動させる
ステップを含んでいることが望ましい。1つの好適構成
例においては、第2要素を第1要素に対して相対的に、
前記第1水平方向と逆向きの、即ち、前記リードの前記
端子側端部から前記先端部側への方向と逆向きの、第2
水平方向に移動するようにしている。前記第2要素は、
この水平方向の移動と同時に更に垂直方向下方へ、前記
第1要素から離れる方向へも移動させることが好まし
い。以上の移動の結果として得られる効果は、各リード
の先端側端部を、水平方向には当該リードの端子側端部
へ近付く方向へ、また、垂直方向にはその端子側端部か
ら離れる方向へ移動させるというものであり、これによ
って、前記複数のリードを夫々の成形位置へ変形させ、
それら成形位置では、それら複数のリードが前記第1要
素から離れる方向である略々垂直方向下方へ延在する。
別の好適構成例では、前記複数のリードが初期状態で前
記第1及び第2要素の表面に平行な水平方向に屈曲して
おり、前記第1及び第2要素を垂直方向へ、互いに離れ
る方向へ移動させる。この移動によって、水平方向の屈
曲が部分的に直線に近付けられ、それと共に、前記複数
のリードを垂直方向に延在する屈曲形態をとるように屈
曲させる。The tip-side end portions of the plurality of leads are separably fixed to the first element, and the tip-side end portions of the plurality of leads are in the execution of the moving step. It is preferable that the first element is separated from the first element. All the tip end portions of the plurality of leads are attached to the second element, and the tip end portions of the plurality of leads are relative to the respective terminal end portions of the leads. Desirably, the step of moving the second element includes the step of moving the second element relative to the first element. In one preferred configuration, the second element is relative to the first element,
A second direction opposite to the first horizontal direction, that is, a direction opposite to the direction from the terminal side end of the lead to the tip end side;
I am trying to move horizontally. The second element is
Simultaneously with this horizontal movement, it is preferable to move further downward in the vertical direction and away from the first element. The effect obtained as a result of the above movement is that the tip end of each lead is moved horizontally toward the terminal end of the lead, and vertically away from the terminal end. Is to move to the respective molding positions,
In the molding position, the leads extend substantially vertically downward in the direction away from the first element.
In another preferable configuration example, the plurality of leads are bent in a horizontal direction parallel to the surfaces of the first and second elements in an initial state, and the first and second elements are vertically separated from each other. Move to. This movement causes the horizontal bend to partially approximate a straight line, which in turn causes the plurality of leads to bend in a bent configuration that extends vertically.
【0011】本発明のこの局面にかかる方法は更に、前
記リード成形ステップの完了後に前記複数のリードの周
囲に流動性で好ましくは変形容易な絶縁材料を注入し、
該流動性材料を硬化させて、前記複数のリードの周囲に
絶縁支持層を形成するステップを含むものとすることが
好ましい。最も好ましいのは、前記第1要素を、可撓性
を有する絶縁シートから成る最上層シートとし、前記複
数のリードの夫々の端子側端部に、この最上層シートを
貫通して延在する端子構造体を設けるというものであ
る。The method according to this aspect of the invention further comprises injecting a flowable and preferably deformable insulating material around the plurality of leads after completion of the lead forming step,
It is preferable to include a step of curing the fluid material to form an insulating support layer around the plurality of leads. Most preferably, the first element is an uppermost layer sheet made of a flexible insulating sheet, and terminals extending through the uppermost layer sheet at respective terminal side end portions of the plurality of leads. The structure is provided.
【0012】特に好適な構成例の1つは、前記第2要素
それ自体を半導体チップやウェーハ等のマイクロエレク
トロニクス素子としたものである。この構成例では、前
記複数のリードの夫々の先端側端部を前記第2要素に取
付ける取付ステップが、前記複数のリードの夫々の先端
側端部を前記チップ等のマイクロエレクトロニクス素子
の複数の接点にボンディングするステップを含む。この
ステップは、前記複数のリードがそれらの初期位置であ
る未変形位置にあるときに実行することが望ましい。こ
の場合、複数の先端側端部の全てが同時に、マイクロエ
レクトロニクス素子の複数の接点にボンディングされ
る。前記複数のリードは、複数の接点にボンディングさ
れるときには、それらリードの初期状態である未変形状
態にあるため、それら複数のリードの夫々の前記先端側
端部の位置は、この段階では良好に制御し得る。このこ
とによって、複数のリードの夫々の先端側端部と複数の
接点との間の位置揃えを容易に行えるようになってい
る。更に、ボンディング・プロセスそれ自体が、リード
の先端側端部と接点との間に、かなり大きな力を作用さ
せ得るものとなっている。One of the particularly preferable structural examples is one in which the second element itself is a microelectronic element such as a semiconductor chip or a wafer. In this configuration example, the attaching step of attaching the tip end portions of the leads to the second element includes attaching the tip end portions of the leads to a plurality of contacts of a microelectronic element such as the chip. Bonding to. This step is preferably performed when the leads are in their initial position, the undeformed position. In this case, all of the tip ends are simultaneously bonded to the contacts of the microelectronic element. When the plurality of leads are bonded to the plurality of contacts, they are in an undeformed state which is an initial state of the leads. Therefore, the position of the tip end portion of each of the plurality of leads is good at this stage. Controllable. This facilitates the alignment between the tip-side ends of the leads and the contacts. Moreover, the bonding process itself can exert a significant amount of force between the distal end of the lead and the contact.
【0013】前記第1要素が、複数の端子を備えた可撓
性を有する絶縁シートであり、前記第2要素が、チップ
ないしウェーハ等のマイクロエレクトロニクス素子であ
る場合には、前記移動ステップの完了後に該マイクロエ
レクトロニクス素子と該絶縁シートとの間の空間に変形
容易な絶縁支持層を導入するようにしてもよい。そうす
ることによって得られるアセンブリでは、前記複数の端
子が、可撓性を有する前記複数のリードによって前記マ
イクロエレクトロニクス素子に接続されているにもかか
わらず、該マイクロエレクトロニクス素子に対して相対
的に、該マイクロエレクトロニクス素子の表面に平行な
方向と、該マイクロエレクトロニクス素子へ近付く方向
とのいずれにも、容易に移動することができる。こうし
て得られるアセンブリは、テスト・プローブを接触させ
て行うテストを容易に実行できることに加えて、大形基
板への搭載も容易である。この端子の移動容易性によっ
てチップとそれを搭載した基板との間の熱膨張量ないし
熱収縮量の差の影響が緩和される。この方法の変更例で
は、前記第1要素が、チップないしウェーハ等のマイク
ロエレクトロニクス素子である。この場合、そのチップ
ないしウェーハは、初期状態では、前記複数のリードが
その表面に沿って延在しており、それら複数のリードの
夫々の前記端子側端部が、そのチップ等に設けられてい
る複数の接点に止着されていると共に、それら複数のリ
ードの夫々の前記先端側端部が、そのウェーハ等の表面
に分離可能に取付けられている。この変更例では、前記
第2要素は、複数の接点構造体を備えた可撓性を有する
絶縁シートであることが望ましい。前記複数のリードの
夫々の前記先端側端部は、前記絶縁シートと前記マイク
ロエレクトロニクス素子とが相手に対して相対的に移動
するようにする以前に、前記複数の接点構造体に取付け
ておく。When the first element is a flexible insulating sheet having a plurality of terminals, and the second element is a microelectronic element such as a chip or a wafer, the moving step is completed. After that, an easily deformable insulating support layer may be introduced into the space between the microelectronic element and the insulating sheet. In the assembly obtained by doing so, the plurality of terminals are connected to the microelectronic element by the plurality of flexible leads, but relative to the microelectronic element, It can be easily moved in both a direction parallel to the surface of the microelectronic element and a direction approaching the microelectronic element. The assembly thus obtained can be easily mounted on a large-sized substrate in addition to being able to easily perform a test in which a test probe is brought into contact. The ease of movement of the terminals reduces the influence of the difference in the amount of thermal expansion or the amount of thermal contraction between the chip and the substrate on which the chip is mounted. In a modification of this method, the first element is a microelectronic device such as a chip or a wafer. In this case, the chip or wafer has the plurality of leads extending along the surface thereof in the initial state, and the terminal side end of each of the plurality of leads is provided on the chip or the like. The tip ends of the plurality of leads are detachably attached to the surface of the wafer and the like while being fixed to the plurality of contacts. In this modification, the second element is preferably a flexible insulating sheet having a plurality of contact structures. The tip end of each of the plurality of leads is attached to the plurality of contact structures before the insulating sheet and the microelectronic element are moved relative to each other.
【0014】特に好適な1つの構成例では、前記第1及
び第2要素のうちの一方の要素が、複数の接点を備えた
複数の半導体チップを包含しているウェーハ等のマルチ
チップ・ユニットであり、また、前記第1及び第2要素
のうちの他方の要素が、それら複数のチップの上を覆う
ように延展しているシートである。この場合、例えば前
記第1要素である前記シートが複数の領域を含んでお
り、それら領域の1つずつが、前記複数のチップの各々
に対応している。前記第2要素がウェーハである場合に
は、前記複数のリードの夫々の前記先端側端部を前記第
2要素に取付けるステップは、前記複数の領域のうちの
幾つかにおける、そして望ましくは前記複数の領域の全
てにおける複数のリードの夫々の先端側端部を、対応す
る複数のチップの複数の接点に同時にボンディングする
ことによって、それら領域の各々を前記複数のチップの
1つずつに接続するステップを含んでいることが好まし
い。この方法は更に、前記マルチチップ素子ないしウェ
ーハから複数のチップを切り出すと共に、前記シートか
ら複数の領域を切り出すことによって、各々が1つのチ
ップとそれに対応した前記シートの一部分とを含んでい
る複数の個別のユニットを形成する、切断ステップを含
んでいる。この方法は更に、前記リード・ボンディング
・ステップの完了後で前記切断ステップの実行前に、前
記ウェーハと前記シートとの間に流動性絶縁材料を注入
し、該絶縁材料を硬化させて変形容易な絶縁支持層を形
成するステップを含んでいることが好ましい。この場
合、前記切断ステップは、前記絶縁支持層を切断するこ
とによって、該切断ステップで形成される各々のユニッ
トが前記絶縁支持層の一部を含むようにするステップを
含むことになる。別法として、マルチチップ・ユニット
が、例えば共通の1つのヒート・シンク等の支持部材に
搭載した複数のチップから成るアセンブリ等として使用
するための所望の形態とした、複数のチップから成るア
センブリを含んでおり、前記第1要素である前記シート
が、それら複数のチップを相互接続するための回路を含
んでいるものとすることができる。この変更例では、そ
れら複数のチップは互いに切り離されることはない。In a particularly preferred configuration example, one of the first and second elements is a multi-chip unit such as a wafer containing a plurality of semiconductor chips with a plurality of contacts. And the other of the first and second elements is a sheet extending so as to cover the plurality of chips. In this case, for example, the sheet, which is the first element, includes a plurality of regions, and one of the regions corresponds to each of the plurality of chips. If the second element is a wafer, the step of attaching the distal ends of each of the plurality of leads to the second element is in some of the plurality of regions, and preferably in the plurality of regions. Connecting each tip end of each of the plurality of leads in all of the regions to one of the plurality of chips by simultaneously bonding to the plurality of contacts of the corresponding plurality of chips. It is preferable to include. The method further comprises cutting a plurality of chips from the multi-chip device or wafer and cutting a plurality of regions from the sheet, each of which includes one chip and a corresponding portion of the sheet. It includes a cutting step to form individual units. The method further comprises injecting a flowable insulating material between the wafer and the sheet after completion of the lead bonding step and prior to performing the cutting step and curing the insulating material to facilitate deformation. It preferably includes the step of forming an insulating support layer. In this case, the cutting step includes a step of cutting the insulating support layer so that each unit formed in the cutting step includes a part of the insulating support layer. Alternatively, a multi-chip unit may be provided in a desired configuration for use as a multi-chip unit, such as a multi-chip assembly mounted on a common support member such as a heat sink. And the first element, the sheet, may include circuitry for interconnecting the plurality of chips. In this modification, the chips are not separated from each other.
【0015】前記複数のリードの夫々の前記先端側端部
を前記マイクロエレクトロニクス素子の前記複数の接点
にボンディングするステップは、前記最上層シートであ
る前記第1要素を、前記マイクロエレクトロニクス素子
に対して位置合せし、それによって、それら複数の先端
側端部が前記複数の接点と位置が揃うようにするステッ
プと、その位置が揃った状態を維持したままで、前記シ
ートを前記マイクロエレクトロニクス素子に押付けるス
テップとを含んでいることが最も好ましい。この場合、
前記シートが、前記ボンディング・ステップの実行中
に、補強構造体と係合することによって、位置揃えを補
助するようにすることができる。この補強用構造体は、
前記シートに貼着した、例えば金属箔等の、可撓性を有
するが実質的に耐伸張性を有する箔を含むものとするこ
とができる。別法として、或いはこれに付加するものと
して、前記補強構造体を、大きな剛性を持ち中央開口を
有するリングを含むものとし、前記シートを、その中央
開口に延展させて、該リングによって緊張状態に展張保
持するようにしてもよい。前記シートを前記接点装備面
に押付けるステップは、例えば空気圧等の流体圧を、前
記シートの上面に、直接に、或いは膜部材やバッグ等を
介して作用させて、前記シートの全面に亙って一様な圧
力を維持するステップを含むものとすることができる。The step of bonding the tip end of each of the plurality of leads to the plurality of contacts of the microelectronic element includes connecting the first element, which is the top layer sheet, to the microelectronic element. Aligning, thereby aligning the tips of the plurality of tips with the contacts, and pressing the sheet against the microelectronic element while maintaining the alignment. Most preferably, the step of applying is included. in this case,
The sheet may assist in alignment by engaging a stiffening structure during the bonding step. This reinforcing structure is
A flexible but substantially stretch resistant foil, such as a metal foil, attached to the sheet may be included. Alternatively or in addition, the reinforcing structure may include a ring having great rigidity and having a central opening, the sheet extending into the central opening and tensioned by the ring. You may make it hold | maintain. In the step of pressing the sheet against the contact-equipped surface, a fluid pressure such as air pressure is applied to the upper surface of the sheet directly or through a membrane member or a bag to cover the entire surface of the sheet. And maintaining a uniform pressure.
【0016】本発明にかかる別実施例の方法では、成形
プロセスを実行することによって、完成後にマイクロエ
レクトロニクス素子に取付ける部品を製造するようにし
ている。このような部品を製造する製造プロセスにおい
ては、前記第2要素は、一時的要素、即ち除去可能な要
素とすることができ、例えば、溶解可能なポリマーのシ
ート等とすることができる。この一時的要素は、支持層
を形成した後には、例えば溶解可能なシートを溶解除去
すること等によって除去し、それによって前記複数のリ
ードの夫々の前記先端側端部を前記支持層の下面に露出
させるようにする。前記絶縁支持層を形成するステップ
の実行前または完了後に、前記複数のリードの夫々の前
記先端側端部に接合材料を付着させるようにしてもよ
い。こうして得られた部品を、チップ等のマイクロエレ
クトロニクス素子に取付けるには、前記支持層の露出面
をそのチップ等の素子の接点装備面に重ね合わせた上
で、前記複数のリードの夫々の前記先端側端部をそのチ
ップ等の素子の複数の接点にボンディングすればよい。
この部品をそのチップ等の素子に接続完了した後には、
可撓性を有する前記シートに備えられている複数の端子
が、そのチップの複数の接点に電気的に接続されていな
がら、しかも、それら複数の接点に対して相対的に、そ
のチップの表面に平行な方向とそのチップの表面に近付
く方向との両方において、移動可能な状態にある。In another embodiment of the method according to the invention, a molding process is carried out to produce the components to be mounted on the microelectronic element after completion. In the manufacturing process for manufacturing such parts, the second element may be a temporary element, ie a removable element, for example a sheet of dissolvable polymer or the like. This temporary element is removed after the support layer is formed, for example by dissolving and removing a dissolvable sheet, whereby the distal ends of each of the plurality of leads are placed on the underside of the support layer. Make it exposed. Before or after the step of forming the insulating support layer is completed, a bonding material may be attached to the tip end portions of the leads. In order to attach the component thus obtained to a microelectronic element such as a chip, the exposed surface of the support layer is superposed on the contact mounting surface of the element such as the chip, and then the tip of each of the plurality of leads is attached. The side edge may be bonded to a plurality of contacts of the element such as the chip.
After completing the connection of this part to the element such as the chip,
A plurality of terminals provided on the flexible sheet are electrically connected to a plurality of contacts of the chip, and on the surface of the chip relative to the plurality of contacts. It is movable both in the parallel direction and in the direction approaching the surface of the chip.
【0017】以上の方法の1つの変更例においては、前
記第2要素が、恒久的な、可撓性を有する絶縁シートで
あり、この絶縁シートは、初期状態では前記第1シート
に隣接して位置している。前記複数のリードの各々の前
記先端側端部には、導電性の先端構造体が設けられ、こ
の先端構造体は例えば、前記第2絶縁シートを貫通して
延在している導電性のポストないしビア等である。前記
リード成形ステップにおいては、前記第2シートを前記
第1シートから離れる方向へ移動させ、それらシートの
間に流動性絶縁材料を注入する。前記先端構造体には、
導電性接合材料を備えておくようにしてもよく、そうす
ることによって得られる部品は、前記第2シートの表面
をマイクロエレクトロニクス素子の接点装備面に重ね合
わせることによって、そのマイクロエレクトロニクス素
子に接続することができる。In a modification of the above method, the second element is a permanent, flexible insulating sheet, which is initially adjacent to the first sheet. positioned. A conductive tip structure is provided at the tip end of each of the plurality of leads, and the tip structure is, for example, a conductive post extending through the second insulating sheet. Or beer, etc. In the lead forming step, the second sheet is moved away from the first sheet, and a fluid insulating material is injected between the sheets. The tip structure includes
A conductive bonding material may be provided, the component thus obtained being connected to the microelectronic element by superimposing the surface of the second sheet on the contact mounting surface of the microelectronic element. be able to.
【0018】本発明の別の1つの局面は、マイクロエレ
クトロニクスにおける接続のための部品を提供するもの
であり、この部品は、第1面である下面を有する絶縁性
の第1要素と、該第1要素の該第1面の上を延在してい
る複数の細長い可撓性リードとを備えている。前記複数
のリードの各々が、前記第1要素に止着された端子側端
部と、前記第1要素に分離可能に止着されて該第1要素
から離れる方向へ移動可能な先端側端部とを有する。前
記複数のリードの各々の前記先端側端部が、当該リード
の前記端子側端部から、前記第1面に平行な第1水平方
向へオフセットしているようにすることが好ましい。絶
縁性の前記第1要素は、前記第1面とは反対側の、上面
である第2面を有するシートであることが好ましく、前
記部品が更に、前記複数のリードの夫々の前記端子側端
部の位置において前記シートを貫通して延在している複
数の導電性の端子構造体を含んでいることが好ましい。
前記複数の各リードは前記先端側端部に導電性の接合材
料を有していることが好ましい。この場合、前記複数の
リードが金を含むものとし、また、前記接合材料が、例
えばスズ、ゲルマニウム、及びシリコンから成る部類中
から選択した金属等の、金との間で低融点共晶合金を形
成するように選択した金属を含むものとすることができ
る。前記複数のリードは、互いに隣接するリードの対応
する構成要素どうしの間の間隔が約 1.25mm 以下の、規
則的な格子状パターンをなすように配列することが望ま
しい。前記複数のリードの各々は、長さを約 200〜約 1
000 ミクロン、厚さを約 10 〜約 25 ミクロン、そして
幅を約 10 〜約 50 ミクロンとすることが望ましい。本
発明のこの局面にかかる部品は、先に説明した方法にお
いて使用し得るものである。Another aspect of the present invention provides a component for connection in microelectronics, the component comprising an insulative first element having a first surface, a lower surface, and the first element. A plurality of elongated flexible leads extending over the first side of the element. Each of the plurality of leads has a terminal-side end portion fixed to the first element and a tip-side end portion separably fixed to the first element and movable in a direction away from the first element. Have and. It is preferable that the tip-side end of each of the plurality of leads is offset from the terminal-side end of the lead in a first horizontal direction parallel to the first surface. It is preferable that the insulative first element is a sheet having a second surface that is an upper surface opposite to the first surface, and the component further includes the terminal side end of each of the plurality of leads. It is preferable to include a plurality of conductive terminal structures extending through the sheet at the positions of the portions.
It is preferable that each of the plurality of leads has a conductive bonding material at the tip end portion. In this case, the plurality of leads include gold, and the bonding material forms a low melting point eutectic alloy with gold, such as a metal selected from the group consisting of tin, germanium, and silicon. Can include a metal selected to do so. It is preferable that the plurality of leads be arranged in a regular grid pattern with a spacing between corresponding components of adjacent leads being about 1.25 mm or less. Each of the plurality of leads has a length of about 200 to about 1
It is desirable to have a thickness of 000 microns, a thickness of about 10 to about 25 microns, and a width of about 10 to about 50 microns. The component according to this aspect of the invention can be used in the method described above.
【0019】本発明の更に別の1つの局面は、マイクロ
エレクトロニクス用のコネクタを提供するものであり、
このコネクタは、可撓性を有する絶縁シート等の、下面
を有するボディを備えており、また、面アレイを成すよ
うに配列され、前記ボディに取付けられて該ボディの前
記下面に露出した複数の端子構造体を備えている。本発
明のこの局面にかかるコネクタは、複数のリードを備え
ており、それらリードの各々は前記下面から離れる方向
へ延在しており、それらリードの各々は、前記複数の端
子構造体のうちの1つに接続された端子側端部と、当該
端子構造体から離れた先端側端部とを有している。本発
明のこの局面にかかるコネクタは更に、前記ボディの前
記下面に接している変形容易な絶縁材料の層を備えてお
り、該変形容易層は前記ボディとは反対側に下面を有す
る。該変形容易層は前記複数のリードを略々囲繞して支
持している。該複数のリードの夫々の前記先端側端部は
該変形容易層の前記下面から突出している。そのため、
マイクロエレクトロニクス素子の接点装備面と該変形容
易層の前記下面とを重ね合わせることで前記複数のリー
ドの夫々の前記先端側端部を前記マイクロエレクトロニ
クス素子の複数の接点と当接させることができる。前記
複数のリードの各々が、その前記先端側端部に、該先端
側端部を前記接点に接合するための導電性接合材料を備
えていることが望ましい。前記複数のリードは略々S字
形のものとすることができる。前記複数のリードの各々
を、互いに反対側を向いた主面を有する金属リボンで形
成し、該リボンが、その主面に垂直な方向に屈曲して、
S字形をはじめとする前記リードの屈曲形態を形成する
ようにすることができる。Yet another aspect of the present invention is to provide a connector for microelectronics.
The connector includes a body having a lower surface, such as a flexible insulating sheet, and is arranged in a plane array and is attached to the body to expose a plurality of exposed surfaces on the lower surface of the body. It has a terminal structure. The connector according to this aspect of the present invention includes a plurality of leads, each of the leads extending in a direction away from the lower surface, and each of the leads of the plurality of terminal structures. It has a terminal side end connected to one and a tip side end apart from the terminal structure. The connector according to this aspect of the invention further comprises a layer of easily deformable insulating material in contact with the lower surface of the body, the easily deformable layer having a lower surface opposite the body. The easily deformable layer substantially surrounds and supports the leads. The tip end of each of the plurality of leads projects from the lower surface of the easily deformable layer. for that reason,
By overlapping the contact mounting surface of the microelectronic element and the lower surface of the easily deformable layer, the tip end of each of the leads can be brought into contact with the contacts of the microelectronic element. It is desirable that each of the plurality of leads is provided with a conductive bonding material at the tip end portion thereof for joining the tip end portion to the contact. The plurality of leads may be substantially S-shaped. Each of the plurality of leads is formed of a metal ribbon having major surfaces facing each other, and the ribbon is bent in a direction perpendicular to the major surface,
It is possible to form a bent form of the lead including an S-shape.
【0020】本発明の更に別の1つの局面は、マイクロ
エレクトロニクス・アセンブリを提供するものであり、
このマイクロエレクトロニクス・アセンブリは、面アレ
イを成すように配列した複数の接点を備えた正面を有す
るマイクロエレクトロニクス素子を備えている。このア
センブリは、前記マイクロエレクトロニクス素子の前記
正面との間に間隔を保ちつつ該正面に向かい合った下面
を備えたコネクタ・ボディを備えている。該コネクタ・
ボディは、前記下面に露出して面アレイを成すように配
列した複数の端子構造体を備え、前記マイクロエレクト
ロニクス素子の前記接点のアレイの上に延展している。
このアセンブリは、前記複数の端子構造体と前記複数の
接点との間に延在している、屈曲形状の可撓性を有する
複数のリードを備えている。ここでも、前記複数のリー
ドの各々を、互いに逆を向いた主面を有し、その主面に
垂直な方向へ屈曲されてS字形を形成している金属製リ
ボンで構成することができる。Yet another aspect of the present invention is to provide a microelectronic assembly,
The microelectronic assembly comprises a microelectronic element having a front surface with a plurality of contacts arranged in a planar array. The assembly includes a connector body having a lower surface facing the front surface of the microelectronic element with a space provided between the front surface and the front surface of the microelectronic element. The connector
The body includes a plurality of terminal structures exposed in the lower surface and arranged in a planar array extending over the array of contacts of the microelectronic element.
The assembly includes a plurality of bent-shaped flexible leads extending between the plurality of terminal structures and the plurality of contacts. Here again, each of the plurality of leads can be formed of a metal ribbon having main surfaces that are opposite to each other and bent in a direction perpendicular to the main surfaces to form an S-shape.
【0021】以上に述べた本発明の様々な局面のうちの
最後の2つの局面にかかるアセンブリとコネクタとは、
それらより先に説明した好適方法によって容易に製造し
得るものである。本発明のこれら局面にかかる好適なア
センブリとコネクタとは、半導体チップやその他の素子
のための、コンパクトで信頼性の高い接続構造を提供す
るものである。The assembly and connector according to the last two of the various aspects of the invention described above are:
It can be easily manufactured by the preferred methods described above. The preferred assemblies and connectors according to these aspects of the invention provide a compact and reliable connection structure for semiconductor chips and other devices.
【0022】本発明の更に別の1つの局面は、チップな
いしウェーハのアセンブリを提供するものであり、この
アセンブリは、チップを備えるか、または、複数のチッ
プを包含したウェーハを備えるものであり、そのチップ
ないしウェーハは、複数の電気接点を設けた第1面を有
しており、このアセンブリは更に、複数の変形可能なリ
ードを備えており、それら複数のリードの各々が、前記
複数の接点のうちの1つに恒久的に接続された固定端部
と、前記ウェーハの前記第1面に分離可能に止着された
先端側端部とを有する。本発明のこの局面にかかるチッ
プないしウェーハのアセンブリは、先に説明した方法に
利用し得るものである。Yet another aspect of the present invention provides a chip or wafer assembly, which comprises a chip or a wafer containing a plurality of chips, The chip or wafer has a first surface provided with a plurality of electrical contacts, the assembly further comprising a plurality of deformable leads, each of the plurality of leads having a plurality of said contacts. A fixed end that is permanently connected to one of the two, and a tip end that is separably fastened to the first surface of the wafer. The chip or wafer assembly according to this aspect of the invention can be utilized in the methods previously described.
【0023】[0023]
【発明の実施の形態】以下に本発明の幾つかの好適実施
例について、図面を参照しつつ詳細に説明して行く。本
発明の一実施例にかかる部品を製造する方法において
は、先ず、製造開始材料として多層シート30を用意す
る。多層シート30は絶縁シート34を含んでおり(図
2)、この絶縁シート34は、例えばポリイミド・フィ
ルム等をはじめとする、半導体業界で使用されている既
知の寸法的に安定したポリマー・フィルムで形成するこ
とが好ましい。絶縁シート34の厚さは 40 ミクロン以
下とすることが望ましく、約 20 〜約 30 ミクロンであ
れば更に好ましく、そして 25 ミクロンが最も好まし
い。絶縁シート34の上面35を、銅を電着して形成し
た最上層36が覆っており、また、絶縁シート34の反
対側の下面37を、同様に形成した最下層38が覆って
いる。それら銅層の厚さは、例えば約 5〜約 25 ミクロ
ンである。図1及び図2に示した製造開始時の状態で
は、以上の夫々の層は、多層シート30の全体に亙って
連続しており実質的に一様である。この多層シート30
を、ぴんと張った緊張状態にする。その緊張状態にした
ままで、この多層シート30をリング状の略々円形の枠
体32に貼着し、それによってこの多層シート30を、
その枠体32の中央開口の部分に展張する。多層シート
30を枠体32に貼着するには、例えばエポキシ樹脂フ
ィルム等の適当な耐熱性接着剤を使用し、その接着剤フ
ィルムの厚さは約 10 ミクロン程度であることが好まし
い。枠体32を形成する材料は、大きな剛性を有し、ま
た、この多層シート30と枠体32とを貼着したものを
後の工程において適用する半導体部品の熱膨張係数と略
々等しい熱膨張係数を有する材料にする。多くの場合、
半導体部品を形成する材料はシリコンであるため、枠体
32の材料には、その熱膨張係数がシリコンの熱膨張係
数と略々等しいものを使用する。モリブデンなどは、枠
体32の材料として好適なものである。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Some preferred embodiments of the present invention will be described below in detail with reference to the drawings. In the method of manufacturing a component according to the embodiment of the present invention, first, the multilayer sheet 30 is prepared as a manufacturing starting material. Multilayer sheet 30 includes an insulating sheet 34 (FIG. 2), which is a known dimensionally stable polymer film used in the semiconductor industry, including, for example, polyimide films. It is preferably formed. The thickness of the insulating sheet 34 is desirably less than 40 microns, more preferably from about 20 to about 30 microns, and most preferably 25 microns. The upper surface 35 of the insulating sheet 34 is covered with an uppermost layer 36 formed by electrodeposition of copper, and the lower surface 37 on the opposite side of the insulating sheet 34 is covered with a similarly formed lowermost layer 38. The copper layers have a thickness of, for example, about 5 to about 25 microns. In the state at the start of manufacturing shown in FIGS. 1 and 2, the above layers are continuous and substantially uniform over the entire multilayer sheet 30. This multilayer sheet 30
Into a tight and tense state. The multilayer sheet 30 is adhered to the ring-shaped substantially circular frame body 32 while keeping the tension state, whereby the multilayer sheet 30 is
The frame 32 is spread over the central opening. To attach the multilayer sheet 30 to the frame 32, a suitable heat resistant adhesive such as an epoxy resin film is used, and the thickness of the adhesive film is preferably about 10 microns. The material forming the frame body 32 has a large rigidity, and the thermal expansion coefficient is substantially equal to the thermal expansion coefficient of a semiconductor component to which the multilayer sheet 30 and the frame body 32 are attached in a subsequent process. Use a material with a coefficient. In many cases,
Since the material forming the semiconductor component is silicon, the material of the frame body 32 has a thermal expansion coefficient substantially equal to that of silicon. Molybdenum or the like is a suitable material for the frame body 32.
【0024】このプロセスの次の段階では、最下層38
を下面レジスト50で完全にマスキングする一方で、最
上層36を、図3に示したようなパターンを成すように
選択的にマスキングする。この選択的なマスキングを行
うには、例えば、電気泳動レジストを塗布し、レジスタ
で覆われるべき領域を選択的に露光し、そしてレジスト
の熱硬化処理及び現像処理を施すことによって未硬化レ
ジスト材料を除去するという、一般的な技法を用いれば
よい。適当なレジストの一例を挙げるならば、米国、マ
サチューセッツ州、Wellesley に所在の Shippley 社
が、「Eagle Electrophoretic Resist」という商品名で
販売しているレジストがある。このレジストを現像する
ための現像剤も同社で併せて販売している。パターンは
非常に多くの端子形成領域40を含んでおり、その数
は、一般的には、数万であったり、数十万であったりす
る。それら多数の端子形成領域40は、略々規則的なパ
ターンを成すように配列されており、このパターンに
は、1つまたは複数の規則的な直交格子が含まれてお
り、その直交格子は、このシートの表面に沿った一方の
方向には一定のピッチPX を持ち、他方の方向には一定
のピッチPY を持つ。一般的には、PY はPX に等し
い。後に詳細に説明するように、このシートの様々な部
分領域の1つ1つが最終的にウェーハ上の個々のチップ
の1つ1つに関連することになる。そのような部分領域
の各々の中の夫々の格子は、互いに連続していてもよ
く、或いは、格子パターンの中の空白部ないし不連続部
によって互いに分離されていてもよい。図12に幾つも
の部分領域41を模式的に示してあり、それら部分領域
は、目に見える境界線43で互いに分離されている。た
だしこのような目に見える境界線が必ずしも常に存在し
ているわけではない。各々の端子形成領域40は、リン
グ44の外周を画成している円環状マスク領域42と、
リング44内の中央孔を画成している中央マスク領域4
6とを含んでいる。リング44自体はマスクされていな
い。このシートの残りの部分もマスクされておらず、そ
れによって、実質的に連続した非マスク領域48が形成
されており、この非マスク領域48は、各々の端子形成
領域40の周囲を囲繞していると共に、各端子形成領域
40のリング44から、その端子形成領域40の円環状
マスク領域42によって分離されている。この連続領域
48は、このシートの全体または大部分に亙って存在し
ているようにすることが望ましい。アレイの中の所定の
位置では、端子形成領域を他と異なった形態(図示せ
ず)にしてあり、そこでは、円環状マスク領域42の一
部を切り欠いて除去してあり、それによってリング44
を連続領域48に接続してある。後に更に詳細に説明す
るが、このように異なった形態とした端子形成領域は、
電位面端子を形成するものである。The next step in the process is to reach the bottom layer 38.
Is completely masked with bottom resist 50, while top layer 36 is selectively masked to form the pattern shown in FIG. This selective masking can be accomplished, for example, by applying an electrophoretic resist, selectively exposing the areas to be covered by the resist, and then subjecting the uncured resist material to thermal curing and development of the resist. A general technique of removing may be used. An example of a suitable resist is that sold by Shippley of Wellesley, Mass., USA under the trade name "Eagle Electrophoretic Resist". The company also sells a developer for developing this resist. The pattern includes a large number of terminal formation regions 40, and the number thereof is generally tens of thousands or hundreds of thousands. The large number of terminal formation regions 40 are arranged in a substantially regular pattern, and this pattern includes one or a plurality of regular orthogonal lattices, and the orthogonal lattices are It has a constant pitch P X in one direction along the surface of the sheet and a constant pitch P Y in the other direction. In general, P Y is equal to P X. As will be explained in more detail below, each of the various subregions of this sheet will eventually be associated with each of the individual chips on the wafer. The respective grids in each such subregion may be continuous with each other or may be separated from each other by blanks or discontinuities in the grid pattern. FIG. 12 schematically shows several partial areas 41, which are separated from each other by a visible boundary line 43. However, such visible boundaries do not always exist. Each terminal formation region 40 includes an annular mask region 42 that defines the outer periphery of the ring 44,
Central mask area 4 defining a central hole in ring 44
Includes 6 and. The ring 44 itself is unmasked. The rest of the sheet is also unmasked, thereby forming a substantially continuous unmasked region 48, which surrounds each terminal formation region 40. At the same time, the ring 44 of each terminal formation region 40 is separated from the ring-shaped mask region 42 of the terminal formation region 40. This continuous region 48 is preferably present over all or most of the sheet. At a predetermined position in the array, the terminal forming area has a different shape (not shown), in which a part of the annular mask area 42 is cut away to remove the ring. 44
Are connected to the continuous region 48. As will be described in more detail later, the terminal formation region having such a different shape is
It forms a potential surface terminal.
【0025】以上の選択的マスキングを完了したなら
ば、続いてこのアセンブリに耐エッチ材料を電気メッキ
する。耐エッチ材料は、例えばニッケル、金、それにパ
ラジウムから成る部類中から選択した金属材料等であ
り、最も好ましいのはニッケルである。メッキの厚さ
は、例えば約 1 〜 3 ミクロンであるが、最も好ましい
のは約 2ミクロンである。メッキした金属は各端子形成
領域40のリング44を覆うと共に連続領域48も覆
う。続いて一般的なレジスト除去方法を用いてレジスト
を除去すると、円環状領域42と中央孔領域46とで
は、銅の最上層36が露出する。続いてこのアセンブリ
に、例えば CuCl エッチ等の一般的な銅エッチング溶液
を用いてエッチングを施す。このエッチング処理の間、
先にメッキしたニッケル等の耐エッチ材料がレジスト即
ちエッチ・ストップとして働いて銅層36を保護する。
一方、中央孔領域46及び円環状領域42では、耐エッ
チ材料が存在していないために銅層が除去され、図4に
示したパターンが残ることになり、即ち、連続領域48
とリング領域44とでは銅及びニッケルが残るが、中央
孔領域46と円環状領域42とではエッチングによっ
て、絶縁フィルム34の上面35が露出する。以上のエ
ッチング手順の間、最下層の銅層38は底面レジスト5
0によって保護されている。Once the above selective masking is complete, the assembly is then electroplated with an etch resistant material. The etch resistant material is, for example, a metal material selected from the group consisting of nickel, gold, and palladium, with nickel being most preferred. The plating thickness is, for example, about 1 to 3 microns, most preferably about 2 microns. The plated metal covers the ring 44 of each terminal formation area 40 as well as the continuous area 48. Subsequently, when the resist is removed by using a general resist removing method, the uppermost copper layer 36 is exposed in the annular region 42 and the central hole region 46. The assembly is then etched using a common copper etching solution such as a CuCl 2 etch. During this etching process
An etch resistant material such as nickel that was previously plated acts as a resist or etch stop to protect the copper layer 36.
On the other hand, in the central hole region 46 and the annular region 42, the copper layer is removed because the etch resistant material is not present, and the pattern shown in FIG. 4 remains, that is, the continuous region 48.
While copper and nickel remain in the ring region 44 and the ring region 44, the upper surface 35 of the insulating film 34 is exposed in the central hole region 46 and the annular region 42 by etching. During the above-described etching procedure, the bottom copper layer 38 is the bottom resist 5
Protected by 0.
【0026】このプロセスの次の段階では、絶縁フィル
ム34の、各端子形成領域の中央孔領域46の内部に相
当する箇所に孔52を形成する。それら孔52を形成す
るには、エキシマ・レーザのレーザ光等の放射エネルギ
を用いて融蝕によって形成するようにしており、この放
射エネルギの好ましい波長は 308nmである。夫々の端子
形成領域の中央孔46に対応した複数の孔を有するマス
ク54を、このマスク54のそれら複数の孔が夫々の中
央孔46の位置に重なるように位置合せしてアセンブリ
の上に載置し、このマスク54のそれら複数の孔を通し
て放射エネルギを照射する。マスク54は、モリブデン
等の耐熱性材料で形成する。放射エネルギの大部分はマ
スク54によって吸収される。ただし、中央孔46を囲
繞している銅及びニッケルのリング44もまた、マスク
として機能して、絶縁シートの融蝕領域を中央孔46の
内側の領域に限定する。In the next stage of this process, holes 52 are formed in the insulating film 34 at locations corresponding to the interior of the central hole area 46 of each terminal formation area. The holes 52 are formed by ablation using radiant energy such as laser light from an excimer laser, and the preferable wavelength of this radiant energy is 308 nm. A mask 54 having a plurality of holes corresponding to the central holes 46 of the respective terminal forming regions is placed on the assembly by aligning the plurality of holes of the mask 54 with the positions of the respective central holes 46. Radiant energy is applied through the plurality of holes in the mask 54. The mask 54 is formed of a heat resistant material such as molybdenum. Most of the radiant energy is absorbed by the mask 54. However, the copper and nickel ring 44 surrounding the central hole 46 also functions as a mask, limiting the ablated region of the insulating sheet to the region inside the central hole 46.
【0027】このプロセスの次の段階では、無電解メッ
キ処理を実行して孔(即ちビア)52に、銅のビア・ラ
イナ56の層をライニングする。この無電解メッキ処理
は、例えば、パラジウム塩等の電着促進剤を用いたシー
ディング即ち前処理と、それに続く無電解メッキ溶液そ
のものに触れさせる処理とから成るものである。銅層5
6は、各々の孔52の下端まで延展して最下層の銅層3
8に接続すると共に、各リング44の上面、即ち上方を
向いている表面を覆うように形成される。従って、この
銅によって形成されるブラインド・ビア・ライナによっ
て、各リング44が最下層の銅層38に接続される。こ
の銅によって形成される層の好ましい厚さは、約 10 ミ
クロンである。この処理の間、下面レジスト50は形成
されたままであり、そのため最下層の銅層38の、シー
ト34とは反対側の表面には銅が付着しない。このプロ
セスの、以上が完了した時点では、多層シート30に
は、その上面35に複数のリング形状の端子構造体44
が形成されていると共に、絶縁シートを貫通して延在す
るブラインド・ビア・ライナ56が、それらリング形状
の端子構造体の各々の中央に形成されている。また、実
質的に連続した銅の導電性の電位面48がシートの上面
を覆って延展している。リング形状の端子構造体44の
各々は、この連続層48によって囲繞されているが、た
だし、実質的に導電材料が存在していない円環状領域4
2によって、この連続層48から絶縁されている(図
3)。しかしながら、上述した他と異なる形態に形成し
た電位面端子(図示せず)では、そのリング形状の端子
構造体44が連続層48に電気的に接続している。続い
て、上面に形成されている銅でできた部分に、ニッケル
を、約 2ミクロンの厚さに電気メッキする。このメッキ
のためのメッキ電流は、最下層の銅層38へ供給して、
ビア・ライナ56を介して端子44へ導かれるようにす
る。メッキ電流は電位面端子を介して電位面に流れる。
このニッケル層の上に更に、金層を電気メッキし、この
金層の好ましい厚さは、約 0.5ミクロンである。これら
ニッケル層及び金層は、銅の表面及び端縁部を覆う耐蝕
性の保護被覆を形成するものである。The next step in the process is to perform an electroless plating process to line holes (ie, vias) 52 with a layer of copper via liner 56. This electroless plating treatment is, for example, a seeding or pretreatment using an electrodeposition accelerator such as a palladium salt and a subsequent treatment for contacting the electroless plating solution itself. Copper layer 5
6 is the lowermost copper layer 3 extending to the lower end of each hole 52.
8 and is formed so as to cover the upper surface of each ring 44, that is, the surface facing upward. Thus, the blind via liner formed by this copper connects each ring 44 to the bottom copper layer 38. The preferred thickness of the layer formed by this copper is about 10 microns. During this process, the bottom resist 50 remains formed so that no copper is deposited on the surface of the bottom copper layer 38 opposite the sheet 34. Upon completion of the above of this process, the multilayer sheet 30 has a plurality of ring-shaped terminal structures 44 on the upper surface 35 thereof.
And a blind via liner 56 extending through the insulating sheet is formed in the center of each of the ring-shaped terminal structures. Also, a substantially continuous copper conductive potential surface 48 extends over the top surface of the sheet. Each of the ring-shaped terminal structures 44 is surrounded by this continuous layer 48, provided that the annular region 4 is substantially free of conductive material.
It is insulated from this continuous layer 48 by 2 (FIG. 3). However, in a potential surface terminal (not shown) formed in a different form from the above, the ring-shaped terminal structure 44 is electrically connected to the continuous layer 48. Subsequently, nickel is electroplated on the top surface made of copper to a thickness of about 2 microns. The plating current for this plating is supplied to the lowermost copper layer 38,
It is guided to the terminal 44 through the via liner 56. The plating current flows to the potential surface via the potential surface terminal.
On top of this nickel layer is further electroplated a gold layer, the preferred thickness of this gold layer being about 0.5 micron. These nickel and gold layers form a corrosion resistant protective coating over the copper surface and edges.
【0028】このプロセスの次の段階では、下面レジス
ト50を除去して上面レジスト58を塗布する。上面レ
ジスト58は、絶縁シート34の上面の全域を覆うよう
に、従って、リング構造体44及び連続導電領域48の
表面も全て覆うように塗布する。そして、これによって
露出した最下層の銅層38の下面にパターン形成を施
し、それには、上で説明したのと同様に、レジストを塗
布し、露光を施し、硬化処理及び現像処理を施す。この
パターン形成は、各々が略々ダンベル形状でアレイを成
すように配列した複数のリード領域がレジストに覆われ
ずに残り、一方、最下層38のその他の部分がレジスト
によって覆われるようにする。それら複数の領域の各々
に、個々にリード60を形成するが、それには、最下層
の銅層38の表面に、電気メッキによってニッケル層6
2を形成し(このニッケル層62の厚さは一般的には約
5ミクロンである)、そのニッケル層の上に更に電気メ
ッキによって金層64を形成する(この金層の厚さは一
般的には約 5〜約 25 ミクロンであり、約 20 ミクロン
とすることが好ましい)。続いて、リード60を形成す
るために使用したレジストを除去する。In the next stage of this process, the bottom resist 50 is removed and the top resist 58 is applied. The upper surface resist 58 is applied so as to cover the entire area of the upper surface of the insulating sheet 34, and thus also covers the entire surfaces of the ring structure 44 and the continuous conductive region 48. Then, a pattern is formed on the lower surface of the lowermost copper layer 38 exposed by this, and the resist is applied, exposed, and cured and developed in the same manner as described above. This patterning allows the plurality of lead regions, each of which is generally dumbbell shaped and arranged in an array, to remain uncovered by the resist, while the rest of the bottom layer 38 is covered by the resist. Leads 60 are individually formed in each of the plurality of regions by forming a nickel layer 6 on the surface of the lowermost copper layer 38 by electroplating.
2 (the thickness of the nickel layer 62 is typically about
5 microns), and further electroplating a gold layer 64 on the nickel layer (the thickness of the gold layer is typically about 5 to about 25 microns, and may be about 20 microns). preferable). Then, the resist used for forming the lead 60 is removed.
【0029】各々のリード60は、略々円形の、端子側
端部の膨出部66(図8)と、それより幾分小さな、略
々円形の、先端側端部の膨出部68と、それら膨出部の
間を延在している細長く比較的幅の狭い帯状部70とを
含んでいる。リード60は、規則的な直交格子状に配設
してあり、そのピッチ及び配列は、上面に形成されてい
る複数のリング形状の端子44の格子のピッチ及び配列
と同一にしてある。そして、各々の円形膨出部66は、
上面に形成されている複数の端子44のうちの1つと、
即ちその端子に形成されているビア56と、同心的に位
置している。このプロセスの次の段階では、リードの先
端側端部領域68の露出した表面に、導電性接合材料を
スポット72の形に付着させる。適当な接合材料の一例
は、スズ層74(この層の好ましい厚さは約 10 ミクロ
ンである)と、このスズ層を覆う酸化防止用の金層76
(この層の好ましい厚さは約 2ミクロンである)とから
成るものである。ここでも、先ず、リードの露出表面を
レジストで被覆する。続いて、写真法を用いてパターン
形成を施し、現像処理することによって、そのレジスト
の被覆層の、接合材料をスポット72の形に付着させる
箇所に孔を形成する。そして、それら各スポット72
に、電気メッキ法を用いて導電性接合材料を被着する。
後に更に詳細に説明するように、その他の接合材料を使
用することもでき、その他の被着法を採用することもで
きる。Each lead 60 has a substantially circular bulge portion 66 (FIG. 8) at the terminal side end, and a substantially circular bulge portion 68 at the tip side end, which is somewhat smaller than that. , And an elongated strip portion 70 having a relatively narrow width and extending between the bulges. The leads 60 are arranged in a regular orthogonal lattice pattern, and their pitch and arrangement are the same as the pitch and arrangement of the lattice of the plurality of ring-shaped terminals 44 formed on the upper surface. Then, each circular bulge 66
One of the plurality of terminals 44 formed on the upper surface,
That is, it is located concentrically with the via 56 formed in the terminal. The next step in the process is to deposit conductive bonding material in the form of spots 72 on the exposed surface of the distal end regions 68 of the leads. An example of a suitable bonding material is a tin layer 74 (a preferred thickness of this layer is about 10 microns) and an anti-oxidation gold layer 76 over the tin layer.
(The preferred thickness of this layer is about 2 microns). Here again, first, the exposed surface of the lead is coated with a resist. Subsequently, a pattern is formed by using a photographic method, and a development process is performed to form holes in the resist coating layer where the bonding material is attached in the form of spots 72. And each of those spots 72
Then, a conductive bonding material is deposited by electroplating.
Other bonding materials may be used and other deposition methods may be employed, as described in more detail below.
【0030】このプロセスの次の段階では、上面レジス
ト58をそのままにして、最下層の銅層38に CuCl エ
ッチ溶液を使用してサブエッチング処理を施す。金層6
4及びニッケル層62は、このエッチ溶液によって実質
的に影響を受けず、従ってエッチング・マスクとして機
能する。最下層の銅層38は、その露出した領域が腐蝕
溶解される共に、リード60の側縁部、即ち金層及びニ
ッケル層の側縁部からも腐蝕溶解されて行く。このプロ
セスが進行するにつれて、銅層38は、その露出した領
域が除去されると共に、リード60の下側の部分も徐々
に除去されて行く。リード60の各側縁部から内側へ除
去されて行く除去量、即ちアンダーカット量は時間と共
に増大して行く。このプロセスの処理時間を適切に選択
して、帯状部70の両側の側縁部から進行していったア
ンダーカット領域が互いにつながり、それによって帯状
部70が、絶縁シート34から、間隙78をもって離隔
するようにする。ただし、先端側端部の膨出部68の直
径Dtip を帯状部70の幅WS よりも大きくしてあるた
め、銅層38のエッチ量、即ちアンダーカット量が先端
側端部の膨出部68の中心にまで進行してしまうことは
ない。そして、その中心に達する前にエッチング処理を
終了させるため、先端側端部の膨出部68から絶縁シー
ト34の底面37まで延在する銅製の小さなボタン部8
0が残る。このボタン部80は、その直径が、先端側端
部の膨出部68の直径よりも大幅に小さくなるようにす
ることが望ましい。また、このボタン部の直径を約 50
ミクロン以下にして、このボタン部が絶縁シート34の
下面37と接触する部分の表面積が非常に小さくなるよ
うにすることが望ましい。付着力は接触している部分の
表面積に正比例し、この付着力は、リードの先端側端部
が重力や通常の丁寧な取扱いにおける加速力によって、
絶縁シートの下面から引き離されてしまわない程度の強
さがあれば十分である。ボタン部80と絶縁シートとの
間の付着は、以下に説明するプロセスの実行中に容易に
解消されるようにしてある。In the next stage of this process, the top resist 58 is left untouched and the bottom copper layer 38 is sub-etched using a CuCl etch solution. Gold layer 6
4 and nickel layer 62 are substantially unaffected by this etch solution and thus act as an etch mask. The exposed area of the lowermost copper layer 38 is corroded and dissolved, and the side edges of the leads 60, that is, the side edges of the gold layer and the nickel layer are corroded and dissolved. As this process proceeds, the exposed areas of copper layer 38 are removed, while the underlying portions of leads 60 are gradually removed. The amount of removal, that is, the amount of undercut, that is removed inward from each side edge of the lead 60 increases with time. By appropriately selecting the processing time of this process, the undercut regions that have proceeded from the side edge portions on both sides of the strip-shaped portion 70 are connected to each other, whereby the strip-shaped portion 70 is separated from the insulating sheet 34 with a gap 78. To do so. However, since the diameter D tip of the bulged portion 68 at the tip end side is made larger than the width W S of the strip portion 70, the etching amount of the copper layer 38, that is, the amount of undercut, is bulged at the tip side end portion. It does not reach the center of the portion 68. Then, in order to finish the etching process before reaching the center, a small button portion 8 made of copper extending from the bulged portion 68 at the tip end portion to the bottom surface 37 of the insulating sheet 34.
0 remains. It is desirable that the diameter of the button portion 80 be significantly smaller than the diameter of the bulging portion 68 at the tip end. Also, make the diameter of this button part approximately 50
It is desirable that the surface area of the portion where the button portion comes into contact with the lower surface 37 of the insulating sheet 34 is made extremely small by making the thickness below micron. Adhesive force is directly proportional to the surface area of the contacting part, and this adhesive force is due to gravity at the tip end side of the lead and acceleration force in normal careful handling.
It is sufficient if it is strong enough not to be separated from the lower surface of the insulating sheet. The adhesion between the button portion 80 and the insulating sheet is designed to be easily removed during the process described below.
【0031】上述のエッチング処理によって端子側端部
の膨出部66の側縁部からも内側へアンダーカットが進
行するため、その結果、各リードの端子側端部の膨出部
66に対して同心的な略々円形の端子側端部ボタン部8
2が形成される。各々の端子側端部ボタン部82は、そ
れに対応したビア56に対しても同心的であり、そのビ
ア・ライナと金属接合によって接続している。端子側端
部ボタン部82は更に、リードの端子側端部の膨出部6
6とも金属接合よって接続している。従って各リード
は、電気的に連続した、一体の、金属接合によって接続
した端子側端部構造体を備えており、この端子側端部構
造体は、端子側端部の膨出部66と、ボタン部82と、
ビア・ライナ56と、リング形状の端子44とから成
り、絶縁シートを貫通してリードの端子側端部66から
絶縁シートの上面まで延在している。このような端子側
構造体の各々が、リードの端子側端部66をその位置に
しっかりと保持している。以上の工程に続いて上面レジ
スト58を除去し、そして、端子即ちリング44と、ビ
ア・ライナ56と、リード60とを含めた全ての金属製
の部材を無電解メッキによって薄い金の被覆層で覆う。
この金の被覆層の望ましい厚さは約 1ミクロンである。
無電解メッキによって形成したこの金層は、最下層の銅
層38をエッチングしたことによって露出した側縁部及
び表面をも含めた、露出している全ての金属の表面及び
側縁部を被覆するものである。Since the undercut progresses inward from the side edge of the bulging portion 66 at the terminal side end due to the above-described etching process, as a result, the undercutting with respect to the bulging portion 66 at the terminal side end of each lead is performed. Concentric approximately circular terminal side button part 8
2 is formed. Each terminal-side end button portion 82 is also concentric with the corresponding via 56 and is connected to the via liner by metal bonding. The terminal-side end button portion 82 is further provided with a bulge 6 at the terminal-side end of the lead.
6 is also connected by metal bonding. Therefore, each lead is provided with an electrically continuous, integral, terminal-side end structure connected by metal bonding, and this terminal-side end structure has a bulge portion 66 at the terminal-side end, A button portion 82,
The via liner 56 and the ring-shaped terminal 44 extend through the insulating sheet from the terminal-side end portion 66 of the lead to the upper surface of the insulating sheet. Each such terminal-side structure holds the lead terminal-side end 66 securely in place. Following the above steps, the top resist 58 is removed and all metal components including terminals or rings 44, via liners 56 and leads 60 are electrolessly plated with a thin gold coating. cover.
The desired thickness of this gold coating is about 1 micron.
This gold layer formed by electroless plating covers all exposed metal surfaces and edges, including those exposed by etching the bottom copper layer 38. It is a thing.
【0032】図12に模式的に示した、金属材料が存在
していない透明領域83のような基準マークも、その他
の構成部分を形成するために実行する以上のメッキ及び
エッチングの工程によって同時に形成するようにしてい
る。A fiducial mark such as the transparent region 83 in which the metal material is not present, which is schematically shown in FIG. 12, is simultaneously formed by the above plating and etching steps to be performed for forming other components. I am trying to do it.
【0033】この方法では、以上が完了した時点で部品
が完成する。このとき、絶縁シート34は依然として枠
体32(図1)に止着されたままであり、張りつめられ
た状態に維持されている。このとき、絶縁シート34
は、絶縁性のコネクタ・ボディを構成している。この部
品をこの状態のままで、ハンドリングしたり、出荷した
り、保管したりすることもできるが、この部品に直ぐに
マイクロエレクトロニクス素子に取付けてもよい。この
部品の夫々の構成部分の実際の寸法は、この部品を使用
するマイクロエレクトロニクス素子によって異なる。た
だし、現在広く採用されている接点ピッチの設定寸法に
対しては、以下の、表 に示した寸法を用いることがで
きる(寸法の単位は全てミクロンである)。In this method, the parts are completed when the above is completed. At this time, the insulating sheet 34 is still fixed to the frame body 32 (FIG. 1) and is maintained in a taut state. At this time, the insulating sheet 34
Form an insulative connector body. Although this component can be handled, shipped, or stored in this state, it may be directly attached to the microelectronic element. The actual dimensions of each component of this part will depend on the microelectronic device in which it is used. However, for the contact pitch setting dimensions that are widely used at present, the following dimensions shown in the table below can be used (all dimensions are in micron).
【表1】 表 I ピッチ(PX, PY) 1000 500 300 200 リング形状の端子44の内径(di) 100 100 75 50 端子の外径(do) 250 250 150 150 最上層の銅層36の厚さ 10 10 5 5 端子側端部の膨出部66の直径 150 150 125 100 最下層の銅層38の厚さ 15 10 5 5 先端側端部の膨出部68の直径(Dtip) 100 100 75 50 長さ(Ll)(端子側端部の膨出部66の中心 から先端側端部の膨出部68の中心まで) 1000 750 500 300 帯状部70の幅(WS) 35 25 20 15 TABLE 1 TABLE I Pitch (P X, P Y) 1000 500 300 200 inside diameter (d i) of the ring-shaped terminals 44 100 100 75 outside diameter of 50 terminals (d o) 250 250 150 150 uppermost copper layer Thickness of 36 10 10 5 5 Diameter of the bulging portion 66 at the terminal side end 150 150 125 100 Thickness of the lowermost copper layer 38 15 10 5 5 Diameter of the bulging portion 68 at the tip side end (D tip ) 100 100 75 50 length (L l) (from the center of the bulging portion 66 of the terminal end to the center of the bulged portion 68 of the distal end portion) 1000 750 500 300 width of strip portion 70 (W S) 35 25 20 15
【0034】本発明の更に別の実施例にかかる取付方法
は、上述のようにして製造して完成した部品84を、即
ち、枠体32と、複数のリード及び端子を備えた絶縁シ
ート即ちコネクタ・ボディ34とから成るものを、半導
体ウェーハ86(図11)に取付ける方法である。ウェ
ーハ86は、独立した多数のチップ領域88を含んでお
り、それらチップ領域88は、その各々が、1つの半導
体チップを構成する幾つもの素子を含んでいる。それら
個々のチップ領域88の1つ1つが、部品84の複数の
領域41(図12)の1つ1つに対応している。ウェー
ハ86は更に、非常に多くの接点90を備えており、そ
れら接点90はチップの上面92に装備されている(図
13)。この部品84を、その絶縁シート34の下面3
7を下向きにして、即ちチップの上面に臨ませて、ウェ
ーハ86の上面に載置する。チップに係合する、多数の
孔を備えた真空保持台94が、ウェーハ86の下に配置
されており、ウェーハ86は、それら多数の孔96を介
して供給される負圧によってこの保持台94に固定され
る。A mounting method according to still another embodiment of the present invention is a component 84 manufactured and completed as described above, that is, an insulating sheet or connector having a frame 32 and a plurality of leads and terminals. A method of attaching the body 34 and the body 34 to the semiconductor wafer 86 (FIG. 11). The wafer 86 includes a large number of independent chip areas 88, each of which includes a number of elements that form one semiconductor chip. Each of the individual chip areas 88 corresponds to each of the areas 41 (FIG. 12) of the component 84. The wafer 86 further comprises a large number of contacts 90, which are mounted on the upper surface 92 of the chip (FIG. 13). This component 84 is attached to the lower surface 3 of the insulating sheet 34.
7 is placed face down, that is, facing the upper surface of the chip, and mounted on the upper surface of the wafer 86. A vacuum holder 94 having a number of holes for engaging the chips is disposed below the wafer 86, and the wafer 86 is held by the negative pressure supplied through the holes 96. Fixed to.
【0035】部品84も同様にして、上部保持台98に
係合保持される。上部保持台98は透明板102を含ん
でおり、この透明板102は石英製とすることが好まし
く、この透明板102には、その周囲に金属製リング1
03を嵌装してある。接続部品84は、上部保持台98
に気密状態で係合保持されており、そうするために、こ
の接続部品84の円形の枠体32とリング103との間
に、Oリング(図示せず)を介装してある。負圧は供給
口100を介して、この接続部品84と透明板102と
の間の空間へ供給され、それによって、この接続部品8
4の可撓性を有するシートが透明板102にしっかりと
係合保持される。The component 84 is similarly engaged and held by the upper holding base 98. The upper holding table 98 includes a transparent plate 102, which is preferably made of quartz, and the transparent plate 102 has a metal ring 1 around the transparent plate 102.
03 is fitted. The connecting part 84 is an upper holding base 98.
In this case, an O-ring (not shown) is interposed between the circular frame 32 of the connecting part 84 and the ring 103. The negative pressure is supplied to the space between the connecting part 84 and the transparent plate 102 via the supply port 100, whereby the connecting part 8 is connected.
The flexible sheet of No. 4 is firmly engaged with and held by the transparent plate 102.
【0036】接続部品84とウェーハ86とを、上部保
持台と下部保持台とに係合保持した状態で、接続部品8
4をウェーハ86に対して位置合せする。それには、上
部保持台98と下部保持台94との一方もしくは両方
を、水平方向即ちX−Y方向へ移動させ、また一方の保
持台を垂直軸心を中心として回転させることによって、
接続部品84とウェーハ86とが、相手に対して相対的
に、図11に矢印θで示した方角方向へ揺動するように
する。これらの移動は、マイクロメータ・スクリュー式
の調節機構(図示せず)によって制御することができ
る。このプロセスを実行する際には、部品84上に形成
してある基準マーク83を観察することによって部品8
4のチップに対する相対的な位置を修正することができ
る。部品84の絶縁フィルム34が透明であるため、チ
ップ88の表面を、透明板102とこの絶縁フィルム3
4とを通して観察することができる。従って、部品84
の基準マーク83及び相対位置と、チップ88とを、観
察者が、或いはマシン・ビジョン・システムによって、
検出することができる。With the connecting part 84 and the wafer 86 engaged and held by the upper holding table and the lower holding table, the connecting part 8
Align 4 with wafer 86. To this end, one or both of the upper holding base 98 and the lower holding base 94 are moved in the horizontal direction, that is, the XY direction, and one of the holding bases is rotated about the vertical axis,
The connection component 84 and the wafer 86 are caused to swing relative to each other in the direction of the arrow θ shown in FIG. These movements can be controlled by a micrometer screw type adjustment mechanism (not shown). When performing this process, the component 8 is observed by observing the fiducial marks 83 formed on the component 84.
The position relative to the four chips can be modified. Since the insulating film 34 of the component 84 is transparent, the surface of the chip 88 is covered with the transparent plate 102 and the insulating film 3.
4 and can be observed. Therefore, the component 84
The reference mark 83 and the relative position of the chip and the chip 88 can be displayed by an observer or by a machine vision system.
Can be detected.
【0037】接続部品84をウェーハ(即ちチップ)に
精密に位置合せすることによって、各リード60の先端
側端部68をウェーハ上の対応する正しい接点90に位
置合せする。この精密な位置合せは、その部品がウェー
ハの略々全域を覆う比較的大きな部品である場合でも、
その部品の全域に亙って達成することができる。例え
ば、ウェーハ及び部品の直径は、約 10 〜 30cm である
こともある。このような広い面積の場合でも、その全域
に亙って、複数のリードの夫々の先端側端部を、必要な
精度をもって、複数の接点に位置合せすることができ
る。このような精密位置合せに寄与している幾つかの要
因が存在している。先ず、絶縁フィルム34が、リード
形成プロセス及び位置合せプロセスの両方の全期間を通
して同一の枠体32によって連続して緊張状態に保持さ
れているため、リードが正しい位置からずれることがな
い。また、リードの先端側端部68が、リードの形成が
完了したときから位置合せプロセスが完了するまでの
間、ボタン部80(図10)によって常時、絶縁フィル
ムに止着されている。そのため、リードの先端側端部6
8が絶縁フィルムに対して相対的にずれることがない。
更に、枠体32の熱膨張係数をウェーハの熱膨張係数に
近いものにしてあるため、位置合せプロセスの実行中に
温度が変動しても、また、後に説明するそれ以後のステ
ップの実行中に温度が変動しても、それによって絶縁フ
ィルムの位置がウェーハに対してずれるということがな
い。更に、基準マーク83を形成するのに、接続部品8
4のその他の構成要素を形成するために行うエッチング
及びメッキのプロセスにおいて同時に形成するようにし
ているため、基準マーク83がリードに対して精密に位
置合せされている。Fine alignment of the connecting components 84 to the wafer (ie, the chip) aligns the distal end 68 of each lead 60 with the corresponding correct contact 90 on the wafer. This precise alignment, even if the part is a relatively large part that covers almost the entire wafer,
It can be achieved over the whole area of the part. For example, the diameter of the wafer and components may be about 10-30 cm. Even in the case of such a large area, the tip end portions of the leads can be aligned with the contacts with the required accuracy over the entire area. There are several factors that contribute to such fine alignment. First, the insulation film 34 is continuously held in tension by the same frame 32 during the entire lead formation process and alignment process, so that the leads are not displaced from their proper positions. Further, the tip end portion 68 of the lead is always fixed to the insulating film by the button portion 80 (FIG. 10) from the time when the lead formation is completed to the time when the alignment process is completed. Therefore, the tip side end portion 6 of the lead is
8 does not shift relative to the insulating film.
Further, since the thermal expansion coefficient of the frame body 32 is close to the thermal expansion coefficient of the wafer, even if the temperature fluctuates during the execution of the alignment process, and during the subsequent steps described later, Even if the temperature changes, the position of the insulating film does not shift with respect to the wafer. Furthermore, the connection component 8 is used to form the reference mark 83.
The fiducial marks 83 are precisely aligned with the leads because they are formed simultaneously in the etching and plating processes used to form the other four components.
【0038】接続部品84とウェーハ(即ちチップ)と
を精密に位置合せしたまま、上下の保持台を互いに接近
する方向へ移動させて、接続部品84とウェーハとを重
ね合わせる。続いて、上部保持台の透明板102と接続
部品84との間へ圧縮ガスを導入して、図13に矢印で
示したように、その圧縮ガスをシート34の上面に作用
させる。これによってシート34は下方へ、即ちウェー
ハに近付く方向へ付勢され、そのため各リードの先端側
端部に被着してある接合材料72が、それに位置合せさ
れている接点90に押付けられる。接続部品84ないし
ウェーハが平坦度を維持していない場合でも、この加圧
ガスの働きにより、不都合なほど大きな局所的応力を一
切かけることなく、接続部品84(より詳しくは複数の
リードの夫々の先端側端部の接合材料72)と、複数の
接点とを、ウェーハの表面の全域に亙って密着させるこ
とができる。While the connection component 84 and the wafer (ie, the chip) are precisely aligned, the upper and lower holding bases are moved toward each other to superpose the connection component 84 and the wafer. Subsequently, a compressed gas is introduced between the transparent plate 102 of the upper holding table and the connecting component 84, and the compressed gas is made to act on the upper surface of the sheet 34 as shown by the arrow in FIG. This urges the sheet 34 downward, i.e., toward the wafer, so that the bonding material 72 deposited on the distal end of each lead is pressed against the contacts 90 aligned with it. Even if the connection part 84 or the wafer does not maintain the flatness, the action of the pressurized gas does not apply any undesirably large local stress to the connection part 84 (more specifically, each of the plurality of leads). The bonding material 72) at the tip end and the plurality of contacts can be brought into close contact with each other over the entire surface of the wafer.
【0039】こうして組付けたアセンブリを、そのガス
の圧力を維持したままで、スポット72の接合材料を活
性化させるのに十分な温度にまで加熱し、それによっ
て、リードの先端側端部とウェーハ86の接点90との
間に、金属接合によって接続したボンド部104(図1
4)が形成されるようにする。この加熱工程では、アセ
ンブリを約 240℃の温度に約 150秒間維持することが好
ましい。各スポット72に存在するスズは、その周囲に
存在する、接点90並びにリードそれ自体に含まれてい
る金との間で相互拡散を生じて、液体層を形成する。こ
の液体層が更に、接点パッド90及びリードの先端側端
部68から金を溶出させる。金の成分比が上昇するにつ
れて、この組成物の凝固点温度が上昇する。そして、つ
いにはそのボンド部が凝固する。このボンディング・プ
ロセスに続いてアニーリング・プロセスを実行する。ア
ニーリング・プロセスでは、金とスズとの間の相互拡散
を実質的に許容するのに十分な温度に維持し、一般的に
は約 180℃の温度に約 10 分間維持する。これによっ
て、ボンド部の金の含有量を更に高め、ボンド部を更に
強化する。このプロセスの全期間を通して、リードの先
端側端部68はボタン部80を介して絶縁シート34の
下面37に接続した状態に維持されている。そのため、
リードの先端側端部68が、このボンディング・プロセ
スの実行中に本来の位置からずれてしまうということが
ない。The assembly thus assembled is heated, while maintaining its gas pressure, to a temperature sufficient to activate the bonding material at spot 72, thereby causing the tip end of the lead and the wafer The bond portion 104 (FIG.
4) is formed. This heating step preferably maintains the assembly at a temperature of about 240 ° C. for about 150 seconds. The tin present at each spot 72 undergoes interdiffusion with the surrounding contacts 90 as well as the gold contained in the lead itself, forming a liquid layer. This liquid layer also elutes gold from the contact pads 90 and the lead end 68. As the gold component ratio increases, the freezing point temperature of this composition increases. Finally, the bond part solidifies. Following this bonding process, an annealing process is performed. The annealing process is maintained at a temperature sufficient to substantially allow interdiffusion between gold and tin, typically at a temperature of about 180 ° C for about 10 minutes. This further increases the gold content of the bond portion and further strengthens the bond portion. Throughout the entire process, the tip end 68 of the lead is maintained in a state of being connected to the lower surface 37 of the insulating sheet 34 via the button portion 80. for that reason,
The tip end 68 of the lead will not be displaced from its original position during the bonding process.
【0040】このボンディング・プロセスの実行中にウ
ェーハ86及び接続部品84が加熱される際に、絶縁シ
ート34及び電位面層48は、ウェーハの膨張率よりも
大きな膨張率で膨張しようとする。しかしながらそれら
絶縁シート及び電位面層は、枠体32によって張力を加
えられた状態に維持されているため、それら絶縁シート
及び電位面層の熱膨張は、結局、その張力による引張応
力を緩和するにとどまる。それら絶縁シート34及び電
位面層48上に形成されている構成要素の実際の移動量
は、枠体32の熱膨張量に略々等しい。しかも枠体32
はウェーハ86の熱膨張係数と略々等しい熱膨張係数を
持つようにしてある。そのため接続部品84の構成要素
は、加熱プロセスの実行中も、ウェーハの構成要素に対
して位置合せされた状態に維持されている。As the wafer 86 and the connecting components 84 are heated during the bonding process, the insulating sheet 34 and the potential surface layer 48 tend to expand at a rate greater than that of the wafer. However, since the insulating sheet and the potential surface layer are maintained in a state of being tensioned by the frame body 32, the thermal expansion of the insulating sheet and the potential surface layer eventually reduces the tensile stress due to the tension. Stay The actual movement amount of the components formed on the insulating sheet 34 and the potential surface layer 48 is substantially equal to the thermal expansion amount of the frame body 32. Moreover, the frame 32
Has a coefficient of thermal expansion approximately equal to that of the wafer 86. As such, the components of connecting piece 84 remain aligned with the components of the wafer during the heating process.
【0041】このプロセスの、以上が完了した段階で
は、図14に示した状態になり、このとき各リード60
は、その先端側端部66が、端子構造体66、82、5
6及び44によって、このアセンブリの第1要素である
絶縁シート34にしっかりと接合されている。各リード
は更に、その第2端である先端側端部68が、このアセ
ンブリの第2要素であるウェーハ86にしっかりと接合
されている。各リードの先端側端部68は、そのリード
の端子側端部66から、シート34の下面37に平行な
第1水平方向に、即ち図14に示した左側から右側への
方向D1 にオフセットしている。これと同じ方向をリー
ドの底面図(図8)にも図示した。D1 はこの接続部品
の全域において同一の方向である。即ち、どのリードの
先端側端部も、そのリードの端子側端部から同一方向へ
オフセットしている。At the stage when the above is completed in this process, the state shown in FIG.
Of the terminal structure 66, 82, 5
It is firmly joined by 6 and 44 to the first element of this assembly, the insulating sheet 34. Each lead is further rigidly bonded at its second end, the distal end 68, to the second element of the assembly, the wafer 86. The tip side end portion 68 of each lead is offset from the lead terminal side end portion 66 in the first horizontal direction parallel to the lower surface 37 of the sheet 34, that is, in the direction D 1 from the left side to the right side shown in FIG. are doing. The same direction is also shown in the bottom view of the lead (FIG. 8). D 1 has the same direction over the entire area of this connecting component. That is, the tip end of each lead is offset in the same direction from the terminal end of the lead.
【0042】このプロセスの続く次の段階では、保持台
98を除去してその代わりに金属製の真空保持台105
を装着し、この保持台105には幾つもの孔107が貫
通形成されている。ここでも、保持台105と保持台9
4とに負圧を供給して、絶縁シート34を備えた接続部
品84と、ウェーハ86とを、それら保持台にしっかり
と保持する。続いて、それら保持台の一方もしくは両方
を移動させることによって、それら保持台が相手に対し
て相対的に移動するようにし、それによって、保持台9
4を、従ってチップ(第2要素)86を、垂直方向に、
保持台105から、従って、絶縁シート(第1要素)3
4から、離れる方向へ移動させ、即ち、矢印V1 で示し
た方向へ移動させる。このとき同時に、保持台94及び
ウェーハ(第2要素)86を、保持台105及び絶縁シ
ート(第1要素)34に対して相対的に水平方向D2
へ、即ち図15における左側へ移動させる。別の言い方
をするならば、第2要素(ウェーハ)86、接点90、
及び接点90に接合されたリードの先端側端部68の移
動の水平方向成分が、第1方向(最初のオフセット方
向)D1 とは逆向きの第2方向D2 になるようにする。
従って、第2要素86及びリードの先端側端部68が、
第1要素(絶縁シート)34に対して相対的に、またリ
ードの端子側端部66に対して相対的に、円弧形経路A
2 を描くようにするのである。垂直方向の移動量は、一
般的には約 100〜 500ミクロンとし、水平方向の移動量
は、垂直方向の移動量と略々等しくする。In the next subsequent step of the process, the holding table 98 is removed and replaced by a metal vacuum holding table 105.
The holder 105 has a plurality of holes 107 formed therethrough. Again, the holding table 105 and the holding table 9
A negative pressure is supplied to 4 and 4 to firmly hold the connection component 84 provided with the insulating sheet 34 and the wafer 86 on their holding bases. Subsequently, by moving one or both of the holding bases, the holding bases are moved relative to each other, whereby the holding base 9 is moved.
4 and thus the tip (second element) 86 in the vertical direction,
From the holding table 105, and thus the insulating sheet (first element) 3
4 is moved in the away direction, that is, in the direction indicated by the arrow V 1 . At the same time, the holding table 94 and the wafer (second element) 86 are simultaneously moved in the horizontal direction D 2 relative to the holding table 105 and the insulating sheet (first element) 34.
, That is, to the left in FIG. In other words, the second element (wafer) 86, the contact 90,
The horizontal component of the movement of the tip end portion 68 of the lead joined to the contact 90 is set to the second direction D 2 opposite to the first direction (first offset direction) D 1 .
Therefore, the second element 86 and the distal end 68 of the lead are
The arcuate path A relative to the first element (insulating sheet) 34 and relative to the terminal end portion 66 of the lead.
Try to draw 2 . The amount of vertical movement is generally about 100 to 500 microns, and the amount of horizontal movement is approximately equal to the amount of vertical movement.
【0043】これと同じ移動を、第2要素(ウェーハ)
86及びリードの先端側端部68に対する第1要素(絶
縁シート)34及びリードの端子側端部66の相対的な
移動を記述する形に言い換えることも可能である。その
ように基準の枠組みを変更した場合には、第1要素を第
2要素に対して相対的に、水平方向には最初のオフセッ
ト方向D1 へ移動させ、またそれと同時に、垂直方向に
は第2要素から離れる方向へ移動させ、それによって第
1要素が第2要素に対して相対的に円弧形経路A1 を描
くようにすればよい。ただし、どのような言い方をする
にせよ、2つの要素の相対移動による最終的な効果とし
て、各リードの先端側端部68が、水平方向にはそのリ
ードの端子側端部66へ近付く方向へ移動し、且つ、垂
直方向にはそのリードの端子側端部66から離れる方向
へ移動することになり、これによって各リードが、図1
5に示したように、垂直方向に高さを有する、略々S字
形に屈曲した構造体に成形される。The same movement as this is performed for the second element (wafer).
In other words, it is possible to describe the relative movement of the first element (insulating sheet) 34 and the terminal end 66 of the lead with respect to 86 and the tip end 68 of the lead. If the standard framework is changed in such a manner, the first element is moved in the horizontal direction in the first offset direction D 1 relative to the second element, and at the same time, in the vertical direction, the first element is moved. The two elements may be moved away from each other so that the first element draws an arcuate path A 1 relative to the second element. However, no matter what the term is used, the net effect of the relative movement of the two elements is that the tip end 68 of each lead approaches the terminal end 66 of that lead in the horizontal direction. It moves in the vertical direction and away from the terminal side end portion 66 of the lead, which causes each lead to move in the direction shown in FIG.
As shown in FIG. 5, it is formed into a structure having a height in the vertical direction and bent into a substantially S shape.
【0044】このS字形のリードは、最初にリード60
を構成していたときのリボン部即ち帯状部70の上面及
び下面に対して垂直な方向に屈曲されている。換言すれ
ば、帯状部(リボン部)70の屈曲は、このリボン部の
主面に対して、即ち、このリボン部の当初の上面及び下
面に対して垂直な方向になっている。更に、図15に示
すように各々のS字形構造体は、そのリードの端子側端
部66に近接した位置に、従って第1要素、即ちコネク
タ・ボディ34に近接した位置に、第1屈曲部111を
有し、そのリードの先端側端部68に近接した位置に、
従って、接点90及び第2要素(ウェーハ)86に近接
した位置に、第2屈曲部113を有する。屈曲部113
は、屈曲部111とは逆向きに屈曲している。リードの
うちの、先端側端部66を構成している部分と、端子側
端部68を構成している部分とは、略々、それらの当初
の延在方向を維持しており、そのため、リードの当初の
上面及び下面、即ち主面は、それらの部分の領域では、
夫々上方と下方とを向いたままである。図15には1本
のリードだけしか示していないが、このリード成形プロ
セスにおいては、全てのリードが同時に成形される。従
って、全てのリードが同じS字形の屈曲を呈し、しか
も、全てのS字リードが、互いに平行に、同一の向きに
延在する。This S-shaped lead is first made of the lead 60.
Is bent in a direction perpendicular to the upper surface and the lower surface of the ribbon portion, that is, the belt-shaped portion 70. In other words, the bending of the strip portion (ribbon portion) 70 is in a direction perpendicular to the main surface of the ribbon portion, that is, the original upper surface and lower surface of the ribbon portion. Further, as shown in FIG. 15, each S-shaped structure has a first bend at a position proximate to the terminal end 66 of its lead, and thus at a position proximate to the first element or connector body 34. 111, at a position close to the tip end side 68 of the lead,
Therefore, the second bent portion 113 is provided at a position close to the contact 90 and the second element (wafer) 86. Bend 113
Is bent in the opposite direction to the bent portion 111. Of the lead, the portion forming the tip end portion 66 and the portion forming the terminal end portion 68 maintain their original extending directions, and therefore, The original upper and lower surfaces of the lead, i.e. the main surface, are
They remain facing upward and downward, respectively. Although only one lead is shown in FIG. 15, in this lead forming process, all leads are formed simultaneously. Therefore, all leads exhibit the same S-shaped bend, yet all S-leads extend parallel to one another and in the same orientation.
【0045】このリード形成プロセスの実行中に、リー
ドの先端側端部68は絶縁シートの底面37から引き離
される。銅製のボタン部80は容易に分離する。全ての
リードを変形させるために必要な力は、絶縁シート34
の下面37とウェーハ86の上面92との間に存在する
大気圧から加わる力である。各リードを屈曲させるため
に必要な力は、リードの実際の寸法によって異なるが、
必要な力の推定値の合理的な値は、リード1本につき約
2g である。大気圧から得られる力は、単に、標準大気
圧と、ウェーハないし接続部品の面積との積で与えられ
る。大気圧から得られる力が不充分であるときには、ワ
ックス等の一時的な接着剤を用いてウェーハ86及び絶
縁シート34を夫々の保持台に一時的に接着すればよ
い。或いは別法として、保持台の外周をガスケットで密
封可能にし、大気圧を超えるガス等の流体の圧力を絶縁
シート34とウェーハ86との間に導入して、それら要
素を夫々の保持台に係合させる力を増大させ、それによ
ってリードを屈曲させるために利用できる力を増大させ
るという方法もある。During the execution of this lead forming process, the tip end portion 68 of the lead is separated from the bottom surface 37 of the insulating sheet. The copper button portion 80 is easily separated. The force required to deform all the leads is the insulation sheet 34
Is a force applied from the atmospheric pressure existing between the lower surface 37 and the upper surface 92 of the wafer 86. The force required to bend each lead depends on the actual size of the lead,
A reasonable estimate of the force required is about 1 lead.
It is 2g. The force obtained from atmospheric pressure is simply given by the product of standard atmospheric pressure and the area of the wafer or connecting components. When the force obtained from the atmospheric pressure is insufficient, the wafer 86 and the insulating sheet 34 may be temporarily bonded to their respective holding bases using a temporary adhesive such as wax. Alternatively, the outer periphery of the holding base can be sealed with a gasket, and the pressure of a fluid such as a gas exceeding atmospheric pressure is introduced between the insulating sheet 34 and the wafer 86, and those elements are connected to the respective holding bases. There is also a way to increase the force to be applied and thereby increase the force available to bend the lead.
【0046】リード成形ステップに続いて、絶縁シート
34とウェーハ86とが夫々の移動後の位置にある状態
で、しかもそれらが依然として保持台105と保持台9
4とに係合保持されている状態で、流動性及び硬化性を
有する絶縁材料108を絶縁シート34とウェーハ86
との間に注入する。コネクタ・ボディである絶縁シート
34の下面37は、ビア・ライナ56等の端子構造体に
よって塞がれている孔以外には実質的に孔を持たない。
そのため、この流動性絶縁材料は、コネクタ・ボディで
ある絶縁シート34とウェーハ86との間に閉じ込めら
れ、絶縁シート34の上面に設けられている端子の構成
要素44を覆ってしまうことはない。この流動性絶縁材
料には、未硬化状態においては粘性が非常に小さくしか
も絶縁シートの材料及びウェーハの材料に対する良好な
濡れ性を有するものを用いることが好ましく、そうすれ
ば、この流動性絶縁材料が、絶縁シートとウェーハとの
間の全ての空間を効果的に充填して、容易に全てのリー
ド60の間に入り込む。絶縁材料108としては、硬化
後にエラストマー等の変形容易な材料を形成するものを
選択する。適当な流動性絶縁材料の例は、米国、ミシガ
ン州、Midland に所在の Dow Corning社が、「DOW 577
SILICONE」という商品名で販売している硬化性シリコー
ンや、Shin-Etsu Silicones of America社が出している
その他の硬化性シリコーンである。この流動性絶縁材料
を充填するには、外から圧力を加えて注入するという方
法を用いてもよく、或いは、外から圧力を加えずに毛管
現象のみによって空間が充填されるのを待つという方法
もある。流動性絶縁材料を注入したならば、それをそこ
で硬化させる。流動性絶縁材料の組成によって、室温で
自然に硬化するものもあれば、加熱を必要とするものも
あり、また放射エネルギの照射を必要とするものもあ
る。上に例示したシリコーン材料の典型的な硬化サイク
ルは、約 160℃で、約 20 分を必要とするというもので
ある。Following the lead forming step, the insulating sheet 34 and the wafer 86 are in their post-movement positions, and yet they are still in the holder 105 and the holder 9.
4, the insulating material 108 having fluidity and curability is attached to the insulating sheet 34 and the wafer 86.
Inject between and. The lower surface 37 of the insulating sheet 34, which is the connector body, has substantially no holes other than the holes blocked by the terminal structure such as the via liner 56.
Therefore, this fluid insulating material is trapped between the insulating sheet 34 that is the connector body and the wafer 86, and does not cover the terminal component 44 provided on the upper surface of the insulating sheet 34. It is preferable to use a material having a very low viscosity in the uncured state and having a good wettability with respect to the material of the insulating sheet and the material of the wafer as the fluid insulating material. Effectively fills all the space between the insulating sheet and the wafer, and easily penetrates between all the leads 60. As the insulating material 108, a material that forms a material such as an elastomer that is easily deformed after being cured is selected. An example of a suitable flowable insulating material is Dow Corning, Inc. of Midland, Michigan, U.S.A.
It is a curable silicone sold under the product name "SILICONE" and other curable silicones from Shin-Etsu Silicones of America. In order to fill the fluid insulating material, a method of injecting by applying pressure from the outside may be used, or a method of waiting for the space to be filled only by capillary action without applying pressure from the outside. There is also. Once the flowable insulating material has been injected, it is cured there. Depending on the composition of the flowable insulating material, some may spontaneously cure at room temperature, some require heating, and some require irradiation with radiant energy. A typical cure cycle for the silicone material exemplified above is about 160 ° C. and requires about 20 minutes.
【0047】硬化したならば、その時点でこのアセンブ
リは、最上層の絶縁シート34と、変形容易な絶縁層1
08と、ウェーハ86とを含み、更に、リード60によ
って接点90に接続した端子44を備えたものとなって
おり、このアセンブリを保持台から取外す。続いて、絶
縁シート34の上面に形成された連続層である電位面層
48を、複数の端子44のところだけに夫々に開口を残
して、その他の部分をはんだを遮るための一般的なはん
だマスク層110で覆う。続いて、一般的なフリップチ
ップ・ボンディング法に採用されているのと同様のはん
だボール付着法を用いて、端子44にはんだボール11
6を付着させる。はんだボール116の各々は、好まし
くは銅または銅合金で形成した球形のコア112と、鉛
−スズはんだ等のはんだの被覆層114とから成るもの
である。例えば、それらはんだボールは、直径 200ミク
ロンの球形のコア112に、63%鉛−37%スズのはんだ
の層114を 50 ミクロンの厚さに被覆したものとする
ことができる。複数の端子44の配列パターンに対応し
たパターンで配列した複数の孔を有するモリブデン・シ
ート(図示せず)を、それら複数の端子44に位置合せ
して載置し、このモリブデン・シートの夫々の孔の中に
はんだボールを入れる。これによって各々のはんだボー
ルが1つずつの端子44に位置合せされ、この後に、適
当なフラックスを塗布する。このアセンブリの全体を、
はんだを溶融させるのに十分な温度である例えば約 200
℃にまで加熱し、その温度に約 40 秒間維持する。はん
だが流動して、図17に示したように端子44に接合す
る。この後、はんだ付けに使用したフラックスをアセン
ブリからきれいに除去する。Once cured, the assembly now includes the top insulating sheet 34 and the easily deformable insulating layer 1.
08 and a wafer 86, and further provided with a terminal 44 connected to a contact 90 by a lead 60, which assembly is removed from the holder. Subsequently, the potential surface layer 48, which is a continuous layer formed on the upper surface of the insulating sheet 34, is generally soldered to leave the openings only at the plurality of terminals 44 and shield the other portions from the solder. Cover with mask layer 110. Then, the solder balls 11 are attached to the terminals 44 by using a solder ball attachment method similar to that used in a general flip chip bonding method.
6 is attached. Each solder ball 116 comprises a spherical core 112, preferably formed of copper or a copper alloy, and a coating layer 114 of solder, such as lead-tin solder. For example, the solder balls may be a 200 micron diameter spherical core 112 coated with a layer 114 of 63% lead-37% tin solder to a thickness of 50 microns. A molybdenum sheet (not shown) having a plurality of holes arranged in a pattern corresponding to the arrangement pattern of the plurality of terminals 44 is aligned and placed on the plurality of terminals 44, and each of the molybdenum sheets is placed. Put the solder balls in the holes. This aligns each solder ball with one terminal 44, after which the appropriate flux is applied. The entire assembly
A temperature sufficient to melt the solder, for example about 200
Heat to ° C and hold at that temperature for about 40 seconds. The solder flows and joins the terminals 44 as shown in FIG. After this, the flux used for soldering is cleanly removed from the assembly.
【0048】このはんだ付け工程に続いて、カットソー
を使用して、絶縁シート34の様々な領域の間の境界線
43(図12)に沿って、ウェーハ86と、絶縁シート
34と、可撓性絶縁層108とを同時に切断する。境界
線43は、ウェーハ86を構成している複数のチップ8
8どうしを区画する線と位置が揃っている。そのためこ
の切断工程によって、図18に示したような個別のユニ
ットが得られ、それらユニットの各々は、絶縁シート3
4の1つの領域41と、絶縁層108の一部分と、ウェ
ーハ86のうちの1個のチップ88とを含んでいる。各
々の領域の複数のはんだボール付の端子44、116
は、格子状に配列しており、その格子のピッチはチップ
上の複数の接点のピッチと実質的に等しい。この1個の
ユニット全体の、水平面内における表面積は、1個のチ
ップの水平面内における表面積と同じ広さでしかない。
この後、各ユニットを個別にテストすることができ、そ
れには、例えば、テスト・フィクスチャと1個のユニッ
トとを互いに押付けることによって、その1個のユニッ
ト全体の、複数のはんだボール付の端子を、そのテスト
・フィクスチャの複数の一時的接点即ちプローブに同時
に接触させるようにすればよい。絶縁材料108の変形
容易性と絶縁シート34の可撓性とによって、テスト・
フィクスチャへの同時接触が高い信頼性で行えるように
なっている。一般に「バーン・イン」と呼ばれている長
期テスト操作にも同じ手順を採用することができる。Following this soldering step, a cut-and-sew is used to cut the wafer 86, the insulating sheet 34, and the flexible sheet along the boundary line 43 (FIG. 12) between the various regions of the insulating sheet 34. The insulating layer 108 and the insulating layer 108 are cut at the same time. The boundary line 43 indicates the plurality of chips 8 that form the wafer 86.
It is aligned with the line that separates the eight. Therefore, by this cutting step, individual units as shown in FIG. 18 are obtained, and each of these units has the insulating sheet 3
4 region 41, a portion of the insulating layer 108, and a chip 88 of one of the wafers 86. Terminals 44, 116 with a plurality of solder balls in each area
Are arranged in a grid, and the pitch of the grid is substantially equal to the pitch of the contacts on the chip. The surface area of the entire unit in the horizontal plane is as large as the surface area of the single chip in the horizontal plane.
After this, each unit can be tested individually, for example, by pressing the test fixture and one unit against each other, with a plurality of solder balls on the whole unit. The terminal may be brought into simultaneous contact with a plurality of temporary contacts or probes of the test fixture. Due to the deformability of the insulating material 108 and the flexibility of the insulating sheet 34,
Simultaneous contact to the fixture is now possible with high reliability. The same procedure can be employed for long term test operations commonly referred to as "burn in".
【0049】ユニットのテストを終了した後に、また必
要とあらば更にバーン・インを行った後に、そのユニッ
トを、回路板やチップ・パッケージ等の基板上に恒久的
に搭載することができ、それには、はんだボールを基板
上の接点パッドに接触させ、アセンブリを加熱してはん
だをリフローさせればよい。このはんだ付けの方法それ
自体は、フリップチップ法や表面搭載法を用いた搭載工
程におけるはんだ付け方法と同様のものでよい。例え
ば、表面搭載法において広く行われているようにユニッ
ト上のはんだボールの各々を、フラックス中にはんだ粒
子を分散させたはんだペーストで形成したパッドの上に
載置するという方法などがある。このユニットは、もと
のチップと同程度の大きさしかないコンパクトなもので
あるため、他のチップに非常に近接させて搭載すること
ができ、そのため、非常にコンパクトな回路アセンブリ
を形成することができる。搭載した後にも、このユニッ
トは動作に関する大きな利点を提供する。即ち、可撓性
を有するリード60と、可撓性を有する絶縁シート34
と、可撓性を有し変形容易な絶縁材料108とを使用し
ているため、各々の端子44とその端子に付着したはん
だボール116とが、チップ上の対応した接点90に対
して相対的に移動することができる。この可撓性のため
に、チップと、そのチップを搭載した回路板ないし基板
との間の、熱膨張量ないし熱収縮量の差を許容すること
ができ、はんだ接合部に大きな応力を作用させずに済
む。After the unit has been tested and, if necessary, further burned in, the unit can be permanently mounted on a substrate such as a circuit board or chip package, May contact the solder balls with the contact pads on the substrate and heat the assembly to reflow the solder. This soldering method itself may be the same as the soldering method in the mounting process using the flip chip method or the surface mounting method. For example, there is a method in which each of the solder balls on the unit is placed on a pad formed of a solder paste in which solder particles are dispersed in a flux, which is widely used in the surface mounting method. The unit is so compact that it is about the same size as the original chip, so it can be mounted very close to other chips, thus forming a very compact circuit assembly. You can Even after installation, this unit offers significant operational advantages. That is, the lead 60 having flexibility and the insulating sheet 34 having flexibility
And the flexible and easily deformable insulating material 108, the terminals 44 and the solder balls 116 attached to the terminals are relative to the corresponding contacts 90 on the chip. Can be moved to. Due to this flexibility, a difference in the amount of thermal expansion or contraction between the chip and the circuit board or substrate on which the chip is mounted can be tolerated, and large stress is applied to the solder joint. You don't have to.
【0050】本発明の更に別の実施例にかかる接続部品
として、以上に説明したものと類似した構成を有する
が、ただし、補強シート57(図19)を備えたものが
あり、この補強シート57は絶縁シート34の上面を覆
っており、従って、この絶縁シート34の上面に備えら
れている端子44’及び電位面層48’を覆っている。
この補強層57は、絶縁シート34の上面の全域に亙っ
て延展している。絶縁シート34と補強層57とは、そ
れら両方を、図1を参照して先に説明したリング形状の
枠体32と同様のリング形状の枠体(図示せず)に止着
するようにすることが望ましい。補強層57の装着は、
端子44や、電位面層48’や、それらに付随するビア
及びビア・ライナ等の上面に備える構成要素を形成した
後に行うことが望ましい。補強層57を装着するには、
例えば、剥離可能な粘着剤を用いて、絶縁シート、及び
絶縁シート上のその他の構造体に貼着すればよい。絶縁
シートの下面37’に設けるリード60’、及びそれに
付属する構成要素に関しては、それらを形成する前に補
強層を装着するようにしてもよい。補強層は、ウェーハ
の熱膨張係数と等しい熱膨張係数を有するものとするこ
とが好ましい。ウェーハがシリコン製であれば、モリブ
デンが、この補強シートの好ましい材料の1つとなる。
補強層は、比較的薄いシート即ち箔の形態のものとする
ことが望ましく、その厚さは、約 25 ミクロンと約 250
ミクロンとの間とすることが好ましい。接続部品をウェ
ーハに取付ける取付工程の実行中は、この補強層に流体
圧を作用させおき、それによって、この補強層を介して
絶縁シート34’に流体圧が作用した状態を維持してお
く。この補強層は、絶縁シートの伸張及び変形に抵抗
し、それによって、リードの先端側端部とウェーハ上の
接点とが精密に位置合わせされた状態を維持するのを助
ける。この補強層には更に、絶縁シートに基準マークを
形成してある位置に対応した位置に開口(図示せず)を
形成し、その開口を通して基準マークを観察できるよう
にしておいてもよい。ウェーハへの取付が完了した後に
はこの補強層を除去する。それには、不活性化加熱処理
を施して、粘着剤を不活性化させるようにする。この方
法の変更例として、この補強層を、絶縁層の内部に埋め
込んだ恒久層として装備するという方法もある。そのよ
うな恒久層とする場合には、その恒久層の、複数の端子
に対応した位置に、夫々に開口を形成して、それら開口
を通してビアが貫通延在するようにしておく。As a connecting part according to yet another embodiment of the present invention, there is a connecting part having a structure similar to that described above, but provided with a reinforcing sheet 57 (FIG. 19). Covers the upper surface of the insulating sheet 34, and thus covers the terminals 44 'and the potential surface layer 48' provided on the upper surface of the insulating sheet 34.
The reinforcing layer 57 extends over the entire upper surface of the insulating sheet 34. The insulating sheet 34 and the reinforcing layer 57 are both fastened to a ring-shaped frame body (not shown) similar to the ring-shaped frame body 32 described above with reference to FIG. Is desirable. The mounting of the reinforcing layer 57 is
This is preferably performed after forming the components provided on the upper surface of the terminal 44, the potential surface layer 48 ′, and the vias and via liners accompanying them. To attach the reinforcing layer 57,
For example, a peelable pressure-sensitive adhesive may be used and attached to the insulating sheet and other structures on the insulating sheet. Regarding the lead 60 'provided on the lower surface 37' of the insulating sheet and the components attached thereto, a reinforcing layer may be attached before forming them. The reinforcing layer preferably has a coefficient of thermal expansion equal to that of the wafer. If the wafer is made of silicon, molybdenum is one of the preferred materials for this reinforcing sheet.
The stiffening layer is preferably in the form of a relatively thin sheet or foil and has a thickness of about 25 microns and about 250 microns.
It is preferably between micron. During the mounting process for mounting the connection component to the wafer, fluid pressure is applied to the reinforcing layer, thereby maintaining the state in which the fluid pressure is applied to the insulating sheet 34 'through the reinforcing layer. This stiffening layer resists stretching and deformation of the insulating sheet, thereby helping to maintain the finely aligned leading ends of the leads and the contacts on the wafer. The reinforcing layer may be further provided with an opening (not shown) at a position corresponding to the position where the reference mark is formed on the insulating sheet so that the reference mark can be observed through the opening. The reinforcing layer is removed after the wafer is completely attached. It is subjected to a heat treatment for deactivation so that the pressure-sensitive adhesive is deactivated. As a modified example of this method, there is also a method of equipping the reinforcing layer as a permanent layer embedded inside the insulating layer. When such a permanent layer is used, openings are formed in the permanent layer at positions corresponding to the plurality of terminals, and the vias extend through the openings.
【0051】本発明の更に別の変更例として、接続部材
を、より少ない数の領域を備えたものとして製作し、ウ
ェーハの一部分のみに適用するということも可能であ
る。更に、接続部材とボンディングする前にウェーハを
切断して個々のチップに切り分けておくという方法もあ
る。この場合には、リードの先端側端部をボンディング
する工程をチップ1個ずつに対して実行することにな
る。このような構成では、接続部品を製作する際に、各
々がチップ1個分の大きさの領域の絶縁シートを有し、
また各々がチップ1個に対する接続を行うのに必要なリ
ードを備えた、個別のユニットとして製作すればよい。
このような個別の接続部品は、互いに完全に切り離して
もよく、或いは、半ば連続したテープまたはシートの形
で提供して、複数の個別のチップに対して連続して次々
とボンディングするのに適するようにしてもよい。この
種の構成を採用する場合には、ボンディングの完了後
に、個別のチップと絶縁フィルムの個別の部分とを、先
に説明したのと同様に、相手に対して相対的に移動させ
てリードの成形を行う。ウェーハの全体を同時に処理す
る場合には、それによって、処理の経済性と簡明度とが
非常に優れたものとなる。例えば、一度の切断で、絶縁
シートとウェーハとを共に切断してユニットを形成する
ことができる。これに対して、チップ1個分の大きさの
ユニットを対象とした処理や、少数のチップしか含まな
いユニットを対象とした処理では、リードの先端側端部
とチップ上の接点との位置揃えが容易であり、また、プ
ロセスの実行中に障害が発生したときのロスを大幅に低
減することができる。As a further modification of the invention, it is possible to make the connecting member with a smaller number of areas and apply it to only a part of the wafer. Furthermore, there is also a method of cutting the wafer into individual chips before bonding with the connecting member. In this case, the step of bonding the end portions on the tip end side of the leads is executed for each chip. In such a configuration, when manufacturing the connection component, each has an insulating sheet in an area of a size of one chip,
It may also be manufactured as a separate unit, each with the leads required to make a connection to a single chip.
Such individual connection components may be completely separated from each other, or they may be provided in the form of a semi-continuous tape or sheet, suitable for bonding one after another to a plurality of individual chips. You may do it. In the case of adopting this type of structure, after the bonding is completed, the individual chips and the individual portions of the insulating film are moved relative to each other in the same manner as described above, and the leads are moved. Perform molding. If the whole wafer is processed at the same time, it makes the process very economical and simple. For example, the unit can be formed by cutting the insulating sheet and the wafer together with one cutting. On the other hand, in the processing targeting a unit having the size of one chip or the processing targeting a unit containing only a small number of chips, the tip end side of the lead and the contact on the chip are aligned. It is easy to perform, and the loss when a failure occurs during the execution of the process can be greatly reduced.
【0052】本発明にかかる更に別の変更例は、半導体
ウェーハないしチップ以外のその他のマイクロエレクト
ロニクス部品を接続部品に取付けられるようにし、それ
を利用して、リード成形プロセスを実行できるようにし
たものである。例えば、接点を備えた回路板またはモジ
ュールを、上で説明したウェーハやチップの場合と実質
的に同じ方法で接続部品に取付けることができる。Yet another modification according to the present invention is that a microelectronic component other than a semiconductor wafer or a chip can be attached to a connecting component, and it can be used to perform a lead forming process. Is. For example, a circuit board or module with contacts can be attached to connecting components in substantially the same manner as for wafers and chips as described above.
【0053】更に別の変更例にかかる接続部品を図20
に示した。この変更例にかかる構造は絶縁シート134
を含んでおり、この絶縁シート134の上面135に複
数の端子144を備えている。リード160は、細長い
帯状構造部170を含んでおり、この帯状構造部170
は絶縁シートの下面137の下側を延在している。各リ
ードは、端子側端部構造体を備えた端子側端部166を
備えており、この端子側端部構造体は、絶縁シート13
4を貫通して、その下面から上面まで延在しており、対
応する端子144に連なっている。以上の要素は、図1
〜図19を参照して上で説明したものと同様のものとす
ることができる。例えば、各々のリードの帯状部170
は、絶縁シートとの間に間隙を保ち、端子側端部構造体
と、リードの先端側端部168の点状接触部とでだけ、
絶縁シートに接続しているようにすることができる。FIG. 20 shows a connection part according to another modification.
It was shown to. The structure according to this modification is the insulating sheet 134.
And a plurality of terminals 144 are provided on the upper surface 135 of the insulating sheet 134. The lead 160 includes an elongated strip structure 170.
Extends under the lower surface 137 of the insulating sheet. Each lead has a terminal-side end portion 166 having a terminal-side end portion structure, and the terminal-side end portion structure has an insulating sheet 13.
4 extends from the lower surface to the upper surface and is connected to the corresponding terminal 144. The above elements are shown in FIG.
~ It may be similar to that described above with reference to Figure 19. For example, the strip 170 of each lead
Keeps a gap between the insulating sheet and the terminal-side end structure and the point-like contact portion of the lead end-side end 168,
It may be connected to an insulating sheet.
【0054】図20の接続部品は更に位置決めシート1
80を含んでおり、この位置決めシートはスチレンの重
合体や共重合体等の溶解性のシート状の材料で形成され
ている。各々のリードは先端構造体181を備えてお
り、この先端構造体181は、ブラインド・ビア等であ
り、位置決めシート180を貫通して延在しており、そ
の先端が外側へ広がった頭部を形成している。この先端
の頭部は位置決めシート180の下面182の側に存在
しており、換言すれば、位置決めシート180の、リー
ドが存在する側とは反対側、即ち絶縁シートである最上
層シート134が存在する側とは反対側に存在してい
る。この場合も、図20に示した変形前の初期状態で
は、各リードの先端側端部168は当該リードの端子側
端部161から、第1水平方向D1 へオフセットしてい
る。The connecting part shown in FIG.
This positioning sheet is made of a soluble sheet-shaped material such as a styrene polymer or copolymer. Each lead is provided with a tip structure 181. This tip structure 181 is a blind via or the like, extends through the positioning sheet 180, and its tip has a head that spreads outward. Is forming. The head of this tip is present on the lower surface 182 side of the positioning sheet 180, in other words, the side of the positioning sheet 180 opposite to the side on which the leads are present, that is, the uppermost sheet 134 which is an insulating sheet is present. It exists on the opposite side to the side that does. Also in this case, in the initial state before deformation shown in FIG. 20, the tip-side end 168 of each lead is offset from the terminal-side end 161 of the lead in the first horizontal direction D 1 .
【0055】成形プロセスにおいては、絶縁シート13
4と位置決めシート180とを、夫々保持台198と保
持台199とに係合させる。それら保持台を、それらが
相手に対して相対的に移動するように移動させ、それに
よって保持台199及び位置決めシート180を(従っ
てリードの先端側端部168を)、絶縁シート134及
びリードの端子側端部166に対して相対的に円弧形に
移動させて、図21に示した位置まで移動させる。位置
決めシート180を(従ってリードの先端側端部を16
8を)、リードの端子側端部に対して相対的に、第1方
向D1 とは逆向きの第2水平方向へ移動させると共に、
絶縁シート134及び端子側端部166から離れる方向
である垂直下方へも移動させる。ここでも、各々のリー
ドの先端側端部は、水平方向にはそのリードの端子側端
部へ近付く方向へ移動させるが、垂直方向にはそのリー
ドの端子側端部から離れる方向へ移動させるようにし、
これによって、リードが変形されて、垂直方向に高さを
持つS字形に屈曲した状態になる。ここでも、全てのS
字形リードは、そのリードを構成しているリボンの主面
に対して垂直な方向に屈曲されている。更に、それらS
字形リードは、互いに平行に延在している。In the molding process, the insulating sheet 13
4 and the positioning sheet 180 are engaged with the holding table 198 and the holding table 199, respectively. The holders are moved so that they move relative to one another, thereby holding holder 199 and positioning sheet 180 (and thus lead end 168), insulating sheet 134 and lead terminals. It is moved in an arc shape relative to the side end portion 166, and is moved to the position shown in FIG. Position the positioning sheet 180
8), relative to the terminal side end of the lead, while moving in the second horizontal direction opposite to the first direction D 1 ,
It is also moved vertically downward, which is a direction away from the insulating sheet 134 and the terminal side end portion 166. Again, the tip end of each lead is moved horizontally toward the lead terminal end, but vertically moved away from the lead terminal end. West,
As a result, the lead is deformed and bent into an S-shape having a vertical height. Again, all S
The V-shaped lead is bent in a direction perpendicular to the main surface of the ribbon forming the lead. Furthermore, those S
The V-shaped leads extend parallel to each other.
【0056】この工程に続いて、流動性及び硬化性を有
する絶縁材料118を、絶縁シート134と位置決めシ
ート180との間へ導入し、先に説明したものと実質的
に同様にして硬化させ、硬化が完了したならば、この接
続部品を保持台から取外す。続いて、図22に示したよ
うに、位置決めシート180を除去して(溶剤を作用さ
せて除去することが好ましい)絶縁支持層118の下面
119を露出させる。この状態においては、絶縁支持層
118が、複数のリード160を囲繞して支持してい
る。各々のリードの先端構造体181は、絶縁支持層の
下面に露出している。先端構造体181に導電性接合材
料170を付着させ、絶縁支持層118の下面119の
全面に絶縁性接着剤173を塗布する。この絶縁性接着
剤には、例えば、いわゆる瞬間硬化接着剤で、その活性
化温度が、室温よりは高いが、このアセンブリのその他
の構成要素を損傷させるおそれのある温度よりは低いも
のを用いる。適当な無溶剤形の瞬間硬化接着剤の一例を
挙げるなら、米国、カリフォルニア州、 Rancho Doming
uez に所在の Ablestick Electronics Materials andAd
hesives 社が 「ABLEBOND 967-3」という商品名で販売
しているものがある。導電性接合材料170には、先に
説明した共晶合金形接合材料を用いることができ、また
更に、酸化を防止するために薄い金の層を形成するよう
にしてもよい。以上が完了した時点で、この接続部品は
使用可能な状態になる。Following this step, a flowable and curable insulating material 118 is introduced between the insulating sheet 134 and the positioning sheet 180 and cured in substantially the same manner as previously described. When the curing is complete, remove this connecting piece from the holding table. Subsequently, as shown in FIG. 22, the positioning sheet 180 is removed (preferably a solvent is used for removal) to expose the lower surface 119 of the insulating support layer 118. In this state, the insulating support layer 118 surrounds and supports the leads 160. The tip structure 181 of each lead is exposed on the lower surface of the insulating support layer. A conductive bonding material 170 is attached to the tip structure 181, and an insulating adhesive 173 is applied to the entire lower surface 119 of the insulating support layer 118. The insulating adhesive is, for example, a so-called flash cure adhesive, the activation temperature of which is above room temperature but below the temperature at which other components of the assembly may be damaged. Rancho Doming, CA, USA, is an example of a suitable solventless instant cure adhesive.
Ablestick Electronics Materials and Ad located in uez
There is a product sold by hesives under the product name "ABLEBOND 967-3". The eutectic alloy type bonding material described above can be used as the conductive bonding material 170, and further, a thin gold layer may be formed to prevent oxidation. When the above is completed, this connecting component is ready for use.
【0057】使用法について説明すると、絶縁支持層の
下面119を、半導体チップ、ウェーハ、或いはその他
のマイクロエレクトロニクス素子202の接点装備面2
00に重ね合わせて、複数のリードの夫々の先端側端部
168を(従って先端構造体181及び導電性接合材料
170を)、複数の接点204に位置合わせし、続い
て、そのように組合せたアセンブリを加熱及び加圧し、
その加圧によって絶縁支持層118の下面119を接点
装備面200に接触させて、複数のリードの夫々の先端
側端部を複数の接点に接触させる。この状態の下で、接
着剤173が、絶縁支持層118とマイクロエレクトロ
ニクス素子202との間の無空隙の境界面を形成し、ま
た複数のリードとマイクロエレクトロニクス素子の複数
の接点との間に、導電性接合材料が金属接合によって接
続したボンド部を形成して、それらを電気的接続を形成
し、これによって、複数の端子144が複数の接点に接
続される。こうして出来上がったアセンブリは、回路板
やその他の基板の上に、先に説明したアセンブリと同様
にして搭載することができ、それによって同様の利点が
得られる。ここでも、この接続部品を大きな部品として
製作し、1枚のウェーハの全てのチップに同時に取付け
た後に、そのウェーハからチップを切り出すと共に絶縁
シートの夫々の部分を互いに切り離すことによって、個
々のユニットを形成することができる。また別法とし
て、この接続部品をチップ1個の大きさに製作し、ウェ
ーハからチップを切り出した後に、チップ1個ずつにそ
の接続部品を取付けるようにすることも可能である。To explain the method of use, the lower surface 119 of the insulating support layer is used as the contact mounting surface 2 of the semiconductor chip, wafer, or other microelectronic device 202.
00, the distal ends 168 of each of the plurality of leads (and thus the tip structure 181 and conductive bonding material 170) were aligned with the plurality of contacts 204, and then so combined. Heat and press the assembly,
By the pressure, the lower surface 119 of the insulating support layer 118 is brought into contact with the contact mounting surface 200, so that the tip end portions of the leads are brought into contact with the contacts. Under this condition, the adhesive 173 forms a void-free interface between the insulating support layer 118 and the microelectronic device 202, and also between the leads and the contacts of the microelectronic device. The conductive bonding material forms bonds that are connected by metallurgical bonding to form electrical connections between them, thereby connecting the terminals 144 to the contacts. The resulting assembly can be mounted on a circuit board or other substrate in the same manner as the previously described assembly, with similar advantages. Again, this connection part is manufactured as a large part, mounted on all the chips of one wafer at the same time, and then the chips are cut out from the wafer and the individual parts of the insulating sheet are cut off from each other to separate the individual units. Can be formed. Alternatively, it is also possible to manufacture this connecting component in the size of one chip, cut the chip from the wafer, and then attach the connecting component to each chip.
【0058】更に別の変更例として、位置決めシート1
80を最終的に完成した接続部品の一部としてそのまま
残すようにしてもよい。この場合には位置決めシート1
80を、最上層シート134に使用する材料と同様の可
撓性を有する絶縁材料で形成することが好ましい。位置
決めシート180には、その下面に接着剤の被覆層を形
成して、位置決めシートとチップ等のマイクロエレクト
ロニクス素子との間の無空隙の境界面の形成を助けるよ
うにしてもよい。更に別の変更例として、リードの端子
側端部を担持している第1要素それ自体を、剛性を有す
る厚い基板で形成し、リードの端子側端部に内部導体を
接続するようにしてもよい。この種の構成においては、
マイクロエレクトロニクス素子であるチップを直接、リ
ードを介して基板に接続し、リードフレーミング成形工
程では、そのマイクロエレクトロニクス素子をその基板
に対して相対的に移動させるようにする。以上に説明し
た構成及び方法においては、絶縁シートであるコネクタ
・ボディと、チップないしマイクロエレクトロニクス素
子との間に、変形可能層を形成するために使用していた
流動性の絶縁材料を省略することができる。これによっ
て、絶縁シートであるコネクタ・ボディが、チップない
しマイクロエレクトロニクス素子の上方に、リード自体
によって弾性支持されるようになる。As another modification, the positioning sheet 1
The 80 may be left as it is as a part of the finally completed connection component. In this case, positioning sheet 1
Preferably, 80 is formed of an insulating material that is flexible and similar to the material used for top sheet 134. An adhesive coating layer may be formed on the lower surface of the positioning sheet 180 to help form a void-free interface between the positioning sheet and a microelectronic element such as a chip. As still another modification, the first element itself, which carries the terminal-side end of the lead, may be formed of a thick substrate having rigidity, and the internal conductor may be connected to the terminal-side end of the lead. Good. In this type of configuration,
A chip, which is a microelectronic element, is directly connected to a substrate via a lead, and in the lead framing molding process, the microelectronic element is moved relative to the substrate. In the structure and method described above, the fluid insulating material used to form the deformable layer between the connector body, which is an insulating sheet, and the chip or the microelectronic element is omitted. You can This allows the connector body, which is an insulating sheet, to be elastically supported above the chip or microelectronic element by the leads themselves.
【0059】更に別の変更例として、リードの先端側端
部を移動させるための第2要素を、一時的にリードの先
端側端部に係合ないし接合するようにした、保持台に類
似した構造のツールとすることも可能である。リード移
動(成形)工程が終了したならば、そのツールをリード
の先端側端部から取外せばよい。As a further modification, the second element for moving the distal end portion of the lead is similar to the holding table in which the second element is temporarily engaged with or joined to the distal end portion of the lead. It can also be a structural tool. When the lead moving (molding) process is completed, the tool may be removed from the tip end of the lead.
【0060】この接続部品に備えられている端子を基板
に接続する方法は、必ずしもはんだ付け法に限られるも
のではない。その他の方法を用いることも可能であり、
例えば、共晶合金形接合法、拡散形接合法、或いは物理
的に端子を接点に接触した状態に維持する方法や、ソケ
ット部材等を用いる方法も可能である。端子の形態は、
それら方法に適合する形態に変更すればよい。共晶合金
形接合材料としては、好適な材料である金−スズの組成
物以外にも、様々な材料を用いることができる。例えば
金は、ゲルマニウム、シリコン、スズ、或いはそれらを
組合せた組成物との間で共晶合金組成物を形成すること
ができる。リードの先端側端部をウェーハないしその他
のマイクロエレクトロニクス部品の接点に取付けるため
に採用することのできる方法には、共晶合金形接合法以
外にも、例えば、液相の形成を伴わない拡散形接合法
や、はんだ付けによる方法、或いは金属を分散させたポ
リマー組成物を使用する方法等がある。接合材料を付着
させるために採用することのできる方法には、メッキ法
以外にも、例えば、リードの先端側端部を浸漬する浸漬
法、シルクスクリーンを使用した印刷法、それに、ペー
ストを塗布する方法等がある。導電性接合材料を付着さ
せる箇所を、リードの先端側端部ではなく、マイクロエ
レクトロニクス素子の接点にするということも可能であ
る。別法として、特に接合材料を必要としないボンディ
ング法を採用することもできる。その種のボンディング
法の具体例としては、リードの先端側端部を接点へ加熱
音波接合または加熱圧着接合する方法がある。リードの
材料としては、金以外にも、銀、銅、真鍮等を使用する
ことができる。端子、導電層、及びビア・ライナの材料
としては、銅及びニッケル以外にも様々な金属材料を使
用することができる。The method of connecting the terminals provided in this connection component to the substrate is not necessarily limited to the soldering method. Other methods can also be used,
For example, a eutectic alloy type joining method, a diffusion type joining method, a method of physically maintaining the terminal in contact with the contact, or a method of using a socket member or the like is also possible. The terminal form is
It may be changed to a form suitable for those methods. As the eutectic alloy-type bonding material, various materials can be used in addition to the gold-tin composition which is a suitable material. For example, gold can form a eutectic alloy composition with germanium, silicon, tin, or a combination thereof. Methods that can be used to attach the tip ends of the leads to the contact points of the wafer or other microelectronic components include, other than eutectic alloy bonding methods, for example, diffusion type methods without liquid phase formation. There are a joining method, a soldering method, a method of using a polymer composition in which a metal is dispersed, and the like. As the method that can be adopted for attaching the bonding material, in addition to the plating method, for example, a dipping method in which the tip end of the lead is dipped, a printing method using a silk screen, and a paste are applied. There are ways. It is also possible to make the place to which the conductive bonding material is attached not the tip end side end of the lead but the contact point of the microelectronic element. Alternatively, a bonding method that does not particularly require a bonding material can be adopted. As a specific example of such a bonding method, there is a method in which the tip end side end portion of the lead is joined to the contact by thermosonic bonding or thermocompression bonding. As the material of the lead, silver, copper, brass or the like can be used in addition to gold. Various metallic materials other than copper and nickel can be used as materials for the terminals, conductive layers, and via liners.
【0061】図23に示したように、各リード260
を、その端子側端部266が、絶縁シートであるコネク
タ・ボディ(図示せず)から上方へ突出した端子構造体
256に接続しており、また、その先端側端部268
に、この先端側端部を接点に接合するための接合材料2
72またはその他の適当な備えを施したものとすること
も可能である。これら構成要素は、先に説明した構造に
おける対応した構成要素と類似のものとすることができ
る。図23の構造は、リードの先端側端部268と端子
側端部266とを接続している屈曲した帯状部270を
含んでいる。初期状態である、図23に実線で描いたリ
ードの未変形状態においては、先端側端部、端子側端
部、及び帯状部270の全てが実質的に同一平面上にあ
って、コネクタ・ボディの下面に接触して或いは近接し
て位置している。この状態から、先端側端部268を、
ウェーハやチップ等のマイクロエレクトロニクス素子に
備えられている接点にボンディングし、それには、図1
3〜図15を参照して説明したのと同様の接続プロセス
を実行すればよい。As shown in FIG. 23, each lead 260
Is connected to a terminal structure 256 projecting upward from a connector body (not shown) which is an insulating sheet, and its end portion 268 is connected to the tip end portion 268.
And a bonding material 2 for bonding the tip end to the contact point.
72 or any other suitable provision may be provided. These components can be similar to the corresponding components in the structure described above. The structure of FIG. 23 includes a bent strip 270 connecting the tip end 268 of the lead and the terminal end 266. In the undeformed state of the lead drawn by the solid line in FIG. 23, which is the initial state, the tip end, the terminal end, and the strip 270 are all substantially on the same plane, and the connector body Is in contact with or close to the lower surface of the. From this state, the tip end side 268,
Bonding to contacts provided on microelectronic devices such as wafers and chips, which is shown in FIG.
The connection process similar to that described with reference to FIGS.
【0062】ボンディングが完了したならば、続いて、
そのマイクロエレクトロニクス素子を、コネクタ・ボデ
ィである絶縁シートに対して相対的に(従ってリードの
端子側端部266に対して相対的に)垂直方向下方へ直
線的に移動させる。これによって、端子側端部268
は、垂直下方へ、即ち第1要素(絶縁シート)から離れ
る方向へ同様の一方向性の移動をすることになる。この
相対移動の方向を図23には矢印V1'で示した。リード
の先端側端部のこの下方への移動によって、初期状態で
は屈曲していた帯状部270が、破線270’で模式的
に示したように、直線に近付けられる。従って、この移
動の完了後には、リードは、先に説明したS字形リード
よりも直線に近くなっている。ただし、この移動プロセ
スの実行中に、リードが完全には真っ直ぐにならないよ
うにすることが、従って、リードが先端側端部及び端子
側端部を絶縁シート及びマイクロエレクトロニクス素子
から引っ張ることがないようにすることが好ましい。初
期状態で屈曲している帯状部を備えたリードを用いる方
法には、更に、図15を参照して先に説明した、複合移
動を組込むこともできる。そうした場合には、その相対
的移動が、第2要素及び先端側端部268を端子側端部
266へ近付ける水平方向D2'への移動を含んでいるな
らば、予め屈曲した帯状部270を備えているために、
その屈曲した帯状部270を屈曲形状270”にするこ
とができる。After the bonding is completed,
The microelectronic element is linearly moved vertically downward relative to the connector body insulating sheet (and thus relative to the lead terminal end 266). As a result, the terminal side end portion 268
Will have a similar unidirectional movement vertically downward, ie away from the first element (insulation sheet). The direction of this relative movement is shown by the arrow V 1 'in FIG. By this downward movement of the tip end portion of the lead, the belt-shaped portion 270 that has been bent in the initial state is brought close to a straight line as schematically shown by a broken line 270 '. Therefore, after the completion of this movement, the lead is closer to a straight line than the S-shaped lead described above. However, it is necessary to ensure that the leads are not completely straightened during the course of this transfer process, so that the leads do not pull the tip end and the terminal end from the insulating sheet and the microelectronic element. Is preferred. The method of using a lead having a band portion that is bent in the initial state can further incorporate the compound movement described above with reference to FIG. In such a case, if the relative movement includes movement in the horizontal direction D 2 ′ that brings the second element and the tip end 268 closer to the terminal end 266, then the pre-curved band 270 is removed. To be prepared
The bent strip 270 can have a bent shape 270 ″.
【0063】このように初期状態で屈曲した複数のリー
ドを、コネクタ・ボディである絶縁シート上に配列する
際の配列の仕方は、様々なものとすることができる。例
えば各々の屈曲リードを、その端子側端部366と先端
側端部368との間の帯状部370が、その初期状態で
ある未変形の状態において、既にS字形をなして、コネ
クタ・ボディである絶縁シートの下面337(図24)
に沿って延在しているものとすることができる。また複
数のS字形リード構造体の並べ方は、図24に示したよ
うに、それらリードの端子側端部366を1本の列に沿
わせて配列し、それらリードの先端側端部368を同様
に、ただし端子側端部の列からオフセットした別の1本
の列に沿わせて配列して、それらリードを半ば重なり合
った形に並べるという方法がある。別法として、屈曲リ
ードを、そのリードの端子側端部382と先端側端部3
84との間に屈曲部を1箇所だけ備えた略々U字形の構
造体380とする方法もある。更に、幾つもの屈曲部を
備えた構造体とすることも可能である。The plurality of leads bent in the initial state as described above can be arranged in various ways on the insulating sheet which is the connector body. For example, each bent lead is formed into an S shape in the undeformed state in which the band-shaped portion 370 between the terminal side end portion 366 and the tip end side end portion 368 is already in the initial state, and the bent body is formed into a connector body. Lower surface 337 of an insulating sheet (FIG. 24)
Can extend along. In addition, as shown in FIG. 24, the arrangement of the plurality of S-shaped lead structures is such that the terminal side end portions 366 of the leads are arranged along one row and the tip side end portions 368 of the leads are the same. However, there is a method of arranging the leads along another row offset from the row of the terminal side ends and arranging the leads in a partially overlapping manner. Alternatively, the bent lead may be formed by connecting the terminal end 382 and the tip end 3 of the lead.
There is also a method of forming a substantially U-shaped structure 380 that has only one bent portion between the structure 84 and 84. Further, it is also possible to make a structure having a number of bent portions.
【0064】図26の接続部品では、各リードの先端側
端部468をその位置に保持するために、例えばボタン
部のような、この先端側端部の下側に備えた接続構造体
を使用してはいない。その代わりに各リードの先端側端
部468が、それに隣接しているリードの端子側端部4
66に、破断容易要素471を介して接続している。こ
の破断容易要素471によって、各々の先端側端部46
8をコネクタ・ボディである絶縁シートの下面437に
隣接した位置に保持しているのである。破断容易要素4
71は、リードそれ自体を構成している帯状部470に
連続した部分として形成することができ、即ち、この帯
状部470の両側からこの帯状部に切り込んだ一対のV
字形切欠部473で形成することができる。取付プロセ
スにおいては、リードの先端側端部468を、チップ等
のマイクロエレクトロニクス素子の接点にボンディング
し、このボンディングは先に説明したのと同様の方法で
行えばよく、例えば、先端側端部468に付着させた導
電性接合材料472を活性化させる等の方法を用いるこ
とができる。ボンディングが完了したならば、先に説明
したのと同様の方法で、マイクロエレクトロニクス素子
をコネクタ・ボディである絶縁シートに対して相対的に
移動させて、各リードの先端側端部468が垂直方向に
はコネクタ・ボディから離れる方向へ、即ち、そのリー
ドの端子側端部466から離れる方向へ移動し、また、
水平方向にはそのリードの端子側端部466へ近付く方
向へ移動するようにする。この移動の動作によって、破
断容易要素471が破断して、各リードの先端側端部が
それに隣接しているリードの端子側端部との結合から解
放される。破断容易リードの幾つかの形態が、例えば、
1994年2月3日発行のPCT公報第 WO9403036号(出願第
US93/06930号)に開示されている。尚、このPCT公報
の開示のうち、リードの破断容易構造を記載している部
分を、この言及をもって本開示に組込むものとする。In the connection part of FIG. 26, in order to hold the distal end portion 468 of each lead in its position, a connecting structure provided under the distal end portion, such as a button portion, is used. I haven't. Instead, the tip end 468 of each lead is connected to the terminal end 4 of the lead adjacent to it.
66 via a breakable element 471. This easy-to-break element 471 allows each distal end 46 to
8 is held at a position adjacent to the lower surface 437 of the insulating sheet that is the connector body. Breakable element 4
71 can be formed as a continuous part of the strip-shaped portion 470 that constitutes the lead itself, that is, a pair of Vs cut from both sides of the strip-shaped portion 470.
It can be formed by the letter-shaped notch 473. In the mounting process, the tip end portion 468 of the lead is bonded to the contact point of the microelectronic element such as a chip, and this bonding may be performed in the same manner as described above. It is possible to use a method such as activating the conductive bonding material 472 attached to the. When the bonding is completed, the microelectronic element is moved relative to the insulating sheet that is the connector body in the same manner as described above, so that the front end 468 of each lead is vertically moved. Move away from the connector body, ie away from the terminal end 466 of the lead, and
In the horizontal direction, the lead is moved toward the terminal side end portion 466. This movement action causes the rupture element 471 to rupture, releasing the tip end of each lead from coupling with the terminal end of the adjacent lead. Some forms of easy break leads include, for example:
PCT Bulletin No. WO9403036 (Application No. 2/3/1994)
US93 / 06930). Note that, in the disclosure of this PCT publication, a portion describing a structure for easily breaking a lead is incorporated into the present disclosure with this reference.
【0065】図27の接続部品では、各リードの先端側
端部568には膨出部を設けておらず、この先端側端部
568は、そのリードを形成している帯状部570の連
続した一部を構成している。ここでも、各リードの先端
側端部568はそれに隣接しているリードの端子側端部
566に、破断容易部571を介して接続している。こ
の接続部品では、絶縁シートであるコネクタ・ボディ5
34が、リードの端子側端部568に位置合せされた孔
569を備えている。図28に示したように、この接続
部品に関して実行するボンディング手順においては、ボ
ンディング・ツール593が使用される。絶縁シートで
あるコネクタ・ボディ534と、それに設けられている
複数のリードとを、マイクロエレクトロニクス素子であ
るチップ586の複数の接点594に位置合せした後
に、ボンディング・ツール593を孔569の中へ降ろ
して各リードの先端側端部568に次々と押付けて行
き、それら先端側端部を夫々の接点にボンディングして
行く。このボンディングが完了したならば、マイクロエ
レクトロニクス素子であるチップ586を、絶縁シート
であるコネクタ・ボディ534に対して相対的に、先に
説明したのと同様に移動させる。ここでも、この移動に
よって、各リードの先端側端部568とそれに隣接して
いるリードの端子側端部566との間の破断容易部57
1が破断して、先端側端部568が解放され、それによ
ってリードを、絶縁シートであるコネクタ・ボディ53
4から離れる方向へ先に説明したのと同様にして屈曲さ
せることができるようになる。この移動工程の実行前ま
たは完了後に孔569を塞ぐようにしてもよく、それに
は、例えば、絶縁層の上面に更に別のフィルムないしシ
ートを貼着すればよい。In the connection part of FIG. 27, the tip end side 568 of each lead is not provided with a bulge, and the tip end side end 568 is a continuous strip 570 forming the lead. It constitutes a part. Here again, the tip end 568 of each lead is connected to the terminal end 566 of the lead adjacent thereto via the breakable portion 571. In this connection part, the connector body 5 which is an insulating sheet
34 includes a hole 569 aligned with the terminal end 568 of the lead. As shown in FIG. 28, the bonding tool 593 is used in the bonding procedure executed for this connecting component. After aligning the connector body 534, which is an insulating sheet, and the leads provided therein with the contacts 594 of the chip 586, which is a microelectronic element, the bonding tool 593 is lowered into the hole 569. Then, the leads are pressed to the tip end portions 568 of the leads one after another, and the tip end portions are bonded to the respective contacts. When this bonding is completed, the chip 586, which is a microelectronic element, is moved relative to the connector body 534, which is an insulating sheet, in the same manner as described above. Again, this movement results in a breakable portion 57 between the tip end 568 of each lead and the terminal end 566 of the lead adjacent thereto.
1 is broken and the distal end 568 is released, thereby allowing the leads to be connected to the connector body 53 which is an insulating sheet.
It becomes possible to bend in the direction away from 4 in the same manner as described above. The hole 569 may be closed before or after this moving step is performed, for example, another film or sheet may be attached to the upper surface of the insulating layer.
【0066】図29に示したように、ウェーハやチップ
等のマイクロエレクトロニクス素子686それ自体に、
そのチップないしウェーハ等の接点装備面692に沿っ
て延在する、或いはその上方に延在する複数のリード6
60を装備するということも可能である。ある。この場
合、各リードの固定端部である端子側端部666を、そ
のチップないしウェーハ等の接点694に、従って、そ
のチップないしウェーハ等の内部回路(参照番号695
で模式的に示した)に、恒久的に接続してもよい。各リ
ードの先端側端部668は、そのチップないしウェーハ
等の上面に、例えば先に説明したのと同様に弱い力で粘
着する小さなボタン部680を介して、容易に取り外せ
る状態で止着しておくようにすればよい。先端側端部に
接合材料672を付着させておくようにすることも任意
である。これらの構造は、先に説明したリード構造体と
実質的に同様の方法で製作することができる。チップの
接点装備面692には、リード成形工程の実行中にチッ
プ自体を保護するための、ポリイミド等の絶縁材料の被
覆層693をコートしておくのもよい。この被覆層69
3は、完成したアセンブリにそのまま残っていても構わ
ない。図29の複数のリードを装備したチップないしウ
ェーハは、下面637に複数の端子644を装備したコ
ネクタ・ボディ634に取付けることができる。それら
端子644の各々は内部回路の素子ないし導体645に
接続している。更にそれら端子644の各々が、コネク
タ・ボディの上面に備えられている構造体646に接続
されている構成とすることもできる。構造体646は、
例えば先に説明したようなはんだボール・プロセスによ
って、外部の基板に接続できるようにしたものである。
ボンディング・プロセスは先に説明したものと実質的に
同一である。ここでも、ボンディングの完了後には、2
つの要素を垂直方向には相手から離れる方向へ移動さ
せ、それと共に水平方向にも移動させて、望ましい形に
屈曲させたリード構造体を形成するようにする。As shown in FIG. 29, the microelectronic element 686 itself such as a wafer or a chip is
A plurality of leads 6 extending along or above the contact mounting surface 692 of the chip or wafer.
It is also possible to equip 60. is there. In this case, the terminal side end portion 666 which is the fixed end portion of each lead is connected to the contact 694 of the chip or the wafer, and thus the internal circuit of the chip or the wafer (reference numeral 695).
(Schematically shown in FIG. 3) may be permanently connected. The tip-side end portion 668 of each lead is easily attached to the upper surface of the chip or the wafer, for example, via the small button portion 680 that adheres with a weak force as described above. You should leave it. It is also optional to adhere the bonding material 672 to the tip end portion. These structures can be made in a manner substantially similar to the lead structure described above. The contact mounting surface 692 of the chip may be coated with a coating layer 693 of an insulating material such as polyimide for protecting the chip itself during the lead forming process. This coating layer 69
No. 3 may remain in the completed assembly. The chip or wafer with multiple leads of FIG. 29 can be attached to a connector body 634 with multiple terminals 644 on the bottom surface 637. Each of these terminals 644 is connected to an element or conductor 645 of the internal circuit. Further, each of the terminals 644 may be connected to the structure 646 provided on the upper surface of the connector body. The structure 646 is
For example, it can be connected to an external substrate by the solder ball process as described above.
The bonding process is substantially the same as described above. Again, after the bonding is complete, 2
The two elements are moved vertically away from each other and with them horizontally to form the desired bent lead structure.
【0067】図30に示したように、本発明の更に別の
実施例にかかるアセンブリとして、複数のチップ70
1、702、703のような、複数のマイクロエレクト
ロニクス素子を含むことのできるアセンブリがある。こ
れら複数の素子を、例えば共通支持部材であるヒート・
シンク704に物理的に取付け、その際に、夫々の接点
装備面705、706、707が互いに略々同一平面上
にくるようにする。それらチップの厚さが互いに異なる
場合には、ヒート・シンク704に、互いに高さの異な
る複数のチップ搭載面を設けておけばよい。それらマイ
クロエレクトロニクス素子を、それらの間の相対的な水
平方向位置が、所定の相対的位置となるように配置す
る。これは即ち、それらチップの接点アレイどうしの間
の相対的な位置が、所定の相対的位置となるように配置
するということに他ならない。それら素子に適用するコ
ネクタ・ボディ734は、多数の端子744を装備して
いる。それら端子744は、夫々のチップ(マイクロエ
レクトロニクス素子)に設けられている夫々の接点のア
レイに対応したアレイを成すように配列しておくことが
望まれる。端子744は更に、外部の基板(図示せず)
に接続できるようにしてある。それら端子744と、複
数のチップの複数の接点との間を接続する、非常に多く
のS字形リード766を、先に説明したのと同様の成形
工程によって成形する。その場合に、コネクタ・ボディ
734を、チップ701、702、703を組合せたア
センブリに重ね合わせて、コネクタ・ボディ734に装
備した複数のリードの先端側端部を、複数のチップの複
数の接点に同時にボンディングすればよく、このボンデ
ィングが完了したならば、それらチップのアセンブリを
コネクタ・ボディ734に対して相対的に移動させる。
別法として、図29を参照して先に説明したようにし
て、複数のチップ701、702、703の方にリード
を装備し、それらリードの先端側端部を、コネクタ・ボ
ディの複数の端子744にボンディングするという方法
を用いてもよい。ここでも、変形容易な絶縁材料(図示
せず)を、コネクタ・ボディとチップのアセンブリとの
間の空間に注入して、屈曲したリードを実質的に囲繞す
ることが望ましい。この構成では、コネクタ・ボディ7
34は、相互接続用の複数の導体745を備えており、
それら導体は、異なった端子744どうしを相互接続
し、従って、異なったチップ(マイクロエレクトロニク
ス素子)どうしを相互接続して、マルチチップ・モジュ
ールを形成する。図30に示したそれら導体745は、
あくまでも模式的に示したものである。実際に利用する
際には、それら導体は、例えば多層配線した何本もの導
体を含むものであったり、コネクタ・ボディ734自体
の上面と下面とに形成された何本もの導体を含むもので
あったりする。別法の工程として、複数のチップ70
1、702、703の各々を、個別にコネクタ・ボディ
734に位置合せして、夫々のリード760の先端側端
部768にボンディングした後に、それらチップに支持
部材ないしヒート・シンク704を接合するという方法
もある。As shown in FIG. 30, a plurality of chips 70 are provided as an assembly according to still another embodiment of the present invention.
There are assemblies, such as 1, 702, 703, that can include multiple microelectronic elements. These multiple elements are connected to the heat
Physically attached to the sink 704 so that the respective contact mounting surfaces 705, 706, 707 are substantially coplanar with each other. When the chips have different thicknesses, the heat sink 704 may be provided with a plurality of chip mounting surfaces having different heights. The microelectronic elements are arranged such that the relative horizontal position between them is a predetermined relative position. This means that the relative positions of the contact arrays of the chips are arranged so as to be a predetermined relative position. The connector body 734 applied to these devices is equipped with a large number of terminals 744. It is desired that the terminals 744 be arranged so as to form an array corresponding to the array of the respective contacts provided on the respective chips (microelectronic elements). The terminal 744 is further provided on an external board (not shown).
It can be connected to. A large number of S-shaped leads 766 connecting between the terminals 744 and the contacts of the chips are molded by a molding process similar to that described above. In that case, the connector body 734 is superposed on the assembly in which the chips 701, 702, and 703 are combined, and the distal end portions of the leads provided in the connector body 734 are connected to the contacts of the chips. Bonding can be done at the same time, and once this bonding is complete, the chip assembly is moved relative to the connector body 734.
Alternatively, a plurality of chips 701, 702, 703 may be provided with leads, and the distal ends of the leads may be attached to a plurality of terminals of the connector body as described above with reference to FIG. A method of bonding to 744 may be used. Again, it is desirable to inject a deformable insulating material (not shown) into the space between the connector body and the assembly of chips to substantially surround the bent leads. In this configuration, the connector body 7
34 comprises a plurality of conductors 745 for interconnection,
The conductors interconnect different terminals 744 and thus different chips (microelectronic devices) to form a multi-chip module. The conductors 745 shown in FIG.
It is only shown schematically. In actual use, these conductors include, for example, a number of conductors that are multi-layered, or a number of conductors that are formed on the upper surface and the lower surface of the connector body 734 itself. Or As an alternative process, a plurality of chips 70
Each of the 1, 702, 703 is individually aligned with the connector body 734 and bonded to the distal end 768 of the respective lead 760 and then the support member or heat sink 704 is bonded to the chips. There is also a method.
【0068】本発明にかかる構造及び方法によって接続
するマイクロエレクトロニクス素子は、チップそのもの
を含んでいる必要はない。例えば、マイクロエレクトロ
ニクス素子自体は、剛性プリント配線板、セラミック・
モジュール、或いは金属コア配線層等の、回路板ないし
相互接続モジュールであってもよい。この種の素子に接
続するために使用するリードは、一般的に、チップない
しウェーハに接続するために使用するリードよりも大型
である。従って、回路板に直接接続するために使用する
リードは、厚さが約 10 ミクロン〜約 35 ミクロンで、
長さが約 500ミクロン〜約 2500 ミクロンの、リボン形
状の構造体として形成することが望ましい。この用途に
用いるリボンは、金よりも銅合金で形成することが望ま
しい。The microelectronic components connected by the structure and method according to the present invention need not include the chip itself. For example, the microelectronic device itself is a rigid printed wiring board, a ceramic
It may be a circuit board or interconnect module such as a module or metal core wiring layer. The leads used to connect to this type of device are generally larger than the leads used to connect to a chip or wafer. Therefore, the leads used to connect directly to the circuit board should be about 10 microns to about 35 microns thick and
Desirably, it is formed as a ribbon-shaped structure having a length of about 500 microns to about 2500 microns. The ribbon used for this purpose is preferably formed of a copper alloy rather than gold.
【0069】以上に説明した多くの特徴の、様々な変更
態様、並びに種々の組合せを、請求項に記載した発明か
ら逸脱することなく実施することができる。従って、以
上の好適実施例の説明はあくまでも具体例を例示したも
のであって、本発明はそれら好適実施例に限定されるも
のではない。Various modifications, as well as various combinations, of the many features described above can be implemented without departing from the claimed invention. Therefore, the above description of the preferred embodiments is merely an example, and the present invention is not limited to these preferred embodiments.
【図1】本発明の一実施例にかかる部品の製造に用いる
要素の平面図である。FIG. 1 is a plan view of an element used to manufacture a component according to an embodiment of the present invention.
【図2】図1に示した要素のうちの1つの要素の一部分
を拡大して模式的に示した部分断面部である。FIG. 2 is a partial cross-sectional view schematically showing an enlarged part of one of the elements shown in FIG.
【図3】図2に示した要素の部分を示した部分上面図で
あるが、ただし製造過程における図2よりも後の段階を
示した図である。FIG. 3 is a partial top view showing a portion of the element shown in FIG. 2, but at a stage later than FIG. 2 in the manufacturing process.
【図4】図2と同様の模式的な部分断面図であるが、た
だし製造過程における図2よりも後の段階を示した図で
ある。FIG. 4 is a schematic partial cross-sectional view similar to FIG. 2, but showing a stage after that in FIG. 2 in the manufacturing process.
【図5】図2と同様の模式的な部分断面図であるが、た
だし製造過程における図3よりも後の段階を示した図で
ある。FIG. 5 is a schematic partial cross-sectional view similar to FIG. 2, but showing a stage later than that in FIG. 3 in the manufacturing process.
【図6】図2と同様の模式的な部分断面図であるが、た
だし製造過程における図4よりも後の段階を示した図で
ある。FIG. 6 is a schematic partial cross-sectional view similar to FIG. 2, but showing a stage later than that of FIG. 4 in the manufacturing process.
【図7】図2と同様の模式的な部分断面図であるが、た
だし製造過程における図5よりも後の段階を示した図で
ある。FIG. 7 is a schematic partial cross-sectional view similar to FIG. 2, but showing a stage later than FIG. 5 in the manufacturing process.
【図8】図1〜図7に示した要素の部分を示した部分底
面図である。FIG. 8 is a partial bottom view showing a portion of the element shown in FIGS.
【図9】図2と同様の図であるが、ただし製造過程にお
ける更に後の段階での要素を示した図である。FIG. 9 is a view similar to FIG. 2, but showing the elements at a later stage in the manufacturing process.
【図10】図2と同様の図であるが、ただし製造過程に
おける更に後の段階での要素を示した図である。FIG. 10 is a view similar to FIG. 2, but showing the elements at a later stage in the manufacturing process.
【図11】図1〜図10の部品を、本発明の別実施例に
かかる取付工程に用いられる更なる部品及び装置と共に
示した示した模式的な分解図であるが、FIG. 11 is a schematic exploded view showing the parts of FIGS. 1 to 10 together with further parts and devices used in the mounting process according to another embodiment of the present invention,
【図12】図11の工程の実行後の部分的に完成したア
センブリを示した上面図である。12 is a top view of the partially completed assembly after performing the process of FIG.
【図13】図10と同様の部分断面図であるが、ただし
取付工程における図10よりも後の段階にある前記部品
を半導体チップと共に示した図である。FIG. 13 is a partial cross-sectional view similar to FIG. 10, but showing the part together with the semiconductor chip at a stage later than FIG. 10 in the mounting process.
【図14】図10と同様の部分断面図であるが、ただし
取付工程における図13よりも後の段階にある前記部品
を半導体チップと共に示した図である。FIG. 14 is a partial cross-sectional view similar to FIG. 10, but showing the part together with the semiconductor chip at a stage later than FIG. 13 in the mounting process.
【図15】図10と同様の部分断面図であるが、ただし
取付工程における図14よりも後の段階にある前記部品
を半導体チップと共に示した図である。FIG. 15 is a partial cross-sectional view similar to FIG. 10, but showing the component together with the semiconductor chip at a stage later than that in FIG. 14 in the mounting process.
【図16】図10と同様の部分断面図であるが、ただし
取付工程における図15よりも後の段階にある前記部品
を半導体チップと共に示した図である。16 is a partial cross-sectional view similar to FIG. 10, but showing the component together with the semiconductor chip at a stage later than FIG. 15 in the mounting process.
【図17】図10と同様の部分断面図であるが、ただし
取付工程における図16よりも後の段階にある前記部品
を半導体チップと共に示した図である。FIG. 17 is a partial cross-sectional view similar to FIG. 10, but showing the component together with the semiconductor chip at a stage later than that in FIG. 16 in the mounting process.
【図18】完成したアセンブリを示した斜視図である。FIG. 18 is a perspective view showing the completed assembly.
【図19】図10と同様の部分断面図であるが、ただし
本発明の別実施例にかかる部品を示した図である。FIG. 19 is a partial cross-sectional view similar to FIG. 10, but showing components according to another embodiment of the invention.
【図20】本発明の更なる別実施例にかかる部品及び工
程を示した部分断面図である。FIG. 20 is a partial sectional view showing components and steps according to still another embodiment of the present invention.
【図21】図20と同様の部分断面図であるが、ただし
図20よりも後の段階にある前記部品を示した図であ
る。21 is a partial cross-sectional view similar to FIG. 20, but showing the component at a later stage than FIG. 20.
【図22】図20と同様の部分断面図であるが、ただし
図21よりも後の段階にある前記部品を示した図であ
る。22 is a partial cross-sectional view similar to FIG. 20, but showing the component at a later stage than FIG. 21.
【図23】本発明の更なる別実施例にかかる部品の作用
を説明した模式的部分斜視図である。FIG. 23 is a schematic partial perspective view explaining the operation of the component according to still another embodiment of the present invention.
【図24】本発明の更なる別実施例にかかる部品を示し
た模式的な部分平面図である。FIG. 24 is a schematic partial plan view showing a component according to still another embodiment of the present invention.
【図25】本発明の更なる別実施例にかかる部品を示し
た模式的な部分平面図である。FIG. 25 is a schematic partial plan view showing a component according to still another embodiment of the present invention.
【図26】本発明の更なる別実施例にかかる部品を示し
た模式的な部分平面図である。FIG. 26 is a schematic partial plan view showing a component according to still another embodiment of the present invention.
【図27】本発明の更なる別実施例にかかる部品を示し
た模式的な部分平面図である。FIG. 27 is a schematic partial plan view showing a component according to still another embodiment of the present invention.
【図28】図27の部品に用いる取付工程の一部を示し
た模式的な部分断面図である。28 is a schematic partial cross-sectional view showing a part of a mounting process used for the component of FIG. 27. FIG.
【図29】本発明の更なる別実施例にかかる部品を示し
た模式的な部分断面図である。FIG. 29 is a schematic partial cross-sectional view showing a component according to still another embodiment of the present invention.
【図30】本発明の更なる別実施例にかかるアセンブリ
の模式的な部分側面図である。FIG. 30 is a schematic partial side view of an assembly according to yet another embodiment of the present invention.
34 絶縁シート(コネクタ・ボディ) 44 端子 60 リード 66 リードの端子側端部 68 リードの先端側端部 84 接続部品 86 ウェーハ 90 接点 94 118 絶縁支持層 134 絶縁シート(最上層シート) 160 リード 202 マイクロエレクトロニクス素子 204 接点 366、466、566、666 リードの端子側端部 368、468、588、668 リードの先端側端部 534、634、734 絶縁シート(コネクタ・ボデ
ィ) 660、760 リード 701、702、703 チップ34 Insulation Sheet (Connector Body) 44 Terminal 60 Lead 66 Lead Terminal Side End 68 Lead Tip Side End 84 Connection Component 86 Wafer 90 Contact 94 118 Insulation Support Layer 134 Insulation Sheet (Top Layer Sheet) 160 Lead 202 Micro Electronic element 204 Contact point 366, 466, 566, 666 Lead end side 368, 468, 588, 668 Lead end side 534, 634, 734 Insulation sheet (connector body) 660, 760 Lead 701, 702, 703 chip
───────────────────────────────────────────────────── フロントページの続き (72)発明者 トーマス・エイチ・ディステファーノ アメリカ合衆国カリフォルニア州95030, モンテ・セレノ,ロビン・アン・レーン 15363 (72)発明者 ジョン・ダブリュー・スミス アメリカ合衆国カリフォルニア州94303, パロ・アルト,サン・アントニオ・ロード 777,ナンバー140 ─────────────────────────────────────────────────── ─── Continued Front Page (72) Inventor Thomas H. Distefano California, USA 95030, Monte Sereno, Robin Ann Lane 15363 (72) Inventor John W. Smith, California 94303, Palo, USA Alto, San Antonio Road 777, number 140
Claims (67)
アレイの製造方法において、 (a) 第1要素(84)を用意するステップであって、該第1
要素は複数の細長い可撓性リード(60)を備えた第1面(3
7)を有し、それら複数のリードは該第1面に沿って延在
しており、それら複数のリードの各々は、該第1要素に
取付けられた端子側端部(66)と、該端子側端部からオフ
セットした先端側端部(68)とを有する、第1要素用意ス
テップと、 (b) 前記複数のリードを成形するステップであって、前
記複数のリードの夫々の前記先端側端部の全てを同時
に、前記第1要素に対して相対的に所定変位をなすよう
に変位させて前記先端側端部を前記第1要素から離れる
方向へ屈曲させ、それによって該成形ステップの完了後
には前記複数の細長い可撓性リードが前記第1面から離
れる方向へ延在しているようにすることで前記複数のリ
ードを成形する、リード成形ステップと、を含んでいる
ことを特徴とする方法。1. Leads for microelectronics
In the array manufacturing method, (a) a step of preparing a first element (84),
The element has a first side (3) with a plurality of elongated flexible leads (60).
7), the plurality of leads extending along the first surface, each of the plurality of leads having a terminal end (66) attached to the first element, A first element preparing step having a tip side end portion (68) offset from a terminal side end portion, and (b) molding the plurality of leads, wherein the tip side of each of the plurality of leads is provided. All of the ends are simultaneously displaced relative to the first element in a predetermined displacement to bend the distal end away from the first element, thereby completing the molding step. A lead forming step of subsequently forming the plurality of leads by causing the plurality of elongated flexible leads to extend in a direction away from the first surface. how to.
部(68)が初期状態では前記第1要素に止着されており、
前記複数のリードの夫々の前記先端側端部が前記リード
成形ステップの実行中に前記第1要素から引き離される
ことを特徴とする請求項1記載の方法。2. The front end portion (68) of each of the plurality of leads is fixed to the first element in an initial state,
The method of claim 1, wherein the distal end of each of the plurality of leads is pulled away from the first element during the lead forming step.
部を第2要素(86)に取付ける取付ステップを更に含んで
おり、前記リード成形ステップが、前記第2要素を前記
第1要素に対して相対的に前記所定変位をなすように移
動させる移動ステップを含んでいることを特徴とする請
求項1または2記載の方法。3. The method further comprises the step of attaching the distal end of each of the plurality of leads to a second element (86), the lead forming step including attaching the second element to the first element. 3. The method according to claim 1 or 2, further comprising a moving step of moving the member relative to the predetermined displacement.
部が、初期状態では当該リードの前記端子側端部から前
記第1要素の前記第1面に平行な第1水平方向(D1) へ
オフセットしており、前記要素を移動させる前記移動ス
テップが、前記第2要素を前記第1方向と逆向きの第2
水平方向(D1) へ移動させると共に、該第2要素を前記
第1要素から離れる方向である垂直方向下方へ移動させ
るステップを含んでいることを特徴とする請求項3記載
の方法。4. The tip-side end portion of each of the plurality of leads is initially in a first horizontal direction (D 1) parallel to the first surface of the first element from the terminal-side end portion of the lead. ), The moving step of moving the element causes the second element to move in a second direction opposite to the first direction.
Is moved in the horizontal direction (D 1), The method according to claim 3, characterized in that it comprises a step of moving vertically downward is a direction away said second element from said first element.
て前記複数のリードの各々が成形位置へ移動され、該成
形位置では当該リードが前記第1面から離れる略々垂直
方向へ延在することを特徴とする請求項4記載の方法。5. The horizontal and vertical movements cause each of the plurality of leads to move to a molding position where the leads extend in a generally vertical direction away from the first surface. The method of claim 4 characterized.
複数のリードの周囲に流動性絶縁材料(108) を注入して
該流動性絶縁材料を硬化させ、それによって前記複数の
リードの周囲に絶縁支持層を形成するステップを含んで
いることを特徴とする請求項3記載の方法。6. Injecting a flowable insulating material (108) around the plurality of leads to cure the flowable insulating material after completion of the lead forming step, thereby providing an insulating support around the plurality of leads. 4. The method of claim 3, including the step of forming a layer.
が、前記第2要素と前記第1要素との間に前記流動性絶
縁材料を注入するステップを含んでいることを特徴とす
る請求項6記載の方法。7. The step of injecting a flowable insulating material comprises the step of injecting the flowable insulating material between the second element and the first element. The method described.
要素(180) を除去するステップを含んでいることを特徴
とする請求項6記載の方法。8. The second layer after the formation of the insulating support layer is completed.
The method of claim 6 including the step of removing the element (180).
1面に接着剤(173)を塗布するステップを含んでいるこ
とを特徴とする請求項8記載の方法。9. The method of claim 8 including the step of applying an adhesive (173) to a first surface of the support layer opposite the first layer.
相対的に移動させる前記移動ステップが、前記2要素を
ツール(94)に、該ツールが該第2要素の前記第1要素と
は反対側の第1面に当接するようにして係合させるステ
ップと、前記第1要素をフィクスチャ(105) に、該フィ
クスチャが該第1要素の前記第2要素とは反対側の第2
面に当接するようにして係合させるステップと、前記ツ
ールと前記フィクスチャとが互いに相手に対して相対的
に移動するようにするステップとを含んでいることを特
徴とする請求項3記載の方法。10. The moving step of moving the second element relative to the first element causes the two elements to be a tool (94), the tool being the first element of the second element. Abuttingly engaging the opposite first surface with the first element in a fixture (105), the fixture having a first element opposite the second element of the first element. Two
4. The method according to claim 3, further comprising a step of engaging the surfaces so as to abut each other, and a step of causing the tool and the fixture to move relative to each other. Method.
前記第1要素を前記フィクスチャに係合させる夫々の前
記ステップが、前記ツールと前記フィクスチャとの夫々
を介して負圧を供給することによって、大気圧が前記第
2及び第1要素を前記ツール及びフィクスチャに押圧す
るようにするステップを含んでいることを特徴とする請
求項10記載の方法。11. Each of the steps of engaging the second element with the tool and engaging the first element with the fixture provides a negative pressure through each of the tool and the fixture. 11. The method of claim 10 including the step of causing atmospheric pressure to press the second and first elements against the tool and fixture.
シートである上面と下面とを有する最上層シート(34)を
含んでおり、前記複数のリードが前記最上層シートの前
記下面(37)に沿って延在しており、前記複数のリードを
提供する前記ステップが、前記複数のリードの各々の前
記端子側端部に、前記最上層シートに形成した孔の中に
突出する端子構造体(44, 56)を設けるステップを含んで
いることを特徴とする請求項3記載の方法。12. The first element includes a top layer sheet (34) having a top surface and a bottom surface which are flexible insulating sheets, and the plurality of leads includes the bottom surface (34) of the top layer sheet (34). 37) along with the step of providing the plurality of leads at the terminal end of each of the plurality of leads protruding into the hole formed in the top sheet. The method of claim 3 including the step of providing a structure (44, 56).
シートである第2シート(180) を含んでおり、前記移動
ステップの完了後に前記最上層シートと前記第2シート
との間に流動性絶縁材料を注入し、該流動性絶縁材料を
硬化させ、それによって、前記最上層シートと前記第2
シートとの間に絶縁支持層(118) を形成するステップを
含んでいることを特徴とする請求項12記載の方法。13. The second element comprises a second sheet (180), which is a flexible insulating sheet, between the top sheet and the second sheet after completion of the moving step. Injecting a flowable insulating material and curing the flowable insulating material, whereby the top sheet and the second layer
13. The method of claim 12 including the step of forming an insulating support layer (118) with the sheet.
端部を前記第2要素に取付ける前記取付ステップが、前
記先端側端部の各々に、前記第2シートに形成した孔の
中に突出する先端構造体(181) を設けるステップを含ん
でおり、前記端子構造体を設ける前記ステップが、前記
端子構造体(144) が前記最上層シートの前記リードとは
反対側の前記上面において外方へ膨出するように実行さ
れ、前記先端構造体を設ける前記ステップが、前記先端
構造体が前記第2シートの前記リードとは反対側の下面
において外方へ膨出するように前記先端構造体を形成す
るステップを含んでおり、それによって、前記構造体の
前記外方膨出部分が、前記移動ステップの実行中に前記
両方のシートへ前記リードの両方の端部を止着するのを
助けるようにしたことを特徴とする請求項13記載の方
法。14. The attaching step of attaching the tip end of each of the plurality of leads to the second element projects into each of the tip ends into a hole formed in the second sheet. The step of providing the tip structure (181) for providing the terminal structure, the step of providing the terminal structure includes And the step of providing the tip structure is performed such that the tip structure bulges outward at a lower surface of the second sheet opposite the lead. Forming the outer bulge portion of the structure to help secure both ends of the lead to the sheets during the performance of the moving step. What you did 14. The method of claim 13 characterized.
をその上に装備した接点装備面を有する少なくとも1つ
の能動マイクロエレクトロニクス・デバイスを含んでお
り、前記複数のリードの夫々の前記先端側端部を前記第
2要素に取付ける前記取付ステップが、前記移動ステッ
プの実行前に前記リードの前記先端側端部を前記接点に
ボンディングするボンディング・ステップを含んでいる
ことを特徴とする請求項3記載の方法。15. The second element (86) comprises a plurality of contacts (90).
Including at least one active microelectronic device having a contact mounting surface mounted thereon, the mounting step for mounting the distal end of each of the plurality of leads to the second element. 4. The method of claim 3 including the step of bonding the tip end of the lead to the contact prior to performing the step.
シートである上面と下面とを有する最上層シート(34)を
含んでおり、前記複数のリードが前記下面に沿って延在
しており、前記複数のリードの各々が、その前記端子側
端部に端子構造体(44, 56)を備えており、該端子構造体
が前記最上層シートを貫通して前記上面まで延在してお
り、それによって、前記リードの前記先端側端部を前記
接点にボンディングする前記ボンディング・ステップが
前記端子構造体を前記接点に接続するようにしたことを
特徴とする請求項15記載の方法。16. The first element includes a top layer sheet (34) having a top surface and a bottom surface that are flexible insulating sheets, the plurality of leads extending along the bottom surface. Each of the plurality of leads is provided with a terminal structure (44, 56) at the terminal side end thereof, the terminal structure extending through the uppermost layer sheet to the upper surface. 16. The method of claim 15, wherein the bonding step of bonding the distal end of the lead to the contact connects the terminal structure to the contact.
ングする前記ボンディング・ステップが、前記最上層シ
ートを前記第2要素に位置合せして、前記先端側端部が
前記接点と位置が揃うようにするステップと、前記最上
層シートを、前記少なくとも1つのマイクロエレクトロ
ニクス素子の前記接点装備面へ押圧する押圧ステップと
を含んでいることを特徴とする請求項16記載の方法。17. The bonding step of bonding the tip end to the contact aligns the top sheet with the second element such that the tip end is aligned with the contact. 17. The method of claim 16 including the steps of: pressing and pressing the topmost sheet against the contact mounting surface of the at least one microelectronic element.
トの前記上面へ流体圧を加えるステップを含んでいるこ
とを特徴とする請求項17記載の方法。18. The method of claim 17, wherein the pressing step comprises applying fluid pressure to the top surface of the top sheet.
複数のリードと前記複数の接点とを加熱して、多数のリ
ード及び接点との境界面における導電性接合材料(74)を
同時に活性化するステップを含んでいることを特徴とす
る請求項17記載の方法。19. The bonding step comprises heating the plurality of leads and the plurality of contacts to simultaneously activate the conductive bonding material (74) at the interface of the plurality of leads and the contacts. 18. The method of claim 17, comprising:
・ステップの実行中に補強構造体(48, 32)に当接してい
るようにすることを特徴とする請求項17記載の方法。20. The method according to claim 17, characterized in that the topmost sheet is in contact with a reinforcing structure (48, 32) during the performance of the bonding step.
に貼着した可撓性を有するが実質的に耐伸張性を有する
金属箔(48)を含んでいることを特徴とする請求項20記
載の方法。21. The reinforcing structure comprises a flexible but substantially stretch resistant metal foil (48) affixed to the topmost sheet. The method described.
る実質的に剛体のリング(32)を含んでおり、前記最上層
シートが、前記開口を横断して延展していると共に該リ
ングによって緊張状態に維持されていることを特徴とす
る請求項20記載の方法。22. The stiffening structure includes a substantially rigid ring (32) having an opening in the center, the topmost sheet extending across the opening and by the ring. 21. The method of claim 20, wherein the method is maintained in tension.
えた多数の半導体チップ(88)を含んでいるウェーハ(80)
であり、前記最上層シートが、それら多数のチップのう
ちの複数のチップの上に延展しており、前記ボンディン
グ・ステップが、前記最上層シートの複数の領域の中の
複数のリードの夫々の先端側端部を、前記チップのうち
の複数のチップに備えられている複数の接点へ同時にボ
ンディングすることによって、前記最上層シートの前記
領域の各々が前記チップのうちの1個のチップに接続さ
れるようにするステップを含んでおり、該方法が更に、
前記ウェーハから前記チップを切り出し前記最上層シー
トから前記領域を切り出すことによって、各々が1個の
チップ(88)と前記シートのそのチップに対応した1つの
領域とを含んでいる個々のユニットを形成する切断ステ
ップを含んでいることを特徴とする請求項16記載の方
法。23. A wafer (80) in which the second element comprises a number of semiconductor chips (88) with a plurality of contacts (90).
The top sheet extends over a plurality of chips of the number of chips, and the bonding step includes a plurality of leads for each of a plurality of leads in a plurality of regions of the top sheet. Each of the regions of the topmost sheet is connected to one of the chips by simultaneously bonding the tip end to a plurality of contacts provided on a plurality of the chips. And the method further comprises the steps of:
Cutting the chips from the wafer to cut the regions from the top sheet forms individual units each containing one chip (88) and one region of the sheet corresponding to that chip. 17. The method of claim 16 including the step of cutting.
で前記切断ステップの実行前に前記ウェーハと前記最上
層シートとの間に流動性絶縁材料(108) を注入し、該絶
縁材料を硬化させることによって、変形容易な絶縁支持
層を形成するステップを含んでおり、前記切断ステップ
が、前記絶縁支持層を切断することによって前記ユニッ
トの各々が前記絶縁支持層の一部分を含むようにするス
テップを含んでいることを特徴とする請求項23記載の
方法。24. By injecting a flowable insulating material (108) between the wafer and the top sheet after completion of the bonding step and prior to performing the cutting step and curing the insulating material. Forming a deformable insulating support layer, the cutting step including cutting the insulating support layer so that each of the units includes a portion of the insulating support layer. 24. The method of claim 23, wherein the method comprises:
の全てのチップの上に延展しており、前記ボンディング
・ステップが、前記複数のリードを前記ウェーハ上の全
てのチップの接点に1回の動作でボンディングするステ
ップを含んでいることを特徴とする請求項23記載の方
法。25. The topmost sheet extends over all of the chips on the wafer, and the bonding step comprises: 24. The method of claim 23 including the step of operatively bonding.
クトロニクス素子(701, 702, 703) を含んでおり、前記
複数のリードの夫々の先端側端部をそれら複数のマイク
ロエレクトロニクス素子に接続することを特徴とする請
求項3記載の方法。26. The second element includes a plurality of microelectronic elements (701, 702, 703), each tip end of the plurality of leads being connected to the plurality of microelectronic elements. The method according to claim 3, wherein:
夫々の端子側端部のうちの少なくとも幾つかの間の相互
接続部(745) を含んでおり、それによって、前記複数の
マイクロエレクトロニクス素子が前記第1要素を介して
相互接続されるようにすることを特徴とする請求項26
記載の方法。27. The first element includes an interconnection (745) between at least some of the terminal ends of each of the plurality of leads, whereby the plurality of microelectronic elements are provided. 27. Interconnected via said first element.
The described method.
ド(60)を屈曲形状に成形するように実行することを特徴
とする請求項3記載の方法。28. The method of claim 3, wherein the moving step is performed to shape the plurality of leads (60) into a bent shape.
は、厚さが約 25 ミクロン以下の略々平坦なリボンの形
状をしていることを特徴とする請求項28記載の方法。29. The method of claim 28, wherein the plurality of leads (60) is initially in the shape of a generally flat ribbon having a thickness of about 25 microns or less.
状態では屈曲しており、前記移動ステップの実行中にそ
れら複数のリードが少なくとも部分的に直線に近付けら
れることを特徴とする請求項3記載の方法。30. The plurality of leads (260, 370) are initially bent so that the plurality of leads are at least partially approximated to a straight line during execution of the moving step. Item 3. The method according to Item 3.
続のための部品において、 (a) 第1面(37)を有する絶縁性の第1要素(34)と、 (b) 前記第1要素の前記第1面の上を延在している複数
の細長い可撓性リード(60)であって、それら複数のリー
ドの各々が、前記第1要素に固定状態で止着された端子
側端部(66)と、前記第1要素に分離可能に止着された先
端側端部(68)とを有し、それら複数のリードの各々の前
記先端側端部が、当該リードの前記端子側端部から、前
記第1面に平行な水平方向へオフセットしている、複数
のリードと、を備えたことを特徴とする部品。31. A component for connection in microelectronics, comprising: (a) an insulative first element (34) having a first surface (37), and (b) a first surface of the first element. A plurality of elongated flexible leads (60) extending above, each of which has a terminal end (66) fixedly secured to said first element; A tip end portion (68) separably fixed to the first element, and the tip end portion of each of the plurality of leads is separated from the terminal end portion of the lead by the first end portion (68). A component having a plurality of leads, which are offset in the horizontal direction parallel to one surface.
端部から同一の水平方向へオフセットしていることを特
徴とする請求項31記載の部品。32. The component according to claim 31, wherein all of the tip end portions are offset in the same horizontal direction from the terminal end portions.
とは反対側の第2面(35)を有する絶縁性の第1シート(3
4)であり、前記部品が更に、前記リードの前記端子側端
部の位置において前記シートを貫通して延在している導
電性の端子構造体(44, 56)を備えていることを特徴とす
る請求項31記載の部品。33. An insulative first sheet (3) in which the insulative first element has a second surface (35) opposite the first surface.
4), wherein the component further comprises a conductive terminal structure (44, 56) extending through the sheet at the position of the terminal-side end of the lead. 32. The part according to claim 31.
有することを特徴とする請求項33記載の部品。34. The component according to claim 33, wherein the first insulating sheet is flexible.
先端側端部に導電性接合材料(74)を備えていることを特
徴とする請求項31記載の部品。35. The component of claim 31, wherein each of the plurality of leads includes a conductive bonding material (74) at the tip end thereof.
前記接合材料が、スズ、ゲルマニウム、及びシリコンか
ら成る部類中から選択した少なくとも1つの金属を含ん
でいることを特徴とする請求項35記載の部品。36. The plurality of leads includes gold,
36. The component of claim 35, wherein the bonding material comprises at least one metal selected from the group consisting of tin, germanium, and silicon.
構造体が、格子間隔が約 1.25mm 以下の、規則的な格子
状パターンを成すように配列されていることを特徴とす
る請求項31記載の部品。37. The method according to claim 31, wherein the plurality of leads and the plurality of terminal structures are arranged so as to form a regular grid pattern with a grid spacing of about 1.25 mm or less. Parts.
約 1000 ミクロン、厚さが約 5 〜約 25 ミクロン、そ
して幅が約 10〜約 50 ミクロンであることを特徴とす
る請求項37記載の部品。38. The plurality of leads have a length of about 200-.
38. The component of claim 37, having a thickness of about 1000 microns, a thickness of about 5 to about 25 microns, and a width of about 10 to about 50 microns.
リにおいて、 (a) 面アレイを成すように配列した複数の接点(90)を備
えた正面を有するマイクロエレクトロニクス素子(86, 8
8)と、 (b) 前記素子の前記正面との間に間隔を保ちつつ該素子
の該正面に向かい合った下面(37)を備えた可撓性を有す
るコネクタ・ボディ(34)であって、前記下面に露出して
面アレイを成すように配列した複数の端子構造体(44, 5
6)を備え、前記素子の前記接点のアレイの上に延展して
いる、コネクタ・ボディと、 (c) 前記複数の端子構造体と前記複数の接点との間に延
在している、屈曲形状の可撓性を有する複数のリード(6
0)であって、それら複数のリードの各々が、前記複数の
端子構造体のうちの1つに取付けられた端子側端部と、
前記複数の接点のうちの1つに取付けられた先端側端部
とを有する、複数のリードと、を備えたことを特徴とす
るアセンブリ。39. In a microelectronic assembly, a microelectronic device (86, 8) having a front surface comprising a plurality of contacts (90) arranged in an (a) plane array.
8), and (b) a flexible connector body (34) having a lower surface (37) facing the front surface of the element while maintaining a space between the front surface of the element, A plurality of terminal structures (44, 5) that are exposed on the lower surface and are arranged to form a surface array.
A connector body comprising 6) and extending over the array of contacts of the element; and (c) a bend extending between the plurality of terminal structures and the plurality of contacts. Multiple flexible leads (6
0), wherein each of the plurality of leads has a terminal side end portion attached to one of the plurality of terminal structures,
A plurality of leads having a distal end attached to one of the plurality of contacts.
略々S字形であり、互いに逆を向いた主面を有する金属
リボンによって構成されており、該リボンはその主面に
垂直な方向へ屈曲されてS字形を形成していることを特
徴とする請求項39記載のアセンブリ。40. The plurality of flexible leads comprises:
It is substantially S-shaped, and is constituted by a metal ribbon having main surfaces opposite to each other, and the ribbon is bent in a direction perpendicular to the main surface to form an S-shape. The assembly of claim 39.
に形成されていることを特徴とする請求項40記載のア
センブリ。41. The assembly of claim 40, wherein the ribbon is integrally formed with the terminal structure.
に略々並行であることを特徴とする請求項40記載のア
センブリ。42. The assembly of claim 40, wherein all of the plurality of S-shaped leads are substantially parallel to each other.
て、約 1.25mm 以下の接点ピッチで互いに離隔している
ことを特徴とする請求項39記載のアセンブリ。43. The assembly of claim 39, wherein the plurality of contacts are spaced from each other in the array with a contact pitch of about 1.25 mm or less.
厚さが約 30 ミクロン以下であることを特徴とする請求
項43記載のアセンブリ。44. The plurality of flexible leads comprises:
The assembly of claim 43 having a thickness of about 30 microns or less.
前記正面と前記コネクタ・ボディの前記下面との間の空
間を実質的に充填している変形容易な絶縁材料(108) を
備えたことを特徴とする請求項44記載のアセンブリ。45. A deformable insulating material (108) substantially filling the space between the front surface of the microelectronic element and the lower surface of the connector body. The assembly of paragraph 44.
が、前記マイクロエレクトロニクス素子とは反対側を向
いた上面(35)を有する可撓性を有するシート状要素(34)
を備えており、前記端子構造体(44, 56)が前記シート状
要素を貫通して前記上面まで延在していることを特徴と
する請求項45記載のアセンブリ。46. The flexible sheet-like element (34) wherein the flexible connector body has an upper surface (35) facing away from the microelectronic element.
46. The assembly of claim 45, further comprising: the terminal structure (44, 56) extending through the sheet-like element to the upper surface.
が、前記端子構造体の位置以外には実質的に孔を持たな
いことを特徴とする請求項46記載のアセンブリ。47. The bottom surface (37) of the connector body.
47. The assembly of claim 46, wherein the assembly has substantially no holes except at the location of the terminal structure.
タにおいて、 (a) 下面(137) を有するボディ(134) と、 (b) 面アレイを成すように配列され、前記ボディに取付
けられて前記下面に露出した複数の端子構造体(140)
と、 (c) 複数の略々S字形のリード(160) であって、それら
S字形リードの各々は前記下面から離れる方向へ延在し
ており、それらS字形リードの各々は、前記複数の端子
構造体のうちの1つに接続された端子側端部と、当該端
子構造体から離れた先端側端部とを有している、複数の
S字形リードと、 (d) 前記ボディの前記下面に接している変形容易な絶縁
材料の層(118) であって、該変形容易層は前記ボディと
は反対側に下面(119) を有し、該変形容易層は前記複数
のS字形リードを略々囲繞して支持しており、前記複数
のS字形リードの夫々の前記先端側端部は該変形容易層
の前記下面から突出しており、それによって、マイクロ
エレクトロニクス素子の接点装備面と該変形容易層の前
記下面とを重ね合わせることで前記複数のS字形リード
の夫々の前記先端側端部を前記マイクロエレクトロニク
ス素子の複数の接点(204) と当接させることができるよ
うにしてある、変形容易層と、を備えたことを特徴とす
るコネクタ。48. In a connector for microelectronics, (a) a body (134) having a lower surface (137) and (b) are arranged so as to form a plane array, and are attached to the body and exposed to the lower surface. Multiple Terminal Structure (140)
And (c) a plurality of substantially S-shaped leads (160), each of the S-shaped leads extending in a direction away from the lower surface, and each of the S-shaped leads having the plurality of S-shaped leads (160). A plurality of S-shaped leads having a terminal side end connected to one of the terminal structures and a tip side end remote from the terminal structure; and (d) the body A layer of deformable insulating material (118) in contact with the lower surface, the deformable layer having a lower surface (119) opposite the body, the deformable layer comprising the plurality of S-shaped leads. And the tip end portion of each of the plurality of S-shaped leads projects from the lower surface of the easily deformable layer, whereby the contact mounting surface of the microelectronic element and the By overlapping the lower surface of the easily deformable layer with the bottom surface of the plurality of S-shaped leads, And a deformable layer capable of abutting each of the distal end portions with a plurality of contacts (204) of the microelectronic element.
先端側端部に、該先端側端部を前記接点に接合するため
の導電性接合材料(170) を備えていることを特徴とする
請求項48記載のコネクタ。49. Each of the plurality of leads is provided with a conductive bonding material (170) at its tip end portion for joining the tip end portion to the contact. The connector of claim 48.
対側を向いた主面を有する金属リボンで形成されてお
り、該リボンが、その主面に垂直な方向に屈曲してS字
形を形成していることを特徴とする請求項49記載のコ
ネクタ。50. Each of the plurality of leads is formed of a metal ribbon having major surfaces facing each other, and the ribbon is bent in a direction perpendicular to the major surface to form an S-shape. 50. The connector according to claim 49, wherein:
タにおいて、 (a) 下面(137) を有するボディ(134) と、 (b) 面アレイを成すように配列され、前記ボディに取付
けられて前記下面に露出した複数の端子構造体(140)
と、 (c) 複数の屈曲した可撓性リード(160) であって、それ
ら複数のリードの各々は前記下面から離れる方向へ延在
しており、それら複数のリードの各々は、互いに反対側
を向いた上面及び下面を有する金属リボンで形成されて
おり、該リボンは、その上面及び下面に垂直な方向に屈
曲しており、それら複数のリードの各々は、前記複数の
端子構造体のうちの1つに接続された端子側端部と、前
記端子構造体から離れた先端側端部とを有する、複数の
リードと、 (d) 前記ボディの前記下面に接している変形容易な絶縁
材料の層(118) であって、該変形容易層は前記ボディと
は反対側に下面を有し、該変形容易層は前記リードを略
々囲繞して支持しており、前記リードの前記先端側端部
は該変形容易層の前記下面から突出しており、それによ
って、マイクロエレクトロニクス素子の接点装備面と該
変形容易層の前記下面とを重ね合わせることで前記複数
のリードの夫々の前記先端側端部を前記マイクロエレク
トロニクス素子の複数の接点と当接させることができる
ようにしてある、変形容易層と、を備えたことを特徴と
するコネクタ。51. In a connector for microelectronics, (a) a body (134) having a lower surface (137) and (b) are arranged so as to form a plane array, and are attached to the body and exposed to the lower surface. Multiple Terminal Structure (140)
(C) a plurality of bent flexible leads (160), each of the plurality of leads extending in a direction away from the lower surface, and each of the plurality of leads being on opposite sides of each other. Is formed of a metal ribbon having an upper surface and a lower surface facing each other, the ribbon is bent in a direction perpendicular to the upper surface and the lower surface, and each of the plurality of leads is one of the plurality of terminal structures. A plurality of leads each having a terminal-side end connected to one of the terminals and a tip-side end separated from the terminal structure; and (d) an easily deformable insulating material in contact with the lower surface of the body. A layer (118) of the deformable layer having a lower surface on the side opposite to the body, the deformable layer substantially surrounding and supporting the lead, and the distal side of the lead. The ends project from the lower surface of the easy-deformation layer, and thereby the marker. By overlapping the contact-equipped surface of the microelectronic element and the lower surface of the easily deformable layer, it is possible to bring the tip end portions of the leads into contact with the contacts of the microelectronic element. And a deformation-promoting layer, the connector being provided.
造する製造方法において、 (a) 複数の半導体チップを包含しているウェーハ(686)
を用意するステップであって、該ウェーハは複数の細長
い可撓性リードを備えた第1面(692) を有し、それら複
数のリードは該第1面に沿って延在しており、それら複
数のリードの各々は、該ウェーハに取付けた端子側端部
と、該端子側端部からオフセットした先端側端部とを有
する、ウェーハ用意ステップと、 (b) 前記複数のリードの夫々の前記先端側端部を第2要
素(634) に取付ける取付ステップと、 (c) 前記複数のリードを成形するステップであって、前
記第2要素を、前記ウェーハに対して相対的に所定移動
をなすように移動させて、前記複数のリードの夫々の前
記先端側端部の全てを同時に前記ウェーハから離れる方
向へ変位させることで前記複数のリードを成形する、リ
ード成形ステップと、を含んでいることを特徴とする方
法。52. A method of manufacturing a plurality of semiconductor chip assemblies, comprising: (a) a wafer containing a plurality of semiconductor chips (686).
Wherein the wafer has a first surface (692) with a plurality of elongated flexible leads, the plurality of leads extending along the first surface, Each of the plurality of leads has a terminal side end attached to the wafer, and a tip side end offset from the terminal side end, a wafer preparation step, (b) each of the plurality of leads A mounting step of mounting the end portion on the front end side to the second element (634), and (c) a step of molding the plurality of leads, wherein the second element is moved in a predetermined manner relative to the wafer. To form the plurality of leads by moving all of the plurality of leads at the same time in the direction away from the wafer to move all of the tip end portions of the plurality of leads at the same time. A method characterized by.
端部(668) が初期状態では前記ウェーハに止着されてお
り、前記複数のリードの夫々の前記先端側端部が前記リ
ード成形ステップの実行中に前記ウェーハから引き離さ
れることを特徴とする請求項52記載の方法。53. The tip end portion (668) of each of the plurality of leads is fixed to the wafer in an initial state, and the tip end portion of each of the plurality of leads is formed by the lead forming step. 53. The method of claim 52, wherein the method is stripped from the wafer during the performance of.
端部が、初期状態では当該リードの前記端子側端部から
前記ウェーハの前記第1面に平行な第1水平方向(D1)
へオフセットしており、前記第2要素を移動させる前記
移動ステップが、前記第2要素を前記第1方向と逆向き
の第2水平方向(D1) へ移動させると共に、該第2要素
を前記ウェーハから離れる方向である垂直方向下方へ移
動させるステップを含んでいることを特徴とする請求項
52記載の方法。54. The tip-side end portion of each of the plurality of leads is initially in a first horizontal direction (D 1 ) parallel to the first surface of the wafer from the terminal-side end portion of the lead.
Offsetting to, the moving step of moving the second element moves the second element in a second horizontal direction (D 1 ) opposite to the first direction and moves the second element to the 53. The method of claim 52 including the step of moving vertically downwardly away from the wafer.
シートである最上層シート(634) を含んでおり、該最上
層シートは、前記ウェーハとは反対側を向いた上面と、
前記ウェーハの方を向いた下面(634) と、前記上面から
前記下面へ延在している複数の接点構造体(644, 646)と
を有し、前記複数のリードの夫々の前記先端側端部を前
記第2要素に取付ける前記取付ステップが、前記移動ス
テップに先立って前記複数のリードの夫々の前記先端側
端部を前記複数の接点構造体に電気的に接続する接続ス
テップを含んでいることを特徴とする請求項52記載の
方法。55. The second element includes a top layer sheet (634), which is a flexible insulating sheet, the top layer sheet having a top surface facing away from the wafer;
A lower surface (634) facing the wafer, and a plurality of contact structure bodies (644, 646) extending from the upper surface to the lower surface, and the tip end of each of the plurality of leads. The attaching step of attaching a portion to the second element includes a connecting step of electrically connecting the tip end of each of the leads to the contact structures prior to the moving step. 53. The method of claim 52, wherein:
前記複数のチップの全ての上に延展しており、前記接続
ステップが、前記ウェーハ上の前記複数のチップの全て
に対応した前記複数のリードを前記最上層シートの前記
複数の接点構造体に1回の動作で接続するステップを含
んでいることを特徴とする請求項55記載の方法。56. The top layer sheet extends over all of the plurality of chips on the wafer, and the connecting step corresponds to all of the plurality of chips on the wafer. 56. The method of claim 55, including the step of connecting a plurality of contact structures of the top layer sheet in a single operation.
ートとの間の前記複数のリードの周囲に流動性絶縁材料
(108) を注入するステップを更に含んでいることを特徴
とする請求項55記載の方法。57. A flowable insulating material around the plurality of leads between the wafer and the insulating top sheet.
The method of claim 55, further comprising injecting (108).
ーハと絶縁性の前記最上層シートとを切断して、各々が
前記複数のチップのうちの1つまたは幾つかと絶縁性の
前記最上層シートのうちの一部とを含んでいる複数のユ
ニットを形成するステップを更に含んでいることを特徴
とする請求項52から57までのいずれか記載の方法。58. Cutting the wafer and the insulating topmost sheet after completion of the moving step such that each of the topmost sheet is insulative with one or more of the plurality of chips. 58. The method of any of claims 52-57, further comprising forming a plurality of units including a portion of the.
相対的に移動させる前記移動ステップが、前記ウェーハ
をボタン形保持台(94)に、該ボタン形保持台が該ウェー
ハの前記最上層シートとは反対側の第2面に当接するよ
うにして係合させるステップと、前記最上層シートを上
部保持台(105) に、該上部保持台が該最上層シートの前
記ウェーハとは反対側の上面に当接するようにして係合
させるステップと、それら保持台が互いに相手に対して
相対的に移動するようにするステップとを含んでいるこ
とを特徴とする請求項55から57までのいずれか記載
の方法。59. The moving step of moving the second element relative to the wafer comprises placing the wafer on a button-shaped holding table (94), the button-shaped holding table being the uppermost sheet of the wafer. And a step of engaging the second surface on the opposite side to the upper surface sheet on the upper holding table (105), the upper holding table on the side opposite to the wafer of the uppermost sheet. 58. Any of claims 55 to 57, including the steps of engaging the upper surfaces in abutting engagement with each other, and causing the holders to move relative to each other. The method described.
えたウェーハを用意する前記ウェーハ用意ステップが、
前記ウェーハの前記第1面に絶縁材料の被覆層(693) を
被着し、続いて、その被覆層を被着した面の上で前記リ
ードの成形を実行するステップを含んでいることを特徴
とする請求項52から57までのいずれか記載の方法。60. The wafer preparing step of preparing a wafer having the plurality of leads on the first surface,
Depositing a coating layer (693) of an insulating material on the first side of the wafer, and then performing the molding of the leads on the surface having the coating layer deposited thereon. 58. A method according to any of claims 52 to 57.
るウェーハであって、該ウェーハのそれら複数のチップ
が、前記第1面に設けた複数の接点を有する、ウェーハ
と、 (b) 複数の変形可能なリード(660) であって、それら複
数のリードの各々が、前記複数の接点のうちの1つに恒
久的に接続された固定端部と、前記ウェーハの前記第1
面に分離可能に止着された先端側端部とを有する、複数
のリードと、を備えたことを特徴とするウェーハ・アセ
ンブリ。61. A wafer assembly comprising: (a) a wafer including a plurality of semiconductor chips and having a first surface, wherein the plurality of chips of the wafer are provided on the first surface. (B) a plurality of deformable leads (660), each of which has a fixed end permanently connected to one of the plurality of contacts. Part and the first of the wafer
A plurality of leads having a tip end that is separably fastened to the surface, and a wafer assembly.
覆層(693) を備えたことを特徴とする請求項61記載の
ウェーハ・アセンブリ。62. The wafer assembly of claim 61, further comprising an insulating coating layer (693) on the first surface of the wafer.
チップ(686) と、 (b) 複数の変形可能なリード(660) であって、それら複
数のリードの各々が、前記複数の接点のうちの1つに恒
久的に接続された固定端部と、前記チップの前記第1面
に分離可能に止着された先端側端部とを有する、複数の
リードと、を備えたことを特徴とするチップ・アセンブ
リ。63. A chip assembly comprising: (a) a chip (686) having a first surface and a plurality of contacts provided on the first surface; and (b) a plurality of deformable leads (660). A plurality of leads each having a fixed end permanently connected to one of the plurality of contacts and a tip end separably secured to the first surface of the chip. A chip assembly having a plurality of leads and a plurality of leads.
覆層(693) を備えたことを特徴とする請求項63記載の
チップ・アセンブリ。64. The chip assembly of claim 63, further comprising an insulating coating layer (693) on the first surface of the wafer.
要素が可撓性を有する絶縁シート(34)を含んでおり、前
記第1及び第2要素のうちの他方の要素が1つまたは複
数の半導体チップを含んでおり、前記移動ステップの完
了後に前記複数のリードが前記1つまたは複数の半導体
チップと可撓性を有する前記絶縁シートとの間に位置す
るようにすることを特徴とする請求項3記載の方法。65. One of the first and second elements comprises a flexible insulating sheet (34), and the other of the first and second elements is one. Or a plurality of semiconductor chips, the plurality of leads being located between the one or more semiconductor chips and the flexible insulating sheet after completion of the moving step. The method according to claim 3, wherein
方の要素が、単一の半導体チップ(88)であることを特徴
とする請求項65記載の方法。66. The method of claim 65, wherein the other of the first and second elements is a single semiconductor chip (88).
方の要素(86)が、複数の半導体チップ(88)を含んでお
り、前記方法が更に、前記移動ステップの完了後に前記
第1及び第2要素を切断して、各々が1個のチップを含
んでいる複数の個別のユニットを形成するステップを含
んでいることを特徴とする請求項65記載の方法。67. The other of the first and second elements (86) includes a plurality of semiconductor chips (88), and the method further comprises the first step after completion of the moving step. 66. The method of claim 65, including the step of cutting the second element to form a plurality of individual units, each containing a single chip.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US271768 | 1994-07-07 | ||
US08/271,768 US5518964A (en) | 1994-07-07 | 1994-07-07 | Microelectronic mounting with multiple lead deformation and bonding |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10005524A Division JP2898265B2 (en) | 1994-07-07 | 1998-01-14 | Microelectronic element mounting structure and method of manufacturing the same |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0855881A true JPH0855881A (en) | 1996-02-27 |
JP3022949B2 JP3022949B2 (en) | 2000-03-21 |
Family
ID=23036993
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP7172437A Expired - Lifetime JP3022949B2 (en) | 1994-07-07 | 1995-07-07 | Microelectronic element mounting structure and method of manufacturing the same |
JP10005524A Expired - Fee Related JP2898265B2 (en) | 1994-07-07 | 1998-01-14 | Microelectronic element mounting structure and method of manufacturing the same |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10005524A Expired - Fee Related JP2898265B2 (en) | 1994-07-07 | 1998-01-14 | Microelectronic element mounting structure and method of manufacturing the same |
Country Status (8)
Country | Link |
---|---|
US (7) | US5518964A (en) |
EP (1) | EP0870325B1 (en) |
JP (2) | JP3022949B2 (en) |
KR (1) | KR100211611B1 (en) |
AT (1) | ATE342582T1 (en) |
AU (1) | AU2913595A (en) |
DE (1) | DE69535266T2 (en) |
WO (1) | WO1996002068A1 (en) |
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- 1995-06-29 AT AT95924747T patent/ATE342582T1/en not_active IP Right Cessation
- 1995-06-29 EP EP95924747A patent/EP0870325B1/en not_active Expired - Lifetime
- 1995-06-29 DE DE69535266T patent/DE69535266T2/en not_active Expired - Fee Related
- 1995-06-29 AU AU29135/95A patent/AU2913595A/en not_active Abandoned
- 1995-06-29 WO PCT/US1995/008182 patent/WO1996002068A1/en active IP Right Grant
- 1995-07-07 JP JP7172437A patent/JP3022949B2/en not_active Expired - Lifetime
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EP0870325B1 (en) | 2006-10-11 |
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EP0870325A1 (en) | 1998-10-14 |
US6104087A (en) | 2000-08-15 |
US5913109A (en) | 1999-06-15 |
EP0870325A4 (en) | 1998-10-14 |
JP3022949B2 (en) | 2000-03-21 |
DE69535266T2 (en) | 2007-01-18 |
KR100211611B1 (en) | 1999-08-02 |
KR960006723A (en) | 1996-02-23 |
AU2913595A (en) | 1996-02-09 |
US6080603A (en) | 2000-06-27 |
ATE342582T1 (en) | 2006-11-15 |
US6635553B1 (en) | 2003-10-21 |
WO1996002068A1 (en) | 1996-01-25 |
JP2898265B2 (en) | 1999-05-31 |
JPH10256314A (en) | 1998-09-25 |
US5801441A (en) | 1998-09-01 |
US5518964A (en) | 1996-05-21 |
DE69535266D1 (en) | 2006-11-23 |
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JP2001060596A (en) | Manufacture of semiconductor device |
Legal Events
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