JPH083699B2 - フルグラフイツク画面の表示方式 - Google Patents

フルグラフイツク画面の表示方式

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JPH083699B2
JPH083699B2 JP62013765A JP1376587A JPH083699B2 JP H083699 B2 JPH083699 B2 JP H083699B2 JP 62013765 A JP62013765 A JP 62013765A JP 1376587 A JP1376587 A JP 1376587A JP H083699 B2 JPH083699 B2 JP H083699B2
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JP
Japan
Prior art keywords
virtual code
ram
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full
display method
Prior art date
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JP62013765A
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English (en)
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JPS63182692A (ja
Inventor
陽一 箕浦
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Alps Alpine Co Ltd
Original Assignee
Alps Electric Co Ltd
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Publication date
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はグラフィックの画面のみのCRT、特にワード
プロセッサーを対象としたいわゆるフルグラフィック画
面に対し、文字を高速に表示処理制御することができる
フルグラフィック画面の表示方式に関する。
〔発明の背景〕
一般的に、フルフラフィックのCRTに対して文字を出
力する場合、コードリフレッシュ方式のものと比して、
アクセスするメモリーの量が多いことから極端に表示ス
ピードが低下してしまうという問題点があった。
〔発明の目的〕
そこで、本発明の上記したような従来の技術の問題点
に着目してなされたもので、かかる問題点を解消して、
フルグラフィック画面に対する文字の出力の表示スピー
ドをアップすることができるようにしたフルグラフィッ
ク画面の表示方式を提供することを目的としている。
〔問題点を解決しようとするための手段〕
この目的を達成するために、本発明に係るフルグラフ
ィック画面の表示方式は、メインメモリー上に第一及び
第二の仮想的なコードRAMを形成し、前記第一の仮想的
なコードRAMによって現在表示中の内容をセーブし、第
二の仮想的なコードRAMに、続いて表示しようとする内
容を書き込んで、第一及び第二の仮想的なコードRAMの
差分データのみをビデオRAMにアクセスし、CRTに対する
書込み処理を行なうことを特徴としている。
〔作用〕
上記したような構成とすることによって、ビデオRAM
に対するアクセスは第一の仮想的なコードRAMと第二の
仮想的なコードRAMとの差分データのみとなるため、ア
クセスする量が減り、そのためにフルグラフィック画面
に対して文字の出力を行なう表示スピードが非常にアッ
プすることとなるのである。
〔実施例〕
次に、本発明の実施の一例を第１図乃至第２図を参照
して詳細に説明する。
第１図は本発明に係るフルグラフィック画面の表示方
式が実行されるハードウェアのブロック図であり、図中
１はCPUを示している。このCPU1にはメインメモリー２
とビデオRAM（Ｖ−RAM）３が相互接続されたものとなっ
ている。又、前記メインメモリー２内には第一の仮想的
なコードRAM2aと第二の仮想的なコードRAM2bが形成され
ているもので、この第一の仮想的なコードRAM2aによっ
て現在CRTに表示中の内容がセーブされ、第２の仮想的
なコードRAM2bには、これから表示しようとする内容が
書き込まれるものとなっており、その第一の仮想的なコ
ードRAM2aと、第二の仮想的なコードRAM2bとの差分デー
タをCPU1によって計算し、ビデオRAM3にアクセスするも
のとなっている。
又、第２図として示すのは本発明に係るフルグラフィ
ック画面の表示方式の制御内容を表わすフローチャート
図であり、メインメモリー２上に形成されている第二の
仮想的なコードRAM2bに対して、これから表示しようと
する内容を展開（書き込み）する。続いて、この第二の
仮想的なコードRAM2bに書き込まれた内容を、現在表示
中の内容をセーブしている第一の仮想的なコードRAM2a
とCPU1によって比較して、その比較の結果、第一及び第
二の仮想的なコードRAM2a・2aの内容の異なる部分、即
ち、差分データのみをビデオRAM3上にフォント（文字形
態）をアクセス（出力）する。次いで、仮想的なコード
RAM2aの内容を前記ビデオRAM3上にアクセスした内容の
ものに更新するものとなっている。
〔発明の効果〕
上述したように本発明に係るフルグラフィック画面の
表示方式によれば、メインメモリー上に形成された第一
及び第二の仮想的なコードRAMの内容を比較して、その
差分データのみをビデオRAMにアクセスするため、アク
セスする量が極めて少なくて済み、その分フルグラフィ
ックのCRTに対して文字を出力表示する場合のスピード
が非常にアップされるものとなっている。
【図面の簡単な説明】
第１図は本発明に係るフルグラフィック画面の表示方式
が実行されるハードウェアのブロック図，第２図は同制
御のフローチャート図である。 １……CPU、２……メインメモリー 2a……第一の仮想的なコードRAM 2b……第二の仮想的なコードRAM ３……ビデオRAM

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】メインメモリー上に第一及び第二の仮想的
    なコードRAMを形成し、前記第一の仮想的なコードRAMに
    よって現在表示中の内容をセーブし、第二の仮想的なコ
    ードRAMに、続いて表示しようとする内容を書き込ん
    で、第一及び第二の仮想的なコードRAMの差分データの
    みをビデオRAMにアクセスし、CRTに対する書き込み処理
    を行なうことを特徴とするフラグラフィック画面の表示
    方式。
JP62013765A 1987-01-23 1987-01-23 フルグラフイツク画面の表示方式 Expired - Lifetime JPH083699B2 (ja)

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JPS63182692A JPS63182692A (ja) 1988-07-27
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Publication number Priority date Publication date Assignee Title
JPH02278421A (ja) * 1989-04-20 1990-11-14 Fujitsu Ltd テキスト表示方式

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JPS63182692A (ja) 1988-07-27

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