JPH0831853B2 - ビットクロック再生回路 - Google Patents
ビットクロック再生回路Info
- Publication number
- JPH0831853B2 JPH0831853B2 JP1123722A JP12372289A JPH0831853B2 JP H0831853 B2 JPH0831853 B2 JP H0831853B2 JP 1123722 A JP1123722 A JP 1123722A JP 12372289 A JP12372289 A JP 12372289A JP H0831853 B2 JPH0831853 B2 JP H0831853B2
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- JP
- Japan
- Prior art keywords
- circuit
- output
- phase
- variable frequency
- bit clock
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Synchronisation In Digital Transmission Systems (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はビットクロック再生回路に係り、特にBSチュ
ーナ用ビットクロック再生回路に関する。
ーナ用ビットクロック再生回路に関する。
第２図は従来のBSチューナ用ビットクロック再生回路
を示す回路図である。第２図において、本再生回路は４
相位相復調回路１、位相検波回路２、ろ波器３、水晶発
振回路４、固定分周回路17、で倍及び同調回路13、再生
ビットクロック出力端14とからなり、この再生ビットク
ロックがPCM復調回路に用いられる。
を示す回路図である。第２図において、本再生回路は４
相位相復調回路１、位相検波回路２、ろ波器３、水晶発
振回路４、固定分周回路17、で倍及び同調回路13、再生
ビットクロック出力端14とからなり、この再生ビットク
ロックがPCM復調回路に用いられる。
一般にBSチューナでのPCM復調用ICに使用されるディ
ジタル・フィルタのクロックは、４相位相復調された信
号と位相が同期していなくてはならない。
ジタル・フィルタのクロックは、４相位相復調された信
号と位相が同期していなくてはならない。
第２図に示すように、この種のBSチューナのビットク
ロック再生では、周波数が安定な電圧制御発振回路４
（水晶発振回路）を使った位相同期方式を採用してい
る。しかし、このクロック周波数は、PCM復調回路に使
用されるディジタル・フィルタによって異なっており、
36.864MHzや24.576MHz,12.288MHz等が一般的であるが、
20MHzを越える水晶の電圧制御発振回路４は、実用的で
はない為、36.864MHzのクロックが必要な場合は、12.28
8MHzの水晶電圧制御発振器を使用し、これの３次歪みに
同調させる方式をとっている。
ロック再生では、周波数が安定な電圧制御発振回路４
（水晶発振回路）を使った位相同期方式を採用してい
る。しかし、このクロック周波数は、PCM復調回路に使
用されるディジタル・フィルタによって異なっており、
36.864MHzや24.576MHz,12.288MHz等が一般的であるが、
20MHzを越える水晶の電圧制御発振回路４は、実用的で
はない為、36.864MHzのクロックが必要な場合は、12.28
8MHzの水晶電圧制御発振器を使用し、これの３次歪みに
同調させる方式をとっている。
前述した従来のクロック再生回路は、３次歪に同調さ
せるために同調回路が必要な為、IC化には適していない
し、またクロック周波数を変えることができない為、デ
ィジタル・フィルタの選択性が限られるという欠点があ
る。
せるために同調回路が必要な為、IC化には適していない
し、またクロック周波数を変えることができない為、デ
ィジタル・フィルタの選択性が限られるという欠点があ
る。
本発明の目的は、前記欠点が解決され、容易にクロッ
ク周波数を変えることができるようにしたビットクロッ
ク再生回路を提供することにある。
ク周波数を変えることができるようにしたビットクロッ
ク再生回路を提供することにある。
本発明のビットクロック再生回路は、４相位相復調回
路にて位相復調された信号と第１の可変分周出力とを同
期検波する第１の位相検波回路と、この位相検波回路の
出力を第１の低減ろ波器を介した出力電圧で制御され水
晶電圧制御発振回路と、この水晶電圧制御発振回路の出
力と第２の可変分周出力とを同期検波する第２の位相検
波回路と、この位相検波回路の出力を第２の低域ろ波器
を介した出力電圧で制御される電圧制御発振回路と、こ
の電圧制御発振回路の出力をスイッチにより切替えた分
周比で分周し前記第１の可変分周出力とする第１の可変
分周手段と、前記電圧制御発振回路の出力をスイッチに
より切替えた分周比で分周し前記第２の可変分周出力と
する第２の可変分周手段とを備え、前記電圧制御発振回
路の出力を前記４相位相復調回路の復調出力と位相同期
したビットクロックを得ると共に、このビットクロック
の周波数を前記各可変分周手段のスイッチを切替えるこ
とにより可変させたことを特徴とする。
路にて位相復調された信号と第１の可変分周出力とを同
期検波する第１の位相検波回路と、この位相検波回路の
出力を第１の低減ろ波器を介した出力電圧で制御され水
晶電圧制御発振回路と、この水晶電圧制御発振回路の出
力と第２の可変分周出力とを同期検波する第２の位相検
波回路と、この位相検波回路の出力を第２の低域ろ波器
を介した出力電圧で制御される電圧制御発振回路と、こ
の電圧制御発振回路の出力をスイッチにより切替えた分
周比で分周し前記第１の可変分周出力とする第１の可変
分周手段と、前記電圧制御発振回路の出力をスイッチに
より切替えた分周比で分周し前記第２の可変分周出力と
する第２の可変分周手段とを備え、前記電圧制御発振回
路の出力を前記４相位相復調回路の復調出力と位相同期
したビットクロックを得ると共に、このビットクロック
の周波数を前記各可変分周手段のスイッチを切替えるこ
とにより可変させたことを特徴とする。
次に図面を参照しながら本発明を説明する。
第１図は本発明の一実施例のビットクロック再生回路
を示す回路図である。
を示す回路図である。
第１図において、本実施例のBSチューナ用ビットクロ
ック再生回路は、４相位相復調回路１と、これにより位
相復調された信号と第１の可変分周回路の出力とを同期
検波する第１の位相検波回路２と、低域ろ波器３を介し
た出力で制御される第１の水晶電圧制御発振回路４と、
前記第１の水晶電圧制御発振回路４の出力と第２の可変
分周回路の出力とで同期検波する第２の位相検波回路10
と、低域ろ波器９を介した出力で制御される第２の電圧
制御発振回路８とを含み、前記第２の電圧制御発振回路
８の出力を、前記第２の分周回路を介し、前記第２の位
相検波回路10に、第１の可変信号として帰還せしめ、前
記第２の電圧制御発振回路８の出力を第１の分周回路を
介し前記第１の位相検波回路に第２の可変信号として帰
還せしめ、前記４相位相復調回路１の復調出力と位相同
期した周波数の安定したビットクロック信号を再生する
ように構成される。
ック再生回路は、４相位相復調回路１と、これにより位
相復調された信号と第１の可変分周回路の出力とを同期
検波する第１の位相検波回路２と、低域ろ波器３を介し
た出力で制御される第１の水晶電圧制御発振回路４と、
前記第１の水晶電圧制御発振回路４の出力と第２の可変
分周回路の出力とで同期検波する第２の位相検波回路10
と、低域ろ波器９を介した出力で制御される第２の電圧
制御発振回路８とを含み、前記第２の電圧制御発振回路
８の出力を、前記第２の分周回路を介し、前記第２の位
相検波回路10に、第１の可変信号として帰還せしめ、前
記第２の電圧制御発振回路８の出力を第１の分周回路を
介し前記第１の位相検波回路に第２の可変信号として帰
還せしめ、前記４相位相復調回路１の復調出力と位相同
期した周波数の安定したビットクロック信号を再生する
ように構成される。
尚、前記可変分周回路は、第１の可変分周回路が36分
周回路５、24分周回路６、12分周回路７からなり、第２
の可変分周回路が、直接接続回路（１分周回路）、２分
周回路11および３分周回路12から構成される。
周回路５、24分周回路６、12分周回路７からなり、第２
の可変分周回路が、直接接続回路（１分周回路）、２分
周回路11および３分周回路12から構成される。
なお、電圧制御発振回路８としては、電圧制御発振回
路４に水晶電圧制御発振回路を用いているので、通常の
PLLに使用されるIC化された無安定マルチバイブレータ
などを用いることができる。この電圧制御発振回路８は
簡単な抵抗・コンデンサの時定数回路で構成されるの
で、IC化に不適当な３次歪の同調回路を不要とすること
ができる。
路４に水晶電圧制御発振回路を用いているので、通常の
PLLに使用されるIC化された無安定マルチバイブレータ
などを用いることができる。この電圧制御発振回路８は
簡単な抵抗・コンデンサの時定数回路で構成されるの
で、IC化に不適当な３次歪の同調回路を不要とすること
ができる。
例えば、４相位相復調回路１の周波数が1.024MHzと
し、水晶電圧制御発振回路４の周波数を12.288MHzとす
る。この場合、第１のスイッチ15をに設定し、第２の
スイッチ16をに設定すれば、クロック周波数として3
6.864MHzが得られる。またクロック周波数を24.576MHz
にしたい時は、第１のスイッチ15を、第２のスイッチ
16をに設定し、12.288MHzにしたい時は、第１のスイ
ッチ15を、第２のスイッチ16をに設定すればよい。
この様に第１、第２の可変分周回路の分周比をスイッチ
15,16で同期して切替えることにより、電圧制御発振回
路８の発振周波数が切替えられ、従ってその出力である
ビットクロック周波数を任意に切替えることができる。
し、水晶電圧制御発振回路４の周波数を12.288MHzとす
る。この場合、第１のスイッチ15をに設定し、第２の
スイッチ16をに設定すれば、クロック周波数として3
6.864MHzが得られる。またクロック周波数を24.576MHz
にしたい時は、第１のスイッチ15を、第２のスイッチ
16をに設定し、12.288MHzにしたい時は、第１のスイ
ッチ15を、第２のスイッチ16をに設定すればよい。
この様に第１、第２の可変分周回路の分周比をスイッチ
15,16で同期して切替えることにより、電圧制御発振回
路８の発振周波数が切替えられ、従ってその出力である
ビットクロック周波数を任意に切替えることができる。
以上説明したように、本発明は、位相検波回路、分周
回路、電圧制御発振回路、低域ろ波器による位相同期回
路を２つ有することにより、IC化も容易で、分周回路の
分周比と電圧制御発振回路の発振周波数を適切に設定す
ることによって、クロック周波数を何通りかに選ぶこと
ができる為、PCM復調回路に使用されるディジタルフィ
ルタのクロック周波数に合ったビットクロックを出力で
きるという効果がある。
回路、電圧制御発振回路、低域ろ波器による位相同期回
路を２つ有することにより、IC化も容易で、分周回路の
分周比と電圧制御発振回路の発振周波数を適切に設定す
ることによって、クロック周波数を何通りかに選ぶこと
ができる為、PCM復調回路に使用されるディジタルフィ
ルタのクロック周波数に合ったビットクロックを出力で
きるという効果がある。
第１図は本発明の一実施例のビットクロック再生回路を
示すブロック図、第２図は従来のBSチューナ用ビットク
ロック再生回路のブロック図である。 １……４相位相復調回路、２……位相検波回路、３……
低域ろ波器、４……水晶電圧制御発振回路、5,6,7,11,1
2……分周回路、８……電圧制御発振回路、９……低域
ろ波器、10……位相検波回路、13……てい倍及び同調回
路、14……再生ビットクロック出力端、15……第１のス
イッチ、16……第２のスイッチ、17……固定分周回路。
示すブロック図、第２図は従来のBSチューナ用ビットク
ロック再生回路のブロック図である。 １……４相位相復調回路、２……位相検波回路、３……
低域ろ波器、４……水晶電圧制御発振回路、5,6,7,11,1
2……分周回路、８……電圧制御発振回路、９……低域
ろ波器、10……位相検波回路、13……てい倍及び同調回
路、14……再生ビットクロック出力端、15……第１のス
イッチ、16……第２のスイッチ、17……固定分周回路。
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０３Ｌ 7/08 Ｚ
Claims (1)
- 【請求項１】４相位相復調回路にて位相復調された信号
と第１の可変分周出力とを同期検波する第１の位相検波
回路と、この位相検波回路の出力を第１の低域ろ波器を
介した出力電圧で制御され水晶電圧制御発振回路と、こ
の水晶電圧制御発振回路の出力と第２の可変分周出力と
を同期検波する第２の位相検波回路と、この位相検波回
路の出力を第２の低域ろ波器を介した出力電圧で制御さ
れる電圧制御発振回路と、この電圧制御発振回路の出力
をスイッチにより切替えた分周比で分周し前記第１の可
変分周出力とする第１の可変分周手段と、前記電圧制御
発振回路の出力をスイッチにより切替えた分周比で分周
し前記第２の可変分周出力とする第２の可変分周手段と
を備え、前記電圧制御発振回路の出力を前記４相位相復
調回路の復調出力と位相同期したビットクロックを得る
と共に、このビットクロックの周波数を前記各可変分周
手段のスイッチを切替えることにより可変させたことを
特徴とするビットクロック再生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1123722A JPH0831853B2 (ja) | 1989-05-16 | 1989-05-16 | ビットクロック再生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1123722A JPH0831853B2 (ja) | 1989-05-16 | 1989-05-16 | ビットクロック再生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02302140A JPH02302140A (ja) | 1990-12-14 |
| JPH0831853B2 true JPH0831853B2 (ja) | 1996-03-27 |
Family
ID=14867743
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1123722A Expired - Lifetime JPH0831853B2 (ja) | 1989-05-16 | 1989-05-16 | ビットクロック再生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0831853B2 (ja) |
-
1989
- 1989-05-16 JP JP1123722A patent/JPH0831853B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02302140A (ja) | 1990-12-14 |
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