JPH08250497A - 半導体装置の金属配線層の形成方法 - Google Patents
半導体装置の金属配線層の形成方法Info
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Links
- 229910052751 metal Inorganic materials 0.000 title claims abstract description 84
- 239000002184 metal Substances 0.000 title claims abstract description 84
- 239000004065 semiconductor Substances 0.000 title claims abstract description 26
- 230000015572 biosynthetic process Effects 0.000 title description 2
- 229910052782 aluminium Inorganic materials 0.000 claims abstract description 38
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims abstract description 38
- 230000004888 barrier function Effects 0.000 claims abstract description 29
- 238000005530 etching Methods 0.000 claims abstract description 25
- 239000000758 substrate Substances 0.000 claims abstract description 12
- 238000000034 method Methods 0.000 claims description 49
- 238000005229 chemical vapour deposition Methods 0.000 claims description 29
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 claims description 20
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 claims description 16
- 229910052721 tungsten Inorganic materials 0.000 claims description 16
- 239000010937 tungsten Substances 0.000 claims description 16
- 239000010936 titanium Substances 0.000 claims description 14
- 238000000151 deposition Methods 0.000 claims description 11
- 238000009832 plasma treatment Methods 0.000 claims description 11
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 10
- 229910052786 argon Inorganic materials 0.000 claims description 10
- 239000007789 gas Substances 0.000 claims description 10
- 229910052719 titanium Inorganic materials 0.000 claims description 10
- 238000010438 heat treatment Methods 0.000 claims description 8
- 238000007740 vapor deposition Methods 0.000 claims description 8
- 239000010949 copper Substances 0.000 claims description 7
- 239000000463 material Substances 0.000 claims description 7
- 239000001257 hydrogen Substances 0.000 claims description 6
- 229910052739 hydrogen Inorganic materials 0.000 claims description 6
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 5
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 claims description 5
- 229910052802 copper Inorganic materials 0.000 claims description 5
- 229910052763 palladium Inorganic materials 0.000 claims description 2
- 238000005240 physical vapour deposition Methods 0.000 claims description 2
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims 2
- 239000010408 film Substances 0.000 abstract description 21
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 abstract description 11
- 229910052710 silicon Inorganic materials 0.000 abstract description 11
- 239000010703 silicon Substances 0.000 abstract description 11
- 239000010409 thin film Substances 0.000 abstract description 2
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical compound [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 abstract 1
- 238000009499 grossing Methods 0.000 abstract 1
- 238000009413 insulation Methods 0.000 abstract 1
- 239000010410 layer Substances 0.000 description 71
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 15
- 229920002120 photoresistant polymer Polymers 0.000 description 15
- 239000011229 interlayer Substances 0.000 description 10
- 125000004435 hydrogen atom Chemical class [H]* 0.000 description 5
- 238000004544 sputter deposition Methods 0.000 description 5
- 238000007796 conventional method Methods 0.000 description 4
- 230000008021 deposition Effects 0.000 description 4
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 description 2
- TUTOKIOKAWTABR-UHFFFAOYSA-N dimethylalumane Chemical compound C[AlH]C TUTOKIOKAWTABR-UHFFFAOYSA-N 0.000 description 2
- 239000011810 insulating material Substances 0.000 description 2
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 2
- 230000006911 nucleation Effects 0.000 description 2
- 238000010899 nucleation Methods 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- 229910018594 Si-Cu Inorganic materials 0.000 description 1
- 229910008465 Si—Cu Inorganic materials 0.000 description 1
- 229910010303 TiOxNy Inorganic materials 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- AZDRQVAHHNSJOQ-UHFFFAOYSA-N alumane Chemical compound [AlH3] AZDRQVAHHNSJOQ-UHFFFAOYSA-N 0.000 description 1
- 239000012159 carrier gas Substances 0.000 description 1
- 230000003197 catalytic effect Effects 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 238000003672 processing method Methods 0.000 description 1
- 238000004381 surface treatment Methods 0.000 description 1
- JLTRXTDYQLMHGR-UHFFFAOYSA-N trimethylaluminium Chemical compound C[Al](C)C JLTRXTDYQLMHGR-UHFFFAOYSA-N 0.000 description 1
- 239000011800 void material Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76871—Layers specifically deposited to enhance or enable the nucleation of further layers, i.e. seed layers
- H01L21/76876—Layers specifically deposited to enhance or enable the nucleation of further layers, i.e. seed layers for deposition from the gas phase, e.g. CVD
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76861—Post-treatment or after-treatment not introducing additional chemical elements into the layer
- H01L21/76862—Bombardment with particles, e.g. treatment in noble gas plasmas; UV irradiation
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76865—Selective removal of parts of the layer
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76877—Filling of holes, grooves or trenches, e.g. vias, with conductive material
- H01L21/76879—Filling of holes, grooves or trenches, e.g. vias, with conductive material by selective deposition of conductive material in the vias, e.g. selective C.V.D. on semiconductor material, plating
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76855—After-treatment introducing at least one additional element into the layer
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Microelectronics & Electronic Packaging (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Power Engineering (AREA)
- Plasma & Fusion (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Electrodes Of Semiconductors (AREA)
- Drying Of Semiconductors (AREA)
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Abstract
供。 【解決手段】 絶縁膜の形成された半導体基板上に金属
配線及びコンタクトホールの形成される部位を限定した
後、限定された金属配線及びコンタクトホール領域を有
する結果物構造上に順次にオーミック層及び障壁層を形
成する。障壁層が形成された結果物の全面に電子サイク
ロトロン共鳴(ECR)食刻および SiH4プラズマ処理
を連続に施し、化学気相蒸着(CVD)方法で金属配線
部位及びコンタクトホール部位の内部にのみアルミニウ
ムを蒸着したのち、絶縁膜の表面に存在する物質層を食
刻する。ECR食刻により金属配線及びコンタクトホー
ル部位の側壁の表面を滑らかにすると共に、アルミニウ
ムの核生成及び成長が均一で迅速に起こるようにし、 S
iH4 プラズマ処理により金属配線部位およびコンタクト
ホール部位の内部にのみCVDアルミニウムを成長でき
る。
Description
線層の形成方法に係り、特に化学気相蒸着(Chemical V
apor Deposition 、以下「CVD」という。)アルミニ
ウムを用いて金属コンタクトホールの埋没および金属配
線層を同時に形成する半導体装置の金属配線層の形成方
法に関する。
れて、横方向と同じ比率でコンタクトホールの縦方向の
幾何学的なサイズを縮めることが困難になるため、アス
パクト比は増えつつある。これにより、既存の金属配線
層の形成方法を使用する場合、非平坦化、不良な段差塗
布性、残留性金属短絡、低収率および信頼性の劣化など
のような種々の問題が生ずるに至った。
するための新たな配線技術として金属コンタクトホール
の埋没と金属配線層を同時に形成する、所謂「二重波形
(Dual Damascene) 」技術を使用している。この二重波
状技術ではブランケット−CVDタングステン(W)を
使用することが一般的である。図1A〜図2Eは従来の
二重波状技術による半導体装置の金属配線層の形成方法
を説明するための断面図である。
せず)の形成されたシリコン基板10上に絶縁層12を
形成した後、その上に層間絶縁膜14として酸化膜を所
定の厚さに蒸着する。次いで、この結果物上に金属配線
層を形成するための第1フォトレジストパターン16を
形成したのち、これをマスクとして使用して前記層間絶
縁膜14を食刻する。
ストパターン16を取り除いた後、結果物上にコンタク
トホールを形成するための第2フォトレジストパターン
18を形成する。次いで、この第2フォトレジストパタ
ーン18をマスクとして使用して層間絶縁膜14及び絶
縁層12を食刻する。図1Cを参照すると、前記第2フ
ォトレジストパターン18を食刻した後、結果物上にチ
タン(Ti)及び窒化チタン(TiN)をスパッタリン
グ方法又はCVD方法で順に蒸着してオーミック層(図
示せず)及び障壁層20を形成する。
成された結果物上にブランケットタングステンをCVD
方法により蒸着してタングステン層21を形成する。図
2Eを参照すると、前記層間絶縁膜14の上部のタング
ステン層21を化学機械ポリイング(Chemical Mechani
cal Polishing 、以下「CMP」という。)方法で食刻
することにより、金属コンタクトホールをタングステン
で埋没させると共にタングステン配線を形成する。
た従来の二重波状技術による金属配線層の形成方法によ
ると、次のような問題が生じる。第一に、金属プラグと
して使用されるタングステンの比抵抗がアルミニウムよ
り高いため(アルミニウムの比抵抗は 2.7〜 3.3μΩcm
であり、タングステンの比抵抗は5〜6μΩcmである)
金属配線の形成速度が遅延するという問題を生ずる。
するので、コンタクトホールの内部に不整合による継ぎ
目(seam) が形成される。したがって、後続くCMP工
程を施す時、前記継ぎ目部位で食刻率が速くなり、Vの
字形のバレー(valley)がタングステン配線の中心部に
形成されるという問題を生ずる(図2D及び図2E参
照)。
ムの硬度より大きくて、前記タングステンを数千Åの厚
さに蒸着するのでCMP方法で食刻する時、アルミニウ
ムに比して工程の所要時間が長くなるという問題を生ず
る。したがって、本発明の目的は前述した従来の方法の
問題点を解決し得る半導体装置の金属配線層の形成方法
を提供することにある。
に本発明は、絶縁膜の形成された半導体基板上に金属配
線層を形成する方法において、前記絶縁膜に金属配線及
びコンタクトホールの形成される部位を限定する段階
と、前記限定された金属配線及びコンタクトホール領域
を有する結果物の構造上に順次にオーミック層及び障壁
層を形成する段階と、前記障壁層の形成された結果物の
全面に電子サイクロトロン共鳴(ElectronCyclotron Re
sonance、以下「ECR」という。)食刻および SiH4
プラズマ処理を連続に施す段階と、CVD方法で前記金
属配線部位及びコンタクトホール部位の内部にのみアル
ミニウムを蒸着する段階と、前記絶縁膜の表面に存在す
る物質層を食刻する段階とを備える。
他の障壁層を形成する段階をさらに備えることが望まし
い。前記ECR食刻はアルゴン(Ar)ガス、水素(H
2 )ガス又はアルゴンと水素との混合ガスのいずれか一
つを使用して施すことができ、アルゴンガスを使用した
ECR食刻は−70Vのバイアス電圧および 2.4GHz, 1
000kW のマイクロウェーブ電力を使用して60秒以内に
施すことが望ましい。前記 SiH4 プラズマ処理は350
℃の基板温度及び100Wの電力条件で施すことが望ま
しい。
い圧力を使用する化学気相蒸着チャンバで施し、前記チ
ャンバの全体圧力を1torr以下に保つことが望ましい。
前記アルミニウム蒸着段階は350℃以下の温度で施す
ことが望ましい。また、前記目的を達成するために本発
明は、絶縁膜の形成された半導体基板上に金属配線層を
形成する方法において、前記絶縁膜に金属配線及びコン
タクトホールの形成される部位を限定する段階と、前記
限定された結果物上に障壁層を形成する段階と、前記障
壁層の形成された結果物の全面にECR食刻および SiH
4プラズマ処理を連続に施す段階と、CVD方法で前記
金属配線部位及びコンタクトホール部位の内部にのみア
ルミニウムを蒸着する段階と、前記アルミニウムの蒸着
された結果物上に物理蒸着方法で金属層を形成する段階
と、前記金属層の形成された結果物の全面に熱処理を施
す段階と、前記絶縁間膜の表面に存在する物質層を食刻
する段階とを備える。
ち、大気露出なしに連続に450〜600℃の温度で1
0分以下に施すことが望ましい。前記金属層を構成する
物質として、銅(Cu)、チタン(Ti)、パラジウム
(Pd)およびタングステン(W)よりなる群から選ば
れたいずれか一つを使用することが望ましい。
明を詳細に説明する。図3A〜図4Gは本発明による半
導体装置の金属配線層の形成方法を説明するための断面
図である。図3Aは層間絶縁膜14の形成及び金属配線
部位を限定する段階を示す。所定の段差構造物(図示せ
ず)の形成されたシリコン基板10上に絶縁物質、例え
ば酸化物を蒸着して絶縁層12を形成する。その後、前
記結果物を平坦化させるために絶縁物質、例えば酸化物
を厚く蒸着して層間絶縁膜14を形成する。次いで、前
記層間絶縁膜14上にフォトレジストを塗布し、これを
露光及び現像して金属配線層を形成するための第1フォ
トレジストパターン16を形成する。次に、前記第1フ
ォトレジストパターン16をマスクとして使用して前記
層間絶縁膜14を食刻することにより金属配線部位を限
定する。
段階を示す。前記第1フォトレジストパターン16を取
り除いた後、結果物上に再びフォトレジストを塗布し、
これを露光及び現像してコンタクトホールを形成するた
めの第2フォトレジストパターン18を形成する。次い
で、前記第2フォトレジストパターン18をマスクとし
て使用して層間絶縁膜14及び絶縁層12を食刻するこ
とにより、コンタクトホール部位を限定する。
す。前記第2フォトレジストパターン18を取り除いた
後、前記限定された金属配線部位及びコンタクトホール
部位を、例えば硫酸( H2SO4)及び希釈されたHF溶液
で洗浄して前記部位の底面のシリコン基板上に存在する
有機物及び自然酸化膜を取り除く。次いで、前記結果物
上にチタン(Ti)及び窒化チタン(TiN)をスパッ
タリング方法又はCVD方法で順に蒸着することによ
り、コンタクト抵抗を軽減するためのオーミック層19
及び後続く工程で形成されるプラグとシリコン基板との
界面における相互拡散を防止するための障壁層20を形
成する。次に、前記結果物を炉で熱処理してTiOxNy 形
態の強化した障壁層を形成する。
理を施す段階を示す。高真空の保たれたスパッタリング
チャンバ又はCVDチャンバで薄膜の窒化チタンよりな
る障壁層を追加に蒸着したのち、前記結果物を直進性の
優れたアルゴン、水素又はアルゴンと水素との混合ガス
よりなるECRプラズマで食刻することにより、金属配
線部位及びコンタクトホール部位の側壁に存在する障壁
層20の表面を滑らかにすると共に、チタンリーチ(T
i−rich)窒化チタン膜20を形成する。この際、前記
ECR食刻をアルゴンガスを用いて施す場合、バイアス
電圧−70V、周波数2.45 GHzおよび電力 1000kW のマ
イクロウェーブ電力条件で60秒以下に食刻を施す。
ウムを蒸着する場合、チタンは触媒的機能を有している
が、前記窒化チタン層の表面全体に核生成のためのチタ
ンが均一に存しないので、極めて粗い表面のCVDアル
ミニウムが成長するようになる。即ち、窒化チタン層の
表面に存在するチタンによりCVDアルミニウムが急速
に成長しその表面が粗くなるので、成長が不均一になっ
て金属配線部位及びコンタクトホール部位内にボイド
(void) が形成され得る。したがって、本発明では直進
性の優れたECR食刻処理で金属配線部位及びコンタク
トホール部位の側壁を滑らかにすると共に、その表面を
チタンの充分な状態にすることにより、前記側壁全体で
均一に核生成を起こらせることができる。次の表ECR
食刻の前後にXPSを用いて分析した窒化チタン層の表
面の組成を示す。
後、アルゴンECR食刻を施すことにより、窒化チタン
層の表面でチタンの量が相対的に増えることがわかる。
次いで、前記ECR食刻を施したのち、結果物を大気露
出なしに連続に SiH4プラズマに数十秒間露出させる。
この際、シリコン基板の位置するサセプタ(susceptor)
の温度を350℃で加熱し、100Wの電力をかける。
前記 SiH4 プラズマは露出される面積が比較的広い表面
にのみ接触され、比較的狭い領域、即ち金属配線部位及
びコンタクトホール部位の側壁及び底面には接触されな
いので、前記金属配線部位及びコンタクトホール部位を
除いた障壁層20上に薄膜のシリコン層22が形成され
る。
形成する段階を示す。前記 SiH4 プラズマ処理の完了さ
れた結果物を、高真空状態の保たれたCVDアルミニウ
ム蒸着チャンバに入れ込んだ後、320℃以下の温度で
数分以下にアルミニウムソース気体、例えばジメチルア
ルミニウムヒドリド(Dimethyl Aluminium Hydride;D
MAH)又は5%のトリメチルアルミニウム(Trimethy
l Aluminum;TMA)を含有するDMAHを運搬気体で
ある水素(H2 )と共に流す。その結果、前記SiH4 プ
ラズマの接触しない金属配線部位及びコンタクトホール
部位の側壁及び底面上にアルミニウムが成長するように
なり、前記金属配線部位及びコンタクトホール部あの内
部にのみCVDアルミニウムプラグ24が形成される。
す。具体的に、金属配線のみ存在する場合にも金属配線
部位の側壁を障壁層20が取り囲んでいるので、シリコ
ンや銅(Cu)をドーピングすることなく、純粋なアル
ミニウムだけで金属配線を形成しても優秀な信頼性を確
保し得る。しかしながら、必要ならば前記CVDアルミ
ニウムプラグ24の形成された結果物を大気露出なし
に、スパッタチャンバに移動させて100Åの厚さ以下
の銅薄膜を蒸着し、450℃で5分以下に高温熱処理を
加えてCVDアルミニウム内に銅及び周囲のシリコンを
拡散させることにより、Al−Si−Cu合金のプラグ
24aを形成することができる。
物質層、即ち SiH4 プラズマ処理により形成された薄膜
のシリコン層22、金属層26及び障壁層20の一部分
をCMP方法で取り除く段階を示す。図5A〜図5Dは
それぞれ、窒化チタン(TiN)の処理方法及び下地膜
による化学気相蒸着(CVD)アルミニウムの蒸着特性
を示すグラフである。図5Aは窒化チタンを蒸着した場
合を、図5Bは前記蒸着炉で450℃で30分間の熱処
理を行った場合を、図5Cは前記熱処理後、350℃で
30秒間100Wで SiH4 プラズマ処理を行った場合
を、図5Dは(111)方向の単結晶シリコン層の場合
を示す。
VDアルミニウムの蒸着温度を240℃から320℃に
増やすと、窒化チタン層上では温度に係わらず、CVD
アルミニウムが成長する反面(図5A及び図5B参
照)、単結晶シリコン層上では一定温度以上でのみCV
Dアルミニウムの成長が観察された(図5D参照)。し
かしながら、 SiH4 プラズマ処理を行った場合には、3
20℃までCVDアルミニウムが蒸着されなかったが、
その以上の温度では小粒子状のアルミニウムの成長が見
だされた(図5C参照)。
体装置の金属配線層の形成方法によると、ECR食刻の
表面処理を施して金属配線部位及びコンタクトホール部
位の側壁表面を滑らかにすると共に、アルミニウムの核
生成及び成長が均一で迅速に起こるようにしたのち、 S
iH4 プラズマ処理を施して金属配線部位及びコンタクト
トホール部位を除いた残り領域上でアルミニウムが成長
されないようにする。したがって、ボイドの発生しない
金属配線層を形成することができる。
めには下地膜の相異なる場合にのみ可能なので、従来の
二重波状技術による金属配線層の形成方法によれば、窒
化チタン障壁層がウェーハの全面に蒸着されている状態
で金属配線部位及びコンタクトホール部位にのみ選択的
にタングステンプラグを形成することがでぎない。さら
に、本発明によると、前記図3Cから4Fまでの工程段
階をCVD及びスパッタリング設備と共にモジュール化
しているクラスタ(cluster)形態の設備で連続に行える
ので(前記設備は現在一般的に普及されている)、1段
階または2段階程度の単純な工程でスループットの遅れ
なしに工程を行うことができる。
の変形が本発明の技術的思想内で当分野での通常の知識
を持つ者により可能なことは明白である。
の金属配線層の形成方法を説明するための断面図であ
る。
置の金属配線層の形成方法を説明するための断面図であ
る。
属配線層の形成方法を説明するための断面図である。
属配線層の形成方法を説明するための断面図である。
N)の処理方法および下地膜による化学気相蒸着(CV
D)アルミニウムの蒸着特性を示すグラフである。
Claims (11)
- 【請求項1】 絶縁膜の形成された半導体基板上に金属
配線層を形成する方法において、 前記絶縁膜に金属配線及びコンタクトホールの形成され
る部位を限定する段階と、 前記限定された金属配線及びコンタクトホール領域を有
する結果物の構造上に順次にオーミック層及び障壁層を
形成する段階と、 前記障壁層の形成された結果物の全面に電子サイクロト
ロン共鳴食刻およびSiH4 プラズマ処理を連続に施す
段階と、 化学気相蒸着方法で前記金属配線部位及び前記コンタク
トホール部位の内部にのみアルミニウムを蒸着する段階
と、 前記絶縁膜の表面に存在する物質層を食刻する段階とを
備えることを特徴とする半導体装置の金属配線層の形成
方法。 - 【請求項2】 前記障壁層を形成した後、前記障壁層上
に他の障壁層を形成する段階を備えることを特徴とする
請求項1記載の半導体装置の金属配線層の形成方法。 - 【請求項3】 前記電子サイクロトロン共鳴食刻をアル
ゴンガス、水素ガスまたはアルゴンと水素との混合ガス
のいずれか一つを使用して施すことを特徴とする請求項
1記載の半導体装置の金属配線層の形成方法。 - 【請求項4】 前記アルゴンガスを使用した電子サイク
ロトロン共鳴食刻は−70Vのバイアス電圧及び100
0kW,2.4GHzのマイクロウェーブ電力を使用し
て60秒以内に施すことを特徴とする請求項3記載の半
導体装置の金属配線層の形成方法。 - 【請求項5】 前記 SiH4 プラズマ処理は350℃の基
板温度および100Wの電力条件で施すことを特徴とす
る請求項1記載の半導体装置の金属配線層の形成方法。 - 【請求項6】 前記アルミニウム蒸着段階は大気圧より
低い圧力を使用する化学気相蒸着チャンバで施すことを
特徴とする請求項1記載の半導体装置の金属配線層の形
成方法。 - 【請求項7】 前記化学気相蒸着チャンバで全体圧力を
1torr以下に保つことを特徴とする請求項6記載の半導
体装置の金属配線層の形成方法。 - 【請求項8】 前記アルミニウム蒸着段階は350℃以
下の温度で施すことを特徴とする請求項1記載の半導体
装置の金属配線層の形成方法。 - 【請求項9】 絶縁膜の形成された半導体基板上に金属
配線層を形成する方法において、 前記絶縁膜に金属配線及びコンタクトホールの形成され
る部位を限定する段階と、 前記限定された結果物上に障壁層を形成する段階と、 前記障壁層の形成された結果物の全面に電子サイクロト
ロン共鳴食刻および SiH4 プラズマ処理を連続に施す段
階と、 化学気相蒸着方法で前記金属配線部位及び前記コンタク
トホール部位の内部にのみアルミニウムを蒸着する段階
と、 前記アルミニウムの蒸着された結果物上に物理蒸着方法
で金属層を形成する段階と、 前記金属層の形成された結果物の全面に熱処理を施す段
階と、 前記絶縁間膜の表面に存在する物質層を食刻する段階と
を備えることを特徴とする半導体装置の金属配線層の形
成方法。 - 【請求項10】 前記熱処理は、前記金属層を形成した
のち、大気露出なしに連続に450〜600℃の温度で
10分以下に施すことを特徴とする請求項9記載の半導
体装置の金属配線層の形成方法。 - 【請求項11】 前記金属層を構成する物質は、銅、チ
タン、パラジウムおよびタングステンよりなる群から選
ばれたいずれか一つを使用することを特徴とする請求項
9記載の半導体装置の金属配線層の形成方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950004381A KR0144913B1 (ko) | 1995-03-03 | 1995-03-03 | 반도체장치의 금속배선층 형성방법 |
KR1995P4381 | 1995-03-03 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH08250497A true JPH08250497A (ja) | 1996-09-27 |
JP3607398B2 JP3607398B2 (ja) | 2005-01-05 |
Family
ID=19409186
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP04297496A Expired - Fee Related JP3607398B2 (ja) | 1995-03-03 | 1996-02-29 | 半導体装置の金属配線層の形成方法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5960320A (ja) |
JP (1) | JP3607398B2 (ja) |
KR (1) | KR0144913B1 (ja) |
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1995
- 1995-03-03 KR KR1019950004381A patent/KR0144913B1/ko not_active IP Right Cessation
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1996
- 1996-02-29 JP JP04297496A patent/JP3607398B2/ja not_active Expired - Fee Related
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Also Published As
Publication number | Publication date |
---|---|
US5960320A (en) | 1999-09-28 |
KR960035795A (ko) | 1996-10-28 |
KR0144913B1 (ko) | 1998-08-17 |
JP3607398B2 (ja) | 2005-01-05 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040526 |
|
A131 | Notification of reasons for refusal |
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|
A521 | Written amendment |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20041007 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20071015 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20081015 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091015 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101015 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111015 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121015 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131015 Year of fee payment: 9 |
|
LAPS | Cancellation because of no payment of annual fees |