JPH08221151A - クロック供給装置 - Google Patents
クロック供給装置Info
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- JPH08221151A JPH08221151A JP7024154A JP2415495A JPH08221151A JP H08221151 A JPH08221151 A JP H08221151A JP 7024154 A JP7024154 A JP 7024154A JP 2415495 A JP2415495 A JP 2415495A JP H08221151 A JPH08221151 A JP H08221151A
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Abstract
(57)【要約】
【目的】 ＣＰＵに対する動作クロックの切換を行って
も、周辺回路に対する動作クロックと常に同期すると共
に、周辺回路に対して安定した動作クロックの供給を行
うことのできるクロック供給装置を提供することを目的
とする。 【構成】 基準クロックをＣＰＵ分周部１７において分
周して第１及び第２クロックを生成する。この第１及び
第２クロックのどちらかをＣＰＵクロック切換部１５に
おいて選択してＣＰＵ１２に出力すると共に、周辺回路
分周部１８に入力する。周辺回路分周部１８では予め定
められた分周回数だけ分周した第３及び第４クロックを
出力し、周辺回路クロック供給部１６において所定の大
きさの動作クロックを選択して周辺回路１３に供給す
る。
も、周辺回路に対する動作クロックと常に同期すると共
に、周辺回路に対して安定した動作クロックの供給を行
うことのできるクロック供給装置を提供することを目的
とする。 【構成】 基準クロックをＣＰＵ分周部１７において分
周して第１及び第２クロックを生成する。この第１及び
第２クロックのどちらかをＣＰＵクロック切換部１５に
おいて選択してＣＰＵ１２に出力すると共に、周辺回路
分周部１８に入力する。周辺回路分周部１８では予め定
められた分周回数だけ分周した第３及び第４クロックを
出力し、周辺回路クロック供給部１６において所定の大
きさの動作クロックを選択して周辺回路１３に供給す
る。
Description
【０００１】
【産業上の利用分野】本発明は、例えばＣＰＵを中心と
するマイコンシステム等に用いられるものであり、デジ
タル回路に対してクロックを出力するクロック供給装置
に関するものである。
するマイコンシステム等に用いられるものであり、デジ
タル回路に対してクロックを出力するクロック供給装置
に関するものである。
【０００２】
【従来の技術】近年、ＣＰＵを中心とし、通信機能など
を有する周辺回路を備えたマイコンシステムが多くの分
野で利用されている。このようなシステムでは、ＣＰＵ
をはじめとして主にデジタル回路により構成されてい
る。デジタル回路はクロックを基準として動作するもの
であり、その消費電力は動作クロックの速さに比例して
大きくなる。このためＣＰＵによっては、低消費電力を
実現するために動作クロックの周波数を低くして動作す
るものもある。これはＣＰＵの処理が忙しいときは高速
の動作クロックを使用し、逆に忙しくない場合は低速の
動作クロックを使用するというものである。
を有する周辺回路を備えたマイコンシステムが多くの分
野で利用されている。このようなシステムでは、ＣＰＵ
をはじめとして主にデジタル回路により構成されてい
る。デジタル回路はクロックを基準として動作するもの
であり、その消費電力は動作クロックの速さに比例して
大きくなる。このためＣＰＵによっては、低消費電力を
実現するために動作クロックの周波数を低くして動作す
るものもある。これはＣＰＵの処理が忙しいときは高速
の動作クロックを使用し、逆に忙しくない場合は低速の
動作クロックを使用するというものである。
【０００３】図４は従来のクロック供給装置を備えたマ
イコンシステムの構成を示すブロック図である。図４に
おいて、１は動作クロックの基準となる基準クロックを
発生させる発振装置であり、一般には水晶発振器や振動
子などが用いられている。２はマイコンシステム内の各
装置を制御するＣＰＵ、３はＣＰＵ２からの制御信号に
より動作する周辺回路であり、本従来例では外部装置５
とデータの送受信を行う通信機能を備えたものを例とし
て示している。４は発振装置１から基準クロックを入力
し、ＣＰＵ２及び周辺装置３に対して動作クロックを出
力するクロック供給装置である。
イコンシステムの構成を示すブロック図である。図４に
おいて、１は動作クロックの基準となる基準クロックを
発生させる発振装置であり、一般には水晶発振器や振動
子などが用いられている。２はマイコンシステム内の各
装置を制御するＣＰＵ、３はＣＰＵ２からの制御信号に
より動作する周辺回路であり、本従来例では外部装置５
とデータの送受信を行う通信機能を備えたものを例とし
て示している。４は発振装置１から基準クロックを入力
し、ＣＰＵ２及び周辺装置３に対して動作クロックを出
力するクロック供給装置である。
【０００４】図４に示すように、発信装置１から出力さ
れた基準クロックはクロック供給装置４に入力され、ク
ロック供給装置４において基準クロックを分周すること
により、ＣＰＵ２、周辺回路３を動作させる動作クロッ
クをそれぞれ生成して出力する。以下にクロック供給装
置４の構成について説明する。
れた基準クロックはクロック供給装置４に入力され、ク
ロック供給装置４において基準クロックを分周すること
により、ＣＰＵ２、周辺回路３を動作させる動作クロッ
クをそれぞれ生成して出力する。以下にクロック供給装
置４の構成について説明する。
【０００５】図５は従来のクロック供給装置の構成を示
すブロック図であり、クロック供給装置４の構成につい
て示したものである。図５において、６は基準クロック
を分周部９において分周することにより数種類の動作ク
ロックを出力するクロック生成部、７はクロック生成部
６から出力され、ＣＰＵ２を動作させるのに適した複数
のクロックから択一的にクロックを選択するＣＰＵクロ
ック切換部、８はクロック生成部６から出力され、周辺
回路３を動作させるのに適した複数のクロックから択一
的にクロックを選択する周辺回路クロック供給部であ
る。
すブロック図であり、クロック供給装置４の構成につい
て示したものである。図５において、６は基準クロック
を分周部９において分周することにより数種類の動作ク
ロックを出力するクロック生成部、７はクロック生成部
６から出力され、ＣＰＵ２を動作させるのに適した複数
のクロックから択一的にクロックを選択するＣＰＵクロ
ック切換部、８はクロック生成部６から出力され、周辺
回路３を動作させるのに適した複数のクロックから択一
的にクロックを選択する周辺回路クロック供給部であ
る。
【０００６】以上のように構成されたクロック供給装置
について、以下にその動作について説明する。
について、以下にその動作について説明する。
【０００７】図５に示すように、クロック生成部６は、
発振装置１（図４参照）から出力された基準クロックを
入力し、基準クロックを分周部９において分周を行い、
ＣＰＵ２を動作させるのに適した第１クロック及び第２
クロックを、周辺回路３を動作させるのに適した第３ク
ロック及び第４クロックを出力する。ただし、通常は入
力される基準クロックが最高速である。
発振装置１（図４参照）から出力された基準クロックを
入力し、基準クロックを分周部９において分周を行い、
ＣＰＵ２を動作させるのに適した第１クロック及び第２
クロックを、周辺回路３を動作させるのに適した第３ク
ロック及び第４クロックを出力する。ただし、通常は入
力される基準クロックが最高速である。
【０００８】ＣＰＵクロック切換部７では、分周部９か
ら出力された第１及び第２クロックからどちらか一方を
選択してＣＰＵ２に動作クロックを供給するのである
が、ＣＰＵクロック切換部７におけるクロックの切換は
ＣＰＵ２からの切換信号によって行われるものであり、
ＣＰＵ２における処理が忙しいときは高速のクロックを
選択し、忙しくない場合は低速のクロックを選択するこ
とになる。
ら出力された第１及び第２クロックからどちらか一方を
選択してＣＰＵ２に動作クロックを供給するのである
が、ＣＰＵクロック切換部７におけるクロックの切換は
ＣＰＵ２からの切換信号によって行われるものであり、
ＣＰＵ２における処理が忙しいときは高速のクロックを
選択し、忙しくない場合は低速のクロックを選択するこ
とになる。
【０００９】また、周辺回路クロック供給部８において
も周辺回路３に対するクロックの切換を行うことができ
るのであるが、本従来例のように周辺回路３が通信機能
を備えていた場合などでは、外部装置５とデータ通信を
行うために一方的にクロックを切り換えて動作速度を変
更することはできず、安定したクロックの供給を行う必
要がある。このため、クロック生成部６からＣＰＵ２及
び周辺回路３に対して出力されるクロックは別系統によ
り供給が行われていた。
も周辺回路３に対するクロックの切換を行うことができ
るのであるが、本従来例のように周辺回路３が通信機能
を備えていた場合などでは、外部装置５とデータ通信を
行うために一方的にクロックを切り換えて動作速度を変
更することはできず、安定したクロックの供給を行う必
要がある。このため、クロック生成部６からＣＰＵ２及
び周辺回路３に対して出力されるクロックは別系統によ
り供給が行われていた。
【００１０】
【発明が解決しようとする課題】しかしながら上記従来
の構成では、ＣＰＵ２へ供給するクロックと周辺回路３
へ供給するクロックとは別系統であるために回路量が増
えてしまうと共に、周辺回路３が通信機能を備えている
場合などでは周辺回路３に対する動作クロックの切換を
行うことができず、ＣＰＵ２において勝手に動作クロッ
クを切り換えてしまうと、ＣＰＵ２と周辺回路３とにお
いて同期がとれないといった問題点を有していた。
の構成では、ＣＰＵ２へ供給するクロックと周辺回路３
へ供給するクロックとは別系統であるために回路量が増
えてしまうと共に、周辺回路３が通信機能を備えている
場合などでは周辺回路３に対する動作クロックの切換を
行うことができず、ＣＰＵ２において勝手に動作クロッ
クを切り換えてしまうと、ＣＰＵ２と周辺回路３とにお
いて同期がとれないといった問題点を有していた。
【００１１】また、動作クロックを切り換える際に、切
換のタイミングによっては短いパルスが発生して誤動作
の原因になるといった問題点を有していた。
換のタイミングによっては短いパルスが発生して誤動作
の原因になるといった問題点を有していた。
【００１２】本発明は上記従来の問題点を解決するもの
であり、ＣＰＵに対する動作クロックの切換を頻繁に行
ってもＣＰＵと周辺回路とは常に同期すると共に、周辺
回路には安定した動作クロックの供給を行うことのでき
るクロック供給装置を提供することを目的とする。
であり、ＣＰＵに対する動作クロックの切換を頻繁に行
ってもＣＰＵと周辺回路とは常に同期すると共に、周辺
回路には安定した動作クロックの供給を行うことのでき
るクロック供給装置を提供することを目的とする。
【００１３】また、動作クロックの切換を行う際に、短
いパルス等が発生しないように切換のタイミングを制御
することのできるクロック供給装置を提供することを目
的とする。
いパルス等が発生しないように切換のタイミングを制御
することのできるクロック供給装置を提供することを目
的とする。
【００１４】
【課題を解決するための手段】この目的を達成するため
に本発明のクロック供給装置は、基準クロックを予め定
められた分周回数ほど分周して数種類のＣＰＵに対する
動作クロックを生成する第１の分周部と、第１の分周部
から出力される数種類の動作クロックを択一的に選択す
るクロック切換部と、クロック切換部において選択され
た動作クロックを予め定められた分周回数ほど分周して
数種類の周辺回路に対する動作クロックを生成する第２
の分周部と、第２の分周部から出力される数種類の動作
クロックを択一的に選択するクロック供給部とを備え、
第２の分周部における分周回数は、第１の分周部から出
力される個々の動作クロックを分周した際に少なくとも
１つは所定の大きさの動作クロックが出力されるように
予め定められており、ＣＰＵからの切換信号がクロック
切換部及びクロック供給部に入力されても、クロック供
給部では切換前と同じ大きさの動作クロックを選択する
構成とした。
に本発明のクロック供給装置は、基準クロックを予め定
められた分周回数ほど分周して数種類のＣＰＵに対する
動作クロックを生成する第１の分周部と、第１の分周部
から出力される数種類の動作クロックを択一的に選択す
るクロック切換部と、クロック切換部において選択され
た動作クロックを予め定められた分周回数ほど分周して
数種類の周辺回路に対する動作クロックを生成する第２
の分周部と、第２の分周部から出力される数種類の動作
クロックを択一的に選択するクロック供給部とを備え、
第２の分周部における分周回数は、第１の分周部から出
力される個々の動作クロックを分周した際に少なくとも
１つは所定の大きさの動作クロックが出力されるように
予め定められており、ＣＰＵからの切換信号がクロック
切換部及びクロック供給部に入力されても、クロック供
給部では切換前と同じ大きさの動作クロックを選択する
構成とした。
【００１５】また、数種類のクロックを択一的に選択す
るクロック切換部と、クロック切換部に入力される数種
類のクロックのタイミングを見計らう切換タイミング制
御部と、ＣＰＵが出力した切換信号を一時記憶しておく
記憶部とを備え、切換タイミング制御部はＣＰＵから出
力される切換信号を受け、記憶部に記憶させると共に、
クロック切換部に入力される数種類のクロックのタイミ
ングを見計らい、クロックが共にロウレベルであること
を検出したときに、記憶部に記憶していた切換信号をク
ロック切換部に対して出力する構成とした。
るクロック切換部と、クロック切換部に入力される数種
類のクロックのタイミングを見計らう切換タイミング制
御部と、ＣＰＵが出力した切換信号を一時記憶しておく
記憶部とを備え、切換タイミング制御部はＣＰＵから出
力される切換信号を受け、記憶部に記憶させると共に、
クロック切換部に入力される数種類のクロックのタイミ
ングを見計らい、クロックが共にロウレベルであること
を検出したときに、記憶部に記憶していた切換信号をク
ロック切換部に対して出力する構成とした。
【００１６】
【作用】この構成により、周辺回路に対する動作クロッ
クをＣＰＵに対する動作クロックを分周して生成するこ
とにより、ＣＰＵと周辺回路とを常に同期させることが
できると共に、周辺回路に対しては常に所定の大きさの
動作クロックを供給することができる。
クをＣＰＵに対する動作クロックを分周して生成するこ
とにより、ＣＰＵと周辺回路とを常に同期させることが
できると共に、周辺回路に対しては常に所定の大きさの
動作クロックを供給することができる。
【００１７】また、動作クロックを切り換えるための切
換信号を一旦記憶し、動作クロックが共にロウレベルの
ときに切換信号をクロック切換部に対して出力する。
換信号を一旦記憶し、動作クロックが共にロウレベルの
ときに切換信号をクロック切換部に対して出力する。
【００１８】
（実施例１）以下に本発明の第１の実施例について、図
面を参照しながら説明する。
面を参照しながら説明する。
【００１９】図１は本発明の第１の実施例におけるクロ
ック供給装置の構成を示すブロック図であり、クロック
供給装置１１について示している。ただし、クロック供
給装置１１は、従来例と同様に図４に示したようなデジ
タル回路により構成されるマイコンシステムに用いられ
ているものとしている。図１において、１２はデジタル
回路により構成されたマイコンシステム全体の制御を行
うＣＰＵであり、１３はマイコンシステムにおける周辺
回路であり、従来例と同様に周辺回路１３は通信機能を
備えたものとしている。
ック供給装置の構成を示すブロック図であり、クロック
供給装置１１について示している。ただし、クロック供
給装置１１は、従来例と同様に図４に示したようなデジ
タル回路により構成されるマイコンシステムに用いられ
ているものとしている。図１において、１２はデジタル
回路により構成されたマイコンシステム全体の制御を行
うＣＰＵであり、１３はマイコンシステムにおける周辺
回路であり、従来例と同様に周辺回路１３は通信機能を
備えたものとしている。
【００２０】１４は入力された基準クロックを分周する
ことによって数種類のクロックを出力するクロック生成
部であり、ＣＰＵ１２を動作させるＣＰＵ分周部１７と
周辺回路１３を動作させる周辺回路分周部１８とにより
構成されている。１５はクロック生成部１４から出力さ
れた複数のクロックから択一的にクロックを選択するＣ
ＰＵクロック切換部、１６はクロック生成部１４から出
力された複数のクロックから択一的にクロックを選択す
る周辺回路クロック供給部である。
ことによって数種類のクロックを出力するクロック生成
部であり、ＣＰＵ１２を動作させるＣＰＵ分周部１７と
周辺回路１３を動作させる周辺回路分周部１８とにより
構成されている。１５はクロック生成部１４から出力さ
れた複数のクロックから択一的にクロックを選択するＣ
ＰＵクロック切換部、１６はクロック生成部１４から出
力された複数のクロックから択一的にクロックを選択す
る周辺回路クロック供給部である。
【００２１】なお、本実施例が従来例と大きく異なるの
は、従来例では基準クロックからＣＰＵ２（図５参
照）、周辺回路３（図５参照）に対する動作クロックを
それぞれ生成していたのに対し、本実施例では基準クロ
ックからＣＰＵ１２に対する動作クロックを生成し、実
際にＣＰＵ１２に出力される動作クロックから周辺回路
１３に対する動作クロックを生成する点である。
は、従来例では基準クロックからＣＰＵ２（図５参
照）、周辺回路３（図５参照）に対する動作クロックを
それぞれ生成していたのに対し、本実施例では基準クロ
ックからＣＰＵ１２に対する動作クロックを生成し、実
際にＣＰＵ１２に出力される動作クロックから周辺回路
１３に対する動作クロックを生成する点である。
【００２２】以上のように構成されたクロック供給装置
について、以下にその動作について説明する。
について、以下にその動作について説明する。
【００２３】まず、動作クロックの流れについて説明す
る。図１に示すように、従来例と同様に発信装置（図示
せず）から出力された基準クロックは、クロック生成部
１４に入力される。クロック生成部１４では、ＣＰＵ分
周部１７において基準クロックを分周し、ＣＰＵ１２を
動作させる動作クロックである第１及び第２クロックを
生成する。クロック生成部１４から出力された第１及び
第２クロックはＣＰＵクロック切換部１５において択一
的に選択される。ＣＰＵクロック切換部１５において選
択された動作クロックは、ＣＰＵ１２に対して出力され
ると共に、クロック生成部１４に対しても出力される。
る。図１に示すように、従来例と同様に発信装置（図示
せず）から出力された基準クロックは、クロック生成部
１４に入力される。クロック生成部１４では、ＣＰＵ分
周部１７において基準クロックを分周し、ＣＰＵ１２を
動作させる動作クロックである第１及び第２クロックを
生成する。クロック生成部１４から出力された第１及び
第２クロックはＣＰＵクロック切換部１５において択一
的に選択される。ＣＰＵクロック切換部１５において選
択された動作クロックは、ＣＰＵ１２に対して出力され
ると共に、クロック生成部１４に対しても出力される。
【００２４】クロック生成部１４では、ＣＰＵクロック
切換部１５において選択された動作クロックを入力し、
周辺回路分周部１８において入力した動作クロックを、
第１及び第２クロックを考慮して予め定められた分周回
数ほど分周を行うことにより、周辺回路１３を動作させ
るための動作クロックである第３及び第４クロックを生
成する。クロック生成部１４から出力された第３及び第
４クロックは周辺回路クロック供給部１６において択一
的に選択されて周辺回路１３に対して出力されることに
なる。
切換部１５において選択された動作クロックを入力し、
周辺回路分周部１８において入力した動作クロックを、
第１及び第２クロックを考慮して予め定められた分周回
数ほど分周を行うことにより、周辺回路１３を動作させ
るための動作クロックである第３及び第４クロックを生
成する。クロック生成部１４から出力された第３及び第
４クロックは周辺回路クロック供給部１６において択一
的に選択されて周辺回路１３に対して出力されることに
なる。
【００２５】次に、本実施例における動作クロックの切
換動作について説明する。周辺回路分周部１８におい
て、ＣＰＵ分周部１７及び周辺回路分周部１８の分周回
数は予め定められており、周辺回路分周部１８に第１及
び第２クロックのどちらが入力されても、少なくとも第
３クロックと第４クロックとのどちらか一方はある所定
の大きさの周波数を有して出力されるものとしている。
換動作について説明する。周辺回路分周部１８におい
て、ＣＰＵ分周部１７及び周辺回路分周部１８の分周回
数は予め定められており、周辺回路分周部１８に第１及
び第２クロックのどちらが入力されても、少なくとも第
３クロックと第４クロックとのどちらか一方はある所定
の大きさの周波数を有して出力されるものとしている。
【００２６】今、ＣＰＵクロック切換部１５において第
１クロックが選択され、第１クロックがＣＰＵ１２に出
力されると共に、クロック生成部１４に入力された第１
クロックを周辺回路分周部１８において分周し、第３ク
ロックが周辺回路クロック供給部１６において選択され
て周辺回路１３に出力されている状態で、ＣＰＵ１２が
切換信号をＣＰＵクロック切換部１５及び周辺回路クロ
ック供給部１６に出力すると、ＣＰＵクロック切換部１
５では第２クロックを選択し、ＣＰＵ１２に対して第２
クロックを出力すると共に、クロック生成部１４の周辺
回路分周部１８に対しても出力する。周辺回路分周部１
８は第２クロックを分周して第３及び第４クロックを生
成して周辺回路クロック供給部１６に対して出力し、周
辺回路クロック供給部１６は周辺回路１３に第４クロッ
クを出力する。つまり、周辺回路分周部１８において、
第１クロックが入力されたときの第３クロックと、第２
クロックが入力されたときの第４クロックとは同じ大き
さとなっており、ＣＰＵ１２に第１及び第２クロックの
どちらが使用されても、周辺回路１３には常に一定の大
きさの動作クロックが供給されることになる。
１クロックが選択され、第１クロックがＣＰＵ１２に出
力されると共に、クロック生成部１４に入力された第１
クロックを周辺回路分周部１８において分周し、第３ク
ロックが周辺回路クロック供給部１６において選択され
て周辺回路１３に出力されている状態で、ＣＰＵ１２が
切換信号をＣＰＵクロック切換部１５及び周辺回路クロ
ック供給部１６に出力すると、ＣＰＵクロック切換部１
５では第２クロックを選択し、ＣＰＵ１２に対して第２
クロックを出力すると共に、クロック生成部１４の周辺
回路分周部１８に対しても出力する。周辺回路分周部１
８は第２クロックを分周して第３及び第４クロックを生
成して周辺回路クロック供給部１６に対して出力し、周
辺回路クロック供給部１６は周辺回路１３に第４クロッ
クを出力する。つまり、周辺回路分周部１８において、
第１クロックが入力されたときの第３クロックと、第２
クロックが入力されたときの第４クロックとは同じ大き
さとなっており、ＣＰＵ１２に第１及び第２クロックの
どちらが使用されても、周辺回路１３には常に一定の大
きさの動作クロックが供給されることになる。
【００２７】上記したことを具体的な数値を用いて示す
と、ＣＰＵ分周部１７から出力される第１クロックが１
２ＭＨｚ、第２クロックが６ＭＨｚとし、周辺回路分周
部１８において、第３クロックを２５０分周、第４クロ
ックを１２５分周行うようにして生成すると、ＣＰＵ１
２の動作クロックが第１クロックから第２クロックに切
り換わった場合、もしくは第２クロックから第１クロッ
クから切り換わった場合でも周辺回路分周部１８から出
力される第３及び第４クロックは常にどちらか一方が４
８ｋＨｚに保たれると共に、ＣＰＵ１２と周辺回路１３
との同期も保たれることになる。また、この例のように
分周の回数が２倍である場合は、フリップフロップ回路
１個で実現できる。
と、ＣＰＵ分周部１７から出力される第１クロックが１
２ＭＨｚ、第２クロックが６ＭＨｚとし、周辺回路分周
部１８において、第３クロックを２５０分周、第４クロ
ックを１２５分周行うようにして生成すると、ＣＰＵ１
２の動作クロックが第１クロックから第２クロックに切
り換わった場合、もしくは第２クロックから第１クロッ
クから切り換わった場合でも周辺回路分周部１８から出
力される第３及び第４クロックは常にどちらか一方が４
８ｋＨｚに保たれると共に、ＣＰＵ１２と周辺回路１３
との同期も保たれることになる。また、この例のように
分周の回数が２倍である場合は、フリップフロップ回路
１個で実現できる。
【００２８】なお、本実施例ではＣＰＵ分周部１７から
出力される動作クロックの種類は２種類としているが、
３種類以上であっても構わない。
出力される動作クロックの種類は２種類としているが、
３種類以上であっても構わない。
【００２９】以上のように本実施例では、ＣＰＵクロッ
ク切換部１５において選択された動作クロックを周辺回
路分周部１８において分周することにより周辺回路に対
する動作クロックを生成するので、ＣＰＵ１２と周辺回
路１３を同期させることができると共に、ＣＰＵ分周部
１７及び周辺回路分周部１８における分周回数を予め定
め、ＣＰＵ分周部１７において生成される数種類の動作
クロックのどれが周辺回路分周部１８に入力されても、
周辺回路分周部１８から出力される数種類の動作クロッ
クのうち少なくとも１つは、ある所定の大きさの周波数
を有する動作クロックを有し、周辺回路クロック供給部
１６においてこの所定の大きさの動作クロックが常に選
択されて周辺回路１３に供給されることにより、周辺回
路１３は常に一定の大きさの動作クロックによって動作
することが可能となる。
ク切換部１５において選択された動作クロックを周辺回
路分周部１８において分周することにより周辺回路に対
する動作クロックを生成するので、ＣＰＵ１２と周辺回
路１３を同期させることができると共に、ＣＰＵ分周部
１７及び周辺回路分周部１８における分周回数を予め定
め、ＣＰＵ分周部１７において生成される数種類の動作
クロックのどれが周辺回路分周部１８に入力されても、
周辺回路分周部１８から出力される数種類の動作クロッ
クのうち少なくとも１つは、ある所定の大きさの周波数
を有する動作クロックを有し、周辺回路クロック供給部
１６においてこの所定の大きさの動作クロックが常に選
択されて周辺回路１３に供給されることにより、周辺回
路１３は常に一定の大きさの動作クロックによって動作
することが可能となる。
【００３０】（実施例２）以下に本発明の第２の実施例
について、図面を参照しながら説明する。
について、図面を参照しながら説明する。
【００３１】図２は本発明の第２の実施例におけるクロ
ック供給装置の構成を示すブロック図であり、クロック
供給装置２１について示している。図２において、２２
は数種類の動作クロックを択一的に選択するクロック切
換部、２３は動作クロックの切換のタイミングを制御す
る切換タイミング制御部、２４は切換タイミング制御部
２３から出力される制御信号を一時記憶しておく記憶部
である。また、２５はクロック供給装置２１が用いられ
ているマイコンシステム等のＣＰＵである。なお、本実
施例は入力される数種類の動作クロックの切換のタイミ
ングについて示したものである。
ック供給装置の構成を示すブロック図であり、クロック
供給装置２１について示している。図２において、２２
は数種類の動作クロックを択一的に選択するクロック切
換部、２３は動作クロックの切換のタイミングを制御す
る切換タイミング制御部、２４は切換タイミング制御部
２３から出力される制御信号を一時記憶しておく記憶部
である。また、２５はクロック供給装置２１が用いられ
ているマイコンシステム等のＣＰＵである。なお、本実
施例は入力される数種類の動作クロックの切換のタイミ
ングについて示したものである。
【００３２】以上のように構成されたクロック供給装置
２１について、以下にその動作について説明する。
２１について、以下にその動作について説明する。
【００３３】図２に示すように、第１クロック及び第２
クロックは、クロック切換部２２においていづれか一方
が選択され、選択クロックとしてＣＰＵ２５あるいはそ
の他の周辺回路（図示せず）に供給される。
クロックは、クロック切換部２２においていづれか一方
が選択され、選択クロックとしてＣＰＵ２５あるいはそ
の他の周辺回路（図示せず）に供給される。
【００３４】次に、動作クロックの切換の様子について
説明する。第１及び第２クロックは前述したようにクロ
ック切換部２２に入力されるが、同時に切換タイミング
制御部２３にも入力されている。ＣＰＵ２５からの切換
信号が切換タイミング制御部２３に入力されると、切換
タイミング制御部２３は切換信号が来ていることを記憶
部２４に記憶させると共に、第１及び第２クロックが共
にロウレベルなるタイミングを見計らっている。切換タ
イミング制御部２３で第１及び第２クロックが共にロウ
レベルであることが検知されると、切換タイミング制御
部２３はその旨を示す信号を記憶部２４に出力し、記憶
部２４に切換信号が記憶されていればクロック切換部２
２に切換信号を出力する。
説明する。第１及び第２クロックは前述したようにクロ
ック切換部２２に入力されるが、同時に切換タイミング
制御部２３にも入力されている。ＣＰＵ２５からの切換
信号が切換タイミング制御部２３に入力されると、切換
タイミング制御部２３は切換信号が来ていることを記憶
部２４に記憶させると共に、第１及び第２クロックが共
にロウレベルなるタイミングを見計らっている。切換タ
イミング制御部２３で第１及び第２クロックが共にロウ
レベルであることが検知されると、切換タイミング制御
部２３はその旨を示す信号を記憶部２４に出力し、記憶
部２４に切換信号が記憶されていればクロック切換部２
２に切換信号を出力する。
【００３５】図３は本発明の第２の実施例におけるクロ
ック供給装置のタイミングチャートを示したものであ
り、図３を用いて前述の切換タイミングについて詳細に
説明する。
ック供給装置のタイミングチャートを示したものであ
り、図３を用いて前述の切換タイミングについて詳細に
説明する。
【００３６】第１クロック及び第２クロックは、図３に
示すようなタイミングチャートを示しているものとす
る。今、ＣＰＵ２５から出力された切換信号が図３に示
したようなタイミングで出力されたものとして、従来の
ようにクロック切換部２２で切換を行った場合、このと
き第１クロックはハイレベルであり第２クロックはロウ
レベルであるために、クロック切換部２２から出力され
る選択クロックには、短いパルスが発生して誤動作を引
き起こしてしまう。そこで本実施例では、ＣＰＵ２５か
ら出力された切換信号は、切換タイミング制御部２３を
経て一旦記憶部２４に記憶し、これと同時に切換タイミ
ング制御部２３は、第１及び第２クロックが共にロウレ
ベルの時を見計らって、その旨を示す制御信号を記憶部
２４に出力し、記憶部２４はこの制御信号を受けると記
憶していた切換信号をクロック切換部２２に出力する。
クロック切換部２２では第１クロックを第２クロックに
切り換えて選択信号として出力する。
示すようなタイミングチャートを示しているものとす
る。今、ＣＰＵ２５から出力された切換信号が図３に示
したようなタイミングで出力されたものとして、従来の
ようにクロック切換部２２で切換を行った場合、このと
き第１クロックはハイレベルであり第２クロックはロウ
レベルであるために、クロック切換部２２から出力され
る選択クロックには、短いパルスが発生して誤動作を引
き起こしてしまう。そこで本実施例では、ＣＰＵ２５か
ら出力された切換信号は、切換タイミング制御部２３を
経て一旦記憶部２４に記憶し、これと同時に切換タイミ
ング制御部２３は、第１及び第２クロックが共にロウレ
ベルの時を見計らって、その旨を示す制御信号を記憶部
２４に出力し、記憶部２４はこの制御信号を受けると記
憶していた切換信号をクロック切換部２２に出力する。
クロック切換部２２では第１クロックを第２クロックに
切り換えて選択信号として出力する。
【００３７】なお、本実施例では２つの動作クロックの
切換について説明を行ったが、３つ以上であっても構わ
ない。
切換について説明を行ったが、３つ以上であっても構わ
ない。
【００３８】以上のように本実施例では、ＣＰＵ２５か
ら出力される切換信号が切換タイミング制御部２３に入
力された後、一旦記憶部２４に切換信号を記憶させる。
ここで、切換タイミング制御部２３が第１及び第２クロ
ックがともにロウレベルであるタイミングを検知する
と、記憶部２４に記憶されている切換信号がクロック切
換部２２に対して出力されるので、動作クロックを切り
換える際に短いパルスが発生することを防止することが
できる。
ら出力される切換信号が切換タイミング制御部２３に入
力された後、一旦記憶部２４に切換信号を記憶させる。
ここで、切換タイミング制御部２３が第１及び第２クロ
ックがともにロウレベルであるタイミングを検知する
と、記憶部２４に記憶されている切換信号がクロック切
換部２２に対して出力されるので、動作クロックを切り
換える際に短いパルスが発生することを防止することが
できる。
【００３９】
【発明の効果】以上のように本発明は、ＣＰＵに対する
動作クロックを分周することによって周辺回路に対する
動作クロックを生成することから、ＣＰＵへの動作クロ
ックと周辺回路への動作クロックとは常に同期すること
になり、また、ＣＰＵへの動作クロックを切り換える際
に、クロック供給部において常に一定の大きさの動作ク
ロックうぃ選択することにより、周辺回路へは常に所定
の大きさ動作クロックを供給することができる優れたク
ロック供給装置を実現できるものである。
動作クロックを分周することによって周辺回路に対する
動作クロックを生成することから、ＣＰＵへの動作クロ
ックと周辺回路への動作クロックとは常に同期すること
になり、また、ＣＰＵへの動作クロックを切り換える際
に、クロック供給部において常に一定の大きさの動作ク
ロックうぃ選択することにより、周辺回路へは常に所定
の大きさ動作クロックを供給することができる優れたク
ロック供給装置を実現できるものである。
【００４０】また、ＣＰＵから出力される切換信号を一
旦記憶部に記憶させ、切換タイミング制御部において動
作クロックが共にロウレベルであることを検知したとき
に、記憶部に記憶されている切換信号がクロック切換部
に出力されることから、動作クロックの切換を行う際
に、誤動作の原因となる短いパルスの発生することを防
止することがでる優れたクロック供給装置を実現できる
ものである。
旦記憶部に記憶させ、切換タイミング制御部において動
作クロックが共にロウレベルであることを検知したとき
に、記憶部に記憶されている切換信号がクロック切換部
に出力されることから、動作クロックの切換を行う際
に、誤動作の原因となる短いパルスの発生することを防
止することがでる優れたクロック供給装置を実現できる
ものである。
【図１】本発明の第１の実施例におけるクロック供給装
置の構成を示すブロック図
置の構成を示すブロック図
【図２】本発明の第２の実施例におけるクロック供給装
置の構成を示すブロック図
置の構成を示すブロック図
【図３】本発明の第２の実施例におけるクロック供給装
置のタイミングチャート
置のタイミングチャート
【図４】従来のクロック供給装置を備えたマイコンシス
テムの構成を示すブロック図
テムの構成を示すブロック図
【図５】従来のクロック供給装置の構成を示すブロック
図
図
１１ クロック供給装置 １２ ＣＰＵ １３ 周辺回路 １４ クロック生成部 １５ ＣＰＵクロック切換部（クロック切換部） １６ 周辺回路クロック供給部（クロック供給部） １７ ＣＰＵ分周部（第１の分周部） １８ 周辺回路分周部（第２の分周部） ２１ クロック供給装置 ２２ クロック切換部 ２３ 切換タイミング制御部 ２４ 記憶部 ２５ ＣＰＵ
Claims (3)
- 【請求項１】基準クロックを予め定められた分周回数ほ
ど分周して数種類のＣＰＵに対する動作クロックを生成
する第１の分周部と、前記第１の分周部から出力される
数種類の動作クロックを択一的に選択するクロック切換
部と、前記クロック切換部において選択された動作クロ
ックを予め定められた分周回数ほど分周して数種類の周
辺回路に対する動作クロックを生成する第２の分周部
と、前記第２の分周部から出力される数種類の動作クロ
ックを択一的に選択するクロック供給部とを備え、前記
第２の分周部における分周回数は、前記第１の分周部か
ら出力される個々の動作クロックを分周した際に少なく
とも１つは所定の大きさの動作クロックが出力されるよ
うに予め定められており、ＣＰＵからの切換信号が前記
クロック切換部及び前記クロック供給部に入力されて
も、前記クロック供給部では切換前と同じ大きさの動作
クロックを選択することを特徴とするクロック供給装
置。 - 【請求項２】前記第１の分周部から出力される一方の動
作クロックが他方の動作クロックの２倍の周波数を有
し、前記第２の分周部における一方の分周回数が他方の
２倍となっていることを特徴とする請求項１記載のクロ
ック供給装置。 - 【請求項３】数種類のクロックを択一的に選択するクロ
ック切換部と、前記クロック切換部に入力される数種類
のクロックのタイミングを見計らう切換タイミング制御
部と、ＣＰＵが出力した切換信号を一時記憶しておく記
憶部とを備え、前記切換タイミング制御部はＣＰＵから
出力される切換信号を受け、前記記憶部に記憶させると
共に、前記クロック切換部に入力される数種類のクロッ
クのタイミングを見計らい、クロックが共にロウレベル
であることを検出したときに、前記記憶部に記憶してい
た切換信号を前記クロック切換部に対して出力すること
を特徴とするクロック供給装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7024154A JPH08221151A (ja) | 1995-02-13 | 1995-02-13 | クロック供給装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7024154A JPH08221151A (ja) | 1995-02-13 | 1995-02-13 | クロック供給装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08221151A true JPH08221151A (ja) | 1996-08-30 |
Family
ID=12130431
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7024154A Pending JPH08221151A (ja) | 1995-02-13 | 1995-02-13 | クロック供給装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08221151A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002229667A (ja) * | 2001-02-01 | 2002-08-16 | Sony Corp | クロック生成回路およびデータ処理システム |
| US7065667B2 (en) * | 2002-08-29 | 2006-06-20 | Oki Electric Industry Co., Ltd. | Integrated circuit device to generate a clock of a suitable frequency for operating a peripheral device |
| JP2012203866A (ja) * | 2011-03-28 | 2012-10-22 | Renesas Electronics Corp | クロック生成回路、それを用いたプロセッサシステム、及びクロック周波数制御方法 |
-
1995
- 1995-02-13 JP JP7024154A patent/JPH08221151A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002229667A (ja) * | 2001-02-01 | 2002-08-16 | Sony Corp | クロック生成回路およびデータ処理システム |
| JP4691791B2 (ja) * | 2001-02-01 | 2011-06-01 | ソニー株式会社 | データ処理システム |
| US7065667B2 (en) * | 2002-08-29 | 2006-06-20 | Oki Electric Industry Co., Ltd. | Integrated circuit device to generate a clock of a suitable frequency for operating a peripheral device |
| JP2012203866A (ja) * | 2011-03-28 | 2012-10-22 | Renesas Electronics Corp | クロック生成回路、それを用いたプロセッサシステム、及びクロック周波数制御方法 |
| US20140247074A1 (en) * | 2011-03-28 | 2014-09-04 | Renesas Electronics Corporation | Clock generation circuit, processor system using same, and clock frequency control method |
| US9252752B2 (en) | 2011-03-28 | 2016-02-02 | Renesas Electronics Corporation | Clock generation circuit, processor system using same, and clock frequency control method |
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