JPH08102900A - 液晶プロジェクタ装置 - Google Patents
液晶プロジェクタ装置Info
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- JPH08102900A JPH08102900A JP23903494A JP23903494A JPH08102900A JP H08102900 A JPH08102900 A JP H08102900A JP 23903494 A JP23903494 A JP 23903494A JP 23903494 A JP23903494 A JP 23903494A JP H08102900 A JPH08102900 A JP H08102900A
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- Japan
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- signal
- crystal display
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Abstract
(57)【要約】
１１
【構成】 キーストーン補正回路１４は、同期信号分離
回路１２からの同期信号に基づいて、入力映像信号の走
査線内の画素数を所定走査線数単位で変化させることに
より、キーストーン歪補正を行う。この補正は、液晶表
示パネル１８Ｒ、１８Ｇ、１８Ｂ上での表示画像の外形
あるいは表示枠が、キーストーン歪として生ずる台形と
は逆向きの台形となるように、所定走査線毎に水平時間
軸を圧縮することにより行う。このような歪補正画像が
表示された液晶表示パネル１８Ｒ、１８Ｇ、１８Ｂに光
源１７からの光を照射し、投射レンズ１９を介してスク
リーン面上に投影することにより、キーストーン歪が補
正された映像が得られる。 【効果】 電気的にキーストーン歪補正が行えるため、
スクリーンとの位置関係が変わっても簡単に対応でき、
光学的な対処が困難な投射角度が大きい場合でもキース
トーン歪補正が有効に行える。
回路１２からの同期信号に基づいて、入力映像信号の走
査線内の画素数を所定走査線数単位で変化させることに
より、キーストーン歪補正を行う。この補正は、液晶表
示パネル１８Ｒ、１８Ｇ、１８Ｂ上での表示画像の外形
あるいは表示枠が、キーストーン歪として生ずる台形と
は逆向きの台形となるように、所定走査線毎に水平時間
軸を圧縮することにより行う。このような歪補正画像が
表示された液晶表示パネル１８Ｒ、１８Ｇ、１８Ｂに光
源１７からの光を照射し、投射レンズ１９を介してスク
リーン面上に投影することにより、キーストーン歪が補
正された映像が得られる。 【効果】 電気的にキーストーン歪補正が行えるため、
スクリーンとの位置関係が変わっても簡単に対応でき、
光学的な対処が困難な投射角度が大きい場合でもキース
トーン歪補正が有効に行える。
Description
【０００１】
【産業上の利用分野】本発明は、液晶表示パネルに光源
からの光を照射して投射レンズを介してスクリーン面上
に画像を投射する液晶プロジェクタ装置に関する。
からの光を照射して投射レンズを介してスクリーン面上
に画像を投射する液晶プロジェクタ装置に関する。
【０００２】
【従来の技術】テレビジョン映像等の画像をスクリーン
面上に投影するプロジェクタ装置としては、従来より陰
極線管（ＣＲＴ）を用いたＣＲＴプロジェクタ装置が知
られている。
面上に投影するプロジェクタ装置としては、従来より陰
極線管（ＣＲＴ）を用いたＣＲＴプロジェクタ装置が知
られている。
【０００３】また近年においては、液晶表示パネルを用
い、投射用光源からの光を液晶表示パネルの裏面から照
射し投射レンズ等の光学系を介してスクリーン面上に画
像を投影するような液晶プロジェクタ装置も多く用いら
れるようになってきている。
い、投射用光源からの光を液晶表示パネルの裏面から照
射し投射レンズ等の光学系を介してスクリーン面上に画
像を投影するような液晶プロジェクタ装置も多く用いら
れるようになってきている。
【０００４】このようなプロジェクタ装置においては、
プロジェクタの設置位置により、スクリーンに投影され
た画像が台形に歪むことがある。この歪はキーストーン
歪と呼ばれている。
プロジェクタの設置位置により、スクリーンに投影され
た画像が台形に歪むことがある。この歪はキーストーン
歪と呼ばれている。
【０００５】すなわち、図１４において、プロジェクタ
装置１０１のレンズ光軸１０２が、スクリーン平面１０
３に対して傾いているとき、具体的にはスクリーン平面
１０３に垂直な方向に対してレンズ光軸が角度αだけ傾
いているとき、投射された画像の画枠あるいは表示枠
は、図１５の実線に示すように台形状となり、いわゆる
キーストーン歪が生ずる。ここで、図１４の仮想線（２
点鎖線）は、プロジェクタ装置１０１のレンズ光軸１０
２に対して直交する仮想的な投影像面１０５を示してお
り、この仮想的な投影像面１０５上での画像の表示枠を
図１５の仮想線に示している。
装置１０１のレンズ光軸１０２が、スクリーン平面１０
３に対して傾いているとき、具体的にはスクリーン平面
１０３に垂直な方向に対してレンズ光軸が角度αだけ傾
いているとき、投射された画像の画枠あるいは表示枠
は、図１５の実線に示すように台形状となり、いわゆる
キーストーン歪が生ずる。ここで、図１４の仮想線（２
点鎖線）は、プロジェクタ装置１０１のレンズ光軸１０
２に対して直交する仮想的な投影像面１０５を示してお
り、この仮想的な投影像面１０５上での画像の表示枠を
図１５の仮想線に示している。
【０００６】このようなキーストーン歪の補正は、投影
しようとする画像そのものを予め当該歪とは逆の台形、
すなわちスクリーン上での短辺が長く、長辺が短くなる
ような台形の表示枠とするように調整することで行わ
れ、このような補正が行われた画像をスクリーン面上に
投射することで、スクリーン面上の画像の表示枠が長方
形あるいは矩形に補正される。
しようとする画像そのものを予め当該歪とは逆の台形、
すなわちスクリーン上での短辺が長く、長辺が短くなる
ような台形の表示枠とするように調整することで行わ
れ、このような補正が行われた画像をスクリーン面上に
投射することで、スクリーン面上の画像の表示枠が長方
形あるいは矩形に補正される。
【０００７】このキーストーン歪の補正については、上
記ＣＲＴプロジェクタ装置の場合には、ＣＲＴあるいは
いわゆるブラウン管の偏向回路の電気的な調整により、
管面上で歪の補正が比較的容易に行える。
記ＣＲＴプロジェクタ装置の場合には、ＣＲＴあるいは
いわゆるブラウン管の偏向回路の電気的な調整により、
管面上で歪の補正が比較的容易に行える。
【０００８】
【発明が解決しようとする課題】ところで、液晶プロジ
ェクタ装置の場合には、上記キーストーン歪の補正は非
常に難しいことから、一般的には光学的に歪が発生しな
いように、例えば図１６に示すような光学系の構造をと
るようにしている。
ェクタ装置の場合には、上記キーストーン歪の補正は非
常に難しいことから、一般的には光学的に歪が発生しな
いように、例えば図１６に示すような光学系の構造をと
るようにしている。
【０００９】すなわち、この図１６の液晶プロジェクタ
装置は、液晶表示パネル１２１に対して照明系であるラ
ンプ１２２からの光を照射し、投射レンズ１２３を介し
てスクリーン１２５に画像を投影するものである。この
液晶プロジェクタ装置において、上記キーストーン歪が
発生しないように、液晶表示パネル１２１とスクリーン
１２５とを平行としており、また、投射レンズ１２３と
液晶表示パネル１２１及び照明系であるランプ１２２と
を光軸からずらして、すなわち所定のシフト量ｄだけシ
フトさせて、キーストーン歪を発生させずに固定の投射
角度αを持たせている。すなわち、液晶表示パネル１２
１とスクリーン１２５とが平行ならば、キーストーン歪
は発生しない。さらに、この状態で投射レンズ１２３を
上下に移動させれば、キーストーン歪を発生すること無
く投射角度αを変化させることができる。
装置は、液晶表示パネル１２１に対して照明系であるラ
ンプ１２２からの光を照射し、投射レンズ１２３を介し
てスクリーン１２５に画像を投影するものである。この
液晶プロジェクタ装置において、上記キーストーン歪が
発生しないように、液晶表示パネル１２１とスクリーン
１２５とを平行としており、また、投射レンズ１２３と
液晶表示パネル１２１及び照明系であるランプ１２２と
を光軸からずらして、すなわち所定のシフト量ｄだけシ
フトさせて、キーストーン歪を発生させずに固定の投射
角度αを持たせている。すなわち、液晶表示パネル１２
１とスクリーン１２５とが平行ならば、キーストーン歪
は発生しない。さらに、この状態で投射レンズ１２３を
上下に移動させれば、キーストーン歪を発生すること無
く投射角度αを変化させることができる。
【００１０】しかしながら、上記投射角度αが大きくな
るほど投射レンズ１２３の有効利用率が低下し、明るさ
を確保するためには大口径の投射レンズ１２３を用いる
ことが必要とされる。また、投射角度αを連続的に変え
られるようにするためには、投射レンズ１２３等を上下
方向に精密に移動させる機構やメカニズムが必要とされ
る。このようなことから、図１６の構造の液晶プロジェ
クタ装置は、構造が複雑化しコストアップの原因となる
のみならず、長期の安定性や振動衝撃に対する信頼性を
確保するのが困難である等の問題がある。
るほど投射レンズ１２３の有効利用率が低下し、明るさ
を確保するためには大口径の投射レンズ１２３を用いる
ことが必要とされる。また、投射角度αを連続的に変え
られるようにするためには、投射レンズ１２３等を上下
方向に精密に移動させる機構やメカニズムが必要とされ
る。このようなことから、図１６の構造の液晶プロジェ
クタ装置は、構造が複雑化しコストアップの原因となる
のみならず、長期の安定性や振動衝撃に対する信頼性を
確保するのが困難である等の問題がある。
【００１１】そこで、本発明は上述の実情に鑑み、電気
的な信号処理により上記キーストーン歪の補正が行え、
スクリーンとの位置関係が変わっても簡単に対応でき、
光学的な対処が困難な投射角度が大きい条件でもキース
トーン歪の補正が行えるような液晶プロジェクタ装置を
提供することを目的とする。
的な信号処理により上記キーストーン歪の補正が行え、
スクリーンとの位置関係が変わっても簡単に対応でき、
光学的な対処が困難な投射角度が大きい条件でもキース
トーン歪の補正が行えるような液晶プロジェクタ装置を
提供することを目的とする。
【００１２】
【課題を解決するための手段】本発明に係る液晶プロジ
ェクタ装置は、光源からの光により液晶表示パネルを照
明し投射レンズを介してスクリーン面上に投射する液晶
プロジェクタ装置において、入力映像信号から同期信号
を分離する同期分離手段と、上記同期分離手段からの同
期信号に基づいて上記入力映像信号の走査線内の画素数
を所定走査線数単位で変化させることによりキーストー
ン歪を補正するキーストーン歪補正手段と、このキース
トーン歪補正手段により歪補正された映像信号を上記液
晶表示パネル上に表示駆動する液晶表示駆動手段とを有
して成ることにより上述した課題を解決する。
ェクタ装置は、光源からの光により液晶表示パネルを照
明し投射レンズを介してスクリーン面上に投射する液晶
プロジェクタ装置において、入力映像信号から同期信号
を分離する同期分離手段と、上記同期分離手段からの同
期信号に基づいて上記入力映像信号の走査線内の画素数
を所定走査線数単位で変化させることによりキーストー
ン歪を補正するキーストーン歪補正手段と、このキース
トーン歪補正手段により歪補正された映像信号を上記液
晶表示パネル上に表示駆動する液晶表示駆動手段とを有
して成ることにより上述した課題を解決する。
【００１３】ここで、上記入力映像信号は複合カラー映
像信号であり、この入力信号を輝度信号とクロマ信号と
に分離して上記キーストーン歪補正手段によりそれぞれ
補正処理することが挙げられる。
像信号であり、この入力信号を輝度信号とクロマ信号と
に分離して上記キーストーン歪補正手段によりそれぞれ
補正処理することが挙げられる。
【００１４】また、上記キーストーン歪補正手段は、入
力映像信号の走査線内のサンプルの隣接サンプル間を補
間処理することにより画素数を変換することが好まし
い。
力映像信号の走査線内のサンプルの隣接サンプル間を補
間処理することにより画素数を変換することが好まし
い。
【００１５】
【作用】電気的にキーストーン歪の補正が行え、スクリ
ーンとの位置関係が変わっても簡単に対応でき、光学的
な対処が困難な投射角度が大きい条件でもキーストーン
歪の補正が行える。
ーンとの位置関係が変わっても簡単に対応でき、光学的
な対処が困難な投射角度が大きい条件でもキーストーン
歪の補正が行える。
【００１６】
【実施例】以下、本発明の好ましい実施例について、図
面を参照しながら説明する。
面を参照しながら説明する。
【００１７】図１は、本発明に係る液晶プロジェクタ装
置の一実施例の概略的な構成を示すブロック図である。
置の一実施例の概略的な構成を示すブロック図である。
【００１８】この図１に示す装置において、入力端子１
１に供給された複合カラー映像信号は、同期分離及びＹ
（輝度）／Ｃ（クロマ）分離回路１２に送られて、同期
信号と、Ｙ（輝度）信号と、クロマ信号とに分離され
る。クロマ信号はクロマデコーダ回路１３により色差信
号であるＲ−ＹとＢ−Ｙとに変換される。このクロマデ
コーダ回路１３からの色差信号Ｒ−Ｙ、Ｂ−Ｙと、上記
Ｙ信号とが、キーストーン歪補正回路１４に送られる。
キーストーン歪補正回路１４では、スクリーン面に対し
て斜めに投射されることにより生ずるキーストーン歪の
補正及びスクリーン面上での投射画像の位置の調整が行
われ、出力映像信号であるＹ信号及び色差信号がＲＧＢ
デコーダ１５に送られる。ＲＧＢデコーダ１５では、
Ｙ、Ｒ−Ｙ、Ｂ−Ｙの各信号に基づいて、Ｒ（赤）、Ｇ
（緑）、Ｂ（青）の３原色の映像信号が取り出され、液
晶表示装置（ＬＣＤ）駆動回路１６に送られて、このＬ
ＣＤ駆動回路１６が各色に対応する３枚の液晶表示パネ
ル１８Ｒ、１８Ｇ、１８Ｂを表示駆動する。これらの液
晶表示パネル１８Ｒ、１８Ｇ、１８Ｂは、ランプ等の光
源１７からの光が透過して得られた各色Ｒ、Ｇ、Ｂの画
像が、投射レンズ１９を介してスクリーン面に投射され
る。
１に供給された複合カラー映像信号は、同期分離及びＹ
（輝度）／Ｃ（クロマ）分離回路１２に送られて、同期
信号と、Ｙ（輝度）信号と、クロマ信号とに分離され
る。クロマ信号はクロマデコーダ回路１３により色差信
号であるＲ−ＹとＢ−Ｙとに変換される。このクロマデ
コーダ回路１３からの色差信号Ｒ−Ｙ、Ｂ−Ｙと、上記
Ｙ信号とが、キーストーン歪補正回路１４に送られる。
キーストーン歪補正回路１４では、スクリーン面に対し
て斜めに投射されることにより生ずるキーストーン歪の
補正及びスクリーン面上での投射画像の位置の調整が行
われ、出力映像信号であるＹ信号及び色差信号がＲＧＢ
デコーダ１５に送られる。ＲＧＢデコーダ１５では、
Ｙ、Ｒ−Ｙ、Ｂ−Ｙの各信号に基づいて、Ｒ（赤）、Ｇ
（緑）、Ｂ（青）の３原色の映像信号が取り出され、液
晶表示装置（ＬＣＤ）駆動回路１６に送られて、このＬ
ＣＤ駆動回路１６が各色に対応する３枚の液晶表示パネ
ル１８Ｒ、１８Ｇ、１８Ｂを表示駆動する。これらの液
晶表示パネル１８Ｒ、１８Ｇ、１８Ｂは、ランプ等の光
源１７からの光が透過して得られた各色Ｒ、Ｇ、Ｂの画
像が、投射レンズ１９を介してスクリーン面に投射され
る。
【００１９】この図１のキーストーン歪補正回路１４
は、例えば図２のような構成を有している。
は、例えば図２のような構成を有している。
【００２０】この図２において、入力端子２１Ｙ、２１
RY、２１BYには、上記クロマデコーダ１３からのＹ（輝
度）信号、Ｒ−Ｙ色差信号、及びＢ−Ｙ色差信号がそれ
ぞれ供給されている。これらの各信号は、それぞれアナ
ログ／ディジタル（Ａ／Ｄ）変換器２２Ｙ、２２RY、２
２BYに送られてディジタル信号に変換され、ラッチ回路
２３Ｙ、２３RY、２３BYを介して補間回路２４Ｙ、２４
RY、２４BYにそれぞれ送られている。
RY、２１BYには、上記クロマデコーダ１３からのＹ（輝
度）信号、Ｒ−Ｙ色差信号、及びＢ−Ｙ色差信号がそれ
ぞれ供給されている。これらの各信号は、それぞれアナ
ログ／ディジタル（Ａ／Ｄ）変換器２２Ｙ、２２RY、２
２BYに送られてディジタル信号に変換され、ラッチ回路
２３Ｙ、２３RY、２３BYを介して補間回路２４Ｙ、２４
RY、２４BYにそれぞれ送られている。
【００２１】補間回路２４Ｙ、２４RY、２４BYでは、走
査線内の画素数を所定走査線数単位で変化させる、ある
いは時間軸を変化させるようなディジタル信号処理を行
うことにより、前述したキーストーン歪の補正を行って
いる。この補間回路２４Ｙ、２４RY、２４BYの具体的な
構成及び処理内容については後述する。
査線内の画素数を所定走査線数単位で変化させる、ある
いは時間軸を変化させるようなディジタル信号処理を行
うことにより、前述したキーストーン歪の補正を行って
いる。この補間回路２４Ｙ、２４RY、２４BYの具体的な
構成及び処理内容については後述する。
【００２２】補間回路２４Ｙからの出力信号はメモリ２
５Ｙへ、また補間回路２４RY、２４BYからの各出力信号
はマルチプレクサ２６で合成されてメモリ２５Ｃへ、そ
れぞれ送られる。これらのメモリ２５Ｙ、２５Ｃでは、
上記補間回路２４Ｙやマルチプレクサ２６からの出力信
号であるディジタルデータの書き込み動作が制御され、
所定の読み出しクロックで読み出し制御されている。
５Ｙへ、また補間回路２４RY、２４BYからの各出力信号
はマルチプレクサ２６で合成されてメモリ２５Ｃへ、そ
れぞれ送られる。これらのメモリ２５Ｙ、２５Ｃでは、
上記補間回路２４Ｙやマルチプレクサ２６からの出力信
号であるディジタルデータの書き込み動作が制御され、
所定の読み出しクロックで読み出し制御されている。
【００２３】メモリ２５Ｙから読み出された出力はラッ
チ回路２７Ｙを介して、またメモリ２５Ｃから読み出さ
れた出力は切換回路２８で交互に切り換えられてラッチ
回路２７RY及び２７BYを介して、それぞれ出力端子２９
Ｙ、２９RY、２９BYより取り出される。
チ回路２７Ｙを介して、またメモリ２５Ｃから読み出さ
れた出力は切換回路２８で交互に切り換えられてラッチ
回路２７RY及び２７BYを介して、それぞれ出力端子２９
Ｙ、２９RY、２９BYより取り出される。
【００２４】また、端子３１Ｈには水平同期信号が、端
子３１Ｖには垂直同期信号がそれぞれ供給されており、
端子３１Ｈからの水平同期信号はクロック発生回路３２
に送られてクロック信号が発生され、このクロック信号
が各回路部に供給されるようになっている。各端子３１
Ｈ、３１Ｖからの水平、垂直同期信号は、係数制御回路
３３及びメモリ制御回路３６に送られている。係数制御
回路３３は、補間演算のための係数が記憶された係数Ｒ
ＯＭ３４を制御して必要な係数を読み出し、この係数が
バッファ３５を介して上記各補間回路２４Ｙ、２４RY、
２４BYに送られている。メモリ制御回路３６は、上記各
メモリ２５Ｙ、２５Ｃの書き込み／読み出しを制御す
る。
子３１Ｖには垂直同期信号がそれぞれ供給されており、
端子３１Ｈからの水平同期信号はクロック発生回路３２
に送られてクロック信号が発生され、このクロック信号
が各回路部に供給されるようになっている。各端子３１
Ｈ、３１Ｖからの水平、垂直同期信号は、係数制御回路
３３及びメモリ制御回路３６に送られている。係数制御
回路３３は、補間演算のための係数が記憶された係数Ｒ
ＯＭ３４を制御して必要な係数を読み出し、この係数が
バッファ３５を介して上記各補間回路２４Ｙ、２４RY、
２４BYに送られている。メモリ制御回路３６は、上記各
メモリ２５Ｙ、２５Ｃの書き込み／読み出しを制御す
る。
【００２５】さらに、端子３７には、キーストーン歪補
正のための補正制御情報が供給されており、これがデコ
ーダ３８でデコードされて、レジスタ３９を介して上記
係数制御回路３３に、またレジスタ４０を介して上記メ
モリ制御回路３６に送られている。
正のための補正制御情報が供給されており、これがデコ
ーダ３８でデコードされて、レジスタ３９を介して上記
係数制御回路３３に、またレジスタ４０を介して上記メ
モリ制御回路３６に送られている。
【００２６】ここで、補間回路２４Ｙ、２４RY、２４BY
及びメモリ２５Ｙ、２５Ｃによる走査線（ライン）毎の
間引き処理あるいは圧縮処理について説明する。
及びメモリ２５Ｙ、２５Ｃによる走査線（ライン）毎の
間引き処理あるいは圧縮処理について説明する。
【００２７】先ず、補間回路２４Ｙ、２４RY、２４BYに
おいては、図３のＡに示す入力データ列Ｄ0,Ｄ1,Ｄ2,・
・・に基づいて補間処理を行い、図３のＢに示す各タイ
ミングに相当する画素データを算出する。このときの補
間演算は、例えば図４に示すように、入力サンプルデー
タＤnとＤn-1との間の補間データＸm を、線形補間ある
いは直線補間により求めており、具体的な係数としては
８種類ａ〜ｈを用い、サンプル間を８分割した内の１つ
の位置に対応するデータを線形補間により求めるてい
る。補間したデータＸ0,Ｘ1,Ｘ2,・・・は、図３のＣに
示すように上記入力データと同様なタイミングで出力さ
れるため、メモリ２５Ｙ、２５Ｃに書き込むときに一部
をスキップして、すなわち例えばデータＸ5とＸ6との間
で書き込みを停止して、データを間引いている。
おいては、図３のＡに示す入力データ列Ｄ0,Ｄ1,Ｄ2,・
・・に基づいて補間処理を行い、図３のＢに示す各タイ
ミングに相当する画素データを算出する。このときの補
間演算は、例えば図４に示すように、入力サンプルデー
タＤnとＤn-1との間の補間データＸm を、線形補間ある
いは直線補間により求めており、具体的な係数としては
８種類ａ〜ｈを用い、サンプル間を８分割した内の１つ
の位置に対応するデータを線形補間により求めるてい
る。補間したデータＸ0,Ｘ1,Ｘ2,・・・は、図３のＣに
示すように上記入力データと同様なタイミングで出力さ
れるため、メモリ２５Ｙ、２５Ｃに書き込むときに一部
をスキップして、すなわち例えばデータＸ5とＸ6との間
で書き込みを停止して、データを間引いている。
【００２８】図５は、上記補間回路２４Ｙの具体的な構
成の一例を示し、図６は、図５の各部のデータの具体例
を示している。
成の一例を示し、図６は、図５の各部のデータの具体例
を示している。
【００２９】図５において、入力端子４１には、上記図
２のラッチ回路２３Ｙからの輝度信号データＹＤn が供
給されている。この輝度信号データＹＤn の具体例を図
６のａに示す。ラッチ回路あるいは遅延回路４２は、こ
の入力データを図６のクロックＣＬＫの立ち上がりでサ
ンプルして、図６のｂの出力を得る。この遅延回路４２
からの出力データは、遅延回路４３で１サンプル遅延さ
れて図６のｃのデータとなり、さらに遅延回路４４で１
サンプル遅延されて図６のｄのデータとなる。この出力
データｄは、第１の係数乗算器４５に送られて上記図２
の係数ＲＯＭ３４からの第１の係数Ｋ１と乗算され、加
算器４７に送られる。また、上記遅延回路４３からの出
力データｃは、第２の係数乗算器４６に送られて上記図
２の係数ＲＯＭ３４からの第２の係数Ｋ２と乗算され、
上記加算器４７に送られる。すなわち、各乗算器４５、
４６では、１サンプルずれた、あるいは時間軸上で隣合
う一対のサンプルデータに対して、第１、第２の係数Ｋ
１、Ｋ２との乗算がそれぞれ行われ、これらが加算器４
７で加算されることにより、上記直線補間が行われる。
加算器４７からの出力データは、遅延回路４８を介し
て、図６のｅに示す補間データとして取り出される。こ
の補間データは、上記図３のデータＸに相当する。
２のラッチ回路２３Ｙからの輝度信号データＹＤn が供
給されている。この輝度信号データＹＤn の具体例を図
６のａに示す。ラッチ回路あるいは遅延回路４２は、こ
の入力データを図６のクロックＣＬＫの立ち上がりでサ
ンプルして、図６のｂの出力を得る。この遅延回路４２
からの出力データは、遅延回路４３で１サンプル遅延さ
れて図６のｃのデータとなり、さらに遅延回路４４で１
サンプル遅延されて図６のｄのデータとなる。この出力
データｄは、第１の係数乗算器４５に送られて上記図２
の係数ＲＯＭ３４からの第１の係数Ｋ１と乗算され、加
算器４７に送られる。また、上記遅延回路４３からの出
力データｃは、第２の係数乗算器４６に送られて上記図
２の係数ＲＯＭ３４からの第２の係数Ｋ２と乗算され、
上記加算器４７に送られる。すなわち、各乗算器４５、
４６では、１サンプルずれた、あるいは時間軸上で隣合
う一対のサンプルデータに対して、第１、第２の係数Ｋ
１、Ｋ２との乗算がそれぞれ行われ、これらが加算器４
７で加算されることにより、上記直線補間が行われる。
加算器４７からの出力データは、遅延回路４８を介し
て、図６のｅに示す補間データとして取り出される。こ
の補間データは、上記図３のデータＸに相当する。
【００３０】上記図５の構成のさらに具体的な回路構成
例を、図７に示す。
例を、図７に示す。
【００３１】この図７においては、上記係数乗算器４
５、４６として、演算ＲＯＭ４５Ｍ、４６Ｍを用いてい
る。この演算ＲＯＭは、入力データがＡ０〜Ａ７の８ビ
ットアドレスとして、また係数データがＡ８〜Ａ１１の
４ビットアドレスとしてそれぞれ供給されることによ
り、これらのデータの乗算結果が端子Ｑ０〜Ｑ７より取
り出されるようになっている。これらの演算ＲＯＭ４５
Ｍ、４６Ｍからの出力は、それぞれ遅延回路４５Ｔ、４
６Ｔを介して加算器４７に供給される。他の構成は上記
図５と同様であるため、対応する部分に同じ指示符号を
付して説明を省略する。
５、４６として、演算ＲＯＭ４５Ｍ、４６Ｍを用いてい
る。この演算ＲＯＭは、入力データがＡ０〜Ａ７の８ビ
ットアドレスとして、また係数データがＡ８〜Ａ１１の
４ビットアドレスとしてそれぞれ供給されることによ
り、これらのデータの乗算結果が端子Ｑ０〜Ｑ７より取
り出されるようになっている。これらの演算ＲＯＭ４５
Ｍ、４６Ｍからの出力は、それぞれ遅延回路４５Ｔ、４
６Ｔを介して加算器４７に供給される。他の構成は上記
図５と同様であるため、対応する部分に同じ指示符号を
付して説明を省略する。
【００３２】また、この図７には、上記図２の係数ＲＯ
Ｍ３４の具体例を示している。この係数ＲＯＭあるいは
係数選択ＲＯＭ３４は、画素係数選択のために、ピクセ
ルクロックをカウントした値のピクセルカウント値P-NO
が下位１０ビットアドレスＡ０〜Ａ９として供給され、
また、間引き画素数が同じとなるライン毎にグループ化
したときのグループ単位でインクリメントされる値のグ
ループカウント値G-NOが上位６ビットアドレスＡ１０〜
Ａ１５として供給されており、これらの入力アドレスに
応じて、それぞれ４ビットずつの上記第１の係数Ｋ１及
び第２の係数Ｋ２が出力される。また、上記図３と共に
説明したメモリへの書き込みを停止させるためのスキッ
プ信号SKIPも、例えば端子Ｑ１５から取り出されるよう
になっている。
Ｍ３４の具体例を示している。この係数ＲＯＭあるいは
係数選択ＲＯＭ３４は、画素係数選択のために、ピクセ
ルクロックをカウントした値のピクセルカウント値P-NO
が下位１０ビットアドレスＡ０〜Ａ９として供給され、
また、間引き画素数が同じとなるライン毎にグループ化
したときのグループ単位でインクリメントされる値のグ
ループカウント値G-NOが上位６ビットアドレスＡ１０〜
Ａ１５として供給されており、これらの入力アドレスに
応じて、それぞれ４ビットずつの上記第１の係数Ｋ１及
び第２の係数Ｋ２が出力される。また、上記図３と共に
説明したメモリへの書き込みを停止させるためのスキッ
プ信号SKIPも、例えば端子Ｑ１５から取り出されるよう
になっている。
【００３３】次に、図８は、上記図２のクロマ信号側の
補間回路の具体例を示している。ただし、この図８の例
では、一対の色差信号Ｒ−Ｙ、Ｂ−Ｙの各演算を時分割
的に交互に行わせる構成を示しており、図２の回路をそ
のまま表すものではない。
補間回路の具体例を示している。ただし、この図８の例
では、一対の色差信号Ｒ−Ｙ、Ｂ−Ｙの各演算を時分割
的に交互に行わせる構成を示しており、図２の回路をそ
のまま表すものではない。
【００３４】この図８において、入力端子５１には、図
９のａに示すように、Ｒ−Ｙ信号とＢ−Ｙ信号とが交互
に配置されて成るデータ列の信号が供給されている。こ
の入力データは、遅延回路５２、５６でそれぞれラッチ
され、いずれも図９のｂに示すようなデータとなる。遅
延回路５２からの出力データは、遅延回路５３と５４と
で２サンプル分遅延され、図９のｄに示すようなデータ
となる。なお、遅延回路５３からの出力データを図９の
ｃに示す。遅延回路５４からの出力データｄは係数乗算
器５５に送られて係数Ｋ１と乗算された後、加算器５８
に送られる。また遅延回路５６からの出力データｂは、
係数乗算器５６に送られて係数Ｋ２と乗算された後、加
算器５８に送られて、上記乗算器５５からの出力と加算
される。加算器５８からの出力データは、遅延回路５９
を介して、図９のｅに示すような補間データとして取り
出される。
９のａに示すように、Ｒ−Ｙ信号とＢ−Ｙ信号とが交互
に配置されて成るデータ列の信号が供給されている。こ
の入力データは、遅延回路５２、５６でそれぞれラッチ
され、いずれも図９のｂに示すようなデータとなる。遅
延回路５２からの出力データは、遅延回路５３と５４と
で２サンプル分遅延され、図９のｄに示すようなデータ
となる。なお、遅延回路５３からの出力データを図９の
ｃに示す。遅延回路５４からの出力データｄは係数乗算
器５５に送られて係数Ｋ１と乗算された後、加算器５８
に送られる。また遅延回路５６からの出力データｂは、
係数乗算器５６に送られて係数Ｋ２と乗算された後、加
算器５８に送られて、上記乗算器５５からの出力と加算
される。加算器５８からの出力データは、遅延回路５９
を介して、図９のｅに示すような補間データとして取り
出される。
【００３５】次に、図１０は、上述のようにして補間処
理が施された後の上記図２のメモリ２５Ｙ、２５Ｃに書
き込まれるデータ列の具体例を示している。
理が施された後の上記図２のメモリ２５Ｙ、２５Ｃに書
き込まれるデータ列の具体例を示している。
【００３６】この図１０の例において、所定数のライン
あるいは走査線をグループ化して、このグループを単位
として間引き画素数あるいはピクセル数を変化させてい
る。すなわち、グループＧ０の各ラインの画素数を例え
ばX00〜X0745の７４６画素とし、次のグループＧ１の各
ラインについてはそれぞれ２画素間引いて画素数を例え
ばX10〜X1743の７４４画素としている。以下、グループ
毎に間引き画素数を２画素ずつ増やしてゆき、グループ
Ｇ59では、元の７４６画素から１１８画素間引いて、例
えばX590〜X59627の６２８画素としている。
あるいは走査線をグループ化して、このグループを単位
として間引き画素数あるいはピクセル数を変化させてい
る。すなわち、グループＧ０の各ラインの画素数を例え
ばX00〜X0745の７４６画素とし、次のグループＧ１の各
ラインについてはそれぞれ２画素間引いて画素数を例え
ばX10〜X1743の７４４画素としている。以下、グループ
毎に間引き画素数を２画素ずつ増やしてゆき、グループ
Ｇ59では、元の７４６画素から１１８画素間引いて、例
えばX590〜X59627の６２８画素としている。
【００３７】このような画素データが書き込まれたメモ
リを読み出す際の一例を図１１に示す。
リを読み出す際の一例を図１１に示す。
【００３８】この図１１において、表示画像の各ライン
の中心が一致するように読み出しタイミングを制御して
おり、例えば、グループＧ０の各ラインの７４６サンプ
ルの画素データ読み出しに対して、次のグループＧ１の
各ラインの７４４サンプルの画素データは、読み出し開
始タイミングが１サンプル分遅れ、読み出し終了タイミ
ングが１サンプル分進んでいる。このように、１ライン
の画素データについての画面の左端に対応する読み出し
開始タイミングと、画面の右端に対応する読み出し終了
タイミングとを、同じ量だけ遅らせ、進ませることによ
り、そのラインの中心が常に他のラインの中心と一致す
ることになる。
の中心が一致するように読み出しタイミングを制御して
おり、例えば、グループＧ０の各ラインの７４６サンプ
ルの画素データ読み出しに対して、次のグループＧ１の
各ラインの７４４サンプルの画素データは、読み出し開
始タイミングが１サンプル分遅れ、読み出し終了タイミ
ングが１サンプル分進んでいる。このように、１ライン
の画素データについての画面の左端に対応する読み出し
開始タイミングと、画面の右端に対応する読み出し終了
タイミングとを、同じ量だけ遅らせ、進ませることによ
り、そのラインの中心が常に他のラインの中心と一致す
ることになる。
【００３９】このような歪補正処理がなされた映像信号
を液晶表示パネルに表示して光源からの光を透過させて
スクリーン上に投射することにより、前述したキースト
ーン歪が補正された画像を得ることができる。
を液晶表示パネルに表示して光源からの光を透過させて
スクリーン上に投射することにより、前述したキースト
ーン歪が補正された画像を得ることができる。
【００４０】すなわち、図１２のＡは、補正前の液晶表
示パネルに表示される画面の画素を模式的に示すもので
あり、長方形あるいは矩形の画素表示面をスクリーン上
に投射したとき、図１２のＢに示すような台形状に歪ん
だ画像が得られる。このようなキーストーン歪が生じて
いる状態で、上記キーストーン歪補正処理を施すことに
より、液晶表示パネル上に実際に表示される画像の表示
枠は、図１３のＡに示すように、下辺が短い台形となっ
て表れ、これをスクリーン上に投射したときの画像は、
図１３のＢに示すように、上下の辺の長さの揃った長方
形あるいは矩形状の表示枠となる。
示パネルに表示される画面の画素を模式的に示すもので
あり、長方形あるいは矩形の画素表示面をスクリーン上
に投射したとき、図１２のＢに示すような台形状に歪ん
だ画像が得られる。このようなキーストーン歪が生じて
いる状態で、上記キーストーン歪補正処理を施すことに
より、液晶表示パネル上に実際に表示される画像の表示
枠は、図１３のＡに示すように、下辺が短い台形となっ
て表れ、これをスクリーン上に投射したときの画像は、
図１３のＢに示すように、上下の辺の長さの揃った長方
形あるいは矩形状の表示枠となる。
【００４１】以上説明した本発明の実施例によれば、デ
ィジタル信号処理により走査線内の画素数を変化させ、
スクリーン上での上下の画像長さを揃え、投影された画
像が視覚的に歪まないようにしている。
ィジタル信号処理により走査線内の画素数を変化させ、
スクリーン上での上下の画像長さを揃え、投影された画
像が視覚的に歪まないようにしている。
【００４２】具体例として、水平面に対する最大投射角
が±２１．５度で、最大歪が約１６％のとき、歪の補正
としては、視覚的に目立たない２％以下の歪を無視する
ことにして、２％ステップで、＋１６、＋１４、＋１
２、＋１０、＋８、＋６、＋４、＋２、０、−２、−
４、−６、−８、−１０、−１２、−１４％の１５段階
で調整可能としている。
が±２１．５度で、最大歪が約１６％のとき、歪の補正
としては、視覚的に目立たない２％以下の歪を無視する
ことにして、２％ステップで、＋１６、＋１４、＋１
２、＋１０、＋８、＋６、＋４、＋２、０、−２、−
４、−６、−８、−１０、−１２、−１４％の１５段階
で調整可能としている。
【００４３】このように、電気的にキーストーン歪補正
を行うことにより、液晶プロジェクタ装置とスクリーン
との位置関係が、移動、設置条件により変化しても、簡
単に対応できる。また、光学的な補正が困難なような投
射角度が大きい条件、すなわち小さい部屋でも大きなス
クリーンサイズを必要とするような例えばホームシアタ
ー等の用途に使用する場合にも、キーストーン歪補正が
行える。
を行うことにより、液晶プロジェクタ装置とスクリーン
との位置関係が、移動、設置条件により変化しても、簡
単に対応できる。また、光学的な補正が困難なような投
射角度が大きい条件、すなわち小さい部屋でも大きなス
クリーンサイズを必要とするような例えばホームシアタ
ー等の用途に使用する場合にも、キーストーン歪補正が
行える。
【００４４】なお、本発明は上述の実施例のみに限定さ
れるものではなく、例えば、輝度信号と色差信号との組
み合せの代わりに、Ｒ、Ｇ、Ｂの３原色信号を用いてそ
れぞれに対して補間処理を行わせるようにしてもよい。
また、上記実施例はＡＳＩＣ等のハードウェア回路回路
として、あるいはマイクロプロセッサ、マイクロコンピ
ュータ、ディジタル信号プロセッサ等のプログラマブル
デバイスを用いて、あるいはハードウェア回路とプログ
ラマブルデバイスとの組み合せの装置により実現でき
る。
れるものではなく、例えば、輝度信号と色差信号との組
み合せの代わりに、Ｒ、Ｇ、Ｂの３原色信号を用いてそ
れぞれに対して補間処理を行わせるようにしてもよい。
また、上記実施例はＡＳＩＣ等のハードウェア回路回路
として、あるいはマイクロプロセッサ、マイクロコンピ
ュータ、ディジタル信号プロセッサ等のプログラマブル
デバイスを用いて、あるいはハードウェア回路とプログ
ラマブルデバイスとの組み合せの装置により実現でき
る。
【００４５】さらに、本発明の特定の実施例については
図面を参照しながら詳述したが、本発明はこれらの厳密
な実施例に限定されるものではなく、本発明の趣旨を逸
脱しない範囲で種々の変形や変更が行えることは勿論で
ある。
図面を参照しながら詳述したが、本発明はこれらの厳密
な実施例に限定されるものではなく、本発明の趣旨を逸
脱しない範囲で種々の変形や変更が行えることは勿論で
ある。
【００４６】
【発明の効果】以上の説明からも明らかなように、本発
明に係る液晶プロジェクタ装置は、光源からの光により
液晶表示パネルを照明し投射レンズを介してスクリーン
面上に投射する液晶プロジェクタ装置において、入力映
像信号から分離して得られる同期信号に基づいて入力映
像信号の走査線内の画素数を所定走査線数単位で変化さ
せることによりキーストーン歪を補正しているため、電
気的な信号処理により上記キーストーン歪の補正が行
え、スクリーンとの位置関係が変わっても簡単に対応で
き、光学的な対処が困難な投射角度が大きい条件でもキ
ーストーン歪の補正が行える。
明に係る液晶プロジェクタ装置は、光源からの光により
液晶表示パネルを照明し投射レンズを介してスクリーン
面上に投射する液晶プロジェクタ装置において、入力映
像信号から分離して得られる同期信号に基づいて入力映
像信号の走査線内の画素数を所定走査線数単位で変化さ
せることによりキーストーン歪を補正しているため、電
気的な信号処理により上記キーストーン歪の補正が行
え、スクリーンとの位置関係が変わっても簡単に対応で
き、光学的な対処が困難な投射角度が大きい条件でもキ
ーストーン歪の補正が行える。
【００４７】また、上記キーストーン歪の補正として、
入力映像信号の走査線内の画素の隣接画素間を直線補間
処理して画素数の間引き処理を行うことにより、演算量
を少なくすることができる。
入力映像信号の走査線内の画素の隣接画素間を直線補間
処理して画素数の間引き処理を行うことにより、演算量
を少なくすることができる。
【図１】本発明に係る液晶プロジェクタ装置の一実施例
の概略的な構成を示すブロック図である。
の概略的な構成を示すブロック図である。
【図２】液晶プロジェクタ装置に用いられるキーストー
ン歪補正回路の概略構成の一例を示すブロック回路図で
ある。
ン歪補正回路の概略構成の一例を示すブロック回路図で
ある。
【図３】キーストーン歪補正の際の直線近似による画素
間引き処理の動作を説明するための説明図である。
間引き処理の動作を説明するための説明図である。
【図４】直線補間の原理を説明するための図である。
【図５】輝度信号の補間回路の具体例を示す回路図であ
る。
る。
【図６】輝度信号の補間処理の具体例を説明するための
タイミングチャートである。
タイミングチャートである。
【図７】輝度信号の補間回路のより具体的な回路構成の
一例を示す回路図である。
一例を示す回路図である。
【図８】色差信号の補間回路の具体例を示す回路図であ
る。
る。
【図９】色差信号の補間処理の具体例を説明するための
タイミングチャートである。
タイミングチャートである。
【図１０】間引き及び補間処理されてメモリに書き込ま
れるデータを説明するためのタイミングチャートであ
る。
れるデータを説明するためのタイミングチャートであ
る。
【図１１】メモリから読み出されたデータを説明するた
めのタイミングチャートである。
めのタイミングチャートである。
【図１２】キーストーン歪補正前の映像信号を投射する
場合の液晶表示パネルでの表示画像及びスクリーン面上
での投影画像を示す図である。
場合の液晶表示パネルでの表示画像及びスクリーン面上
での投影画像を示す図である。
【図１３】キーストーン歪補正された映像信号を投射す
る場合の液晶表示パネルでの表示画像及びスクリーン面
上での投影画像を示す図である。
る場合の液晶表示パネルでの表示画像及びスクリーン面
上での投影画像を示す図である。
【図１４】キーストーン歪発生の原理を説明するための
図である。
図である。
【図１５】キーストーン歪を説明するための投影画像を
示す図である。
示す図である。
【図１６】キーストーン歪の発生を光学的に防止するた
めの原理を説明するための図である。
めの原理を説明するための図である。
１２ 同期分離及びＹ／Ｃ分離回路 １３ クロマデコーダ １４ キーストーン歪補正回路 １５ ＲＧＢデコーダ １６ ＬＣＤ駆動回路 １８Ｒ、１８Ｇ、１８Ｂ 液晶表示パネル １９ 投射レンズ ２４Ｙ、２４RY、２４BY 補間回路 ２５Ｙ、２５Ｃ メモリ ３３ 係数制御回路 ３４ 係数ＲＯＭ ３６ メモリ制御回路
Claims (3)
- 【請求項１】 光源からの光により液晶表示パネルを照
明し投射レンズを介してスクリーン面上に投射する液晶
プロジェクタ装置において、 入力映像信号から同期信号を分離する同期分離手段と、 上記同期分離手段からの同期信号に基づいて上記入力映
像信号の走査線内の画素数を所定走査線数単位で変化さ
せることによりキーストーン歪を補正するキーストーン
歪補正手段と、 このキーストーン歪補正手段により歪補正された映像信
号を上記液晶表示パネル上に表示駆動する液晶表示駆動
手段とを有して成ることを特徴とする液晶プロジェクタ
装置。 - 【請求項２】 上記入力映像信号は複合カラー映像信号
であり、この入力信号を輝度信号とクロマ信号とに分離
して上記キーストーン歪補正手段によりそれぞれ補正処
理することを特徴とする請求項１記載の液晶プロジェク
タ装置。 - 【請求項３】 上記キーストーン歪補正手段は、入力映
像信号の走査線内の画素の隣接画素間を直線補間処理す
ることにより画素数の間引き処理を行うことを特徴とす
る請求項１又は２記載の液晶プロジェクタ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23903494A JPH08102900A (ja) | 1994-10-03 | 1994-10-03 | 液晶プロジェクタ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23903494A JPH08102900A (ja) | 1994-10-03 | 1994-10-03 | 液晶プロジェクタ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08102900A true JPH08102900A (ja) | 1996-04-16 |
Family
ID=17038899
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23903494A Withdrawn JPH08102900A (ja) | 1994-10-03 | 1994-10-03 | 液晶プロジェクタ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08102900A (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1058452A1 (en) * | 1998-02-18 | 2000-12-06 | Seiko Epson Corporation | Image processing device and image processing method |
| KR100308579B1 (ko) * | 1999-03-25 | 2001-09-26 | 구자홍 | 엘씨디(ｌｃｄ)프로젝터의 키이스톤 왜곡 보정을 위한 수평주사율 변환장치 |
| KR20020000940A (ko) * | 2000-06-22 | 2002-01-09 | 구자홍 | 키스톤 보정 장치 및 방법 |
| US6609797B2 (en) | 1999-01-29 | 2003-08-26 | Ricoh Co., Ltd | Projector with adjustably positioned image plate |
| KR100618177B1 (ko) * | 2004-03-30 | 2006-08-31 | 세이코 엡슨 가부시키가이샤 | 프로젝터의 사다리꼴 보정 |
| JP2009188982A (ja) * | 2008-01-08 | 2009-08-20 | Mitsubishi Electric Corp | 画像処理装置、画像表示装置、及び画像処理方法 |
| JP2009251547A (ja) * | 2008-04-11 | 2009-10-29 | Seiko Epson Corp | プロジェクタおよびその制御方法 |
| US8422812B2 (en) | 2008-01-08 | 2013-04-16 | Mitsubishi Electric Corporation | Image processor and method therefor, and image display device |
| US8497873B2 (en) | 2009-03-26 | 2013-07-30 | Mitsubishi Electric Corporation | Apparatus and method for correction of projected images |
| US8675998B2 (en) | 2007-12-06 | 2014-03-18 | Mitsubishi Electric Corporation | Method and apparatus for high frequency component smoothing, and image display apparatus |
-
1994
- 1994-10-03 JP JP23903494A patent/JPH08102900A/ja not_active Withdrawn
Cited By (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1058452A1 (en) * | 1998-02-18 | 2000-12-06 | Seiko Epson Corporation | Image processing device and image processing method |
| EP1058452A4 (en) * | 1998-02-18 | 2005-05-11 | Seiko Epson Corp | IMAGE PROCESSING DEVICE AND METHOD |
| US6609797B2 (en) | 1999-01-29 | 2003-08-26 | Ricoh Co., Ltd | Projector with adjustably positioned image plate |
| KR100308579B1 (ko) * | 1999-03-25 | 2001-09-26 | 구자홍 | 엘씨디(ｌｃｄ)프로젝터의 키이스톤 왜곡 보정을 위한 수평주사율 변환장치 |
| KR20020000940A (ko) * | 2000-06-22 | 2002-01-09 | 구자홍 | 키스톤 보정 장치 및 방법 |
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| US8675998B2 (en) | 2007-12-06 | 2014-03-18 | Mitsubishi Electric Corporation | Method and apparatus for high frequency component smoothing, and image display apparatus |
| JP2009188982A (ja) * | 2008-01-08 | 2009-08-20 | Mitsubishi Electric Corp | 画像処理装置、画像表示装置、及び画像処理方法 |
| JP4569697B2 (ja) * | 2008-01-08 | 2010-10-27 | 三菱電機株式会社 | 画像処理装置、画像表示装置、及び画像処理方法 |
| US8422812B2 (en) | 2008-01-08 | 2013-04-16 | Mitsubishi Electric Corporation | Image processor and method therefor, and image display device |
| JP2009251547A (ja) * | 2008-04-11 | 2009-10-29 | Seiko Epson Corp | プロジェクタおよびその制御方法 |
| US8497873B2 (en) | 2009-03-26 | 2013-07-30 | Mitsubishi Electric Corporation | Apparatus and method for correction of projected images |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20020115 |