JPH07321578A - Ａｇｃ回路 - Google Patents
Ａｇｃ回路Info
- Publication number
- JPH07321578A JPH07321578A JP10724794A JP10724794A JPH07321578A JP H07321578 A JPH07321578 A JP H07321578A JP 10724794 A JP10724794 A JP 10724794A JP 10724794 A JP10724794 A JP 10724794A JP H07321578 A JPH07321578 A JP H07321578A
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- voltage comparator
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Abstract
(57)【要約】
【目的】 スペクトル拡散変調信号復調器のＡＧＣ回路
ループを短時間でを安定させることができるものを提供
すること。 【構成】 電圧比較器の出力をデジタルデータに変換す
るＡ／Ｄ変換器と、前記Ａ／Ｄ変換器の出力を記憶する
メモリと、前記メモリからのデータをアナログ信号に変
換するＤ／Ａ変換器と、前記Ｄ／Ａ変換器の出力と前記
電圧比較器の出力を切り換える切換器と、前記Ａ／Ｄ変
換器、メモリ、Ｄ／Ａ変換器、切換器を制御する制御部
とを設け、初期設定時に、前記切換器を前記電圧比較器
側にし、選局時に、前記切換器を前記Ｄ／Ａ変換器側に
切り換えるように構成する。
ループを短時間でを安定させることができるものを提供
すること。 【構成】 電圧比較器の出力をデジタルデータに変換す
るＡ／Ｄ変換器と、前記Ａ／Ｄ変換器の出力を記憶する
メモリと、前記メモリからのデータをアナログ信号に変
換するＤ／Ａ変換器と、前記Ｄ／Ａ変換器の出力と前記
電圧比較器の出力を切り換える切換器と、前記Ａ／Ｄ変
換器、メモリ、Ｄ／Ａ変換器、切換器を制御する制御部
とを設け、初期設定時に、前記切換器を前記電圧比較器
側にし、選局時に、前記切換器を前記Ｄ／Ａ変換器側に
切り換えるように構成する。
Description
【０００１】
【産業上の利用分野】本発明は、スペクトラム拡散変調
を用いた無線通信機のＡＧＣ回路に関する。
を用いた無線通信機のＡＧＣ回路に関する。
【０００２】
【従来の技術】従来、スペクトル拡散変調用受信器に用
いられている相関検出をおこなうタイプのＡＧＣ回路と
しては、図２に示すように、ＡＧＣのループ回路からの
制御電圧に応じたゲインにより可変ゲインアンプ１が入
力信号を増幅してミキサ２に出力し、ミキサ２は入力し
た信号をＩＦ周波数に変換し、アンプ３によって所要の
レベルに増幅してＳＡＷマッチドフィルタ５の入力端子
４に入力し、ＳＡＷマッチドフィルタ５は、入力信号の
ＰＮパターンと自己パターンとの相関検出をおこなって
検出信号を出力し、前記検出信号を遅延回路６と乗算器
７によって遅延検波し、ローパスフィルタ８を通過させ
て高周波成分を減衰してデータ信号波形を抽出すると共
に、絶対値回路９は、ローパスフィルタ８の出力信号の
絶対値を抽出してピーク検波器１０に入力し、ピーク検
波器１０は、入力信号のピーク値を検出して電圧比較器
１１に入力し、電圧比較器１１は、入力信号と基準電圧
レベルとを比較し、アンテナから入力した信号が適性レ
ベルよりも小さい場合は、例えば「負」の電圧を出力
し、適性レベルより大きければ「正」の電圧を出力し、
適性レベルであれば、出力は０ボルトを出力する。電圧
レベル変換器１２は、電圧比較器１１の出力をアンプ１
が動作可能な所要の電圧に変換して可変ゲインアンプ１
のゲインコントロール端子１３に入力し、可変ゲインア
ンプ１のゲインを大きく、あるいは、小さくするように
してＡＧＣ回路を構成するようにしていた。しかしなが
ら、上記の構成のＡＧＣ回路は、ＳＡＷマッチドフィル
タ５を含めて一連のループを形成しているため、受信信
号がアンプに入力されてからＡＧＣ回路のループが安定
するまでに多くの時間がかかるという問題を有してい
た。
いられている相関検出をおこなうタイプのＡＧＣ回路と
しては、図２に示すように、ＡＧＣのループ回路からの
制御電圧に応じたゲインにより可変ゲインアンプ１が入
力信号を増幅してミキサ２に出力し、ミキサ２は入力し
た信号をＩＦ周波数に変換し、アンプ３によって所要の
レベルに増幅してＳＡＷマッチドフィルタ５の入力端子
４に入力し、ＳＡＷマッチドフィルタ５は、入力信号の
ＰＮパターンと自己パターンとの相関検出をおこなって
検出信号を出力し、前記検出信号を遅延回路６と乗算器
７によって遅延検波し、ローパスフィルタ８を通過させ
て高周波成分を減衰してデータ信号波形を抽出すると共
に、絶対値回路９は、ローパスフィルタ８の出力信号の
絶対値を抽出してピーク検波器１０に入力し、ピーク検
波器１０は、入力信号のピーク値を検出して電圧比較器
１１に入力し、電圧比較器１１は、入力信号と基準電圧
レベルとを比較し、アンテナから入力した信号が適性レ
ベルよりも小さい場合は、例えば「負」の電圧を出力
し、適性レベルより大きければ「正」の電圧を出力し、
適性レベルであれば、出力は０ボルトを出力する。電圧
レベル変換器１２は、電圧比較器１１の出力をアンプ１
が動作可能な所要の電圧に変換して可変ゲインアンプ１
のゲインコントロール端子１３に入力し、可変ゲインア
ンプ１のゲインを大きく、あるいは、小さくするように
してＡＧＣ回路を構成するようにしていた。しかしなが
ら、上記の構成のＡＧＣ回路は、ＳＡＷマッチドフィル
タ５を含めて一連のループを形成しているため、受信信
号がアンプに入力されてからＡＧＣ回路のループが安定
するまでに多くの時間がかかるという問題を有してい
た。
【０００３】
【発明が解決しようとする課題】上記のように、アンテ
ナで受信した入力信号のレベルによってＡＧＣアンプの
ゲインをコントロールするように構成されたＡＧＣ回路
は、アンテナからの受信信号がアンプ等に入力されてか
らＡＧＣ回路のループが安定するまでに多くの時間を必
要とするという問題を有していたので、本発明において
は短時間でＡＧＣ回路のループを安定させることができ
るＡＧＣ回路を提供することにある。
ナで受信した入力信号のレベルによってＡＧＣアンプの
ゲインをコントロールするように構成されたＡＧＣ回路
は、アンテナからの受信信号がアンプ等に入力されてか
らＡＧＣ回路のループが安定するまでに多くの時間を必
要とするという問題を有していたので、本発明において
は短時間でＡＧＣ回路のループを安定させることができ
るＡＧＣ回路を提供することにある。
【０００４】
【課題を解決するための手段】受信したＰＳＫ信号を増
幅するＲＦアンプと、前記ＲＦアンプの出力をＩＦ信号
に変換するミキサと、前記ＩＦ信号の相関を検出し、相
関信号を出力するＳＡＷマッチドフィルタと、前記相関
信号を遅延検波する遅延検波器と、前記遅延検波した信
号を濾波するローパスフィルタと、前記ローパスフィル
タ出力の絶対値を抽出する絶対値回路と、前記絶対値回
路の出力をピーク検波するピーク検波器と、前記ピーク
検波器の出力レベルを比較する電圧比較器とで構成さ
れ、前記電圧比較器の出力によって前記ＲＦアンプのゲ
インを制御するようにしたスペクトル拡散変調信号用復
調器のＡＧＣ回路において、前記電圧比較器の出力をデ
ジタルデータに変換するＡ／Ｄ変換器と、前記Ａ／Ｄ変
換器の出力を記憶するメモリと、前記メモリからのデー
タをアナログ信号に変換するＤ／Ａ変換器と、前記Ｄ／
Ａ変換器の出力と前記電圧比較器の出力を切り換える切
換器と、前記Ａ／Ｄ変換器、メモリ、Ｄ／Ａ変換器、切
換器を制御する制御部とを設け、初期設定時に、前記切
換器を前記電圧比較器側にし、選局時に、前記切換器を
前記Ｄ／Ａ変換器側に切り換えるように構成したことを
特徴とする。
幅するＲＦアンプと、前記ＲＦアンプの出力をＩＦ信号
に変換するミキサと、前記ＩＦ信号の相関を検出し、相
関信号を出力するＳＡＷマッチドフィルタと、前記相関
信号を遅延検波する遅延検波器と、前記遅延検波した信
号を濾波するローパスフィルタと、前記ローパスフィル
タ出力の絶対値を抽出する絶対値回路と、前記絶対値回
路の出力をピーク検波するピーク検波器と、前記ピーク
検波器の出力レベルを比較する電圧比較器とで構成さ
れ、前記電圧比較器の出力によって前記ＲＦアンプのゲ
インを制御するようにしたスペクトル拡散変調信号用復
調器のＡＧＣ回路において、前記電圧比較器の出力をデ
ジタルデータに変換するＡ／Ｄ変換器と、前記Ａ／Ｄ変
換器の出力を記憶するメモリと、前記メモリからのデー
タをアナログ信号に変換するＤ／Ａ変換器と、前記Ｄ／
Ａ変換器の出力と前記電圧比較器の出力を切り換える切
換器と、前記Ａ／Ｄ変換器、メモリ、Ｄ／Ａ変換器、切
換器を制御する制御部とを設け、初期設定時に、前記切
換器を前記電圧比較器側にし、選局時に、前記切換器を
前記Ｄ／Ａ変換器側に切り換えるように構成したことを
特徴とする。
【０００５】
【作用】以上のように構成したので、本発明によるＡＧ
Ｃ回路は初期設定において、切換器の切換端子を電圧レ
ベル変換器の出力側に切り換え、ＡＧＣアンプのゲイン
コントロール端子に電圧レベル変換器の出力が印加され
るようにし、制御部はメモリのアドレスを前記識別デー
タに対応する局のメモリ領域に設定して指定局番からの
電波を受信し、ＡＧＣループが安定した時点の電圧レベ
ル変換器の出力をＡ／Ｄ変換器によってＡ／Ｄ変換して
メモリに記憶し、上記の操作を所要の局番ごとに繰り返
して局番ごとに電圧レベル変換器の適正な出力レベルの
データをメモリに記憶し、特定の局を受信に際しては、
制御部はメモリから対応する局番のデータを読み出し、
切換器をＤ／Ａ変換側に切り換え、Ｄ／Ａ変換器からの
アナログデータをＡＧＣアンプのゲインコントロール端
子に印加してＡＧＣアンプのゲインをコントロールす
る。
Ｃ回路は初期設定において、切換器の切換端子を電圧レ
ベル変換器の出力側に切り換え、ＡＧＣアンプのゲイン
コントロール端子に電圧レベル変換器の出力が印加され
るようにし、制御部はメモリのアドレスを前記識別デー
タに対応する局のメモリ領域に設定して指定局番からの
電波を受信し、ＡＧＣループが安定した時点の電圧レベ
ル変換器の出力をＡ／Ｄ変換器によってＡ／Ｄ変換して
メモリに記憶し、上記の操作を所要の局番ごとに繰り返
して局番ごとに電圧レベル変換器の適正な出力レベルの
データをメモリに記憶し、特定の局を受信に際しては、
制御部はメモリから対応する局番のデータを読み出し、
切換器をＤ／Ａ変換側に切り換え、Ｄ／Ａ変換器からの
アナログデータをＡＧＣアンプのゲインコントロール端
子に印加してＡＧＣアンプのゲインをコントロールす
る。
【０００６】
【実施例】以下図に基づいて本発明によるスペクトル拡
散用ＡＧＣ回路の一実施例を詳細に説明する。図１にお
いて、入力されたＰＳＫ信号を可変ゲインアンプ１に入
力し、ミキサ２でＩＦ信号に変換し、さらに、アンプ３
で増幅し、ＳＡＷマッチドフィルタ５の入力端子４に入
力し、ＳＡＷマッチドフィルタ５から出力される相関信
号を遅延回路６と乗算器７によって遅延検波し、ローパ
スフィルタ８を通過させ、絶対値回路９がローパスフィ
ルタ８の信号波形の絶対値を抽出し、ピーク検波器１０
でピーク検波し、電圧比較器１１が基準信号と比較し、
電圧レベル変換器１２から出力された電圧レベルを切換
器１３の固定端子１４に入力すると共にＡ／Ｄ変換器１
５に入力し、Ａ／Ｄ変換器１５の出力は制御部１７によ
ってメモリ１６に書き込み、制御部１７によってメモリ
１６から読み出したデータをＤ／Ａ変換器１８に出力
し、Ｄ／Ａ変換器１８の出力を切換器１３の固定端子１
９に入力する。切換器１３の切換端子２０はアンプ１の
ゲインコントロール端子２１に入力し、選局部２２の出
力は制御部１７に入力するようにする。
散用ＡＧＣ回路の一実施例を詳細に説明する。図１にお
いて、入力されたＰＳＫ信号を可変ゲインアンプ１に入
力し、ミキサ２でＩＦ信号に変換し、さらに、アンプ３
で増幅し、ＳＡＷマッチドフィルタ５の入力端子４に入
力し、ＳＡＷマッチドフィルタ５から出力される相関信
号を遅延回路６と乗算器７によって遅延検波し、ローパ
スフィルタ８を通過させ、絶対値回路９がローパスフィ
ルタ８の信号波形の絶対値を抽出し、ピーク検波器１０
でピーク検波し、電圧比較器１１が基準信号と比較し、
電圧レベル変換器１２から出力された電圧レベルを切換
器１３の固定端子１４に入力すると共にＡ／Ｄ変換器１
５に入力し、Ａ／Ｄ変換器１５の出力は制御部１７によ
ってメモリ１６に書き込み、制御部１７によってメモリ
１６から読み出したデータをＤ／Ａ変換器１８に出力
し、Ｄ／Ａ変換器１８の出力を切換器１３の固定端子１
９に入力する。切換器１３の切換端子２０はアンプ１の
ゲインコントロール端子２１に入力し、選局部２２の出
力は制御部１７に入力するようにする。
【０００７】次に上記の構成からなるＡＧＣ回路の各部
の動作を説明する。可変ゲインアンプ１は、ＡＧＣのル
ープ回路からの制御電圧に応じたゲインコントロール信
号により入力信号のゲインをコントロールして出力し、
ミキサ２は、アンプ１から入力した信号をＩＦ周波数に
変換し、アンプ３は、ＳＡＷマッチドフィルタ５が相関
信号を出力できるに必要な所要のレベルの信号に増幅
し、ＳＡＷマッチドフィルタ５は、受信したＰＮパター
ンと自己パターンとの一致を判別するための相関検出を
おこない、前記相関検出された信号は遅延回路６によっ
て遅延されて乗算器７の一方の入力端子に入力され、乗
算器７の他方の入力端子に入力された非遅延信号と乗算
されることによって遅延検波される。ローパスフィルタ
８は前記遅延検波信号の高周波成分を減衰させることに
よって得られるエンベロープ波形から送信されたデータ
信号波形を抽出し、クロックを生成するため、絶対値回
路９は入力された信号の絶対値を抽出してピーク検波器
１０に入力し、ピーク検波器１０は、絶対値回路９の出
力のピーク値を検出して電圧比較器１１に出力し、電圧
比較器１１は入力信号と基準電圧レベルとを比較し、ア
ンテナから入力された信号が適性レベルよりも小さい場
合は、例えば、「負」の電圧を出力し、適性レベルより
大きければ「正」の電圧を出力し、適性レベルであれ
ば、出力は０ボルトを出力する。電圧レベル変換器１２
は、電圧比較器１１の出力によって可変ゲインアンプ１
のゲインコントロール信号を動作可能な電圧帯まで変換
して可変ゲインアンプ１にフィードバックし、可変ゲイ
ンアンプ１のゲインを大きく、あるいは、小さくする。
の動作を説明する。可変ゲインアンプ１は、ＡＧＣのル
ープ回路からの制御電圧に応じたゲインコントロール信
号により入力信号のゲインをコントロールして出力し、
ミキサ２は、アンプ１から入力した信号をＩＦ周波数に
変換し、アンプ３は、ＳＡＷマッチドフィルタ５が相関
信号を出力できるに必要な所要のレベルの信号に増幅
し、ＳＡＷマッチドフィルタ５は、受信したＰＮパター
ンと自己パターンとの一致を判別するための相関検出を
おこない、前記相関検出された信号は遅延回路６によっ
て遅延されて乗算器７の一方の入力端子に入力され、乗
算器７の他方の入力端子に入力された非遅延信号と乗算
されることによって遅延検波される。ローパスフィルタ
８は前記遅延検波信号の高周波成分を減衰させることに
よって得られるエンベロープ波形から送信されたデータ
信号波形を抽出し、クロックを生成するため、絶対値回
路９は入力された信号の絶対値を抽出してピーク検波器
１０に入力し、ピーク検波器１０は、絶対値回路９の出
力のピーク値を検出して電圧比較器１１に出力し、電圧
比較器１１は入力信号と基準電圧レベルとを比較し、ア
ンテナから入力された信号が適性レベルよりも小さい場
合は、例えば、「負」の電圧を出力し、適性レベルより
大きければ「正」の電圧を出力し、適性レベルであれ
ば、出力は０ボルトを出力する。電圧レベル変換器１２
は、電圧比較器１１の出力によって可変ゲインアンプ１
のゲインコントロール信号を動作可能な電圧帯まで変換
して可変ゲインアンプ１にフィードバックし、可変ゲイ
ンアンプ１のゲインを大きく、あるいは、小さくする。
【０００８】本発明によるＡＧＣ回路のゲインコントロ
ールの方法は、初期設定において、切換器の切換端子２
０を固定端子１４の側にし、アンプ１のゲインコントロ
ール端子２１に電圧レベル変換器１２の出力が印加され
るようにし、所定の指定局番からの電波が受信できるよ
うに受信機をセットし、その局番を識別する識別データ
を選局部２２から制御部１７に入力し、制御部１７はメ
モリ１６のアドレスを前記識別データに対応する局のメ
モリ領域に設定し、指定局番からの電波を受信すること
によってＡＧＣループが安定した時点の電圧レベル変換
器１２の出力をＡ／Ｄ変換器１５によってＡ／Ｄ変換
し、メモリ１６に記憶する。上記の操作を所要の局番ご
とに繰り返し、メモリ１５にそれぞれの局番ごとの適正
なゲインコントロール用電圧レベルのデータが記憶され
る。
ールの方法は、初期設定において、切換器の切換端子２
０を固定端子１４の側にし、アンプ１のゲインコントロ
ール端子２１に電圧レベル変換器１２の出力が印加され
るようにし、所定の指定局番からの電波が受信できるよ
うに受信機をセットし、その局番を識別する識別データ
を選局部２２から制御部１７に入力し、制御部１７はメ
モリ１６のアドレスを前記識別データに対応する局のメ
モリ領域に設定し、指定局番からの電波を受信すること
によってＡＧＣループが安定した時点の電圧レベル変換
器１２の出力をＡ／Ｄ変換器１５によってＡ／Ｄ変換
し、メモリ１６に記憶する。上記の操作を所要の局番ご
とに繰り返し、メモリ１５にそれぞれの局番ごとの適正
なゲインコントロール用電圧レベルのデータが記憶され
る。
【０００９】特定の局の選局時には、制御部１７に選局
部２２から局番識別データを入力され、制御部１７はメ
モリ１６から前記局番識別データに対応するデータを読
みだし、Ｄ／Ａ変換器１８によってＤ／Ａ変換し、切換
器の切換端子２０を固定端子１９の側に切り換え、Ｄ／
Ａ変換１８の出力をアンプ１のゲインコントロール端子
２１に印加してアンプ１のゲインをコントロールする。
尚、ループが安定し、電圧レベル変換器１２の出力によ
ってＡＧＣを動作させる方法として、制御部１７にタイ
マーを接続し、選局と同時に前記タイマーが時間のカウ
ントを開始し、制御部１７が前記タイマーからの出力に
よって所定の時間経過したことを判別し、前記切換器の
切換端子を電圧レベル変換器１２の出力側に切り換える
ようしてもよい。あるいは、選局時に、前記制御部によ
って、前記Ｄ／Ａ変換器の出力の安定することを監視
し、安定した時点で前記切換器の切換端子を電圧レベル
変換器１２の出力側に切り換えるようにしてもよい。
部２２から局番識別データを入力され、制御部１７はメ
モリ１６から前記局番識別データに対応するデータを読
みだし、Ｄ／Ａ変換器１８によってＤ／Ａ変換し、切換
器の切換端子２０を固定端子１９の側に切り換え、Ｄ／
Ａ変換１８の出力をアンプ１のゲインコントロール端子
２１に印加してアンプ１のゲインをコントロールする。
尚、ループが安定し、電圧レベル変換器１２の出力によ
ってＡＧＣを動作させる方法として、制御部１７にタイ
マーを接続し、選局と同時に前記タイマーが時間のカウ
ントを開始し、制御部１７が前記タイマーからの出力に
よって所定の時間経過したことを判別し、前記切換器の
切換端子を電圧レベル変換器１２の出力側に切り換える
ようしてもよい。あるいは、選局時に、前記制御部によ
って、前記Ｄ／Ａ変換器の出力の安定することを監視
し、安定した時点で前記切換器の切換端子を電圧レベル
変換器１２の出力側に切り換えるようにしてもよい。
【００１０】
【発明の効果】以上に説明したように、本発明によるＡ
ＧＣ回路によれば、それぞれの局番ごとのゲインコント
ロール信号のレベルをＡＧＣのゲインコントロールデー
タとして予めメモリに記憶し、選択した局番に対応する
ＡＧＣのゲインコントロールデータを読み出してＡＧＣ
アンプに印加するようにしてので、選局と同時に、ただ
ちにＡＧＣがかり、適正なゲインコントロールがなされ
るので、ループが安定するのを待つための待ち時間を著
しく短縮することができる。
ＧＣ回路によれば、それぞれの局番ごとのゲインコント
ロール信号のレベルをＡＧＣのゲインコントロールデー
タとして予めメモリに記憶し、選択した局番に対応する
ＡＧＣのゲインコントロールデータを読み出してＡＧＣ
アンプに印加するようにしてので、選局と同時に、ただ
ちにＡＧＣがかり、適正なゲインコントロールがなされ
るので、ループが安定するのを待つための待ち時間を著
しく短縮することができる。
【図１】本発明によるＡＧＣ回路のブロック図である。
【図２】従来のＡＧＣ回路のブロック図である。
１ アンプ ２ ミキサ ３ アンプ ４ リミッタ ５ ＳＡＷマッチドフィルタ ６ 遅延回路 ７ 乗算器 ８ ローパスフィルタ ９ 絶対値回路
Claims (3)
- 【請求項１】 受信したＰＳＫ信号を増幅するＲＦアン
プと、前記ＲＦアンプの出力をＩＦ信号に変換するミキ
サと、前記ＩＦ信号の相関を検出し、相関信号を出力す
るＳＡＷマッチドフィルタと、前記相関信号を遅延検波
する遅延検波器と、前記遅延検波した信号を濾波するロ
ーパスフィルタと、前記ローパスフィルタ出力の絶対値
を抽出する絶対値回路と、前記絶対値回路の出力をピー
ク検波するピーク検波器と、前記ピーク検波器の出力レ
ベルを比較する電圧比較器とで構成され、前記電圧比較
器の出力によって前記ＲＦアンプのゲインを制御するよ
うにしたスペクトル拡散変調信号用復調器のＡＧＣ回路
において、前記電圧比較器の出力をデジタルデータに変
換するＡ／Ｄ変換器と、前記Ａ／Ｄ変換器の出力を記憶
するメモリと、前記メモリからのデータをアナログ信号
に変換するＤ／Ａ変換器と、前記Ｄ／Ａ変換器の出力と
前記電圧比較器の出力を切り換える切換器と、前記Ａ／
Ｄ変換器、メモリ、Ｄ／Ａ変換器、切換器を制御する制
御部とを設け、初期設定時に、前記切換器を前記電圧比
較器側にし、選局時に、前記切換器を前記Ｄ／Ａ変換器
側に切り換えるように構成したことを特徴とするＡＧＣ
回路。 - 【請求項２】 選局時に、タイマーが所要の時間になっ
たことを検出し、前記切換器を前記電圧比較器側に切り
換えるようにしたことを特徴とする請求項２記載のＡＧ
Ｃ回路。 - 【請求項３】 選局時に、前記電圧比較器の出力レベル
が所要のレベルに達したことを検出し、前記切換器を前
記電圧比較器側に切り換えるようにしたことを特徴とす
る請求項２記載のＡＧＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10724794A JPH07321578A (ja) | 1994-05-20 | 1994-05-20 | Ａｇｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10724794A JPH07321578A (ja) | 1994-05-20 | 1994-05-20 | Ａｇｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07321578A true JPH07321578A (ja) | 1995-12-08 |
Family
ID=14454217
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10724794A Pending JPH07321578A (ja) | 1994-05-20 | 1994-05-20 | Ａｇｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07321578A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN105048981A (zh) * | 2015-06-12 | 2015-11-11 | 杭州永川科技有限公司 | 一种超低相位抖动的高精度信号数字化装置及方法 |
-
1994
- 1994-05-20 JP JP10724794A patent/JPH07321578A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN105048981A (zh) * | 2015-06-12 | 2015-11-11 | 杭州永川科技有限公司 | 一种超低相位抖动的高精度信号数字化装置及方法 |
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