JPH071773A - ダウン・ロード・データの収容制御装置 - Google Patents
ダウン・ロード・データの収容制御装置Info
- Publication number
- JPH071773A JPH071773A JP14649792A JP14649792A JPH071773A JP H071773 A JPH071773 A JP H071773A JP 14649792 A JP14649792 A JP 14649792A JP 14649792 A JP14649792 A JP 14649792A JP H071773 A JPH071773 A JP H071773A
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- JP
- Japan
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- data
- memory
- registration
- control device
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Abstract
(57)【要約】
【目的】 登録データ（ダウン・ロード・データ）をメ
モリの連続的なアドレスに収容することができるダウン
・ロード・データの収容制御装置を提供する。 【構成】 ホスト装置１からの２種類の受信データを１
つのメモリ２４にダウン・ロードし、その後このダウン
・ロードされたデータを読み出して印字機構部２７より
印字出力するプリンタ２におけるダウン・ロード・デー
タの収容制御装置において、２種類の受信データのう
ち、いずれか一方を前記メモリ２４の番号の小さいエリ
アから順に連続して書き込む登録処理を行い、他方を前
記メモリ２４の最大番地から少なくなる方向に向かって
順に連続して書き込む登録処理を行い、かつ、新受信デ
ータは対応する前受信データを書き換えて登録処理する
制御手段２１を備えた。
モリの連続的なアドレスに収容することができるダウン
・ロード・データの収容制御装置を提供する。 【構成】 ホスト装置１からの２種類の受信データを１
つのメモリ２４にダウン・ロードし、その後このダウン
・ロードされたデータを読み出して印字機構部２７より
印字出力するプリンタ２におけるダウン・ロード・デー
タの収容制御装置において、２種類の受信データのう
ち、いずれか一方を前記メモリ２４の番号の小さいエリ
アから順に連続して書き込む登録処理を行い、他方を前
記メモリ２４の最大番地から少なくなる方向に向かって
順に連続して書き込む登録処理を行い、かつ、新受信デ
ータは対応する前受信データを書き換えて登録処理する
制御手段２１を備えた。
Description
【０００１】
【０００１】
【０００２】
【産業上の利用分野】本発明は、ホスト装置からの２種
類の受信データを１つのメモリにダウン・ロードする際
のダウン・ロード・データのメモリへの収容制御装置に
関する。
類の受信データを１つのメモリにダウン・ロードする際
のダウン・ロード・データのメモリへの収容制御装置に
関する。
【０００３】
【０００２】
【０００４】
【従来の技術】一般にプリンタにおいては、外部ホスト
から、予め定めた文字コードとそれに対応するフォント
・データを複数個ダウン・ロードしておき（外字登録機
能）、その後文字コードを指定することにより対応する
フォント・データを文字にして印字する機能（外字印字
機能）と、予め定めたフォーム番号とそれに対応する印
字データ（印字コードの集合）を複数個ダウン・ロード
しておき（フォーム登録機能）、その後フォーム番号を
指定することにより対応するフォーム・データ（印字コ
ードの集合）を文字として印字する機能（フォーム参照
機能）を持っており、文字およびフォント・データから
なる外字登録データと、フォーム番号および印字データ
からなるフォーム登録データのいずれも、前にダウン・
ロードしたデータを破棄して、後から新しいデータをダ
ウン・ロードすることが可能になっている。
から、予め定めた文字コードとそれに対応するフォント
・データを複数個ダウン・ロードしておき（外字登録機
能）、その後文字コードを指定することにより対応する
フォント・データを文字にして印字する機能（外字印字
機能）と、予め定めたフォーム番号とそれに対応する印
字データ（印字コードの集合）を複数個ダウン・ロード
しておき（フォーム登録機能）、その後フォーム番号を
指定することにより対応するフォーム・データ（印字コ
ードの集合）を文字として印字する機能（フォーム参照
機能）を持っており、文字およびフォント・データから
なる外字登録データと、フォーム番号および印字データ
からなるフォーム登録データのいずれも、前にダウン・
ロードしたデータを破棄して、後から新しいデータをダ
ウン・ロードすることが可能になっている。
【０００５】
【０００３】ところで、外字登録データとフォーム登録
データの最大量を決めて別個のメモリに格納した場合
は、使うかどうか分からないメモリを大量に持たなけれ
ばならず不経済である。そのため、両登録データの個々
のデータ量は制限せずに、合計データ量のみ制限し、１
つのメモリに両登録データをダウン・ロード（格納）し
ていた。
データの最大量を決めて別個のメモリに格納した場合
は、使うかどうか分からないメモリを大量に持たなけれ
ばならず不経済である。そのため、両登録データの個々
のデータ量は制限せずに、合計データ量のみ制限し、１
つのメモリに両登録データをダウン・ロード（格納）し
ていた。
【０００６】
【０００４】図１、図２、図３は従来例に係るダウン・
ロード・データの収容エリアを示す模式図であり、図１
に示すように、ホスト装置からまず外字登録データが送
られてくると、メモリのゼロ番地（図の左端）のエリア
から連続して書き込み、次にフォーム登録データが送ら
れてくると、外字登録データに引き続く番地のエリアか
ら書き込みが開始される。この時、図の右側（番地の大
きい方の側）のエリアに空きが生じている。
ロード・データの収容エリアを示す模式図であり、図１
に示すように、ホスト装置からまず外字登録データが送
られてくると、メモリのゼロ番地（図の左端）のエリア
から連続して書き込み、次にフォーム登録データが送ら
れてくると、外字登録データに引き続く番地のエリアか
ら書き込みが開始される。この時、図の右側（番地の大
きい方の側）のエリアに空きが生じている。
【０００７】
【０００５】この状態で、前の外字登録データよりデー
タ量の大きい新外字登録データが送られてくると、図２
あるいは図３に示すように、外字登録データが新データ
に書き換えられる。図２に示す書き換え制御は、まず、
前外字登録データのエリア部分（図１に示すエリア）に
新外字登録データの前半部（１／２）を書き込み、即
ち、前外字登録データを新外字登録データの前半部（１
／２）に書き換え、新外字登録データの後半部（２／
２）は空きエリア（図１に示す空きエリア）部分に書き
込む方式である。従ってデータ量によっては、右端部に
空きエリアが発生する場合がある。
タ量の大きい新外字登録データが送られてくると、図２
あるいは図３に示すように、外字登録データが新データ
に書き換えられる。図２に示す書き換え制御は、まず、
前外字登録データのエリア部分（図１に示すエリア）に
新外字登録データの前半部（１／２）を書き込み、即
ち、前外字登録データを新外字登録データの前半部（１
／２）に書き換え、新外字登録データの後半部（２／
２）は空きエリア（図１に示す空きエリア）部分に書き
込む方式である。従ってデータ量によっては、右端部に
空きエリアが発生する場合がある。
【０００８】
【０００６】一方、図３に示す書き換え制御は、逆に、
図１に示す空きエリアにまず新外字登録データの前半部
（１／２；なお、前半部と言っても丁度半分と言う意味
ではなく、また図２における前半部とも必ずしも一致す
るものではない）を書き込み、次いで後半部（２／２）
を図１に示す前外字登録データのエリアに書き込む方式
である。従って、後半部（２／２）とフォーム登録デー
タのエリアの間には空きエリアが発生する場合がある。
図１に示す空きエリアにまず新外字登録データの前半部
（１／２；なお、前半部と言っても丁度半分と言う意味
ではなく、また図２における前半部とも必ずしも一致す
るものではない）を書き込み、次いで後半部（２／２）
を図１に示す前外字登録データのエリアに書き込む方式
である。従って、後半部（２／２）とフォーム登録デー
タのエリアの間には空きエリアが発生する場合がある。
【０００９】
【０００７】
【００１０】
【発明が解決しようとする課題】従来の装置において
は、上述したように新しい登録データに書き換える時、
連続的なアドレスに収容することができなくなる場合が
生じるため、データの連続性をチェックする処理が必要
になり（後述するように、フォント・データ取り込み回
路が外部データの連続性を必要としているため）、時間
が掛かると共にプログラムあるいはハードウェア構成が
複雑になるという欠点があった。
は、上述したように新しい登録データに書き換える時、
連続的なアドレスに収容することができなくなる場合が
生じるため、データの連続性をチェックする処理が必要
になり（後述するように、フォント・データ取り込み回
路が外部データの連続性を必要としているため）、時間
が掛かると共にプログラムあるいはハードウェア構成が
複雑になるという欠点があった。
【００１１】
【０００８】本発明は上記従来装置の欠点を解消し、登
録データ（ダウン・ロード・データ）をメモリの連続的
なアドレスに収容することができるダウン・ロード・デ
ータの収容制御装置を提供することを目的とする。
録データ（ダウン・ロード・データ）をメモリの連続的
なアドレスに収容することができるダウン・ロード・デ
ータの収容制御装置を提供することを目的とする。
【００１２】
【０００９】
【００１３】
【課題を解決するための手段】上記目的は、ホスト装置
からの２種類の受信データを１つのメモリにダウン・ロ
ードし、その後このダウン・ロードされたデータを読み
出して印字機構部より印字出力するプリンタにおけるダ
ウン・ロード・データの収容制御装置において、２種類
の受信データのうち、いずれか一方を前記メモリの番号
の小さいエリアから順に連続して書き込む登録処理を行
い、他方を前記メモリの最大番地から少なくなる方向に
向かって順に連続して書き込む登録処理を行い、かつ、
新受信データは対応する前受信データを書き換えて登録
処理する制御手段を備えたことにより達成される。
からの２種類の受信データを１つのメモリにダウン・ロ
ードし、その後このダウン・ロードされたデータを読み
出して印字機構部より印字出力するプリンタにおけるダ
ウン・ロード・データの収容制御装置において、２種類
の受信データのうち、いずれか一方を前記メモリの番号
の小さいエリアから順に連続して書き込む登録処理を行
い、他方を前記メモリの最大番地から少なくなる方向に
向かって順に連続して書き込む登録処理を行い、かつ、
新受信データは対応する前受信データを書き換えて登録
処理する制御手段を備えたことにより達成される。
【００１４】
【００１０】
【００１５】
【作用】ＣＰＵからなる制御手段では、２つの受信デー
タである外字登録データと、フォーム登録データのう
ち、いずれか一方をメモリの番号の小さいエリアから順
に連続して書き込む登録処理を行い、他方をメモリの最
大番地から少なくなる方向に向かって順に連続して書き
込む登録処理を行い、かつ、新受信データは対応する前
受信データを書き換えて登録処理する。
タである外字登録データと、フォーム登録データのう
ち、いずれか一方をメモリの番号の小さいエリアから順
に連続して書き込む登録処理を行い、他方をメモリの最
大番地から少なくなる方向に向かって順に連続して書き
込む登録処理を行い、かつ、新受信データは対応する前
受信データを書き換えて登録処理する。
【００１６】
【００１１】
【００１７】
【実施例】以下、本発明の実施例を図面に基づいて説明
する。図４は実施例に係るプリンタシステム構成図、図
５はプリンタのハードウェアを示すブロック図であり、
図において１はホスト装置、２はプリンタである。
する。図４は実施例に係るプリンタシステム構成図、図
５はプリンタのハードウェアを示すブロック図であり、
図において１はホスト装置、２はプリンタである。
【００１８】
【００１２】プリンタ２は図５に示すように、ＣＰＵ２
１およびこれに制御される送受信素子（ＬＳＩ）２２、
受信データメモリ（ＲＡＭ）２３、外字データ／フォー
ムデータメモリ（以下登録データメモリと呼ぶ）（ＲＯ
Ｍ）２４、ＪＩＳ・ＣＧ（キャラクタ・ジェネレータ）
メモリ（ＲＯＭ）２５、フォント・データ取り込み回路
（ＬＳＩ）２６、印字機構部２７等から構成されてい
る。なお、フォント・データ取り込み回路２６が登録デ
ータの連続性を必要としているものである。
１およびこれに制御される送受信素子（ＬＳＩ）２２、
受信データメモリ（ＲＡＭ）２３、外字データ／フォー
ムデータメモリ（以下登録データメモリと呼ぶ）（ＲＯ
Ｍ）２４、ＪＩＳ・ＣＧ（キャラクタ・ジェネレータ）
メモリ（ＲＯＭ）２５、フォント・データ取り込み回路
（ＬＳＩ）２６、印字機構部２７等から構成されてい
る。なお、フォント・データ取り込み回路２６が登録デ
ータの連続性を必要としているものである。
【００１９】
【００１３】図６ないし図９は実施例に係るダウン・ロ
ード・データの収容エリアを示す模式図であり、この模
式図と図４に基づいてＣＰＵ２１のプログラム処理内容
を説明する。まずホスト装置１から、外字登録データお
よびフォーム登録データが送信されてくると、受信処理
（Ｓ１）が行われ、一旦受信データメモリ２３に受信デ
ータが格納された後、受信データ解析処理（Ｓ２）が行
われ、次いで外字登録処理（Ｓ３）とフォーム登録処理
（Ｓ４）が行われる。
ード・データの収容エリアを示す模式図であり、この模
式図と図４に基づいてＣＰＵ２１のプログラム処理内容
を説明する。まずホスト装置１から、外字登録データお
よびフォーム登録データが送信されてくると、受信処理
（Ｓ１）が行われ、一旦受信データメモリ２３に受信デ
ータが格納された後、受信データ解析処理（Ｓ２）が行
われ、次いで外字登録処理（Ｓ３）とフォーム登録処理
（Ｓ４）が行われる。
【００２０】
【００１４】本実施例における外字登録処理は、図６に
示すように登録データメモリ２４の先頭アドレスから順
に外字登録データを連続して書き込む処理である。ま
た、フォーム登録処理は、同図に示すように後端アドレ
スから番号が小さくなる方向に順にフォーム登録データ
を連続して書き込む処理である。
示すように登録データメモリ２４の先頭アドレスから順
に外字登録データを連続して書き込む処理である。ま
た、フォーム登録処理は、同図に示すように後端アドレ
スから番号が小さくなる方向に順にフォーム登録データ
を連続して書き込む処理である。
【００２１】
【００１５】次に、印字処理（Ｓ５）が行われる。即
ち、フォーム・データ解析処理（Ｓ６）、ＪＩＳフォン
ト展開（Ｓ７）、外字フォント展開（Ｓ８）が行われ、
印字機構部２７で印字出力される。
ち、フォーム・データ解析処理（Ｓ６）、ＪＩＳフォン
ト展開（Ｓ７）、外字フォント展開（Ｓ８）が行われ、
印字機構部２７で印字出力される。
【００２２】
【００１６】ここで、新しくダウン・ロードされた外字
登録データは、図６に示す前外字登録データを書き換え
て、図７に示すように先頭アドレスから連続性を以て登
録メモリ２４内に収容される。フォーム登録データがダ
ウン・ロードされた場合も図８のように、後端アドレス
からアドレスの小さい方に向かって連続性を以て収容さ
れる。なお、図９は実際の受信データのエリアの割り付
けを示す模式図であり、外字登録データより小さいアド
レスにデータ管理用情報を入れている。
登録データは、図６に示す前外字登録データを書き換え
て、図７に示すように先頭アドレスから連続性を以て登
録メモリ２４内に収容される。フォーム登録データがダ
ウン・ロードされた場合も図８のように、後端アドレス
からアドレスの小さい方に向かって連続性を以て収容さ
れる。なお、図９は実際の受信データのエリアの割り付
けを示す模式図であり、外字登録データより小さいアド
レスにデータ管理用情報を入れている。
【００２３】
【００１７】
【００２４】
【発明の効果】以上説明したように、本発明によれば、
２つの受信データ（外字登録データとフォーム登録デー
タ）を、１つのメモリの、番地の上での両端側から中央
に向かって収容するようにしたからデータの連続性が確
保され、プログラム上の書き込み、読み出し処理が簡単
にでき、また、プログラムを単純にできるためプログラ
ム実行時間を短くできる。
２つの受信データ（外字登録データとフォーム登録デー
タ）を、１つのメモリの、番地の上での両端側から中央
に向かって収容するようにしたからデータの連続性が確
保され、プログラム上の書き込み、読み出し処理が簡単
にでき、また、プログラムを単純にできるためプログラ
ム実行時間を短くできる。
【図１】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図２】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図２】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図４】本発明の実施例に係るプリンタシステム構成図
である。
である。
【図５】プリンタのハードウェアを示すブロック図であ
る。
る。
【図６】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図７】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図８】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図９】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
１ ホスト装置 ２ プリンタ ２１ ＣＰＵ ２４ 登録データメモリ ２７ 印字機構部
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成５年２月２２日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】図面の簡単な説明
【補正方法】変更
【補正内容】
【図面の簡単な説明】
【図１】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図２】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図３】従来例に係るダウン・ロード・データの収容エ
リアを示す模式図である。
リアを示す模式図である。
【図４】本発明の実施例に係るプリンタシステム構成図
である。
である。
【図５】プリンタのハードウェアを示すブロック図であ
る。
る。
【図６】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図７】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図８】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【図９】本発明の実施例に係るダウン・ロード・データ
の収容エリアを示す模式図である。
の収容エリアを示す模式図である。
【符号の説明】 １ ホスト装置 ２ プリンタ ２１ ＣＰＵ ２４ 登録データメモリ ２７ 印字機構部
Claims (2)
- 【請求項１】 ホスト装置からの２種類の受信データを
１つのメモリにダウン・ロードし、その後、このダウン
・ロードされたデータを読み出して印字機構部より印字
出力するプリンタにおけるダウン・ロード・データの収
容制御装置において、２種類の受信データのうち、いず
れか一方を前記メモリの番号の小さいエリアから順に連
続して書き込む登録処理を行い、他方を前記メモリの最
大番地から少なくなる方向に向かって順に連続して書き
込む登録処理を行い、かつ、新受信データは対応する前
受信データを書き換えて登録処理する制御手段を備えた
ことを特徴とするダウン・ロード・データの収容制御装
置。 - 【請求項２】 前記２種類の受信データは、文字コード
およびフォント・データからなる外字登録データと、フ
ォーム番号および印字データからなるフォーム登録デー
タであることを特徴とする請求項１記載のダウン・ロー
ド・データの収容制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14649792A JPH071773A (ja) | 1992-05-12 | 1992-05-12 | ダウン・ロード・データの収容制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14649792A JPH071773A (ja) | 1992-05-12 | 1992-05-12 | ダウン・ロード・データの収容制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH071773A true JPH071773A (ja) | 1995-01-06 |
Family
ID=15408964
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14649792A Pending JPH071773A (ja) | 1992-05-12 | 1992-05-12 | ダウン・ロード・データの収容制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH071773A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6221749B1 (en) | 1998-09-02 | 2001-04-24 | Shinko Electric Industries Co., Ltd. | Semiconductor device and production thereof |
| US6429517B1 (en) | 1998-10-16 | 2002-08-06 | Shinko Electric Industries Co., Ltd | Semiconductor device and fabrication method thereof |
-
1992
- 1992-05-12 JP JP14649792A patent/JPH071773A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6221749B1 (en) | 1998-09-02 | 2001-04-24 | Shinko Electric Industries Co., Ltd. | Semiconductor device and production thereof |
| US6429517B1 (en) | 1998-10-16 | 2002-08-06 | Shinko Electric Industries Co., Ltd | Semiconductor device and fabrication method thereof |
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