JPH07160521A - 耐障害機能を有する情報処理装置 - Google Patents
耐障害機能を有する情報処理装置Info
- Publication number
- JPH07160521A JPH07160521A JP5311564A JP31156493A JPH07160521A JP H07160521 A JPH07160521 A JP H07160521A JP 5311564 A JP5311564 A JP 5311564A JP 31156493 A JP31156493 A JP 31156493A JP H07160521 A JPH07160521 A JP H07160521A
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- Japan
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- information processing
- bus
- information
- processing apparatus
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- Pending
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Abstract
(57)【要約】
【目的】 簡単なハードウェアで障害が即時に発見でき
る情報処理装置。 【構成】 比較手段１０８，２０８が情報処理装置１０
０，２００の内部バス１０４，２０４から情報処理装置
１００，２００の処理結果を得て、処理結果を比較す
る。処理結果が同じであれば正常であり、同じでなけれ
ば異常と判断して、障害通知ライン１０７，２０７を介
してそれぞれＣＰＵ１０１，２０１に報告し、障害処理
を行なう。この場合、比較手段１０８，２０８は処理結
果を内部バスから得ているので、即時に処理結果の異常
または正常の判断ができる。また、２重化バスを用いて
いないので装置が簡単になっている。
る情報処理装置。 【構成】 比較手段１０８，２０８が情報処理装置１０
０，２００の内部バス１０４，２０４から情報処理装置
１００，２００の処理結果を得て、処理結果を比較す
る。処理結果が同じであれば正常であり、同じでなけれ
ば異常と判断して、障害通知ライン１０７，２０７を介
してそれぞれＣＰＵ１０１，２０１に報告し、障害処理
を行なう。この場合、比較手段１０８，２０８は処理結
果を内部バスから得ているので、即時に処理結果の異常
または正常の判断ができる。また、２重化バスを用いて
いないので装置が簡単になっている。
Description
【０００１】
【産業上の利用分野】本発明は同一の情報処理を行な
い、処理結果をそれぞれ第１，第２の外部バスに出力す
る第１，第２の情報処理装置と、第１，第２の情報処理
装置の処理結果をそれぞれ比較し、同一でなければ異常
が発生したことを第１，第２の情報処理装置にそれぞれ
報告する第１，第２の比較手段とを有する情報処理シス
テムに関する。
い、処理結果をそれぞれ第１，第２の外部バスに出力す
る第１，第２の情報処理装置と、第１，第２の情報処理
装置の処理結果をそれぞれ比較し、同一でなければ異常
が発生したことを第１，第２の情報処理装置にそれぞれ
報告する第１，第２の比較手段とを有する情報処理シス
テムに関する。
【０００２】
【従来の技術】図２はこの種の情報処理システムの従来
例を示すブロック図である。この情報処理システムにお
いては、第１の情報処理装置を構成するＣＰＵ１０１メ
モリ１０２、外部バス１１０に接続された入出力制御装
置１０９等と、第２の情報処理装置を構成するＣＰＵ２
０１メモリ２０２、外部バス２１０に接続された入出力
制御装置２０９等とが、２重化バス２１，２２を介して
接続されている。第１，第２の情報処理装置は同一の機
能を有しており、両者の出力比較等を行なう内部の障害
検出手段を用いて、外部バス１１０，２１０上の出力の
正常性を保証している。例えば、図２のＣＰＵは図３に
示すように構成されている。演算回路が２重化され、各
演算回路の演算結果の論理を比較回路が比較し、同一で
なければ障害発生と看做して外部バスへの出力を抑止し
ている。
例を示すブロック図である。この情報処理システムにお
いては、第１の情報処理装置を構成するＣＰＵ１０１メ
モリ１０２、外部バス１１０に接続された入出力制御装
置１０９等と、第２の情報処理装置を構成するＣＰＵ２
０１メモリ２０２、外部バス２１０に接続された入出力
制御装置２０９等とが、２重化バス２１，２２を介して
接続されている。第１，第２の情報処理装置は同一の機
能を有しており、両者の出力比較等を行なう内部の障害
検出手段を用いて、外部バス１１０，２１０上の出力の
正常性を保証している。例えば、図２のＣＰＵは図３に
示すように構成されている。演算回路が２重化され、各
演算回路の演算結果の論理を比較回路が比較し、同一で
なければ障害発生と看做して外部バスへの出力を抑止し
ている。
【０００３】このように障害発生を検出して処理する方
法では、各情報処理装置において演算回路等を２重化し
なければならず、ハードウェアが複雑で高価にならざる
を得なかった。また、各情報処理装置から２重化バスへ
の２本の接続線が必要となり、信号線が増加するし、２
重化バスから見ると接続される装置が２倍となり、電気
的な負荷が増大して高速なバスを構築するのが困難とな
る。
法では、各情報処理装置において演算回路等を２重化し
なければならず、ハードウェアが複雑で高価にならざる
を得なかった。また、各情報処理装置から２重化バスへ
の２本の接続線が必要となり、信号線が増加するし、２
重化バスから見ると接続される装置が２倍となり、電気
的な負荷が増大して高速なバスを構築するのが困難とな
る。
【０００４】図４は情報処理システムの他の従来例を示
すブロック図である。この情報処理システムにおいて
は、比較手段１０８，２０８がそれぞれ外部バス１１
０，２１０の出力データを比較して異常発生を検出して
いる。
すブロック図である。この情報処理システムにおいて
は、比較手段１０８，２０８がそれぞれ外部バス１１
０，２１０の出力データを比較して異常発生を検出して
いる。
【０００５】
【発明が解決しようとする課題】上述の従来例のうち前
者は、２重化バスに各情報処理装置を接続するため、高
価なハードウェアとなるうえ、高速化が困難である。ま
た、後者にあっては、論理回路を経た後の外部バス１１
０，２１０の出力により判断しなければならないため、
障害の発生を即時に発見することができず、障害が潜在
かする可能性がある。
者は、２重化バスに各情報処理装置を接続するため、高
価なハードウェアとなるうえ、高速化が困難である。ま
た、後者にあっては、論理回路を経た後の外部バス１１
０，２１０の出力により判断しなければならないため、
障害の発生を即時に発見することができず、障害が潜在
かする可能性がある。
【０００６】本発明は上記問題に鑑み、簡単なハードウ
ェアで障害が即時に発見できる情報処理装置を提供する
ことを目的とする。
ェアで障害が即時に発見できる情報処理装置を提供する
ことを目的とする。
【０００７】
【課題を解決するための手段】本発明の情報処理装置
は、同一の情報処理を行ない、処理結果をそれぞれ第
１，第２の外部バスに出力する第１，第２の情報処理装
置と、第１，第２の情報処理装置の処理結果をそれぞれ
比較し、同一でなければ異常が発生したことを第１，第
２の情報処理装置にそれぞれ報告する第１，第２の比較
手段とを有する情報処理システムであって、前記第１の
比較手段を、前記第１の情報処理装置のＣＰＵに前記第
１の情報処理装置の内部バスを介して直接接続する第１
の接続手段と、前記第２の比較手段を、前記第２の情報
処理装置のＣＰＵに前記第２の情報処理装置の内部バス
を介して直接接続する第２の接続手段と、前記第１の情
報処理装置の内部バスを介して、前記第１の情報処理装
置の処理結果を入手し、前記第２の比較手段に渡す第１
のバス情報提供手段と、前記第２の情報処理装置の内部
バスを介して、前記第２の情報処理装置の処理結果を入
手し、前記第１の比較手段に渡す第２のバス情報提供手
段とを有する。
は、同一の情報処理を行ない、処理結果をそれぞれ第
１，第２の外部バスに出力する第１，第２の情報処理装
置と、第１，第２の情報処理装置の処理結果をそれぞれ
比較し、同一でなければ異常が発生したことを第１，第
２の情報処理装置にそれぞれ報告する第１，第２の比較
手段とを有する情報処理システムであって、前記第１の
比較手段を、前記第１の情報処理装置のＣＰＵに前記第
１の情報処理装置の内部バスを介して直接接続する第１
の接続手段と、前記第２の比較手段を、前記第２の情報
処理装置のＣＰＵに前記第２の情報処理装置の内部バス
を介して直接接続する第２の接続手段と、前記第１の情
報処理装置の内部バスを介して、前記第１の情報処理装
置の処理結果を入手し、前記第２の比較手段に渡す第１
のバス情報提供手段と、前記第２の情報処理装置の内部
バスを介して、前記第２の情報処理装置の処理結果を入
手し、前記第１の比較手段に渡す第２のバス情報提供手
段とを有する。
【０００８】また、前記第１の情報処理装置は、前記第
１の接続手段により自装置の内部バスに接続された前記
第１の比較手段と、前記第１のバス情報提供手段とを自
装置内に含み、前記第２の情報処理装置は、前記第２の
接続手段により自装置の内部バスに接続された前記第２
の比較手段と、前記第２のバス情報提供手段とを自装置
内に含み、前記第１，第２の比較手段は異常の発生を報
告するための障害報告ラインを含んでいるのが好まし
い。
１の接続手段により自装置の内部バスに接続された前記
第１の比較手段と、前記第１のバス情報提供手段とを自
装置内に含み、前記第２の情報処理装置は、前記第２の
接続手段により自装置の内部バスに接続された前記第２
の比較手段と、前記第２のバス情報提供手段とを自装置
内に含み、前記第１，第２の比較手段は異常の発生を報
告するための障害報告ラインを含んでいるのが好まし
い。
【０００９】
【作用】第１，第２の比較手段は第１，第２の情報処理
装置の内部バスから処理結果を得て、処理結果を比較す
ることにより、即時に処理結果の異常または正常の判断
ができる。
装置の内部バスから処理結果を得て、処理結果を比較す
ることにより、即時に処理結果の異常または正常の判断
ができる。
【００１０】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。図１は本発明の情報処理システムの一実施
例を示すブロック図である。本実施例の情報処理システ
ムは、情報処理装置１００，２００から構成されてい
る。
て説明する。図１は本発明の情報処理システムの一実施
例を示すブロック図である。本実施例の情報処理システ
ムは、情報処理装置１００，２００から構成されてい
る。
【００１１】情報処理装置１００においては、ＣＰＵ１
０１は内部バス１０４を介してメモリ１０２、Ｉ／Ｏ装
置１０３、バス情報提供手段１０５、比較手段１０８お
よび外部バス１１０に接続された外部インタフェイス１
０９と接続されるとともに、比較手段１０８とは障害通
知ライン１０７にても接続されている。
０１は内部バス１０４を介してメモリ１０２、Ｉ／Ｏ装
置１０３、バス情報提供手段１０５、比較手段１０８お
よび外部バス１１０に接続された外部インタフェイス１
０９と接続されるとともに、比較手段１０８とは障害通
知ライン１０７にても接続されている。
【００１２】情報処理装置２００においては、ＣＰＵ２
０１は内部バス２０４を介してメモリ２０２、Ｉ／Ｏ装
置２０３、バス情報提供手段２０５、比較手段２０８お
よび外部バス２１０に接続された外部インタフェイス２
０９と接続されるとともに、比較手段２０８とは障害通
知ライン２０７にても接続されている。
０１は内部バス２０４を介してメモリ２０２、Ｉ／Ｏ装
置２０３、バス情報提供手段２０５、比較手段２０８お
よび外部バス２１０に接続された外部インタフェイス２
０９と接続されるとともに、比較手段２０８とは障害通
知ライン２０７にても接続されている。
【００１３】また、情報処理装置１００のバス情報提供
手段１０５は、引込手段２０６を介して情報処理装置２
００の比較手段２０８と接続され、情報処理装置２００
のバス情報提供手段２０５は、引込手段１０６を介して
情報処理装置１００の比較手段１０８と接続されてい
る。
手段１０５は、引込手段２０６を介して情報処理装置２
００の比較手段２０８と接続され、情報処理装置２００
のバス情報提供手段２０５は、引込手段１０６を介して
情報処理装置１００の比較手段１０８と接続されてい
る。
【００１４】次に図１の実施例の動作について説明す
る。通常運転時には、情報処理装置１００，２００のＣ
ＰＵ１０１，２０１は同期して同一の処理を行なう。比
較手段１０８は、内部バス１０４を介して与えられる情
報処理装置１００側の処理結果と、バス情報提供手段２
０５から与えられる情報処理装置２００側の処理結果と
を比較し、両者の間に差異が生じた場合には、障害通知
ライン１０７を介してＣＰＵ１０１に報告する。ＣＰＵ
１０１は、障害発生の報告に従って障害に対応する処理
を行なう。これらの一連の処理は、情報処理装置２００
側についても同様である。
る。通常運転時には、情報処理装置１００，２００のＣ
ＰＵ１０１，２０１は同期して同一の処理を行なう。比
較手段１０８は、内部バス１０４を介して与えられる情
報処理装置１００側の処理結果と、バス情報提供手段２
０５から与えられる情報処理装置２００側の処理結果と
を比較し、両者の間に差異が生じた場合には、障害通知
ライン１０７を介してＣＰＵ１０１に報告する。ＣＰＵ
１０１は、障害発生の報告に従って障害に対応する処理
を行なう。これらの一連の処理は、情報処理装置２００
側についても同様である。
【００１５】本実施例においては、図２または図３で示
されるような２重化バス２１，２２を用いないために構
造が簡単になっている。また、図４のように比較手段が
比較用のデータを外部バスから入力せず、内部バス１０
４，２０４から入力しているので、内部バスと外部バス
との間にある影響を受けず、動作が速くなる。
されるような２重化バス２１，２２を用いないために構
造が簡単になっている。また、図４のように比較手段が
比較用のデータを外部バスから入力せず、内部バス１０
４，２０４から入力しているので、内部バスと外部バス
との間にある影響を受けず、動作が速くなる。
【００１６】
【発明の効果】以上説明したように本発明は、第１，第
２の比較手段が第１，第２の情報処理装置の内部バスか
ら処理結果を得て、処理結果を比較することにより、即
時に処理結果の異常または正常の判断ができるという効
果があり、また、２重化バスを用いないので装置が簡単
になるという効果もある。
２の比較手段が第１，第２の情報処理装置の内部バスか
ら処理結果を得て、処理結果を比較することにより、即
時に処理結果の異常または正常の判断ができるという効
果があり、また、２重化バスを用いないので装置が簡単
になるという効果もある。
【図１】本発明の情報処理システムの一実施例を示すブ
ロック図である。
ロック図である。
【図２】従来例を示すブロック図である。
【図３】図２の従来例のＣＰＵを示すブロック図であ
る。
る。
【図４】他の従来例を示すブロック図である。
１００，２００ 情報処理装置 １０１，２０１ ＣＰＵ １０２，２０２ メモリ １０３，２０３ Ｉ／Ｏ装置 １０４，２０４ 内部バス １０５，２０５ バス情報提供手段 １０６，２０６ 引込手段 １０７，２０７ 障害通知ライン １０８，２０８ 比較手段 １０９，２０９ 外部インタフェイス １１０，２１０ 外部バス
Claims (4)
- 【請求項１】 同一の情報処理を行ない、処理結果をそ
れぞれ第１，第２の外部バスに出力する第１，第２の情
報処理装置と、第１，第２の情報処理装置の処理結果を
それぞれ比較し、同一でなければ異常が発生したことを
第１，第２の情報処理装置にそれぞれ報告する第１，第
２の比較手段とを有する情報処理システムにおいて、 前記第１の比較手段を、前記第１の情報処理装置のＣＰ
Ｕに前記第１の情報処理装置の内部バスを介して直接接
続する第１の接続手段と、 前記第２の比較手段を、前記第２の情報処理装置のＣＰ
Ｕに前記第２の情報処理装置の内部バスを介して直接接
続する第２の接続手段と、 前記第１の情報処理装置の内部バスを介して、前記第１
の情報処理装置の処理結果を入手し、前記第２の比較手
段に渡す第１のバス情報提供手段と、 前記第２の情報処理装置の内部バスを介して、前記第２
の情報処理装置の処理結果を入手し、前記第１の比較手
段に渡す第２のバス情報提供手段とを有することを特徴
とする情報処理システム。 - 【請求項２】 前記第１の情報処理装置は、前記第１の
接続手段により自装置の内部バスに接続された前記第１
の比較手段と、前記第１のバス情報提供手段とを自装置
内に含み、前記第２の情報処理装置は、前記第２の接続
手段により自装置の内部バスに接続された前記第２の比
較手段と、前記第２のバス情報提供手段とを自装置内に
含む請求項１記載の情報処理システム。 - 【請求項３】 前記第１，第２の比較手段は異常の発生
を報告するための障害報告ラインを含んでいる請求項１
または２記載の情報処理システム。 - 【請求項４】 前記第１，第２の情報処理装置は前記同
一の処理を同時に行なう請求項１記載の情報処理システ
ム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5311564A JPH07160521A (ja) | 1993-12-13 | 1993-12-13 | 耐障害機能を有する情報処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5311564A JPH07160521A (ja) | 1993-12-13 | 1993-12-13 | 耐障害機能を有する情報処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07160521A true JPH07160521A (ja) | 1995-06-23 |
Family
ID=18018755
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5311564A Pending JPH07160521A (ja) | 1993-12-13 | 1993-12-13 | 耐障害機能を有する情報処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07160521A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1997006487A1 (de) * | 1995-08-10 | 1997-02-20 | Itt Automotive Europe Gmbh | Microprozessorsystem für sicherheitskritische regelungen |
| JP2009526299A (ja) * | 2006-02-09 | 2009-07-16 | イーズ ディフェンス アンド セキュリティー システムズ リミテッド | 高速冗長データ処理システム |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5529342A (en) * | 1978-08-24 | 1980-03-01 | Minnesota Mining & Mfg | Slender beltlike piece material and its preparation |
| JPH04178839A (ja) * | 1990-11-14 | 1992-06-25 | Nec Corp | マイクロプロセッサ |
-
1993
- 1993-12-13 JP JP5311564A patent/JPH07160521A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5529342A (en) * | 1978-08-24 | 1980-03-01 | Minnesota Mining & Mfg | Slender beltlike piece material and its preparation |
| JPH04178839A (ja) * | 1990-11-14 | 1992-06-25 | Nec Corp | マイクロプロセッサ |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1997006487A1 (de) * | 1995-08-10 | 1997-02-20 | Itt Automotive Europe Gmbh | Microprozessorsystem für sicherheitskritische regelungen |
| JP2009526299A (ja) * | 2006-02-09 | 2009-07-16 | イーズ ディフェンス アンド セキュリティー システムズ リミテッド | 高速冗長データ処理システム |
| US8386843B2 (en) | 2006-02-09 | 2013-02-26 | Cassidian Limited | High speed redundant data processing system |
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