JPH0714727U - Ｐｌｌ回路 - Google Patents

Ｐｌｌ回路

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JPH0714727U
JPH0714727U JP040653U JP4065393U JPH0714727U JP H0714727 U JPH0714727 U JP H0714727U JP 040653 U JP040653 U JP 040653U JP 4065393 U JP4065393 U JP 4065393U JP H0714727 U JPH0714727 U JP H0714727U
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JP
Japan
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pllic
controlled oscillator
buffer amplifier
circuit
pll circuit
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JP040653U
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English (en)
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純 井上
俊夫 秦
修 玉越
孝泰 小牧
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Murata Manufacturing Co Ltd
Original Assignee
Murata Manufacturing Co Ltd
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
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    • H03B7/00—Generation of oscillations using active element having a negative resistance between two of its electrodes
    • H03B7/02—Generation of oscillations using active element having a negative resistance between two of its electrodes with frequency-determining element comprising lumped inductance and capacitance
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/099—Details of the phase-locked loop concerning mainly the controlled oscillator of the loop
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
    • H03B2201/00—Aspects of oscillators relating to varying the frequency of the oscillations
    • H03B2201/02—Varying the frequency of the oscillations by electronic means
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    • H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
    • H03B7/00—Generation of oscillations using active element having a negative resistance between two of its electrodes
    • H03B7/02—Generation of oscillations using active element having a negative resistance between two of its electrodes with frequency-determining element comprising lumped inductance and capacitance
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

(57)【要約】 【目的】 ＰＬＬ回路の小型化を図ることを目的とす
る。 【構成】 ＰＬＬｉｃ２とループフィルタ３と電圧制御
形発振器４とを備えるＰＬＬ回路において、ＰＬＬｉｃ
２は、電圧制御形発振器４のバッファアンプ７を含んで
ｉｃ化されている。 【効果】 従来例のように、電圧制御発振器のバッファ
アンプを組む必要がなくなり、その分部品が削減されて
コストを低減できるとともに、ＰＬＬ回路全体の大幅な
小型化が可能になり、特性の安定したＰＬＬ回路が実現
できる。

Description

【考案の詳細な説明】
【０００１】
【産業上の利用分野】
本考案は、例えば、通信機器の周波数シンセサイザなどに好適なＰＬＬ（ｐｈ ａｓｅ−ｌｏｃｋｅｄ ｌｏｏｐ）回路に関する。
【０００２】
【従来の技術】
図５は、ＰＬＬ回路を用いた従来の周波数シンセサイザの構成図であり、同図 において、２0はＰＬＬｉｃであり、このＰＬＬｉｃ２0は、図示しないプリスケ ーラ、プログラマブルディバイダ、位相比較器およびチャージポンプ等が１チッ プ化されて構成されており、位相比較器には、基準周波数ｆｒの信号が入力され る。３はＰＬＬｉｃ２0の出力から高周波成分およびノイズ成分を除去するルー プフィルタ（ローパスフィルタ）、４0はループフィルタ３の出力によって発振 周波数が制御される電圧制御形発振器（ＶＣＯ）、８は次段回路との整合のため のインピーダンス整合回路であり、このインピーダンス整合回路８の出力がＰＬ Ｌｉｃ２0に与えられる。
【０００３】 電圧制御形発振器４0は、図６に示されるように、共振回路５と、負性抵抗回 路６と、バッファアンプ７とを備えている。
【０００４】
【考案が解決しようとする課題】
このようなＰＬＬ回路においては、その小型化が望まれるが、ｉｃの形状は変 更できないために、ループフィルタ３や電圧制御形発振器４0の小型化が必要に なる。しかしながら、回路の素子構成の単純化には、従来の諸特性値を維持する 必要から限度があり、また、回路を構成している個々の素子自体の小型化にも限 界があるために、小型化が非常に困難である。
【０００５】 また、高周波を扱う場合には、回路上の配線がインダクタンス成分となって特 性劣化の原因となるので、電圧制御形発振器４0とＰＬＬｉｃ２0との間は、イン ダクタンス成分を極力抑えるように設計しなければならないけれども、ＰＬＬｉ ｃ２0の各端子の配置は予め決まっているために、必然的にＰＬＬｉｃ２0と電圧 制御形発振器４0の位置関係が決まってしまい、設計の自由度が小さくなり、イ ンダクタンス成分の減少にも限界がある。
【０００６】 本考案は、上述の点に鑑みて為されたものであって、ＰＬＬ回路の諸特性を維 持しながらその小型化を図ることを目的とする。
【０００７】
【課題を解決するための手段】
本考案では、上述の目的を達成するために、次のように構成している。
【０００８】 すなわち、ＰＬＬｉｃと、このＰＬＬｉｃの出力が与えられるループフィルタ と、このループフィルタの出力によって発振周波数が制御されてその発振出力を 前記ＰＬＬｉｃに与える電圧制御形発振器とを備えるＰＬＬ回路において、前記 電圧制御形発振器は、共振器、負性抵抗回路およびバッファアンプを有し、前記 ＰＬＬｉｃは、前記電圧制御形発振器の前記バッファアンプを含んでｉｃ化され 、前記電圧制御形発振器の前記共振器および負性抵抗回路は、前記ＰＬＬｉｃの 外部に配置されている。
【０００９】
【作用】
上記構成によれば、電圧制御形発振器のバッファアンプをＰＬＬｉｃのｉｃ内 部に取り込んだので、従来例のように、電圧制御形発振器のバッファアンプを組 む必要がなくなり、その分部品が削減されてコストを低減できるとともに、ＰＬ Ｌ回路全体の大幅な小型化が可能になる。また、電圧制御形発振器の共振器およ び負性抵抗回路は、ＰＬＬｉｃの外部に配置されているので、ｉｃのノイズ等の 影響を受けにくく、特性の安定したＰＬＬ回路が実現できる。
【００１０】
【実施例】
以下、図面によって本考案の実施例について、詳細に説明する。
【００１１】 図１は、本考案のＰＬＬ回路であるＰＬＬ周波数シンセサイザのブロック図で あり、図５，図６の従来例に対応する部分には、同一の参照符号を付す。
【００１２】 このＰＬＬ周波数シンセサイザ１は、ＰＬＬｉｃ２と、ＰＬＬｉｃ２の出力か ら高周波成分およびノイズ成分を除去するループフィルタ（ローパスフィルタ） ３と、ループフィルタ３の出力によって発振周波数が制御される電圧制御形発振 器（ＶＣＯ）４とを備えており、電圧制御形発振器４は、共振回路５と、負性抵 抗回路６と、バッファアンプ７とを備えているのは従来例と同様である。
【００１３】 本考案では、ＰＬＬ周波数シンセサイザ１の小型化を図るために、電圧制御形 発振器４のバッファアンプを、ＰＬＬｉｃ２内部に取り込んで構成されている。
【００１４】 図２は、本考案の一実施例のＰＬＬｉｃ２のブロック図であり、この実施例で は、ＰＬＬｉｃ２は、電圧制御形発振器４のバッファアンプ７および出力レベル を最適化するインピーダンス整合回路８をＰＬＬｉｃ２内部に含んで構成されて おり、バッファアンプ７の出力は、インピーダンス整合回路８を介してｉｃ２外 に出力されるとともに、従来と同様の構成のＰＬＬｉｃ（以下「旧ＰＬＬｉｃ部 」という）２0のプリスケーラ（図示せず）に与えられるようになっており、こ の旧ＰＬＬｉｃ部の出力がループフィルタに与えられるようになっている。
【００１５】 このように、電圧制御形発振器４のバッファアンプ７をＰＬＬｉｃ２の内部に 取り込んで構成しているので、従来例のように、電圧制御形発振器のバッファア ンプを組む必要がなくなり、その分部品が削減されてコストを低減できるととも に、ＰＬＬ周波数シンセサイザの大幅な小型化が可能になる。
【００１６】 しかも、電圧制御形発振器４のバッファアンプ７とＰＬＬｉｃ２との接続を、 ｉｃ外部で行う従来例に比べてインダクタンス成分を低減することができ、ノイ ズ特性などが改善される。
【００１７】 また、ＰＬＬ周波数シンセサイザ１の諸々の特性値を左右する電圧制御形発振 器４の共振回路５および負性抵抗回路６は、ｉｃ２の外部に配置して設計するの でｉｃ２のノイズ等の影響を受けにくく、従来と同じ良好な特性を維持すること ができる。
【００１８】 図３は、本考案の他の実施例のＰＬＬｉｃ２ａのブロック図であり、上述の実 施例に対応する部分には、同一の参照符号を付す。
【００１９】 この実施例では、ＰＬＬｉｃ２ａは、電圧制御形発振器４のバッファアンプ７ をＰＬＬｉｃ２ａ内部に含んで構成されており、バッファアンプ７の出力は、ｉ ｃ２ａ外のインピーダンス整合回路８を介して出力とされる一方、旧ＰＬＬｉｃ 部２0のプリスケーラに与えられるようになっている。その他の構成は、上述の 実施例と同様である。
【００２０】 図４は、本考案のさらに他の実施例のＰＬＬｉｃ２ｂのブロック図であり、上 述の実施例に対応する部分には、同一の参照符号を付す。
【００２１】 この実施例では、ＰＬＬｉｃ２ｂは、電圧制御形発振器４の２段に構成された バッファアンプ７1，７2およびインピーダンス整合回路８を、ＰＬＬｉｃ２ｂ内 部に含んで構成されている。このようにバッファアンプ７1，７2を２段で構成す ることにより、利得およびアイソレーションなどが改善される。
【００２２】 なお、本考案の他の実施例として、バッファアンプは２段に限らず、さらに、 多段の構成としてもよい。
【００２３】
【考案の効果】
以上のように本考案によれば、電圧制御形発振器のバッファアンプをＰＬＬｉ ｃのｉｃ内部に取り込んだので、従来例のように、電圧制御発振器のバッファア ンプを組む必要がなくなり、その分部品が削減されてコストを低減できるととも に、ＰＬＬ回路全体の大幅な小型化が可能になる。また、電圧制御形発振器の共 振器および負性抵抗回路を、ＰＬＬｉｃの外部に配置しているので、特性の安定 したＰＬＬ回路が実現できる。
【図面の簡単な説明】
【図１】本考案のＰＬＬ回路のブロック図である。
【図２】本考案の一実施例のＰＬＬｉｃのブロック図で
ある。
【図３】本考案の他の実施例のＰＬＬｉｃのブロック図
である。
【図４】本考案のさらに他の実施例のＰＬＬｉｃのブロ
ック図である。
【図５】従来例のＰＬＬ回路のブロック図である。
【図６】従来例の電圧制御形発振器の構成を示すブロッ
ク図である。
【符号の説明】
２，２0，２ａ，２ｂ ＰＬＬｉｃ ３ ループフィルタ ４，４0 電圧制御形発振器 ７，７1，７2 バッファアンプ
───────────────────────────────────────────────────── フロントページの続き (72)考案者 小牧 孝泰 京都府長岡京市天神二丁目26番10号 株式 会社村田製作所内

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項１】 ＰＬＬｉｃと、このＰＬＬｉｃの出力が
    与えられるループフィルタと、このループフィルタの出
    力によって発振周波数が制御されてその発振出力を前記
    ＰＬＬｉｃに与える電圧制御形発振器とを備えるＰＬＬ
    回路において、 前記電圧制御形発振器は、共振器、負性抵抗回路および
    バッファアンプを有し、 前記ＰＬＬｉｃは、前記電圧制御形発振器の前記バッフ
    ァアンプを含んでｉｃ化され、前記電圧制御形発振器の
    前記共振器および負性抵抗回路は、前記ＰＬＬｉｃの外
    部に配置されることを特徴とするＰＬＬ回路。
JP040653U 1993-07-26 1993-07-26 Ｐｌｌ回路 Pending JPH0714727U (ja)

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JP040653U JPH0714727U (ja) 1993-07-26 1993-07-26 Ｐｌｌ回路
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