JPH069375B2 - 中間調画情報の符号化伝送方式 - Google Patents
中間調画情報の符号化伝送方式Info
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- JPH069375B2 JPH069375B2 JP59085644A JP8564484A JPH069375B2 JP H069375 B2 JPH069375 B2 JP H069375B2 JP 59085644 A JP59085644 A JP 59085644A JP 8564484 A JP8564484 A JP 8564484A JP H069375 B2 JPH069375 B2 JP H069375B2
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- circuit
- processing circuit
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- Multimedia (AREA)
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- Image Processing (AREA)
Description
【発明の詳細な説明】 〔発明の技術分野〕 本発明は、中間調画情報を冗長度抑圧符号化して伝送す
る中間調画情報の符号化伝送方式の改良に関する。
る中間調画情報の符号化伝送方式の改良に関する。
近年、アナログ画信号を中間調画情報を含んだ形で二値
信号に変換する手法として、ディザ法が多く使用されて
いる。このディザ法は、中間調成分を含むアナログ信号
を二値化する過程で、ランダムあるいは擬似ランダム関
数により二値化判定しきい値を変動させ、入力画像の濃
淡の局所的平均値に対応する数の輝点を発生させる方法
である。例えば、画像をＭ画素化点×Ｎ走査線毎にブロ
ック化し、これらのブロック毎にその各画素に互いに異
なる二値化判定レベルを割当ててこの二値化判定レベル
に従ってアナログ画信号を二値化することにより、輝点
数を組織的に画像空間に配置して画像の中間調を表現す
る。第１図は、４×４を１ブロックとして全画素が0.5
Ｖ〜16.5Ｖの各濃度である場合をそれぞれ表現したパタ
ーンを示すものである。
信号に変換する手法として、ディザ法が多く使用されて
いる。このディザ法は、中間調成分を含むアナログ信号
を二値化する過程で、ランダムあるいは擬似ランダム関
数により二値化判定しきい値を変動させ、入力画像の濃
淡の局所的平均値に対応する数の輝点を発生させる方法
である。例えば、画像をＭ画素化点×Ｎ走査線毎にブロ
ック化し、これらのブロック毎にその各画素に互いに異
なる二値化判定レベルを割当ててこの二値化判定レベル
に従ってアナログ画信号を二値化することにより、輝点
数を組織的に画像空間に配置して画像の中間調を表現す
る。第１図は、４×４を１ブロックとして全画素が0.5
Ｖ〜16.5Ｖの各濃度である場合をそれぞれ表現したパタ
ーンを示すものである。
ところで、一般に画像伝送では情報量を低減する目的で
二値化画信号を冗長度抑圧符号化して伝送するようにし
ており、前記ディザ法により二値化された画信号につい
ても、従来より例えばMHあるいはMR符号化方式(CCITTT.
4)により符号化して伝送している。
二値化画信号を冗長度抑圧符号化して伝送するようにし
ており、前記ディザ法により二値化された画信号につい
ても、従来より例えばMHあるいはMR符号化方式(CCITTT.
4)により符号化して伝送している。
しかしながら、ディザ法により二値化された画信号は、
前記第１図のパターンから明らかなように“黒”、
“白”の変化が非常に多いため、従来のように二値化画
信号をそのままMHあるいはMR符号化すると、伝送する情
報量が多くなって伝送時間が長くなる欠点がある。
前記第１図のパターンから明らかなように“黒”、
“白”の変化が非常に多いため、従来のように二値化画
信号をそのままMHあるいはMR符号化すると、伝送する情
報量が多くなって伝送時間が長くなる欠点がある。
本発明は、上記事情に鑑みてなされたもので、ディザ処
理された二値化情報の黒白変化を減少させて冗長度抑圧
符号化後の情報量を低減し、これにより伝送時間を短縮
することができ、しかもこれを簡単な回路構成により実
現できる中間調画情報の符号化伝送方式を提供すること
を目的とする。
理された二値化情報の黒白変化を減少させて冗長度抑圧
符号化後の情報量を低減し、これにより伝送時間を短縮
することができ、しかもこれを簡単な回路構成により実
現できる中間調画情報の符号化伝送方式を提供すること
を目的とする。
本発明は、上記目的を達成するために、隣接するディザ
パターン間で各画素レベルが相関を有している点に着目
し、Ｍ画素化点×Ｎ走査線のディザマトリクスにより網
点処理して得られた二値化信号を符号化して伝送するに
際し、上記二値化信号中の互いに隣接するディザマトリ
クス間で、これらのディザマトリクスを構成する各画素
毎に相互に位置が対応する画素間の信号変化を一走査線
分ずつ相関処理回路で検出し、その変化信号を符号化に
供するようにし、かつ上記相関処理回路を、１個のシフ
トレジスタと排他的論理和回路とにより構成したもので
ある。
パターン間で各画素レベルが相関を有している点に着目
し、Ｍ画素化点×Ｎ走査線のディザマトリクスにより網
点処理して得られた二値化信号を符号化して伝送するに
際し、上記二値化信号中の互いに隣接するディザマトリ
クス間で、これらのディザマトリクスを構成する各画素
毎に相互に位置が対応する画素間の信号変化を一走査線
分ずつ相関処理回路で検出し、その変化信号を符号化に
供するようにし、かつ上記相関処理回路を、１個のシフ
トレジスタと排他的論理和回路とにより構成したもので
ある。
第２図は、本発明の一実施例における中間調画情報の符
号化伝送方式を適用した信号処理装置の構成を示す回路
ブロック図である。
号化伝送方式を適用した信号処理装置の構成を示す回路
ブロック図である。
この装置の符号化部１は、図示しない読取部から出力さ
れたアナログ画信号ＡＳをＭ画素化点×Ｎ走査線のディ
ザマトリクスにより網点処理する網点処理回路２と、こ
の網点処理回路２の網点処理により得られた二値化信号
ＢＳに所定の相関処理を施こす相関処理回路３と、この
相関処理回路３から出力された二値化信号ＣＳを例えば
ＭＨあるいはＭＲ符号化して図示しない変調部へ供給す
る符号化回路４とから構成されている。
れたアナログ画信号ＡＳをＭ画素化点×Ｎ走査線のディ
ザマトリクスにより網点処理する網点処理回路２と、こ
の網点処理回路２の網点処理により得られた二値化信号
ＢＳに所定の相関処理を施こす相関処理回路３と、この
相関処理回路３から出力された二値化信号ＣＳを例えば
ＭＨあるいはＭＲ符号化して図示しない変調部へ供給す
る符号化回路４とから構成されている。
一方復合化部５は、図示しない復調部からの符号化信号
ＤＳを送信側で使用している符号化方式に対応する復合
化方式により復合化する復合化回路６と、この復合化回
路６から出力された二値化信号ＥＳを相関処理して送信
側で相関処理する前の二値化信号ＦＳを再生する相関処
理回路７とから構成されている。
ＤＳを送信側で使用している符号化方式に対応する復合
化方式により復合化する復合化回路６と、この復合化回
路６から出力された二値化信号ＥＳを相関処理して送信
側で相関処理する前の二値化信号ＦＳを再生する相関処
理回路７とから構成されている。
さて、前記符号化部１の相関処理回路３は例えば第３図
のように、シリアル入力、パラレル出力形のシフトレジ
スタ３１と、排他的論理和回路（EX-OR回路）３２と、
アンドゲート回路３３とからなる。そして、網点処理回
路２からの二値化信号ＢＳをEX-OR回路３２の一方の入
力端に導入するとともにシフトレジスタ３１に入力し、
このシフトレジスタ３１で前記ディザマトリクスの画素
化点数Ｍ（Ｍは２以上の整数）分だけシフトした画素信
号をアンドゲート回路３３を会して上記EX-OR回路３２
の他方の入力端に導入する。そして、このEX-OR回路３
２の出力を相関処理後の二値化信号ＣＳとして出力す
る。なお、上記アンドゲート回路３３は、クリア信号
（“Ｌ”レベル）CLRによりゲート制御される。
のように、シリアル入力、パラレル出力形のシフトレジ
スタ３１と、排他的論理和回路（EX-OR回路）３２と、
アンドゲート回路３３とからなる。そして、網点処理回
路２からの二値化信号ＢＳをEX-OR回路３２の一方の入
力端に導入するとともにシフトレジスタ３１に入力し、
このシフトレジスタ３１で前記ディザマトリクスの画素
化点数Ｍ（Ｍは２以上の整数）分だけシフトした画素信
号をアンドゲート回路３３を会して上記EX-OR回路３２
の他方の入力端に導入する。そして、このEX-OR回路３
２の出力を相関処理後の二値化信号ＣＳとして出力す
る。なお、上記アンドゲート回路３３は、クリア信号
（“Ｌ”レベル）CLRによりゲート制御される。
一方復号化部５の相関処理回路７は、例えば第４図に示
す如く排他的論理和回路（EX-OR回路）７１と、シリア
ル入力・パラレル出力形のシフトレジスタ７２と、アン
ドゲート回路７３とから構成される。そして、復号化回
路６からの二値化信号ＥＳをEX-OR回路７１の一方の入
力端に導入し、このEX-OR回路７１の出力信号を処理後
の再生二値化信号ＦＳとして出力するとともにシフトレ
ジスタ７２に入力している。このシフトレジスタ７２
は、上記再生二値化信号ＦＳを前記ディザマトリクスの
画素化点数Ｍだけシフトしたのち端子ＱＤより出力する
ものである。そして相関処理回路７は、上記シフトレジ
スタ７２の出力信号をアンドゲート回路７３を介して前
記EX-OR回路７１の他方の入力端に導入する。なお、ア
ンドゲート回路７３は、クリア信号（“Ｌ”レベル）CL
Rによりゲート制御される。また、CLKはシフトレジスタ
７２のシフトクロックである。
す如く排他的論理和回路（EX-OR回路）７１と、シリア
ル入力・パラレル出力形のシフトレジスタ７２と、アン
ドゲート回路７３とから構成される。そして、復号化回
路６からの二値化信号ＥＳをEX-OR回路７１の一方の入
力端に導入し、このEX-OR回路７１の出力信号を処理後
の再生二値化信号ＦＳとして出力するとともにシフトレ
ジスタ７２に入力している。このシフトレジスタ７２
は、上記再生二値化信号ＦＳを前記ディザマトリクスの
画素化点数Ｍだけシフトしたのち端子ＱＤより出力する
ものである。そして相関処理回路７は、上記シフトレジ
スタ７２の出力信号をアンドゲート回路７３を介して前
記EX-OR回路７１の他方の入力端に導入する。なお、ア
ンドゲート回路７３は、クリア信号（“Ｌ”レベル）CL
Rによりゲート制御される。また、CLKはシフトレジスタ
７２のシフトクロックである。
次に、以上の構成に基づいて本実施例の符号化伝送方式
を説明する。なお、ここでは網点処理回路２で４×４の
ディザマトリクスにより網点処理を行なう場合について
説明を行なう。したがって、各相関処理回路３，７のシ
フトレジスタ３１，７２は、シフト入力した画素を上記
ディザマトリクスに対応して４画素分遅延したのちシフ
ト出力するように構成される。
を説明する。なお、ここでは網点処理回路２で４×４の
ディザマトリクスにより網点処理を行なう場合について
説明を行なう。したがって、各相関処理回路３，７のシ
フトレジスタ３１，７２は、シフト入力した画素を上記
ディザマトリクスに対応して４画素分遅延したのちシフ
ト出力するように構成される。
網点処理回路２から例えば第５図に示すディザパターン
の走査線Ｈに対応する二値化信号ＢＳが出力され、この
信号ＢＳが相関処理回路３に供給されると、この二値化
信号ＢＳ（第６図(a)）はEX-OR回路３２でシフトレジス
タ３１から４画素遅延されて出力された信号ＢＳ′と画
素毎に排他的論理和処理される。このとき、アンドゲー
ト回路３３には、最初の４画素分だ“Ｌ”レベルで５画
素目から“Ｈ”レベルとなるクリア信号CLRが供給され
る。したがって、EX-OR回路３２からは、第６図(a)のよ
うに最初の４画素は二値化信号ＢＳがそのまま出力さ
れ、５画素目から二値化信号ＢＳとシフトレジスタ３１
で４画素遅延された二値化信号との相関がとられた信号
（信号変化情報）が出力される。しかして、信号変化の
少ない二値化信号が符号化回路４に供給され、この結果
符号化データの情報量が低減される。
の走査線Ｈに対応する二値化信号ＢＳが出力され、この
信号ＢＳが相関処理回路３に供給されると、この二値化
信号ＢＳ（第６図(a)）はEX-OR回路３２でシフトレジス
タ３１から４画素遅延されて出力された信号ＢＳ′と画
素毎に排他的論理和処理される。このとき、アンドゲー
ト回路３３には、最初の４画素分だ“Ｌ”レベルで５画
素目から“Ｈ”レベルとなるクリア信号CLRが供給され
る。したがって、EX-OR回路３２からは、第６図(a)のよ
うに最初の４画素は二値化信号ＢＳがそのまま出力さ
れ、５画素目から二値化信号ＢＳとシフトレジスタ３１
で４画素遅延された二値化信号との相関がとられた信号
（信号変化情報）が出力される。しかして、信号変化の
少ない二値化信号が符号化回路４に供給され、この結果
符号化データの情報量が低減される。
一方、復号化回路６で復号化された二値化信号ＥＳが相
関処理回路７に供給されると、この信号ＥＳはEX-OR回
路７１でアンドゲート回路７３を介して供給されたシフ
トレジスタ７２の出力信号ＥＳ′と排他的論理和処理さ
れる。このとき、クリア信号CLRは最初の４画素分が
“Ｌ”レベルで５画素目以後に“Ｈ”レベルとなる。こ
のため、EX-OR回路７１からは、最初の４画素目までは
上記二値化信号ＥＳがそのまま出力されるが、その後は
二値化信号ＥＳとシフトレジスタ７２の出力信号ＥＳ′
との排他的論理和出力ＦＳが第６図(b)のように出力さ
れる。すなわち、送信側で相関処理された二値化信号に
逆相関処理を施こした信号、つまり送信側で相関処理す
る前の二値化信号が再生される。
関処理回路７に供給されると、この信号ＥＳはEX-OR回
路７１でアンドゲート回路７３を介して供給されたシフ
トレジスタ７２の出力信号ＥＳ′と排他的論理和処理さ
れる。このとき、クリア信号CLRは最初の４画素分が
“Ｌ”レベルで５画素目以後に“Ｈ”レベルとなる。こ
のため、EX-OR回路７１からは、最初の４画素目までは
上記二値化信号ＥＳがそのまま出力されるが、その後は
二値化信号ＥＳとシフトレジスタ７２の出力信号ＥＳ′
との排他的論理和出力ＦＳが第６図(b)のように出力さ
れる。すなわち、送信側で相関処理された二値化信号に
逆相関処理を施こした信号、つまり送信側で相関処理す
る前の二値化信号が再生される。
このように、本実施例であれば、隣接するディザパター
ンの各画素レベルが相互に類似するというディザマトリ
クスの二値化信号の性質に着目し、隣接するディザパタ
ーンの対応する位置の画素どうしで相関をとるようにし
たので、一般に“黒”、“白”の変化が多いディザ画情
報の二値化信号でも信号変化の少ない信号に変換するこ
とができ、この結果この二値化信号を符号化した場合に
その情報量を著しく少なくすることができる。したがっ
て、伝送に要する時間を短縮することができる。また、
相関回路３，７は、シフトレジスタとEX-OR回路とアン
ドゲート回路とを用いるだけで極めて簡単に構成できる
ので、装置の複雑化や大形化を招かない。
ンの各画素レベルが相互に類似するというディザマトリ
クスの二値化信号の性質に着目し、隣接するディザパタ
ーンの対応する位置の画素どうしで相関をとるようにし
たので、一般に“黒”、“白”の変化が多いディザ画情
報の二値化信号でも信号変化の少ない信号に変換するこ
とができ、この結果この二値化信号を符号化した場合に
その情報量を著しく少なくすることができる。したがっ
て、伝送に要する時間を短縮することができる。また、
相関回路３，７は、シフトレジスタとEX-OR回路とアン
ドゲート回路とを用いるだけで極めて簡単に構成できる
ので、装置の複雑化や大形化を招かない。
なお、本発明は上記実施例に限定されるものではなく、
例えば相関回路の構成、ディザマトリクスのＭ×Ｎの大
きさ等についても、本発明の要旨を逸脱しない範囲で種
々変形して実施できる。
例えば相関回路の構成、ディザマトリクスのＭ×Ｎの大
きさ等についても、本発明の要旨を逸脱しない範囲で種
々変形して実施できる。
以上詳述したように本発明によれば、相関処理回路ちよ
り、ディザマトリクスにより網点処理して得られた二値
化信号中の互いに隣接するディザマトリクス間で、これ
らのディザマトリクスを構成する各画素毎に相互に位置
が対応する画素間の信号変化を一走査線分ずつ検出し、
その変化信号を符号化に供するようにし、かつ上記相関
処理回路を、１個のシフトレジスタと排他的論理和回路
とにより構成したことによって、ディザ処理された二値
化画情報の黒白変化を減少させて冗長度抑圧符号化後の
情報量を低減し、これにより伝送時間を短縮することが
でき、しかもこれを簡単な回路構成により実現できる中
間調画情報の符号化伝送方式を提供することができる。
り、ディザマトリクスにより網点処理して得られた二値
化信号中の互いに隣接するディザマトリクス間で、これ
らのディザマトリクスを構成する各画素毎に相互に位置
が対応する画素間の信号変化を一走査線分ずつ検出し、
その変化信号を符号化に供するようにし、かつ上記相関
処理回路を、１個のシフトレジスタと排他的論理和回路
とにより構成したことによって、ディザ処理された二値
化画情報の黒白変化を減少させて冗長度抑圧符号化後の
情報量を低減し、これにより伝送時間を短縮することが
でき、しかもこれを簡単な回路構成により実現できる中
間調画情報の符号化伝送方式を提供することができる。
さらに、本発明では、各走査線上でその隣接する画素群
間で位置が対応する画素の比較を行なってその変化を検
出しているので、「Ｎ走査線分の画像データ記憶するラ
インメモリを設けて、ディザ画像をディザマトリクスの
Ｎ×Ｎ画素からなるブロック単位でブロック相互間の変
化を検出する技術」と比べて、相関処理回路としては基
本的に一走査線分の画像データを記憶する１個のシフト
レジスタと排他的論理和回路を設けるだけで良く、この
結果極めて簡単な回路構成で実現できる。
間で位置が対応する画素の比較を行なってその変化を検
出しているので、「Ｎ走査線分の画像データ記憶するラ
インメモリを設けて、ディザ画像をディザマトリクスの
Ｎ×Ｎ画素からなるブロック単位でブロック相互間の変
化を検出する技術」と比べて、相関処理回路としては基
本的に一走査線分の画像データを記憶する１個のシフト
レジスタと排他的論理和回路を設けるだけで良く、この
結果極めて簡単な回路構成で実現できる。
第１図はパターンの一例を示す模式図、第２図〜第６図
(a)，(b)は本発明の一実施例における符号化伝送方式を
説明するためのもので、第２図は同方式を適用した信号
処理装置の構成を示す回路ブロック図、第３図および第
４図はそれぞれ送信側および受信側の相関処理回路の回
路構成図、第５図および第６図(a)，(b)は作用説明に用
いるためのパターン図およびタイミング図である。 １……符号化部、２……網点処理部、３……相関処理回
路、４……符号化回路、５……復号化部、６……復号化
回路、７……相関処理回路、３１，７２……シフトレジ
スタ、３２，７１……排他的論理和処理回路（EX-OR回
路）、３３，７３……アンドゲート回路。
(a)，(b)は本発明の一実施例における符号化伝送方式を
説明するためのもので、第２図は同方式を適用した信号
処理装置の構成を示す回路ブロック図、第３図および第
４図はそれぞれ送信側および受信側の相関処理回路の回
路構成図、第５図および第６図(a)，(b)は作用説明に用
いるためのパターン図およびタイミング図である。 １……符号化部、２……網点処理部、３……相関処理回
路、４……符号化回路、５……復号化部、６……復号化
回路、７……相関処理回路、３１，７２……シフトレジ
スタ、３２，７１……排他的論理和処理回路（EX-OR回
路）、３３，７３……アンドゲート回路。
Claims (1)
- 【請求項１】送信側装置に、アナログ画信号をＭ画素化
点×Ｎ走査線のディザマトリクスにより網点処理してそ
の処理後の二値化信号を一走査線分ずつシリアル出力す
るための網点処理回路と、 この網点処理回路から一走査線分ずつ出力されたシリア
ル二値化信号中の互いに隣接するディザマトリクス間
で、これらのディザマトリクスを構成する各画素毎に相
互に位置が対応する画素間の信号変化を検出し、その変
化信号を一走査線分ずつシリアル出力するための相関処
理回路と、 この相関処理回路から出力された一走査線分の変化信号
を所定の符号化方式に従って符号化し出力するための符
号化回路とを具備し、 かつ前記相関処理回路は、前記網点処理回路から出力さ
れたシリアル二値化信号を一走査線分ずつシリアルに取
り込んで前記Ｍ画素分遅延したのち一走査線分ずつシリ
アルに出力する１個のシフトレジスタと、 このシフトレジスタから一走査線分ずつシリアルに出力
された二値化信号と、同時に前記網点処理回路から一走
査線分ずつシリアルに出力された二値化信号とを画素毎
に排他的論理和処理し、この処理後の信号を前記変化信
号として出力する排他的論理和回路とを備えたことを特
徴とする中間調画情報の符号化伝送方式。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59085644A JPH069375B2 (ja) | 1984-04-27 | 1984-04-27 | 中間調画情報の符号化伝送方式 |
| KR1019850002588A KR890004438B1 (ko) | 1984-04-27 | 1985-04-17 | 중간조 화면정보의 부호화 전송방식 |
| US06/728,275 US4667251A (en) | 1984-04-27 | 1985-04-29 | Method and apparatus for encoding and transmitting picture information of half tones |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59085644A JPH069375B2 (ja) | 1984-04-27 | 1984-04-27 | 中間調画情報の符号化伝送方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60229573A JPS60229573A (ja) | 1985-11-14 |
| JPH069375B2 true JPH069375B2 (ja) | 1994-02-02 |
Family
ID=13864526
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59085644A Expired - Lifetime JPH069375B2 (ja) | 1984-04-27 | 1984-04-27 | 中間調画情報の符号化伝送方式 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4667251A (ja) |
| JP (1) | JPH069375B2 (ja) |
| KR (1) | KR890004438B1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2005112870A1 (en) | 2004-05-21 | 2005-12-01 | Accu-Break Pharmaceuticals, Inc. | Pharmaceutical tablets having a separation mark positioned on the side of said tablets |
Families Citing this family (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US4729034A (en) * | 1985-06-27 | 1988-03-01 | Netexpress Systems, Inc. | Method and apparatus for selection of a coding reference line for two-dimensional coding of image data representing screened images |
| JPS62181576A (ja) * | 1986-02-05 | 1987-08-08 | Fuji Photo Film Co Ltd | 放射線画像情報圧縮方法 |
| US4794461A (en) * | 1986-09-10 | 1988-12-27 | Netexpress Systems, Inc. | Method and apparatus for block coding vertical mode codes for enhanced compression of image data |
| JPH077461B2 (ja) * | 1986-11-14 | 1995-01-30 | コニカ株式会社 | 画像推定方法 |
| US5175807A (en) * | 1986-12-04 | 1992-12-29 | Quantel Limited | Video signal processing with added probabilistic dither |
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