JPH0653351A - 多層配線を有する電子パッケージ基板及び方法 - Google Patents

多層配線を有する電子パッケージ基板及び方法

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JPH0653351A JP5090132A JP9013293A JPH0653351A JP H0653351 A JPH0653351 A JP H0653351A JP 5090132 A JP5090132 A JP 5090132A JP 9013293 A JP9013293 A JP 9013293A JP H0653351 A JPH0653351 A JP H0653351A
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Abstract

(57)【要約】 【目的】 配線チャネルに配置される信号線、及び、バ
イア・チャネルに配置されるバイアを有する多層回路基
板内において、結合ノイズを低減する。 【構成】 使用されないバイア１１０が層を横断し、使
用されない信号線１０６と接続されて電気網を形成す
る。これにより、モジュール全体を通じて結合ノイズが
低減される。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は回路基板或いは集積回路
モジュール上における平行導体間の結合ノイズの低減に
関する。
【０００２】
【従来の技術】高性能集積回路パッケージ、及び特に多
層プリント回路基板を有するパッケージ内において、配
線プレーンには、典型的には多数の導体が互いに平行に
密接して配置される。導体数を増加させる絶縁パッケー
ジ形成のための絶え間ぬ努力が費やされている。これは
しばしば、導体の交差部分をより小径化し、中心間距離
をより接近させることにより達成される。多層基板では
導体の増加は単位厚み当たりの回路層数を増加すること
によっても一般に実現される。
【０００３】ＶＬＳＩチップ、チップ・キャリア、回路
カード、及び回路基板などの様々なレベルのパッケージ
ングにおいて導体密度が増加すると、導体間の結合ノイ
ズ或いはクロス・トークの問題が顕著化する。このノイ
ズは他の平行に走り活動化される導体を流れる電流のス
イッチングにより、静的な導体に誘導される電圧に起因
する。近接領域にある導体が悪影響を受け、活動化され
る導体が影響を及ぼす範囲は信号周波数、寄生容量、イ
ンダクタンス、ソース及び終端インピーダンス、誘電
率、グランド及び電圧プレーン間距離、導体間の平行
度、及び他のファクタに依存する。より多くの導体が配
置されるほど、高周波スイッチングにより誘導される電
圧レベルはデータの検出を誤らせ、結果的に処理エラー
を引き起こす。
【０００４】従来、平行導体間の結合ノイズを低減する
ための数多くの方法が存在する。従来方法の例には、分
離を拡大するために導体サイズを減少する方法、絶縁体
の誘電率を減少する方法、或いはグランド基準プレーン
を近傍に配置する方法などが存在する。これらの方法の
各々はある程度の効果は発揮するものの、それぞれに固
有の問題を有する。例えば、任意のプレーン上における
導体間距離を増加することにより、配線密度が減少す
る。更に同一プレーン或いは隣接プレーン内において、
互いに平行に密接して配置される導体はクロス・トーク
の影響を受けるため、任意のプレーン上における隣接導
体間の距離は受容可能な信号対ノイズ比率を提供するた
めの決定的ファクタとはなり得ない。信号プレーン間に
グランド・プレーンを配置することは有効ではあるが、
製造コストを押し上げ、いずれにしろ同一基板層上の導
体間のクロス・トークを完全に取除くことはできない。
更に、これらの方法の組合せが実施可能であるがこれに
よっても低電圧で動作する導体間における信号対ノイズ
比率を十分に改善することはできない。
【０００５】Ecker 等による米国特許第４７８５１３５
号明細書は電気回路導体間のクロス・トークを低減する
ための構成について述べており、ここでは相互誘導電圧
領域或いはクロス・トーク領域内に存在する導体は、互
いに集中或いは離散するように、平行或いは共通の基板
チャンネルに配置される。Ecker における問題は通常の
平行な位置から導体をシフトすることにより、配線レイ
アウト計算に複雑なファクタを追加する点が挙げられ
る。
【０００６】Deutsh等による米国特許第５００６９１８
号では、集積回路チップ或いはチップ・キャリアの配線
プレーンにおける活動化信号ラインと静的信号ライン間
の結合により引き起こされる遠端配線ノイズが、Ｘ−Ｙ
配線プレーン対における配線層内にフローティング状態
の交差ラインを設けることにより低減される。Deutshは
遠端ノイズの低減を取扱ってはいるが、例えば近端ノイ
ズもまた重要な問題を引き起こす可能性がある。
【０００７】
【発明が解決しようとする課題】したがって、多層回路
基板上における導体間の結合ノイズを更に低減する必要
性が存在し、本発明はこの課題を解決することを目的と
するものである。
【０００８】
【課題を解決するための手段】上述の課題を鑑み、本発
明は複数の配線層の各々における配線チャネルのセット
内に配置される信号線、及びバイア・チャネルのセット
内に配置されるバイアを有する多層回路基板或いは他の
電子基板において、結合ノイズを低減するための装置及
び方法を提供する。本発明の実施例によれば、使用され
ないバイア・チャネル及び配線チャネルにシールド・ラ
インを設けて、これらを相互接続し、電気網（メッシ
ュ）を形成する。これによりモジュール全体を通じて結
合ノイズが低減される。
【０００９】上述の環境状況において、本発明の実施例
により結合ノイズを低減する方法は、不使用の配線チャ
ネル及び不使用のバイア・チャネルのロケーションを決
定するステップ、不使用の配線チャネル及び不使用のバ
イア・チャネル内にシールド・ラインを設けるステッ
プ、及びシールド・ラインを互いに接続すると共に、基
準電圧に対し、少なくとも１個の終端抵抗を介して相互
接続するステップを含む。
【００１０】
【実施例】図１及び図２を参照すると従来の多層回路基
板が示されている。従来通り、図１の回路基板１００は
多数の信号プレーン１０２（Ａ−Ｃ）、及び信号プレー
ン間に配置される銅メッシュ状の多数のグランド・プレ
ーン１０４（Ａ、Ｂ）を含む。各信号プレーンはＸ層１
０９Ａ及びＹ層１０９Ｂを含む。Ｘ層はＸ方向（図１の
内部方向）に導体を走行させる。Ｙ層はＹ方向（図１を
左右に横断する方向）に信号線を走行させる。信号線１
０６及びグランド線１０７は各信号プレーン上の固定配
線チャネル１０８内に配置される。同様に固定バイア・
チャネル１１２内に配置される多数のバイア１１０が層
を横断し、選択的に種々の信号線を相互接続する。従来
通り、多数の配線チャネル１０８及びバイア・チャネル
１１２はエンプティ（不使用）である。
【００１１】図１の回路基板の最上部を除去した様子を
図２に示す。
【００１２】図１及び図２の回路基板において、結合ノ
イズが本明細書の「従来の技術」の欄で述べた多数の要
因により誘導される。本発明はバイア及び信号線の遠端
ノイズ及び近端ノイズの両者を低減する。これは不使用
のバイア及び配線チャネルを導体で充填し、導体を一緒
に電気メッシュとして接続し、メッシュを基準電圧に結
合することにより達成される。メッシュを基準電圧に保
持することにより帰還電流路が提供される。このように
して、近端及び遠端ノイズの低減が達成される。
【００１３】本発明は図３及び図４を参照することによ
り、より理解される。図３及び図４はそれぞれ本発明に
より改善された図１及び図２の回路基板の断面図及び最
上部を除去した図である。図３及び図４に示されるよう
に、導体２０２（好適には銅或いはモリブデンなどの低
抵抗材料）は不使用の配線チャネル１０８及びバイア・
チャネル１１２の各々に配置される。導体は互いに電気
的に接続され、回路基板１００内に導体メッシュを形成
する。この導体メッシュは５Ｋオーム或いはそれ以下の
終端抵抗５０６（図５）を介して、基準電圧に、例えば
基板上の複数のチップ（図示せず）の各々のグランド
（接地）ピン・パッドに結合される。終端抵抗は設計の
制約条件が許す環境においては、完全に取除くことが可
能である。更にノイズをより低減するために、導体メッ
シュを各グランド・プレーンに直接或いは終端抵抗を介
して接続する変更も可能である。
【００１４】本発明の実施例による回路基板の一部の等
角投影図が図５に示され、これにはグランド・プレーン
５０２Ａ、５０２Ｂ及び２枚の信号プレーンが表され
る。図示のように、Ｘ、Ｙの信号線及びバイアは導体に
より形成される導体メッシュ５０４により囲まれる。こ
の導体メッシュ５０４は不使用の配線チャネル及びバイ
ア・チャネル内に配置される。好適には可能な範囲で、
各エンプティ配線チャネル及びバイア・チャネルは導体
により充填され、導体メッシュとして結合される。再
度、導体メッシュは直接或いは終端抵抗を通じて基準電
圧に結合され、更に各グランド・プレーンに電気的に接
続される。
【００１５】上述の環境において、本発明の実施例によ
り結合ノイズを低減する方法は図６に示されるように、
不使用の配線チャネル及び不使用のバイア・チャネルの
ロケーションを決定するステップ（６０２）、不使用の
配線チャネル及び不使用のバイア・チャネル内に配置さ
れるシールド・ラインを提供するステップ（６０４）、
及びシールド・ラインを互いにネットすなわちメッシュ
として相互接続すると共に、基準電圧に対し、少なくと
も１個の終端抵抗を介して相互接続するステップ（６０
６及び６０８）を含む。
【００１６】メッシュを形成するために余分な配線機能
を使用することによる別の利点は、基本ライン・パラメ
ータがより均一な許容差を有することである。ライン・
パラメータは抵抗を除けば環境、すなわち問題のライン
を囲むラインに依存する。今日の回路基板及びモジュー
ルでは、たくさんの配線チャネル及びバイア・チャネル
が不使用であり、これによりオープン領域及び高密度の
配線領域を有する基板或いはモジュールが生成される。
オープン領域を通過するラインは、典型的には高密度領
域を通過するラインとは異なり、異なるライン・パラメ
ータ（すなわち、より高いインピーダンス及びインダク
タンス、及びより低いキャパシタンス）を有する。上述
の導体メッシュを構成するためにオープン領域を取除く
ことにより、より均一な環境が生成され、それによりラ
イン間のパラメータの相違を低減することが可能とな
る。
【００１７】本発明の原理は、回路基板に加えてＶＬＳ
Ｉチップ及び他の電子パッケージングへも適用可能であ
る。
【００１８】
【発明の効果】以上説明したように、本発明によれば多
層回路基板上における導体間の結合ノイズを低減するこ
とが可能となる。
【図面の簡単な説明】
【図１】多数の不使用配線チャネル及びバイア・チャネ
ルを有する多層回路基板の断面図である。
【図２】図１の回路基板の上面図である。
【図３】本発明の実施例による改善された回路基板の断
面図である。
【図４】図３の回路基板の上面図である。
【図５】本発明の実施例による回路基板の一部の等角投
影図（基板は表していない）である。
【図６】本発明の実施例により図１及び図２の回路基板
において、結合ノイズを低減する方法の流れ図である。
【符号の説明】
１００ 回路基板 １０２ 信号プレーン １０４ グランド・プレーン １０６ 信号線 １０７ グランド線 １０８ 固定配線チャネル １１２ 固定バイア・チャネル ５０６ 終端抵抗 ５０４ 導体メッシュ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ロジャー・アラン・リペンス アメリカ合衆国12578、ニューヨーク州ソ ルト・ポイント、ティンカータウン・ロー ド 254

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】複数層の各々の配線チャネルのセット内に
    配置される複数の信号線と、バイア・チャネルのセット
    内に配置され、前記層を横断して延びて前期信号線を電
    気網に接続する複数のバイアとを含み、配線チャネル数
    が信号線数よりも大きく、前記バイア・チャネル数がバ
    イア数よりも大きい、多層配線を有する電子パッケージ
    基板において、結合ノイズを低減する方法であって、 不使用の配線チャネル及び不使用のバイア・チャネルの
    ロケーションを決定するステップと、 不使用の配線チャネル及び不使用のバイア・チャネル内
    にシールド・ラインを設けるステップと、 シールド・ラインを互いに接続すると共に、基準電圧に
    電気的に相互接続するステップと、 を含むことを特徴とする方法。
  2. 【請求項２】前記電気的に相互接続するステップは、シ
    ールド・ラインを回路基板上のチップのグランド・ピン
    ・パッドに、終端抵抗を介して結合するステップを含む
    ことを特徴とする請求項１記載の方法。
  3. 【請求項３】前記電気的に相互接続するステップは、シ
    ールド・ラインを回路基板のグランド・プレーンに電気
    的に接続するステップを含むことを特徴とする請求項１
    記載の方法。
  4. 【請求項４】複数のプレーンの各々の配線チャネルのセ
    ット内に配置される複数の信号線と、前記信号線を電気
    網に接続するためにバイア・チャネルのセット内に配置
    されプレーンを横断する複数のバイアとを含み、、配線
    チャネルの数が信号線数よりも大きく、前記バイア・チ
    ャネルの数がバイア数よりも大きい電子パッケージ基板
    であって、 使用されない配線チャネル及び使用されないバイア・チ
    ャネル内に各々配置された複数の電気的導体を含み、 前記電気的導体は互いに接続され且つ基準電圧に電気的
    に相互接続されることを特徴とする基板。
  5. 【請求項５】前記電気的導体は基板のグランド・プレー
    ンに電気的に接続されることを特徴とする請求項４記載
    の基板。
JP5090132A 1992-05-20 1993-04-16 多層配線を有する電子パッケージ基板及び方法 Expired - Lifetime JPH0770837B2 (ja)

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