JPH0630191B2 - Ｖｔｒのキヤプスタンサ−ボ回路 - Google Patents
Ｖｔｒのキヤプスタンサ−ボ回路Info
- Publication number
- JPH0630191B2 JPH0630191B2 JP60162274A JP16227485A JPH0630191B2 JP H0630191 B2 JPH0630191 B2 JP H0630191B2 JP 60162274 A JP60162274 A JP 60162274A JP 16227485 A JP16227485 A JP 16227485A JP H0630191 B2 JPH0630191 B2 JP H0630191B2
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- JP
- Japan
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- speed
- servo circuit
- circuit
- phase
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はＶＴＲのキャプスタンサーボ回路に関する。
キャプスタンモータの比較的長周期の速度ドリフト、定
数ばらつきなどを検出してこれを補正する回路を付加
し、テープ長手方向に記録したコントロール信号の再生
信号を参照して動作する位相サーボ回路の出力と切替可
能にし、これによってアセンプリ編集のとき、編集点で
再生モードから記録モードに切換えても一定トラックピ
ッチが保たれるようにしたものである。
数ばらつきなどを検出してこれを補正する回路を付加
し、テープ長手方向に記録したコントロール信号の再生
信号を参照して動作する位相サーボ回路の出力と切替可
能にし、これによってアセンプリ編集のとき、編集点で
再生モードから記録モードに切換えても一定トラックピ
ッチが保たれるようにしたものである。
第４図は従来から知られているＶＴＲのキャプスタンサ
ーボ回路で、特にアセンブリ編集を考慮した工夫がなさ
れている（特公昭４９−１８８０５号明細書参照）。
ーボ回路で、特にアセンブリ編集を考慮した工夫がなさ
れている（特公昭４９−１８８０５号明細書参照）。
第４図で、キャプスタンモータ１の軸に取付けられた周
波数発電機から例えば４５０Hzで２相（９０゜位相差）
の速度信号ＦＧ（Ａ）、ＦＧ（Ｂ）を得て、周波数／電
圧変換部ｆ／ｖを有する周知の速度サーボ回路２に与
え、その出力の速度制御電圧をａ入力として加算アンプ
３を通じてキャプスタンモータ１に供給してループ制御
により一定テープスピードを得ている。
波数発電機から例えば４５０Hzで２相（９０゜位相差）
の速度信号ＦＧ（Ａ）、ＦＧ（Ｂ）を得て、周波数／電
圧変換部ｆ／ｖを有する周知の速度サーボ回路２に与
え、その出力の速度制御電圧をａ入力として加算アンプ
３を通じてキャプスタンモータ１に供給してループ制御
により一定テープスピードを得ている。
一方、再生時には、テープ長手方向に記録したコントロ
ール信号（３０Hz）の再生信号ＰＢ−ＣＴＬと、ドラム
モータの回転基準にも使用している３０Hzの基準信号Ｒ
ＥＦとを、位相比較部φを有する位相サーボ回路４に与
え、位相誤差出力を加算アンプ３のｂ入力から速度制御
電圧に加え、ＰＢ−ＣＴＬとＲＥＦとが一致するように
キャプスタンモータ１の回転位相を制御している。
ール信号（３０Hz）の再生信号ＰＢ−ＣＴＬと、ドラム
モータの回転基準にも使用している３０Hzの基準信号Ｒ
ＥＦとを、位相比較部φを有する位相サーボ回路４に与
え、位相誤差出力を加算アンプ３のｂ入力から速度制御
電圧に加え、ＰＢ−ＣＴＬとＲＥＦとが一致するように
キャプスタンモータ１の回転位相を制御している。
速度信号ＦＧ（Ａ）、ＦＧ（Ｂ）を計算するＦＧカウン
タ５を設け、記録時ＲＥＣには３０Hzの分周出力を再生
コントロール信号ＰＢ−ＣＴＬの代りに切換スイッチ６
を介して位相サーボ回路４に供給している。
タ５を設け、記録時ＲＥＣには３０Hzの分周出力を再生
コントロール信号ＰＢ−ＣＴＬの代りに切換スイッチ６
を介して位相サーボ回路４に供給している。
アセンブリ編集ＡＳＳ又はつなぎ撮りのときには、編集
点よりテープを少し巻戻し、一旦再生モードにしてから
編集点以後、記録モードに切換える。再生モード中に、
ＦＧカウンタ５を再生コントロール信号ＰＢ−ＣＴＬで
リセット（強制同期）させると、編集点以後、自己リセ
ット（自走）するＦＧカウンタ５の出力はＰＢ−ＣＬＴ
の位相情報を保つ。従って編集点の前後でトラックピッ
チが不連続に乱れることが無い。
点よりテープを少し巻戻し、一旦再生モードにしてから
編集点以後、記録モードに切換える。再生モード中に、
ＦＧカウンタ５を再生コントロール信号ＰＢ−ＣＴＬで
リセット（強制同期）させると、編集点以後、自己リセ
ット（自走）するＦＧカウンタ５の出力はＰＢ−ＣＬＴ
の位相情報を保つ。従って編集点の前後でトラックピッ
チが不連続に乱れることが無い。
第４図のサーボ回路は、速度信号ＦＧ（Ａ）、ＦＧ
（Ｂ）の周波数がＰＢ−ＣＴＬ（３０Hz）の整数倍であ
ることを前提にしている。非整数倍（端数がある）であ
ると、ＦＧカウンタ５がＰＢ−ＣＴＬによる強制リセッ
トから自走に切換わったとき、３０Hz出力が例えば３１
Hzに変化し、編集点前後でのトラックの連続性を保てな
くなる。このことはサーボループに含まれる機械系、特
にキャプスタンの径を精度を激しく管理しなければなら
ないことを意味する。例えばキャプスタン径が標準より
太ければ、テープが基準速度で走っているときのＦＧ周
波数は小さくなり、従ってＦＧカウンタ５による分周出
力も３０Hzより小さくなってしまう。同様に周波数発電
機も高精度にしなければならない。
（Ｂ）の周波数がＰＢ−ＣＴＬ（３０Hz）の整数倍であ
ることを前提にしている。非整数倍（端数がある）であ
ると、ＦＧカウンタ５がＰＢ−ＣＴＬによる強制リセッ
トから自走に切換わったとき、３０Hz出力が例えば３１
Hzに変化し、編集点前後でのトラックの連続性を保てな
くなる。このことはサーボループに含まれる機械系、特
にキャプスタンの径を精度を激しく管理しなければなら
ないことを意味する。例えばキャプスタン径が標準より
太ければ、テープが基準速度で走っているときのＦＧ周
波数は小さくなり、従ってＦＧカウンタ５による分周出
力も３０Hzより小さくなってしまう。同様に周波数発電
機も高精度にしなければならない。
更に、記録モード又はアセンブルモードのときには位相
サーボ系が働らかないので、キャプスタン径のばらつき
や、速度サーボ回路２の温度特性、経時変化でテープ速
度が基準値からずれてしまう問題もある。
サーボ系が働らかないので、キャプスタン径のばらつき
や、速度サーボ回路２の温度特性、経時変化でテープ速
度が基準値からずれてしまう問題もある。
本発明はこの問題にかんがみ、アセンブリ編集に対応で
きしかも機械系に高精度を必要としないキャプスタンサ
ーボ回路を提供することを目的とする。
きしかも機械系に高精度を必要としないキャプスタンサ
ーボ回路を提供することを目的とする。
本発明のキャプスタンサーボ回路は、第１図に示すよう
に、周波数発電機の出力の一定期間内（例えば２秒間）
のパルス数計測値又は所定パルス数に対応した時間計測
値について、基準からのずれ量を検出して電圧に変換す
る速度偏差補償回路７を具備している。そして位相サー
ボ回路４及び速度偏差補償回路７の各出力を切換スイッ
チ６で選択して速度サーボ回路２の出力の速度制御電圧
に加算するように構成されている。
に、周波数発電機の出力の一定期間内（例えば２秒間）
のパルス数計測値又は所定パルス数に対応した時間計測
値について、基準からのずれ量を検出して電圧に変換す
る速度偏差補償回路７を具備している。そして位相サー
ボ回路４及び速度偏差補償回路７の各出力を切換スイッ
チ６で選択して速度サーボ回路２の出力の速度制御電圧
に加算するように構成されている。
モータ速度の長周期のドリフト、機器ごとのばらつきな
どが補正される。アセンブリ編集時、編集点で再生から
記録へ切換えたときに、速度偏差補償回路が位相サーボ
回路と相補的に機能し、編集点前後のトラック位相の連
続性が保たれる。
どが補正される。アセンブリ編集時、編集点で再生から
記録へ切換えたときに、速度偏差補償回路が位相サーボ
回路と相補的に機能し、編集点前後のトラック位相の連
続性が保たれる。
第１図は本発明を適用したキャプスタンサーボ回路を示
す。速度サーボ回路２及び位相サーボ回路４に加えて速
度偏差補償回路７が付加されている。この補償回路７は
記録時に動作し、比較的長い周期（数秒）で速度信号Ｆ
Ｇのパルス数を計数し、計数値と基準値との偏差を電圧
として導出するように成っている。
す。速度サーボ回路２及び位相サーボ回路４に加えて速
度偏差補償回路７が付加されている。この補償回路７は
記録時に動作し、比較的長い周期（数秒）で速度信号Ｆ
Ｇのパルス数を計数し、計数値と基準値との偏差を電圧
として導出するように成っている。
速度信号ＦＧ（Ａ）、ＦＧ（Ｂ）はＥＸ−ＯＲ８で２逓
倍され、ＦＧカウンタ９で計数される。カウンタ９の計
数（ゲート）区間は例えば２秒ごとで、ゲート信号がイ
ネーブル入力に与えられるごとにコンパレータ１０（又
は減算器）にカウント値が導出され、基準ＦＧカウント
値発生回路１１からの基準値と比較される。比較結果の
誤差分はＤ／Ａコンバータ１２で電圧値に変換され、オ
フセット回路１３で適当なオフセット値が付加されてか
ら、切換スイッチ６のＲＥＣ側を経てｂ入力として加算
アンプ３に加えられる。なおオフセット回路１３は可変
抵抗ＶＲを備え、アッテネータとしても機能し、偏差補
償回路７を含むループのゲインを調整するためにも用い
られる。
倍され、ＦＧカウンタ９で計数される。カウンタ９の計
数（ゲート）区間は例えば２秒ごとで、ゲート信号がイ
ネーブル入力に与えられるごとにコンパレータ１０（又
は減算器）にカウント値が導出され、基準ＦＧカウント
値発生回路１１からの基準値と比較される。比較結果の
誤差分はＤ／Ａコンバータ１２で電圧値に変換され、オ
フセット回路１３で適当なオフセット値が付加されてか
ら、切換スイッチ６のＲＥＣ側を経てｂ入力として加算
アンプ３に加えられる。なおオフセット回路１３は可変
抵抗ＶＲを備え、アッテネータとしても機能し、偏差補
償回路７を含むループのゲインを調整するためにも用い
られる。
速度偏差補償回路７は、キャプスタンの回転周期より短
い速度変動については補正能力が無いが、定常的な速度
誤差、例えば速度サーボ回路２を含む速度サーボ系の温
度ドリフト、経時変化、機器ごとのばらつきなどを補償
して一定値に収束させる働きをする。
い速度変動については補正能力が無いが、定常的な速度
誤差、例えば速度サーボ回路２を含む速度サーボ系の温
度ドリフト、経時変化、機器ごとのばらつきなどを補償
して一定値に収束させる働きをする。
例えば、ＦＧ周波数を９００Hz（２ＦＧ）とすると、２
秒間でＦＧカウンタ９は１８００パルス計数するから、
１１ビットカウンタ（２０４８進）をＦＧカウンタ９に
用いる。偏差検出精度は１パルス当り１／１８００＝0.
055 ％であるから、速度偏差を概ね±0.1 ％以内に納め
ることができる。なおコンパレータ１０の出力は偏差分
のみであるから、Ｄ／Ａコンバータ１２のビット数は５
ビット以下でよい。
秒間でＦＧカウンタ９は１８００パルス計数するから、
１１ビットカウンタ（２０４８進）をＦＧカウンタ９に
用いる。偏差検出精度は１パルス当り１／１８００＝0.
055 ％であるから、速度偏差を概ね±0.1 ％以内に納め
ることができる。なおコンパレータ１０の出力は偏差分
のみであるから、Ｄ／Ａコンバータ１２のビット数は５
ビット以下でよい。
アセンブリ編集時には、既述のように編集点よりテープ
を少し戻し、切換スイッチ６をＰＢ側にして一旦再生モ
ードにする。この再生モードで速度サーボ回路２のみが
機能していると仮定すると、キャプスタンモータ１は一
応定速で回転するが、キャプスタン径のばらつきや速度
サーボ目標値の温度ドリフト、経時変化等に応じて再生
コントロール信号ＰＢ−ＣＴＬは基準の３０Hzからずれ
ている。ここで位相サーボ回路４を働らかせると、正確
に３０Hzの再生コントロール信号ＰＢ−ＣＴＬが基準信
号ＲＥＦに位相同期して得られるようにモータ速度及び
回転位相が調整される。このＰＢ−ＣＬＴを参照したサ
ーボにより、再生時には記録時と全く同一のテープ速度
が再現されることになる。
を少し戻し、切換スイッチ６をＰＢ側にして一旦再生モ
ードにする。この再生モードで速度サーボ回路２のみが
機能していると仮定すると、キャプスタンモータ１は一
応定速で回転するが、キャプスタン径のばらつきや速度
サーボ目標値の温度ドリフト、経時変化等に応じて再生
コントロール信号ＰＢ−ＣＴＬは基準の３０Hzからずれ
ている。ここで位相サーボ回路４を働らかせると、正確
に３０Hzの再生コントロール信号ＰＢ−ＣＴＬが基準信
号ＲＥＦに位相同期して得られるようにモータ速度及び
回転位相が調整される。このＰＢ−ＣＬＴを参照したサ
ーボにより、再生時には記録時と全く同一のテープ速度
が再現されることになる。
ここで記録時には、速度偏差補償回路７が機能した状態
でテープ速度制御が行われ、テープ側縁に３０Hzの基準
信号に基いてコントロール信号が記録されることに注意
すべきである。つまり再生モードでは、位相サーボ回路
４が速度偏差補償回路７の代用をしていると考えること
ができ、一方、位相サーボがかかった状態では、速度偏
差補償回路７のＦＧカウンタ９は例えば１８００パルス
／２秒の偏差のない基準値相当の計数を行っていると考
えてよい。このためアセンブリ編集点において切換スイ
ッチ６をＰＢ側からＲＥＣ＋ＡＳＳ側に切換えても、キ
ャプスタンモータ１に加わる電圧は殆ど変化しない。そ
してモータの慣性により編集点の前後でトラック位相及
びＣＴＬ間隔の連続性は保たれている。編集点以後は、
逆に速度編集補償回路７が位相サーボ回路４の代用とな
って機能しモータ速度を一定値に安定化させることにな
る。
でテープ速度制御が行われ、テープ側縁に３０Hzの基準
信号に基いてコントロール信号が記録されることに注意
すべきである。つまり再生モードでは、位相サーボ回路
４が速度偏差補償回路７の代用をしていると考えること
ができ、一方、位相サーボがかかった状態では、速度偏
差補償回路７のＦＧカウンタ９は例えば１８００パルス
／２秒の偏差のない基準値相当の計数を行っていると考
えてよい。このためアセンブリ編集点において切換スイ
ッチ６をＰＢ側からＲＥＣ＋ＡＳＳ側に切換えても、キ
ャプスタンモータ１に加わる電圧は殆ど変化しない。そ
してモータの慣性により編集点の前後でトラック位相及
びＣＴＬ間隔の連続性は保たれている。編集点以後は、
逆に速度編集補償回路７が位相サーボ回路４の代用とな
って機能しモータ速度を一定値に安定化させることにな
る。
以上のように、本発明では第４図のようなＦＧカウンタ
５をＰＢ−ＣＴＬで強制リセットする位相同期方式を採
用していないので、ＦＧ周波数が３０Hzの端数の無い整
数倍である必要が無い。従ってキャプスタン径の設計自
由度が増し、多小の径のぼろつきも許容できるようにな
る。また速度サーボ回路２を含む速度サーボ系の目標値
が温度ドリフトや経時変化、装置ごとのばらつきに起因
して変化しても、これらが補正され、安定なテープ速度
が得られる。
５をＰＢ−ＣＴＬで強制リセットする位相同期方式を採
用していないので、ＦＧ周波数が３０Hzの端数の無い整
数倍である必要が無い。従ってキャプスタン径の設計自
由度が増し、多小の径のぼろつきも許容できるようにな
る。また速度サーボ回路２を含む速度サーボ系の目標値
が温度ドリフトや経時変化、装置ごとのばらつきに起因
して変化しても、これらが補正され、安定なテープ速度
が得られる。
なお第２図に示すようなマイクロコンピュータ１５にＦ
Ｇカウンタ＋コンバレータの機能１６を付加してもよ
い。このマイクロコンピュータ１５にはキャプスタンモ
ータ１の立上り時にモータ速度を基準値に速かにロック
させるインスタントスタート機能１７が与えられてい
て、機能１６と１７とはセレクタ１８によって選択利用
される。
Ｇカウンタ＋コンバレータの機能１６を付加してもよ
い。このマイクロコンピュータ１５にはキャプスタンモ
ータ１の立上り時にモータ速度を基準値に速かにロック
させるインスタントスタート機能１７が与えられてい
て、機能１６と１７とはセレクタ１８によって選択利用
される。
また第３図に示すように、ＦＧカウンタ２０によってＦ
Ｇパルスを所定数計数し、その所定数の時間間隔をクロ
ックパルスＣＫに基いて時間計測回路２１で計測し、こ
の計測値と基準値発生回路２２からの基準値とをコンパ
レータ２３で比較し、誤差分をＤ／Ａコンバータ２４か
ら切換スイッチ６を介してキャプスタンモータ１に導出
してもよい。
Ｇパルスを所定数計数し、その所定数の時間間隔をクロ
ックパルスＣＫに基いて時間計測回路２１で計測し、こ
の計測値と基準値発生回路２２からの基準値とをコンパ
レータ２３で比較し、誤差分をＤ／Ａコンバータ２４か
ら切換スイッチ６を介してキャプスタンモータ１に導出
してもよい。
更に、第１図の構成において、ＦＧカウンタ９の基準計
数値、例えば１８００パルス／２秒をカウンタのセンタ
ー値として定め、実際の計数値の上記センター値からの
ずれをカウンタの下位桁から必要があればデコーダを介
してＤ／Ａコンバータ１２に導出するように構成しても
よい。この構成ではコンパレータ１０や基準ＦＧカウン
ト値発生回路１１は不要になる。
数値、例えば１８００パルス／２秒をカウンタのセンタ
ー値として定め、実際の計数値の上記センター値からの
ずれをカウンタの下位桁から必要があればデコーダを介
してＤ／Ａコンバータ１２に導出するように構成しても
よい。この構成ではコンパレータ１０や基準ＦＧカウン
ト値発生回路１１は不要になる。
本発明は上述の如く、速度偏差補償回路を設けたので、
キャプスタンモータ速度の比較的長周期のドリフト、機
器ごとのばらつき等を吸収して回転速度を安定化させる
ことができる。またアセンブル編集時に位相サーボ回路
の出力と速度編集補償回路の出力とを切換えて用い、編
集点前後のトラックピッチの連続性を保つことができ
る。この点については、従来のようなカウンタ同期式
（第４図）を用いていないので、周波数発電機の出力周
波数が３０Hzの再生コントロール信号の整数倍である必
要が無く、キャプスタン径などの機械系の許容精度が低
くてよく、サーボ精度を向上させながらコスト低減が図
れる。
キャプスタンモータ速度の比較的長周期のドリフト、機
器ごとのばらつき等を吸収して回転速度を安定化させる
ことができる。またアセンブル編集時に位相サーボ回路
の出力と速度編集補償回路の出力とを切換えて用い、編
集点前後のトラックピッチの連続性を保つことができ
る。この点については、従来のようなカウンタ同期式
（第４図）を用いていないので、周波数発電機の出力周
波数が３０Hzの再生コントロール信号の整数倍である必
要が無く、キャプスタン径などの機械系の許容精度が低
くてよく、サーボ精度を向上させながらコスト低減が図
れる。
第１図は本発明を適用したＶＴＲのキャプスタンサーボ
回路のブロック図、第２図は第１図の速度偏差補償回路
をマイクロコンピュータで構成するときの概念図、第３
図は速度偏差補償回路の変形例を示すブロック図、第４
図は従来のキャプスタンサーボ回路のブロック図であ
る。 なお図面に用いられた符号において、 １……キャプスタンモータ ２……速度サーボ回路 ３……加算アンプ ４……位相サーボ回路 ６……切換スイッチ ７……速度偏差補償回路 である。
回路のブロック図、第２図は第１図の速度偏差補償回路
をマイクロコンピュータで構成するときの概念図、第３
図は速度偏差補償回路の変形例を示すブロック図、第４
図は従来のキャプスタンサーボ回路のブロック図であ
る。 なお図面に用いられた符号において、 １……キャプスタンモータ ２……速度サーボ回路 ３……加算アンプ ４……位相サーボ回路 ６……切換スイッチ ７……速度偏差補償回路 である。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭61−187147（ＪＰ，Ａ) 特開 昭59−124054（ＪＰ，Ａ) 実開 昭52−150314（ＪＰ，Ｕ) 特公 昭49−18805（ＪＰ，Ｂ１)
Claims (1)
- 【請求項１】周波数発電機の出力に基いてキャプスタン
モータの回転数を一定に保つための速度制御電圧を出力
する速度サーボ回路と、 再生時に基準信号とテープ長手方向に記録された一定周
期のコントロール信号との位相が一致するように位相制
御電圧を出力する位相サーボ回路と、 上記周波数発電機の出力の一定時間内のパルス数計測値
又は所定パルス数に対応した時間計測値について、基準
からのずれ量を検出して電圧に変換する速度偏差補償回
路とを具備し、 上記位相サーボ回路及び速度偏差補償回路の各出力を切
換スイッチで選択して上記速度サーボ回路の出力の速度
制御電圧に加算するように構成したＶＴＲのキャプスタ
ンサーボ回路。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60162274A JPH0630191B2 (ja) | 1985-07-23 | 1985-07-23 | Ｖｔｒのキヤプスタンサ−ボ回路 |
| CA000514294A CA1270946A (en) | 1985-07-23 | 1986-07-21 | Capstan servo circuit |
| AT86305617T ATE65634T1 (de) | 1985-07-23 | 1986-07-22 | Servosystem fuer eine antriebsrolle. |
| EP86305617A EP0210822B1 (en) | 1985-07-23 | 1986-07-22 | Capstan servo system |
| US06/887,954 US4698703A (en) | 1985-07-23 | 1986-07-22 | Capstan servo system |
| DE8686305617T DE3680411D1 (de) | 1985-07-23 | 1986-07-22 | Servosystem fuer eine antriebsrolle. |
| KR1019860005971A KR950000417B1 (ko) | 1985-07-23 | 1986-07-23 | Vtr의 캡스턴 서보 시스템 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60162274A JPH0630191B2 (ja) | 1985-07-23 | 1985-07-23 | Ｖｔｒのキヤプスタンサ−ボ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6222257A JPS6222257A (ja) | 1987-01-30 |
| JPH0630191B2 true JPH0630191B2 (ja) | 1994-04-20 |
Family
ID=15751349
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60162274A Expired - Fee Related JPH0630191B2 (ja) | 1985-07-23 | 1985-07-23 | Ｖｔｒのキヤプスタンサ−ボ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0630191B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4920818B2 (ja) * | 2000-09-22 | 2012-04-18 | 健 矢野 | パンチング装置およびパンチングシステム |
-
1985
- 1985-07-23 JP JP60162274A patent/JPH0630191B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6222257A (ja) | 1987-01-30 |
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