JPH0564091A - ビデオカメラ - Google Patents
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- JPH0564091A JPH0564091A JP3223832A JP22383291A JPH0564091A JP H0564091 A JPH0564091 A JP H0564091A JP 3223832 A JP3223832 A JP 3223832A JP 22383291 A JP22383291 A JP 22383291A JP H0564091 A JPH0564091 A JP H0564091A
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- H04N5/765—Interface circuits between an apparatus for recording and another apparatus
- H04N5/77—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera
- H04N5/772—Interface circuits between an apparatus for recording and another apparatus between a recording apparatus and a television camera the recording apparatus and the television camera being placed in the same enclosure
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- H04N5/78—Television signal recording using magnetic recording
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- H04N9/80—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
- H04N9/804—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback involving pulse code modulation of the colour picture signal components
- H04N9/8042—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback involving pulse code modulation of the colour picture signal components involving data reduction
Abstract
(57)【要約】
【目的】 固体撮像素子の信号読み出し速度を、ダイナ
ミックＲＡＭに整合させながら、通常のテレビレートよ
り遅くできるビデオカメラを提供する。 【構成】 ＤＲＡＭ８，９の高速ページモードにおける
同一ＲＡＳアドレスに書き込むための最大許容時間を１
００マイクロ秒、固体撮像素子３の水平画素数を１０２
４画素とすると、１画素当たりの最長転送所要時間は、 １００÷１０２４≒０．０９７６６ マイクロ秒 となる。パルス発生器１５の原発振クロックを５０メガ
ヘルツとすると、このクロック周期（２０ナノ秒）の整
数倍の時間を固体撮像素子３の実際の転送クロック周期
として選ぶことになり、８０ナノ秒となる。以上の条件
で固体撮像素子３の信号読み出しをすることにより、ダ
イナミックＲＡＭに整合した動作が得られる。
ミックＲＡＭに整合させながら、通常のテレビレートよ
り遅くできるビデオカメラを提供する。 【構成】 ＤＲＡＭ８，９の高速ページモードにおける
同一ＲＡＳアドレスに書き込むための最大許容時間を１
００マイクロ秒、固体撮像素子３の水平画素数を１０２
４画素とすると、１画素当たりの最長転送所要時間は、 １００÷１０２４≒０．０９７６６ マイクロ秒 となる。パルス発生器１５の原発振クロックを５０メガ
ヘルツとすると、このクロック周期（２０ナノ秒）の整
数倍の時間を固体撮像素子３の実際の転送クロック周期
として選ぶことになり、８０ナノ秒となる。以上の条件
で固体撮像素子３の信号読み出しをすることにより、ダ
イナミックＲＡＭに整合した動作が得られる。
Description
【０００１】
【産業上の利用分野】本発明は、ＣＣＤ等の固体撮像素
子のデータをメモリに記憶するビデオカメラに関する。
子のデータをメモリに記憶するビデオカメラに関する。
【０００２】
【従来の技術】まず通常のＣＣＤ等の固体撮像素子の駆
動のためのタイミングを示す。図５，図６には、説明の
ために必要な部分のみを示している。図５で１０１はＣ
ＣＤ、１０２はサンプルホールド回路、１０３はタイミ
ング信号発生回路である。図６でａはＣＣＤの出力、ｂ
はサンプルホールドパルスでタイミング信号発生回路１
０３から発生される。ｃはサンプルホールド後の信号で
ある。
動のためのタイミングを示す。図５，図６には、説明の
ために必要な部分のみを示している。図５で１０１はＣ
ＣＤ、１０２はサンプルホールド回路、１０３はタイミ
ング信号発生回路である。図６でａはＣＣＤの出力、ｂ
はサンプルホールドパルスでタイミング信号発生回路１
０３から発生される。ｃはサンプルホールド後の信号で
ある。
【０００３】従来、固体撮像素子１０１の１フィールド
分の画素信号を、テレビの標準方式の１フィールドの周
期で読み出している。ところで、固体撮像素子の画素数
が近年多くなり、１水平ライン当たりの転送画素数が多
くなってきている。
分の画素信号を、テレビの標準方式の１フィールドの周
期で読み出している。ところで、固体撮像素子の画素数
が近年多くなり、１水平ライン当たりの転送画素数が多
くなってきている。
【０００４】
【発明が解決しようとする課題】ところで、転送画素数
が増大すると、画素当たりの転送時間が短くなり、転送
不良や固体撮像素子１０１の１画素当たり出力信号の時
間幅が短すぎて、サンプルホールドのタイミング精度が
厳しくなったり、固体撮像素子１０１の信号をＡ−Ｄ変
換してディジタル化する場合など、高速で動作するＡ−
Ｄ変換器が必要になってくる。
が増大すると、画素当たりの転送時間が短くなり、転送
不良や固体撮像素子１０１の１画素当たり出力信号の時
間幅が短すぎて、サンプルホールドのタイミング精度が
厳しくなったり、固体撮像素子１０１の信号をＡ−Ｄ変
換してディジタル化する場合など、高速で動作するＡ−
Ｄ変換器が必要になってくる。
【０００５】このような原因で、結果的に固体撮像素子
の歩留りの低下を招いたり、固体撮像素子周辺の回路を
複雑なものにしている。
の歩留りの低下を招いたり、固体撮像素子周辺の回路を
複雑なものにしている。
【０００６】また、必要以上に遅く読み出すと、固体撮
像素子の信号をメモリに蓄えたりする際に、転送時間が
長くなったりして、カメラとしては、連写速度が遅くな
るなどの弊害がある。
像素子の信号をメモリに蓄えたりする際に、転送時間が
長くなったりして、カメラとしては、連写速度が遅くな
るなどの弊害がある。
【０００７】本発明は、このような事情に鑑みてなされ
たもので、固体撮像素子のデータをダイナミックＲＡＭ
（以下ＤＲＡＭという）に記憶させるビデオカメラにお
いて、固体撮像素子の信号読み出し速度をダイナミック
ＲＡＭに整合させながら、通常のテレビレートより遅く
できるビデオカメラを提供することを目的とする。
たもので、固体撮像素子のデータをダイナミックＲＡＭ
（以下ＤＲＡＭという）に記憶させるビデオカメラにお
いて、固体撮像素子の信号読み出し速度をダイナミック
ＲＡＭに整合させながら、通常のテレビレートより遅く
できるビデオカメラを提供することを目的とする。
【０００８】
【課題を解決するための手段】前記目的を達成するた
め、本発明では、ビデオカメラをつぎの（１），（２）
のとおりに構成する。
め、本発明では、ビデオカメラをつぎの（１），（２）
のとおりに構成する。
【０００９】（１）固体撮像素子と、該固体撮像素子の
信号を読み出すための転送パルスを供給するパルス発生
器と、前記固体撮像素子から読み出された信号をディジ
タル信号に変換するＡ−Ｄ変換器と、該ディジタル信号
を記憶させるための高速ページモードで動作するダイナ
ミックＲＡＭとを備えたビデオカメラであって、前記固
体撮像素子の少なくとも１ラインを読み出すのに要する
時間が、前記高速ページモードにおける同一ＲＡＳアド
レスに書き込むための最大許容時間より短く、かつ前記
転送パルスの周期が前記パルス発生器の原発振クロック
の周期の整数倍の周期である読み出し手段を備えたビデ
オカメラ。
信号を読み出すための転送パルスを供給するパルス発生
器と、前記固体撮像素子から読み出された信号をディジ
タル信号に変換するＡ−Ｄ変換器と、該ディジタル信号
を記憶させるための高速ページモードで動作するダイナ
ミックＲＡＭとを備えたビデオカメラであって、前記固
体撮像素子の少なくとも１ラインを読み出すのに要する
時間が、前記高速ページモードにおける同一ＲＡＳアド
レスに書き込むための最大許容時間より短く、かつ前記
転送パルスの周期が前記パルス発生器の原発振クロック
の周期の整数倍の周期である読み出し手段を備えたビデ
オカメラ。
【００１０】（２）読み出し手段は、固体撮像素子の少
なくとも１ラインを読み出すのに要する時間が、テレビ
の標準方式の水平同期周期より長い前記（１）記載のビ
デオカメラ。
なくとも１ラインを読み出すのに要する時間が、テレビ
の標準方式の水平同期周期より長い前記（１）記載のビ
デオカメラ。
【００１１】
【作用】前記（１），（２）の構成により、固体撮像素
子の少なくとも１ラインが、ダイナミックＲＡＭの高速
ページモードにおける同一ＲＡＳに書き込むための最大
許容時間内に読み出される。（２）の構成では、前記少
なくとも１ラインが、テレビの標準方式の水平同期周期
より長い時間で読み出される。
子の少なくとも１ラインが、ダイナミックＲＡＭの高速
ページモードにおける同一ＲＡＳに書き込むための最大
許容時間内に読み出される。（２）の構成では、前記少
なくとも１ラインが、テレビの標準方式の水平同期周期
より長い時間で読み出される。
【００１２】
【実施例】以下本発明を実施例により詳しく説明する。
図１は実施例である“電子スチルカメラ”のブロック図
である。図において、１は撮像レンズ、２は絞り及びシ
ャッタ等の光量制御部材、３は固体撮像素子ＣＣＤ、４
はサンプルホールド及びγ（ガンマ），ＫＮＥＥ（ニ
ー）補正を行う前処理回路、５は前処理回路の出力信号
を選択して次段のＡ−Ｄ変換器に出力するためのスイッ
チ回路、６は第１のＡ−Ｄ変換回路、７は第２のＡ−Ｄ
変換回路、８は第１のメモリ（ＤＲＡＭ）、９は第２の
メモリ（ＤＲＡＭ）、１０は輝度信号と色差信号を形成
するためのマトリックス回路、１１は前記輝度信号と色
差信号を記憶するための第３のメモリ、１２はデータ圧
縮回路、１３は後述する第５のメモリ記憶媒体１４との
インターフェース回路である。１４は、ハードディスク
（メモリカード，光ディスクなどの記憶媒体でもよ
い）、１５は固体撮像素子を駆動するためのタイミング
信号，サンプルホールドパルス，Ａ−Ｄ変換パルスを発
生するためのパルス信号発生器、１６はメモリの読み書
きやＤＲＡＭのリフレッシュ動作を制御するためのメモ
リコントローラ、１７は記録トリガースイッチ、１８は
撮影シーケンス等システムを制御するためのマイクロコ
ントローラである。
図１は実施例である“電子スチルカメラ”のブロック図
である。図において、１は撮像レンズ、２は絞り及びシ
ャッタ等の光量制御部材、３は固体撮像素子ＣＣＤ、４
はサンプルホールド及びγ（ガンマ），ＫＮＥＥ（ニ
ー）補正を行う前処理回路、５は前処理回路の出力信号
を選択して次段のＡ−Ｄ変換器に出力するためのスイッ
チ回路、６は第１のＡ−Ｄ変換回路、７は第２のＡ−Ｄ
変換回路、８は第１のメモリ（ＤＲＡＭ）、９は第２の
メモリ（ＤＲＡＭ）、１０は輝度信号と色差信号を形成
するためのマトリックス回路、１１は前記輝度信号と色
差信号を記憶するための第３のメモリ、１２はデータ圧
縮回路、１３は後述する第５のメモリ記憶媒体１４との
インターフェース回路である。１４は、ハードディスク
（メモリカード，光ディスクなどの記憶媒体でもよ
い）、１５は固体撮像素子を駆動するためのタイミング
信号，サンプルホールドパルス，Ａ−Ｄ変換パルスを発
生するためのパルス信号発生器、１６はメモリの読み書
きやＤＲＡＭのリフレッシュ動作を制御するためのメモ
リコントローラ、１７は記録トリガースイッチ、１８は
撮影シーケンス等システムを制御するためのマイクロコ
ントローラである。
【００１３】つぎに図２，図３，図４で本実施例の動作
を説明する。図２は本実施例の撮影動作を示すフローチ
ャートである。はじめにＳ１で記録トリガースイッチ１
７が押されたか調べ、押されたら撮影動作（Ｓ２以降）
に進む。Ｓ２ではシャッタや絞り等２を制御して固体撮
像素子３の露出を行う。つぎにＳ３ではメモリコントロ
ーラ１６を制御して固体撮像素子３に蓄積された信号を
メモリ８，９に転送する。Ｓ４では再びメモリコントロ
ーラ１６を制御して、メモリ８，９上のデータをマトリ
ックス回路１０に転送し、以降メモリ１１，圧縮回路１
２，そしてインターフェース１３を通して、ハードディ
スク１４に保存され基本的な撮影動作を終了する。
を説明する。図２は本実施例の撮影動作を示すフローチ
ャートである。はじめにＳ１で記録トリガースイッチ１
７が押されたか調べ、押されたら撮影動作（Ｓ２以降）
に進む。Ｓ２ではシャッタや絞り等２を制御して固体撮
像素子３の露出を行う。つぎにＳ３ではメモリコントロ
ーラ１６を制御して固体撮像素子３に蓄積された信号を
メモリ８，９に転送する。Ｓ４では再びメモリコントロ
ーラ１６を制御して、メモリ８，９上のデータをマトリ
ックス回路１０に転送し、以降メモリ１１，圧縮回路１
２，そしてインターフェース１３を通して、ハードディ
スク１４に保存され基本的な撮影動作を終了する。
【００１４】つぎに本発明の主旨であるところの固体撮
像素子３の信号をメモリ（ＤＲＡＭ）８，９に書き込む
動作について図３，図４で説明する。まず図３は、固体
撮像素子３の画素配列図である。図でＲ，Ｇ，Ｂはそれ
ぞれの画素のカラーフィルタの色を示している。また、
数字は各画素の２次元平面での位置を示している。例え
ばＲ１２は“１行２列”の位置の画素であることを示
す。
像素子３の信号をメモリ（ＤＲＡＭ）８，９に書き込む
動作について図３，図４で説明する。まず図３は、固体
撮像素子３の画素配列図である。図でＲ，Ｇ，Ｂはそれ
ぞれの画素のカラーフィルタの色を示している。また、
数字は各画素の２次元平面での位置を示している。例え
ばＲ１２は“１行２列”の位置の画素であることを示
す。
【００１５】そして図４は、固体撮像素子３の信号の読
み出しから、メモリ８，９への記録までのタイミングを
説明するための図である。図でａ，ｂ，ｃ，ｄは固体撮
像素子３の出力である（図３参照）。ｅは固体撮像素子
３の信号を読み出す転送パルス、ｆはサンプルホールド
パルス、ｇは４本のサンプルホールド出力を２つのＡ−
Ｄ変換器６，７へ切り替えて入力させるためのスイッチ
パルスである。ｈ，ｉは、スイッチ回路５から出力され
たＡ−Ｄ変換器６，７への入力データで、Ｒ，Ｇ，Ｂ
は、ａ，ｂ，ｃ，ｄで読み出された各画素のデータを示
す。ｊはＡ−Ｄ変換パルスでこれに同期してＡ−Ｄ変換
される。ｋはメモリ８，９へのＲＡＳ(rawaddress stro
be)信号、ｌはメモリ８，９へのＲＡＳ，ＣＡＳ(column
addressstrobe) アドレスデータ信号、ｍはメモリ８，
９へのＣＡＳ信号である。
み出しから、メモリ８，９への記録までのタイミングを
説明するための図である。図でａ，ｂ，ｃ，ｄは固体撮
像素子３の出力である（図３参照）。ｅは固体撮像素子
３の信号を読み出す転送パルス、ｆはサンプルホールド
パルス、ｇは４本のサンプルホールド出力を２つのＡ−
Ｄ変換器６，７へ切り替えて入力させるためのスイッチ
パルスである。ｈ，ｉは、スイッチ回路５から出力され
たＡ−Ｄ変換器６，７への入力データで、Ｒ，Ｇ，Ｂ
は、ａ，ｂ，ｃ，ｄで読み出された各画素のデータを示
す。ｊはＡ−Ｄ変換パルスでこれに同期してＡ−Ｄ変換
される。ｋはメモリ８，９へのＲＡＳ(rawaddress stro
be)信号、ｌはメモリ８，９へのＲＡＳ，ＣＡＳ(column
addressstrobe) アドレスデータ信号、ｍはメモリ８，
９へのＣＡＳ信号である。
【００１６】ここでＤＲＡＭの高速ページモードについ
て簡単に述べる。高速ページモードでは、ＲＡＳをＬＯ
ＷにしたままＷＥ(write enable)をＬＯＷにし、ＣＡＳ
のみの動作により書き込みが行われる。つまり、ＲＡＳ
アドレスにより１ワードが選択され、次にＣＡＳアドレ
スを指定すると、指定されたアドレスのデータがはじめ
に書き込まれ、その後は、ＲＡＳアドレスを指定しなく
ともＣＡＳアドレスのみの変更（入力データは勿論変更
する）で次々連続して１ワード分のデータを書き込むモ
ードである。
て簡単に述べる。高速ページモードでは、ＲＡＳをＬＯ
ＷにしたままＷＥ(write enable)をＬＯＷにし、ＣＡＳ
のみの動作により書き込みが行われる。つまり、ＲＡＳ
アドレスにより１ワードが選択され、次にＣＡＳアドレ
スを指定すると、指定されたアドレスのデータがはじめ
に書き込まれ、その後は、ＲＡＳアドレスを指定しなく
ともＣＡＳアドレスのみの変更（入力データは勿論変更
する）で次々連続して１ワード分のデータを書き込むモ
ードである。
【００１７】タイミング等詳しくは、メモリ製造にかか
わる各社のデータブック等により明らかにされているの
でここでの説明は省くが、本発明に関するところでは、
この連続して書き込む際のＲＡＳアドレスの有効時間が
使用上制限がある（例えば１００マイクロ秒以内）点で
ある。本発明の動作は、この制限時間内に、固体撮像素
子の水平１ライン分の信号の読み出し及びメモリ８，９
への書き込みを終了させるということである。
わる各社のデータブック等により明らかにされているの
でここでの説明は省くが、本発明に関するところでは、
この連続して書き込む際のＲＡＳアドレスの有効時間が
使用上制限がある（例えば１００マイクロ秒以内）点で
ある。本発明の動作は、この制限時間内に、固体撮像素
子の水平１ライン分の信号の読み出し及びメモリ８，９
への書き込みを終了させるということである。
【００１８】従って、固体撮像素子３の信号を読み出す
際は、まず標準方式のテレビレートで言うところの水平
ブランキング期間にＲＡＳアドレスの指定を行った後、
固体撮像素子３の信号を読み出しを開始し、これに同期
させてＣＡＳアドレス及び書き込みパルスをパルス発生
器１５及びメモリコントローラ１６から出力すればよ
い。
際は、まず標準方式のテレビレートで言うところの水平
ブランキング期間にＲＡＳアドレスの指定を行った後、
固体撮像素子３の信号を読み出しを開始し、これに同期
させてＣＡＳアドレス及び書き込みパルスをパルス発生
器１５及びメモリコントローラ１６から出力すればよ
い。
【００１９】ところで本実施例では水平画素数を１０２
４画素とする。そして、先に述べた高速ページモードの
制限時間即ち最大許容時間を１００マイクロ秒とする
と、 １００÷１０２４≒０．０９７６６ マイクロ秒 で１画素当たりの最長転送所要時間は約９７．６ナノ秒
となる。
４画素とする。そして、先に述べた高速ページモードの
制限時間即ち最大許容時間を１００マイクロ秒とする
と、 １００÷１０２４≒０．０９７６６ マイクロ秒 で１画素当たりの最長転送所要時間は約９７．６ナノ秒
となる。
【００２０】さらにここで、パルス発生器１５の原発振
クロックを５０メガヘルツとすると、このクロック周期
（２０ナノ秒）の整数倍の時間を固体撮像素子の実際の
転送クロック周期として選ぶことになり、８０ナノ秒と
なる。
クロックを５０メガヘルツとすると、このクロック周期
（２０ナノ秒）の整数倍の時間を固体撮像素子の実際の
転送クロック周期として選ぶことになり、８０ナノ秒と
なる。
【００２１】つまり本実施例では、固体撮像素子３から
信号を読み出す転送パルス周期は、図４のｅのパルスの
周期に相当し８０ナノ秒となる。従って、ｌ，ｍの信号
の周期もこれに等しくすればよい。
信号を読み出す転送パルス周期は、図４のｅのパルスの
周期に相当し８０ナノ秒となる。従って、ｌ，ｍの信号
の周期もこれに等しくすればよい。
【００２２】以上の動作により、固体撮像素子３の信号
を読み出し、Ａ−Ｄ変換し、メモリ８，９への転送をＤ
ＲＡＭの高速ページモードの書き込みの速度に整合させ
ることが可能となる。
を読み出し、Ａ−Ｄ変換し、メモリ８，９への転送をＤ
ＲＡＭの高速ページモードの書き込みの速度に整合させ
ることが可能となる。
【００２３】なお、実施例は電子スチルカメラである
が、本発明はこれに限定されるものではなく、処理時間
の許す範囲内で、他のビデオカメラにおいても実施でき
る。
が、本発明はこれに限定されるものではなく、処理時間
の許す範囲内で、他のビデオカメラにおいても実施でき
る。
【００２４】また、前記実施例では、固体撮像素子の水
平画素をメモリの１ワードのビット数に等しいとして説
明したが、水平画素はメモリの１ワードのビット数以下
であればいくつでもよい。
平画素をメモリの１ワードのビット数に等しいとして説
明したが、水平画素はメモリの１ワードのビット数以下
であればいくつでもよい。
【００２５】また、前記実施例では固体撮像素子の水平
２ラインを同時に読み出しているが、固体撮像素子の読
み出し構造によるもので、水平１ラインずつ読み出して
もよい。
２ラインを同時に読み出しているが、固体撮像素子の読
み出し構造によるもので、水平１ラインずつ読み出して
もよい。
【００２６】さらにＡ−Ｄ変換器６，７，メモリ８，９
も前記実施例では２組設けたが、１組でも、または３組
以上で構成してもよい。これらはシステムの目的，コス
ト，大きさなどを考慮して構成すればよい。
も前記実施例では２組設けたが、１組でも、または３組
以上で構成してもよい。これらはシステムの目的，コス
ト，大きさなどを考慮して構成すればよい。
【００２７】
【発明の効果】以上説明したように、本発明によれば、
メモリへのデータ転送時間をいたずらに延ばさない範囲
で、固体撮像素子の読み出し速度を通常のテレビレート
より遅くできるため、固体撮像素子の読み出し転送に余
裕を持たせることができる。そして、結果的に固体撮像
素子の歩留まりの向上が期待できるようになる。
メモリへのデータ転送時間をいたずらに延ばさない範囲
で、固体撮像素子の読み出し速度を通常のテレビレート
より遅くできるため、固体撮像素子の読み出し転送に余
裕を持たせることができる。そして、結果的に固体撮像
素子の歩留まりの向上が期待できるようになる。
【００２８】また、Ａ−Ｄ変換器などの固体撮像素子周
辺の回路も比較的速度の遅いものでよくなるなど、カメ
ラ全体のコスト，消費電力の削減も可能となる。
辺の回路も比較的速度の遅いものでよくなるなど、カメ
ラ全体のコスト，消費電力の削減も可能となる。
【図面の簡単な説明】
【図１】 実施例のブロック図
【図２】 実施例の動作を示すフローチャート
【図３】 実施例の固体撮像素子の画素配列を示す図
【図４】 実施例のタイミングチャート
【図５】 従来例要部のブロック図
【図６】 従来例の説明図
３ 固体撮像素子 ４ 前処理回路 ６，７ Ａ−Ｄ変換回路 ８，９ メモリ（ＤＲＡＭ） １５ パルス信号発生器 １８ マイクロコントローラ
Claims (2)
- 【請求項１】 固体撮像素子と、該固体撮像素子の信号
を読み出すための転送パルスを供給するパルス発生器
と、前記固体撮像素子から読み出された信号をディジタ
ル信号に変換するＡ−Ｄ変換器と、該ディジタル信号を
記憶させるための高速ページモードで動作するダイナミ
ックＲＡＭとを備えたビデオカメラであって、前記固体
撮像素子の少なくとも１ラインを読み出すのに要する時
間が、前記高速ページモードにおける同一ＲＡＳアドレ
スに書き込むための最大許容時間より短く、かつ前記転
送パルスの周期が前記パルス発生器の原発振クロックの
周期の整数倍の周期である読み出し手段を備えたことを
特徴とするビデオカメラ。 - 【請求項２】 読み出し手段は、固体撮像素子の少なく
とも１ラインを読み出すのに要する時間が、テレビの標
準方式の水平同期周期より長いことを特徴とする請求項
１記載のビデオカメラ。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03223832A JP3118032B2 (ja) | 1991-09-04 | 1991-09-04 | ビデオカメラ |
| US08/260,036 US5694166A (en) | 1991-09-04 | 1994-06-15 | Video camera with slower than standard read-out from CCD |
| US08/927,980 US6130711A (en) | 1991-09-04 | 1997-09-11 | Video camera with slower than standard read-out from CCD |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03223832A JP3118032B2 (ja) | 1991-09-04 | 1991-09-04 | ビデオカメラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0564091A true JPH0564091A (ja) | 1993-03-12 |
| JP3118032B2 JP3118032B2 (ja) | 2000-12-18 |
Family
ID=16804419
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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