JPH06319104A - 画像信号入出力装置 - Google Patents
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- 239000004065 semiconductor Substances 0.000 abstract description 10
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/21—Intermediate information storage
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- H04N1/2112—Intermediate information storage for one or a few pictures using still video cameras
- H04N1/2137—Intermediate information storage for one or a few pictures using still video cameras with temporary storage before final recording, e.g. in a frame buffer
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- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
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- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/87—Regeneration of colour television signals
- H04N9/877—Regeneration of colour television signals by assembling picture element blocks in an intermediate memory
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- H04N5/76—Television signal recording
- H04N5/78—Television signal recording using magnetic recording
- H04N5/781—Television signal recording using magnetic recording on disks or drums
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- H04N5/783—Adaptations for reproducing at a rate different from the recording rate
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- Multimedia (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
- Picture Signal Circuits (AREA)
Abstract
(57)【要約】
【目的】 半導体メモリから読み出した映像データに帰
線期間を付加する簡易手段を提供する。 【構成】 Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８
に、入力される映像信号の有効画素期間データのみをＡ
／Ｄ変換器２３、２４、２５によってＡ／Ｄ変換して蓄
える。また、入力される映像信号の最終部分にある帰線
消去期間のペデスタルレベルを各Ａ／Ｄ変換器２３、２
４、２５においてＡ／Ｄ変換させ、その状態で各Ａ／Ｄ
変換器を強制的に停止させる。Ｙメモリ２６、Ｒメモリ
２７、Ｂメモリ２８から読み出したデータをＤ／Ａ変換
器３１、３２、３３によってＤ／Ａ変換して映像信号を
復元するとき、帰線消去期間はＡ／Ｄ変換器２３、２
４、２５のデータを直接Ｄ／Ａ変換器３１、３２、３３
に入力して生成させる。
線期間を付加する簡易手段を提供する。 【構成】 Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８
に、入力される映像信号の有効画素期間データのみをＡ
／Ｄ変換器２３、２４、２５によってＡ／Ｄ変換して蓄
える。また、入力される映像信号の最終部分にある帰線
消去期間のペデスタルレベルを各Ａ／Ｄ変換器２３、２
４、２５においてＡ／Ｄ変換させ、その状態で各Ａ／Ｄ
変換器を強制的に停止させる。Ｙメモリ２６、Ｒメモリ
２７、Ｂメモリ２８から読み出したデータをＤ／Ａ変換
器３１、３２、３３によってＤ／Ａ変換して映像信号を
復元するとき、帰線消去期間はＡ／Ｄ変換器２３、２
４、２５のデータを直接Ｄ／Ａ変換器３１、３２、３３
に入力して生成させる。
Description
【０００１】
【技術分野】本発明は磁気ディスク等の記録媒体に映像
信号を記録する際若しくは読み出しの際に、映像信号を
一旦メモリに蓄わえた後、所定フォーマットの信号に形
成する画像信号入出力装置に関する。
信号を記録する際若しくは読み出しの際に、映像信号を
一旦メモリに蓄わえた後、所定フォーマットの信号に形
成する画像信号入出力装置に関する。
【０００２】
【従来技術】スチルビデオカメラに用いられる磁気ディ
スク又は光ディスクに記録された静止画像をディスプレ
イに表示する場合、又はそれら磁気ディスク若しくは光
ディスクに静止画像を記録する場合には、１フィールド
若しくは１フレーム分のアナログ映像信号を一旦Ａ／Ｄ
変換して半導体メモリに蓄わえ、その後その半導体メモ
リからデジタルの映像データを読み出し、Ｄ／Ａ変換し
て記録又は再生出力が行われる。
スク又は光ディスクに記録された静止画像をディスプレ
イに表示する場合、又はそれら磁気ディスク若しくは光
ディスクに静止画像を記録する場合には、１フィールド
若しくは１フレーム分のアナログ映像信号を一旦Ａ／Ｄ
変換して半導体メモリに蓄わえ、その後その半導体メモ
リからデジタルの映像データを読み出し、Ｄ／Ａ変換し
て記録又は再生出力が行われる。
【０００３】このように静止画像の記録・再生時に映像
信号を半導体メモリに一旦蓄えるのは、スチルビデオカ
メラにおける映像記録の場合、イメージセンサによって
撮影した静止画像の確認、若しくは記録すべき画像の選
択等を行うためであり、再生時においては、ディスクか
ら直接ディスプレイに出力したのでは、ディスクを繰り
返し回転させつつヘッドをシークさせ続けなければなら
ず、ディスク及びヘッドの破損を招く虞があることによ
る。したがって、再生時には、ディスクから記録映像信
号を１回読み出してメモリに蓄わえ、そのメモリからデ
ィスプレイに繰り返し出力させている。
信号を半導体メモリに一旦蓄えるのは、スチルビデオカ
メラにおける映像記録の場合、イメージセンサによって
撮影した静止画像の確認、若しくは記録すべき画像の選
択等を行うためであり、再生時においては、ディスクか
ら直接ディスプレイに出力したのでは、ディスクを繰り
返し回転させつつヘッドをシークさせ続けなければなら
ず、ディスク及びヘッドの破損を招く虞があることによ
る。したがって、再生時には、ディスクから記録映像信
号を１回読み出してメモリに蓄わえ、そのメモリからデ
ィスプレイに繰り返し出力させている。
【０００４】したがって、メモリに一旦蓄えた映像デー
タが、記録又は再生のためにそのメモリから出力される
場合、水平及び垂直帰線消去期間を映像信号に付加しな
ければならない。
タが、記録又は再生のためにそのメモリから出力される
場合、水平及び垂直帰線消去期間を映像信号に付加しな
ければならない。
【０００５】
【発明が解決しようとする課題】イメージセンサ等から
入力された映像信号に水平及び垂直帰線消去期間を付加
する従来の回路例を図４に示す。この図に示すように、
入力された映像信号はＡ／Ｄ変換器５２によってデジタ
ルデータに変換された後、半導体メモリ５３に１フレー
ム又は１フィールド分の映像信号が蓄えられる。半導体
メモリ５３に蓄えられた映像信号は順次読み出され、ア
ンド回路４０（１）、４０（２）、・・・４０（ｎ）を
介してＤ／Ａ変換器５４に入力され、アナログ信号に変
換されて磁気ディスク等に出力される。
入力された映像信号に水平及び垂直帰線消去期間を付加
する従来の回路例を図４に示す。この図に示すように、
入力された映像信号はＡ／Ｄ変換器５２によってデジタ
ルデータに変換された後、半導体メモリ５３に１フレー
ム又は１フィールド分の映像信号が蓄えられる。半導体
メモリ５３に蓄えられた映像信号は順次読み出され、ア
ンド回路４０（１）、４０（２）、・・・４０（ｎ）を
介してＤ／Ａ変換器５４に入力され、アナログ信号に変
換されて磁気ディスク等に出力される。
【０００６】また、半導体メモリ５３から読み出された
映像データに帰線消去期間を付加し、ペデスタルレベル
を設定する回路はアンド回路４０（１）、４０（２）、
・・・・、４０（ｎ）を用い、デジタル映像信号の各構
成ビット線毎にＤ／Ａ変換器３１に不要なデータが入力
されることを抑止することで行われる。
映像データに帰線消去期間を付加し、ペデスタルレベル
を設定する回路はアンド回路４０（１）、４０（２）、
・・・・、４０（ｎ）を用い、デジタル映像信号の各構
成ビット線毎にＤ／Ａ変換器３１に不要なデータが入力
されることを抑止することで行われる。
【０００７】この様な帰線消去期間を形成するためのア
ンド回路４０（１）、４０（２）、・・・・、４０
（ｎ）は特に重要な回路とはいえず、スチルビデオ装置
等のコンパクト化を図る場合、このような回路をできう
るかぎり省くことができれば、装置自体の簡略化を図る
ことができ、且つコンパクト化に貢献させることもでき
る。
ンド回路４０（１）、４０（２）、・・・・、４０
（ｎ）は特に重要な回路とはいえず、スチルビデオ装置
等のコンパクト化を図る場合、このような回路をできう
るかぎり省くことができれば、装置自体の簡略化を図る
ことができ、且つコンパクト化に貢献させることもでき
る。
【０００８】そこで、本発明は、スチルビデオ装置のよ
り高いコンパクト化を図るため、スチルビデオ装置等に
用いる、帰線消去期間のペデスタルレベルを生成するた
めの回路部品を省いた画像信号入出力装置を提供するも
のである。
り高いコンパクト化を図るため、スチルビデオ装置等に
用いる、帰線消去期間のペデスタルレベルを生成するた
めの回路部品を省いた画像信号入出力装置を提供するも
のである。
【０００９】
【課題を解決するための手段】本発明に係る画像信号入
出力装置は、第１映像信号フォーマットの入力映像信号
をデジタルデータに変換するＡ／Ｄ変換手段と、前記デ
ジタルデータを蓄えるメモリ手段と、該メモリ手段に蓄
えられたデジタルデータ及び前記Ａ／Ｄ変換手段出力デ
ータをＤ／Ａ変換するＤ／Ａ変換手段と、前記入力映像
信号の最終部にある帰線消去期間を検出して前記Ａ／Ｄ
変換手段にその帰線消去期間のペデスタルレベルをＡ／
Ｄ変換させて停止させるとともに、第２映像信号フォー
マットの帰線消去期間では前記Ａ／Ｄ変換手段の出力を
前記Ｄ／Ａ変換手段に出力させ、前記第２映像信号フォ
ーマットの映像期間では前記メモリ手段に蓄えられたデ
ータを前記Ｄ／Ａ変換手段に出力させる手段とを備える
ことを特徴とする。
出力装置は、第１映像信号フォーマットの入力映像信号
をデジタルデータに変換するＡ／Ｄ変換手段と、前記デ
ジタルデータを蓄えるメモリ手段と、該メモリ手段に蓄
えられたデジタルデータ及び前記Ａ／Ｄ変換手段出力デ
ータをＤ／Ａ変換するＤ／Ａ変換手段と、前記入力映像
信号の最終部にある帰線消去期間を検出して前記Ａ／Ｄ
変換手段にその帰線消去期間のペデスタルレベルをＡ／
Ｄ変換させて停止させるとともに、第２映像信号フォー
マットの帰線消去期間では前記Ａ／Ｄ変換手段の出力を
前記Ｄ／Ａ変換手段に出力させ、前記第２映像信号フォ
ーマットの映像期間では前記メモリ手段に蓄えられたデ
ータを前記Ｄ／Ａ変換手段に出力させる手段とを備える
ことを特徴とする。
【００１０】
【実施例】以下図示実施例に基づいて本発明を説明す
る。図１は本発明を適用した画像信号入出力装置のブロ
ック図である。
る。図１は本発明を適用した画像信号入出力装置のブロ
ック図である。
【００１１】システムコントロール回路１０はプログラ
ムを記憶させた半導体メモリを備えるマイクロコンピュ
ータであり、本画像信号入出力装置全体の処理を行う。
このシステムコントロール回路１０には操作部１４が接
続されており、操作部１４を介して各入力出力命令が実
行される。
ムを記憶させた半導体メモリを備えるマイクロコンピュ
ータであり、本画像信号入出力装置全体の処理を行う。
このシステムコントロール回路１０には操作部１４が接
続されており、操作部１４を介して各入力出力命令が実
行される。
【００１２】図示しない外部入力端子等から本画像信号
入出力装置に、例えばＮＴＳＣ方式等の各種テレビジョ
ン信号をデコードして得られた輝度信号（Ｙ＋Ｓ）及び
色差信号（Ｒ−Ｙ、Ｂ−Ｙ）が入力される。入力された
輝度信号（Ｙ＋Ｓ）はＡ／Ｄ変換器２３と同期信号分離
＆パルス発生回路２１とに入力される。同じく入力され
た色差信号（Ｒ−Ｙ）はＡ／Ｄ変換器２４に入力され、
色差信号（Ｂ−Ｙ）はＡ／Ｄ変換器２５に入力される。
Ａ／Ｄ変換器２３は入力輝度信号（Ｙ＋Ｓ）をＡ／Ｄ変
換して、Ａ／Ｄ変換データをＹメモリ２６及びＤ／Ａ変
換器３１とに出力する。
入出力装置に、例えばＮＴＳＣ方式等の各種テレビジョ
ン信号をデコードして得られた輝度信号（Ｙ＋Ｓ）及び
色差信号（Ｒ−Ｙ、Ｂ−Ｙ）が入力される。入力された
輝度信号（Ｙ＋Ｓ）はＡ／Ｄ変換器２３と同期信号分離
＆パルス発生回路２１とに入力される。同じく入力され
た色差信号（Ｒ−Ｙ）はＡ／Ｄ変換器２４に入力され、
色差信号（Ｂ−Ｙ）はＡ／Ｄ変換器２５に入力される。
Ａ／Ｄ変換器２３は入力輝度信号（Ｙ＋Ｓ）をＡ／Ｄ変
換して、Ａ／Ｄ変換データをＹメモリ２６及びＤ／Ａ変
換器３１とに出力する。
【００１３】同じくＡ／Ｄ変換器２４によってＡ／Ｄ変
換された色差信号（Ｒ−Ｙ）データはＲメモリ２７とＤ
／Ａ変換器３２に出力される。Ａ／Ｄ変換器２５におい
て変換された色差信号（Ｂ−Ｙ）データはＢメモリ２８
とＤ／Ａ変換器３３に出力される。
換された色差信号（Ｒ−Ｙ）データはＲメモリ２７とＤ
／Ａ変換器３２に出力される。Ａ／Ｄ変換器２５におい
て変換された色差信号（Ｂ−Ｙ）データはＢメモリ２８
とＤ／Ａ変換器３３に出力される。
【００１４】他方同期信号分離＆パルス発生回路２１は
入力される輝度信号（Ｙ＋Ｓ）から同期信号を分離し、
その同期信号に同期させたクロックfs１を発生してメモ
リコントロール回路２２及びシステムコントロール回路
１０に出力する。メモリコントロール回路２２はこの同
期信号分離＆パルス発生回路２１から入力されるクロッ
クfs１を用いてサンプリングクロックとメモリアドレス
信号を生成する。
入力される輝度信号（Ｙ＋Ｓ）から同期信号を分離し、
その同期信号に同期させたクロックfs１を発生してメモ
リコントロール回路２２及びシステムコントロール回路
１０に出力する。メモリコントロール回路２２はこの同
期信号分離＆パルス発生回路２１から入力されるクロッ
クfs１を用いてサンプリングクロックとメモリアドレス
信号を生成する。
【００１５】サンプリングクロックはＡ／Ｄ変換器２
３、２４、２５に入力されると共に、メモリコントロー
ル回路２２において生成されたメモリアドレス信号はＹ
メモリ２６、Ｒメモリ２７及びＢメモリ２８に出力され
る。また、Ａ／Ｄ変換器２３、２４、２５の負論理信号
入力端子である各出力イネーブル端子には、負論理信号
のブランキング信号／ＢＬＫ１（「／」は負論理信号を
表す）がメモリコントロール回路２２より入力される。
このブランキング信号／ＢＬＫ１は、正論理信号入力端
子であるＹメモリ２６、Ｒメモリ２７、Ｂメモリ２８の
各出力イネーブル端子にも入力される。
３、２４、２５に入力されると共に、メモリコントロー
ル回路２２において生成されたメモリアドレス信号はＹ
メモリ２６、Ｒメモリ２７及びＢメモリ２８に出力され
る。また、Ａ／Ｄ変換器２３、２４、２５の負論理信号
入力端子である各出力イネーブル端子には、負論理信号
のブランキング信号／ＢＬＫ１（「／」は負論理信号を
表す）がメモリコントロール回路２２より入力される。
このブランキング信号／ＢＬＫ１は、正論理信号入力端
子であるＹメモリ２６、Ｒメモリ２７、Ｂメモリ２８の
各出力イネーブル端子にも入力される。
【００１６】図２はメモリコントロール回路２２内にお
いてブランキング信号／ＢＬＫ１を生成するための論理
図である。この図に示すように、同期信号発生回路３４
から入力されるブランキング信号／ＢＬＫ２（負論理信
号）と、システムコントロール回路１０から入力される
メモリ／ライト・リード切り替え信号（このメモリ／ラ
イト・リード切り替え信号がＬｏｗレベルであるとき
は、メモリへのデータ書き込みが命令され、Ｈｉｇｈレ
ベルであると、メモリデータの読み出しが命令されてい
ることを表す）との負論理和がアンド回路３６によって
求められ、アンド回路３６の出力がブランキング信号／
ＢＬＫ１としてＡ／Ｄ変換器２３、２４、２５とＹメモ
リ２６、Ｒメモリ２７、Ｂメモリ２８とに出力される。
いてブランキング信号／ＢＬＫ１を生成するための論理
図である。この図に示すように、同期信号発生回路３４
から入力されるブランキング信号／ＢＬＫ２（負論理信
号）と、システムコントロール回路１０から入力される
メモリ／ライト・リード切り替え信号（このメモリ／ラ
イト・リード切り替え信号がＬｏｗレベルであるとき
は、メモリへのデータ書き込みが命令され、Ｈｉｇｈレ
ベルであると、メモリデータの読み出しが命令されてい
ることを表す）との負論理和がアンド回路３６によって
求められ、アンド回路３６の出力がブランキング信号／
ＢＬＫ１としてＡ／Ｄ変換器２３、２４、２５とＹメモ
リ２６、Ｒメモリ２７、Ｂメモリ２８とに出力される。
【００１７】ブランキング信号／ＢＬＫ１は、本画像信
号入出力装置に入力される映像信号をＡ／Ｄ変換して各
Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８に書き込む
場合と、新たな信号フォーマットの映像信号に帰線消去
期間のペデスタルレベルを付加する場合にＬｏｗレベル
にされる。また、Ｙメモリ２６、Ｒメモリ２７及びＢメ
モリ２８からデータを読み出す期間は、ブランキング信
号／ＢＬＫ１がブランキング信号／ＢＬＫ２と等しい論
理で、Ｈｉｇｈレベルにされる。Ｙメモリ２６から読み
出されたデータはＤ／Ａ変換器３１に入力されてＤ／Ａ
変換される。このＤ／Ａ変換されたアナログ信号は加算
器３９に入力される。
号入出力装置に入力される映像信号をＡ／Ｄ変換して各
Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８に書き込む
場合と、新たな信号フォーマットの映像信号に帰線消去
期間のペデスタルレベルを付加する場合にＬｏｗレベル
にされる。また、Ｙメモリ２６、Ｒメモリ２７及びＢメ
モリ２８からデータを読み出す期間は、ブランキング信
号／ＢＬＫ１がブランキング信号／ＢＬＫ２と等しい論
理で、Ｈｉｇｈレベルにされる。Ｙメモリ２６から読み
出されたデータはＤ／Ａ変換器３１に入力されてＤ／Ａ
変換される。このＤ／Ａ変換されたアナログ信号は加算
器３９に入力される。
【００１８】同様に、Ｒメモリ２７から読み出されたデ
ジタルデータはＤ／Ａ変換器３２に入力されアナログ信
号に変換されて、磁気ディスク記録装置又はディスプレ
イ装置等の図示しない装置に出力される。Ｂメモリ２８
から読み出されたデータも同じようにＤ／Ａ変換器３３
においてアナログ信号に変換されて図示しない装置に出
力される。なお、Ａ／Ｄ変換器２３、２４、２５の複数
の端子からなるデータ出力端子と、Ｙメモリ２６、Ｒメ
モリ２７及びＢメモリ２８の複数の端子からなるデータ
入出力端子とはスリーステート信号入出力端子となって
おり、ローカルバスによって接続されている。
ジタルデータはＤ／Ａ変換器３２に入力されアナログ信
号に変換されて、磁気ディスク記録装置又はディスプレ
イ装置等の図示しない装置に出力される。Ｂメモリ２８
から読み出されたデータも同じようにＤ／Ａ変換器３３
においてアナログ信号に変換されて図示しない装置に出
力される。なお、Ａ／Ｄ変換器２３、２４、２５の複数
の端子からなるデータ出力端子と、Ｙメモリ２６、Ｒメ
モリ２７及びＢメモリ２８の複数の端子からなるデータ
入出力端子とはスリーステート信号入出力端子となって
おり、ローカルバスによって接続されている。
【００１９】つまり、Ａ／Ｄ変換器２３、２４、２５の
各出力イネーブル端子に入力されるブランキング信号／
ＢＬＫ１がＬｏｗレベルでなければ、各Ａ／Ｄ変換器２
３、２４、２５のデータ出力端子はハイインピーダンス
状態にされる。同じように、Ｙメモリ２６、Ｒメモリ２
７及びＢメモリ２８の各出力イネーブル端子にＨｉｇｈ
レベルのブランキング信号／ＢＬＫ１が入力されなけれ
ば、各データ入出力端子はハイインピーダンス状態にさ
れる。また、各メモリ２６、２７、２８の各出力イネー
ブル端子は正論理信号入力端子であり、Ａ／Ｄ変換器２
３、２４、２５の各出力イネーブル端子は負論理信号入
力端子である。したがって、メモリコントロール回路２
２から入力されるブランキング信号／ＢＬＫ１によりい
ずれか一方のデバイスのデータ出力端子がアクティブに
されることになる。
各出力イネーブル端子に入力されるブランキング信号／
ＢＬＫ１がＬｏｗレベルでなければ、各Ａ／Ｄ変換器２
３、２４、２５のデータ出力端子はハイインピーダンス
状態にされる。同じように、Ｙメモリ２６、Ｒメモリ２
７及びＢメモリ２８の各出力イネーブル端子にＨｉｇｈ
レベルのブランキング信号／ＢＬＫ１が入力されなけれ
ば、各データ入出力端子はハイインピーダンス状態にさ
れる。また、各メモリ２６、２７、２８の各出力イネー
ブル端子は正論理信号入力端子であり、Ａ／Ｄ変換器２
３、２４、２５の各出力イネーブル端子は負論理信号入
力端子である。したがって、メモリコントロール回路２
２から入力されるブランキング信号／ＢＬＫ１によりい
ずれか一方のデバイスのデータ出力端子がアクティブに
されることになる。
【００２０】加算器３９に入力された輝度信号には、同
期信号発生回路３４で新たに生成され、この加算器３９
に入力される同期信号／ＳＹＮＣ（負論理信号）が付加
されて、図示しない装置に出力される。
期信号発生回路３４で新たに生成され、この加算器３９
に入力される同期信号／ＳＹＮＣ（負論理信号）が付加
されて、図示しない装置に出力される。
【００２１】同期信号発生回路３４はこの同期信号／Ｓ
ＹＮＣの他に、ブランキング信号／ＢＬＫ２とクロック
fs２を生成してメモリコントロール回路２２に出力す
る。メモリコントロール回路２２はブランキング信号／
ＢＬＫ２をブランキング信号／ＢＬＫ１と同じ論理でＡ
／Ｄ変換器２３、２４、２５と、Ｙメモリ２６、Ｒメモ
リ２７、Ｂメモリ２８とに出力する。尚、ブランキング
信号／ＢＬＫ２はクロックfs２と同期信号／ＳＹＮＣと
に基づいて生成される。さらにメモリコントロール回路
２２はクロックfs２からＤ／Ａ変換クロックfsを生成し
てＤ／Ａ変換器３１、３２、３３に出力すると共に、Ｙ
メモリ２６、Ｒメモリ２７及びＢメモリ２８に対してデ
ータ読み出しアドレス値を生成して出力する。
ＹＮＣの他に、ブランキング信号／ＢＬＫ２とクロック
fs２を生成してメモリコントロール回路２２に出力す
る。メモリコントロール回路２２はブランキング信号／
ＢＬＫ２をブランキング信号／ＢＬＫ１と同じ論理でＡ
／Ｄ変換器２３、２４、２５と、Ｙメモリ２６、Ｒメモ
リ２７、Ｂメモリ２８とに出力する。尚、ブランキング
信号／ＢＬＫ２はクロックfs２と同期信号／ＳＹＮＣと
に基づいて生成される。さらにメモリコントロール回路
２２はクロックfs２からＤ／Ａ変換クロックfsを生成し
てＤ／Ａ変換器３１、３２、３３に出力すると共に、Ｙ
メモリ２６、Ｒメモリ２７及びＢメモリ２８に対してデ
ータ読み出しアドレス値を生成して出力する。
【００２２】以上の構成において以下動作を説明する。
本画像信号入出力装置に入力された輝度信号（Ｙ＋Ｓ）
から同期信号分離＆パルス発生回路２１においてその輝
度信号（Ｙ＋Ｓ）に含まれる同期信号が分離抽出され、
その同期信号に位相を一致させたクロックfs１が同期信
号分離＆パルス発生回路２１において生成される。この
クロックfs１はメモリコントロール回路２２に入力さ
れ、各画素のアナログ信号をサンプリングするためのサ
ンプリングクロック生成に用いられると共に、クロック
fs１に同期してアップカウントされる各メモリのアドレ
ス値生成に用いられる。
本画像信号入出力装置に入力された輝度信号（Ｙ＋Ｓ）
から同期信号分離＆パルス発生回路２１においてその輝
度信号（Ｙ＋Ｓ）に含まれる同期信号が分離抽出され、
その同期信号に位相を一致させたクロックfs１が同期信
号分離＆パルス発生回路２１において生成される。この
クロックfs１はメモリコントロール回路２２に入力さ
れ、各画素のアナログ信号をサンプリングするためのサ
ンプリングクロック生成に用いられると共に、クロック
fs１に同期してアップカウントされる各メモリのアドレ
ス値生成に用いられる。
【００２３】メモリコントロール回路２２はこのサンプ
リングクロックをＡ／Ｄ変換器２３、２４、２５に出力
する。Ａ／Ｄ変換器２３、２４、２５はメモリコントロ
ール回路２２から入力されるサンプリングクロックに従
い各々入力輝度信号、色差信号（Ｒ−Ｙ、Ｂ−Ｙ）をサ
ンプリングし、Ａ／Ｄ変換してそれぞれＹメモリ２６、
Ｒメモリ２７及びＢメモリ２８に出力する。
リングクロックをＡ／Ｄ変換器２３、２４、２５に出力
する。Ａ／Ｄ変換器２３、２４、２５はメモリコントロ
ール回路２２から入力されるサンプリングクロックに従
い各々入力輝度信号、色差信号（Ｒ−Ｙ、Ｂ−Ｙ）をサ
ンプリングし、Ａ／Ｄ変換してそれぞれＹメモリ２６、
Ｒメモリ２７及びＢメモリ２８に出力する。
【００２４】また、メモリコントロール回路２２はＹメ
モリ２６、Ｒメモリ２７、Ｂメモリ２８にＡ／Ｄ変換し
たデータを書き込むアドレス値を生成しているが、この
アドレス値により、映像信号のメモリ書き込みが終了す
る時点を検出し、全ての映像信号のＡ／Ｄ変換終了直後
に、Ａ／Ｄ変換器２３、２４、２５に１回のみＡ／Ｄ変
換を行わせるべく、１パルスのサンプリングクロックを
各Ａ／Ｄ変換器２３、２４、２５に出力する。
モリ２６、Ｒメモリ２７、Ｂメモリ２８にＡ／Ｄ変換し
たデータを書き込むアドレス値を生成しているが、この
アドレス値により、映像信号のメモリ書き込みが終了す
る時点を検出し、全ての映像信号のＡ／Ｄ変換終了直後
に、Ａ／Ｄ変換器２３、２４、２５に１回のみＡ／Ｄ変
換を行わせるべく、１パルスのサンプリングクロックを
各Ａ／Ｄ変換器２３、２４、２５に出力する。
【００２５】つまり、１フレーム若しくは１フィールド
分の輝度信号、色差信号（Ｒ−Ｙ、Ｂ−Ｙ）が入力され
た最終映像信号部分にある帰線消去期間のペデスタルレ
ベルをＡ／Ｄ変換器２３、２４、２５に１画素分のみＡ
／Ｄ変換させる。Ａ／Ｄ変換器２３、２４、２５は、メ
モリコントロール回路２２から入力されるこの１パルス
のＡ／Ｄ変換命令により映像信号の最終部分にあるペデ
スタルレベルをＡ／Ｄ変換して停止する。すなわち、ペ
デスタルレベルのＡ／Ｄ変換後は、サンプリングクロッ
クが入力されないため、Ａ／Ｄ変換器２３、２４、２５
はペデスタルレベルのＡ／Ｄ変換データを保持する。
分の輝度信号、色差信号（Ｒ−Ｙ、Ｂ−Ｙ）が入力され
た最終映像信号部分にある帰線消去期間のペデスタルレ
ベルをＡ／Ｄ変換器２３、２４、２５に１画素分のみＡ
／Ｄ変換させる。Ａ／Ｄ変換器２３、２４、２５は、メ
モリコントロール回路２２から入力されるこの１パルス
のＡ／Ｄ変換命令により映像信号の最終部分にあるペデ
スタルレベルをＡ／Ｄ変換して停止する。すなわち、ペ
デスタルレベルのＡ／Ｄ変換後は、サンプリングクロッ
クが入力されないため、Ａ／Ｄ変換器２３、２４、２５
はペデスタルレベルのＡ／Ｄ変換データを保持する。
【００２６】また、Ａ／Ｄ変換器２３、２４、２５にお
いてＡ／Ｄ変換された輝度信号及び色差信号（Ｒ−Ｙ、
Ｂ−Ｙ）は各水平走査線の有効画素部分のデータのみが
順次Ｙメモリ２６、Ｒメモリ２７及びＢメモリ２８に書
き込まれ蓄えられればよく、入力映像信号の帰線消去期
間のデータは全くＹメモリ２６、Ｒメモリ２７及びＢメ
モリ２８に書き込む必要がない。
いてＡ／Ｄ変換された輝度信号及び色差信号（Ｒ−Ｙ、
Ｂ−Ｙ）は各水平走査線の有効画素部分のデータのみが
順次Ｙメモリ２６、Ｒメモリ２７及びＢメモリ２８に書
き込まれ蓄えられればよく、入力映像信号の帰線消去期
間のデータは全くＹメモリ２６、Ｒメモリ２７及びＢメ
モリ２８に書き込む必要がない。
【００２７】このようにして各Ｙメモリ２６、Ｒメモリ
２７及びＢメモリ２８に１フレーム分又は１フィールド
分のデータ蓄積が完了されると、メモリコントロール回
路２２からシステムコントロール回路１０にデータ蓄積
完了情報が報知される。システムコントロール回路１０
は、この報知されるデータ蓄積完了情報に応じて、各メ
モリに蓄えられたデータを、例えば磁気ディスクに記録
すべく各メモリ２６、２７、２８からのデータを読み出
しコマンドをメモリコントロール回路２２に出力する。
２７及びＢメモリ２８に１フレーム分又は１フィールド
分のデータ蓄積が完了されると、メモリコントロール回
路２２からシステムコントロール回路１０にデータ蓄積
完了情報が報知される。システムコントロール回路１０
は、この報知されるデータ蓄積完了情報に応じて、各メ
モリに蓄えられたデータを、例えば磁気ディスクに記録
すべく各メモリ２６、２７、２８からのデータを読み出
しコマンドをメモリコントロール回路２２に出力する。
【００２８】メモリコントロール回路２２はこのシステ
ムコントロール回路１０からのデータ読み出しコマンド
に応じて同期信号発生回路３４から入力されるクロック
fs２に同期して各メモリ２６、２７、２８のメモリアド
レスを生成して各メモリ２６、２７、２８に出力する。
ムコントロール回路１０からのデータ読み出しコマンド
に応じて同期信号発生回路３４から入力されるクロック
fs２に同期して各メモリ２６、２７、２８のメモリアド
レスを生成して各メモリ２６、２７、２８に出力する。
【００２９】各メモリ２６、２７、２８から読み出され
たデータはＤ／Ａ変換器３１、３２、３３それぞれに入
力されアナログ信号に変換されて図示しない装置、例え
ば磁気ディスク又はディスプレイ等に出力される。ま
た、メモリ２６、２７、２８から読み出された輝度信
号、色差信号に付加すべき帰線消去期間のペデスタルレ
ベルは、Ａ／Ｄ変換を停止しているＡ／Ｄ変換器２３、
２４、２５のデータを用いる。つまり、外部へ出力する
映像信号の帰線消去期間においては、Ｙメモリ２６、２
７、２８のデータ出力を一時停止させ、代わりにＡ／Ｄ
変換器２３、２４、２５のデータを用いる。
たデータはＤ／Ａ変換器３１、３２、３３それぞれに入
力されアナログ信号に変換されて図示しない装置、例え
ば磁気ディスク又はディスプレイ等に出力される。ま
た、メモリ２６、２７、２８から読み出された輝度信
号、色差信号に付加すべき帰線消去期間のペデスタルレ
ベルは、Ａ／Ｄ変換を停止しているＡ／Ｄ変換器２３、
２４、２５のデータを用いる。つまり、外部へ出力する
映像信号の帰線消去期間においては、Ｙメモリ２６、２
７、２８のデータ出力を一時停止させ、代わりにＡ／Ｄ
変換器２３、２４、２５のデータを用いる。
【００３０】これはブランキング信号／ＢＬＫ１によっ
て制御できる。何故なら、同期信号発生回路３４から入
力されるブランキング信号／ＢＬＫ２をＡ／Ｄ変換器２
３、２４、２５の各出力イネーブル端子と、Ｙメモリ２
６、Ｒメモリ２７及びＢメモリ２８の各出力イネーブル
端子とにそのまま出力することによって、帰線消去期間
ではＡ／Ｄ変換器２３、２４、２５が各メモリ２６、２
７、２８に代わってＡ／Ｄ変換データをＤ／Ａ変換器３
１、３２、３３にそのまま出力するからである。
て制御できる。何故なら、同期信号発生回路３４から入
力されるブランキング信号／ＢＬＫ２をＡ／Ｄ変換器２
３、２４、２５の各出力イネーブル端子と、Ｙメモリ２
６、Ｒメモリ２７及びＢメモリ２８の各出力イネーブル
端子とにそのまま出力することによって、帰線消去期間
ではＡ／Ｄ変換器２３、２４、２５が各メモリ２６、２
７、２８に代わってＡ／Ｄ変換データをＤ／Ａ変換器３
１、３２、３３にそのまま出力するからである。
【００３１】各Ａ／Ｄ変換器２３、２４、２５は本画像
信号入出力装置に入力される映像信号の最終部分にある
ペデスタルレベルをＡ／Ｄ変換して停止しているので、
そのペデスタルレベルのＡ／Ｄ変換データがそのままＤ
／Ａ変換器３１、３２、３３に入力されることになる。
このようにして帰線消去期間はＡ／Ｄ変換器２３、２、
２４、２５のデータが、各有効映像期間に於いては各Ｙ
メモリ２６、Ｒメモリ２７、Ｂメモリ２８からのデータ
がそれぞれＤ／Ａ変換されて、任意のフォーマットを持
った映像信号が形成される。この様子を図３に示す。こ
の図に示すように帰線消去期間５０はＡ／Ｄ変換器２
３、２４、２５のデータがそのままＤ／Ａ変換器３１、
３２、３３においてＤ／Ａ変換され、映像有効期間にお
いてはＹメモリ２６、Ｒメモリ２７及びＢメモリ２８か
ら出力されたデータがＤ／Ａ変換されている。
信号入出力装置に入力される映像信号の最終部分にある
ペデスタルレベルをＡ／Ｄ変換して停止しているので、
そのペデスタルレベルのＡ／Ｄ変換データがそのままＤ
／Ａ変換器３１、３２、３３に入力されることになる。
このようにして帰線消去期間はＡ／Ｄ変換器２３、２、
２４、２５のデータが、各有効映像期間に於いては各Ｙ
メモリ２６、Ｒメモリ２７、Ｂメモリ２８からのデータ
がそれぞれＤ／Ａ変換されて、任意のフォーマットを持
った映像信号が形成される。この様子を図３に示す。こ
の図に示すように帰線消去期間５０はＡ／Ｄ変換器２
３、２４、２５のデータがそのままＤ／Ａ変換器３１、
３２、３３においてＤ／Ａ変換され、映像有効期間にお
いてはＹメモリ２６、Ｒメモリ２７及びＢメモリ２８か
ら出力されたデータがＤ／Ａ変換されている。
【００３２】このようにして各Ｙメモリ２６、Ｒメモリ
２７、Ｂメモリ２８から読み出されたデータとＡ／Ｄ変
換器２３、２４、２５から直接出力されるデータがＤ／
Ａ変換され、さらに同期信号発生回路３４で生成された
同期信号が付加されて、新たな映像信号が形成される。
形成された映像信号は、磁気ディスク又はディスプレイ
等に出力される。これにより、従来のように帰線消去期
間のペデスタルレベルを形成するための専用回路を省く
ことができ、本画像信号入出力装置の回路構成をより簡
略することができる。
２７、Ｂメモリ２８から読み出されたデータとＡ／Ｄ変
換器２３、２４、２５から直接出力されるデータがＤ／
Ａ変換され、さらに同期信号発生回路３４で生成された
同期信号が付加されて、新たな映像信号が形成される。
形成された映像信号は、磁気ディスク又はディスプレイ
等に出力される。これにより、従来のように帰線消去期
間のペデスタルレベルを形成するための専用回路を省く
ことができ、本画像信号入出力装置の回路構成をより簡
略することができる。
【００３３】なお、本発明は静止画像を記録するスチル
ビデオ装置において、ＮＴＳＣ方式、ＰＡＬ方式又はハ
イビジョン信号等の映像信号をスチルビデオ装置に記録
する際に、信号フォーマットを変換する装置として用い
ることができる。また、動画像を記録したビデオテープ
レコーダ、光ディスク装置等において１こま再生、つま
り静止画をディスプレイ等に表示させる際に、そのビデ
オテープ等から読み出した映像信号を１こま分蓄わえ、
ディスプレイに表示させる装置に用いることができる。
ビデオ装置において、ＮＴＳＣ方式、ＰＡＬ方式又はハ
イビジョン信号等の映像信号をスチルビデオ装置に記録
する際に、信号フォーマットを変換する装置として用い
ることができる。また、動画像を記録したビデオテープ
レコーダ、光ディスク装置等において１こま再生、つま
り静止画をディスプレイ等に表示させる際に、そのビデ
オテープ等から読み出した映像信号を１こま分蓄わえ、
ディスプレイに表示させる装置に用いることができる。
【００３４】
【発明の効果】以上詳述してきたように、本発明によれ
ば、映像信号の信号フォーマットを変換する際、又は動
画像における１こま再生等において、映像信号を一旦半
導体メモリに蓄わえ、その後新たにディスプレイ等に表
示できる画像信号を形成する際、帰線消去期間のペデス
タルレベルを付加する方法として、入力される映像信号
の最終部分に存在する帰線期間のペデスタルレベルをＡ
／Ｄ変換器に保持させ、そのＡ／Ｄ変換器出力を用いて
直接生成するので、回路の簡略化による装置のコンパク
ト化を図ることができると共に、半導体メモリの記憶容
量を必要最小限にすることができる。
ば、映像信号の信号フォーマットを変換する際、又は動
画像における１こま再生等において、映像信号を一旦半
導体メモリに蓄わえ、その後新たにディスプレイ等に表
示できる画像信号を形成する際、帰線消去期間のペデス
タルレベルを付加する方法として、入力される映像信号
の最終部分に存在する帰線期間のペデスタルレベルをＡ
／Ｄ変換器に保持させ、そのＡ／Ｄ変換器出力を用いて
直接生成するので、回路の簡略化による装置のコンパク
ト化を図ることができると共に、半導体メモリの記憶容
量を必要最小限にすることができる。
【図１】本発明の一実施例を適用した画像信号入出力装
置のブロック図である。
置のブロック図である。
【図２】本実施例においてブランキング信号／ＢＬＫ１
を生成するための論理図である。
を生成するための論理図である。
【図３】本実施例において生成された映像信号の様子を
示す図である。
示す図である。
【図４】従来例を示す図である。
１０ システムコントロール回路 １４ 操作部 ２１ 同期信号分離＆パルス発生回路 ２２ メモリコントロール回路 ２３、２４、２５ Ａ／Ｄ変換器 ２６ Ｙメモリ ２７ Ｒメモリ ２８ Ｂメモリ ３１、３２、３３ Ｄ／Ａ変換器
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成６年６月３０日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】請求項１
【補正方法】変更
【補正内容】
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】０００９
【補正方法】変更
【補正内容】
【０００９】 本発明に係る画像信号入出力装置は、入
力映像信号をデジタルデータに変換するＡ／Ｄ変換手段
と、前記デジタルデータを蓄えるメモリ手段と、該メモ
リ手段に蓄えられたデジタルデータおよび前記Ａ／Ｄ変
換手段出力データをＤ／Ａ変換するＤ／Ａ変換手段と、
前記入力映像信号の最終部にある帰線消去期間を検出し
て前記Ａ／Ｄ変換手段にその帰線消去期間のペデスタル
レベルをＡ／Ｄ変換させて停止させるとともに、出力映
像信号の帰線消去期間では前記Ａ／Ｄ変換手段の出力を
前記Ｄ／Ａ変換手段に出力させ、前記出力映像信号の映
像期間では前記メモリ手段に蓄えられたデータを前記Ｄ
／Ａ変換手段に出力させる手段とを備えることを特徴と
する。
力映像信号をデジタルデータに変換するＡ／Ｄ変換手段
と、前記デジタルデータを蓄えるメモリ手段と、該メモ
リ手段に蓄えられたデジタルデータおよび前記Ａ／Ｄ変
換手段出力データをＤ／Ａ変換するＤ／Ａ変換手段と、
前記入力映像信号の最終部にある帰線消去期間を検出し
て前記Ａ／Ｄ変換手段にその帰線消去期間のペデスタル
レベルをＡ／Ｄ変換させて停止させるとともに、出力映
像信号の帰線消去期間では前記Ａ／Ｄ変換手段の出力を
前記Ｄ／Ａ変換手段に出力させ、前記出力映像信号の映
像期間では前記メモリ手段に蓄えられたデータを前記Ｄ
／Ａ変換手段に出力させる手段とを備えることを特徴と
する。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】００１７
【補正方法】変更
【補正内容】
【００１７】 ブランキング信号／ＢＬＫ１は、本画像
信号入出力装置に入力される映像信号をＡ／Ｄ変換して
各Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８に書き込
む場合と、各メモリから映像信号を読み出す場合に、新
たに同期信号を付加する目的で、帰線消去期間、ペデス
タルレベルを付加する場合にＬｏｗレベルにされる。ま
た、Ｙメモリ２６、Ｒメモリ２７及びＢメモリ２８から
データを読み出す期間は、ブランキング信号／ＢＬＫ１
がブランキング信号／ＢＬＫ２と等しい論理で、Ｈｉｇ
ｈレベルにされる。Ｙメモリ２６から読み出されたデー
タはＤ／Ａ変換器３１に入力されてＤ／Ａ変換される。
このＤ／Ａ変換されたアナログ信号は加算器３９に入力
される。
信号入出力装置に入力される映像信号をＡ／Ｄ変換して
各Ｙメモリ２６、Ｒメモリ２７、Ｂメモリ２８に書き込
む場合と、各メモリから映像信号を読み出す場合に、新
たに同期信号を付加する目的で、帰線消去期間、ペデス
タルレベルを付加する場合にＬｏｗレベルにされる。ま
た、Ｙメモリ２６、Ｒメモリ２７及びＢメモリ２８から
データを読み出す期間は、ブランキング信号／ＢＬＫ１
がブランキング信号／ＢＬＫ２と等しい論理で、Ｈｉｇ
ｈレベルにされる。Ｙメモリ２６から読み出されたデー
タはＤ／Ａ変換器３１に入力されてＤ／Ａ変換される。
このＤ／Ａ変換されたアナログ信号は加算器３９に入力
される。
【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】００３０
【補正方法】変更
【補正内容】
【００３０】 これはブランキング信号／ＢＬＫ１によ
って制御できる。何故なら、同期信号発生回路３４から
入力されるブランキング信号／ＢＬＫ２をＡ／Ｄ変換器
２３、２４、２５の各出力イネーブル端子と、Ｙメモリ
２６、Ｒメモリ２７及びＢメモリ２８の各出力イネーブ
ル端子とにそのまま出力することによって、帰線消去期
間ではＡ／Ｄ変換器２３、２４、２５が各メモリ２６、
２７、２８に代わってＡ／Ｄ変換データをＤ／Ａ変換器
３１、３２、３３にそのまま出力するからである。すな
わち、ブランキング信号／ＢＬＫ１の出力（「Ｌ」）に
より、各メモリ２６、２７、２８からの読み出しが禁止
されている間、Ａ／Ｄ変換器２３、２４、２５からペデ
スタルレベルが継続的に出力される。
って制御できる。何故なら、同期信号発生回路３４から
入力されるブランキング信号／ＢＬＫ２をＡ／Ｄ変換器
２３、２４、２５の各出力イネーブル端子と、Ｙメモリ
２６、Ｒメモリ２７及びＢメモリ２８の各出力イネーブ
ル端子とにそのまま出力することによって、帰線消去期
間ではＡ／Ｄ変換器２３、２４、２５が各メモリ２６、
２７、２８に代わってＡ／Ｄ変換データをＤ／Ａ変換器
３１、３２、３３にそのまま出力するからである。すな
わち、ブランキング信号／ＢＬＫ１の出力（「Ｌ」）に
より、各メモリ２６、２７、２８からの読み出しが禁止
されている間、Ａ／Ｄ変換器２３、２４、２５からペデ
スタルレベルが継続的に出力される。
【手続補正５】
【補正対象書類名】明細書
【補正対象項目名】００３３
【補正方法】変更
【補正内容】
【００３３】 なお上記実施例は、例えばＮＴＳＣ方式
に従った映像信号が一旦メモリ２６、２７、２８に格納
された後、水平及び垂直帰線消去期間を付加されてメモ
リ２６、２７、２８から読み出され、新たに生成した同
期信号が付加された映像信号としてモニタ装置等に出力
される構成であったが、本発明は静止画像を記録するス
チルビデオ装置において、ＮＴＳＣ方式、ＰＡＬ方式又
はハイビジョン信号等の映像信号をスチルビデオ装置に
記録する際に、信号フォーマットを変換する装置として
用いることもできる。また、動画像を記録したビデオテ
ープレコーダ、光ディスク装置において１こま再生、つ
まり静止画をディスプレイ等に表示させる際に、そのビ
デオテープ等から読み出した映像信号を１こま分蓄わ
え、ディスプレイに表示させる装置に用いることができ
る。
に従った映像信号が一旦メモリ２６、２７、２８に格納
された後、水平及び垂直帰線消去期間を付加されてメモ
リ２６、２７、２８から読み出され、新たに生成した同
期信号が付加された映像信号としてモニタ装置等に出力
される構成であったが、本発明は静止画像を記録するス
チルビデオ装置において、ＮＴＳＣ方式、ＰＡＬ方式又
はハイビジョン信号等の映像信号をスチルビデオ装置に
記録する際に、信号フォーマットを変換する装置として
用いることもできる。また、動画像を記録したビデオテ
ープレコーダ、光ディスク装置において１こま再生、つ
まり静止画をディスプレイ等に表示させる際に、そのビ
デオテープ等から読み出した映像信号を１こま分蓄わ
え、ディスプレイに表示させる装置に用いることができ
る。
【手続補正６】
【補正対象書類名】図面
【補正対象項目名】図１
【補正方法】変更
【補正内容】
【図１】
Claims (1)
- 【請求項１】 第１映像信号フォーマットの入力映像信
号をデジタルデータに変換するＡ／Ｄ変換手段と、前記
デジタルデータを蓄えるメモリ手段と、該メモリ手段に
蓄えられたデジタルデータ及び前記Ａ／Ｄ変換手段出力
データをＤ／Ａ変換するＤ／Ａ変換手段と、前記入力映
像信号の最終部にある帰線消去期間を検出して前記Ａ／
Ｄ変換手段にその帰線消去期間のペデスタルレベルをＡ
／Ｄ変換させて停止させるとともに、第２映像信号フォ
ーマットの帰線消去期間では前記Ａ／Ｄ変換手段の出力
を前記Ｄ／Ａ変換手段に出力させ、前記第２映像信号フ
ォーマットの映像期間では前記メモリ手段に蓄えられた
データを前記Ｄ／Ａ変換手段に出力させる手段とを備え
ることを特徴とする画像信号入出力装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13110893A JP3222621B2 (ja) | 1993-05-07 | 1993-05-07 | 画像信号入出力装置 |
| US08/237,208 US5452022A (en) | 1993-05-07 | 1994-05-03 | Image signal storage device for a still video apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13110893A JP3222621B2 (ja) | 1993-05-07 | 1993-05-07 | 画像信号入出力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06319104A true JPH06319104A (ja) | 1994-11-15 |
| JP3222621B2 JP3222621B2 (ja) | 2001-10-29 |
Family
ID=15050173
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13110893A Expired - Fee Related JP3222621B2 (ja) | 1993-05-07 | 1993-05-07 | 画像信号入出力装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5452022A (ja) |
| JP (1) | JP3222621B2 (ja) |
Families Citing this family (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5784099A (en) * | 1994-09-13 | 1998-07-21 | Intel Corporation | Video camera and method for generating time varying video images in response to a capture signal |
| US5592237A (en) * | 1994-11-04 | 1997-01-07 | Infimed, Inc. | High resolution image processor with multiple bus architecture |
| JP3392967B2 (ja) * | 1994-12-27 | 2003-03-31 | ペンタックス株式会社 | スチルビデオカメラ |
| JP3688399B2 (ja) * | 1996-07-26 | 2005-08-24 | 株式会社東芝 | 歪補正回路 |
| US6380967B1 (en) * | 1996-12-07 | 2002-04-30 | Frank Sacca | System to capture, store, and retrieve composite video for transmission over telephone lines |
| JPH10285519A (ja) * | 1997-04-10 | 1998-10-23 | Asahi Optical Co Ltd | 画像記録装置 |
| EP1317136B1 (en) * | 1997-05-27 | 2006-04-19 | Seiko Epson Corporation | Image processing apparatus and integrated circuit therefor |
| JPH10336694A (ja) * | 1997-06-03 | 1998-12-18 | Brother Ind Ltd | 映像信号取込装置 |
| JPH11155150A (ja) * | 1997-11-20 | 1999-06-08 | Nintendo Co Ltd | 映像信号ディジタル処理装置、映像信号ディジタル処理のための情報記憶媒体、および映像信号ディジタル処理方法 |
| US6204792B1 (en) * | 1999-03-15 | 2001-03-20 | Photobit Corporation | Ping-pong readout |
| US7415161B2 (en) * | 2004-03-25 | 2008-08-19 | Faraday Technology Corp. | Method and related processing circuits for reducing memory accessing while performing de/compressing of multimedia files |
| JP4525726B2 (ja) * | 2007-10-23 | 2010-08-18 | 富士ゼロックス株式会社 | 復号装置、復号プログラム及び画像処理装置 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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1993
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-
1994
- 1994-05-03 US US08/237,208 patent/US5452022A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US5452022A (en) | 1995-09-19 |
| JP3222621B2 (ja) | 2001-10-29 |
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