JPH0563476A - Ａｇｃ回路 - Google Patents
Ａｇｃ回路Info
- Publication number
- JPH0563476A JPH0563476A JP24032191A JP24032191A JPH0563476A JP H0563476 A JPH0563476 A JP H0563476A JP 24032191 A JP24032191 A JP 24032191A JP 24032191 A JP24032191 A JP 24032191A JP H0563476 A JPH0563476 A JP H0563476A
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- JP
- Japan
- Prior art keywords
- circuit
- output
- agc
- integrating
- signal
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- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】
【目的】 ＴＡＣＡＮ／ＤＭＥの受信機のＡＧＣ回路に
おいて、受信信号の低レベル時におけるＳ／Ｎを改善す
る。 【構成】 受信信号を増幅するリニア増幅器１，２と、
増幅器の出力を包絡線検波する検波回路３と、検波回路
の出力からペアパルス信号を抽出するデコーダ回路４
と、デコーダ回路の出力のピーク値を保持するピークホ
ールド回路５と、検波回路の出力を積分する積分回路７
と、積分回路の出力とピークホールド回路の出力を加算
する加算回路８と、加算回路の出力によりＡＧＣ電圧を
発生してリニア増幅器の利得を制御するＡＧＣ回路６と
を備える。
おいて、受信信号の低レベル時におけるＳ／Ｎを改善す
る。 【構成】 受信信号を増幅するリニア増幅器１，２と、
増幅器の出力を包絡線検波する検波回路３と、検波回路
の出力からペアパルス信号を抽出するデコーダ回路４
と、デコーダ回路の出力のピーク値を保持するピークホ
ールド回路５と、検波回路の出力を積分する積分回路７
と、積分回路の出力とピークホールド回路の出力を加算
する加算回路８と、加算回路の出力によりＡＧＣ電圧を
発生してリニア増幅器の利得を制御するＡＧＣ回路６と
を備える。
Description
【０００１】
【産業上の利用分野】本発明はＡＧＣ回路に関し、特に
ＴＡＣＡＮ／ＤＭＥの受信機における最大利得時のノイ
ズレベルを抑圧するＡＧＣ回路に関する。
ＴＡＣＡＮ／ＤＭＥの受信機における最大利得時のノイ
ズレベルを抑圧するＡＧＣ回路に関する。
【０００２】
【従来の技術】従来、ＴＡＣＡＮ／ＤＭＥの受信機にお
けるＡＧＣ回路として図２に示す回路が用いられてい
る。同図に示す例は、２段増幅回路として受信信号１０
１を増幅するリニア増幅器１及び２と、リニア増幅器２
の出力する増幅受信信号を包絡線検波する検波回路３
と、検波回路３の検出出力信号３０１からペアパルスに
よる送信信号を抽出してデコード信号４０１として出力
するデコーダ回路４と、デコード信号４０１を受けてそ
のピーク値を保持するピークホールド回路５と、ピーク
ホールド回路５によって保持されたピーク値に基づいて
リニア増幅器１，２の利得を適正に制御すべきＡＧＣ電
圧を発生するＡＧＣ回路６から構成され、ピークホール
ド回路５とＡＧＣ回路６による閉ループ構成でＡＧＣ動
作を行っている。
けるＡＧＣ回路として図２に示す回路が用いられてい
る。同図に示す例は、２段増幅回路として受信信号１０
１を増幅するリニア増幅器１及び２と、リニア増幅器２
の出力する増幅受信信号を包絡線検波する検波回路３
と、検波回路３の検出出力信号３０１からペアパルスに
よる送信信号を抽出してデコード信号４０１として出力
するデコーダ回路４と、デコード信号４０１を受けてそ
のピーク値を保持するピークホールド回路５と、ピーク
ホールド回路５によって保持されたピーク値に基づいて
リニア増幅器１，２の利得を適正に制御すべきＡＧＣ電
圧を発生するＡＧＣ回路６から構成され、ピークホール
ド回路５とＡＧＣ回路６による閉ループ構成でＡＧＣ動
作を行っている。
【０００３】
【発明が解決しようとする課題】このような従来のＴＡ
ＣＡＮ／ＤＭＥの受信機におけるＡＧＣ回路は、受信信
号１０１が非常に低いレベルとなった場合、２つのリニ
ア増幅器１，２は最大利得状態となり、多くの熱雑音を
発生させる。このため、検波出力信号３０１のノイズレ
ベルが増大し、Ｓ／Ｎが劣化するという問題がある。本
発明の目的は、受信信号の低レベル時におけるＳ／Ｎを
改善したＡＧＣ回路を提供することにある。
ＣＡＮ／ＤＭＥの受信機におけるＡＧＣ回路は、受信信
号１０１が非常に低いレベルとなった場合、２つのリニ
ア増幅器１，２は最大利得状態となり、多くの熱雑音を
発生させる。このため、検波出力信号３０１のノイズレ
ベルが増大し、Ｓ／Ｎが劣化するという問題がある。本
発明の目的は、受信信号の低レベル時におけるＳ／Ｎを
改善したＡＧＣ回路を提供することにある。
【０００４】
【課題を解決するための手段】本発明のＡＧＣ回路は、
受信信号を包絡線検波する検波回路の出力を積分する積
分回路と、この積分回路の出力とデコーダ回路の出力ピ
ーク値を保持するピークホールド回路の出力を加算する
加算回路を有しており、この加算回路の出力によりＡＧ
Ｃ回路がリニア増幅器の利得を制御するように構成す
る。
受信信号を包絡線検波する検波回路の出力を積分する積
分回路と、この積分回路の出力とデコーダ回路の出力ピ
ーク値を保持するピークホールド回路の出力を加算する
加算回路を有しており、この加算回路の出力によりＡＧ
Ｃ回路がリニア増幅器の利得を制御するように構成す
る。
【０００５】
【作用】本発明によれば、特に受信信号の入力レベルが
低いときには、積分回路の出力でＡＧＣ動作が行われる
ようになり、このＡＧＣ動作によってリニア増幅器の利
得が低下され、熱雑音の発生を抑制してＳ／Ｎを改善す
る。
低いときには、積分回路の出力でＡＧＣ動作が行われる
ようになり、このＡＧＣ動作によってリニア増幅器の利
得が低下され、熱雑音の発生を抑制してＳ／Ｎを改善す
る。
【０００６】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明のＡＧＣ回路を用いたＴＡＣＡＮ／Ｄ
ＭＥの受信機の受信回路の主要部分を示すブロック図で
ある。同図に示す例は、２段増幅回路として受信信号１
０１を増幅するリニア増幅器１及び２と、リニア増幅器
２の出力する増幅受信信号を包絡線検波する検波回路３
と、検波回路３の検出出力信号３０１からペアパルスに
よる送信信号を抽出しデコード信号４０１として出力す
るデコーダ回路４と、デコード信号４０１を受けてその
ピーク値を保持するピークホールド回路５と、前記検波
出力信号３０１を積分する積分回路７と、ピークホール
ド回路５によって保持されたピーク値信号５０１と積分
回路７の出力を加算する加算回路８と、加算回路８の出
力により前記リニア増幅器１，２の利得を適正制御すべ
きＡＧＣ電圧を発生するＡＧＣ回路６とで構成され、こ
れらで閉ループ構成のＡＧＣ動作を行っている。
る。図１は本発明のＡＧＣ回路を用いたＴＡＣＡＮ／Ｄ
ＭＥの受信機の受信回路の主要部分を示すブロック図で
ある。同図に示す例は、２段増幅回路として受信信号１
０１を増幅するリニア増幅器１及び２と、リニア増幅器
２の出力する増幅受信信号を包絡線検波する検波回路３
と、検波回路３の検出出力信号３０１からペアパルスに
よる送信信号を抽出しデコード信号４０１として出力す
るデコーダ回路４と、デコード信号４０１を受けてその
ピーク値を保持するピークホールド回路５と、前記検波
出力信号３０１を積分する積分回路７と、ピークホール
ド回路５によって保持されたピーク値信号５０１と積分
回路７の出力を加算する加算回路８と、加算回路８の出
力により前記リニア増幅器１，２の利得を適正制御すべ
きＡＧＣ電圧を発生するＡＧＣ回路６とで構成され、こ
れらで閉ループ構成のＡＧＣ動作を行っている。
【０００７】動作は次の通りである。積分回路７と加算
回路８以外の動作は図２に示した従来例と同じである。
積分回路７は検波出力信号３０１を積分し、加算回路８
に出力しているが、受信信号１０１の入力レベルが非常
に低いレベルとならない限りＴＡＣＡＮ／ＤＭＥの信号
はそのデューティ比が約１％と低いため、積分出力信号
７０１の平均レベルは低い。このため、ＡＧＣ回路６の
動作はピークホールド回路５の出力であるピーク値信号
５０１によって決定される。つまり、受信信号１０１に
よってＡＧＣ動作が行われる。
回路８以外の動作は図２に示した従来例と同じである。
積分回路７は検波出力信号３０１を積分し、加算回路８
に出力しているが、受信信号１０１の入力レベルが非常
に低いレベルとならない限りＴＡＣＡＮ／ＤＭＥの信号
はそのデューティ比が約１％と低いため、積分出力信号
７０１の平均レベルは低い。このため、ＡＧＣ回路６の
動作はピークホールド回路５の出力であるピーク値信号
５０１によって決定される。つまり、受信信号１０１に
よってＡＧＣ動作が行われる。
【０００８】ところが、受信信号１０１の入力レベルが
非常に低いレベルになると、ピーク値信号５０１のレベ
ルが下がり、このためＡＧＣ回路６の制御によりリニア
増幅器１，２が最大利得状態となり、多くの熱雑音を発
生するようになる。すると、検波出力信号３０１の熱雑
音が増大し、この熱雑音はデューティ比が高いため、積
分出力信号７０１の平均レベルは高くなる。このため、
ＡＧＣ回路６の動作は積分回路７の出力信号である積分
出力信号７０１によって決定されるようになる。積分出
力信号７０１が高くなると、ＡＧＣ回路６がリニア増幅
器１，２の利得を下げる制御を行うように設定すること
により、検波出力信号３０１のノイズレベルの増大を抑
圧することができる。
非常に低いレベルになると、ピーク値信号５０１のレベ
ルが下がり、このためＡＧＣ回路６の制御によりリニア
増幅器１，２が最大利得状態となり、多くの熱雑音を発
生するようになる。すると、検波出力信号３０１の熱雑
音が増大し、この熱雑音はデューティ比が高いため、積
分出力信号７０１の平均レベルは高くなる。このため、
ＡＧＣ回路６の動作は積分回路７の出力信号である積分
出力信号７０１によって決定されるようになる。積分出
力信号７０１が高くなると、ＡＧＣ回路６がリニア増幅
器１，２の利得を下げる制御を行うように設定すること
により、検波出力信号３０１のノイズレベルの増大を抑
圧することができる。
【０００９】
【発明の効果】以上説明したように本発明は、検波出力
を積分する積分回路と、ピークホールド回路の出力と積
分回路の出力を加算する加算回路を有し、この加算回路
の出力でリニア増幅器の利得を制御するように構成して
いるので、検波出力信号を積分した積分出力信号が高レ
ベルとなったときにリニア増幅器の利得を下げる制御を
行うことにより、従来に比較して低いレベルの受信信号
入力時に検波出力信号のノイズレベルの増大を抑圧し、
Ｓ／Ｎを改善することができる効果がある。
を積分する積分回路と、ピークホールド回路の出力と積
分回路の出力を加算する加算回路を有し、この加算回路
の出力でリニア増幅器の利得を制御するように構成して
いるので、検波出力信号を積分した積分出力信号が高レ
ベルとなったときにリニア増幅器の利得を下げる制御を
行うことにより、従来に比較して低いレベルの受信信号
入力時に検波出力信号のノイズレベルの増大を抑圧し、
Ｓ／Ｎを改善することができる効果がある。
【図１】本発明のＡＧＣ回路の回路図である。
【図２】従来のＡＧＣ回路の回路図である。
【符号の説明】 １，２ リニア増幅器 ３ 検波回路 ４ デコーダ回路 ５ ピークホールド回路 ６ ＡＧＣ回路 ７ 積分回路 ８ 加算回路
Claims (1)
- 【請求項１】 ＴＡＣＡＮ／ＤＭＥの受信機に設けら
れ、受信信号を増幅するリニア増幅器と、この増幅器の
出力を包絡線検波する検波回路と、この検波回路の出力
からペアパルス信号を抽出するデコーダ回路と、このデ
コーダ回路の出力のピーク値を保持するピークホールド
回路と、前記検波回路の出力を積分する積分回路と、こ
の積分回路の出力と前記ピークホールド回路の出力を加
算する加算回路と、この加算回路の出力によりＡＧＣ電
圧を発生して前記リニア増幅器の利得を制御するＡＧＣ
回路とを備えることを特徴とするＡＧＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24032191A JPH0563476A (ja) | 1991-08-28 | 1991-08-28 | Ａｇｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24032191A JPH0563476A (ja) | 1991-08-28 | 1991-08-28 | Ａｇｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0563476A true JPH0563476A (ja) | 1993-03-12 |
Family
ID=17057734
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24032191A Pending JPH0563476A (ja) | 1991-08-28 | 1991-08-28 | Ａｇｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0563476A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0936680A (ja) * | 1995-07-14 | 1997-02-07 | Nec Corp | Ａｇｃアンプ |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56108982A (en) * | 1980-02-01 | 1981-08-28 | Nec Corp | Receiver for pair-pulse distance-measurement signal |
| JPH01270687A (ja) * | 1988-04-22 | 1989-10-27 | Nec Corp | デブロッキング回路 |
| JPH03113385A (ja) * | 1989-09-28 | 1991-05-14 | Nec Corp | デブロッキング回路 |
-
1991
- 1991-08-28 JP JP24032191A patent/JPH0563476A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56108982A (en) * | 1980-02-01 | 1981-08-28 | Nec Corp | Receiver for pair-pulse distance-measurement signal |
| JPH01270687A (ja) * | 1988-04-22 | 1989-10-27 | Nec Corp | デブロッキング回路 |
| JPH03113385A (ja) * | 1989-09-28 | 1991-05-14 | Nec Corp | デブロッキング回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0936680A (ja) * | 1995-07-14 | 1997-02-07 | Nec Corp | Ａｇｃアンプ |
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