JPH0559634B2 - - Google Patents
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- JPH0559634B2 JPH0559634B2 JP56209394A JP20939481A JPH0559634B2 JP H0559634 B2 JPH0559634 B2 JP H0559634B2 JP 56209394 A JP56209394 A JP 56209394A JP 20939481 A JP20939481 A JP 20939481A JP H0559634 B2 JPH0559634 B2 JP H0559634B2
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- JP
- Japan
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- signal
- circuit
- signal generation
- generation means
- test wave
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- 238000001514 detection method Methods 0.000 claims description 17
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 12
- 238000000926 separation method Methods 0.000 claims description 4
- 230000003111 delayed effect Effects 0.000 claims 2
- 238000007599 discharging Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 8
- 239000003990 capacitor Substances 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- 238000000034 method Methods 0.000 description 2
- 238000005070 sampling Methods 0.000 description 2
- 230000002411 adverse Effects 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Receiver Circuits (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
本発明は、ビデオ信号の自動利得制御（以下
AGCと略す）回路に好適な集積回路に関するも
のである。
AGCと略す）回路に好適な集積回路に関するも
のである。
通常、VTR等で用いられているビデオ信号の
記録用AGC回路においては、同期信号のバツク
ポーチに白パルスを付加したビデオ信号を被検波
信号として発生させて、AGC制御信号を得、ビ
デオ信号のシンクチツプから白レベルまでの振幅
が一定になるように制御している。従来上記白パ
ルスをビデオ信号に付加するためのキーパルスを
得る集積回路としては、第１図に示すように、ピ
ーク検波回路１と微小定電流放電回路２と比較器
３から構成し、等価的に入力された同期信号の後
縁を遅延させたパルスを得ていた。ピーク検波用
コンデンサ４としてモノリシツクICに内蔵可能
な値は10pF程度であり、その時の放電電流は
10μA程度になるが、抵抗バイアス法電流吸込み
回路で比較的容易に得られ、集積化を実現してい
る。第２図の動作説明図を用いてさらに詳細に説
明する。第２図ａに示した可変利得回路５の出力
であるビデオ信号から、同期分離回路６を介して
得られた第２図ｂに示した同期信号が、ピーク検
波回路１に供給され、同期信号のピークがサンプ
ルされる。サンプルされた電位は、微小定電流放
電回路２において、非サンプル期間に放電降下し
て、放電回路２の出力は第２図ｃに示すようにな
る。第２図ｃの信号は、基準電圧源７で与えられ
た比較電位イ〔第２図ｃに破線で図示〕を有する
比較器３に供給され、比較器３からは、第２図ｃ
に示した信号が比較電位イより高い場合高電位
を、低い場合低電位を有する第２図ｄに示すよう
なパルスを発生し、被検波信号発生回路８にキー
パルスとして入力される。被検波信号発生回路８
では、上記キーパルス期間だけ、他方から入力さ
れたビデオ信号とシンクチツプとの電位差を定数
倍して白パルスを発生させ、ビデオ信号に付加
し、第２図ｅに示すような被検波信号を得て、検
波回路９を介して可変利得回路５を制御してい
た。
記録用AGC回路においては、同期信号のバツク
ポーチに白パルスを付加したビデオ信号を被検波
信号として発生させて、AGC制御信号を得、ビ
デオ信号のシンクチツプから白レベルまでの振幅
が一定になるように制御している。従来上記白パ
ルスをビデオ信号に付加するためのキーパルスを
得る集積回路としては、第１図に示すように、ピ
ーク検波回路１と微小定電流放電回路２と比較器
３から構成し、等価的に入力された同期信号の後
縁を遅延させたパルスを得ていた。ピーク検波用
コンデンサ４としてモノリシツクICに内蔵可能
な値は10pF程度であり、その時の放電電流は
10μA程度になるが、抵抗バイアス法電流吸込み
回路で比較的容易に得られ、集積化を実現してい
る。第２図の動作説明図を用いてさらに詳細に説
明する。第２図ａに示した可変利得回路５の出力
であるビデオ信号から、同期分離回路６を介して
得られた第２図ｂに示した同期信号が、ピーク検
波回路１に供給され、同期信号のピークがサンプ
ルされる。サンプルされた電位は、微小定電流放
電回路２において、非サンプル期間に放電降下し
て、放電回路２の出力は第２図ｃに示すようにな
る。第２図ｃの信号は、基準電圧源７で与えられ
た比較電位イ〔第２図ｃに破線で図示〕を有する
比較器３に供給され、比較器３からは、第２図ｃ
に示した信号が比較電位イより高い場合高電位
を、低い場合低電位を有する第２図ｄに示すよう
なパルスを発生し、被検波信号発生回路８にキー
パルスとして入力される。被検波信号発生回路８
では、上記キーパルス期間だけ、他方から入力さ
れたビデオ信号とシンクチツプとの電位差を定数
倍して白パルスを発生させ、ビデオ信号に付加
し、第２図ｅに示すような被検波信号を得て、検
波回路９を介して可変利得回路５を制御してい
た。
しかし上述の従来技術においては、AGC回路
前段の周波数特性の影響等により、第３図ａに示
すようなバツクポーチ前縁がもち上がつたビデオ
信号がAGC回路に入力されると、キーパルス期
間中のペデスタルレベルに上記もち上がりがある
ため、付加される白パルスは第３図ｂに示すよう
になる。このため被検波信号は第３図ｃに示すよ
うな波形になり、検波回路９の出力はもち上がつ
た分だけ高くなり、可変利得回路の利得が小さく
なり、ビデオ信号の振幅が所望のレベルより小さ
くなるという欠点があつた。
前段の周波数特性の影響等により、第３図ａに示
すようなバツクポーチ前縁がもち上がつたビデオ
信号がAGC回路に入力されると、キーパルス期
間中のペデスタルレベルに上記もち上がりがある
ため、付加される白パルスは第３図ｂに示すよう
になる。このため被検波信号は第３図ｃに示すよ
うな波形になり、検波回路９の出力はもち上がつ
た分だけ高くなり、可変利得回路の利得が小さく
なり、ビデオ信号の振幅が所望のレベルより小さ
くなるという欠点があつた。
本発明の目的は上記した従来技術の欠点をなく
し、AGC回路に入力されたビデオ信号のバツク
ポーチ前縁の波形歪にかかわらずAGC性能の良
好なAGC用集積回路を提供することにある。
し、AGC回路に入力されたビデオ信号のバツク
ポーチ前縁の波形歪にかかわらずAGC性能の良
好なAGC用集積回路を提供することにある。
上記目的を達成するために、本発明では、キー
パルスを得る集積回路として、集積化可能なピー
ク検波回路と微小低電流放電回路により同期信号
の後縁の立ち下りに傾斜をもつた傾斜パルスを発
生させるとともに、上記傾斜パルスを横切る２個
の比較電位を設けて、上記傾斜パルスの電位が２
個の比較電位の間にあるときのみ高電位のパルス
を発生させ、キーパルスとするものである。即ち
第１の比較電位により同期信号のバツクポーチ前
縁部をキーパルス期間から除き、第２の比較電位
によりキーパルス終端を決定して、上記前縁部に
生じた波形歪の影響を解消するものである。
パルスを得る集積回路として、集積化可能なピー
ク検波回路と微小低電流放電回路により同期信号
の後縁の立ち下りに傾斜をもつた傾斜パルスを発
生させるとともに、上記傾斜パルスを横切る２個
の比較電位を設けて、上記傾斜パルスの電位が２
個の比較電位の間にあるときのみ高電位のパルス
を発生させ、キーパルスとするものである。即ち
第１の比較電位により同期信号のバツクポーチ前
縁部をキーパルス期間から除き、第２の比較電位
によりキーパルス終端を決定して、上記前縁部に
生じた波形歪の影響を解消するものである。
以下本発明を実施例を用いて説明する。第４図
は本発明のAGC用集積回路の一実施例を示す図
で、第５図は本発明の動作を説明する図である。
第４図において、第１図に示した従来例と同等あ
るいは同一部分は同一番号が付してある。今、従
来例ではAGC特性を劣化させる第５図ａに示す
ようなビデオ信号がAGC回路に入力されると、
可変利得回路５、同期信号分離回路６を介して、
第５図ｂに示すような同期信号が得られ、次段の
ピーク検波回路１に供給される。ピーク検波回路
１及び微小定電流放電回路２では、同期信号のピ
ーク電位をサンプルするとともに、非サンプル期
間には放電降下し、第５図ｃに示すような信号が
得られる。第５図ｃの信号は、基準電圧源１０で
与えられた比較電位ロ〔第５図ｃに破線で図示〕
を有する比較器１１、および基準電圧源１２で与
えられた比較電位ハ〔第５図ｃに一点鎖線で図
示〕を有する比較器１３に供給され、比較器１１
の出力として第５図ｄ、また比較器１３の出力と
して第５図ｅに示すような信号が得られる。次に
AND回路１４で、上記比較器１１，１３の両出
力のANDをとると、第５図ｆに示すようなビデ
オ信号のバツクポーチの前縁を含まないパルスが
得られ、キーパルスとして被検波信号発生回路８
に供給される。而して、被検波信号としては、第
５図ｇに示すように、バツクポーチ前縁のもち上
がりによる悪影響をうけていない白パルスが付加
されることとになり、AGC性能の劣化を解消で
きる。またピーク検波用コンデンサ４としては、
従来例で前に説明したように、モノリシツクIC
に内蔵可能な値（10pF程度）で、十分第５図ｃ
に示すような信号が得られ、本発明の全構成の集
積化が容易に可能となる。
は本発明のAGC用集積回路の一実施例を示す図
で、第５図は本発明の動作を説明する図である。
第４図において、第１図に示した従来例と同等あ
るいは同一部分は同一番号が付してある。今、従
来例ではAGC特性を劣化させる第５図ａに示す
ようなビデオ信号がAGC回路に入力されると、
可変利得回路５、同期信号分離回路６を介して、
第５図ｂに示すような同期信号が得られ、次段の
ピーク検波回路１に供給される。ピーク検波回路
１及び微小定電流放電回路２では、同期信号のピ
ーク電位をサンプルするとともに、非サンプル期
間には放電降下し、第５図ｃに示すような信号が
得られる。第５図ｃの信号は、基準電圧源１０で
与えられた比較電位ロ〔第５図ｃに破線で図示〕
を有する比較器１１、および基準電圧源１２で与
えられた比較電位ハ〔第５図ｃに一点鎖線で図
示〕を有する比較器１３に供給され、比較器１１
の出力として第５図ｄ、また比較器１３の出力と
して第５図ｅに示すような信号が得られる。次に
AND回路１４で、上記比較器１１，１３の両出
力のANDをとると、第５図ｆに示すようなビデ
オ信号のバツクポーチの前縁を含まないパルスが
得られ、キーパルスとして被検波信号発生回路８
に供給される。而して、被検波信号としては、第
５図ｇに示すように、バツクポーチ前縁のもち上
がりによる悪影響をうけていない白パルスが付加
されることとになり、AGC性能の劣化を解消で
きる。またピーク検波用コンデンサ４としては、
従来例で前に説明したように、モノリシツクIC
に内蔵可能な値（10pF程度）で、十分第５図ｃ
に示すような信号が得られ、本発明の全構成の集
積化が容易に可能となる。
第６図に本発明の一具体的集積回路例を示す。
第６図においても、第１図、第４図と同等あるい
は同一部分は同一番号を付している。トランジス
タ１５とコンデンサ４でピーク検波回路１を、ト
ランジスタ１６，１７、抵抗１８，１９，２０で
抵抗バイアス法電流吸込み回路による微小定電流
放電回路２を構成している。トランジスタ２１、
抵抗２２は、上記ピーク検波回路１及び微小定電
流放電回路２からの信号を高インピーダンスでう
け、トランジスタ２３，２４、定電流源２５、抵
抗２６、基準電圧源１２からなる比較器１３およ
びトランジスタ２７，２８、定電流源２９、抵抗
３０、基準電圧源１０からなる比較器１１に供給
している。抵抗３１では、上記両比較器１１，１
３からの出力のAND信号を得、トランジスタ３
２、抵抗３３からなる高入力・低出力インピーダ
ンス回路に供給している。而してトランジスタ３
２のエミツタからはバツクポーチ前縁を含まない
キーパルスが次段の被検波信号発生回路８に供給
されることとなり、比較的簡単な回路で集積化が
実現できる。
第６図においても、第１図、第４図と同等あるい
は同一部分は同一番号を付している。トランジス
タ１５とコンデンサ４でピーク検波回路１を、ト
ランジスタ１６，１７、抵抗１８，１９，２０で
抵抗バイアス法電流吸込み回路による微小定電流
放電回路２を構成している。トランジスタ２１、
抵抗２２は、上記ピーク検波回路１及び微小定電
流放電回路２からの信号を高インピーダンスでう
け、トランジスタ２３，２４、定電流源２５、抵
抗２６、基準電圧源１２からなる比較器１３およ
びトランジスタ２７，２８、定電流源２９、抵抗
３０、基準電圧源１０からなる比較器１１に供給
している。抵抗３１では、上記両比較器１１，１
３からの出力のAND信号を得、トランジスタ３
２、抵抗３３からなる高入力・低出力インピーダ
ンス回路に供給している。而してトランジスタ３
２のエミツタからはバツクポーチ前縁を含まない
キーパルスが次段の被検波信号発生回路８に供給
されることとなり、比較的簡単な回路で集積化が
実現できる。
以上述べたように本発明によれば、AGC回路
に入力されるビデオ信号の波形歪にかかわらず
AGC性能が良好で、集積化に適したAGC用集積
回路を実現できる。
に入力されるビデオ信号の波形歪にかかわらず
AGC性能が良好で、集積化に適したAGC用集積
回路を実現できる。
第１図は、従来のAGC用集積回路を示す図、
第２図、第３図は従来例の説明図、第４図は本発
明の一実施例を示す図、第５図は本発明の動作を
説明する図、第６図は本発明の一具体的回路例を
示す図である。 図において、１……ピーク検波回路、２……微
小定電流放電回路、３，１１，１３……比較器、
６……同期分離回路、８……被検波信号発生回
路、１４……AND回路である。
第２図、第３図は従来例の説明図、第４図は本発
明の一実施例を示す図、第５図は本発明の動作を
説明する図、第６図は本発明の一具体的回路例を
示す図である。 図において、１……ピーク検波回路、２……微
小定電流放電回路、３，１１，１３……比較器、
６……同期分離回路、８……被検波信号発生回
路、１４……AND回路である。
Claims (1)
- 【特許請求の範囲】 １ 入力映像信号のレベルを変化させる可変利得
回路と、可変利得回路の出力信号から同期信号を
分離する同期分離回路と、上記可変利得回路から
供給された映像信号と上記映像信号のシンクチツ
プレベルとの電位差を入力制御信号の期間だけ定
数倍した白レベル相当のパルスを上記映像信号に
付加し被検波信号を発生させる被検波信号発生回
路と、上記被検波信号発生回路からの出力信号よ
り検波信号を得て上記可変利得回路に供給する検
波回路と、同期信号の後縁から時刻t1（t1＞０）
だけ遅延したタイミング信号を生成する第１の信
号発生手段と、上記同期信号の後縁から時刻t2
（t1＜t2）だけ遅延したタイミング信号を生成す
る第２の信号生成手段と、上記第１、第２の信号
生成手段からの出力信号により時刻t1とt2の間の
期間を示す信号を生成する第３の信号生成手段と
を有し、上記第３の信号生成手段からの出力信号
を上記被検波信号発生回路に上記制御信号として
供給することを特徴とする自動利得制御用回路。 ２ 上記第１の信号生成手段と上記第２の信号生
成手段はパルスの後縁から放電を開始する放電回
路と、上記放電回路の電圧をそれぞれ異なる２個
の基準電圧で比較する比較回路とからなることを
特徴とする特許請求の範囲第１項記載の自動利得
制御用回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56209394A JPS58111587A (ja) | 1981-12-25 | 1981-12-25 | 自動利得制御用回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56209394A JPS58111587A (ja) | 1981-12-25 | 1981-12-25 | 自動利得制御用回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58111587A JPS58111587A (ja) | 1983-07-02 |
| JPH0559634B2 true JPH0559634B2 (ja) | 1993-08-31 |
Family
ID=16572167
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56209394A Granted JPS58111587A (ja) | 1981-12-25 | 1981-12-25 | 自動利得制御用回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58111587A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2611337B1 (fr) * | 1987-02-20 | 1989-05-26 | Thomson Semiconducteurs | Dispositif de commande automatique de gain de signaux video |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5062725A (ja) * | 1973-10-05 | 1975-05-28 | ||
| JPS554747A (en) * | 1978-06-28 | 1980-01-14 | Hitachi Ltd | Video signal recording circuit |
-
1981
- 1981-12-25 JP JP56209394A patent/JPS58111587A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5062725A (ja) * | 1973-10-05 | 1975-05-28 | ||
| JPS554747A (en) * | 1978-06-28 | 1980-01-14 | Hitachi Ltd | Video signal recording circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58111587A (ja) | 1983-07-02 |
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