JPH05283990A - デューティ補正回路 - Google Patents
デューティ補正回路Info
- Publication number
- JPH05283990A JPH05283990A JP8130492A JP8130492A JPH05283990A JP H05283990 A JPH05283990 A JP H05283990A JP 8130492 A JP8130492 A JP 8130492A JP 8130492 A JP8130492 A JP 8130492A JP H05283990 A JPH05283990 A JP H05283990A
- Authority
- JP
- Japan
- Prior art keywords
- width
- lock
- value
- duty
- duty correction
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Pulse Circuits (AREA)
Abstract
(57)【要約】
【目的】ジッタの発生を抑える。
【構成】記憶部6にデューティ幅計算部5から出力され
る過去複数回分の“H幅−L幅”の計算結果の値を蓄積
する。デューティ補正判断部7は、記憶部6に蓄積され
た計算結果の値により入力信号のデューティ補正を行う
か否かを判断する。
る過去複数回分の“H幅−L幅”の計算結果の値を蓄積
する。デューティ補正判断部7は、記憶部6に蓄積され
た計算結果の値により入力信号のデューティ補正を行う
か否かを判断する。
Description
【0001】
【産業上の利用分野】本発明はデューティ補正回路に関
する。
する。
【0002】
【従来の技術】従来のデューティ補正回路は、図3に示
す様に、フリップフロップ1と、パルス発生部2と、入
力信号の論理Hの継続時間であるH幅を演算するH幅計
算部3と、入力信号の論理Lの継続時間であるL幅を演
算するL幅計算部4と、このH幅,L幅を入力してH幅
からL幅を減算し出力するデューティ幅計算部9と、リ
セットタイミングを制御するリセットタイミング制御部
8とを備える。
す様に、フリップフロップ1と、パルス発生部2と、入
力信号の論理Hの継続時間であるH幅を演算するH幅計
算部3と、入力信号の論理Lの継続時間であるL幅を演
算するL幅計算部4と、このH幅,L幅を入力してH幅
からL幅を減算し出力するデューティ幅計算部9と、リ
セットタイミングを制御するリセットタイミング制御部
8とを備える。
【0003】以下に、従来のデューティ補正回路の動作
の流れを示す図4を参照して説明する。H幅からL幅を
減算し(ステップ20:S20)、この計算結果により
判断し(S21)、H幅の方が大きいと、リセットタイ
ミングレジスタの値を“−1”する(S24)事により
H幅の時間を小さくし、又L幅の方が大きいと、リセッ
トタイミングレジスタの値を“+1”する(S22)事
によりL幅の時間を小さくする事が出来る。
の流れを示す図4を参照して説明する。H幅からL幅を
減算し(ステップ20:S20)、この計算結果により
判断し(S21)、H幅の方が大きいと、リセットタイ
ミングレジスタの値を“−1”する(S24)事により
H幅の時間を小さくし、又L幅の方が大きいと、リセッ
トタイミングレジスタの値を“+1”する(S22)事
によりL幅の時間を小さくする事が出来る。
【0004】例えば、H幅からL幅を減算した計算結
果、H幅の方が大きいとすると、リセットタイミングレ
ジスタの値を“−1”する事により、今度はH幅からL
幅を減算した計算結果はL幅の方が大きくなり、リセッ
トタイミングレジスタの値を“+1”すると、またH幅
からL幅を減算した計算結果はH幅の方が大きくなり、
リセットタイミングレジスタの値を“−1”すると、今
度はH幅からL幅を減算した計算結果はL幅の方が大き
くなりリセットタイミングレジスタの値を“+1”する
動作を、“H幅=L幅”となる(S23)まで繰り返し
動作していた。
果、H幅の方が大きいとすると、リセットタイミングレ
ジスタの値を“−1”する事により、今度はH幅からL
幅を減算した計算結果はL幅の方が大きくなり、リセッ
トタイミングレジスタの値を“+1”すると、またH幅
からL幅を減算した計算結果はH幅の方が大きくなり、
リセットタイミングレジスタの値を“−1”すると、今
度はH幅からL幅を減算した計算結果はL幅の方が大き
くなりリセットタイミングレジスタの値を“+1”する
動作を、“H幅=L幅”となる(S23)まで繰り返し
動作していた。
【0005】
【発明が解決しようとする課題】従来のデューティ補正
回路では、現在のH幅,L幅の値だけでデューティの補
正を行っていたため、ジッタの発生を抑える事が出来な
いという問題点があった。
回路では、現在のH幅,L幅の値だけでデューティの補
正を行っていたため、ジッタの発生を抑える事が出来な
いという問題点があった。
【0006】
【課題を解決するための手段】本発明のデューティ補正
回路は、入力信号の論理Hの継続時間であるH幅と入力
信号の論理Lの継続時間であるL幅を示す値を入力して
このH幅からL幅を減算しこの計算結果の値を出力する
デューティ幅計算部を備えたデューティ補正回路におい
て、このデューティ幅計算部から出力される過去複数回
分の計算結果の値を蓄積するための記憶部と、この記憶
部に蓄積された計算結果の値により前記入力信号のデュ
ーティ補正を行うか否かを判断するデューティ補正判断
部とを備える構成である。
回路は、入力信号の論理Hの継続時間であるH幅と入力
信号の論理Lの継続時間であるL幅を示す値を入力して
このH幅からL幅を減算しこの計算結果の値を出力する
デューティ幅計算部を備えたデューティ補正回路におい
て、このデューティ幅計算部から出力される過去複数回
分の計算結果の値を蓄積するための記憶部と、この記憶
部に蓄積された計算結果の値により前記入力信号のデュ
ーティ補正を行うか否かを判断するデューティ補正判断
部とを備える構成である。
【0007】
【実施例】次に本発明について図面を参照して説明す
る。
る。
【0008】図1は本発明の一実施例を示す構成図であ
り、デューティ補正回路は、フリップフロップ1と、パ
ルス発生部2と、入力信号の論理Hの継続時間であるH
幅を演算するH幅計算部3と、入力信号の論理Lの継続
時間であるL幅を演算するL幅計算部4と、このH幅,
L幅を入力してH幅からL幅を減算し出力するデューテ
ィ幅計算部5と、このデューティ幅計算部5から出力さ
れる過去複数回分の計算結果の値を蓄積するための記憶
部6と、この記憶部6に蓄積された計算結果の値により
入力信号のデューティ補正を行うか否かを判断するデュ
ーティ補正判断部7と、リセットタイミングを制御する
リセットタイミング制御部8とを備える。
り、デューティ補正回路は、フリップフロップ1と、パ
ルス発生部2と、入力信号の論理Hの継続時間であるH
幅を演算するH幅計算部3と、入力信号の論理Lの継続
時間であるL幅を演算するL幅計算部4と、このH幅,
L幅を入力してH幅からL幅を減算し出力するデューテ
ィ幅計算部5と、このデューティ幅計算部5から出力さ
れる過去複数回分の計算結果の値を蓄積するための記憶
部6と、この記憶部6に蓄積された計算結果の値により
入力信号のデューティ補正を行うか否かを判断するデュ
ーティ補正判断部7と、リセットタイミングを制御する
リセットタイミング制御部8とを備える。
【0009】以下に、図2を参照して動作の流れを説明
する。H幅からL幅を減算(以下、“H幅−L幅”)し
(ステップ1:S1)、この計算結果を記憶部に過去数
回分のデータとして記憶する(S2)。デューティ補正
判断部7ではこのデータ及び現在の“H幅−L幅”の計
算結果の値等により、現在のロック状態を判断する(S
3)。ロック状態でないならロック条件を満たしている
かを判断し(S4)、満たしていないなら、リセットタ
イミングレジスタの値を“+1”又は“−1”する(S
7)事により“H幅=L幅”となるように動作する。
する。H幅からL幅を減算(以下、“H幅−L幅”)し
(ステップ1:S1)、この計算結果を記憶部に過去数
回分のデータとして記憶する(S2)。デューティ補正
判断部7ではこのデータ及び現在の“H幅−L幅”の計
算結果の値等により、現在のロック状態を判断する(S
3)。ロック状態でないならロック条件を満たしている
かを判断し(S4)、満たしていないなら、リセットタ
イミングレジスタの値を“+1”又は“−1”する(S
7)事により“H幅=L幅”となるように動作する。
【0010】そして、次回のロック状態の判断(S3)
も、まだロック状態でない為ロック条件を満たしている
かを判断(S4)するとき、例えば、“H幅=L幅”も
しくは現在の“H幅=L幅”の値と2回前の“H幅=L
幅”の値が同じ、かつ1回前の“H幅=L幅”の値と、
3回前の“H幅=L幅”の値が同一の時は、ロック条件
を満たしていると判断し、現在の“H幅−L幅”の値を
記憶しロック状態にし(S5)、リセットタイミングレ
ジスタも従来どうり変化しない(S6)。ロック条件を
満たしていないとロック条件を満たすまで、リセットタ
イミングレジスタの値を“+1”又は“−1”の補正を
行う(S7)。
も、まだロック状態でない為ロック条件を満たしている
かを判断(S4)するとき、例えば、“H幅=L幅”も
しくは現在の“H幅=L幅”の値と2回前の“H幅=L
幅”の値が同じ、かつ1回前の“H幅=L幅”の値と、
3回前の“H幅=L幅”の値が同一の時は、ロック条件
を満たしていると判断し、現在の“H幅−L幅”の値を
記憶しロック状態にし(S5)、リセットタイミングレ
ジスタも従来どうり変化しない(S6)。ロック条件を
満たしていないとロック条件を満たすまで、リセットタ
イミングレジスタの値を“+1”又は“−1”の補正を
行う(S7)。
【0011】次に、前回ロック状態に遷移したとすると
ロック状態の判断(S3)でロック解除条件を満たして
いるかの判断を行い(S8)、まだ条件を満たしていな
いのでロック状態のままリセットタイミングレジスタも
従来どおり変化しないが(S10)、もしロック解除条
件として例えば、ロック条件時に記憶した“H幅−L
幅”の値と記憶部に記憶している過去数回分の“H幅−
L幅”の値が全て同一でないときはロック解除条件を満
たしたと判断し、ロック状態を解除し(S9)、リセッ
トタイミングレジスタの値を“+1”又は“−1”して
デューティ幅計算部の結果が“H幅−L幅”となるよう
にデューティ補正動作を再開する。
ロック状態の判断(S3)でロック解除条件を満たして
いるかの判断を行い(S8)、まだ条件を満たしていな
いのでロック状態のままリセットタイミングレジスタも
従来どおり変化しないが(S10)、もしロック解除条
件として例えば、ロック条件時に記憶した“H幅−L
幅”の値と記憶部に記憶している過去数回分の“H幅−
L幅”の値が全て同一でないときはロック解除条件を満
たしたと判断し、ロック状態を解除し(S9)、リセッ
トタイミングレジスタの値を“+1”又は“−1”して
デューティ幅計算部の結果が“H幅−L幅”となるよう
にデューティ補正動作を再開する。
【0012】
【発明の効果】以上説明したように本発明は、ジッタを
防止する為に、“H幅−L幅”の過去数回分の値によ
り、ロック条件及びロック解除条件を決める為、ジッタ
の発生を抑える事ができるという効果を有する。
防止する為に、“H幅−L幅”の過去数回分の値によ
り、ロック条件及びロック解除条件を決める為、ジッタ
の発生を抑える事ができるという効果を有する。
【図1】本発明の一実施例を示す構成図である。
【図2】本発明の一実施例の動作の流れを示すフローチ
ャートである。
ャートである。
【図3】従来のデューティ補正回路を示す構成図であ
る。
る。
【図4】従来のデューティ補正回路の動作の流れを示す
フローチャートである。
フローチャートである。
1 フリップフロップ 2 パルス発生部 3 H幅計算部 4 L幅計算部 5 デューティ幅計算部 6 記憶部 7 デューティ補正判断部 8 リセットタイミング制御部
Claims (1)
- 【請求項1】 入力信号の論理Hの継続時間であるH幅
と入力信号の論理Lの継続時間であるL幅を示す値を入
力してこのH幅からL幅を減算しこの計算結果の値を出
力するデューティ幅計算部を備えたデューティ補正回路
において、このデューティ幅計算部から出力される過去
複数回分の計算結果の値を蓄積するための記憶部と、こ
の記憶部に蓄積された計算結果の値により前記入力信号
のデューティ補正を行うか否かを判断するデューティ補
正判断部とを備えることを特徴とするデューティ補正回
路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4081304A JP2871942B2 (ja) | 1992-04-03 | 1992-04-03 | デューティ補正回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4081304A JP2871942B2 (ja) | 1992-04-03 | 1992-04-03 | デューティ補正回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH05283990A true JPH05283990A (ja) | 1993-10-29 |
JP2871942B2 JP2871942B2 (ja) | 1999-03-17 |
Family
ID=13742656
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4081304A Expired - Fee Related JP2871942B2 (ja) | 1992-04-03 | 1992-04-03 | デューティ補正回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2871942B2 (ja) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63200925U (ja) * | 1987-06-15 | 1988-12-23 |
-
1992
- 1992-04-03 JP JP4081304A patent/JP2871942B2/ja not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63200925U (ja) * | 1987-06-15 | 1988-12-23 |
Also Published As
Publication number | Publication date |
---|---|
JP2871942B2 (ja) | 1999-03-17 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4087564B2 (ja) | Pll回路 | |
US6038649A (en) | Address generating circuit for block repeat addressing for a pipelined processor | |
JPH05235754A (ja) | ディジタル位相同期回路 | |
JP4411504B2 (ja) | 半導体メモリ用遅延固定ループ装置 | |
JPH05283990A (ja) | デューティ補正回路 | |
JPH10200351A (ja) | デジタルオーディオプロセッサ | |
JP3275316B2 (ja) | 制御システム | |
JP2000004381A5 (ja) | ||
JP3610882B2 (ja) | 映像信号処理装置 | |
JP3541263B2 (ja) | ゲイン設定方法 | |
US20060056254A1 (en) | Electric circuit for providing a selection signal | |
JP2651300B2 (ja) | タイマ回路 | |
JPH0638666B2 (ja) | Acc回路 | |
JP3149864B2 (ja) | 処理回数保証回路 | |
JPH11214970A (ja) | Pwm信号生成回路 | |
JPH11337669A (ja) | 時間計測回路 | |
JPH01251914A (ja) | 入力処理装置 | |
JP3034385B2 (ja) | 楽音制御情報漸次変更回路 | |
JPH1093433A (ja) | オフセットキャンセラ | |
JPH098653A (ja) | 位相検出装置および方法 | |
JP2973882B2 (ja) | フレーム同期保護回路 | |
JPH0816550A (ja) | ディジタル演算回路 | |
JP2834736B2 (ja) | 音声合成装置 | |
JPH0822023B2 (ja) | 巡回型雑音低減装置 | |
JPH04342309A (ja) | 巡回型デジタルフィルタ |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19981208 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |