JPH05267960A - 集積回路の出力回路 - Google Patents
集積回路の出力回路Info
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- JPH05267960A JPH05267960A JP4328727A JP32872792A JPH05267960A JP H05267960 A JPH05267960 A JP H05267960A JP 4328727 A JP4328727 A JP 4328727A JP 32872792 A JP32872792 A JP 32872792A JP H05267960 A JPH05267960 A JP H05267960A
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- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/04—Programme control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/042—Programme control other than numerical control, i.e. in sequence controllers or logic controllers using digital processors
- G05B19/0423—Input/output
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60L—PROPULSION OF ELECTRICALLY-PROPELLED VEHICLES; SUPPLYING ELECTRIC POWER FOR AUXILIARY EQUIPMENT OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRODYNAMIC BRAKE SYSTEMS FOR VEHICLES IN GENERAL; MAGNETIC SUSPENSION OR LEVITATION FOR VEHICLES; MONITORING OPERATING VARIABLES OF ELECTRICALLY-PROPELLED VEHICLES; ELECTRIC SAFETY DEVICES FOR ELECTRICALLY-PROPELLED VEHICLES
- B60L15/00—Methods, circuits, or devices for controlling the traction-motor speed of electrically-propelled vehicles
- B60L15/20—Methods, circuits, or devices for controlling the traction-motor speed of electrically-propelled vehicles for control of the vehicle or its driving motor to achieve a desired performance, e.g. speed, torque, programmed variation of speed
- B60L15/2045—Methods, circuits, or devices for controlling the traction-motor speed of electrically-propelled vehicles for control of the vehicle or its driving motor to achieve a desired performance, e.g. speed, torque, programmed variation of speed for optimising the use of energy
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/0175—Coupling arrangements; Interface arrangements
- H03K19/017581—Coupling arrangements; Interface arrangements programmable
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02T—CLIMATE CHANGE MITIGATION TECHNOLOGIES RELATED TO TRANSPORTATION
- Y02T10/00—Road transport of goods or passengers
- Y02T10/60—Other road transportation technologies with climate change mitigation effect
- Y02T10/64—Electric machine technologies in electromobility
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
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Abstract
(57)【要約】
【目的】 集積回路、特に特定用途向け集積回路に集積
されて電気信号好ましくはアナログ信号を出力するため
の電子出力回路２３ないし２６を、フレキシブルにその
つどの要求に適合させられ得る小形かつ経済的な回路と
して構成する。 【構成】 電子出力回路２３ないし２６がその信号形式
（電流または電圧）および信号レベル範囲（たとえば０
ないし１０Ｖ、−１０Ｖないし＋１０Ｖ）に関してユー
ザーによりパラメータを設定できるようにする。
されて電気信号好ましくはアナログ信号を出力するため
の電子出力回路２３ないし２６を、フレキシブルにその
つどの要求に適合させられ得る小形かつ経済的な回路と
して構成する。 【構成】 電子出力回路２３ないし２６がその信号形式
（電流または電圧）および信号レベル範囲（たとえば０
ないし１０Ｖ、−１０Ｖないし＋１０Ｖ）に関してユー
ザーによりパラメータを設定できるようにする。
Description
【０００１】
【産業上の利用分野】本発明は電気信号、好ましくはア
ナログ信号を出力するための電子出力回路に関する。
ナログ信号を出力するための電子出力回路に関する。
【０００２】
【従来の技術】このような回路はたとえばモジュール構
成のメモリプログラム可能な制御装置に対するアナログ
出力アセンブリで知られている。
成のメモリプログラム可能な制御装置に対するアナログ
出力アセンブリで知られている。
【０００３】このようなアセンブリは通常、信号形式お
よび信号レベル範囲が予め定められている回路を有す
る。アセンブリ上に配置された回路はたとえば０Ｖと＋
１０Ｖとの間の電圧信号を出力する。他の回路はたとえ
ば＋２０ｍＡと−２０ｍＡとの間の電流信号を出力す
る。
よび信号レベル範囲が予め定められている回路を有す
る。アセンブリ上に配置された回路はたとえば０Ｖと＋
１０Ｖとの間の電圧信号を出力する。他の回路はたとえ
ば＋２０ｍＡと−２０ｍＡとの間の電流信号を出力す
る。
【０００４】信号レベルと個々の回路とのこのような固
定的な対応付けの欠点は多様である。第１に誤配線の危
険がある。第２に交換部品保持の増大の必要性がある。
第３に原理的に既存の出力チャネルが利用できない。な
ぜならばこれらのチャネルはそのつどの用途に不適当な
信号を供給するからである。
定的な対応付けの欠点は多様である。第１に誤配線の危
険がある。第２に交換部品保持の増大の必要性がある。
第３に原理的に既存の出力チャネルが利用できない。な
ぜならばこれらのチャネルはそのつどの用途に不適当な
信号を供給するからである。
【０００５】
【発明が解決しようとする課題】本発明の課題は、フレ
キシブルにそのつどの要求に適合させられ得る小形かつ
経済的な回路をユーザーに提供することにある。
キシブルにそのつどの要求に適合させられ得る小形かつ
経済的な回路をユーザーに提供することにある。
【０００６】
【課題を解決するための手段】この課題は、集積回路
（ＩＣ）、特に特定用途向けの集積回路（ＡＳＩＣ）に
集積されて電気信号好ましくはアナログ信号を出力する
ための電子出力回路において、電子出力回路がその信号
レベル範囲に関してユーザーによりパラメータの設定が
可能であることにより解決される。
（ＩＣ）、特に特定用途向けの集積回路（ＡＳＩＣ）に
集積されて電気信号好ましくはアナログ信号を出力する
ための電子出力回路において、電子出力回路がその信号
レベル範囲に関してユーザーによりパラメータの設定が
可能であることにより解決される。
【０００７】
【作用効果】それによって、小形かつ経済的であるほか
に、たとえばユーザーにより設定可能な信号形式パラメ
ータに関係して電圧出力回路としてまたは電流出力回路
として作動可能である回路が得られる。同じく、回路を
ユーザーにより設定可能な信号レベルパラメータに関係
して多くの信号レベル範囲の１つで作動させることが可
能となる。
に、たとえばユーザーにより設定可能な信号形式パラメ
ータに関係して電圧出力回路としてまたは電流出力回路
として作動可能である回路が得られる。同じく、回路を
ユーザーにより設定可能な信号レベルパラメータに関係
して多くの信号レベル範囲の１つで作動させることが可
能となる。
【０００８】出力回路の電流値も電圧値も出力回路に戻
され、その際に、まさに出力すべき信号を表す値が出力
すべき信号の安定化のためにフィードバック回路に与え
られ、また少なくとも他の値が評価回路に線路障害、た
とえば断線または短絡に関する出力信号線の監視のため
に与えられるようにすると有利である。
され、その際に、まさに出力すべき信号を表す値が出力
すべき信号の安定化のためにフィードバック回路に与え
られ、また少なくとも他の値が評価回路に線路障害、た
とえば断線または短絡に関する出力信号線の監視のため
に与えられるようにすると有利である。
【０００９】回路が小型化されていること、すなわち集
積回路の構成部分であると有利である。回路が、費用の
理由から共通のディジタル‐アナログ変換器を介して、
好ましくは時分割多重化して、目標出力信号を与えられ
る多くの出力回路を有すると好適である。このようにす
れば高い集積密度が達成される。
積回路の構成部分であると有利である。回路が、費用の
理由から共通のディジタル‐アナログ変換器を介して、
好ましくは時分割多重化して、目標出力信号を与えられ
る多くの出力回路を有すると好適である。このようにす
れば高い集積密度が達成される。
【００１０】少なくとも１つの出力回路が信号レベル範
囲のマッチングのための外部付加回路を有するならば、
回路は少なくとも１０Ｖまでの電圧に対して設計されて
いなくてよい。ごくわずかな電圧を供給するだけで十分
である。
囲のマッチングのための外部付加回路を有するならば、
回路は少なくとも１０Ｖまでの電圧に対して設計されて
いなくてよい。ごくわずかな電圧を供給するだけで十分
である。
【００１１】回路が出力回路の駆動および監視のため、
また集積回路の上位の中央ユニットとの通信のための論
理ブロックを有するならば、上位の中央ユニットは監視
課題の負担を除かれる。
また集積回路の上位の中央ユニットとの通信のための論
理ブロックを有するならば、上位の中央ユニットは監視
課題の負担を除かれる。
【００１２】
【実施例】以下本発明の実施例を詳細に説明する。
【００１３】図１によればアナログ出力アセンブリ１
は、オプトカップラ４を介して互いに結合されているが
導電的には隔離されている２つの特定用途向け回路２、
３を有する。回路２は自動化装置のバス５と接続されて
いるインタフェース回路である。このバス５を介してデ
ータが出力回路３と図示されていない上位の中央ユニッ
トとの間で交換される。インタフェース回路２ではたと
えば並列‐直列変換が、また場合によっては標準インタ
フェースへの変換が行われる。
は、オプトカップラ４を介して互いに結合されているが
導電的には隔離されている２つの特定用途向け回路２、
３を有する。回路２は自動化装置のバス５と接続されて
いるインタフェース回路である。このバス５を介してデ
ータが出力回路３と図示されていない上位の中央ユニッ
トとの間で交換される。インタフェース回路２ではたと
えば並列‐直列変換が、また場合によっては標準インタ
フェースへの変換が行われる。
【００１４】出力回路３は図示されていない操作端にア
ナログ信号を出力する働きをするもので、ＣＭＯＳ技術
で製造されている。それにより内部損失が最小に制限さ
れ得る。さらに回路３は供給電圧＋５Ｖ、−５Ｖおよび
接地Ｍのみに接続されている。回路３はそれによって最
大の出力信号として当然のことながら同じく最大＋／−
５Ｖを供給し得る。＋／−１０Ｖまでの増幅は後で一層
詳細に説明する外部付加回路１８、１９により行われ
る。この付加回路１８、１９により回路３の出力信号は
必要とされる電圧レベルに増幅され、また相応に高い電
流強度で作動させられる。
ナログ信号を出力する働きをするもので、ＣＭＯＳ技術
で製造されている。それにより内部損失が最小に制限さ
れ得る。さらに回路３は供給電圧＋５Ｖ、−５Ｖおよび
接地Ｍのみに接続されている。回路３はそれによって最
大の出力信号として当然のことながら同じく最大＋／−
５Ｖを供給し得る。＋／−１０Ｖまでの増幅は後で一層
詳細に説明する外部付加回路１８、１９により行われ
る。この付加回路１８、１９により回路３の出力信号は
必要とされる電圧レベルに増幅され、また相応に高い電
流強度で作動させられる。
【００１５】図１によれば出力回路３は４つの出力チャ
ネル６ないし９を有する。その際に出力チャネル６ない
し９は、図面をわかりやすくするために、概要のみを示
されている。各出力チャネルは５つの端子１０ないし１
４を有し、これらは下記のように配置されている。 −出力端子１０を介してチャネルの現在の出力信号が出
力される。 −電流フィードバック端子１１および１２により、抵抗
１５の両端に降下する電圧が測定される。抵抗１５の両
端に降下する電圧は抵抗１５を通る電流、従ってまた出
力線１６の電流Ｉに比例しているので、こうして間接的
に出力線１６に流れる電流Ｉが求められる。測定が可能
なかぎり正確であるように、抵抗１５として好ましくは
精密抵抗が使用される。 −電圧フィードバック端子１３により、図示されていな
い負荷にかかる電圧Ｕが測定される。 −接地フィードバック端子１４により負荷の瞬時の接地
レベルが測定される。
ネル６ないし９を有する。その際に出力チャネル６ない
し９は、図面をわかりやすくするために、概要のみを示
されている。各出力チャネルは５つの端子１０ないし１
４を有し、これらは下記のように配置されている。 −出力端子１０を介してチャネルの現在の出力信号が出
力される。 −電流フィードバック端子１１および１２により、抵抗
１５の両端に降下する電圧が測定される。抵抗１５の両
端に降下する電圧は抵抗１５を通る電流、従ってまた出
力線１６の電流Ｉに比例しているので、こうして間接的
に出力線１６に流れる電流Ｉが求められる。測定が可能
なかぎり正確であるように、抵抗１５として好ましくは
精密抵抗が使用される。 −電圧フィードバック端子１３により、図示されていな
い負荷にかかる電圧Ｕが測定される。 −接地フィードバック端子１４により負荷の瞬時の接地
レベルが測定される。
【００１６】図１中に示されているダイオードブリッジ
１７は保護構造を形成し、また過電圧を抑制する働きを
する。それらは阻止方向に接続されており、また電源、
ここでは＋１５Ｖおよび−１５Ｖに接続されている。
１７は保護構造を形成し、また過電圧を抑制する働きを
する。それらは阻止方向に接続されており、また電源、
ここでは＋１５Ｖおよび−１５Ｖに接続されている。
【００１７】必要とされる端子の数を減少するため、場
合によっては端子１２および１３は一つにまとめられ、
また端子１４は省略され得る。この場合には確かに測定
精度は低下するが、これは個々の場合には許容範囲にあ
る。
合によっては端子１２および１３は一つにまとめられ、
また端子１４は省略され得る。この場合には確かに測定
精度は低下するが、これは個々の場合には許容範囲にあ
る。
【００１８】上記のように、出力回路３は＋５Ｖと−５
Ｖとの間の電圧のみを供給される。従って、その出力信
号もこの電圧範囲以内にある。従って、出力端子１０に
おける出力電圧はそれ自体は公知の増幅器回路１８によ
り増幅される。それにより、出力線１６が＋１０Ｖと−
１０Ｖとの間の電圧を与えられ得ることができる。
Ｖとの間の電圧のみを供給される。従って、その出力信
号もこの電圧範囲以内にある。従って、出力端子１０に
おける出力電圧はそれ自体は公知の増幅器回路１８によ
り増幅される。それにより、出力線１６が＋１０Ｖと−
１０Ｖとの間の電圧を与えられ得ることができる。
【００１９】増幅器回路１８の後に同じくそれ自体は公
知のドライバ回路１９が配置されている。ドライバ回路
１９により、出力線１６が与えられる電圧Ｕを低下する
ことなしに、出力線１６に必要とされる電流Ｉを供給す
ることが可能である。
知のドライバ回路１９が配置されている。ドライバ回路
１９により、出力線１６が与えられる電圧Ｕを低下する
ことなしに、出力線１６に必要とされる電流Ｉを供給す
ることが可能である。
【００２０】図２には出力回路３の内部構成が示されて
いる。図２によれば出力回路３は主として１つの論理ブ
ロック２０、１つのディジタル‐アナログ変換器２１、
１つのデマルチプレクサ２２および４つの出力回路２３
ないし２６から成っている。出力回路２３ないし２６の
うち、図面をみやすくするため、回路２３のみが詳細に
示されている。論理ブロック２０は出力回路３のなかで
多くの機能を引き受ける。一方では論理ブロック２０を
介して図示されていない中央ユニットと出力回路３との
間の通信が行われる。他方では論理ブロック２０は中央
ユニットから伝達された指令およびパラメータを記憶す
る。第３に論理ブロック２０は出力回路２３ないし２６
の駆動を引き受ける。さらに論理ブロック２０は出力回
路２３ないし２６の機能を監視する。
いる。図２によれば出力回路３は主として１つの論理ブ
ロック２０、１つのディジタル‐アナログ変換器２１、
１つのデマルチプレクサ２２および４つの出力回路２３
ないし２６から成っている。出力回路２３ないし２６の
うち、図面をみやすくするため、回路２３のみが詳細に
示されている。論理ブロック２０は出力回路３のなかで
多くの機能を引き受ける。一方では論理ブロック２０を
介して図示されていない中央ユニットと出力回路３との
間の通信が行われる。他方では論理ブロック２０は中央
ユニットから伝達された指令およびパラメータを記憶す
る。第３に論理ブロック２０は出力回路２３ないし２６
の駆動を引き受ける。さらに論理ブロック２０は出力回
路２３ないし２６の機能を監視する。
【００２１】出力アセンブリ１の始動の際またはリセッ
トの後に出力回路３は常に新たにパラメータを設定され
る。出力回路３にそのために中央ユニットから、４つの
出力回路２３ないし２６のどれがそもそも出力信号を与
えられるべきか、電圧信号が出力されるべきか、電流信
号が出力されるべきか、またどれがそれぞれ設定すべき
信号レベル範囲であるかが報知される。これらのパラメ
ータは論理ブロック２０の図示されていないパラメータ
レジスタに記憶される。
トの後に出力回路３は常に新たにパラメータを設定され
る。出力回路３にそのために中央ユニットから、４つの
出力回路２３ないし２６のどれがそもそも出力信号を与
えられるべきか、電圧信号が出力されるべきか、電流信
号が出力されるべきか、またどれがそれぞれ設定すべき
信号レベル範囲であるかが報知される。これらのパラメ
ータは論理ブロック２０の図示されていないパラメータ
レジスタに記憶される。
【００２２】個々の出力回路２３ないし２６の不能動化
は、これらが出力回路２３ないし２６が出力すべき信号
をサイクリックに供給する際に顧慮されないことにより
行われる。信号形式、すなわち電流または電圧出力の設
定はスイッチ２７を介して行われる。電流信号が調節器
２８にフィードバックされるか電圧信号が調節器２８に
フィードバックされるかに応じて、そのつどの出力回路
が電流または電圧出力回路として作用する。信号レベル
範囲のマッチングは論理ブロック２０内で最後に伝達さ
れたディジタル信号を選択された信号レベル範囲に相応
する値に相応に変換することにより行われる。電圧範囲
はいまの場合には０ないし１０Ｖおよび−１０Ｖないし
＋１０Ｖである。電流範囲は４ないし２０ｍＡおよび−
２０ｍＡないし＋２０ｍＡである。しかしもちろん他の
電圧範囲または電流範囲、たとえば０ないし１Ｖまたは
−１Ｖないし１Ｖも考えられる。
は、これらが出力回路２３ないし２６が出力すべき信号
をサイクリックに供給する際に顧慮されないことにより
行われる。信号形式、すなわち電流または電圧出力の設
定はスイッチ２７を介して行われる。電流信号が調節器
２８にフィードバックされるか電圧信号が調節器２８に
フィードバックされるかに応じて、そのつどの出力回路
が電流または電圧出力回路として作用する。信号レベル
範囲のマッチングは論理ブロック２０内で最後に伝達さ
れたディジタル信号を選択された信号レベル範囲に相応
する値に相応に変換することにより行われる。電圧範囲
はいまの場合には０ないし１０Ｖおよび−１０Ｖないし
＋１０Ｖである。電流範囲は４ないし２０ｍＡおよび−
２０ｍＡないし＋２０ｍＡである。しかしもちろん他の
電圧範囲または電流範囲、たとえば０ないし１Ｖまたは
−１Ｖないし１Ｖも考えられる。
【００２３】個々の出力チャネルに対する最後に伝達さ
れた値はサイクリックに論理ブロック２０のレジスタか
ら読出される。それらは論理ブロック２０から選択され
た信号形式および選択された信号レベル範囲に相応して
新しいディジタル値に変換され，また次いでディジタル
‐アナログ変換器２１に伝達される。この変換器はディ
ジタル値をアナログ値に変換し、アナログ値をデマルチ
プレクサ２２に伝達する。このデマルチプレクサは順次
と線路２９を介して伝達された信号に従って出力回路２
３ないし２６の出力回路のサンプル・アンド・ホールド
回路３０に出力すべきアナログ信号を与える。そこから
信号は調節器２８に目標値として与えられる。出力され
た信号をその目標値に安定化するため、増幅器は積分部
分を有する。すなわちＰＩまたはＰＩＤ調節器として構
成されている。
れた値はサイクリックに論理ブロック２０のレジスタか
ら読出される。それらは論理ブロック２０から選択され
た信号形式および選択された信号レベル範囲に相応して
新しいディジタル値に変換され，また次いでディジタル
‐アナログ変換器２１に伝達される。この変換器はディ
ジタル値をアナログ値に変換し、アナログ値をデマルチ
プレクサ２２に伝達する。このデマルチプレクサは順次
と線路２９を介して伝達された信号に従って出力回路２
３ないし２６の出力回路のサンプル・アンド・ホールド
回路３０に出力すべきアナログ信号を与える。そこから
信号は調節器２８に目標値として与えられる。出力され
た信号をその目標値に安定化するため、増幅器は積分部
分を有する。すなわちＰＩまたはＰＩＤ調節器として構
成されている。
【００２４】単一のディジタル‐アナログ変換器２１が
使用される上記の構成の代わりに、各出力回路２３ない
し２６に対してそれぞれの固有のディジタル‐アナログ
変換器２１を有する回路３も使用され得る。
使用される上記の構成の代わりに、各出力回路２３ない
し２６に対してそれぞれの固有のディジタル‐アナログ
変換器２１を有する回路３も使用され得る。
【００２５】測定された電圧信号Ｕも測定された電流信
号Ｉもウインドウコンパレータ３１、３２に与えられ
る。もし回路２３が電圧出力回路として作用し、また電
流Ｉが特定の予め設定された調節値を超過するならば、
このことが論理ブロック２０に線路３３を介して報知さ
れる。論理ブロック２０はこの信号を出力線１６上の短
絡の報知として解釈する。類似の仕方で、回路２３が電
流出力回路として作用し、また電圧Ｕが予め定められた
レベルを超過するならば、断線が認識される。
号Ｉもウインドウコンパレータ３１、３２に与えられ
る。もし回路２３が電圧出力回路として作用し、また電
流Ｉが特定の予め設定された調節値を超過するならば、
このことが論理ブロック２０に線路３３を介して報知さ
れる。論理ブロック２０はこの信号を出力線１６上の短
絡の報知として解釈する。類似の仕方で、回路２３が電
流出力回路として作用し、また電圧Ｕが予め定められた
レベルを超過するならば、断線が認識される。
【００２６】両方の場合に当該のチャネルは不能動化さ
れ、またエラー報知が中央ユニットに報知される。中央
ユニットは次いでエラー報知をユーザーに出力し得る。
れ、またエラー報知が中央ユニットに報知される。中央
ユニットは次いでエラー報知をユーザーに出力し得る。
【００２７】測定された電流および電圧信号がノイズを
含んでいる場合には、場合によっては平滑化が出力回路
の内側および／または外側で必要である。
含んでいる場合には、場合によっては平滑化が出力回路
の内側および／または外側で必要である。
【００２８】以上に説明した本発明は、好ましくはアナ
ログ出力アセンブリに応用可能である。しかしそれは原
理的にディジタル出力アセンブリにも応用可能である。
この場合にはもちろんディジタル‐アナログ変換器２１
は省略され得る。
ログ出力アセンブリに応用可能である。しかしそれは原
理的にディジタル出力アセンブリにも応用可能である。
この場合にはもちろんディジタル‐アナログ変換器２１
は省略され得る。
【図１】本発明によるアナログ出力アセンブリのブロッ
ク回路図。
ク回路図。
【図２】アナログ出力回路の詳細図。
１ アナログ出力アセンブリ ２ インタフェース回路 ３ 出力回路 ４ オプトカップラ ５ バス ６〜９ 出力チャネル １０〜１４ 端子 １５ 抵抗 １６ 出力線 １７ ダイオードブリッジ １８ 増幅器回路 １９ ドライバ回路 ２０ 論理ブロック ２１ ディジタル‐アナログ変換器 ２２ デマルチプレクサ ２３〜２６ 出力回路 ２７ スイッチ ２８ 調節器 ２９、３３ 線路 ３０ サンプル・アンド・ホールド回路 ３１、３２ ウインドウコンパレータ
Claims (10)
- 【請求項１】 集積回路（ＩＣ）に集積されて電気信号
を出力するための電子出力回路（２３ないし２６）にお
いて、電子出力回路（２３ないし２６）がその信号レベ
ル範囲に関してユーザーによりパラメータを設定できる
ようにすることを特徴とする集積回路の出力回路。 - 【請求項２】 ユーザーにより設定可能な信号形式パラ
メータに関係して電圧出力回路としてまたは電流出力回
路として作動することを特徴とする請求項１記載の出力
回路。 - 【請求項３】 ユーザーにより設定可能な信号レベルパ
ラメータに関係して多くの信号レベル範囲で作動するこ
とを特徴とする請求項１または２記載の出力回路。 - 【請求項４】 出力回路（２３ないし２６）の電流値
（Ｉ）も電圧値（Ｕ）も出力回路（２３ないし２６）に
戻され、その際にまさに出力すべき信号を表す値が出力
すべき信号の安定化のためにフィードバック回路（２
８）に与えられ、また少なくとも他の値が評価回路（３
１、３２）に線路障害に関する出力信号線（１６）の監
視のために与えらることを特徴とする請求項１ないし３
の１つに記載の出力回路。 - 【請求項５】 請求項１ないし４の１つによる少なくと
も１つの出力回路（２３ないし２６）を有することを特
徴とする集積回路。 - 【請求項６】 多数の出力回路（２３ないし２６）を有
することを特徴とする請求項５記載の集積回路。 - 【請求項７】 出力回路（２３ないし２６）が共通のデ
ィジタル‐アナログ変換器（２１）を介して目標出力信
号を与えられることを特徴とする請求項６記載の集積回
路。 - 【請求項８】 出力回路（２３ないし２６）が固有のデ
ィジタル‐アナログ変換器（２１）を介して目標出力信
号を与えられることを特徴とする請求項６記載の集積回
路。 - 【請求項９】 少なくとも１つの出力回路（２３ないし
２６）が信号レベル範囲マッチングのための外部付加回
路（１８、１９）を有することを特徴とする請求項５な
いし８の１つに記載の集積回路。 - 【請求項１０】 出力回路（２３ないし２６）の駆動お
よび監視のため、また集積回路（３）の上位の中央ユニ
ットとの通信のための論理ブロック（２０）を有するこ
とを特徴とする請求項５ないし８の１つに記載の集積回
路。
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- 1992-11-04 US US07/971,745 patent/US5546079A/en not_active Expired - Lifetime
- 1992-11-13 JP JP4328727A patent/JPH05267960A/ja active Pending
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