JPH0523596U - 回路装置搭載予備領域を備える回路基板 - Google Patents

回路装置搭載予備領域を備える回路基板

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JPH0523596U
JPH0523596U JP7981591U JP7981591U JPH0523596U JP H0523596 U JPH0523596 U JP H0523596U JP 7981591 U JP7981591 U JP 7981591U JP 7981591 U JP7981591 U JP 7981591U JP H0523596 U JPH0523596 U JP H0523596U
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JP
Japan
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circuit board
circuit
memory
circuit device
spare area
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Application number
JP7981591U
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English (en)
Inventor
哲雄 安達
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Aoi Electronics Co Ltd
Original Assignee
Aoi Electronics Co Ltd
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Publication date
Application filed by Aoi Electronics Co Ltd filed Critical Aoi Electronics Co Ltd
Priority to JP7981591U priority Critical patent/JPH0523596U/ja
Publication of JPH0523596U publication Critical patent/JPH0523596U/ja
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Abstract

(57)【要約】 【目的】 回路装置に不良が発生しても回路装置を搭載
した回路基板を廃棄することなく使用できる回路基板を
提供する。 【構成】 同一機能を有する複数の回路装置(メモリ)
1〜6を搭載した回路基板でメモリカードを構成する。
回路基板9に搭載した回路装置に不良が発生しても、こ
の不良の回路装置を残したまま良品の回路装置と交換す
るための予備領域Sを設け、この予備領域周辺に交換し
た回路装置を接続できる上位データ用と下位データ用に
共用できる2組の予備接続パッド7、8を設ける。

Description

【考案の詳細な説明】
【0001】
【産業上の利用分野】
本考案は、複数個の同一機能を有する回路装置を搭載する回路基板に関する。
【0002】
【従来の技術】
従来、同じ機能を有する複数個のメモリ等の回路装置をガラスエポキシ基板に 搭載する場合、その個数分の領域及び配線しかなく、いずれかのチップに不良が 発生すると、チップの修理交換が困難であり、チップを搭載した基板を廃棄せざ るをえず、歩留まりの低下が避けられないという問題点があった。
【0003】 例えば、前記ガラスエポキシ基板には、複数のメモリが搭載され且増設メモリ も必要似応じて搭載できるように配線が施されており、メモリのパッドと前記配 線のパッドとワイヤボンディングで接続される。このような場合、いずれかのメ モリに不良が発生している場合、修理交換することは困難である。
【0004】
【考案が解決しようとする課題】
本考案は、回路基板に搭載した回路装置に不良が発生しても基板を廃棄するこ となく使用でき、歩留まりを改善しようとするものである。
【0005】
【課題を解決するための手段】
本考案は、回路基板に予備領域を設け、該領域に交換して搭載すべき回路装置 を接続する予備パッド及び配線を予め施しておくことを特徴とする。
【0006】
【実施例】
図1は、本考案実施例の構成図を示している。 実施例としてメモリーカードについて以下に説明する。 図1において、メモリーカード1には、必要とするメモリーが搭載される領域 が1〜6が設定されており、これら領域周辺には前記メモリーのパッドとワイヤ ボンディングにより上位データバスまたは下位データバスと選択的に接続される パッドおよび配線が回路基板9に施されている。さらに、メモリーカードのほぼ 中央部に、前記領域1〜6に搭載されたメモリに不良品が発生した場合、該不良 品を回路基板に搭載したまま良品のメモリと交換して、該交換した良品のメモリ を搭載する予備領域Sを設け、該予備領域Sの周辺にもメモリのパッドとワイヤ ボンディングにより上位データバスまたは下位データバスと選択的に接続される 予備パッドおよび予備配線が施される。
【0007】 図1の(A)で詳述すると、メモリ搭載位置1〜3には、例えば上位データ用 8ビットバスメモリが、またメモリ搭載位置4〜6には下位データ用8ビットバ スメモリが搭載され、上位データ用メモリと下位データ用メモリの組み合わせで 16ビットバスメモリを構成する。そして前記予備領域Sには前記上位データ用 メモリ又は下位データ用メモリのいずれに不良品が発生しても、代わりの8ビッ トバスメモリを搭載できるように、図1の(B)のように予備領域周辺に上位デ ータバス用の予備接続パッド7及び下位データバス用の予備接続パッド8を形成 し、この予備領域Sを上位データ及び下位データ用に共用できるように予備接続 パッドを2組用意する。12はデータバス接続用端子部である。
【0008】 図2は、回路基板9の前記予備領域Sに搭載した上位データ又は下位データ用 メモリのパッド11と前記2組の予備接続パッド7及び8のパターンの一例を示 している。10は回路基板9前記の予備領域Sに搭載したメモリであり、周辺に 形成した上位データ(8ビット)用予備接続パッド7が8個配列され、さらに前 記パッドの近傍に下位データ(8ビット)用予備接続パッド8が8個配列されて いる。 そして、前記予備領域Sに搭載したメモリ10を不良の発生したメモリに応じ て前記2組の予備接続パッド7、8の一方を選択してメモリのパッド11とワイ ヤボンディングすることにより、不良品のメモリも回路基板9に搭載したまま良 品のメモリと交換することができる。
【0009】 前記実施例は、良品の回路装置と交換して搭載する回路基板の予備領域を、回 路基板のほぼ中央部に設定したが、予備領域の設定位置及びその数は前記実施例 に限るものではなく、搭載すべき回路装置の態様に応じて選択実施できるもので ある。
【0010】
【考案の効果】
本考案は、回路基板に搭載した回路装置に不良が発生しても、回路基板を廃棄 することなく使用でる。また、回路基板に同一機能を有する回路装置を多数個搭 載した場合、材料比率が格段に高くなり、歩留まりの影響が如実に表れてくるが 、予備領域を設けることでこの歩留まりを改善することができる。
【図面の簡単な説明】
【図1】本考案構成の該略図である。
【図2】本考案の予備接続パッドパターンを示す図であ
る。
【符号の説明】
S・・予備領域 1・・メモリカード 7、8・・予備
接続パッド 9・・回路基板 10・・メモリ

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項1】 同一機能を有する複数の回路装置を搭載
    する回路基板において、該回路基板に搭載した前記複数
    の回路装置の内不良品を残したまま交換した回路装置を
    搭載する予備領域を設け、該予備領域周辺に前記交換し
    た回路装置に接続する予備接続パッドを形成したことを
    特徴とする回路基板。
JP7981591U 1991-09-06 1991-09-06 回路装置搭載予備領域を備える回路基板 Pending JPH0523596U (ja)

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ID=13700702

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JP7981591U Pending JPH0523596U (ja) 1991-09-06 1991-09-06 回路装置搭載予備領域を備える回路基板

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015034746A (ja) * 2013-08-09 2015-02-19 日本精機株式会社 車両用表示装置の回路基板

Cited By (1)

* Cited by examiner, † Cited by third party
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