JPH05227776A - ２相ｆｇ分周回路 - Google Patents
２相ｆｇ分周回路Info
- Publication number
- JPH05227776A JPH05227776A JP4057217A JP5721792A JPH05227776A JP H05227776 A JPH05227776 A JP H05227776A JP 4057217 A JP4057217 A JP 4057217A JP 5721792 A JP5721792 A JP 5721792A JP H05227776 A JPH05227776 A JP H05227776A
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- Japan
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- signal
- phase
- frequency
- signals
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Abstract
(57)【要約】
【構成】 ２相ＦＧ信号Ｓの何れか一方を１／Ｎ分周す
る１／Ｎ分周器２２と、この１／Ｎ分周出力信号Ａ0 を
更に１／２分周するカウンタ２３と、カウンタ２３の出
力信号の９０度位相信号を形成する論理演算回路２４と
を有し、カウンタ２３の出力信号（ｆｓ０°）と論理演
算回路２４の出力信号（ｆｓ９０°）を出力する。 【効果】 例えばディジタル位相サーボループの構成に
適用すると、高ダイナミックな基準周波数発生器が不要
となり、モータの高速回転にも対応できるようになる。
る１／Ｎ分周器２２と、この１／Ｎ分周出力信号Ａ0 を
更に１／２分周するカウンタ２３と、カウンタ２３の出
力信号の９０度位相信号を形成する論理演算回路２４と
を有し、カウンタ２３の出力信号（ｆｓ０°）と論理演
算回路２４の出力信号（ｆｓ９０°）を出力する。 【効果】 例えばディジタル位相サーボループの構成に
適用すると、高ダイナミックな基準周波数発生器が不要
となり、モータの高速回転にも対応できるようになる。
Description
【０００１】
【産業上の利用分野】本発明は、例えばいわゆるキャプ
スタンモータ等のサーボ信号を形成する際に用いられる
２相ＦＧ分周回路に関するものである。
スタンモータ等のサーボ信号を形成する際に用いられる
２相ＦＧ分周回路に関するものである。
【０００２】
【従来の技術】図３に従来の例えばキャプスタンモータ
のディジタル位相サーボループの構成を示す。この図３
の構成において、ＦＧ信号発生器２から出力されるキャ
プスタンモータ１の回転に応じた２相ＦＧ信号ｆａ，ｆ
ｂは、同期信号発生回路６のアンプ７ａ，７ｂを介して
同期検出回路９に送られる。また、当該同期信号発生回
路６のカウンタ回路８のクロック端子ＣＫには基準周波
数信号ｆR が供給されると共に、当該カウンタ回路８の
アップ／ダウン端子Ｕ／Ｄには上記正逆回転指示信号が
供給されるようになっている。このカウンタ回路８の出
力信号（２ビット）ｓ1 ，ｓ2 は、上記同期検出回路９
に送られるようになっている。当該同期検出回路９では
上記アンプ７ａ，７ｂを介した２相ＦＧ信号ｆａ，ｆｂ
と上記カウンタ回路８の出力信号ｓ1 ，ｓ2 の同期検出
を行う。この同期検出回路９の出力信号Ｃｏは、上記カ
ウンタ回路８のクリア端子ＣＬに送られる。
のディジタル位相サーボループの構成を示す。この図３
の構成において、ＦＧ信号発生器２から出力されるキャ
プスタンモータ１の回転に応じた２相ＦＧ信号ｆａ，ｆ
ｂは、同期信号発生回路６のアンプ７ａ，７ｂを介して
同期検出回路９に送られる。また、当該同期信号発生回
路６のカウンタ回路８のクロック端子ＣＫには基準周波
数信号ｆR が供給されると共に、当該カウンタ回路８の
アップ／ダウン端子Ｕ／Ｄには上記正逆回転指示信号が
供給されるようになっている。このカウンタ回路８の出
力信号（２ビット）ｓ1 ，ｓ2 は、上記同期検出回路９
に送られるようになっている。当該同期検出回路９では
上記アンプ７ａ，７ｂを介した２相ＦＧ信号ｆａ，ｆｂ
と上記カウンタ回路８の出力信号ｓ1 ，ｓ2 の同期検出
を行う。この同期検出回路９の出力信号Ｃｏは、上記カ
ウンタ回路８のクリア端子ＣＬに送られる。
【０００３】さらに、上記カウンタ回路８の出力信号ｓ
1 ，ｓ2 は、選択回路５に送られるようになっている。
当該選択回路５には、上記２相ＦＧ信号ｆａ，ｆｂが反
転，非反転アンプ３ａ，３ｂ，４ａ，４ｂを介した出力
信号ｆ1 ，ｆ2 ，ｆ3 ，ｆ3も供給されている。したが
って、この選択回路５では、これら出力信号ｆ1 ，
ｆ2 ，ｆ3 ，ｆ3 が上記カウンタ回路８の出力信号
ｓ1 ，ｓ2 に基づいて選択される。当該選択回路５の出
力信号ｅ0 は、アンプ１０を介して上記キャプスタンモ
ータ１へサーボ信号として送られる。
1 ，ｓ2 は、選択回路５に送られるようになっている。
当該選択回路５には、上記２相ＦＧ信号ｆａ，ｆｂが反
転，非反転アンプ３ａ，３ｂ，４ａ，４ｂを介した出力
信号ｆ1 ，ｆ2 ，ｆ3 ，ｆ3も供給されている。したが
って、この選択回路５では、これら出力信号ｆ1 ，
ｆ2 ，ｆ3 ，ｆ3 が上記カウンタ回路８の出力信号
ｓ1 ，ｓ2 に基づいて選択される。当該選択回路５の出
力信号ｅ0 は、アンプ１０を介して上記キャプスタンモ
ータ１へサーボ信号として送られる。
【０００４】
【発明が解決しようとする課題】ここで、上述した図３
のディジタル位相サーボループの構成では、上記サーボ
信号を得るために、モータＦＧの４倍以上の基準周波数
が必要となる。すなわち、基準周波数信号ｆR をカウン
トダウンするカウンタ回路８は、例えばｎビットで構成
されるものであるが、上記カウンタ回路８の出力として
は上記出力信号ｓ1 ，ｓ2 の２ビットが最終出力とな
る。したがって、当該カウンタ回路８のビット数はｎ≧
２の関係となり、上記基準周波数信号ｆR は、モータＦ
Ｇ（ｆｓ）の４倍以上が必要となる。
のディジタル位相サーボループの構成では、上記サーボ
信号を得るために、モータＦＧの４倍以上の基準周波数
が必要となる。すなわち、基準周波数信号ｆR をカウン
トダウンするカウンタ回路８は、例えばｎビットで構成
されるものであるが、上記カウンタ回路８の出力として
は上記出力信号ｓ1 ，ｓ2 の２ビットが最終出力とな
る。したがって、当該カウンタ回路８のビット数はｎ≧
２の関係となり、上記基準周波数信号ｆR は、モータＦ
Ｇ（ｆｓ）の４倍以上が必要となる。
【０００５】このことは、モータが高速回転になるほど
基準周波数も高くなり、高ダイナミックな周波数発生器
が必要となることを示している。また、例えば、ダイナ
ミックレンジを上げるために、モータＦＧ（９０度位相
信号）を単純にカウントダウンしただけでは９０度の位
相関係が保たれなくなる。
基準周波数も高くなり、高ダイナミックな周波数発生器
が必要となることを示している。また、例えば、ダイナ
ミックレンジを上げるために、モータＦＧ（９０度位相
信号）を単純にカウントダウンしただけでは９０度の位
相関係が保たれなくなる。
【０００６】そこで、本発明は、上述のような実情に鑑
みて提案されたものであり、高ダイナミックな基準周波
数発生器が不要で、モータの高速回転にも対応できる２
相ＦＧ分周回路を提供することを目的とするものであ
る。
みて提案されたものであり、高ダイナミックな基準周波
数発生器が不要で、モータの高速回転にも対応できる２
相ＦＧ分周回路を提供することを目的とするものであ
る。
【０００７】
【課題を解決するための手段】本発明の２相ＦＧ分周回
路は、上述の目的を達成するために提案されたものであ
り、２相ＦＧ信号の何れか一方を１／Ｎ分周する１／Ｎ
分周手段と、上記１／Ｎ分周手段の出力信号を１／２分
周する１／２分周手段と、上記１／Ｎ分周手段の出力信
号と上記１／２分周手段の出力信号とに基づいて上記１
／２分周手段の出力信号の９０度位相信号を形成する９
０度位相信号形成手段（論理演算手段）とを有してなる
ものであり、上記１／２分周手段の出力信号と上記論理
演算手段の出力信号を出力するようにしたものである。
路は、上述の目的を達成するために提案されたものであ
り、２相ＦＧ信号の何れか一方を１／Ｎ分周する１／Ｎ
分周手段と、上記１／Ｎ分周手段の出力信号を１／２分
周する１／２分周手段と、上記１／Ｎ分周手段の出力信
号と上記１／２分周手段の出力信号とに基づいて上記１
／２分周手段の出力信号の９０度位相信号を形成する９
０度位相信号形成手段（論理演算手段）とを有してなる
ものであり、上記１／２分周手段の出力信号と上記論理
演算手段の出力信号を出力するようにしたものである。
【０００８】すなわち、本発明の２相ＦＧ分周回路は、
ディジタル位相サーボにおいて、９０度位相のモータＦ
Ｇの中から一方の信号（Ｓ）を１／２分周する例えばカ
ウンタを有し、その出力信号をＡ相信号として出力し、
上記一方の信号（Ｓ）と上記Ａ相信号の論理演算によっ
て、当該Ａ相に対して９０度位相となる信号（Ｂ相）を
作り、擬似的な９０度位相のモータＦＧを作り出すよう
にしたものである。このように、ディジタル位相サーボ
において、９０度のＦＧを分周することにより、基準周
波数の周波数レンジを圧縮することを可能としている。
ディジタル位相サーボにおいて、９０度位相のモータＦ
Ｇの中から一方の信号（Ｓ）を１／２分周する例えばカ
ウンタを有し、その出力信号をＡ相信号として出力し、
上記一方の信号（Ｓ）と上記Ａ相信号の論理演算によっ
て、当該Ａ相に対して９０度位相となる信号（Ｂ相）を
作り、擬似的な９０度位相のモータＦＧを作り出すよう
にしたものである。このように、ディジタル位相サーボ
において、９０度のＦＧを分周することにより、基準周
波数の周波数レンジを圧縮することを可能としている。
【０００９】
【作用】本発明の２相ＦＧ分周回路によれば、２相ＦＧ
信号を１／Ｎ分周することで基準周波数のダイナミック
レンジも１／Ｎにすることができ、また、２相ＦＧ信号
を１／Ｎに分周してもモータの回転方向に依存する９０
度の位相関係（進み，遅れ）は正常に保たれる。
信号を１／Ｎ分周することで基準周波数のダイナミック
レンジも１／Ｎにすることができ、また、２相ＦＧ信号
を１／Ｎに分周してもモータの回転方向に依存する９０
度の位相関係（進み，遅れ）は正常に保たれる。
【００１０】
【実施例】以下、本発明の実施例を図面を参照しながら
説明する。
説明する。
【００１１】本実施例の２相ＦＧ分周回路２０は、図１
に示すように、２相ＦＧ信号Ｓの何れか一方（０度又は
９０度）を１／Ｎ分周する１／Ｎ分周器２２と、上記１
／Ｎ分周器２２の出力信号Ａ0 を１／２分周する１／２
分周手段としてのカウンタ２３と、上記１／Ｎ分周器２
２の出力信号Ａ0 と上記カウンタ２３の出力信号（ｆｓ
０°）とに基づいて上記カウンタ２３の出力信号の９０
度位相信号ｆｓ９０°を形成する９０度位相信号形成手
段としての論理演算回路２４とを有してなるものであ
る。なお、この図１において前述した図３と同じ構成要
素には同一の指示符号を付している。
に示すように、２相ＦＧ信号Ｓの何れか一方（０度又は
９０度）を１／Ｎ分周する１／Ｎ分周器２２と、上記１
／Ｎ分周器２２の出力信号Ａ0 を１／２分周する１／２
分周手段としてのカウンタ２３と、上記１／Ｎ分周器２
２の出力信号Ａ0 と上記カウンタ２３の出力信号（ｆｓ
０°）とに基づいて上記カウンタ２３の出力信号の９０
度位相信号ｆｓ９０°を形成する９０度位相信号形成手
段としての論理演算回路２４とを有してなるものであ
る。なお、この図１において前述した図３と同じ構成要
素には同一の指示符号を付している。
【００１２】すなわちこの図１の構成において、上記２
相ＦＧ信号Ｓは、例えばキャプスタンモータ１の回転に
対応して２相ＦＧ信号発生器２から発生される。この２
相ＦＧ信号Ｓのうち０度又は９０度の信号のみが上記１
／Ｎ分周器２２に送られる。この１／Ｎ分周器２２で上
記２相ＦＧ信号Ｓのうちの０度又は９０度の何れか一方
の信号が１／Ｎ分周された出力信号Ａ0 は、図２のａに
示すような信号となる。
相ＦＧ信号Ｓは、例えばキャプスタンモータ１の回転に
対応して２相ＦＧ信号発生器２から発生される。この２
相ＦＧ信号Ｓのうち０度又は９０度の信号のみが上記１
／Ｎ分周器２２に送られる。この１／Ｎ分周器２２で上
記２相ＦＧ信号Ｓのうちの０度又は９０度の何れか一方
の信号が１／Ｎ分周された出力信号Ａ0 は、図２のａに
示すような信号となる。
【００１３】上記１／Ｎ分周器２２の出力信号Ａ0 は、
更に上記カウンタ２３で１／２分周される。なお、この
カウンタ２３の分周比によって任意の分周が可能とな
る。
更に上記カウンタ２３で１／２分周される。なお、この
カウンタ２３の分周比によって任意の分周が可能とな
る。
【００１４】本実施例では、上記カウンタ２３の出力信
号を擬似的にｆｓ０°のモータＦＧ（擬似モータＦＧ）
として端子３２から取り出すようにしている。このｆｓ
０°の擬似モータＦＧは、図２のｂに示すような信号と
なる。
号を擬似的にｆｓ０°のモータＦＧ（擬似モータＦＧ）
として端子３２から取り出すようにしている。このｆｓ
０°の擬似モータＦＧは、図２のｂに示すような信号と
なる。
【００１５】また、上記カウンタ２３の出力信号は、上
記論理演算回路２４にも送られるようになっている。当
該論理演算回路２４は、一方の入力端子に上記１／Ｎ分
周器２２の出力信号Ａ0 が供給され他方の入力端子に上
記カウンタ２３の出力信号（ｆｓ０°）が供給される排
他的論理和（ＥＸ−ＯＲ）ゲート２５と、当該排他的論
理和ゲート２５の出力信号を論理反転するインバータ２
６とから構成されるものである。
記論理演算回路２４にも送られるようになっている。当
該論理演算回路２４は、一方の入力端子に上記１／Ｎ分
周器２２の出力信号Ａ0 が供給され他方の入力端子に上
記カウンタ２３の出力信号（ｆｓ０°）が供給される排
他的論理和（ＥＸ−ＯＲ）ゲート２５と、当該排他的論
理和ゲート２５の出力信号を論理反転するインバータ２
６とから構成されるものである。
【００１６】本実施例では、上記論理和演算回路２４の
出力信号を擬似的にｆｓ９０°のモータＦＧ（擬似モー
タＦＧ）として端子３１から取り出すようにしている。
このｆｓ９０°の擬似モータＦＧは、図２のｃに示すよ
うな信号となる。
出力信号を擬似的にｆｓ９０°のモータＦＧ（擬似モー
タＦＧ）として端子３１から取り出すようにしている。
このｆｓ９０°の擬似モータＦＧは、図２のｃに示すよ
うな信号となる。
【００１７】ここで、本実施例の２相ＦＧ分周回路２０
は、例えば、前述した図３の２相ＦＧ信号発生器２の後
段に設けて好適なものである。すなわち、本実施例の２
相ＦＧ分周回路２０のアンプ２１に供給される信号Ｓは
前記図３の２相ＦＧ信号発生器２からの２相ＦＧ信号ｆ
ａ，ｆｂの何れか一方となり、また、当該図１の端子３
１，３２から出力される擬似モータＦＧが前記図３の後
段の構成に送られる。
は、例えば、前述した図３の２相ＦＧ信号発生器２の後
段に設けて好適なものである。すなわち、本実施例の２
相ＦＧ分周回路２０のアンプ２１に供給される信号Ｓは
前記図３の２相ＦＧ信号発生器２からの２相ＦＧ信号ｆ
ａ，ｆｂの何れか一方となり、また、当該図１の端子３
１，３２から出力される擬似モータＦＧが前記図３の後
段の構成に送られる。
【００１８】上述のように、本実施例の２相ＦＧ分周回
路２０においては、２相ＦＧ信号Ｓの何れか一方（０度
又は９０度）を１／Ｎ分周する１／Ｎ分周器２２と、上
記１／Ｎ分周器２２の出力信号Ａ0 を１／２分周する１
／２分周手段としてのカウンタ２３と、上記１／Ｎ分周
器２２の出力信号Ａ0 と上記カウンタ２３の出力信号
（ｆｓ０°）とに基づいて上記カウンタ２３の出力信号
の９０度位相信号ｆｓ９０°を形成する論理演算回路２
４とを有してなり、２相ＦＧ信号Ｓの何れか一方を１／
Ｎ分周することで基準周波数のダイナミックレンジも１
／Ｎにすることができ、また、２相ＦＧ信号Ｓを１／Ｎ
に分周してもモータの回転方向に依存する９０度の位相
関係（進み，遅れ）は正常に保たれる。
路２０においては、２相ＦＧ信号Ｓの何れか一方（０度
又は９０度）を１／Ｎ分周する１／Ｎ分周器２２と、上
記１／Ｎ分周器２２の出力信号Ａ0 を１／２分周する１
／２分周手段としてのカウンタ２３と、上記１／Ｎ分周
器２２の出力信号Ａ0 と上記カウンタ２３の出力信号
（ｆｓ０°）とに基づいて上記カウンタ２３の出力信号
の９０度位相信号ｆｓ９０°を形成する論理演算回路２
４とを有してなり、２相ＦＧ信号Ｓの何れか一方を１／
Ｎ分周することで基準周波数のダイナミックレンジも１
／Ｎにすることができ、また、２相ＦＧ信号Ｓを１／Ｎ
に分周してもモータの回転方向に依存する９０度の位相
関係（進み，遅れ）は正常に保たれる。
【００１９】
【発明の効果】上述のように、本発明の２相ＦＧ分周回
路においては、２相ＦＧ信号の何れか一方を１／Ｎ分周
し、この１／Ｎ分周出力をさらに１／２分周すると共
に、１／２分周出力の９０度位相信号を形成することに
より、例えば、ディジタル位相サーボループの構成に適
用した場合に、高ダイナミックな基準周波数発生器が不
要で、モータの高速回転にも対応することが可能とな
る。
路においては、２相ＦＧ信号の何れか一方を１／Ｎ分周
し、この１／Ｎ分周出力をさらに１／２分周すると共
に、１／２分周出力の９０度位相信号を形成することに
より、例えば、ディジタル位相サーボループの構成に適
用した場合に、高ダイナミックな基準周波数発生器が不
要で、モータの高速回転にも対応することが可能とな
る。
【図１】本発明実施例の２相ＦＧ分周回路の概略構成を
示すブロック回路図である。
示すブロック回路図である。
【図２】本実施例２相ＦＧ分周回路の各部のタイミング
チャートである。
チャートである。
【図３】従来のディジタル位相サーボループの概略構成
を示すブロック回路図である。
を示すブロック回路図である。
１・・・・・キャプスタンモータ ２・・・・・２相ＦＧ信号発生器 ２０・・・・２相ＦＧ分周回路 ２１・・・・アンプ ２２・・・・１／Ｎ分周器 ２３・・・・カウンタ ２４・・・・論理演算回路 ２５・・・・排他的論理和ゲート ２６・・・・インバータ
Claims (1)
- 【請求項１】 ２相ＦＧ信号の何れか一方を１／Ｎ分周
する１／Ｎ分周手段と、 上記１／Ｎ分周手段の出力信号を１／２分周する１／２
分周手段と、 上記１／２分周手段の出力信号の９０度位相信号を形成
する９０度位相信号形成手段とを有し、 上記１／２分周手段の出力信号と上記９０度位相信号形
成手段の出力信号を出力することを特徴とする２相ＦＧ
分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4057217A JPH05227776A (ja) | 1992-02-12 | 1992-02-12 | ２相ｆｇ分周回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4057217A JPH05227776A (ja) | 1992-02-12 | 1992-02-12 | ２相ｆｇ分周回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05227776A true JPH05227776A (ja) | 1993-09-03 |
Family
ID=13049366
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4057217A Withdrawn JPH05227776A (ja) | 1992-02-12 | 1992-02-12 | ２相ｆｇ分周回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05227776A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6285184B1 (en) | 1998-02-27 | 2001-09-04 | Kabushiki Kaisya Tokyo Kakai | Speed and position signal generator |
-
1992
- 1992-02-12 JP JP4057217A patent/JPH05227776A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6285184B1 (en) | 1998-02-27 | 2001-09-04 | Kabushiki Kaisya Tokyo Kakai | Speed and position signal generator |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990518 |