JPH0518143B2 - - Google Patents
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- JPH0518143B2 JPH0518143B2 JP58095234A JP9523483A JPH0518143B2 JP H0518143 B2 JPH0518143 B2 JP H0518143B2 JP 58095234 A JP58095234 A JP 58095234A JP 9523483 A JP9523483 A JP 9523483A JP H0518143 B2 JPH0518143 B2 JP H0518143B2
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- Japan
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- disk
- data
- memory
- cache memory
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- 238000000034 method Methods 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 6
- 230000004044 response Effects 0.000 description 3
- 230000006870 function Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Memory System Of A Hierarchy Structure (AREA)
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、ストアイン方式を採用するデイス
クキヤツシユシステムに係り、特に電源断時にお
けるデイスクキヤツシユメモリのバツクアツプを
行なうデイスクキヤツシユメモリ・バツクアツプ
方式に関する。
クキヤツシユシステムに係り、特に電源断時にお
けるデイスクキヤツシユメモリのバツクアツプを
行なうデイスクキヤツシユメモリ・バツクアツプ
方式に関する。
ストアイン方式を採用するデイスクキヤツシユ
システムでは、デイスクへの書き込み要求に対
し、まずデイスクキヤツシユメモリにデイスクへ
の書き込みデータが書き込まれる。しかして、デ
イスクコントローラからCPU（上位装置）に書き
込み動作完了が通知され、しかる後、デイスクコ
ントローラの空き時間を利用してデイスクキヤツ
シユメモリのデータをデイスクへ書き込む動作が
行なわれる。
システムでは、デイスクへの書き込み要求に対
し、まずデイスクキヤツシユメモリにデイスクへ
の書き込みデータが書き込まれる。しかして、デ
イスクコントローラからCPU（上位装置）に書き
込み動作完了が通知され、しかる後、デイスクコ
ントローラの空き時間を利用してデイスクキヤツ
シユメモリのデータをデイスクへ書き込む動作が
行なわれる。
このようにストアイン方式を採用する従来のデ
イスクキヤツシユシステムでは、デイスクへの書
き込みが有効に行なわれ当該システムの特長が生
かされるものの、プログラムの論理的な完了単位
でプログラム動作とデイスクの内容との同期が取
れないため、CPUに上記書き込み動作完了が通
知されてからデイスクへの実際の書き込み動作が
完了するまでの間にシステムの電源が遮断された
場合、不都合が生じる欠点があつた。勿論、この
不都合を解消するためには、デイスクキヤツシユ
メモリをバツテリ・バツクアツプすればよいが、
この方式では装置の小型／軽量化が図れない。
イスクキヤツシユシステムでは、デイスクへの書
き込みが有効に行なわれ当該システムの特長が生
かされるものの、プログラムの論理的な完了単位
でプログラム動作とデイスクの内容との同期が取
れないため、CPUに上記書き込み動作完了が通
知されてからデイスクへの実際の書き込み動作が
完了するまでの間にシステムの電源が遮断された
場合、不都合が生じる欠点があつた。勿論、この
不都合を解消するためには、デイスクキヤツシユ
メモリをバツテリ・バツクアツプすればよいが、
この方式では装置の小型／軽量化が図れない。
この発明は上記事情に鑑みてなされたものでそ
の目的は、ストアイン方式を採用するデイスクキ
ヤツシユシステムにおいて、デイスクキヤツシユ
メモリの電源断時のバツクアツプが効率よく行な
えるデイスクキヤツシユメモリ・バツクアツプ方
式を提供することにある。
の目的は、ストアイン方式を採用するデイスクキ
ヤツシユシステムにおいて、デイスクキヤツシユ
メモリの電源断時のバツクアツプが効率よく行な
えるデイスクキヤツシユメモリ・バツクアツプ方
式を提供することにある。
この発明では、デイレクトリメモリに格納され
るデイレクトリ情報に次のデイレクトリ情報への
ポインタ情報を付加し、このポインタ情報を用い
ることにより、デイスクキヤツシユメモリに格納
されている一連のデータのデイスクへの書き込み
順が管理できる構成とし、この構成においてデイ
レクトリメモリ並びにデイスクキヤツシユメモリ
に対するバツクアツプメモリとしての書き換え可
能な不揮発性メモリを設け、電源断検出時にデイ
スクへの未書き込みデータに関するデイレクトリ
情報の少なくともデイスクアドレスと、対応する
未書き込みデータとを不揮発性メモリに格納する
ようにしている。また、この発明では、電源復帰
後に不揮発性メモリの内容に基づいて未書き込み
データをデイスクに書き込むようにしている。
るデイレクトリ情報に次のデイレクトリ情報への
ポインタ情報を付加し、このポインタ情報を用い
ることにより、デイスクキヤツシユメモリに格納
されている一連のデータのデイスクへの書き込み
順が管理できる構成とし、この構成においてデイ
レクトリメモリ並びにデイスクキヤツシユメモリ
に対するバツクアツプメモリとしての書き換え可
能な不揮発性メモリを設け、電源断検出時にデイ
スクへの未書き込みデータに関するデイレクトリ
情報の少なくともデイスクアドレスと、対応する
未書き込みデータとを不揮発性メモリに格納する
ようにしている。また、この発明では、電源復帰
後に不揮発性メモリの内容に基づいて未書き込み
データをデイスクに書き込むようにしている。
第１図はこの発明の一実施例に係るデイスクキ
ヤツシユシステムの構成を示すブロツク図であ
る。同図において符号１０で示されるデイスクコ
ントローラは、例えば上位装置であるCPU２０
からの要求によりデイスク装置３０を制御する。
デイスクコントローラ１０は、CPU２０とのイ
ンタフエースを成すCPUインタフエース１０１、
およびデイスク装置３０とのインタフエースを成
すデバイスインタフエース１０２とを有してい
る。また、デイスクコントローラ１０は、デイス
ク装置３０に対する書き込み／読み出しデータを
格納するデイスクキヤツシユメモリ１０３、およ
び当該デイスクキヤツシユメモリ１０３のデイレ
クトリ情報を登録されるデイレクトリメモリ１０
４をも有している。デイスクキヤツシユメモリ１
０３およびデイレクトリメモリ１０４は例えば
RAMである。
ヤツシユシステムの構成を示すブロツク図であ
る。同図において符号１０で示されるデイスクコ
ントローラは、例えば上位装置であるCPU２０
からの要求によりデイスク装置３０を制御する。
デイスクコントローラ１０は、CPU２０とのイ
ンタフエースを成すCPUインタフエース１０１、
およびデイスク装置３０とのインタフエースを成
すデバイスインタフエース１０２とを有してい
る。また、デイスクコントローラ１０は、デイス
ク装置３０に対する書き込み／読み出しデータを
格納するデイスクキヤツシユメモリ１０３、およ
び当該デイスクキヤツシユメモリ１０３のデイレ
クトリ情報を登録されるデイレクトリメモリ１０
４をも有している。デイスクキヤツシユメモリ１
０３およびデイレクトリメモリ１０４は例えば
RAMである。
第２図はデイレクトリ情報のフオーマツトを示
す。デイレクトリ情報はデイスクアドレスDISK
ADR、書き込みフラグＦ、ポインタ情報Pi、デ
イスクキヤツシユメモリアドレスMEM ADR、
およびサイズ情報SIZEから成つている。デイス
クアドレスDISK ADRは書き込みデータのデイ
スク装置３０への書き込み先を示す。書き込みフ
ラグＦはデイスク装置３０へのデータ書き込みの
終了（“０”）／未終了（“１”）を示す。ポインタ
情報Piは次のデイレクトリ情報のデイレクトリメ
モリ１０４における格納先を示す。デイスクキヤ
ツシユメモリアドレスMEM ADRはデイスク装
置３０に書き込むべきデータのデイスクキヤツシ
ユメモリ１０３における格納先を示す。サイズ情
報SIZEは書き込みデータのサイズを示す。
す。デイレクトリ情報はデイスクアドレスDISK
ADR、書き込みフラグＦ、ポインタ情報Pi、デ
イスクキヤツシユメモリアドレスMEM ADR、
およびサイズ情報SIZEから成つている。デイス
クアドレスDISK ADRは書き込みデータのデイ
スク装置３０への書き込み先を示す。書き込みフ
ラグＦはデイスク装置３０へのデータ書き込みの
終了（“０”）／未終了（“１”）を示す。ポインタ
情報Piは次のデイレクトリ情報のデイレクトリメ
モリ１０４における格納先を示す。デイスクキヤ
ツシユメモリアドレスMEM ADRはデイスク装
置３０に書き込むべきデータのデイスクキヤツシ
ユメモリ１０３における格納先を示す。サイズ情
報SIZEは書き込みデータのサイズを示す。
再び第１図を参照すると、デイスクコントロー
ラ１０は書き換え可能な不揮発性メモリで構成さ
れるバツクアツプメモリ１０５、およびデイスク
コントローラ１０の中心となる制御部１０６を更
に有している。制御部１０６は例えばマイクロプ
ロセツサで構成されている。制御部１０６には、
次にアクセスすべきデイスクキヤツシユメモリ１
０３のアドレスに関するデイレクトリ情報へのポ
インタ情報Piを保持するポインタレジスタ（以
下、PREGと称する）１０７が設けられている。
CPUインタフエース１０１、デバイスインタフ
エース１０２、デイスクキヤツシユメモリ１０
３、デイレクトリメモリ１０４、バツクアツプメ
モリ１０５、および制御部１０６はマイクロプロ
セツサバスなどのバス１０８に接続されている。
ラ１０は書き換え可能な不揮発性メモリで構成さ
れるバツクアツプメモリ１０５、およびデイスク
コントローラ１０の中心となる制御部１０６を更
に有している。制御部１０６は例えばマイクロプ
ロセツサで構成されている。制御部１０６には、
次にアクセスすべきデイスクキヤツシユメモリ１
０３のアドレスに関するデイレクトリ情報へのポ
インタ情報Piを保持するポインタレジスタ（以
下、PREGと称する）１０７が設けられている。
CPUインタフエース１０１、デバイスインタフ
エース１０２、デイスクキヤツシユメモリ１０
３、デイレクトリメモリ１０４、バツクアツプメ
モリ１０５、および制御部１０６はマイクロプロ
セツサバスなどのバス１０８に接続されている。
次に、この発明の一実施例の動作を説明する。
今、CPU２０からのデイスク書き込み要求に対
し、デイスク装置３０に書き込むべき一連のデー
タがデイスクコントローラ１０内のデイスクキヤ
ツシユメモリ１０３に全て書き込まれたものとす
る。このとき、デイスクキヤツシユメモリ１０３
に書き込まれた一連のデータに対応した（デイレ
クトリメモリ１０４内の）各デイレクトリ情報中
の書き込みフラグＦは論理“１”となつている。
また、制御部１０６内のPREG１０７には、書き
込みフラグＦが論理“１”であるデイレクトリ情
報群中の先頭デイレクトリ情報のデイレクトリメ
モリ１０４内格納先アドレス（エントリアドレ
ス）を示すポインタ情報Pi（ｉ＝ｋ）がロードさ
れている。制御部１０６は、上記一連のデータの
デイスクキヤツシユメモリ１０３への書き込みが
終了すると、CPU２０に対して書き込み動作完
了を通知する。その後、制御部１０６は、上記一
連のデータを含む（デイスク装置３０への）未書
き込みデータをデイスクキヤツシユメモリ１０３
からデイスク装置３０へ転送するための動作を、
空き時間を利用して実行する。
今、CPU２０からのデイスク書き込み要求に対
し、デイスク装置３０に書き込むべき一連のデー
タがデイスクコントローラ１０内のデイスクキヤ
ツシユメモリ１０３に全て書き込まれたものとす
る。このとき、デイスクキヤツシユメモリ１０３
に書き込まれた一連のデータに対応した（デイレ
クトリメモリ１０４内の）各デイレクトリ情報中
の書き込みフラグＦは論理“１”となつている。
また、制御部１０６内のPREG１０７には、書き
込みフラグＦが論理“１”であるデイレクトリ情
報群中の先頭デイレクトリ情報のデイレクトリメ
モリ１０４内格納先アドレス（エントリアドレ
ス）を示すポインタ情報Pi（ｉ＝ｋ）がロードさ
れている。制御部１０６は、上記一連のデータの
デイスクキヤツシユメモリ１０３への書き込みが
終了すると、CPU２０に対して書き込み動作完
了を通知する。その後、制御部１０６は、上記一
連のデータを含む（デイスク装置３０への）未書
き込みデータをデイスクキヤツシユメモリ１０３
からデイスク装置３０へ転送するための動作を、
空き時間を利用して実行する。
制御部１０６は、まずPREG１０７にロードさ
れているポインタ上記Pi（ｉ＝ｋ）を用いてデイ
レクトリメモリ１０４をアクセスし、対応するデ
イレクトリ情報を読み出す。次に制御部１０６
は、このデイレクトリ情報中のデイスクキヤツシ
ユメモリアドレスMEM ADR並びにサイズ情報
SIZEに基づいてデイスクキヤツシユメモリ１０
３をら対応するデータを読み出す。制御部１０６
は当該データをデバイスインタフエース１０２経
由でデイスク装置３０に転送し、上記デイレクト
リ情報中のデイスクアドレスDISK ADRで示さ
れる領域に書き込ませる。なお、デバイスインタ
フエース１０２に入出力制御機能を持たせ、制御
部１０６から当該デバイスインタフエース１０２
にデイレクトリ情報（の中のデイスクアドレス
DISK ADR、デイスクキヤツシユメモリアドレ
スMEM ADR、およびサイズ情報）を与えてデ
バイスインタフエース１０２を起動させることも
可能である。制御部１０６は、デイスク装置３０
へのデータ書き込みが終了すると、デイレクトリ
メモリ１０４における対応するデイレクトリ情報
中の書き込みフラグＦを論理“０”にすると共
に、当該デイレクトリ情報中のポインタ情報Pi
（ｉ＝ｋ＋１）をPREG１０７にロードする。次
に制御部１０６は、PREG１０７にポインタ情報
Pi（ｉ＝ｋ）がロードされていた前回と同様にし
て、新たなポインタ情報Pi（ｉ＝ｋ＋１）で示さ
れているデイレクトリ情報に基づいて対応するデ
ータをデイスクキヤツシユメモリ１０３から読み
出す。しかして当該データは前回と同様にデイス
ク装置３０に転送される。制御部１０６は、デイ
スク装置３０へのデータ書き込みが終了すると、
デイレクトリ１０４における対応するデイレクト
リ情報中の書き込みフラグＦを論理“０”にする
と共に、当該デイレクトリ情報中のポインタ情報
Pi（ｉ＝ｋ＋２）をPREG１０７にロードする。
以下、同様にして、ポインタ情報Piでリンクされ
たデイレクトリ情報に対応するデータをデイスク
キヤツシユメモリ１０３から読み出してデイスク
装置３０に書き込む動作が繰り返される。
れているポインタ上記Pi（ｉ＝ｋ）を用いてデイ
レクトリメモリ１０４をアクセスし、対応するデ
イレクトリ情報を読み出す。次に制御部１０６
は、このデイレクトリ情報中のデイスクキヤツシ
ユメモリアドレスMEM ADR並びにサイズ情報
SIZEに基づいてデイスクキヤツシユメモリ１０
３をら対応するデータを読み出す。制御部１０６
は当該データをデバイスインタフエース１０２経
由でデイスク装置３０に転送し、上記デイレクト
リ情報中のデイスクアドレスDISK ADRで示さ
れる領域に書き込ませる。なお、デバイスインタ
フエース１０２に入出力制御機能を持たせ、制御
部１０６から当該デバイスインタフエース１０２
にデイレクトリ情報（の中のデイスクアドレス
DISK ADR、デイスクキヤツシユメモリアドレ
スMEM ADR、およびサイズ情報）を与えてデ
バイスインタフエース１０２を起動させることも
可能である。制御部１０６は、デイスク装置３０
へのデータ書き込みが終了すると、デイレクトリ
メモリ１０４における対応するデイレクトリ情報
中の書き込みフラグＦを論理“０”にすると共
に、当該デイレクトリ情報中のポインタ情報Pi
（ｉ＝ｋ＋１）をPREG１０７にロードする。次
に制御部１０６は、PREG１０７にポインタ情報
Pi（ｉ＝ｋ）がロードされていた前回と同様にし
て、新たなポインタ情報Pi（ｉ＝ｋ＋１）で示さ
れているデイレクトリ情報に基づいて対応するデ
ータをデイスクキヤツシユメモリ１０３から読み
出す。しかして当該データは前回と同様にデイス
ク装置３０に転送される。制御部１０６は、デイ
スク装置３０へのデータ書き込みが終了すると、
デイレクトリ１０４における対応するデイレクト
リ情報中の書き込みフラグＦを論理“０”にする
と共に、当該デイレクトリ情報中のポインタ情報
Pi（ｉ＝ｋ＋２）をPREG１０７にロードする。
以下、同様にして、ポインタ情報Piでリンクされ
たデイレクトリ情報に対応するデータをデイスク
キヤツシユメモリ１０３から読み出してデイスク
装置３０に書き込む動作が繰り返される。
今、制御部１０６内のPREG１０７に、第３図
のシステム状態図に示すようにポインタ情報Pi
（ｉ＝ｌ）がロードされている状態でシステムの
電源が遮断したものとする。制御部１０６は電源
断を検出すると、電源電圧がシステムの動作を保
証できなくなる電圧値まで低下するまでの間に、
以下の動作を行なう。まず制御部１０６はPREG
１０７にロードされているポインタ情報Pi（ｉ＝
ｌ）で示される（デイレクトリメモリ１０４内
の）デイレクトリ情報の例えばデイスクアドレス
DISK ADRおよびサイズ情報SIZEと、当該デイ
レクトリ情報のデイスクキヤツシユメモリアドレ
スMEM ADR並びにサイズ情報SIZEで示される
（デイスクキヤツシユメモリ１０３内の）データ
とを、第３図のシステム状態図において矢印ａ〜
ｃで示すようにバツクアツプメモリ１０５の例え
ば先頭アドレスから始まる連続する領域に書き込
む。次に制御部１０６はポインタ情報Pi（ｉ＝ｌ）
で示されたデイレクトリ情報中のポインタ情報Pi
（ｉ＝ｌ＋１）をPREG１０７にロードした後、
上述した動作を行なう。制御部１０６は、これら
の動作を、ポインタ情報PiがPi（ｉ＝ｌ）である
デイレクトリ情報から始まり、ポインタ情報Piが
最終デイレクトリ情報を示すデイレクトリ情報に
到る、ポインタ情報Piでリンクされた一連のデイ
レクトリ情報（すなわち書き込みフラグＦが論理
“１”である書き込みキユー情報）について実行
する。制御部１０６は最終データをバツクアツプ
メモリ１０５に書き込むとき、当該データに最終
データである旨を示す情報を付加する。
のシステム状態図に示すようにポインタ情報Pi
（ｉ＝ｌ）がロードされている状態でシステムの
電源が遮断したものとする。制御部１０６は電源
断を検出すると、電源電圧がシステムの動作を保
証できなくなる電圧値まで低下するまでの間に、
以下の動作を行なう。まず制御部１０６はPREG
１０７にロードされているポインタ情報Pi（ｉ＝
ｌ）で示される（デイレクトリメモリ１０４内
の）デイレクトリ情報の例えばデイスクアドレス
DISK ADRおよびサイズ情報SIZEと、当該デイ
レクトリ情報のデイスクキヤツシユメモリアドレ
スMEM ADR並びにサイズ情報SIZEで示される
（デイスクキヤツシユメモリ１０３内の）データ
とを、第３図のシステム状態図において矢印ａ〜
ｃで示すようにバツクアツプメモリ１０５の例え
ば先頭アドレスから始まる連続する領域に書き込
む。次に制御部１０６はポインタ情報Pi（ｉ＝ｌ）
で示されたデイレクトリ情報中のポインタ情報Pi
（ｉ＝ｌ＋１）をPREG１０７にロードした後、
上述した動作を行なう。制御部１０６は、これら
の動作を、ポインタ情報PiがPi（ｉ＝ｌ）である
デイレクトリ情報から始まり、ポインタ情報Piが
最終デイレクトリ情報を示すデイレクトリ情報に
到る、ポインタ情報Piでリンクされた一連のデイ
レクトリ情報（すなわち書き込みフラグＦが論理
“１”である書き込みキユー情報）について実行
する。制御部１０６は最終データをバツクアツプ
メモリ１０５に書き込むとき、当該データに最終
データである旨を示す情報を付加する。
次に電源復帰時の動作を説明する。制御部１０
６は電源が復帰すると、バツクアツプメモリ１０
５をアクセスし、その先頭アドレスから順にその
格納内容を読み出す。すなわち制御部１０６はデ
イスクアドレスDISK ADR、次にサイズ情報
SIZEを読み出し、続いて当該サイズ情報SIZEに
従つて（デイスク装置３０へ書き込むべき）デー
タを読み出す。しかして制御部１０６はバツクア
ツプメモリ１０５から読み出したデータをデイス
ク装置３０内のデイスクアドレスDISK ADRで
示される領域に書き込ませる。制御部１０６は上
述の動作を最終データまで繰り返し実行する。こ
の結果、CPU２０から転送された書き込みデー
タは、電源断が発生したにもかかわらず電源復帰
時にはデイスク装置３０に正しく格納される。
６は電源が復帰すると、バツクアツプメモリ１０
５をアクセスし、その先頭アドレスから順にその
格納内容を読み出す。すなわち制御部１０６はデ
イスクアドレスDISK ADR、次にサイズ情報
SIZEを読み出し、続いて当該サイズ情報SIZEに
従つて（デイスク装置３０へ書き込むべき）デー
タを読み出す。しかして制御部１０６はバツクア
ツプメモリ１０５から読み出したデータをデイス
ク装置３０内のデイスクアドレスDISK ADRで
示される領域に書き込ませる。制御部１０６は上
述の動作を最終データまで繰り返し実行する。こ
の結果、CPU２０から転送された書き込みデー
タは、電源断が発生したにもかかわらず電源復帰
時にはデイスク装置３０に正しく格納される。
なお、前記実施例ではバツクアツプメモリ１０
５のデータ（デイスク装置３０への書き込みデー
タ）を直接デイスク装置３０に転送するものとし
て説明したが、いつたんデイスクキヤツシユメモ
リ１０３に書き込み、当該デイスクキヤツシユメ
モリ１０３からデータを読み出してデイスク装置
３０に転送するようにすることも可能である。こ
れは、デバイスインタフエース１０２が入出力制
御機能を有し、制御部１０６からの起動によりデ
ータ入出力を行なうものである場合に有効であ
る。また、バツクアツプメモリ１０５のデータ
（デイスク装置３０への書き込みデータ）をデイ
スクキヤツシユメモリ１０３に書き込む際に、当
該データに付加されていたデイスクアドレス
DISK ADR、サイズ情報SIZEを用いてデイレク
トリ情報を作成しデイレクトリメモリ１０４に登
録するようにしてもよい。この場合、デイスクキ
ヤツシユメモリ１０３に格納された（デイスク装
置３０に書き込むべき）データのデイスク装置３
０への書き込み動作は、通常時の書き込みと同様
となる。また、デイレクトリメモリ１０４に登録
されたデイレクトリ情報により、CPU１２０か
らの読み出し要求に対しデイスクキヤツシユメモ
リ１０３からのデータ読み出しが可能となる。
５のデータ（デイスク装置３０への書き込みデー
タ）を直接デイスク装置３０に転送するものとし
て説明したが、いつたんデイスクキヤツシユメモ
リ１０３に書き込み、当該デイスクキヤツシユメ
モリ１０３からデータを読み出してデイスク装置
３０に転送するようにすることも可能である。こ
れは、デバイスインタフエース１０２が入出力制
御機能を有し、制御部１０６からの起動によりデ
ータ入出力を行なうものである場合に有効であ
る。また、バツクアツプメモリ１０５のデータ
（デイスク装置３０への書き込みデータ）をデイ
スクキヤツシユメモリ１０３に書き込む際に、当
該データに付加されていたデイスクアドレス
DISK ADR、サイズ情報SIZEを用いてデイレク
トリ情報を作成しデイレクトリメモリ１０４に登
録するようにしてもよい。この場合、デイスクキ
ヤツシユメモリ１０３に格納された（デイスク装
置３０に書き込むべき）データのデイスク装置３
０への書き込み動作は、通常時の書き込みと同様
となる。また、デイレクトリメモリ１０４に登録
されたデイレクトリ情報により、CPU１２０か
らの読み出し要求に対しデイスクキヤツシユメモ
リ１０３からのデータ読み出しが可能となる。
ところで前記実施例では、デイレクトリ情報に
サイズ情報SIZEが含まれているものとして説明
したが、書き込みデータのサイズが固定である場
合には当該サイズ情報SIZEは必ずしも必要でな
い。
サイズ情報SIZEが含まれているものとして説明
したが、書き込みデータのサイズが固定である場
合には当該サイズ情報SIZEは必ずしも必要でな
い。
以上詳述したようにこの発明によれば、電源断
時に、デイスクへの未書き込みデータ並びに対応
するデイレクトリ情報の少なくともデイスクアド
レスだけをバツクアツプメモリ（書き込み可能な
不揮発性メモリ）に保存できるので、電源復帰時
にバツクアツプメモリの内容を用いて未書き込み
データを正しくデイスクに書き込むことができ
る。したがつて、バツテリ・バツクアツプ方式に
比べ装置の小型、軽量化が図れる。また、バツク
アツプの対象となるデータが、デイスクキヤツシ
ユメモリの全データ並びにこれら全データに対応
するデイレクトリ情報でなく、デイスクへの未書
き込みデータ並びにこれら未書き込みデータに対
応するデイレクトリ情報であるためバツクアツプ
メモリの容量も少なくて済む。
時に、デイスクへの未書き込みデータ並びに対応
するデイレクトリ情報の少なくともデイスクアド
レスだけをバツクアツプメモリ（書き込み可能な
不揮発性メモリ）に保存できるので、電源復帰時
にバツクアツプメモリの内容を用いて未書き込み
データを正しくデイスクに書き込むことができ
る。したがつて、バツテリ・バツクアツプ方式に
比べ装置の小型、軽量化が図れる。また、バツク
アツプの対象となるデータが、デイスクキヤツシ
ユメモリの全データ並びにこれら全データに対応
するデイレクトリ情報でなく、デイスクへの未書
き込みデータ並びにこれら未書き込みデータに対
応するデイレクトリ情報であるためバツクアツプ
メモリの容量も少なくて済む。
第１図はこの発明の一実施例に係るデイスクキ
ヤツシユシステムの構成を示すブロツク図、第２
図はデイレクトリ情報のフオーマツト図、第３図
は電源断時のバツクアツプ動作を説明するための
システム状態図である。 １０……デイスクコントローラ、２０……
CPU、３０……デイスク装置、１０３……デイ
スクキヤツシユメモリ、１０４……デイレクトリ
メモリ、１０５……バツクアツプメモリ（書き換
え可能な不揮発性メモリ）、１０６……制御部、
１０７……ポインタレジスタ（PREG）。
ヤツシユシステムの構成を示すブロツク図、第２
図はデイレクトリ情報のフオーマツト図、第３図
は電源断時のバツクアツプ動作を説明するための
システム状態図である。 １０……デイスクコントローラ、２０……
CPU、３０……デイスク装置、１０３……デイ
スクキヤツシユメモリ、１０４……デイレクトリ
メモリ、１０５……バツクアツプメモリ（書き換
え可能な不揮発性メモリ）、１０６……制御部、
１０７……ポインタレジスタ（PREG）。
Claims (1)
- 【特許請求の範囲】 １ ストアイン方式を採用するデイスクキヤツシ
ュシステムにおいて、デイスクに書き込むべきデ
ータを格納するデイスクキヤツシユメモリと、こ
のデイスクキヤツシユメモリにおける上記データ
の格納先を示すデイスクキヤツシユメモリアドレ
ス、並びに当該データの上記デイスクへの格納先
を示すデイスクアドレスを含むデイレクトリ情報
を格納するデイレクトリメモリと、デイスクへの
未書込みデータに関する情報を保存する不揮発性
メモリと、上記デイスクキヤツシユメモリ上のデ
ータがデイスクへ書込まれたか否かを示すフラグ
と、このフラグを参照し、上記デイスクキヤツシ
ユメモリ上にデイスクへの未書込みのデータが残
つているときは、そのデイスクアドレスと該当デ
ータの組を上記不揮発性メモリに書き込む手段
と、電源復帰後に上記不揮発性メモリの内容に基
づいて上記未書込みデータを上記デイスクに書き
込む手段とを具備することを特徴とするデイスク
キヤツシユメモリ・バツクアツプ方式。 ２ 上記フラグを電源断検出時に参照されること
を特徴とする特許請求の範囲第１項記載のデイス
クキヤツシユメモリ・バツクアツプ方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58095234A JPS59220856A (ja) | 1983-05-30 | 1983-05-30 | デイスクキヤツシユメモリ・バツクアツプ方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58095234A JPS59220856A (ja) | 1983-05-30 | 1983-05-30 | デイスクキヤツシユメモリ・バツクアツプ方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59220856A JPS59220856A (ja) | 1984-12-12 |
| JPH0518143B2 true JPH0518143B2 (ja) | 1993-03-11 |
Family
ID=14132067
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58095234A Granted JPS59220856A (ja) | 1983-05-30 | 1983-05-30 | デイスクキヤツシユメモリ・バツクアツプ方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59220856A (ja) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6113328A (ja) * | 1984-06-28 | 1986-01-21 | Fujitsu Ltd | データファイルのアクセス制御装置 |
| JPS61210453A (ja) * | 1985-03-15 | 1986-09-18 | Canon Inc | デ−タ記憶装置 |
| JPH0731640B2 (ja) * | 1987-09-08 | 1995-04-10 | 富士通株式会社 | ディスクアクセス制御方式 |
| JPS6476345A (en) * | 1987-09-18 | 1989-03-22 | Fujitsu Ltd | Disk cache control system |
| JPH02236747A (ja) * | 1989-03-10 | 1990-09-19 | Fujitsu Ltd | 二重化ｄａｓｄ等価性情報退避方式 |
| JPH0679293B2 (ja) * | 1990-10-15 | 1994-10-05 | 富士通株式会社 | 計算機システム |
| JPH07271518A (ja) * | 1994-03-29 | 1995-10-20 | Hokkaido Nippon Denki Software Kk | 磁気ディスク装置 |
| JPH07302473A (ja) * | 1994-05-09 | 1995-11-14 | Fujitsu Ltd | 記憶装置及び記録再生システム |
| JP6359980B2 (ja) * | 2015-01-29 | 2018-07-18 | 株式会社メガチップス | 情報処理システム |
-
1983
- 1983-05-30 JP JP58095234A patent/JPS59220856A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59220856A (ja) | 1984-12-12 |
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